JP2000228452A - 電子部品搭載用基板 - Google Patents

電子部品搭載用基板

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JP2000228452A
JP2000228452A JP2800499A JP2800499A JP2000228452A JP 2000228452 A JP2000228452 A JP 2000228452A JP 2800499 A JP2800499 A JP 2800499A JP 2800499 A JP2800499 A JP 2800499A JP 2000228452 A JP2000228452 A JP 2000228452A
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JP
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electronic component
insulating substrate
board
conductor
component mounting
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JP2800499A
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English (en)
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Tsutomu Sato
努 佐藤
Toru Furuta
徹 古田
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Ibiden Co Ltd
Original Assignee
Ibiden Co Ltd
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Publication date
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    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
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    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48225Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/48227Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item

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  • Structure Of Printed Boards (AREA)
  • Insulated Metal Substrates For Printed Circuits (AREA)
  • Production Of Multi-Layered Print Wiring Board (AREA)

Abstract

(57)【要約】 【課題】 構造が簡単で、効率良く内部の熱を放散でき
る電子部品搭載用基板を提供する。 【解決手段】 絶縁基板21の表面に設けられ電子部品
26が接続される導体回路22と、絶縁基板21の裏面
に設けられたはんだボール24と、絶縁基板21の内部
に設けられた内層導体25とを備えた電子部品搭載用基
板20において、内層導体25を、厚さ0,1〜2mm
の金属板から構成したところに特徴を有し、構造が簡単
で、効率良く内部の熱を放散できる。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、半導体等の電子部
品から発生する熱を効率よく放散させる電子部品搭載用
基板に関する。
【0002】
【従来の技術】従来、多層の電子部品搭載用基板1にお
いては、図8に示すように、 絶縁基板2の表面に設け
られた導体回路3に電子部品4が接続され、この電子部
品4が樹脂封止5されている。絶縁基板2の裏面に設け
られた導体回路6には接続用のはんだボール7が複数個
形成されている。尚、導体回路3、導体回路6の表面に
はそれぞれレジスト膜3a,6aが形成されている。
【0003】また、絶縁基板の内部に複数層例えば2層
に銅箔(厚さ12〜35μm,Max70μm)による
内層導体8a,8bが設けられ、一方8aがグランド
(GND)側に、他方8bが電源側(PWR)に接続さ
れる。
【0004】
【発明が解決しようとする課題】然しながら、内層導体
8a,8bは銅箔で構成されており、銅箔の厚さを大き
くするには限界があり、即ち熱容量が大きくすることが
できず、電子部品の発熱量を効率的に放散できないとい
う問題点がある。そこで、図9に示すように、表裏の導
体回路3,6間にサーマルビア9を形成するとともに内
層導体8a,8bと連結すれば、効率的に熱を放散でき
るが、構造が複雑になりコストが嵩むという新たな問題
が発生する。
【0005】本発明は、上記の事情に鑑みてなされたも
ので、その目的は、構造が簡単で、効率良く内部の熱を
放散できる電子部品搭載用基板を提供するにある。
【0006】
【課題を解決するための手段】この課題を解決するため
に本発明が採った手段は、実施例で使用する符号を付し
て説明すると、絶縁基板21の表面に設けられ電子部品
26が接続される導体回路22と、絶縁基板21の裏面
に設けられたはんだボール24と、絶縁基板21の内部
に設けられた内層導体25とを備えた電子部品搭載用基
板20において、前記内層導体25を、厚さ0,1〜2
mmの金属板から構成したところに特徴を有し、構造が
簡単で、効率良く内部の熱を放散できる。
【0007】
【発明の実施の形態】以下、本発明の電子部品搭載用基
板20の第1の実施例につき図1を参照して説明する。
【0008】絶縁基板21の表面には導体回路22が形
成され、これの表面にはレジスト被膜22aが形成され
ている。絶縁基板21の裏面には導体回路23が形成さ
れ、これの表面にはレジスト被膜23aが形成されてい
る。さらに、この導体回路23には複数個のはんだボー
ル24が接続されている。この電子部品搭載用基板20
は、はんだボール24を介して他の基板に接続される。
【0009】絶縁基板21の内部には内層導体としての
メタルコア25が設けられている。このメタルコア25
は、厚さ0,1〜2mmの金属板例えば銅板或いはアル
ミニュウム板或いは鉄板及びそれらを含む合金板から構
成されている。これは、複数に分割されて、その一がグ
ランド(GND)側に接続され、他の一が電源側(PW
R)に接続されている。
【0010】メタルコア25は、厚さ0,1mm以下で
あると、従来の如くサーマルビアを併設しないと十分な
放熱特性が得られず、厚さ2mm以上になると、穴明け
などの高精度加工が難しくなる。
【0011】導体回路22の表面には、電子部品26が
接着等により搭載されており、導体回路22の所定の位
置にワイヤボンド27により接続され、全体が樹脂封止
28されている。
【0012】また、導体回路22と導体回路23との間
には、電気接続用のスルーホール29が接続されてい
る。
【0013】また、電子部品26の真下に位置して導体
回路22と導体回路23との間には、サーマルビア31
が形成されている。このサーマルビア31はメタルコア
25とめっき等により熱的に接続されている。
【0014】本発明では、必ずしもサーマルビアを設け
る必要はないが、併設すると更に放熱特性が向上する。
サーマルビア内は金属めっきを施しても、或いは熱を伝
え易いようにした樹脂や半田等の金属を充填してもよ
い。
【0015】この第1の実施例の電子部品搭載用基板2
0によれば、メタルコア25の熱容量を大きくしたの
で、電子部品26の発熱量を効率良く放散できるという
優れた効果を奏するものである。
【0016】また、内層導体を1枚のメタルコア25で
構成したので、構造が簡単になりコストを低減できると
い効果を奏するものである。
【0017】さらに、サーマルビア31を取付ければさ
らに効率が向上する。
【0018】図2は第2の実施例の電子部品搭載用基板
40を示すもので、第1の実施例との相異は、導体回路
22及び絶縁基板21に凹部41を形成し、電子部品2
6を直接メタルコア25に搭載したものである。
【0019】図3は第3の実施例の電子部品搭載用基板
50を示すもので、第2の実施例との相異は、導体回路
23及び絶縁基板21に凹部51を形成し、メタルコア
25を空気中に露出させたものである。
【0020】この第3の実施例によれば、メタルコア2
5が流通する空気により放冷されるので、放熱効果が一
層向上する。
【0021】図4は第4の実施例の電子部品搭載用基板
60を示すもので、第2の実施例との相異は、メタルコ
ア25に凹部61を形成して下面を段付き状に形成し、
凹部61に電子部品26を搭載したもので、空気中に露
出されたメタルコア25の下面は導体回路23とほぼ面
一に形成されている。
【0022】この第4の実施例によれば、第1〜第3の
実施例の効果に加えて、電子部品搭載用基板60を薄く
することができるという効果を奏するものである。
【0023】本願発明は、その他、図5〜図7に示すよ
うに、フェイスアップタイプの第5,第6,第7の実施
例の電子部品搭載用基板70,71,72を含むもので
ある。
【0024】
【発明の効果】本発明の電子部品搭載用基板は、絶縁基
板の表面に設けられ電子部品が接続される導体回路と、
絶縁基板の裏面に設けられたはんだボールと、絶縁基板
の内部に設けられた内層導体とを備えた電子部品搭載用
基板において、前記内層導体を、0,1〜2mmの金属
板から構成したので、構造が簡単で、効率良く内部の熱
を放散できるという優れた効果を奏するものである。
【図面の簡単な説明】
【図1】 本発明の第1の実施例の縦断正面図である。
【図2】 本発明の第2の実施例の縦断正面図である。
【図3】 本発明の第3の実施例の縦断正面図である。
【図4】 本発明の第4の実施例の縦断正面図である。
【図5】 本発明の第5の実施例の縦断正面図である。
【図6】 本発明の第6の実施例の縦断正面図である。
【図7】 本発明の第7の実施例の縦断正面図である。
【図8】 従来例の縦断正面図である。
【図9】 異なる従来例の縦断正面図である。
【符号の説明】
20 電子部品搭載用基板 21 絶縁基板 22 導体回路 23 導体回路 24 はんだボール 25 メタルコア(内層導体) 26 電子部品 40 電子部品搭載用基板 41 凹部 50 電子部品搭載用基板 51 凹部 60 電子部品搭載用基板 61 凹部 70 電子部品搭載用基板 71 電子部品搭載用基板 72 電子部品搭載用基板

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】 絶縁基板の表面に設けられ電子部品が接
    続される導体回路と、 絶縁基板の裏面に設けられたはんだボールと、 絶縁基板の内部に設けられた内層導体とを備えた電子部
    品搭載用基板において、 前記内層導体を、厚さ0,1〜2mmの金属板から構成
    したことを特徴とする電子部品搭載用基板。
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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7554039B2 (en) 2002-11-21 2009-06-30 Hitachi, Ltd. Electronic device
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