JP2000004102A - 帯域フィルタ実装用の印刷回路基板 - Google Patents
帯域フィルタ実装用の印刷回路基板Info
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- Filters And Equalizers (AREA)
Abstract
(57)【要約】
【課題】 高周波用帯域フィルタをＰＣＢに実装しても
その特性劣化を抑制できるＰＣＢを提供する。 【解決手段】 帯域フィルタの入出力端を接続する端子
と帯域フィルタの電源端を接続する端子との間に穴を開
ける、さらに溝を形成することにより、ＰＣＢによる寄
生容量を削減する。
その特性劣化を抑制できるＰＣＢを提供する。 【解決手段】 帯域フィルタの入出力端を接続する端子
と帯域フィルタの電源端を接続する端子との間に穴を開
ける、さらに溝を形成することにより、ＰＣＢによる寄
生容量を削減する。
Description
【０００１】
【発明の属する技術分野】本発明は、高周波用帯域フィ
ルタの実装のための印刷回路基板に関する。
ルタの実装のための印刷回路基板に関する。
【０００２】
【従来の技術】無線通信システムの構成要素は、印刷回
路基板（Printed Circuit Board：ＰＣＢ）に実装され
る。例えば、帯域フィルタ（Band Pass Filter：ＲＦ
ＢＰＦ）は別途に製造されてＰＣＢに実装される。
路基板（Printed Circuit Board：ＰＣＢ）に実装され
る。例えば、帯域フィルタ（Band Pass Filter：ＲＦ
ＢＰＦ）は別途に製造されてＰＣＢに実装される。
【０００３】図１Ａは、本発明が適用される高周波用帯
域フィルタについて上方から見た斜視図であり、図１Ｂ
は下方から見た斜視図である。ここで、帯域フィルタは
誘電体フィルタより構成される。このような構造を有す
る高周波用帯域フィルタは、図２のようなＰＣＢに実装
される。即ち、帯域フィルタの入力端１０、出力端２
０、及び接地端３０〜３３はＰＣＢの入力端４０、出力
端５０、及び接地端６０〜６３に各々接続される。
域フィルタについて上方から見た斜視図であり、図１Ｂ
は下方から見た斜視図である。ここで、帯域フィルタは
誘電体フィルタより構成される。このような構造を有す
る高周波用帯域フィルタは、図２のようなＰＣＢに実装
される。即ち、帯域フィルタの入力端１０、出力端２
０、及び接地端３０〜３３はＰＣＢの入力端４０、出力
端５０、及び接地端６０〜６３に各々接続される。
【０００４】高周波用帯域フィルタがＰＣＢに実装され
ると、ＰＣＢの誘電率εによって入力端４０と接地端６
０〜６３との間、及び接地端６０〜６３と出力端５０と
の間に容量成分が存在することになり、この容量成分が
フィルタ特性を変化させてしまう。従って、要求特性を
満足するように設計された帯域フィルタが、ＰＣＢに実
装されることにより要求を満たさなくなる（損失増加、
センタ周波数の変化）。
ると、ＰＣＢの誘電率εによって入力端４０と接地端６
０〜６３との間、及び接地端６０〜６３と出力端５０と
の間に容量成分が存在することになり、この容量成分が
フィルタ特性を変化させてしまう。従って、要求特性を
満足するように設計された帯域フィルタが、ＰＣＢに実
装されることにより要求を満たさなくなる（損失増加、
センタ周波数の変化）。
【０００５】図３は高周波用帯域フィルタ単体の、図４
はＰＣＢ実装時のスミスチャートである。帯域フィルタ
単体の場合は、図３の波形Ａよりインピーダンスが誘導
性位置にあり、波形Ｂより帯域幅が広いことが判る。し
かし、帯域フィルタがＰＣＢに実装された場合は、図４
の波形Ａよりインピーダンスがより多く容量成分を有す
るように変化し、波形Ｂより帯域幅が狭くなることが判
る。
はＰＣＢ実装時のスミスチャートである。帯域フィルタ
単体の場合は、図３の波形Ａよりインピーダンスが誘導
性位置にあり、波形Ｂより帯域幅が広いことが判る。し
かし、帯域フィルタがＰＣＢに実装された場合は、図４
の波形Ａよりインピーダンスがより多く容量成分を有す
るように変化し、波形Ｂより帯域幅が狭くなることが判
る。
【０００６】
【発明が解決しようとする課題】このようにＰＣＢに実
装することにより特性が劣化してしまう。このような特
性劣化は、ＰＣＢ材質の誘電率εに起因する。特性劣化
を防ぐためには、帯域フィルタをＰＣＢを考慮に入れて
設計する必要があり、これは設計者に大きな負担とな
る。
装することにより特性が劣化してしまう。このような特
性劣化は、ＰＣＢ材質の誘電率εに起因する。特性劣化
を防ぐためには、帯域フィルタをＰＣＢを考慮に入れて
設計する必要があり、これは設計者に大きな負担とな
る。
【０００７】本発明の目的は、高周波用帯域フィルタを
ＰＣＢに実装してもその特性劣化を抑制できるＰＣＢを
提供することにある。
ＰＣＢに実装してもその特性劣化を抑制できるＰＣＢを
提供することにある。
【０００８】
【課題を解決するための手段】以上のような課題を解決
する本発明のＰＣＢは、帯域フィルタの入出力端を接続
する端子と帯域フィルタの電源端を接続する端子との間
に穴を開けることを特徴とする。また、さらに帯域フィ
ルタの入出力端を接続する端子と帯域フィルタの電源端
を接続する端子との間に溝を形成する。この、穴及び溝
により信号端と電源端との間の誘電率が下がり、容量成
分の影響を減らすことができる。
する本発明のＰＣＢは、帯域フィルタの入出力端を接続
する端子と帯域フィルタの電源端を接続する端子との間
に穴を開けることを特徴とする。また、さらに帯域フィ
ルタの入出力端を接続する端子と帯域フィルタの電源端
を接続する端子との間に溝を形成する。この、穴及び溝
により信号端と電源端との間の誘電率が下がり、容量成
分の影響を減らすことができる。
【０００９】
【発明の実施の形態】以下、本発明に従う好適な実施形
態を添付図面を参照しつつ詳細に説明する。
態を添付図面を参照しつつ詳細に説明する。
【００１０】図５は本発明のＰＣＢであって、このＰＣ
Ｂには、図１に示した高周波用帯域フィルタが実装され
る。
Ｂには、図１に示した高周波用帯域フィルタが実装され
る。
【００１１】本発明のＰＣＢには、入力端４０、出力端
５０、接地端６０〜６３が備えられる。入力端４０には
高周波用帯域フィルタの入力端１０が、出力端５０には
帯域フィルタの出力端２０が各々接続される。接地端６
１は入力端４０と出力端５０との間に位置し、帯域フィ
ルタの接地端３１が、接地端６２には帯域フィルタの接
地端３２が、接地端６３には帯域フィルタの接地端３３
が各々接続される。
５０、接地端６０〜６３が備えられる。入力端４０には
高周波用帯域フィルタの入力端１０が、出力端５０には
帯域フィルタの出力端２０が各々接続される。接地端６
１は入力端４０と出力端５０との間に位置し、帯域フィ
ルタの接地端３１が、接地端６２には帯域フィルタの接
地端３２が、接地端６３には帯域フィルタの接地端３３
が各々接続される。
【００１２】また本発明のＰＣＢは、ＰＣＢを貫通する
第１ホール〜第４ホール８１〜８４を有する。第１ホー
ル８１は入力端４０と接地端６１との間、第２ホール８
２は接地端６１と出力端５０との間、第３ホール８３は
入力端４０と接地端６２との間、第４ホール８４は出力
端５０と接地端６３との間に位置する。また、入力端４
０と接地端６１との間、及び接地端６１と出力端５０と
の間には各々溝が形成され、入力端４０と接地端６２と
の間、及び出力端５０と接地端６３との間にも、入力端
４０と接地端６１との間、及び接地端６１と出力端５０
との間に形成された溝と同じ幅の溝が各々形成される。
この時、第１ホール〜第４ホール８１〜８４の直径は、
それらの該当溝の幅より大きいか、又は等しい。
第１ホール〜第４ホール８１〜８４を有する。第１ホー
ル８１は入力端４０と接地端６１との間、第２ホール８
２は接地端６１と出力端５０との間、第３ホール８３は
入力端４０と接地端６２との間、第４ホール８４は出力
端５０と接地端６３との間に位置する。また、入力端４
０と接地端６１との間、及び接地端６１と出力端５０と
の間には各々溝が形成され、入力端４０と接地端６２と
の間、及び出力端５０と接地端６３との間にも、入力端
４０と接地端６１との間、及び接地端６１と出力端５０
との間に形成された溝と同じ幅の溝が各々形成される。
この時、第１ホール〜第４ホール８１〜８４の直径は、
それらの該当溝の幅より大きいか、又は等しい。
【００１３】第１ホール〜第４ホール８１〜８４は、帯
域フィルタがＰＣＢに実装される時、入力端４０と接地
端６１との間、接地端６１と出力端５０との間、入力端
４０と接地端６２との間、出力端５０と接地端６３との
間にできる容量成分を取り除くためのものである。即
ち、それらホールをあけないと、入力端４０と接地端６
０、６１との間、及び接地端６０、６１と出力端５０と
の間にはＰＣＢ材質の誘電率εによる容量成分が存在す
ることになる。しかしホールをあけることにより、入力
端４０と接地端６０、６１との間、及び接地端６０、６
１と出力端５０との間にはＰＣＢ材質の誘電率εに代わ
って空気の誘電率ε０が存在するようになる。従って、
ＰＣＢ材質の高い誘電率による容量成分を最小化し得
る。
域フィルタがＰＣＢに実装される時、入力端４０と接地
端６１との間、接地端６１と出力端５０との間、入力端
４０と接地端６２との間、出力端５０と接地端６３との
間にできる容量成分を取り除くためのものである。即
ち、それらホールをあけないと、入力端４０と接地端６
０、６１との間、及び接地端６０、６１と出力端５０と
の間にはＰＣＢ材質の誘電率εによる容量成分が存在す
ることになる。しかしホールをあけることにより、入力
端４０と接地端６０、６１との間、及び接地端６０、６
１と出力端５０との間にはＰＣＢ材質の誘電率εに代わ
って空気の誘電率ε０が存在するようになる。従って、
ＰＣＢ材質の高い誘電率による容量成分を最小化し得
る。
【００１４】図６は、本発明のＰＣＢに高周波用帯域フ
ィルタを実装した場合のフィルタ特性を示す。
ィルタを実装した場合のフィルタ特性を示す。
【００１５】波形Ａよりフィルタのインピーダンスが誘
導性の方へ戻り、波形Ｂより図４と比較して帯域幅が広
くなったことが判る。表１は、高周波用帯域フィルタ
が、単体の場合、従来のＰＣＢに実装された場合、本発
明のＰＣＢに実装された場合のインピーダンス特性を示
す。各値は図３、図４、図６のスミスチャートに基づ
く。
導性の方へ戻り、波形Ｂより図４と比較して帯域幅が広
くなったことが判る。表１は、高周波用帯域フィルタ
が、単体の場合、従来のＰＣＢに実装された場合、本発
明のＰＣＢに実装された場合のインピーダンス特性を示
す。各値は図３、図４、図６のスミスチャートに基づ
く。
【表１】
【００１６】表１の１、２、３は図３、図４、図６に示
した波形Ａの各地点を示す。表１を参照すれば、従来の
ＰＣＢに実装した場合のインピーダンス（-17.9370Ω、
-7.1318Ω、-49.3240Ω）は、帯域フィルタ単体の場合
より多くの容量成分を有する値に変化する。しかし本発
明のＰＣＢに帯域フィルタを実装した場合のインピーダ
ンス（-3.3867Ω、-4.9453Ω、-1.7773Ω）は、従来の
ＰＣＢに帯域フィルタを実装した場合に比べて、帯域フ
ィルタが単独に存在する時のインピーダンス特性に近い
ことが判る。
した波形Ａの各地点を示す。表１を参照すれば、従来の
ＰＣＢに実装した場合のインピーダンス（-17.9370Ω、
-7.1318Ω、-49.3240Ω）は、帯域フィルタ単体の場合
より多くの容量成分を有する値に変化する。しかし本発
明のＰＣＢに帯域フィルタを実装した場合のインピーダ
ンス（-3.3867Ω、-4.9453Ω、-1.7773Ω）は、従来の
ＰＣＢに帯域フィルタを実装した場合に比べて、帯域フ
ィルタが単独に存在する時のインピーダンス特性に近い
ことが判る。
【００１７】
【発明の効果】本発明のＰＣＢによりは、ＰＣＢの信号
端と電源端との間に発生する容量成分を取り除くことが
でき、実装時に発生する実装部品の特性劣化を最小にす
ることができる。
端と電源端との間に発生する容量成分を取り除くことが
でき、実装時に発生する実装部品の特性劣化を最小にす
ることができる。
【図１】高周波用帯域フィルタの外部構造。
【図２】従来のＰＣＢ。
【図３】高周波用帯域フィルタのスミスチャート。
【図４】高周波用帯域フィルタをＰＣＢに実装した時の
スミスチャート。
スミスチャート。
【図５】本発明のＰＣＢ。
【図６】高周波用帯域フィルタを本発明のＰＣＢに実装
した時のスミスチャート。
した時のスミスチャート。
１０、４０ 入力端 ２０、５０ 出力端 ３０、３１、３２、３３、６０、６１、６２、６３ 接
地端 ８１、８２、８３、８４ ホール
地端 ８１、８２、８３、８４ ホール
Claims (2)
- 【請求項１】 帯域フィルタの入出力端を接続する端子
と帯域フィルタの電源端を接続する端子との間に穴を開
けることを特徴とする印刷回路基板。 - 【請求項２】 帯域フィルタの入出力端を接続する端子
と帯域フィルタの電源端を接続する端子との間に溝を形
成する請求項１記載の印刷回路基板。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1997P58419 | 1997-11-06 | ||
| KR1019970058419A KR100285957B1 (ko) | 1997-11-06 | 1997-11-06 | 고주파용대역통과필터의실장을위한인쇄회로기판및그설계방법 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2000004102A true JP2000004102A (ja) | 2000-01-07 |
Family
ID=37055749
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10315021A Pending JP2000004102A (ja) | 1997-11-06 | 1998-11-05 | 帯域フィルタ実装用の印刷回路基板 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US6207906B1 (ja) |
| EP (1) | EP0921715B1 (ja) |
| JP (1) | JP2000004102A (ja) |
| KR (1) | KR100285957B1 (ja) |
| DE (1) | DE69835797T2 (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007006149A (ja) * | 2005-06-23 | 2007-01-11 | Hosiden Corp | 電子部品 |
| CN110167251A (zh) * | 2018-02-10 | 2019-08-23 | 欣强电子（清远）有限公司 | 一种具有加速孔的光模块线路板结构及其制作方法 |
| DE102022122333A1 (de) * | 2022-09-02 | 2024-03-07 | WiredSense GmbH | Verstärkerschaltung zur breitbandigen und rauscharmen Verstärkung einer kapazitiven Stromquelle und ein Sensorsystem |
Family Cites Families (11)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4004256A (en) * | 1974-06-10 | 1977-01-18 | Duncan David M | High frequency amplifier stage with input reference translation and output matching |
| DE2949184A1 (de) * | 1979-12-06 | 1981-07-23 | Siemens AG, 1000 Berlin und 8000 München | Elektrische leiterplatte |
| JPH01270289A (ja) * | 1988-04-21 | 1989-10-27 | Matsushita Electric Ind Co Ltd | プリント配線基板 |
| JPH069287B2 (ja) * | 1989-05-10 | 1994-02-02 | 松下電工株式会社 | プリント配線板 |
| WO1992003033A1 (en) * | 1990-07-30 | 1992-02-20 | Motorola, Inc. | Compliancy tolerant pattern for circuit carrying substrates |
| JPH04294602A (ja) * | 1991-03-23 | 1992-10-19 | Nec Corp | マイクロ波回路基板 |
| GB9216915D0 (en) * | 1992-08-10 | 1992-09-23 | Applied Radiation Lab | Improved radio frequency filter |
| FI99216C (fi) * | 1993-07-02 | 1997-10-27 | Lk Products Oy | Dielektrinen suodatin |
| JP3480014B2 (ja) * | 1993-12-07 | 2003-12-15 | 株式会社村田製作所 | 表面実装型誘電体フィルタ |
| JPH07221510A (ja) * | 1994-02-03 | 1995-08-18 | Advantest Corp | プリント基板を用いた高速信号の伝送線路 |
| JPH07240659A (ja) * | 1994-02-28 | 1995-09-12 | Mitsumi Electric Co Ltd | 表面実装ｓａｗフィルタ |
-
1997
- 1997-11-06 KR KR1019970058419A patent/KR100285957B1/ko not_active IP Right Cessation
-
1998
- 1998-11-04 US US09/185,677 patent/US6207906B1/en not_active Expired - Fee Related
- 1998-11-05 JP JP10315021A patent/JP2000004102A/ja active Pending
- 1998-11-06 EP EP98309118A patent/EP0921715B1/en not_active Expired - Lifetime
- 1998-11-06 DE DE69835797T patent/DE69835797T2/de not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| DE69835797T2 (de) | 2007-09-13 |
| KR19990038601A (ko) | 1999-06-05 |
| KR100285957B1 (ko) | 2001-07-12 |
| DE69835797D1 (de) | 2006-10-19 |
| EP0921715B1 (en) | 2006-09-06 |
| US6207906B1 (en) | 2001-03-27 |
| EP0921715A1 (en) | 1999-06-09 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20000913 |