DE69933235T2 - Zwischenschicht zwischen titannitrid und high density plasma oxid - Google Patents
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- 239000010410 layer Substances 0.000 claims description 105
- 238000000034 method Methods 0.000 claims description 51
- NRTOMJZYCJJWKI-UHFFFAOYSA-N Titanium nitride Chemical compound [Ti]#N NRTOMJZYCJJWKI-UHFFFAOYSA-N 0.000 claims description 30
- 238000004519 manufacturing process Methods 0.000 claims description 21
- 239000004065 semiconductor Substances 0.000 claims description 19
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 claims description 15
- 239000000463 material Substances 0.000 claims description 15
- 239000000758 substrate Substances 0.000 claims description 15
- 239000010936 titanium Substances 0.000 claims description 14
- 229910052719 titanium Inorganic materials 0.000 claims description 14
- 238000000151 deposition Methods 0.000 claims description 10
- 239000003989 dielectric material Substances 0.000 claims description 10
- 239000004020 conductor Substances 0.000 claims description 6
- 239000011229 interlayer Substances 0.000 claims description 3
- BOTDANWDWHJENH-UHFFFAOYSA-N Tetraethyl orthosilicate Chemical compound CCO[Si](OCC)(OCC)OCC BOTDANWDWHJENH-UHFFFAOYSA-N 0.000 description 11
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 9
- 229910052721 tungsten Inorganic materials 0.000 description 9
- 239000010937 tungsten Substances 0.000 description 9
- 238000005229 chemical vapour deposition Methods 0.000 description 8
- 229910052751 metal Inorganic materials 0.000 description 7
- 239000002184 metal Substances 0.000 description 7
- XKRFYHLGVUSROY-UHFFFAOYSA-N Argon Chemical compound [Ar] XKRFYHLGVUSROY-UHFFFAOYSA-N 0.000 description 6
- 230000008021 deposition Effects 0.000 description 6
- 230000007547 defect Effects 0.000 description 5
- NMJKIRUDPFBRHW-UHFFFAOYSA-N titanium Chemical compound [Ti].[Ti] NMJKIRUDPFBRHW-UHFFFAOYSA-N 0.000 description 5
- 230000004888 barrier function Effects 0.000 description 4
- 239000002245 particle Substances 0.000 description 4
- 238000012545 processing Methods 0.000 description 4
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 3
- 229910052786 argon Inorganic materials 0.000 description 3
- 229910052782 aluminium Inorganic materials 0.000 description 2
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 2
- 238000013461 design Methods 0.000 description 2
- 238000011161 development Methods 0.000 description 2
- 238000005530 etching Methods 0.000 description 2
- 239000007789 gas Substances 0.000 description 2
- 230000010354 integration Effects 0.000 description 2
- 238000012986 modification Methods 0.000 description 2
- 230000004048 modification Effects 0.000 description 2
- QDZRBIRIPNZRSG-UHFFFAOYSA-N titanium nitrate Chemical compound [O-][N+](=O)O[Ti](O[N+]([O-])=O)(O[N+]([O-])=O)O[N+]([O-])=O QDZRBIRIPNZRSG-UHFFFAOYSA-N 0.000 description 2
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 description 1
- 206010037660 Pyrexia Diseases 0.000 description 1
- 229910052581 Si3N4 Inorganic materials 0.000 description 1
- 239000012790 adhesive layer Substances 0.000 description 1
- 230000002411 adverse Effects 0.000 description 1
- 239000011248 coating agent Substances 0.000 description 1
- 238000000576 coating method Methods 0.000 description 1
- 239000002131 composite material Substances 0.000 description 1
- 238000010276 construction Methods 0.000 description 1
- 238000005137 deposition process Methods 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 239000000835 fiber Substances 0.000 description 1
- 239000001257 hydrogen Substances 0.000 description 1
- 229910052739 hydrogen Inorganic materials 0.000 description 1
- VJPLIHZPOJDHLB-UHFFFAOYSA-N lead titanium Chemical compound [Ti].[Pb] VJPLIHZPOJDHLB-UHFFFAOYSA-N 0.000 description 1
- 238000000206 photolithography Methods 0.000 description 1
- 238000005268 plasma chemical vapour deposition Methods 0.000 description 1
- 238000005498 polishing Methods 0.000 description 1
- 238000000926 separation method Methods 0.000 description 1
- 235000012239 silicon dioxide Nutrition 0.000 description 1
- 239000000377 silicon dioxide Substances 0.000 description 1
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 1
- 229910052814 silicon oxide Inorganic materials 0.000 description 1
- 239000007787 solid Substances 0.000 description 1
- 238000004544 sputter deposition Methods 0.000 description 1
- 230000009885 systemic effect Effects 0.000 description 1
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/28—Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76843—Barrier, adhesion or liner layers formed in openings in a dielectric
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3205—Deposition of non-insulating-, e.g. conductive- or resistive-, layers on insulating layers; After-treatment of these layers
- H01L21/32051—Deposition of metallic or metal-silicide layers
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76801—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76801—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
- H01L21/76829—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing characterised by the formation of thin functional dielectric layers, e.g. dielectric etch-stop, barrier, capping or liner layers
- H01L21/76834—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing characterised by the formation of thin functional dielectric layers, e.g. dielectric etch-stop, barrier, capping or liner layers formation of thin insulating films on the sidewalls or on top of conductors
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- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/52—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames
- H01L23/522—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body
- H01L23/532—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body characterised by the materials
- H01L23/5329—Insulating materials
-
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/52—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames
- H01L23/522—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body
- H01L23/532—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body characterised by the materials
- H01L23/5329—Insulating materials
- H01L23/53295—Stacked insulating layers
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76801—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
- H01L21/76837—Filling up the space between adjacent conductive structures; Gap-filling properties of dielectrics
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- H01L2924/0001—Technical content checked by a classifier
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Description
- Technisches Gebiet
- Diese Erfindung betrifft im Allgemeinen Verbesserungen der Grenzflächeneigenschaften zwischen Titannitrid und einem Oxid, das mit einem hochdichtem Plasma hergestellt wird, während der Halbleitefertigung und betrifft insbesondere die Anwendung einer gesteuerten Zwischenschicht zwischen diesen beiden Materialien, um die Stabilität der Grenzfläche während Hochtemperaturprozessschritten zu verbessern.
- Hintergrund der Erfindung
- Bei der Herstellung von integrierten Schaltungen mit hoher Leistungsfähigkeit werden viele aktive Bauelemente auf einem einzelnen Substrat hergestellt. Insbesondere muss jedes der Bauelemente während der Bauteilherstellung elektrisch isoliert sein. In einem späteren Prozess müssen spezielle Bauelemente miteinander verbunden werden, um die gewünschte Schaltungsfunktion zu erhalten. Die größer werdende Chipdichte, die für Bauelemente mit sehr hoher Integrationsdichte (VLSI) und äußerst hoher Integrationsdichte (ULSI) erforderlich ist, macht es notwendig, dass eine größere Anzahl an Halbleiterbauelementen auf der Scheibenoberfläche vorhanden ist, wodurch die für die Oberflächenverdrahtung verfügbare Fläche verkleinert wird. Als Folge davon werden leitende Verbindungsschemata auf mehreren Ebenen benötigt. Beispielsweise wird dies bewerkstelligt, indem mehrere Ebenen von aufeinanderfolgend gebildeten Metallverbindungsleitungen verwendet werden, wobei jede Ebene derartiger Leitungen durch eine isolierende Schicht aus einem dielektrischen Material getrennt ist. Diese dielektrischen Schichten sind im Allgemeinen als Zwischenmetalldielektrika (IMD) oder Zwischenschichtdielektrika (ILD) bekannt. Kontaktlochöffnungen, die in der Schicht aus dielektrischem Material ausgebildet sind, werden mit einem leitenden Material gebildet, um einen leitenden Pfropfen zu bilden, der die auf unterschiedlichen Ebenen ausgebildeten Metallleitungen verbindet.
- In einem Beispiel für die Herstellung einer Verbindungsstruktur über mehrere Ebenen wird ein Oxid aus hochdichtem Plasma (HDP), das mittels einer chemischen Dampfabscheidung unter Anwendung eines hochdichtem Plasmas (DDP-CVD) abgeschieden wird, benachbart zu leitenden Strukturen, beispielsweise Leitungen, gebildet. Die CVD mit hochdichtem Plasma ist ein üblicherweise verwendeter Prozess für das Spaltenfüllen von Zwischenschichtmetalldielektrika unter 0,5 μm (siehe dazu beispielsweise Korczynski, E., Festkörper technologie, April 1996, Seite 63). Ein weiteres Dielektrikum, etwa ein Oxid aus Tetraethylorthosilikat (TEOS), kann auf der Oberfläche der HDP-Oxidschicht abgeschieden werden. Die TEOS-Schicht liefert gute dielektrische Eigenschaften und kann relativ kostengünstig durch Abscheideverfahren aufgebracht werden, die in der Industrie gut etabliert sind. Die Auswahl der geeigneten dielektrischen Materialien für diese Schichten wird zum größten Teil durch Kosten, Verhalten und Funktionserfordernisse für eine gegebene Anwendung bestimmt.
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1 ist eine repräsentative bekannte Verbindungsstruktur während einer Zwischenphase bei der Herstellung einer Mehrebenenverbindungsstruktur. Eine anschauliche Leitung130 wird gebildet, indem eine Schicht aus leitendem Material, z. B. Aluminium, über der Oberfläche101 eines Substrats100 abgeschieden und strukturiert wird. Zwischenmetalldielektrikumsschichten, etwa eine HDP-Oxidschicht110 und eine TEOS-Oxidschicht140 werden gebildet, wie in1 gezeigt ist. Nach dem Ätzen eines Kontaktlochs190 durch die TEOS-Oxidschicht140 , das sich zu der oberen Fläche131 der Leitung130 erstreckt, ist es im Allgemeinen notwendig, eine Titan-Titannitrid-(Ti-TiN)-Barrierenschicht entlang den Seitenwänden des Kontaktlochs190 zu bilden. Somit wird nach der Herstellung des Kontaktlochs190 eine Schicht aus Titan150 in dem Kontaktloch190 abgeschieden. Titan bildet einen guten ohmschen Kontakt mit der darunter liegenden Leitung130 und dient auch als eine Haftschicht zwischen dem leitenden Metall180 , beispielsweise Wolfram, und den Seiten des Kontaktlochs190 . Da die Titanschicht150 sehr reaktiv ist, und die nachfolgende Wolframabscheidung das freiliegende Titan schädigen kann, wird eine Titannitrid-(TiN-) Schicht160 auf der Oberfläche der Titanschicht150 abgeschieden. Somit sind die Seitenwände des Kontaktlochs190 zusätzlich zu einem Teil der oberen Fläche131 der Leitung130 , die durch das Kontaktloch190 freigelegt wird, mit einer Titan-Titannitrid-Barrierenschicht bedeckt. Das Kontaktloch190 wird danach mit einem leitenden Metall180 gefüllt, etwa Wolfram, woraus sich die Wolframpfropfen-Verbindungsstruktur ergibt, die in1 gezeigt ist. Durch Wiederholen des obigen Prozesses kann eine Mehrebenenverbindungsstruktur mit abwechselnden Schichten aus Leitungen und leitenden Pfropfen über der Oberfläche der Scheibe hergestellt werden. - Während der Herstellung derartiger Mehrebenenverbindungsstrukturen besteht die Möglichkeit der Erzeugung von Defekten, wenn HDP-Oxid und Titannitrid in dem gleichen Prozess verwendet werden. Während gewisser Prozessabläufe, die in der obigen Herstel lungssequenz beschrieben sind, wird die Halbleiterscheibe entlang ihrem Rand festgeklemmt, und Materialien können dadurch die Oberfläche entlang des Scheibenrands, die durch die Klemmeinrichtungen verdeckt sind, nicht erreichen. Gemäß
2 können diese Klemmenrichtungen (nicht gezeigt) die Scheibe201 entlang ihrem Rand200 berühren und können sich über eine Strecke von ungefähr 2 bis 5 mm oder mehr von dem Rand200 des Scheibensubtrats201 aus nach innen erstrecken. Die Klemmeinrichtungen können die Scheibe auf eine Vielzahl von Möglichkeiten berühren. Derartige Klemmeinrichtungen können die Scheibe um den gesamten Umfang herum kontaktieren, während andere Klemmeinrichtungen fingerähnliche Vorsprünge an mehreren Positionen entlang des Scheibenrandes200 besitzen. Unabhängig von der Konfiguration der Klemmeinrichtung werden die Gebiete entlang des Randes der Scheibe201 , die von der Klemmeinrichtung berührt werden, von den Prozessmaterialien abgeschirmt, die auf die Scheibe201 in einem vorgegebenen Herstellungsprozess einwirken. Da beispielsweise die Scheibe201 während eines Titanabscheideprozesses eingeklemmt ist, wird Titan nicht entlang des Randes200 der Scheibe201 , der von der Klemmeinrichtung berührt wird, abgeschieden. Jedoch ist u. U. während anderer Verarbeitungsschritte, etwa der Herstellung des HDP-Oxids, des TEOS-Oxids, und des Titannitrids der Rand der Scheibe201 nicht eingespannt. Folglich dringen während dieser Prozesse Materialien bis zur Oberfläche der Scheibe201 entlang dem Rand200 vor und besitzen die Neigung, sich dann anzusammeln. Wie in2 beispielsweise gezeigt ist, bilden sich Schichten aus Titannitrid210 , HDP-Oxid220 und TEOS-Oxid230 entlang dem Scheibenrand200 während der Bearbeitung aus. Dies geschieht mehrerer Male im Verlaufe des Fertigungsprozesses für Mehrebenenzwischenverbindungsstrukturen. - Diese Situation kann in nachfolgenden Verarbeitungsschritten auf Grund der schlechten Grenzflächeneigenschaften zwischen dem HDP-Oxid und dem Titannitrid problematisch sein. Insbesondere können nachfolgende Hochtemperaturprozessschritte zu einer Ablösung an der Grenzfläche des Titannitrid-HDP-Oxids führen, wodurch eine Bläschenbildung in lokalen Gebieten entlang des Scheibenrands auftreten kann, in der diese Ablösung erfolgt. Diese Gebiete können aufplatzen und können kleine Oxidscheibchen als Partikel in die Luft freisetzen, die dann zufällig verteilt auf der Scheibenoberfläche auftreffen, wodurch ein Verlust an Chips auftritt und die Prozessausbeute nachteilig beeinflusst wird.
- Die vorliegende Erfindung zielt darauf ab, die zuvor genannten Probleme zu lösen oder zumindest deren Auswirkungen zu reduzieren.
- Es sei auf die Patentzusammenfassungen aus Japan hingewiesen, 1998, Nr. 063, 30. Juni 1998 (1998-06-30) und
JP 10 074835 A 102 bis105 über der Oberfläche eines Halbleitersubstrats101 , das Bilden eines isolierenden Films unter hochdichtem Plasma, das Bilden eines Kontaktlochs109 über den Leitungen102 bis105 , das Abscheiden einer Titanschicht110 und einer Titannitridschicht111 beschrieben ist. Der überschüssige Wasserstoff wird vor dem Herstellen der Kontaktlöcher109 aus der Siliziumoxidschicht108 entfernt. - Überblick über die Erfindung
- Die Erfindung betrifft allgemein ein Verfahren zum Reduzieren der Tendenz für Defekte und zum Verbessern der Ausbeute in einem Halbleiterfertigungsprozess, in welchem HDP-Oxid und Titannitrid eingesetzt werden. Die Erfindung ist in einem Beispiel auf einem Prozess zum Herstellen von Mehrebenenverbindungsstrukturen für integrierte Schaltungen und anspruchsvolle Anwendungen geeignet. In diesem Prozess kommen auf Grund der Natur der während der Herstellung eingesetzten Verfahren und Anlagen ein HDP-Oxid und Titannitrid in direkten Kontakt und sammeln sich entlang des Randes der Halbleiterscheibe aufeinander an, wenn die Mehrebenenverbindungsstruktur der Reihe nach hergestellt wird. Die Grenzfläche zwischen dem HDP-Oxid und Titannitrid entlang des Scheibenrandes unterliegt der Ablösung während nachfolgender Prozessschritte und kann das Freisetzen kleiner HDP-Oxidteilchen in die Luft zur Folge haben, die auf der Scheibenoberfläche auftreffen und einen Chipverlust hervorrufen.
- Daher wird gemäß einem Aspekt der vorliegenden Erfindung ein Verfahren zur Herstellung einer Mehrebenenverbindungsstruktur einer integrierten Schaltungsscheibe bereitgestellt. Es wird mindestens eine Leitung über der Oberfläche eines Halbleitersubstrats gebildet, wobei die Oberfläche des Halbleitersubstrats ein Verdrahtungsleitungsmuster aufweist, und es wird ein Zwischenmetalldielektrikum (IMD) durch Abscheidung einer ersten und einer zweiten dielektrischen Schicht gebildet. Die erste dielektrische Schicht weist eine dielektri sche nicht-HDP-Schicht auf, d. h. eine Schicht, die durch einen Prozess gebildet wird, der sich wesentlich von einer chemischen Dampfabscheidung unter hochdichtem Plasma unterscheidet. Die erste dielektrische Schicht ist im Wesentlichen eine, die mit einer Dicke von weniger als ungefähr 200 bis 500 Angstrom abgeschieden oder auf andere Weise gesteuert hergestellt werden kann. Die zweite dielektrische Schicht weist eine HDP-Oxidschicht auf, die auf der oberen Fläche der ersten dielektrischen Schicht mittels eines chemischen Dampfabscheideprozesses bei hochdichtem Plasma aufgebacht wird. Optional wird eine dritte dielektrische Schicht, etwa eine TEOS-Oxidschicht, auf der Oberfläche der zweiten dielektrischen Schicht bei Bedarf aufgebracht. Es wird ein Kontaktloch bzw. eine Kontaktlochöffnung über der mindestens einen Leitung hergestellt. Es werden mehrere Titan-Titan-Nitrid-beschichtete Kontaktlochöffnungen durch diese Zwischenmetalldielektrikumsstruktur gebildet und die Kontaktlochöffnungen werden dann mit einem leitenden Material, etwa Wolfram gefüllt, wobei an dem Rand der Scheibe die erste Schicht aus einem dielektrischen nicht-HDP-Material die zweite Schicht mit Oxid aus hochdichtem Plasma und die Schicht aus Titannitrid trennt.
- Kurze Beschreibung der Zeichnungen
- Die Erfindung kann durch Bezugnahme auf die folgende Beschreibung mit Verbindung mit den begleitenden Zeichnungen verstanden werden, in denen gleiche Bezugszeichen gleiche Elemente bezeichnen, und in denen:
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1 eine Querschnittsansicht einer konventionellen Mehrebenenverbindungsstruktur mit einer Zwischenmetalldielektrikumsstruktur mit HDP-Oxid/TEOS-Oxid zeigt; -
2 eine Querschnittsansicht des Randes einer Halbleiterscheibe in einem Zwischenfertigungsstadium während der Herstellung einer Mehrebenenverbindungsstruktur zeigt, wie sie in1 dargestellt ist; und -
3a bis3g Querschnittsansichten ausgewählter Schritte bei der Herstellung einer Mehrebenenverbindungsstruktur gemäß der vorliegenden Erfindung zeigen. - Obwohl die Erfindung diversen Modifizierungen und alternativen Formen unterliegen kann, sind dennoch spezielle Ausführungsformen beispielhaft in den Zeichnungen gezeigt und hierin detailliert beschrieben. Es sollte jedoch verstanden werden, dass die Beschreibung spezieller Ausführungsformen hierin nicht beabsichtigt, die Erfindung auf die speziellen offenbarten Formen einzuschränken, sondern die Erfindung soll vielmehr alle Modifizierungen, Äquivalente und Alternativen abdecken, die innerhalb des Schutzbereichs der Erfindung liegen, wie sie durch die angefügten Patentansprüche definiert ist.
- Detaillierte Beschreibung spezieller Ausführungsformen
- Nachfolgend sind anschauliche Ausführungsformen der vorliegenden Erfindung beschrieben. Zur besseren Deutlichkeit werden nicht alle Merkmale einer tatsächlichen Implementierung in dieser Beschreibung dargelegt. Es ist jedoch zu beachten, dass bei der Entwicklung einer derartigen tatsächlichen Ausführungsform zahlreiche implementationsspezifische Entscheidungen getroffen werden müssen, um die speziellen Ziele der Entwickler zu erreichen, etwa die Verträglichkeit mit systembezogenen und geschäftsorientierten Rahmenbedingungen, die von Implementierung zu Implementierung variieren können. Ferner ist zu beachten, dass ein derartiger Entwicklungsaufwand komplex und zeitaufwendig sein kann, aber dennoch eine Routinemaßnahme für den Fachmann im Besitze der vorliegenden Offenbarung darstellt.
- Die vorliegende Erfindung wird nun mit Bezug zu den
3a bis3g beschrieben. Es sollte jedoch beachtet werden, dass die Zeichnungen eine stark vereinfachte Form sind und nicht beabsichtigen, jeden während des Fertigungsprozesses eingesetzten Schritt zu beinhalten. Obwohl ferner diverse Gebiete und Strukturen eines Halbleiterbauelements in den Zeichnungen so dargestellt sind, dass diese sehr präzise, scharfe Strukturen und Profile aufweisen, weiß der Fachmann, dass in der Praxis diese Gebiete und Strukturen nicht so präzise sind, wie dies in den Zeichnungen dargestellt ist. Ferner sind die relativen Größen der diversen Merkmale, die in den Zeichnungen dargestellt sind, unter Umständen übertrieben oder kleiner im Vergleich zur Größe jener Strukturgrößen auf hergestellten Bauelementen gezeigt. Dennoch sind die eingefügten Zeichnungen für den Zweck mit eingeschlossen, um anschauliche Beispiele der vorliegenden Erfindung zu beschreiben und zu erläutern. - Das von der vorliegenden Erfindung gelöste Problem resultiert aus den schlechten Grenzflächeneigenschaften, beispielsweise einer schlechten Haftung, zwischen dem HDP-Oxid und Titannitrid. In einem Halbleiterfertigungsprozess, in welchem diese beiden Materialien in einem Gebiet auf oder über der Oberfläche eines Halbleitersubstrats in Kontakt sind, können als Ergebnis einer lokalen Ablösung dieser beiden Materialien während nachfolgender Verarbeitungsschritte Defekte auftreten. Es können sich kleine Bläschen an dem Grenzflächengebiet des HDP-Oxids und des Titannitrids ausbilden, wovon einige Aufplatzen und kleine Teilchen und die Luft freisetzen können, die dann einen Chipverlust hervorrufen können, wenn die Teilchen auf der Scheibenoberfläche auftreffen. Diese Problematik tritt insbesondere in einem Prozess zur Herstellung von Mehrebenenverbindungsstrukturen in integrierten Schaltungen mit hoher Leistungsfähigkeit auf, in denen diese beiden Materialien eingesetzt werden.
- Gemäß der vorliegenden Erfindung können die Defekte, die auf Grund des Vorhandenseins von Titannitrid in Verbindung mit HDP-Oxid entlang des Scheibenrands hervorgerufen werden, wesentlich reduziert werden, indem mindestens eine Schicht aus Material zwischen einer HDP-Oxidschicht und einer Titannitridschicht vorgesehen wird, um damit die Grenzflächeneigenschaften zwischen dem HDP-Oxid und dem Titannitrid während nachfolgender Hochtemperaturverarbeitungsschritte zu verbessern. Daher wird erfindungsgemäß eine weitere Prozessschicht nachfolgend zur Titannitridabscheidung aber vor der HDP-Oxidabscheidung für die nächste Ebene aus Verbindungsstrukturen gebildet. Die Prozessschicht wird somit zwischen einer HDP-Oxidschicht und einer Titannitridschicht gebildet, die ansonsten entlang des Randes der Scheibe in direkten Kontakt kommen würden.
- Es wird nun eine anschauliche Ausführungsform der vorliegenden Erfindung in Bezug zu den
3a bis3g beschrieben. Wein3a gezeigt ist, wird eine beispielhafte Leitung330 mit beispielsweise Aluminium über der Oberfläche eines Halbleitersubstrats300 gebildet. Wie der Fachmann weiß, kann die Leitung330 über einer Komponente eines Transistors oder eines anderen Halbleiterbauelements, die über der Oberfläche eines halbleitenden Substrats gebildet ist, hergestellt werden. Alternativ kann die Leitung330 über einem oder mehreren leitenden Elementen, beispielsweise einem leitenden Pfropfen, hergestellt werden, die in Schemata für Mehrebenenverbindungsstrukturen verwendet werden. - In
3b wird eine Prozessschicht310 über den Oberflächen301 und331 des Substrats300 bzw. der Leitung330 gebildet. Die Prozessschicht310 kann aus einer Vielzahl von Materialien aufgebaut sein, zu denen im Wesentlichen ein beliebiges dielektrisches Material gehört, das durch einen anderen Prozess als eine chemische Dampfabscheidung mit hoch dichtem Plasma gebildet wird. Es wird angenommen, dass das Vorhandensein von Argon und anderer ähnlicher Moleküle in einer Oxidschicht, die durch eine chemische Dampfabscheidung mit hochdichtem Plasma aufgebracht wurde, zumindest teilweise für die schlechten Grenzflächeneigenschaften zwischen dem HDP-Oxid und dem Titannitrid verantwortlich sind. Daher wird in einer anschaulichen Ausführungsform der Erfindung die Prozessschicht310 in einem beliebigen Prozess hergestellt, der im Wesentlichen kein Argon oder andere ähnliche Materialien in die resultierende Prozessschicht310 einbringt. Die Prozessschicht310 wird typischerweise durch eine beliebige Technik aus einer Vielzahl von geeigneten Abscheideverfahren, die im Stand der Technik bekannt sind, gebildet, etwa chemische Dampfabscheidung, und ist im Allgemeinen aus Siliziumdioxid, Siliziumnitrid oder anderen ähnlichen dielektrischen Materialien aufgebaut. - Obwohl die Dicke der Prozessschicht
310 nicht im Besonderen einer Einschränkung unterliegt, ist die Prozessschicht310 im Allgemeinen so ausgebildet, dass diese mit einer Dicke im Bereich von 200 bis 500 Angstrom weniger abgeschieden oder anderweitig gebildet werden kann. Die Dicke der Prozessschicht310 kann wichtig sein, um ein geeignetes Spaltenfüllverhalten zwischen den mehreren Leitungen330 (von denen eine gezeigt ist), die über dem Substrat300 gebildet sind, zu erhalten. - Gemäß
3c wird nach der Herstellung der Prozessschicht310 eine HDP-Oxidschicht320 über der Obefläche311 über der Prozessschicht310 hergestellt. Die HDP-Oxidschicht320 kann durch einen beliebigen chemischen Dampfabscheideprozess mit hochdichtem Plasma, wie dies im Stand der Technik bekannt ist, hergestellt werden. Die HDP-Oxidschicht320 kann mit einer Dicke hergestellt werden, die für eine vorgegebene Anwendung geeignet ist. Im Allgemeinen besitzt die HDP-Oxidschicht320 eine Dicke im Bereich von ungefähr 6000 bis 10000 Angstrom. - In einer anschaulichen Ausführungsform wird die HDP-Oxidschicht
320 mittels eines chemischen Dampfabscheideprozesses mit hochdichtem Plasma bei einem Druck in einem Bereich von ungefähr 1 bis 20 milli-Torr, einer Temperatur im Bereich von ungefähr 250 bis 400 Grad C und einem Verhältnis von Ätzen zu Abscheiden zwischen ungefähr 0,2 bis 0,4 abgeschieden. Gase, die für das Abscheiden/Ätzen verwendet werden können, sind SiH4, O2, Argon und andere ähnliche Gase. - Gemäß
3d wird in einem nachfolgenden Prozess bei Bedarf eine zusätzliche dielektrische Schicht340 , die aus einem Material, etwa einer TEOS-Oxidschicht, aufgebaut ist, über der oberen Fläche321 der HDP-Oxidschicht320 gebildet. In dieser speziellen Ausführungsform ist die Intermetalldielektrikumsstruktur aus drei separat gebildeten dielektrischen Schichten, d. h. die dielektrische nicht-HDP-Schicht310 , die HDP-Oxidschicht320 und die TEOS-Oxidschicht340 aufgebaut. - Gemäß
3e wird ein Kontaktloch bzw. eine Kontaktlochöffnung342 über der Leitung330 durch konventionelle Photolithographie- und Ätzverfahren gebildet. Das Kontaktloch342 erstreckt sich von der oberen Fläche341 zu der oberen Fläche331 der Leitung330 . Natürlich kann sich abhängig von den Dicken der dielektrischen Schichten, die vorhanden sind, das Kontaktloch durch die dielektrische Schicht340 , die HDP-Oxidschicht320 und/oder die Prozessschicht310 erstrecken. - Gemäß
3f wird als nächstes ein Titan-Titan-Nitrid-Barrierensystem in dem Kontaktloch342 hergestellt. Die Titanschicht350 wird zunächst über der Oberfläche341 der dielektrischen Schicht340 und an den Seitenwandflächen343 (siehe auch3e ) des Kontaktlochs342 und über der Oberfläche331 der Leitung330 gebildet. Als nächstes wird eine Titannitridschicht360 über der Oberfläche der Titanschicht350 gebildet. Die Titanschicht350 und die Titannitridschicht360 können durch ein beliebiges aus dem Stand der Technik bekanntes Verfahren hergestellt werden, beispielsweise Sputter-Abscheidung, CVD oder ähnliche Prozesse. Die zusammengesetzte Dicke der Titan-Titan-Nitridbarrierenschicht kann entsprechend den Entwurfserfordernissen variiert werden, liegt im Allgemeinen aber in einem Bereich von 100 bis 500 Angstrom. In einer anschaulichen Ausführungsform besitzt die Titanschicht350 eine Dicke im Bereich von ungefähr 50 bis 300 Angstrom, und die Titannitridschicht besitzt eine Dicke im Bereich von ungefähr 50 bis 300 Angstrom. - Danach wird ein leitendes Material, das aus einem geeigneten Metall aufgebaut ist, etwa Wolfram, über der Oberfläche der Scheibe (nicht gezeigt) gebildet, um das Kontaktloch
342 mit der Titan-Titrannitrid-Beschichtung zu füllen. Das Wolfram, die Titannitrdschicht360 und die Titanschicht350 werden poliert, beispielsweise durch chemisch-mechanisches Polieren) oder in einem oder mehreren Vorgängen geätzt, so dass diese in etwa zu der Oberfläche341 der dielektrischen Schicht340 eben sind, wodurch ein Wolframpfropfen380 in dem Kontaktloch342 zurückbleibt, woraus sich eine Wolframpfropfen-Verbindungsstruktur300 ergibt, wie sie in3g gezeigt ist. - Durch das Einführen der dielektrischen nicht-HDP-Schicht
310 in den Prozessablauf, wie dies zuvor beschrieben ist, kann die Prozessausbeute auf Grund geringerer Defekte verbessert werden. Dies liegt daran, dass das HDP-Oxid und das Titannitrid, die normalerweise sich entlang dem Rand der Scheibe stapeln würden, nicht mehr in direktem Kontakt sind. Stattdessen verbessert das Vorhandensein der dielektrischen nicht-HDP-Schicht die Grenzflächeneigenschaften zwischen dem HDP-Oxid und dem Titannitrid, wodurch die Neigung für die Materialablösung entlang des Scheibenrandes während nachfolgender Hochtemperaturprozesse reduziert wird. Dies wiederum reduziert die Chipverluste, im Vergleich zu einem Prozess, in welchem Titannitrid und HDP-Oxid in direktem Kontakt sind. - Die offenbarten anschaulichen Ausführungsformen sind lediglich anschaulicher Natur, da die Erfindung auf unterschiedliche aber äquivalente Weisen modifiziert und praktiziert werden kann, wie dies dem Fachmann im Besitze der vorliegenden Lehre klar ist. Ferner sind keine Einschränkungen im Hinblick auf die Details des Aufbaus oder der hierin gezeigten Gestaltung beabsichtigt, sofern diese nicht in den folgenden Patentansprüchen beschrieben sind. Es ist daher klar, dass die speziellen offenbarten Ausführungsformen zur Verwendung mit anderen unterschiedlichen Halbleiterfertigungsverfahren, in denen ein HDP-Oxid mit Titannitrid in Kontakt kommt, geändert oder modifiziert werden können, und alle derartigen Variationen werden als innerhalb des Schutzbereichs der Erfindung liegend erachtet. Daher ist der angestrebte Schutzbereich in den nachfolgenden Patentansprüchen festgelegt.
Claims (7)
- Verfahren zur Herstellung einer Mehrebenenverbindungsstruktur einer integrierten Schaltung auf einer Scheibe, wobei das Verfahren zur Herstellung einer Ebene der Mehrebenenverbindungsstruktur umfasst: Bilden mindestens einer Leitung (
330 ) über der Oberfläche eines Halbleitersubstrats (300 ); Bilden einer ersten Schicht (310 ) mit einem dielektrischen nicht-HDP-Material über der Oberfläche des Halbleitersubstrats; Bilden einer zweiten Schicht (320 ), die aus einem, auf Grundlage eines hochdichten Plasmas hergestellten Oxid aufgebaut ist, über der ersten Schicht; Bilden einer Kontaktlochöffnung über der mindestens einen Leitung; Abscheiden einer Schicht aus Titan (350 ) zumindest in der Kontaktlochöffnung; Abscheiden einer Schicht aus Titannitrid (360 ) über der Schicht aus Titan in der Kontaktlochöffnung; und Füllen der Kontaktlochöffnung mit einem leitenden Material (380 ), wobei nach der Herstellung mehr als einer Ebene am Rand der Scheibe eine Schicht aus dielektrischem nicht-HDP-Material eine Schicht aus Oxid, die auf Grundlage eines hochdichten Plasmas hergestellt ist, und eine Schicht aus Titannitrid trennt. - Verfahren nach Anspruch 1, wobei Bilden einer ersten Schicht (
310 ), die aus einem dielektrischen nicht-HDP-Material aufgebaut ist, über der Oberfläche der Leitung (330 ) und dem Halbleitersubstrat (300 ) umfasst: Bilden einer ersten Schicht (310 ), die aus einem dielektrischen nicht-HDP-Material mit einer Dicke von weniger als ungefähr 500 Angstrom aufgebaut ist, über der Oberfläche der Leitung (330 ) und dem Halbleitersubstrat (300 ). - Verfahren nach Anspruch 1, wobei Bilden einer zweiten Schicht (
320 ), die aus einem auf der Grundlage eines hochdichten Plasmas hergestellten Oxids aufgebaut ist, über der ers ten Schicht (310 ) umfasst: Bilden einer zweiten Schicht (320 ), die aus einem auf Grundlage eines hochdichten Plasmas hergestellten Oxids aufgebaut ist, mit einer Dicke im Bereich von ungefähr 6000 bis 10000 Angstrom über der ersten Schicht (310 ). - Verfahren nach Anspruch 1, wobei Bilden einer Kontaktlochöffnung über der mindestens einen Leitung (
330 ) Bilden einer Kontaktlochöffnung durch die erste Schicht (310 ) umfasst. - Verfahren nach Anspruch 1, wobei die dielektrische nicht-HDP-Zwischenschicht (
310 ) zwischen der HDP-Oxidschicht (320 ) und der Titannitridschicht (360 ) vorgesehen ist, um den Chipverlust in einem Prozess zu verringern, in welchem ansonsten ein HDP-Oxid und Titannitrid über einem Halbleitersubstrat in Kontakt sind. - Verfahren nach Anspruch 5, wobei die HDP-Oxidschicht (
320 ) eine Dicke im Bereich von ungefähr 6000 bis 10000 Angstrom aufweist. - Verfahren nach Anspruch 5, wobei die dielektrische nicht-HDP-Schicht (
310 ) eine Dicke von weniger als ungefähr 500 Angstrom aufweist.
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US09/191,763 US6271112B1 (en) | 1998-11-13 | 1998-11-13 | Interlayer between titanium nitride and high density plasma oxide |
US191763 | 1998-11-13 | ||
PCT/US1999/011650 WO2000030175A1 (en) | 1998-11-13 | 1999-05-27 | Interlayer between titanium nitride and high density plasma oxide |
Publications (2)
Publication Number | Publication Date |
---|---|
DE69933235D1 DE69933235D1 (de) | 2006-10-26 |
DE69933235T2 true DE69933235T2 (de) | 2007-09-13 |
Family
ID=22706840
Family Applications (2)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE69933235T Expired - Lifetime DE69933235T2 (de) | 1998-11-13 | 1999-05-27 | Zwischenschicht zwischen titannitrid und high density plasma oxid |
DE69943414T Expired - Lifetime DE69943414D1 (de) | 1998-11-13 | 1999-05-27 | Zwischenschicht zwischen Titannitrid und hochdichtem Plasmaoxid |
Family Applications After (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE69943414T Expired - Lifetime DE69943414D1 (de) | 1998-11-13 | 1999-05-27 | Zwischenschicht zwischen Titannitrid und hochdichtem Plasmaoxid |
Country Status (6)
Country | Link |
---|---|
US (1) | US6271112B1 (de) |
EP (2) | EP1333484B1 (de) |
JP (1) | JP2003526898A (de) |
KR (1) | KR100577446B1 (de) |
DE (2) | DE69933235T2 (de) |
WO (1) | WO2000030175A1 (de) |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007027234A (ja) * | 2005-07-13 | 2007-02-01 | Seiko Epson Corp | 半導体装置及びその製造方法 |
US9406574B1 (en) | 2007-08-09 | 2016-08-02 | Cypress Semiconductor Corporation | Oxide formation in a plasma process |
US8119538B1 (en) | 2007-08-09 | 2012-02-21 | Cypress Semiconductor Corporation | Oxide formation in a plasma process |
US20110204517A1 (en) * | 2010-02-23 | 2011-08-25 | Qualcomm Incorporated | Semiconductor Device with Vias Having More Than One Material |
US8518818B2 (en) | 2011-09-16 | 2013-08-27 | Taiwan Semiconductor Manufacturing Co., Ltd. | Reverse damascene process |
Family Cites Families (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4829024A (en) | 1988-09-02 | 1989-05-09 | Motorola, Inc. | Method of forming layered polysilicon filled contact by doping sensitive endpoint etching |
JP2655213B2 (ja) | 1991-10-14 | 1997-09-17 | 三菱電機株式会社 | 半導体装置の配線接続構造およびその製造方法 |
US5686761A (en) | 1995-06-06 | 1997-11-11 | Advanced Micro Devices, Inc. | Production worthy interconnect process for deep sub-half micrometer back-end-of-line technology |
US5679606A (en) * | 1995-12-27 | 1997-10-21 | Taiwan Semiconductor Manufacturing Company, Ltd. | method of forming inter-metal-dielectric structure |
US5976993A (en) * | 1996-03-28 | 1999-11-02 | Applied Materials, Inc. | Method for reducing the intrinsic stress of high density plasma films |
US5654216A (en) * | 1996-04-08 | 1997-08-05 | Chartered Semiconductor Manufacturing Pte Ltd. | Formation of a metal via structure from a composite metal layer |
JP2985789B2 (ja) | 1996-08-30 | 1999-12-06 | 日本電気株式会社 | 半導体装置の製造方法 |
US5913140A (en) * | 1996-12-23 | 1999-06-15 | Lam Research Corporation | Method for reduction of plasma charging damage during chemical vapor deposition |
US5759906A (en) * | 1997-04-11 | 1998-06-02 | Industrial Technology Research Institute | Planarization method for intermetal dielectrics between multilevel interconnections on integrated circuits |
US6046106A (en) * | 1997-09-05 | 2000-04-04 | Advanced Micro Devices, Inc. | High density plasma oxide gap filled patterned metal layers with improved electromigration resistance |
-
1998
- 1998-11-13 US US09/191,763 patent/US6271112B1/en not_active Expired - Lifetime
-
1999
- 1999-05-27 EP EP03075961A patent/EP1333484B1/de not_active Expired - Lifetime
- 1999-05-27 JP JP2000583086A patent/JP2003526898A/ja active Pending
- 1999-05-27 DE DE69933235T patent/DE69933235T2/de not_active Expired - Lifetime
- 1999-05-27 KR KR1020017006049A patent/KR100577446B1/ko not_active IP Right Cessation
- 1999-05-27 DE DE69943414T patent/DE69943414D1/de not_active Expired - Lifetime
- 1999-05-27 WO PCT/US1999/011650 patent/WO2000030175A1/en active IP Right Grant
- 1999-05-27 EP EP99928340A patent/EP1135803B1/de not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
KR20010086025A (ko) | 2001-09-07 |
WO2000030175A1 (en) | 2000-05-25 |
US6271112B1 (en) | 2001-08-07 |
DE69933235D1 (de) | 2006-10-26 |
EP1333484B1 (de) | 2011-05-04 |
EP1135803B1 (de) | 2006-09-13 |
KR100577446B1 (ko) | 2006-05-10 |
EP1135803A1 (de) | 2001-09-26 |
DE69943414D1 (de) | 2011-06-16 |
JP2003526898A (ja) | 2003-09-09 |
EP1333484A2 (de) | 2003-08-06 |
EP1333484A3 (de) | 2004-03-17 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
8364 | No opposition during term of opposition | ||
8327 | Change in the person/name/address of the patent owner |
Owner name: GLOBALFOUNDRIES INC., GRAND CAYMAN, KY |
|
8328 | Change in the person/name/address of the agent |
Representative=s name: GRUENECKER, KINKELDEY, STOCKMAIR & SCHWANHAEUSSER, |