DE20215687U1 - Endgerät mit einer hybriden parallelen/seriellen Busschnittstelle - Google Patents
Endgerät mit einer hybriden parallelen/seriellen BusschnittstelleInfo
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- serial
- bits
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/38—Information transfer, e.g. on bus
- G06F13/40—Bus structure
- G06F13/4004—Coupling between buses
- G06F13/4027—Coupling between buses using bus bridges
- G06F13/4045—Coupling between buses using bus bridges where the bus bridge performs an extender function
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Description
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Claims (8)
1. Endgerät, gekennzeichnet durch:
eine Verstärkungsregler-Steuereinheit zur Erzeugung eines Datenblocks mit n Bits, der einen Verstärkungswert darstellt;
eine Datenblock-Demultiplexvorrichtung, mit einem Eingang, der zum Empfang des Datenblocks konfiguriert ist, die den Datenblock in eine Vielzahl von Halbbytes demultiplext, wobei jedes Halbbyte eine Vielzahl von Bits enthält;
für jedes Halbbyte:
einen Parallel/Seriell-Wandler zur Umwandlung dieses Halbbytes in serielle Daten;
eine Leitung zur Übertragung der seriellen Daten dieses Halbbytes; und
einen Seriell/Parallel-Wandler zur Umwandlung der seriellen Daten dieses Halbbytes zur Wiedergewinnung dieses Halbbytes; und
eine Datenblock-Rekonstruktionsvorrichtung zum Kombinieren der wiedergewonnenen Halbbytes zu dem Datenblock; sowie
einen Verstärkungsregler zum Empfang des Datenblocks und zur Einstellung seiner Verstärkung unter Verwendung des Verstärkungswerts dieses Datenblocks.
eine Verstärkungsregler-Steuereinheit zur Erzeugung eines Datenblocks mit n Bits, der einen Verstärkungswert darstellt;
eine Datenblock-Demultiplexvorrichtung, mit einem Eingang, der zum Empfang des Datenblocks konfiguriert ist, die den Datenblock in eine Vielzahl von Halbbytes demultiplext, wobei jedes Halbbyte eine Vielzahl von Bits enthält;
für jedes Halbbyte:
einen Parallel/Seriell-Wandler zur Umwandlung dieses Halbbytes in serielle Daten;
eine Leitung zur Übertragung der seriellen Daten dieses Halbbytes; und
einen Seriell/Parallel-Wandler zur Umwandlung der seriellen Daten dieses Halbbytes zur Wiedergewinnung dieses Halbbytes; und
eine Datenblock-Rekonstruktionsvorrichtung zum Kombinieren der wiedergewonnenen Halbbytes zu dem Datenblock; sowie
einen Verstärkungsregler zum Empfang des Datenblocks und zur Einstellung seiner Verstärkung unter Verwendung des Verstärkungswerts dieses Datenblocks.
2. Endgerät nach Anspruch 1, dadurch gekennzeichnet, dass eine Anzahl von Bits in
einem Datenblock N beträgt und eine Anzahl der Leitungen i beträgt, wobei 1 < i < N
ist.
3. Endgerät nach Anspruch 1, dadurch gekennzeichnet, dass eine Anzahl von Bits in
einem Halbbyte vier beträgt und eine Anzahl von Leitungen zwei beträgt.
4. Endgerät nach Anspruch 1, dadurch gekennzeichnet, dass an jedes Halbbyte ein
Startbit angehängt ist.
5. Endgerät, gekennzeichnet durch:
eine Verstärkungsregler-Steuereinheit zur Erzeugung eines Datenblocks mit n Bits, der einen Verstärkungswert darstellt;
eine Datenblock-Demultiplexvorrichtung mit einem Eingang, der zum Empfang des Datenblocks konfiguriert ist, die den Datenblock in eine Vielzahl von Halbbytes demultiplext, wobei jedes Halbbyte eine Vielzahl von Bits enthält;
für jedes Halbbyte:
einen Parallel/Seriell-Wandler zur Umwandlung dieses Halbbytes in serielle Daten;
eine Leitung zur Übertragung der seriellen Daten dieses Halbbytes; und
einen Seriell/Parallel-Wandler zur Umwandlung der seriellen Daten dieses Halbbytes zur Wiedergewinnung dieses Halbbytes; und
eine Datenblock-Rekonstruktionsvorrichtung zum Kombinieren der wiedergewonnenen Halbbytes zu dem Datenblock und zur selektiven Leitung dieses Datenblocks an einen Empfangs-Verstärkungsregler oder einen Sende- Verstärkungsregler; und
wobei der Empfangs-Verstärkungsregler und der Sende-Verstärkungsregler zum Empfang des Datenblocks und zur Einstellung seiner Verstärkung unter Verwendung des Verstärkungswerts dieses Datenblocks konfiguriert sind.
eine Verstärkungsregler-Steuereinheit zur Erzeugung eines Datenblocks mit n Bits, der einen Verstärkungswert darstellt;
eine Datenblock-Demultiplexvorrichtung mit einem Eingang, der zum Empfang des Datenblocks konfiguriert ist, die den Datenblock in eine Vielzahl von Halbbytes demultiplext, wobei jedes Halbbyte eine Vielzahl von Bits enthält;
für jedes Halbbyte:
einen Parallel/Seriell-Wandler zur Umwandlung dieses Halbbytes in serielle Daten;
eine Leitung zur Übertragung der seriellen Daten dieses Halbbytes; und
einen Seriell/Parallel-Wandler zur Umwandlung der seriellen Daten dieses Halbbytes zur Wiedergewinnung dieses Halbbytes; und
eine Datenblock-Rekonstruktionsvorrichtung zum Kombinieren der wiedergewonnenen Halbbytes zu dem Datenblock und zur selektiven Leitung dieses Datenblocks an einen Empfangs-Verstärkungsregler oder einen Sende- Verstärkungsregler; und
wobei der Empfangs-Verstärkungsregler und der Sende-Verstärkungsregler zum Empfang des Datenblocks und zur Einstellung seiner Verstärkung unter Verwendung des Verstärkungswerts dieses Datenblocks konfiguriert sind.
6. Endgerät nach Anspruch 5, dadurch gekennzeichnet, dass eine Anzahl von Bits in
einem Datenblock N beträgt und eine Anzahl der Leitungen i beträgt, wobei 1 < i < N
ist.
7. Endgerät nach Anspruch 5, dadurch gekennzeichnet, dass eine Anzahl von Bits in
einem Halbbyte vier beträgt und eine Anzahl von Leitungen zwei beträgt.
8. Endgerät nach Anspruch 5, dadurch gekennzeichnet, dass an jedem Halbbyte ein
Startbit angehängt ist, wobei die Datenblock-Rekonstruktionsvorrichtung den
Datenblock selektiv anhand eines Werts der Startbits weiterleitet.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| DE20215687U DE20215687U1 (de) | 2002-10-11 | 2002-10-11 | Endgerät mit einer hybriden parallelen/seriellen Busschnittstelle |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| DE20215687U DE20215687U1 (de) | 2002-10-11 | 2002-10-11 | Endgerät mit einer hybriden parallelen/seriellen Busschnittstelle |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| DE20215687U1 true DE20215687U1 (de) | 2002-12-19 |
Family
ID=7975908
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| DE20215687U Expired - Lifetime DE20215687U1 (de) | 2002-10-11 | 2002-10-11 | Endgerät mit einer hybriden parallelen/seriellen Busschnittstelle |
Country Status (1)
| Country | Link |
|---|---|
| DE (1) | DE20215687U1 (de) |
-
2002
- 2002-10-11 DE DE20215687U patent/DE20215687U1/de not_active Expired - Lifetime
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| R207 | Utility model specification |
Effective date: 20030130 |
|
| R150 | Term of protection extended to 6 years |
Effective date: 20051027 |
|
| R151 | Term of protection extended to 8 years |
Effective date: 20081030 |
|
| R152 | Term of protection extended to 10 years |
Effective date: 20101123 |
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| R071 | Expiry of right |