DE2008374C3 - Verfahren zum Herstellen eines Hochfrequenztransistors vom Planartyp mit Hilfe des photolithographischen Ätzverfahrens - Google Patents
Verfahren zum Herstellen eines Hochfrequenztransistors vom Planartyp mit Hilfe des photolithographischen ÄtzverfahrensInfo
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Description
45 Die Erfindung betrifft ein Verfahren zum Herstellen
eines Hochfrequenztransistors vom Pianartyp mit Hilfe des photolithographischen Ätzverfahrens, mit folgenden
Schritten: Ausbildung einer ersten, dicken, isolierenden Oxidschicht mit einer Schichtdicke in der Größe
von 2 bis 3 μπι auf der Oberfläche eines Halbleitersubstrats
vom Leitungstyp der Kollektorzone. Ausbildung eines Fensters in dieser Oxidschicht durch Abätzen,
Ausbildung der Basiszone durch Eindiffundieren eines Störstoffs durch ein Diffusionsfenster und Ausbilden
einer zweiten, dünneren Oxidschicht mit einer Schichtdicke in df>- Größe von 0,5 bis 0.7 μηι im Bereich des
Fensters der ersten Oxidschicht entweder vor oder gleichzeitig mit dem Ausbilden der Basiszone, Ausbilden
der Emitterzone innerhalb der Basiszone durch ein unter Auflegen einer Ätzmaske hergestelltes weiteres
Fenster und Anbringen von Flächenelektroden für die Emitterzone und die Basiszone, deren größter Teil auf
der ersten, dicken Oxidschicht liegt.
Ein derartiges Verfahren ist aus der GB-PS 10 48 424 bekannt. Durch die im Vergleich zur üblichen Herstellung
von Planartransistoren verhältnismäßig große Dicke der ersten Oxidschicht wird der Vorteil erreicht,
daß die Streukapazitäten zwischen den Flächenelektroden und dem Halbleiterträger, deren Abstand durch die
genannte Oxidschicht bestimmt ist, herabgesetzt werden.
Dabei ergibt sich aber das Problem, daß entsprechend
der Dicke der Oxidschicht auch der Abstand zwischen der auf sie aufgelegten photolithographischen Maske
für die Ausbildung der Emitterzone und der durch das Fenster in der Oxidschicht freigelegten Halbleiteroberfläche
ebenfalls vergrößert wird. Dies hat zur Folge, daß die photolithographische Belichtung nicht optimal
scharf wird und entsprechend die Emitterzone einen unscharfen Verlauf haben kann. Da bei einem
Hochfrequenztransistor der Abstand zwischen der Emitterzone und der Kontaktschicht der Basiselektrode
extrem klein ist, z. B. 2 bis 4 μιη, kann der unscharfe
Verlauf zur Folge haben, daß sich diese Zonen berühren, so daß das Produkt unbrauchbar ist
Aufgabe der Erfindung ist es, ein Verfahren der eingangs genannten Art so zu verbessern, daß trotz der
vorherigen Ausbildung einer dicken, die Streukapazitä ten herabsetzenden Oxidschicht die unter Anwendung
des anschließenden photolithographischen Ätzverfahrens ausgebildete Emitterzone einen exakt den
gewünschten Grenzen entsprechenden Verlauf hat.
Diese Aufgabe wird erfindungsgemäß dadurch gelost.
daß zuerst auf der Oberfläche des Halbleitersubstrat* ein podestfö.-miger Teil ausgebildet wird, daß dann die
erste Oxidschicht auf der Oberfläche des Substrats einschließlich des podestförmigen Teils ausgebildet und
das Fenster in ihr im Bereich des podestförmigen Teils und der angrenzenden Bereiche ausgebildet wird und
daß die Dicke der ersten Oxidschicht im Bereich von 1.8 bis 3,0 μπι, die Höhe des podestförmigen Teils im
Bereich von 1.0 bis 2,6 μιη und die Dicke der zweiten
Oxidschicht im Bereich von 0.4 bis 0,8 μιτί derart
gewählt werden, daß die zweite Oxidschicht die Ätzmaske für die Herstellung des Fensters zur
Ausbildung der Emitterzone abstützt.
Hierdurch wird der Vorteil erreicht, daß die Maske
für die Bildung des Fensters für den Emitterdiffusionsprozeß mi<
unmittelbarem Kontakt an der zweiten Oxidschicht auf der Oberfläche des podestförmigen
Teils aufliegt. Deshalb kann die Emitterschablone der Maske sehr exakt definiert auf dieser Oxidschicht
innerhalb der Basiszone reproduziert werden. Da die Maske in unmittelbarer Berührung mit der zweiten
Oxidschicht steht, die wesentlich dünner ist als die erste Oxidschicht, wird die Genauigkeit der Ausbildung des
Fensters in der zweiten Oxidschicht verbessert. Der vorgeschriebene Abstand zwischen der Emitterzone
und der Kontaktschicht der Basiszone kann sehr exakt auf einem Wert im Bereich zwischen 2 und 4 μιη
eingehalten werden.
Es ist zwar bei der Herstellung von Dioden und Transistoren nicht vom Planartyp, sondern vom
Mesatyp bekannt (GB-PS 10 81 376). auf der Oberseite des Halbleitersubstrats einen allgemein als Mesa
bezeichneten podestförmigen Teil auszubilden, danach auf der gesamten Oberseite eine isolierende Oxidschicht
auszubilden und diese Oxidschicht zur Bildung eines Diffusionsfensters an der Oberseite des Mesas wegzuätzen,
an seinen Flanken aber stehenzulassen. Damit wird bezweckt, den p-n-Übergang zwischen Basis und
Kollektorzone völlig innerhalb des Mesas von dessen einer Flanke zur anderen verlaufen zu lassen und damit
im Unterschied zu seinem Verlauf beim Planartyp im wesentlichen krümmungsfrei auszubilden. Der Mesa
ο Jake} höher als die Dicke der Basiszone sein und
«fcebt sich über die ihn umgebenden Teile der Oxidschicht hinaus. Um den Höhenunterschied auszureichen
und den Anschluß an Basis und Emitter mit ebenen Flächenelektroden herstellen zu können, kann
die den Mesa umgebende Vertiefung mit einem
isolierenden Material ausgefüllt werden. Damit werden Jann verringerte Streukapazitäten zwischen den Elektroden
bzw. ihren Zuleitungen und dem Halbleiterkörner erzielt Ein derartiger Transistor wird aber ..icht
nach dem üblichen Planarverfahren hergestellt, und es ist dabei insbesondere eine exakte Deckung von Mesa
und Diffusionsfenster bei Anwendung der photolitho- «raphischen Ätztechnik kaum zu erzielen.
Eine Ausführuiigsform der Erfindung wird im
folgenden an Hand der Zeichnungen näher erläutert. Gleiche Bezugszeichen in den verschiedenen Figuren
bezeichnen gleiche oder entsprechende Teile.
Y i g 1 ist ein Schnitt durch einen Transistor vom
Planartyp zur Veranschaulichung des He.stellungsverfahrens nach dem Stand der Technik;
F i g 2 bis 8 sind Schnitte durch einen Transistor in den verschiedenen Stufen des Herstellungsverfahrens
nach der Erfindung, wobei Fig. 5B eine gegenüber F i g. 5A abgeänderte Ausführungsform zeigt.
Bei den üblichen Verfahren zur Herstellung von Hochfrequenztransistoren vom Planartyp wird bisher
gemäß F i g. 1 so vorgegangen, daß ein Teil einer über einer Kollektorzone 1 eines Halbleiterträgers ausgebildeten
Oxidschicht 2 zur Bildung eines Fensters weggeätzt wird und daß von dem Fenster der so
weggeätzten Oxidschicht 2 aus ein Störstoff in die KcHektorzone 1 diffundiert wird, um eine Basiszone 3
zu" bilden. Eine Oxidschicht 4, die sich während des Diffusionsprozesses über dem Fenster der ersten
Oxidschicht 2 bildet, ist dünner als die erste Oxidschicht 2. Infolgedessen bildet sich auf der Oberfläche der
Oxidschicht 4 eine Vertiefung 5, die die obere Fläche der Baiszone 3 überdeckt. Wegen dieses vertieften Bereiches
5 ist es schwierig, einen guten Kontakt zwischen einer Emitterschabk.ne 8 zur Herstellung des Fensters
für die Ausbildung der Emitterzone und der Oxidschicht 4 im Bereich der Basiszone herzustellen, da die
nterseite der die Emitterschablone 8 tragenden piiotolithographischen Maske 7 von der Oberfläche der
die Vertiefung 5 umgebenden Oxidschicht 2 abgestützt wird und auf du;se Weise ein Zwischenraum zwischen
der Emitterschablone 8 und der Oxidschicht 4 in dem vertieften Teil 5 entsteht. Da dieser Zwischenraum
üblicherweise in der Größenordnung von 5000 bis 8000A liegt, wird die Emitterschablone 8 auf der
photoüthographischen Maske 7 ungenau oder verschmiert
auf der Basiszone 3 abgedruckt, wodurch die Betriebseigenschaften des Transistors verschlechtert
werden. Auch eine Kontaktschicht 9 für die Basis-Elektrode, die nach der Ausbildung der Emitterzone 6 in der
Basiszone 3 ausgebildet wird, wird aus demselben Grund ungenau ausgebildet. Da der Abstand c/zwischen
der Emitterzone 6 und der Basiskontaktschicht 9 auf die Größenordnung von 2 bis 4 μΐη festgelegt ist, kommt es
daher in sehr vielen Fällen vor, daß die Emitterzone und die Basiskontaktschicht 9 einander berühren. Dies
führt zu einem beträchtlichen Ausschuß.
Gemäß dem ersten Schritt des Verfahrens nach der Erfindung wird ein Silicium-Halbleiiersubstrat, das
später die Kollektorzone 11 des Transistors vom Planartyp bildet, unter Anwendung eines photolithogranhischen
Ätzverfahrens so abgeätzt, daß ein flacher podestförmiger Teil 12 auf einem Teil der Hauptoberfläche
des Substrats ausgebildet wird (Fig.2). Bei der
beschriebenen Ausführungsform wird die Höhe des podestförmigen Teils 12 auf den optimalen Wert von
etwa 1,4 μπι festgelegt
Danach wird eine erste, verhältnismäßig dicke isolierende Schicht 13 auf der Hauptoberfiäche des
Substrats ausgebildet (F i g. 3). Bei der beschriebenen
Ausführungsform wird die Dicke der ersten Isolierschicht 13 auf einen optimalen Wert von etwa 2,0 μηι
festgelegt Beim zweiten Schritt des Verfahrens wird ein Teil der ersten Isolierschicht 13 oberhalb des pcdestförmigen
Teils 12 und im angrenzenden Bereich mittels eines photoüthographischen Ätzverfahrens weggeätzt
(Fig.4). .
In einer dritten Stufe des Verfahrens wird ein
Störstoff von der durch die zweite Verfahrensstufe freigelegten Oberfläche des podestförmigen Teils aus in
das Substrat hineindiffundiert, so daß eine Basiszone 14 vom p-Typ in dem Substrat gebildet wird. Ferner wird
auf Grund des die Diffusion des Störstoffs begleitenden Oxydationsprozesses eine Oxidschicht auf der Oberfläche
der Basiszone 14 gebildet. Diese Oxidschicht bildet eine zweite Isolierschicht 15 (vergleiche Fig. 5A).
Diese zweite Oxidschicht 15 wird im angegebenen Maße düiner als die erste Isolierschicht 13 ausgebildet.
Beim Ausführungsbeispiel beträgt ihre Dicke 0,6 μΐη.
Statt dessen kann die dritte Verfahrensstufe auch so durchgeführt werden, daß zuerst die zweite Isolierschicht
15 auf der durch die zweite Verfahrensstufe freigelegten Oberfläche des podestförmigen Teils 12
ausgebildet und danach ein Teil der zweiten Isolierschicht 15a zur Bildung des Diffusionsfensters abgeätzt
wird, so daß eine Basiszone 14 des Transistors durch Eindiffundieren eines Störstoffs in dem podestförmigen
Teil 12 gebildet wird (Fig. 5B). Wenn die Basiszone 14
nach diesem zuletzt beschriebenen Verfahren ausgebildet wird, entstehen keine konkaven und konvexen 1 eile
14a wie in Fig.5A am Übergang zwischen Kollektor und Basis. Hierdurch wird das Rauschen, zu dem
derartige Teile beitragen, verringert.
Da bei der abgeänderten Ausführungsform gemäß Fig.5B zuerst die zweite Isolierschicht 15 auf der
gemäß F i g. 4 freigelegten Oberfläche des podestförmigen Teils 12 ausgebildet wird, kann man auch die
Isolierschicht 15 dadurch bilden, daß man die erste Isolierschicht 13 über dem podestförmigen Teil 12 so
weit abätzt, bis sie die für die Isolierschicht 15 gemäß F i g. 5B gewünschte Dicke von 0.6 μΐη erhält.
Als vierter Schritt des Verfahrens nach der Erfindung
wird eine Maske 16 mit einer darauf ausgebildeten Fmitterschablone 17 in engen Kontakt mit der nut
einem Photolack beschichteten Oberfläche der auf dem podestförmigen Teil 12 ausgebildeten Isolierschicht
gebracht und die Anordnung belichtet. Danach wird der unter der Emitterschablone 17 liegerde Teil 15b der
zweiten Isolierschicht durch ein Ätzverfahren abgeatzt
Äfs fünfter Schritt des Verfahrens nach der Erfindung wird ein Störstoff durch das Fenster 156 in die durch die
vorhergehende Stufe freigelegte Basiszone 14 e.nditlundiert,
so daß darin eine Emitterzone 18 vom n-lyp gebildet wird. Während dieser Emitterdiffusion wird
wiederum eine Oxidschicht auf der Oberfläche der Emitterzone 18 gebildet, die die Isolierschicht 19 bildet
(vergleiche Fi g.7).
Der auf diese Weise gebildete Transistor wird dann weiteren Verarbeitungsvorgängen unterworfen, wie
ζ. B. dem Aufbringen eines Elektrodenmaterials, z. B. Aluminium, auf der Emitterzone 18 und der Basiszone
14 zum Herstellen eines ohmschen Kontakts mit diesen Zonen, das Ausbilden von mit dem Elektrodenmaterial
verbundenen Flächenelektroden 20, 21 auf der zweiten Isolierschicht 15 und der ersten Isolierschicht 13,
Verbinden dieser Flächenelektroden 20, 21 mit Anschlußdrähten 22, 23 ( F i g. 8) und Anbringen einer
Kollektorelektrode 24 auf der Rückseite des Halbleitersubstrats. '
Die Dicke der ersten Isolierschicht 13 kann bei dem beschriebenen Verfahren wesentlich größer gewählt
werden als die der üblichen Isolierschicht 2 (Fig. 1)
nach dem beschriebenen Stand der Technik. Beispielsweise kann aie Dicke der ersten Isolierschicht 13 auf
etwa 2,0 μηι vergrößert werden, was mehr als das Dreifache der Dicke der üblichen Isolierschicht 2 ist, die
bisher bei etwa 0,6 μηι lag. Hierdurch werden
Streukapazitäten zwischen den Flächenelektroden und dem Halbleitersubstrat, die beim Anbringen der
Flächenelektroden auf der Oberfläche der ersten Isolierschicht 13 auftreten, auf Werte herabgesetzt, die
weit unter den üblichen Werten liegen. Hierdurch werden die Hochfrequenzeigenschaften des Transistors
erheblich verbessert.
Außerdem muß beim Ausbilden der Emitterzone 18 nur die zweite Isolierschicht 15. deren Dicke wesentlich
kleiner ist als die der ersten Isolierschicht 13 (und z. B. 4000 Ä beträgt) abgeätzt werden, so daß der Älzvorgang
außerordentlich leicht und exakt ausgeführt werden kann und die Emitterzone 18 in der Basiszone 14
in sehr exakter Übereinstimmung mit den gewünschten Grenzen hergestellt werden kann. Auch hierdurch
werden die Hochfrequenzeigenschaften des Transistors verbessert.
Während vorstehend das Verfahren im Zusammenhang mit der Herstellung eines npn-Transistors
beschrieben wurde, ist jedoch das Verfahren auch für die Herstellung eines pnp-Transistors anwendbar.
Hierzu 2 Blatt Zeichnungen
Claims (2)
- Patentansprüche:I. Verfahren zum Herstellen eines Hochfrequenztransistors vom Planartyp unter Anwendung des s photolithographischen Ätzverfahrens, mit folgenden Schritten: Ausbildung einer ersten, dicken, isolierenden Oxidschicht mit einer Schichtdicke in der Größe von 2 bis 3 μπι auf der Oberfläche eines Halbleitersubstrats vom Leitungstyp der Kollektorzone, Ausbildung eines Fensters in dieser Oxidschicht durch Abätzen, Ausbildung der Basiszone durch Eindiffundieren eines Störstoffs durch ein Diffusionsfenster und Ausbilden einer zweiten, dünneren Oxidschicht mit einer Schictatdicke in der Größe von 0,5 bis 0,7 μπι im Bereich des Fensters der ersten Oxidschicht entweder vor oder gleichzeitig mit dem Ausbilden der Basiszone, Ausbilden der Emitterzone innerhalb der Basiszone durch ein unter Auflegen einer Ätzmaske hergestelltes zweites Fenster und y> Anbringen von Fiächenelektroden für die Emitterzone und die Basiszone, deren größter Teil auf der ersten, dicken Oxidschicht liegt, dadurch gekennzeichnet, daß zuerst auf der Oberfläche des Halbleitersubstrats (U) ein podestförmiger Teil(12) ausgebildet wird, daß dann die erste Oxidschicht(13) auf der Oberfläche des Substrats einschließlich des podestförmigen Teils ausgebildet und das Fenster in ihr im Bereich des podestförmigen Teils und der angrenzenden Bereiche ausgebildet wird und daß die Dicke der ersten Oxidschicht (13) im Bereich von 1,8 bis 3,0 μιη. die Höhe des podestförmigen Teils (12) im Bereich von 1,0 bis 2,6 μπι und die Dicke der zweiten Oxidschicht (55) im Bereich von 04 bis 0,8 μηι derart gewählt werden, daßxiie zweite Oxidschicht (15) die Ätzmaske (16, 17) für die Herstellung des Fensters zur Ausbildung der Emitterzone (18) abstützt.
- 2. Verfahren nach Anspruch I, dadurch gekennzeichnet, daß die Höhe des podestförmigen Teils (12) 1,4 μπι. die Dicke der ersten Oxidschicht 2,0 μπι und die Dicke der zweiten Oxidschicht 0,6 μηι beträgt.
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C3 | Grant after two publication steps (3rd publication) | ||
E77 | Valid patent as to the heymanns-index 1977 | ||
8327 | Change in the person/name/address of the patent owner |
Owner name: SANYO ELECTRIC CO., LTD., MORIGUCHI, OSAKA, JP |
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