DE19735170A1 - Chipmodul, insbesondere für kontaktbehaftete Chipkarten, mit nebeneinander angeordneten Chips - Google Patents
Chipmodul, insbesondere für kontaktbehaftete Chipkarten, mit nebeneinander angeordneten ChipsInfo
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Description
Die Erfindung betrifft ein Chipmodul, insbesondere für kon
taktbehaftete Chipkarten, gemäß dem Oberbegriff des Patentan
spruchs 1.
Chipkarten mit derartigen Chipmodulen werden beispielsweise
als elektronischer Schlüssel im Bereich des Fernsehens ver
wendet, um bei Pay-TV verschlüsselte Video-Signale zu deko
dieren und die dekodierten Signale dann an den Fernseher wei
terzuleiten. Der eigentliche elektronische Schlüssel besteht
hierbei im wesentlichen aus einem integrierten Schaltkreis,
der in dem Chipmodul integriert ist.
Weiterhin ist eine zwei-Chip-Ausführung bekannt, bei welcher
der Mikrocontroller- und ASIC-Chip getrennt sind, wobei die
beiden Chips übereinander im Chipmodul angebracht sind. Sind
die Maße des Mikrocontroller-Chips und des ASIC-Chips annä
hernd gleich bzw. sind die Chipkanten des oberen Chips nicht
mindestens 0,2 mm von den Anschlußkontakten (Bondpads) des
unteren Chips entfernt, kann jedoch aufgrund des Chipklebers,
der auf die Anschlußkontakte des unteren Chips gelangt, keine
zuverlässige Drahtkontaktierung gewährleistet werden. In die
sem Fall müssen die Chips nebeneinander in dem Chipmodul be
festigt werden.
Es ist bereits bekannt, Chips nebeneinander auf der Träger
schicht anzuordnen, wobei eine Zweilagen-Metallschicht vorge
sehen wird. Diese Chipmodulkonstruktion ist jedoch mit hohem
Materialverbrauch verbunden und relativ teuer. Weiterhin be
steht dort das Problem, daß die Anschlußdrähtchen, mit denen
die beiden Chips untereinander verbunden sind, beim Einsatz
üblicher Drahtkontaktierungstechniken für die Massenprodukti
on häufig eine relativ hohe Schleifenhöhe aufweisen, so daß
die maximale Moduldicke (meist 0,6 mm) häufig nicht eingehal
ten werden kann.
Der Erfindung liegt daher die Aufgabe zugrunde, ein Chipmodul
der eingangs genannten Art mit nebeneinander angeordneten
Chips zu schaffen, das einfach und kostengünstig herzustellen
ist und den Einsatz von bei der Massenproduktion üblichen
Drahtkontaktierungstechniken ermöglicht.
Diese Aufgabe wird erfindungsgemäß durch die Merkmale des An
spruchs 1 gelöst. Vorteilhafte Ausführungsformen der Erfin
dung sind in den weiteren Ansprüchen beschrieben.
Bei dem erfindungsgemäßen Chipmodul ist ein neben dem ersten
Chip angeordneter zweiter Chip innerhalb einer in der Träger
schicht vorgesehenen Vertiefung eingesetzt, so daß der erste
und zweite Chip in unterschiedlichen Höhenlagen angeordnet
sind.
Das erfindungsgemäße Chipmodul zeichnet sich dadurch aus,
daß es auch bei Vorliegen nebeneinander angeordneter Chips
sehr einfach und kostengünstig hergestellt werden kann. Außerdem
können die bei der Massenproduktion üblicherweise ein
gesetzten Drahtkontaktierungstechniken, wie beispielsweise
die "Wedge on bump"-Drahtkontaktierungstechnik, verwendet
werden, ohne daß die Schleifenhöhe der Anschlußdrähtchen eine
bestimmte Höhe übersteigt, wenn benachbarte Chips miteinander
kontaktiert werden.
Gemäß einer vorteilhaften Ausführungsform weisen die vonein
ander isolierten Kontaktflächen der leitenden Metallauflage
sowohl ISO-Kontaktflächen, als auch damit elektrisch verbun
dene Zusatzkontaktflächen auf, die sich zumindest bis in die
Nähe eines Chips erstrecken. Diese Zusatzkontaktflächen bie
ten den besonderen Vorteil, daß im Falle nebeneinanderliegen
der Chips sich kreuzende Anschlußdrähtchen und damit Kurz
schlüsse beim Verdrahten der Chips vermieden werden können.
Dadurch kann auch die optimierte Pad-Belegung zumindest auf
einem der beiden Chips beibehalten werden, so daß eine teuere
Umstrukturierung zumindest dieses Chips nicht erforderlich
ist. Beispielsweise kann die standardisierte Padbelegung auf
dem Mikrocontroller beibehalten und nur der kundenspezifische
ASIC-Chip bezüglich der PAD-Anordnung angepaßt werden.
Die Erfindung wird nachfolgend anhand der Zeichnungen bei
spielshaft näher erläutert. In diesen zeigen:
Fig. 1 eine Draufsicht auf ein erfindungsgemäßes Chipmo
dul von der Chipseite her, wobei jedoch die auf
der gegenüberliegenden, durch die Trägerschicht
verdeckten Kontaktflächen ebenfalls eingezeichnet
sind und der in Fig. 2 eingezeichnete Rahmen und
die Vergußmasse aus Harz weggelassen sind und
Fig. 2 einen Schnitt längs der Linie II-II von Fig. 1,
wobei der Übersichtlichkeit halber nur die Trä
gerschicht schraffiert gezeichnet ist.
Wie aus den Fig. 1 und 2 ersichtlich, besteht das erfin
dungsgemäße Chipmodul im wesentlichen aus einer Trägerschicht
1 aus nichtleitendem Material, beispielsweise Epoxyharz, ei
ner auf der Unterseite der Trägerschicht 1 aufgebrachten Me
tallauflage 2, beispielsweise Kupfer, welches eine vergoldete
Oberfläche aufweisen kann, einem ersten Chip 4 und einem
zweiten Chip 3, die nebeneinander angeordnet sind, sowie ei
nem umlaufenden Rahmen 5, vorzugsweise aus Kupfer, welcher
mittels einer Kleberschicht 6 auf der Trägerschicht 1 aufge
klebt ist.
Der Rahmen 5 begrenzt seitlich nach außen eine Vergießmasse
7 aus Harz, welche in bekannter Weise zum Eingießen der Chips
3, 4 dient. Weiterhin erhöht der Rahmen 5 die Stabilität des
Chipmoduls.
Der zweite Chip 3, bei dem es sich beispielsweise um einen
Mikrocontroller-Chip handeln kann, ist in eine rechteckige
Vertiefung 8 eingesetzt, welche durch einen entsprechenden
freigestanzten Bereich innerhalb der Trägerschicht 1 gebildet
wird und geringfügig größer als der zweite Chip 3 ist. Der
zweite Chip 3 liegt somit auf der Metallauflage 2 auf und ist
dort mittels einer Kleberschicht 9 festgeklebt. Der erste
Chip 4 ist dagegen auf der Oberseite der Trägerschicht 1 mit
tels einer Kleberschicht 10 festgeklebt. Der zweite Chip 3
liegt somit auf einer tieferen Ebene als der erste Chip 4,
wobei die Höhendifferenz der Dicke der Trägerschicht 1 ent
spricht. Durch dieses Tiefersetzen des zweiten Chips 3 ist es
möglich, die Schleifenhöhe eines Anschlußdrähtchens 11, mit
dem der erste Chip 4 und der zweite Chip 3 miteinander ver
bunden sind, relativ niedrig zu halten, so daß eine maximale
Moduldicke von 0,6 mm auch bei Anwendung von automatisierten
Massenproduktions-Kontaktierungstechniken wie der "Wedge on
bump"-Technik ohne weiteres eingehalten werden kann.
Die Metallauflage 2, welche sich auf der den Chips 3, 4 ge
genüberliegenden Seite der Trägerschicht 1 befindet, ist in
einzelne, voneinander isolierte ISO-Kontaktflächen C1-C8 un
terteilt. Die isolierenden, freigeätzten Zwischenräume sind
mit dem Bezugszeichen 12 bezeichnet. Wie aus Fig. 1 ersicht
lich, befinden sich die ISO-Kontaktflächen C1 und C2 auf der
einen Seite des zweiten Chips 3, während sich die
ISO-Kontaktflächen C5 und C6 auf der gegenüberliegenden Seite des
zweiten Chips 3 befinden. Die ISO-Kontaktflächen C3 und C4
befinden sich im wesentlichen auf der einen Seite des ersten
Chips 4, während sich die ISO-Kontaktflächen C7 und C8 auf
der gegenüberliegenden Seite des ersten Chips 4 befinden. Die
beiden Chips 3, 4 sind hierbei etwa mittig auf dem Chipmodul
angeordnet.
Im Bereich einer jeden ISO-Kontaktfläche C1-C8 weist die Trä
gerschicht 1 ein Durchgangsloch 13-20 auf, um Anschlußdräht
chen 21-26 von den jeweiligen Anschlußkontakten auf den Chips
3, 4 hindurchführen und mit den jeweiligen ISO-Kontaktflächen
C1-C8 kontaktieren zu können. Wie ersichtlich, müssen nicht
immer sämtliche ISO-Kontaktflächen C1-C8 angeschlossen sein.
Bei dem in Fig. 1 gezeigten Chipmodul sind beispielsweise
die ISO-Kontaktflächen C4, C6 und C8 nicht angeschlossen.
Bei dem Ausführungsbeispiel von Fig. 1 sind die beiden rech
ten Anschlußkontakte (Bondpads) des zweiten Chips 3 über die
Anschlußdrähtchen 21, 22, 23 mit den ISO-Kontaktflächen C1,
C2, C3 verbunden. Einer der beiden linken Anschlußkontakte
des zweiten Chips 3 ist über das Anschlußdrähtchen 25 mit der
ISO-Kontaktfläche C5 verbunden. Der weitere linke Anschluß
kontakt des zweiten Chips 3 ist über das Anschlußdrähtchen 11
mit einem von drei linken Anschlußkontakten des ersten Chips
4 verbunden. Der zweite Anschlußkontakt der drei linken An
schlußkontakte des ersten Chips 4 ist über das Anschlußdräht
chen 26 mit der ISO-Kontaktfläche C7 verbunden. Weiterhin ist
einer der drei rechten Anschlußkontakte des ersten Chips 4
über das Anschlußdrähtchen 24 mit der ISO-Kontaktfläche C3
verbunden.
Im gezeigten Ausführungsbeispiel ist es noch erforderlich,
drei weitere Anschlußkontakte des ersten Chips 4 mit entspre
chenden Kontaktflächen elektrisch zu verbinden, nämlich den
GND-Anschlußkontakt mit der ISO-Kontaktfläche C5, den
RST-Anschlußkontakt mit der ISO-Kontaktfläche C2 und den
VCC-Anschlußkontakt mit der ISO-Kontaktfläche C1. Um zu vermei
den, daß die entsprechenden Anschlußdrähtchen 27, 28 bzw. 29
andere Anschlußdrähtchen, nämlich die Anschlußdrähtchen 26,
22, 23, 24, kreuzen, sind Zusatzkontaktflächen Z5, Z2, Z1,
vorgesehen, welche über neben dem oder unterhalb des zweiten
Chips 3 verlaufende Leiterbahnen mit den dazugehörigen
ISO-Kontaktflächen C5, C1, C2 verbunden und im Bereich neben dem
ersten Chip 4 angeordnet sind.
Wie aus Fig. 1 ersichtlich, weist die Trägerschicht 1 unter
halb des Anschlußdrähtchens 26 und seitlich neben dem
GND-Anschlußkontakt des ersten Chips 4 ein Durchgangsloch 30 auf,
durch welches das Anschlußdrähtchen 27 hindurchgeführt und
mit der darunterliegenden Zusatzkontaktfläche Z5 kontaktiert
werden kann. Im Bereich der Zusatzkontaktfläche Z2 weist die
Trägerschicht 1 ein Durchgangsloch 31 auf, welches zwischen
dem ersten Chip 4 und dem Durchgangsloch 15 der
ISO-Kontaktfläche C3 liegt. Durch dieses Durchgangsloch 35 kann
das Anschlußdrähtchen 28 hindurchgeführt und mit der Zusatz
kontaktfläche Z2 kontaktiert werden. Im Bereich zwischen dem
VCC-Anschlußkontakt des ersten Chips 4 und dem Durchgangsloch
16 der ISO-Kontaktfläche C4 weist die Trägerschicht 1 ein
Durchgangsloch 32 auf, durch welches das Anschlußdrähtchen 29
hindurchgeführt wird, um mit der Zusatzkontaktfläche Z1 kon
taktiert zu werden.
Für die Zusatzkontaktflächen Z1, Z2, Z5 ist es somit charak
teristisch, daß sie sich im chipnahen Bereich zwischen den
Durchgangslöchern 13-20 der ISO-Kontaktflächen C1-C8 befin
den, jeweils nur mit einer ISO-Kontaktfläche C1-C8 in elek
trischer Verbindung stehen und bis in die Nähe des jeweiligen
Anschlußkontakts des ersten Chips 4 geführt sind, mit denen
sie zu kontaktieren sind. Hierdurch kann vermieden werden,
daß die zu den Zusatzkontaktflächen Z1, Z2, Z5 geführten An
schlußdrähtchen 29, 28 bzw. 27 mit anderen Anschlußdrähtchen
21-26 kreuzen und beim automatischen Drahtkontaktieren ei
nen elektrischen Kurzschluß verursachen. Ein weiterer Vorteil
liegt darin, daß die Anschlußdrähtchen 27-29 relativ kurz ge
halten werden können, was sich positiv auf die Zuverlässig
keit des Chipmoduls auswirkt.
1
Trägerschicht
2
Metallauflage
3
zweiter Chip
4
erster Chip
5
Rahmen
6
Kleberschicht
7
Vergießmasse
8
Vertiefung
9
Kleberschicht
10
Kleberschicht
11
Anschlußdrähtchen
12
Zwischenräume
13-20
Durchgangslöcher
21-29
Anschlußdrähtchen
30-32
Durchgangslöcher
Claims (4)
1. Chipmodul, insbesondere für kontaktbehaftete Chipkarten,
bestehend aus einem Trägerband mit einer Trägerschicht (1)
aus nichtleitendem Material, die einseitig mit einer leiten
den Metallauflage (2) versehen ist, welche in voneinander
isolierte Kontaktflächen (C1-C8) unterteilt ist, und aus min
destens zwei Chips (3, 4) , die nebeneinander auf dem Träger
band befestigt und mittels Anschlußdrähtchen (21-29, 11) so
wohl mit zugeordneten Kontaktflächen (C1-C8; Z1, Z2, Z5) als
auch miteinander elektrisch leitend verbunden sind, wobei ein
erster Chip (4) auf der Trägerschicht (1) befestigt ist, da
durch gekennzeichnet, daß ein neben dem ersten Chip (4) ange
ordneter zweiter Chip (3) innerhalb einer in der Träger
schicht (1) vorgesehenen Vertiefung (8) eingesetzt ist, so
daß der erste und zweite Chip (4, 3) in unterschiedlichen Hö
henlagen angeordnet sind.
2. Chipmodul nach Anspruch 1, dadurch gekennzeichnet, daß
sich die Vertiefung (8) bis zur leitenden Metallauflage (2)
hinab erstreckt.
3. Chipmodul nach Anspruch 1 oder 2, dadurch gekennzeichnet,
daß die voneinander isolierten Kontaktflächen der leitenden
Metallauflage (2) sowohl ISO-Kontaktflächen (C1-C8) als auch
damit elektrisch verbundene Zusatzkontaktflächen (Z1, Z2, Z5)
aufweisen, die sich zumindest bis in die Nähe eines Chips (4)
erstrecken.
4. Chipmodul nach Anspruch 3, dadurch gekennzeichnet, daß die
Trägerschicht (1) im Bereich der Zusatzkontaktflächen (Z1,
Z2, Z5) Durchgangslöcher (32, 31, 30) zum Durchführen von An
schlußdrähtchen (29, 28, 27) und Kontaktieren derselben an
den Zusatzkontaktflächen (Z1, Z2, Z5) aufweist.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE1997135170 DE19735170A1 (de) | 1997-08-13 | 1997-08-13 | Chipmodul, insbesondere für kontaktbehaftete Chipkarten, mit nebeneinander angeordneten Chips |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE1997135170 DE19735170A1 (de) | 1997-08-13 | 1997-08-13 | Chipmodul, insbesondere für kontaktbehaftete Chipkarten, mit nebeneinander angeordneten Chips |
Publications (1)
Publication Number | Publication Date |
---|---|
DE19735170A1 true DE19735170A1 (de) | 1998-09-10 |
Family
ID=7838905
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE1997135170 Ceased DE19735170A1 (de) | 1997-08-13 | 1997-08-13 | Chipmodul, insbesondere für kontaktbehaftete Chipkarten, mit nebeneinander angeordneten Chips |
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