DE1126513B - Verfahren zur Bearbeitung von Halbleiteranordnungen - Google Patents
Verfahren zur Bearbeitung von HalbleiteranordnungenInfo
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Description
DEUTSCHES
PATENTAMT
116774 Vmc/21g
BEKANNTMACHUNG
DER ANMELDUNG
UNDAUSGABE DER
AUSLEGESCHRIFT: 29. MÄRZ 1962
Die Erfindung betrifft ein Verfahren zur Bearbeitung
von Halbleiteranordnungen, insbesondere von Germaniumtransistoren und -dioden, mit einem
Halbleiterkörper eines bestimmten Leitfähigkeitstyps, mit mindestens einem pn-übergang und
an dem Halbleiterkörper angebrachten Elektroden sowie Zuführungsdrähten zu den Elektroden, die
anschließend an die Herstellung geätzt und gespült werden.
Es ist üblich, Halbleiteranordnungen während ihrer Herstellung verschiedenen Ätzbehandlungen zu unterwerfen,
vorwiegend um die Oberfläche des eigentlichen Halbleiterkörpers zu reinigen. Zu diesem
Zweck ist z. B. auch die Verwendung eines aus Flußsäure und Wasserstoffsuperoxyd bestehenden Ätzmittels
bekannt. Es ist weiterhin bekannt, die mit Elektroden und Zuleitungen versehenen Halbleiteranordnungen
zur Stabilisierung der Oberflächenverhältnisse nochmals einer chemischen oder elektrolytischen
Ätzbehandlung auszusetzen. Die damit erzielte Verbesserung der Stabilität reicht jedoch für
hochwertige Halbleiterbauelemente noch nicht aus. Zur weiteren Verbesserung der elektrischen Eigenschaften
ist bekanntgeworden, die Halbleiteranordnung während des Betriebes in einer Atmosphäre aus
Halogendämpfen unterzubringen. Die Herstellung solcher Halbleiterbauelemente ist jedoch sehr aufwendig,
da vakuumdichte Hüllen benötigt werden. Zudem sind sie stark temperaturabhängig, da eine
gasförmige Atmosphäre auf Temperaturschwankungen empfindlich reagiert.
Nach der Erfindung werden die Mängel der mit den bekannten Maßnahmen behandelten Halbleiteranordnungen
weitgehend beseitigt und verbesserte Germaniumtransistoren und -dioden geschaffen. Das
Verfahren nach der Erfindung ermöglicht ferner die Herstellung von Germaniumtransistoren, bei denen
die Leistungs- und Stromverstärkung sowie ihre Stabilität erhöht ist. Weiterhin soll der Sättigungsstrom bei Germaniumtransistoren und -dioden herab-
gesetzt werden. Das bekannte Verfahren wird erfindungsgemäß dadurch verbessert, daß die nach Beendigung
des Ätzens und Spülens an sich gebrauchsfertige Halbleiteranordnung einer weiteren Bearbeitung
durch Eintauchen in eine erhitzte Lösung von Wasserstoffsuperoxyd und anschließender Spülung
unterworfen wird.
Die Durchführung des Verfahrens nach der Erfindung, ihre Wirkungsweise, Vorteile und weiteren
über das Bekannte hinausgehenden Merkmale werden im folgenden an Hand der Zeichnung, welche schematisch
die einzelnen Verfahrensmaßnahmen bei der Verfahren zur Bearbeitung von Halbleiteranordnungen
Anmelder: Intermetall Gesellschaft für Metallurgie
und Elektronik m.b.H., Freiburg (Breisgau), Hans-Bunte-Str. 19
Beanspruchte Priorität: V. St. v. Amerika vom 19. August 1958 (Nr. 755 939)
Daniel I. Pomerantz, Lexington, Mass.,
und Lawrence Favro, New York, N. Y. (V. St. A,), sind als Erfinder genannt worden
Herstellung eines Germaniumtransistors darstellt, näher erläutert.
Wie aus der Zeichnung zu ersehen ist, sind die Hauptverfahrensmaßnahmen folgende:
1. Herstellung der Transistoranordnung,
2. Ätzen der Anordnung,
3. Spülung,
4. Bearbeitung der Transistoranordnung,
5. Spülung.
Die Maßnahmen 1, 2 und 3 sind an sich bekannt und können nach irgendeiner bekannten Technik oder
nach dem anschließend beschriebenen Verfahren ausgeführt werden. Diese bekannten Maßnahmen werden
im folgenden kurz am Beispiel eines Germanium-Flächentransistors des Legierungstyps erläutert. Bei
der Herstellung einer Transistoranordnung dieses Typs wird ein kleines Plättchen aus einem Germanium-Einkristall
geschnitten. Es wird in geeigneter Weise mit einer Donator- oder Akzeptorverunreinigung
dotiert, um den gewünschten Leitfähigkeitstyp, beispielsweise η-Typ oder p-Typ, zu erhalten. Die
pn-Übergänge in dem Germaniumkörper werden durch Einlegieren einer Emitter- und einer Kollektorschicht
an den entgegengesetzten Seiten der Plättchenoberfläche erhalten. Es werden dazu Pillen eines
Materials verwendet, welches bei der Legierung mit dem Halbleiterplättchen Zonen eines Leitfähigkeitstyps erzeugt, der entgegengesetzt zu dem des Plättchens
ist. Zwischen den Zonen entgegengesetzter Leitfähigkeit, beispielsweise zwischen der p-Zone und
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der η-Zone, bildet sich ein gleichrichtender pn-übergang, der auch Sperrschicht genannt wird. Im Falle
einer Diode wird nur ein gleichrichtender Übergang gebildet.
Nachdem die genannten pn-Übergänge als Emitter und Kollektor hergestellt sind, wird eine nicht gleichrichtende
Elektrode als Basiselektrode auf das HaIbleiterplättchen aufgebracht. Geeignete Zuführungsdrähte werden dann mit der Emitter-, der Kollektor-
Eine 2minutige Spülung in einer 35°/oigen Lösung nahe ihrem Siedepunkt hat sich als besonders vorteilhaft erwiesen, da die Lösung genügend stabil ist und
relativ leicht gehandhabt werden kann. Außerdem ist S die Zeit und Temperatur für eine wirtschaftliche Fertigung
geeignet, so daß dadurch keine Schwierigkeiten entstehen.
Dann werden der Transistor oder die Diode in kaltem, enthärtetem Wasser gespült, wonach sie für
und der Basiszone bzw. deren Elektroden verbunden. io die Montage und Einbringung in Gehäuse geeignet
Es ist auch bekannt, die Zuführungsdrähte in das sind.
Halbleiterplättchen so einzulegieren, daß gleichzeitig Transistoren, die der verbesserten Bearbeitung geeine
Übergangszone und die Befestigung des Zu- maß der Erfindung unterworfen worden sind, zeichführungsdrahtes
erhalten wird. Die vorstehende Be- nen sich durch eine erhöhte Strom- und Leistungsschreibung über die Herstellung eines Transistors ist 15 verstärkung aus und die letztere 2 bis 6 db betragen
selbstverständlich nur als Beispiel gedacht. Es sind kann. Ferner haben Lebensdauerversuche bei erhöhten
Temperaturen eine größere Stabilität ergeben. So weist beispielsweise die Abnahme der Leistungsverstärkung nach 500 Stunden bei 90° C einen mitt-20
leren Wert von 4 db für nicht zusätzlich bearbeitete Anordnungen gegenüber einem Mittelwert von etwa
1 db für bearbeitete Anordnungen auf. Außerdem wurde sowohl bei Transistoren als auch bei Dioden,
die nach der Erfindung bearbeitet worden sind, be-
ebensogut auch alle anderen Techniken für die Herstellung von Transistoren oder Dioden ohne Rücksicht
auf irgendwelche Einzelheiten bei der Fabrikation oder Konstruktion brauchbar.
Anschließend an die erste Verfahrensmaßnahme wird der Transistor irgendeinem geeigneten Ätzprozeß
unterworfen. Dieser Ätzprozeß kann rein chemischer Natur sein. Es ist aber auch eine elektrochemische
Ätztechnik, die als elektrolytische Ätzung bekannt 25 obachtet, daß sie einen geringeren Sättigungsstrom
ist, möglich. Bei der elektrolytischen Ätzung wird die Oberfläche des Halbleiterplättchens mit einem ätzenden
Elektrolyten in Kontakt gebracht und ein Potentialgefälle quer zum pn-übergang angelegt. Der
Kontakt der Plättchenoberfläche mit dem Ätzmittel kann durch Eintauchen des Plättchens in die Ätzflüssigkeit
oder durch Richten eines Stromes der Ätzflüssigkeit gegen die Plättchenoberfläche erreicht
werden.
Anschließend an das Ätzen wird die Halbleiteranordnung vorwiegend in heißem, enthärtetem Wasser
gespült, um den Ätzelektrolyten und sonstige Rückstände, die sich auf der Plättchenoberfläche gebildet
haben, zu entfernen. Wie bereits oben erwähnt, sind die bisher beschriebenen Verfahrensmaßnahmen an
sich bekannt. Nach ihrer Durchführung wird der Transistor gewöhnlich als geeignet für die Montage
und die Einkapselung angesehen.
Nach der Erfindung wird der Transistor oder die Diode in diesem Stadium einer weiteren Verbesserungsbearbeitung
unterworfen, welche das Eintauchen der Halbleiteranordnung in eine erhitzte Lösung von
Wasserstoffsuperoxyd vorsieht. Die Konzentration der Lösung, ihre Temperatur und die Dauer der Spülung
sind voneinander abhängige Parameter des Bearbeitungsprozesses. Es wurde gefunden, daß sehr
gute Ergebnisse mit einer 35%igen wäßrigen Lösung von Wasserstoffsuperoxyd erhalten werden, wenn
diese bis in die Nähe ihres Siedepunktes (105° C) erhitzt
wird und die Eintauchzeit etwa 2 Minuten betragt. Lösungskonzentrationen und Temperaturen
unter 5 % bzw. 50° C sind brauchbar, aber erfordern erhöhte Eintauchzeiten. Bei höheren Temperaturen
oder Konzentrationen werden kürzere Eintauchzeiten zulässig. Die obere Grenze der Lösungskonzentration
liegt bei etwa 70%, da Lösungen mit stärkerer Konzentration sehr reaktionsfähig und schwer zu handhaben
sind.
besitzen. Das Entstehen von leitenden Oberflächenkanälen wie bei den nicht bearbeiteten Halbleiteranordnungen
wurde nicht festgestellt.
Claims (3)
1. Verfahren zur Bearbeitung von Halbleiteranordnungen, insbesondere von Germaniumtransistoren
und -dioden, mit einem Halbleiterkörper eines bestimmten Leitfähigkeitstyps, mit
mindestens einem pn-übergang und an dem Halbleiterkörper angebrachten Elektroden sowie Zuführungsdrähten
zu den Elektroden, die anschließend an die Herstellung geätzt und gespült werden, dadurch gekennzeichnet, daß die nach
Beendigung des Ätzens und Spülens an sich gebrauchsfertige Halbleiteranordnung einer weiteren
Bearbeitung durch Eintauchen in eine erhitzte Lösung von Wasserstoffsuperoxyd und anschließender Spülung unterworfen wird.
2. Verfahren nach Anspruch 1, dadurch gekennzeichnet, daß die weitere Bearbeitung der
Halbleiteranordnung in einer 5- bis 7O°/oigen wäßrigen Lösung von Wasserstoffsuperoxyd bei Temperaturen
von 50 bis 150° C vorgenommen wird.
3. Verfahren nach Anspruch!, dadurch gekennzeichnet, daß die weitere Bearbeitung der
Halbleiteranordnungen während einer Zeitdauer von etwa 2 Minuten in einer 35%igen bis zum
Siedepunkt erhitzten Lösung von Wasserstoffsuperoxyd durch Eintauchen vorgenommen wird
und anschließend in kaltem, enthärtetem Wasser gespült wird.
In Betracht gezogene Druckschriften: Deutsche Auslegeschrift Nr. 1001077;
österreichische Patentschrift Nr. 199 226; Journ. of appl. Physics, Vol. 25, 1954,
S. 634 bis 641.
Nr. 5,
Hierzu 1 Blatt Zeichnungen
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---|---|---|---|
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Publications (1)
Publication Number | Publication Date |
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Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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DE (1) | DE1126513B (de) |
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GB (1) | GB903026A (de) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE1269738B (de) * | 1964-10-20 | 1968-06-06 | Telefunken Patent | Verfahren zur Stabilisierung von Halbleiterbauelementen |
Families Citing this family (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3242551A (en) * | 1963-06-04 | 1966-03-29 | Gen Electric | Semiconductor switch |
BE655566A (de) * | 1963-11-12 | |||
US3377263A (en) * | 1964-09-14 | 1968-04-09 | Philco Ford Corp | Electrical system for etching a tunnel diode |
US3409979A (en) * | 1965-02-02 | 1968-11-12 | Int Standard Electric Corp | Method for the surface treatment of semiconductor devices |
US3385682A (en) * | 1965-04-29 | 1968-05-28 | Sprague Electric Co | Method and reagent for surface polishing |
US3383319A (en) * | 1965-10-22 | 1968-05-14 | Motorola Inc | Cleaning of semiconductor devices |
JPH084063B2 (ja) * | 1986-12-17 | 1996-01-17 | 富士通株式会社 | 半導体基板の保存方法 |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE1001077B (de) * | 1954-07-14 | 1957-01-17 | Telefunken Gmbh | Verfahren und Anordnung zum elektrolytischen AEtzen von Halbleiterkoerpern oder -systemen |
AT199226B (de) * | 1956-02-29 | 1958-08-25 | Philips Nv | Verfahren zur Herstellung eines halbleitenden Elektrodensystems |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US2530110A (en) * | 1944-06-02 | 1950-11-14 | Sperry Corp | Nonlinear circuit device utilizing germanium |
US2650311A (en) * | 1950-10-26 | 1953-08-25 | Purdue Research Foundation | Radiant energy detecting method and apparatus |
BE546710A (de) * | 1955-06-08 | 1900-01-01 | ||
US2847623A (en) * | 1955-07-27 | 1958-08-12 | Texas Instruments Inc | Full wave rectifier structure and method of preparing same |
BE551335A (de) * | 1955-09-29 |
-
1959
- 1959-07-24 DE DEI16774A patent/DE1126513B/de active Pending
- 1959-08-10 GB GB27238/59A patent/GB903026A/en not_active Expired
- 1959-08-19 FR FR803129A patent/FR1232845A/fr not_active Expired
-
1962
- 1962-09-04 US US221672A patent/US3103733A/en not_active Expired - Lifetime
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE1001077B (de) * | 1954-07-14 | 1957-01-17 | Telefunken Gmbh | Verfahren und Anordnung zum elektrolytischen AEtzen von Halbleiterkoerpern oder -systemen |
AT199226B (de) * | 1956-02-29 | 1958-08-25 | Philips Nv | Verfahren zur Herstellung eines halbleitenden Elektrodensystems |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE1269738B (de) * | 1964-10-20 | 1968-06-06 | Telefunken Patent | Verfahren zur Stabilisierung von Halbleiterbauelementen |
Also Published As
Publication number | Publication date |
---|---|
FR1232845A (fr) | 1960-10-12 |
GB903026A (en) | 1962-08-09 |
US3103733A (en) | 1963-09-17 |
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