DE102020126167A1 - Feldeffekttransistoren mit kanalbereichen, die ein zweidimensionales material umfassen, auf einem mandrel - Google Patents
Feldeffekttransistoren mit kanalbereichen, die ein zweidimensionales material umfassen, auf einem mandrel Download PDFInfo
- Publication number
- DE102020126167A1 DE102020126167A1 DE102020126167.5A DE102020126167A DE102020126167A1 DE 102020126167 A1 DE102020126167 A1 DE 102020126167A1 DE 102020126167 A DE102020126167 A DE 102020126167A DE 102020126167 A1 DE102020126167 A1 DE 102020126167A1
- Authority
- DE
- Germany
- Prior art keywords
- channel layer
- mandrel
- channel
- region
- layer
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 239000000463 material Substances 0.000 title claims abstract description 75
- 230000005669 field effect Effects 0.000 title claims abstract description 24
- 238000000034 method Methods 0.000 claims abstract description 54
- 239000003989 dielectric material Substances 0.000 claims abstract description 20
- 125000006850 spacer group Chemical group 0.000 claims description 29
- 229910052723 transition metal Inorganic materials 0.000 claims description 4
- 150000003624 transition metals Chemical class 0.000 claims description 4
- 239000002019 doping agent Substances 0.000 claims description 3
- ROUIDRHELGULJS-UHFFFAOYSA-N bis(selanylidene)tungsten Chemical compound [Se]=[W]=[Se] ROUIDRHELGULJS-UHFFFAOYSA-N 0.000 claims description 2
- NRJVMVHUISHHQB-UHFFFAOYSA-N hafnium(4+);disulfide Chemical compound [S-2].[S-2].[Hf+4] NRJVMVHUISHHQB-UHFFFAOYSA-N 0.000 claims description 2
- CWQXQMHSOZUFJS-UHFFFAOYSA-N molybdenum disulfide Chemical compound S=[Mo]=S CWQXQMHSOZUFJS-UHFFFAOYSA-N 0.000 claims description 2
- 229910052982 molybdenum disulfide Inorganic materials 0.000 claims description 2
- AFNRRBXCCXDRPS-UHFFFAOYSA-N tin(ii) sulfide Chemical compound [Sn]=S AFNRRBXCCXDRPS-UHFFFAOYSA-N 0.000 claims description 2
- ITRNXVSDJBHYNJ-UHFFFAOYSA-N tungsten disulfide Chemical compound S=[W]=S ITRNXVSDJBHYNJ-UHFFFAOYSA-N 0.000 claims description 2
- 230000008878 coupling Effects 0.000 claims 1
- 238000010168 coupling process Methods 0.000 claims 1
- 238000005859 coupling reaction Methods 0.000 claims 1
- XWPGCGMKBKONAU-UHFFFAOYSA-N zirconium(4+);disulfide Chemical compound [S-2].[S-2].[Zr+4] XWPGCGMKBKONAU-UHFFFAOYSA-N 0.000 claims 1
- 239000010410 layer Substances 0.000 description 175
- 230000008569 process Effects 0.000 description 43
- 238000005530 etching Methods 0.000 description 32
- 239000002135 nanosheet Substances 0.000 description 32
- 238000004519 manufacturing process Methods 0.000 description 16
- 239000004065 semiconductor Substances 0.000 description 14
- 239000000758 substrate Substances 0.000 description 10
- 238000000151 deposition Methods 0.000 description 9
- 239000011229 interlayer Substances 0.000 description 7
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 6
- 239000013078 crystal Substances 0.000 description 6
- 229910052751 metal Inorganic materials 0.000 description 6
- 239000002184 metal Substances 0.000 description 6
- 229910052581 Si3N4 Inorganic materials 0.000 description 5
- 230000015572 biosynthetic process Effects 0.000 description 5
- 239000002131 composite material Substances 0.000 description 5
- 230000008021 deposition Effects 0.000 description 5
- 229910052732 germanium Inorganic materials 0.000 description 5
- GNPVGFCGXDBREM-UHFFFAOYSA-N germanium atom Chemical compound [Ge] GNPVGFCGXDBREM-UHFFFAOYSA-N 0.000 description 5
- 238000002955 isolation Methods 0.000 description 5
- 238000001020 plasma etching Methods 0.000 description 5
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 5
- 238000005229 chemical vapour deposition Methods 0.000 description 4
- 239000000203 mixture Substances 0.000 description 4
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 3
- NRTOMJZYCJJWKI-UHFFFAOYSA-N Titanium nitride Chemical compound [Ti]#N NRTOMJZYCJJWKI-UHFFFAOYSA-N 0.000 description 3
- LEVVHYCKPQWKOP-UHFFFAOYSA-N [Si].[Ge] Chemical compound [Si].[Ge] LEVVHYCKPQWKOP-UHFFFAOYSA-N 0.000 description 3
- 238000000231 atomic layer deposition Methods 0.000 description 3
- 238000001459 lithography Methods 0.000 description 3
- 229910021421 monocrystalline silicon Inorganic materials 0.000 description 3
- 238000003672 processing method Methods 0.000 description 3
- 229910052710 silicon Inorganic materials 0.000 description 3
- 239000010703 silicon Substances 0.000 description 3
- 235000012239 silicon dioxide Nutrition 0.000 description 3
- 239000000377 silicon dioxide Substances 0.000 description 3
- 229910000577 Silicon-germanium Inorganic materials 0.000 description 2
- 239000007795 chemical reaction product Substances 0.000 description 2
- 230000003247 decreasing effect Effects 0.000 description 2
- 230000006872 improvement Effects 0.000 description 2
- 238000005498 polishing Methods 0.000 description 2
- 239000000047 product Substances 0.000 description 2
- 239000011669 selenium Substances 0.000 description 2
- 239000002356 single layer Substances 0.000 description 2
- 239000000126 substance Substances 0.000 description 2
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 2
- 229910052721 tungsten Inorganic materials 0.000 description 2
- 239000010937 tungsten Substances 0.000 description 2
- OKTJSMMVPCPJKN-UHFFFAOYSA-N Carbon Chemical compound [C] OKTJSMMVPCPJKN-UHFFFAOYSA-N 0.000 description 1
- ZOKXTWBITQBERF-UHFFFAOYSA-N Molybdenum Chemical compound [Mo] ZOKXTWBITQBERF-UHFFFAOYSA-N 0.000 description 1
- BUGBHKTXTAQXES-UHFFFAOYSA-N Selenium Chemical compound [Se] BUGBHKTXTAQXES-UHFFFAOYSA-N 0.000 description 1
- NINIDFKCEFEMDL-UHFFFAOYSA-N Sulfur Chemical compound [S] NINIDFKCEFEMDL-UHFFFAOYSA-N 0.000 description 1
- GWEVSGVZZGPLCZ-UHFFFAOYSA-N Titan oxide Chemical compound O=[Ti]=O GWEVSGVZZGPLCZ-UHFFFAOYSA-N 0.000 description 1
- UQZIWOQVLUASCR-UHFFFAOYSA-N alumane;titanium Chemical compound [AlH3].[Ti] UQZIWOQVLUASCR-UHFFFAOYSA-N 0.000 description 1
- 229910021417 amorphous silicon Inorganic materials 0.000 description 1
- 238000000137 annealing Methods 0.000 description 1
- 125000004429 atom Chemical group 0.000 description 1
- 238000000277 atomic layer chemical vapour deposition Methods 0.000 description 1
- 230000004888 barrier function Effects 0.000 description 1
- 238000005452 bending Methods 0.000 description 1
- 239000000969 carrier Substances 0.000 description 1
- 150000001787 chalcogens Chemical group 0.000 description 1
- 239000011248 coating agent Substances 0.000 description 1
- 238000000576 coating method Methods 0.000 description 1
- 230000001419 dependent effect Effects 0.000 description 1
- 238000001312 dry etching Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 230000006870 function Effects 0.000 description 1
- DWRNSCDYNYYYHT-UHFFFAOYSA-K gallium(iii) iodide Chemical compound I[Ga](I)I DWRNSCDYNYYYHT-UHFFFAOYSA-K 0.000 description 1
- 239000007789 gas Substances 0.000 description 1
- 229910021389 graphene Inorganic materials 0.000 description 1
- 229910000449 hafnium oxide Inorganic materials 0.000 description 1
- WIHZLLGSGQNAGK-UHFFFAOYSA-N hafnium(4+);oxygen(2-) Chemical compound [O-2].[O-2].[Hf+4] WIHZLLGSGQNAGK-UHFFFAOYSA-N 0.000 description 1
- 229910052739 hydrogen Inorganic materials 0.000 description 1
- 239000001257 hydrogen Substances 0.000 description 1
- 125000004435 hydrogen atom Chemical class [H]* 0.000 description 1
- 239000013067 intermediate product Substances 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 229910052750 molybdenum Inorganic materials 0.000 description 1
- 239000011733 molybdenum Substances 0.000 description 1
- QKCGXXHCELUCKW-UHFFFAOYSA-N n-[4-[4-(dinaphthalen-2-ylamino)phenyl]phenyl]-n-naphthalen-2-ylnaphthalen-2-amine Chemical compound C1=CC=CC2=CC(N(C=3C=CC(=CC=3)C=3C=CC(=CC=3)N(C=3C=C4C=CC=CC4=CC=3)C=3C=C4C=CC=CC4=CC=3)C3=CC4=CC=CC=C4C=C3)=CC=C21 QKCGXXHCELUCKW-UHFFFAOYSA-N 0.000 description 1
- 230000007935 neutral effect Effects 0.000 description 1
- 238000012856 packing Methods 0.000 description 1
- 230000000704 physical effect Effects 0.000 description 1
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 1
- 229920005591 polysilicon Polymers 0.000 description 1
- 239000000376 reactant Substances 0.000 description 1
- 230000009467 reduction Effects 0.000 description 1
- 229910052711 selenium Inorganic materials 0.000 description 1
- 238000005389 semiconductor device fabrication Methods 0.000 description 1
- 229910021332 silicide Inorganic materials 0.000 description 1
- FVBUAEGBCNSCDD-UHFFFAOYSA-N silicide(4-) Chemical compound [Si-4] FVBUAEGBCNSCDD-UHFFFAOYSA-N 0.000 description 1
- 229910052717 sulfur Inorganic materials 0.000 description 1
- 239000011593 sulfur Substances 0.000 description 1
- 229910052714 tellurium Inorganic materials 0.000 description 1
- PORWMNRCUJJQNO-UHFFFAOYSA-N tellurium atom Chemical compound [Te] PORWMNRCUJJQNO-UHFFFAOYSA-N 0.000 description 1
- 239000010409 thin film Substances 0.000 description 1
- OGIDPMRJRNCKJF-UHFFFAOYSA-N titanium oxide Inorganic materials [Ti]=O OGIDPMRJRNCKJF-UHFFFAOYSA-N 0.000 description 1
- 230000007704 transition Effects 0.000 description 1
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/78—Field effect transistors with field effect produced by an insulated gate
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/778—Field effect transistors with two-dimensional charge carrier gas channel, e.g. HEMT ; with two-dimensional charge-carrier layer formed at a heterojunction interface
- H01L29/7789—Field effect transistors with two-dimensional charge carrier gas channel, e.g. HEMT ; with two-dimensional charge-carrier layer formed at a heterojunction interface the two-dimensional charge carrier gas being at least partially not parallel to a main surface of the semiconductor body
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02518—Deposited layers
- H01L21/02521—Materials
- H01L21/02568—Chalcogenide semiconducting materials not being oxides, e.g. ternary compounds
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02518—Deposited layers
- H01L21/02587—Structure
- H01L21/0259—Microstructure
- H01L21/02603—Nanowires
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/77—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate
- H01L21/78—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices
- H01L21/82—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices to produce devices, e.g. integrated circuits, each consisting of a plurality of components
- H01L21/822—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices to produce devices, e.g. integrated circuits, each consisting of a plurality of components the substrate being a semiconductor, using silicon technology
- H01L21/8232—Field-effect technology
- H01L21/8234—MIS technology, i.e. integration processes of field effect transistors of the conductor-insulator-semiconductor type
- H01L21/823412—MIS technology, i.e. integration processes of field effect transistors of the conductor-insulator-semiconductor type with a particular manufacturing method of the channel structures, e.g. channel implants, halo or pocket implants, or channel materials
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/06—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
- H01L29/0603—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/06—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
- H01L29/0657—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by the shape of the body
- H01L29/0665—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by the shape of the body the shape of the body defining a nanostructure
- H01L29/0669—Nanowires or nanotubes
- H01L29/0673—Nanowires or nanotubes oriented parallel to a substrate
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/06—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
- H01L29/10—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions with semiconductor regions connected to an electrode not carrying current to be rectified, amplified or switched and such electrode being part of a semiconductor device which comprises three or more electrodes
- H01L29/1025—Channel region of field-effect devices
- H01L29/1029—Channel region of field-effect devices of field-effect transistors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/06—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
- H01L29/10—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions with semiconductor regions connected to an electrode not carrying current to be rectified, amplified or switched and such electrode being part of a semiconductor device which comprises three or more electrodes
- H01L29/1025—Channel region of field-effect devices
- H01L29/1029—Channel region of field-effect devices of field-effect transistors
- H01L29/1033—Channel region of field-effect devices of field-effect transistors with insulated gate, e.g. characterised by the length, the width, the geometric contour or the doping structure
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/06—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
- H01L29/10—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions with semiconductor regions connected to an electrode not carrying current to be rectified, amplified or switched and such electrode being part of a semiconductor device which comprises three or more electrodes
- H01L29/1025—Channel region of field-effect devices
- H01L29/1029—Channel region of field-effect devices of field-effect transistors
- H01L29/1033—Channel region of field-effect devices of field-effect transistors with insulated gate, e.g. characterised by the length, the width, the geometric contour or the doping structure
- H01L29/1037—Channel region of field-effect devices of field-effect transistors with insulated gate, e.g. characterised by the length, the width, the geometric contour or the doping structure and non-planar channel
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/401—Multistep manufacturing processes
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/41—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions
- H01L29/423—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions not carrying the current to be rectified, amplified or switched
- H01L29/42312—Gate electrodes for field effect devices
- H01L29/42316—Gate electrodes for field effect devices for field-effect transistors
- H01L29/4232—Gate electrodes for field effect devices for field-effect transistors with insulated gate
- H01L29/42384—Gate electrodes for field effect devices for field-effect transistors with insulated gate for thin film field effect transistors, e.g. characterised by the thickness or the shape of the insulator or the dimensions, the shape or the lay-out of the conductor
- H01L29/42392—Gate electrodes for field effect devices for field-effect transistors with insulated gate for thin film field effect transistors, e.g. characterised by the thickness or the shape of the insulator or the dimensions, the shape or the lay-out of the conductor fully surrounding the channel, e.g. gate-all-around
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
- H01L29/66227—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
- H01L29/66409—Unipolar field-effect transistors
- H01L29/66431—Unipolar field-effect transistors with a heterojunction interface channel or gate, e.g. HFET, HIGFET, SISFET, HJFET, HEMT
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
- H01L29/66227—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
- H01L29/66409—Unipolar field-effect transistors
- H01L29/66477—Unipolar field-effect transistors with an insulated gate, i.e. MISFET
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
- H01L29/66227—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
- H01L29/66409—Unipolar field-effect transistors
- H01L29/66477—Unipolar field-effect transistors with an insulated gate, i.e. MISFET
- H01L29/66545—Unipolar field-effect transistors with an insulated gate, i.e. MISFET using a dummy, i.e. replacement gate in a process wherein at least a part of the final gate is self aligned to the dummy gate
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
- H01L29/66227—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
- H01L29/66409—Unipolar field-effect transistors
- H01L29/66477—Unipolar field-effect transistors with an insulated gate, i.e. MISFET
- H01L29/66787—Unipolar field-effect transistors with an insulated gate, i.e. MISFET with a gate at the side of the channel
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66969—Multistep manufacturing processes of devices having semiconductor bodies not comprising group 14 or group 13/15 materials
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/778—Field effect transistors with two-dimensional charge carrier gas channel, e.g. HEMT ; with two-dimensional charge-carrier layer formed at a heterojunction interface
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/78—Field effect transistors with field effect produced by an insulated gate
- H01L29/786—Thin film transistors, i.e. transistors with a channel being at least partly a thin film
- H01L29/78606—Thin film transistors, i.e. transistors with a channel being at least partly a thin film with supplementary region or layer in the thin film or in the insulated bulk substrate supporting it for controlling or increasing the safety of the device
- H01L29/78618—Thin film transistors, i.e. transistors with a channel being at least partly a thin film with supplementary region or layer in the thin film or in the insulated bulk substrate supporting it for controlling or increasing the safety of the device characterised by the drain or the source properties, e.g. the doping structure, the composition, the sectional shape or the contact structure
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/78—Field effect transistors with field effect produced by an insulated gate
- H01L29/786—Thin film transistors, i.e. transistors with a channel being at least partly a thin film
- H01L29/78696—Thin film transistors, i.e. transistors with a channel being at least partly a thin film characterised by the structure of the channel, e.g. multichannel, transverse or longitudinal shape, length or width, doping structure, or the overlap or alignment between the channel and the gate, the source or the drain, or the contacting structure of the channel
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/12—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
- H01L29/16—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only elements of Group IV of the Periodic System
- H01L29/1606—Graphene
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/12—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
- H01L29/24—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only semiconductor materials not provided for in groups H01L29/16, H01L29/18, H01L29/20, H01L29/22
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66053—Multistep manufacturing processes of devices having a semiconductor body comprising crystalline silicon carbide
- H01L29/66068—Multistep manufacturing processes of devices having a semiconductor body comprising crystalline silicon carbide the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
Abstract
Strukturen für einen Feldeffekttransistor und Verfahren zum Bilden von Strukturen für einen Feldeffekttransistor. Eine Gate-Elektrode weist einen Abschnitt (43) auf, der um eine erste Seitenoberfläche und eine zweite Seitenoberfläche eines Mandrels (38) gehüllt ist, der aus einem dielektrischen Material zusammengesetzt ist. Eine Kanalschicht (34, 36) weist einen Kanalbereich (70) auf, der teilweise zwischen der ersten Seitenoberfläche des Mandrels (38) und dem Abschnitt (43) der Gate-Elektrode positioniert ist. Die Kanalschicht (34, 36) ist aus einem zweidimensionalen Material zusammengesetzt.
Description
- HINTERGRUND
- Die vorliegende Erfindung betrifft eine Halbleitervorrichtungsfertigung und integrierte Schaltungen und insbesondere Strukturen für einen Feldeffekttransistor und Verfahren zum Bilden einer Struktur für einen Feldeffekttransistor.
- Komplementär-Metall-Oxid-Halbleiter (complementary-metal-oxidesemiconductor; CMOS)-Prozesse können verwendet werden, um p-Typ- und n-Typ-Feldeffekttransistoren zu bauen, die verwendet werden, um beispielsweise Logikzellen aufzubauen. Feldeffekttransistoren umfassen im Allgemeinen einen in einem Halbleiterkörper befindlichen Kanalbereich, eine Source, einen Drain, und eine Gate-Elektrode über dem Körper. Wenn eine Steuerspannung, die eine charakteristische Schwellenspannung überschreitet, an die Gate-Elektrode angelegt wird, tritt ein Trägerfluss in dem Kanalbereich zwischen der Source und dem Drain auf, um einen Vorrichtungsausgangsstrom zu erzeugen.
- Nanosheet-Feldeffekttransistoren repräsentieren einen Typ eines nicht-planaren Feldeffekttransistors, der mit einer erhöhten Packungsdichte in einer integrierten Schaltung gefertigt werden kann. Ein Nanosheet-Feldeffekttransistor umfasst mehrere Nanosheet-Kanalschichten, die in einem strukturierten Schichtstapel über einer oberen Oberfläche eines Substrats angeordnet sind, und Source/Drain-Bereiche, die mit den lateralen Enden der Nanosheet-Kanalschichten verbunden sind. Die Nanosheet-Kanalschichten werden anfänglich in dem strukturierten Schichtstapel mit Opferschichten angeordnet, die ein Material (z.B. Silizium-Germanium) enthalten, das sich mit den Nanosheet-Kanalschichten abwechselt und das selektiv bezüglich des Materials (z.B. Silizium) geätzt werden kann, das die Nanosheet-Kanalschichten darstellt. Die Source/Drain-Bereiche können durch epitaktisches Aufwachsen von Halbleitermaterial von den lateralen Enden der Nanosheet-Kanalschichten gebildet werden. Die Opferschichten werden geätzt und entfernt, um die Nanosheet-Kanalschichten freizugeben und Räume für die Bildung einer Gate-Elektrode bereitzustellen. Abschnitte der Gate-Elektrode können alle Seiten der individuellen Nanosheet-Kanalschichten in einer Gate-All-Around-Anordnung umgeben. Während eines Betriebs mit einer an die Gate-Elektrode angelegten Steuerspannung erzeugt der horizontale Fluss von Trägern in den Nanosheet-Kanalschichten den Vorrichtungsausgangsstrom.
- Bei Nanosheet-Feldeffektransistoren kann es Schwierigkeiten beim Skalieren geben, weil Verringerungen der Nanosheet-Dicke schließlich einen Punkt erreichen, an dem ein Quantum-Confinement die Performance signifikant herabsetzt. Zusätzlich können Short-Channel-Effekte die Fähigkeit begrenzen, damit fortzufahren, die Gate-Länge zu schrumpfen. Als solche können Grenzen bezüglich einer elektrostatischen Steuerung für Nanosheet-Feldeffekttransistoren das Skalieren begrenzen.
- Es werden verbesserte Strukturen für einen Feldeffekttransistor und Verfahren zum Bilden einer Struktur für einen Feldeffekttransistor benötigt.
- KURZER ABRISS
- Bei Ausführungsformen der Erfindung wird eine Struktur für einen Feldeffekttransistor bereitgestellt. Die Struktur umfasst einen Mandrel, der aus einem dielektrischen Material zusammengesetzt ist, und eine Gate-Elektrode, die einen Abschnitt aufweist, der um eine erste Seitenoberfläche und eine zweite Seitenoberfläche des Mandrels gehüllt ist. Die Struktur umfasst ferner eine Kanalschicht, die einen Kanalbereich aufweist, der teilweise zwischen der ersten Seitenoberfläche des Mandrels und dem Abschnitt der Gate-Elektrode positioniert ist. Die Kanalschicht ist aus einem zweidimensionalen Material zusammengesetzt.
- Bei Ausführungsformen der Erfindung wird ein Verfahren zum Bilden eines Feldeffekttransistors bereitgestellt. Das Verfahren umfasst ein Bilden einer Kanalschicht umfassend einen Kanalbereich, ein Bilden eines dielektrischen Mandrels, der eine erste Seitenoberfläche und eine zweite Seitenoberfläche umfasst, und ein Bilden einer Gate-Elektrode, die einen Abschnitt aufweist, der um die erste Seitenoberfläche und die zweite Seitenoberfläche des dielektrischen Mandrels gehüllt ist. Die Kanalschicht ist aus einem zweidimensionalen Material zusammengesetzt. Der Kanalbereich der Kanalschicht ist teilweise zwischen der ersten Seitenoberfläche des dielektrischen Mandrels und dem Abschnitt der Gate-Elektrode positioniert.
- Figurenliste
- Die beigefügten Zeichnungen, die in diese Spezifikation einbezogen sind und einen Teil von ihr darstellen, veranschaulichen verschiedene Ausführungsformen der Erfindung und dienen, zusammen mit einer oben gegebenen allgemeinen Beschreibung der Erfindung und der nachstehend gegebenen detaillierten Beschreibung der Ausführungsformen, dazu, die Ausführungsformen der Erfindung zu erläutern. In den Zeichnungen beziehen sich gleiche Bezugszeichen auf gleiche Merkmale in den verschiedenen Ansichten.
-
1 ist eine Ansicht von oben einer Vorrichtungsstruktur in einem anfänglichen Fertigungsstadium eines Verarbeitungsverfahrens gemäß Ausführungsformen der Erfindung. -
2 ist eine Querschnittsansicht insgesamt entlang einer Linie 2-2 in1 . -
3 ist eine Ansicht von oben einer Vorrichtungsstruktur in einem Fertigungsstadium anschließend an1 . -
4 ist eine Querschnittsansicht insgesamt entlang einer Linie 4-4 in3 . -
4A ist eine Querschnittsansicht insgesamt entlang einer Linie 4A-4A in3 . -
4B ist eine Querschnittsansicht insgesamt entlang einer Linie 4B-4B in3 . -
5-10 ,5A-10A , und5B-10B sind jeweilige Querschnittsansichten der Vorrichtungsstruktur in aufeinanderfolgenden Fertigungsstadien des Verarbeitungsverfahrens anschließend an die3A ,3B ,3C . -
11-16 ,11A-16A , und11B-16B sind Querschnittsansichten der Vorrichtungsstruktur in aufeinanderfolgenden Fertigungsstadien eines Verarbeitungsverfahrens gemäß alternativen Ausführungsformen. - DETAILLIERTE BESCHREIBUNG
- Unter Bezugnahme auf die
1 ,2 und gemäß Ausführungsformen der Erfindung sind eine oder mehrere Nanosheet-Kanalschichten10 , eine oder mehrere Opferschichten12 , und eine Opferschicht14 in einem Schichtstapel15 angeordnet, der sich auf einem Substrat11 befindet. Die Opferschicht14 ist in einer vertikalen Richtung zwischen dem Substrat11 und der untersten Opferschicht12 angeordnet. Das Substrat11 kann aus einem einkristallinen Halbleitermaterial, wie etwa einkristallinem Silizium, zusammengesetzt sein. Die Nanosheet-Kanalschichten10 , die Opferschichten12 , und die Opferschicht14 können auf dem Substrat11 durch einen epitaktischen Wachstumsprozess gebildet werden, während dessen die Schichtzusammensetzung durch Variierung der dem Abscheidewerkzeug zugeführten Reaktanten abgewechselt wird. Die Anzahl von Nanosheet-Kanalschichten10 und Opferschichten12 in dem Schichtstapel15 kann sich in der Anzahl von den repräsentativen Ausführungform unterscheiden. Insbesondere kann die Anzahl von Nanosheet-Kanalschichten10 und Opferschichten12 in dem Schichtstapel15 durch die Hinzufügung von Paaren von Nanosheet-Kanalschichten10 und Opferschichten12 zu dem Schichtstapel15 größer als die Anzahl bei der repräsentativen Ausführungform sein. - Die Nanosheet-Kanalschichten
10 sind aus einem einkristallinen Halbleitermaterial zusammengesetzt, und die Opferschichten12 sind aus einem einkristallinen Halbleitermaterial mit einer Zusammensetzung zusammengesetzt, die dazu ausgewählt ist, selektiv bezüglich des einkristallinen Halbleitermaterials der Nanosheet-Kanalschichten10 entfernt zu werden. Die Opferschicht14 ist aus einem einkristallinen Halbleitermaterial mit einer Zusammensetzung zusammengesetzt, die dazu ausgewählt ist, selektiv bezüglich des einkristallinen Halbleitermaterials sowohl der Nanosheet-Kanalschichten10 als auch der Opferschichten12 entfernt zu werden. Wie hierin verwendet, bedeutet der Begriff „selektiv“ in Bezug auf einen Materialentfernungsprozess (z.B. Ätzen), dass, mit Wahl eines geeigneten Ätzmittels, die Materialentfernungsrate (d.h. Ätzrate) für das anvisierte Material größer als die Entfernungsrate für wenigstens ein anderes Material ist, das dem Materialentfernungsprozess ausgesetzt wird. - Bei einer Ausführungsform kann das Halbleitermaterial, das die Nanosheet-Kanalschichten
10 darstellt, einkristallines Silizium sein, das Halbleitermaterial, das die Opferschichten12 darstellt, kann einkristallines Silizium-Germanium sein, das aufgrund seines Germaniumgehalts mit einer höheren Rate geätzt wird als Silizium, und das Halbleitermaterial, das die Opferschicht14 darstellt, kann Silizium-Germanium sein, das aufgrunddessen, das es einen höheren Germaniumgehalt als die Opferschichten12 enthält, mit einer höheren Rate als die Opferschichten12 geätzt wird. Bei einer Ausführungsform sind die Nanosheet-Kanalschichten10 frei von Germanium, der Germaniumgehalt der Opferschichten12 kann von fünfzehn Atomprozent (15 At.-%) bis fünfunddreißig Atomprozent (35 At.-%) reichen, und der Germaniumgehalt der Opferschicht14 kann von fünfzig Atomprozent (50 At.-%) bis fünfundsiebzig Atomprozent (75 At.-%) reichen. - Eine Hartmaske
16 wird über dem Schichtstapel15 abgeschieden und dann durch Lithografie- und Ätzprozesse strukturiert. Abschnitte der Hartmaske16 bedecken Abschnitte des Schichtstapels15 . Die Hartmaske16 kann aus einem dielektrischen Material, wie etwa Siliziumnitrid, zusammengesetzt sein, das durch chemische Dampfabscheidung (chemical vapor deposition; CVD) abgeschieden wird. - Unter Bezugnahme auf die
3 ,4A ,4B ,4C , in denen sich gleiche Bezugszeichen auf gleiche Merkmale in den1 ,2 beziehen, und in einem nachfolgenden Fertigungsstadium, werden die Nanosheet-Kanalschichten10 , Opferschichten12 , und Opferschicht14 mit einem Ätzprozess, wie etwa einem anisotropen Ätzprozess, wie reaktivem Ionenätzen, strukturiert, um Finnen18 zu definieren. Das vorherige Strukturieren der Abschnitte der Hartmaske16 schafft die Struktur für die Finnen18 . - Das Substrat
11 kann durch den Ätzprozess geätzt werden, und insbesondere können selbstausrichtende Gräben in dem Substrat11 zwischen angrenzenden Seitenwänden19 der Finnen18 definiert sein. Anschließend werden Flachgrabenisolationsbereiche20 in den Gräben zwischen den angrenzenden Seitenwänden19 der Finnen18 durch Abscheiden einer aus einem dielektrischen Material, wie etwa Siliziumdioxid, zusammengesetzten Schicht in den Gräben und Aussparen der abgeschiedenen Schicht mit einem Ätzprozess gebildet. - Opfer-Gate-Strukturen
22 werden gebildet, die mit einem Abschnitt jeder Finne18 überlappen und sie umhüllen. Der Begriff „Opfer-Gate-Struktur“ wie hierin verwendet bezieht sich auf eine Platzhalterstruktur für eine anschließend zu bildende Gate-Struktur. Die Opfer-Gate-Strukturen22 weisen eine beabstandete Anordnung entlang der Länge der Finnen18 auf und sind quer zu den Längsachsen der Finnen18 ausgerichtet. Die Opfer-Gate-Strukturen22 können eine dünne Oxidschicht, die die äußeren Oberflächen der Finnen18 überzieht, und eine dickere Schicht umfassen, die ein Opfermaterial, wie etwa amorphes Silizium enthält. Die Opfer-Gate-Strukturen22 können durch Lithografie- und Ätzprozesse aus diesen Bestandsschichten mit reaktivem Ionenätzen (reactive ion etching; RIE) unter Verwendung einer Hartmaske strukturiert werden. Die Opfer-Gate-Strukturen22 sind jeweils durch eine Hartmaskenkappe24 bedeckt. Die Hartmaskenkappe24 , die ein dielektrisches Material, wie etwa Siliziumnitrid, enthält, kann ein Rest der Hartmaske aus den Lithografie- und Ätzprozessen sein, die verwendet wurden, um die Opfer-Gate-Strukturen22 zu strukturieren. - Die Opferschicht
14 kann von jeder Finne18 durch einen selektiven Ätzprozess entfernt werden, um Räume unter den Finnen18 zu schaffen. Wie hierin verwendet, bedeutet der Begriff „selektiv“ in Bezug auf einen Materialentfernungsprozess (z.B. Ätzen), dass, mit Wahl eines geeigneten Ätzmittels, die Materialentfernungsrate (d.h. Ätzrate) für das anvisierte Material größer als die Entfernungsrate für wenigstens ein anderes Material ist, das dem Materialentfernungsprozess ausgesetzt wird. Dann können Seitenwand-Spacer26 angrenzend an die Seitenwände der Opfer-Gate-Strukturen22 gebildet werden. Die Seitenwand-Spacer26 können durch Abscheiden einer konformen Schicht, die aus einem dielektrischen Material, wie etwa einem Low-k-Dielektrikumsmaterial (z.B. SiBCN, SiOC, oder SiOCN) zusammengesetzt ist, und Ätzen der abgeschiedenen konformen Schicht mit einem anisotropen Ätzprozess, wie etwa reaktivem Ionenätzen, gebildet werden. Abschnitte der abgeschiedenen konformen Schicht füllen die Räume, die durch die Entfernung der strukturierten Abschnitte der Operschicht14 erzeugt wurden, um eine untere dielektrische Isolationsschicht28 unter den Finnen18 zu definieren. - Durch einen Ätzprozess, der durch die Seitenwand-Spacer
26 und Opfer-Gate-Strukturen22 selbstausrichtend ist, können Aussparungen25 in den Finnen18 gebildet werden. Der Ätzprozess kann an der unteren dielektrischen Isolationsschicht28 stoppen. Jeder der Finnen18 umfasst Seitenwände19 angrenzend an die Aussparungen, und angrenzende Seitenwände19 der Finnen18 sind durch einen Spalt einer Dimension, S, getrennt. - Unter Bezugnahme auf die
5 ,5A ,5B , in denen sich gleiche Bezugszeichen auf gleiche Merkmale in den4 ,4A ,4B beziehen, und in einem nachfolgenden Fertigungsstadium, werden die Opferschichten12 mit einem Ätzprozess ausgespart, der das Material der Opferschichten12 selektiv bezüglich des Materials der Nanosheet-Kanal-schichten10 entfernt. Durch Abscheiden einer konformen Schicht aus dielektrischem Material, wie etwa Siliziumnitrid, das die Aussparungen angrenzend an die gegenüberliegenden Enden der ausgesparten Opferschichten12 füllt, und dann Durchführen eines anisotropen Ätzprozesses, um die konforme Schicht von einer Außenseite der Aussparungen zu entfernen, werden innere Spacer30 gebildet. - Unter Bezugnahme auf die
6 ,6A ,6B , in denen sich gleiche Bezugszeichen auf gleiche Merkmale in den5 ,5A ,5B beziehen, und in einem nachfolgenden Fertigungsstadium, werden die Nanosheet-Kanalschichten10 mit einem Ätzprozess vollständig entfernt, um Räume32 zu bilden, die sich quer durch die volle Breite der Opferschichten12 und Seitenwand-Spacer26 erstrecken. Beispielsweise kann der Ätzprozess ein Remote-Plasma-unterstützter Trockenätzprozess (z.B. ein Frontier-Ätzen) sein, der die Nanosheet-Kanalschichten10 gegenüber Radikalen (d.h. ungeladenen oder neutralen Spezies) exponiert, die aus einer Gasmischung von Stickstofftrifluorid (NF3) und Wasserstoff (H2) erzeugt werden. Bei konventionellen Prozessen sind die Nanosheet-Kanalschichten10 nicht opfernd und wären in der endgültigen Vorrichtungsstruktur vorhanden. - Unter Bezugnahme auf die
7 ,7A ,7B , in denen sich gleiche Bezugszeichen auf gleiche Merkmale in den6 ,6A ,6B beziehen, und in einem nachfolgenden Fertigungsstadium, wird ein zweidimensionales (2D) Material konform abgeschieden, das jeden der Räume32 teilweise mit Ersatz-Kanal-Schichten34 füllt und das eine Schicht36 bildet, die die Seitenwand-Spacer26 und die Hartmaskenkappe24 umhüllt. Das zweidimensionale Material wird auch auf der unteren dielektrischen Isolationsschicht28 abgeschieden. Die Ersatz-Kanal-Schicht34 füllt jeden Raum32 nur teilweise mit dem zweidimensionalen Material. Die Ersatz-Kanal-Schicht34 und die Schicht36 definieren einen kontinuierlichen dünnen Film, der aus dem zweidimensionalen Material zusammengesetzt ist. - Das zweidimensionale Material, das die Ersatz-Kanal-Schichten
34 und die Schicht36 bildet, kann ein dünner konformer Überzug sein, der beispielsweise durch Atomlagenabscheidung oder chemische Dampfabscheidung abgeschieden wurde. Einschränkungen bezüglich der Abscheidetemperatur werden reduziert, weil die Abscheidung im Prozessfluss stattfindet, bevor die Metall-Gate-Strukturen gebildet werden, die die Opfer-Gate-Strukturen22 ersetzen. Bei einer Ausführungsform kann das zweidimensionale Material durch eine Trägermobilität gekennzeichnet sein, die größer als die Trägermobilität von Silizium ist. Bei einer Ausführungsform kann das zweidimensionale Material aus einem Übergangsmetall-Dichalkogenid zusammengesetzt sein, das ein Übergangsmetall (z.B. Molybdän (Mo) oder Wolfram (W)) und ein Chalkogenatom (Schwefel (S), Selen (Se) oder Tellur (Te)) umfasst. Beispielhafte Übergangsmetall-Dichalkogenide umfassen, ohne Beschränkung darauf, Molybdändisulfid (MoS2), Hafniumdisulfid (HfS2), Zircondisulfid (ZrS2), Wolframdisulfid (WS2), Zinnsulfid (SnS), und Wolframdiselenid (WSe2). Bei einer alternativen Ausführungsform kann das zweidimensionale Material aus Graphen (C) zusammengesetzt sein. Bei einer Ausführungsform kann das zweidimensionale Material und insbesondere das in jeder der Ersatz-Kanal-Schichten34 enthaltene zweidimensionale Material34 eine einzelne Monoschicht von Atomen umfassen, die in einer dünnen Lage angeordnet sind. Bei einer alternativen Ausführungsform kann jede Ersatz-Kanal-Schicht34 eine Monoschicht bis zwei Monoschichten des zweidimensionalen Materials enthalten. Bei einer alternativen Ausführungsform kann jede Ersatz-Kanal-Schicht34 zwei oder mehr Monoschichten des zweidimensionalen Materials enthalten. - Unter Bezugnahme auf die
8 ,8A ,8B , in denen gleiche Bezugszeichen sich auf gleiche Merkmale in den7 ,7A ,7B beziehen, und in einem nachfolgenden Fertigungsstadium, werden Mandrels38 gebildet, die den Rest jedes Raums32 füllen, der nicht durch die Ersatz-Kanal-Schichten34 besetzt ist. Die Mandrels38 können aus einem dielektrischen Material, wie einem Low-k-Dielektrikumsmaterial (z.B. SiBCN, SiOC, oder SiOCN) zusammengesetzt sein, das als Schicht durch eine Atomlagenabscheidung abgeschieden und mit einem isotropen Ätzprozess geätzt wurde, um Abschnitte der zu den Räumen32 äußeren Schicht zu entfernen. Die abgeschiedene Schicht kann innerhalb der Räume32 abgeklemmt (pinched-off) sein, um die Mandrels38 zu bilden. Die Mandrels38 werden gebildet, nachdem die Ersatz-Kanal-Schichten34 und die Schicht36 gebildet worden sind. Die Mandrels38 weisen eine gestapelte Anordnung auf, die durch die Räume32 und Ersatz-Kanal-Strukturen34 geschaffen wird. - Jeder Mandrel
38 umfasst gegenüberliegende Endoberflächen37 , die in einer lateralen Richtung relativ zueinander beabstandet sind, und Seitenoberflächen39 , die zwischen den gegenüberliegenden Endoberflächen37 positioniert sind. Die Seitenoberflächen39 sind um den Umfang jedes Mandrels38 angeordnet. Eine der Seitenoberflächen39 jedes Mandrels38 ist eine obere Seitenoberfläche, die am weitesten (d.h. entfernt) von dem Substrat11 positioniert ist, und eine andere der Seitenoberflächen39 jedes Mandrels38 ist eine untere Seitenoberfläche, die am nächsten (d.h. nahe) bei dem Substrat11 positioniert ist. Die oberen und unteren Seitenoberflächen39 jedes Mandrels38 können in parallelen oder im Wesentlichen parallelen Ebenen enthalten sein. Bei einer Ausführungsform kann jeder Mandrel38 einen rechteckigen Querschnitt parallel zu seiner Längsachse aufweisen. Das zweidimensionale Material in jeder Ersatz-Kanal-Schicht34 ist um alle der Seitenoberflächen39 von einem der Mandrels38 gehüllt (d.h. umgibt sie oder erstreckt sich vollständig um sie) und ist, als ein Ergebnis, auf den oberen und unteren Seitenoberflächen39 sowie allen anderen Seitenoberflächen39 positioniert. Bei einer Ausführungsform ist das zweidimensionale Material in jeder Ersatz-Kanal-Schicht34 in direktem Kontakt mit den Seitenoberflächen39 von einem der Mandrels38 . Die gegenüberliegenden Seitenoberflächen37 jedes Mandrels38 sind nicht durch das zweidimensionale Material bedeckt. - Das zweidimensionale Material in der Schicht
36 kann dotiert sein, wie durch die mit dem Bezugszeichen35 beschrifteten Pfeile mit einfacher Spitze in8 diagrammatisch angezeigt, um seine elektrische Leitfähigkeit zu erhöhen. Bei einer Ausführungsform kann das zweidimensionale Material in der Schicht36 nach seiner Abscheidung und nachdem die Mandrels38 gebildet worden sind, dotiert werden. Bei einer Ausführungsform kann das zweidimensionale Material in der Schicht36 durch einen nicht-beschädigenden Dotierprozess, wie etwa durch einen Plasmadotierprozess, dotiert werden. Bei einer Ausführungsform kann das zweidimensionale Material in der Schicht36 mit einem p-Typ-Dotierstoff dotiert werden, der eine elektrische p-Typ-Leitfähigkeit bereitstellt. Bei einer alternativen Ausführungsform kann das zweidimensionale Material in der Schicht36 mit einem n-Typ-Dotierstoff dotiert werden, der eine elektrische n-Typ-Leitfähigkeit bereitstellt. Die Ersatz-Kanal-Schichten34 werden maskiert und durch den die Schicht36 dotierenden Prozess nicht dotiert. - Unter Bezugnahme auf die
9 ,9A ,9B , in denen gleiche Bezugszeichen sich auf gleiche Merkmale in den8 ,8A ,8B beziehen, und in einem nachfolgenden Fertigungsstadium, werden Source/Drain-Kontakte40 in den Aussparungen25 gebildet. Die Source/Drain-Kontakte40 werden durch die Schicht36 mit dem zweidimensionalen Material der Ersatz-Kanal-Schichten34 gekoppelt. Die Source/Drain-Kontakte40 können aus einem Metall, wie etwa Wolfram oder Titannitrid, zusammengesetzt sein, das abgeschieden und mit einem Rückätzprozess ausgespart wird. Das zweidimensionale Material in der Schicht36 , das dotiert sein kann, umhüllt jeden Source/Drain-Kontakt40 . Diese Beziehung maximiert den Kontaktbereich, was den Kontaktwiderstand reduzieren kann. - Die Ersatz-Kanal-Schichten
34 in jeder Finne18 sind lateral zwischen unterschiedlichen Source/Drain-Kontakten40 angeordnet, und sind mit diesen unterschiedlichen Source/Drain-Kontakten40 gekoppelt. Die Mandrels38 erstrecken sich in einer lateralen Richtung vollständig quer durch jede Finne18 von einem der Source/Drain-Kontakte40 zu einem anderen der Source/Drain-Kontakte40 , und die gegenüberliegenden Endoberflächen37 jedes Mandrels38 enden bei, und kontaktieren direkt, einen der Source/Drain-Kontakte40 . Die Endoberflächen37 jedes Mandrels38 sind frei von dem zweidimensionalen Material, was den direkten Kontakt und die elektrische Isolierung der unterschiedlichen Ersatz-Kanal-Schichten34 in jeder Finne18 erleichtert. - Nach dem Bilden der Source/Drain-Kontakte
40 kann die Schicht36 unter Verwendung eines isotropen Ätzprozesses derart abgekanted werden, dass die unterschiedlichen Source/Drain-Kontakte40 voneinander getrennt werden. Die Höhe der Source/Drain-Kontakte40 kann den Abkantungsgrad der Schicht36 bestimmen. - Eine dielektrische Zwischenlagenschicht
41 wird abgeschieden und planarisiert, um die Räume über den Source/Drain-Kontaten40 zu füllen. Die dielektrische Zwischenlagenschicht41 kann aus einem dielektrischen Material, wie etwa Siliziumdioxid, zusammengesetzt sein, das durch chemische Dampfabscheidung abgeschieden wurde, und kann durch chemisch-mechanisches Polieren planarisiert werden. Die Planarisierung kann die Hartmaskenkappen24 entfernen, was die Opfer-Gate-Strukturen22 für eine nachfolgende Entfernung öffnet. - Unter Bezugnahme auf die
10 ,10A ,10B , in denen sich gleiche Bezugszeichen auf gleiche Merkmale in den9 ,9A ,9B beziehen, und in einem nachfolgenden Fertigungsstadium, werden die Opfer-Gate-Strukturen22 mit einem oder mehreren Ätzprozessen entfernt. Die Opferschichten12 werden anschließend mit einem Ätzprozess entfernt, der das Material der Opferschichten12 selektiv bezüglich der Materialien der Ersatz-Kanal-Schichten34 und der inneren Spacer30 entfernt. - In den Räumen, die durch die Entfernung der Opfer-Gate-Strukturen
22 und Opferschichten12 geöffnet wurden, werden Gate-Strukturen42 gebildet, um die Bildung eines Feldeffekttransistors in einem Ersatz-Gate-Prozess zu vervollständigen. Die Gate-Strukturen42 können eine Gate-Dielektrikums-Schicht, die aus einem dielektrischen Material, wie etwa einen High-k-Dielektrikum, wie Hafniumoxid, zusammengesetzt ist, und eine Gate-Elektrode umfassen, die eine oder mehrere Barrierenmetallschichten und/oder Arbeitsfunktionsmetallschichten, wie etwa Titanaluminumkarbid oder Titannitrid, umfasst. Die Gate-Dielektrikums-Schicht ist zwischen der Gate-Elektrode und den Ersatz-Kanal-Schichten34 angeordnet. - Die Ersatz-Kanal-Schichten
34 sind in einem vertikalen Stapel angeordnet, wobei jede Ersatz-Kanal-Schicht34 um die Seitenoberflächen39 von einem der Mandrels38 gehüllt ist. Abschnitte43 der Gate-Elektrode jeder Gate-Struktur42 befinden sich in den Räumen, die früher durch die entfernten Opferschichten12 besetzt waren. Jeder Gate-Elektroden-Abschnitt43 kann einen Kanalbereich70 von einer der Ersatz-Kanal-Schichten34 und den zugehörigen Mandrel38 in einer Gate-All-Around-Anordnung umhüllen. - Jede Ersatz-Kanal-Schicht
34 umfasst auch Erstreckungsbereiche72 , die sich an den entgegengesetzten lateralen Enden des Kanalbereichs70 befinden. Der Kanalbereich70 ist deshalb lateral zwischen den Erstreckungsbereichen72 positioniert. Die Erstreckungsbereiche72 koppeln gegenüberliegende Enden des Kanalbereichs70 jeder Ersatz-Kanal-Schicht34 mit einem der Source/Drain-Kontakte40 . Der Kanalbereich70 und die Erstreckungsbereiche72 jeder Ersatz-Kanal-Schicht34 sind um alle der Seitenoberflächen39 von einem der Mandrels38 gehüllt (d.h. umgeben sie oder erstrecken sich vollständig um sie herum). Die Erstreckungsbereiche72 , sowie die jeweiligen lateralen Abschnitte des Mandrels38 , auf dem sich die Erstreckungsbereiche72 befinden, erstrecken sich durch die Spalte zwischen angrenzenden inneren Spacern30 . Einer der inneren Spacer30 ist in einer vertikalen Richtung zwischen den Erstreckungsbereichen72 von angrenzenden Kanal-schichten34 angeordnet. - Selbstausrichtende Kontaktkappen
44 , die aus einem dielektrischen Material, wie etwa Siliziumnitrid, zusammengesetzt sind, werden in den Räumen über jeder der Gate-Strukturen42 gebildet, die sich zwischen den Seitenwand-Spacern26 befinden. Die dielektrische Zwischenlagenschicht41 kann entfernt werden, um Räume über den Source/Drain-Kontakten40 zu öffnen, und Graben-Silizid-Kontakte (nicht gezeigt) können in diesen geöffneten Räumen gebildet werden, die sich erstrecken, um die Source/Drain-Kontakte40 zu kontaktieren. - Nachfolgend wird eine Middle-of-Line (MOL)- und Back-End-of-Line (BEOL)-Prozessierung verwendet, um eine Zwischenverbindungsstruktur mit Kontakten zu bilden, die mit dem Feldeffekttransistor gekoppelt sind.
- Die Einführung des zweidimensionalen Materials in die Ersatz-Kanal-Schicht
34 ermöglicht die Bildung eines gestapelten zweidimensionalen Feldeffekttransistors, der durch eine verbesserte effektive Breite und verbesserte Prozessflexibilität gekennzeichnet ist. Die Verbesserung der Prozessflexibilität wird zumindest teilweise ermöglicht, da das zweidimensionale Material vor der Bildung der Source/Drain-Kontakte40 sowie vor der Bildung der Gate-Strukturen42 gebildet wird. Das zweidimensionale Material kann daher aufgrund eines gesenkten Risikos einer Metallinterdiffusion und eines gesenkten Risikos einer Beschädigung der Gate-Strukturen42 mit einer aggressiveren thermischen Bilanz abgeschieden werden. Eine verbesserte elektrostatische Steuerung bezüglich der Ersatz-Kanal-Schichten34 , die durch das zweidimensionale Material ermöglicht wird, kann eine Abwärtsskalierung der Gate-Länge erlauben. - Die Anordnung der Schicht
36 und der Source/Drain-Kontakte40 stellt einen Umhüllungskontakt (wrap-around-contact; WAC) bereit, der einen Kontaktwiderstand reduzieren kann. Weil die Source/Drain-Kontakte40 kein epitaktisches Halbleitermaterial enthalten, wie bei konventionellen Feldeffekttransistoren, ist der Feldeffekttransistor umfassend die Ersatz-Kanal-Schichten des zweidimensionalen Materials ohne Übergang. Durch Anpassen der Dotierung des zweidimensionalen Materials in der Schicht36 und des zum Bilden der Source/Drain-Kontakte40 verwendeten Metalls können entweder n-Typ- oder p-Typ-Feldeffekttransistoren gebildet werden. - Unter Bezugnahme auf die
11 ,11A ,11B , in denen sich gleiche Bezugszeichen auf gleiche Merkmale in den4 ,4A ,4B beziehen, und gemäß einer alternativen Ausführungsform, können die Nanosheet-Kanalschichten10 in dem Schichtstapel mit einer reduzierten Dicke gebildet werden. Angrenzend an die Seitenwände der Finnen18 können Spacer50 gebildet sein. Die Spacer50 können durch durch Abscheiden einer konformen Schicht, die aus einem dielektrischen Material, wie etwa Titanoxid, zusammengesetzt ist, und Ätzen der abgeschiedenen konformen Schicht mit einem anisotropen Ätzprozess, wie etwa reaktivem Ionenätzen, gebildet werden. Eine dielektrische Zwischenlagenschicht52 wird abgeschieden und planarisiert, um die Räume zwischen den Finnen18 und Opfer-Gate-Strukturen22 zu füllen. Die dielektrische Zwischenlagenschicht52 kann aus einem dielektrischen Material, wie etwa Siliziumdioxid, zusammengesetzt sein, das durch chemische Dampfabscheidung abgeschieden wurde, und kann durch chemisch-mechanisches Polieren planarisiert werden. Die Planarisierung kann die Hartmaskenkappen24 entfernen, um die Opfer-Gate-Strukturen22 zu öffnen. - Unter Bezugnahme auf die
12 ,12A ,12B , in denen sich gleiche Bezugszeichen auf gleiche Merkmale in den11 ,11A ,11B beziehen, und in einem nachfolgenden Fertigungsstadium, werden die Opfer-Gate-Strukturen22 mit einem oder mehreren Ätzprozessen entfernt, um Räume54 zu definieren. Die Opferschichten12 werden anschließend mit einem Ätzprozess entfernt, der das Material der Opferschichten12 selektiv bezüglich der Materialien der Ersatz-Kanal-Schichten34 und der inneren Spacer30 entfernt. - Mandrels
56 werden gebildet, die die durch die entfernten Opferschichten12 freigemachten Räume füllen. Die Mandrels56 können aus einem Low-k-DielektrikumsMaterial, wie etwa SiBCN, SiOC, oder SiOCN, zusammengesetzt sein, das durch Atomlagenabscheidung als Schicht konform abgeschieden und mit einem isotropen Ätzprozess geätzt wurde, um Abschnitte der zu den Räumen äußeren Schicht zu entfernen. Die abgeschiedene Schicht kann innerhalb der Räume abgeklemmt (pinched-off) sein, um die Mandrels56 zu bilden. Die dielektrische Zwischenlagenschicht52 blockiert die Abscheidung der Schicht zwischen den Opfer-Gate-Strukturen22 . Jeder Mandrel56 umfasst gegenüberliegende Endoberflächen57 , die in einer lateralen Richtung relativ zueinander beabstandet sind, und Seitenoberflächen59 , die zwischen den gegenüberliegenden Endoberflächen positioniert sind. Die Endoberflächen57 und Seitenoberflächen59 sind ähnlich den Endoberflächen37 und Seitenoberflächen39 der Mandrels38 , wie zuvor beschrieben. - Unter Bezugnahme auf die
13 ,13A ,13B , in denen sich gleiche Bezugszeichen auf gleiche Merkmale in den12 ,12A ,12B beziehen, und in einem nachfolgenden Fertigungsstadium, werden die Nanosheet-Kanalschichten10 , wie vorstehend beschrieben, mit einem Ätzprozess vollständig entfernt, um die Räume32 zu bilden, die sich quer durch die volle Breite der Finnen18 und Seitenwand-Spacer26 erstrecken. Die Mandrels56 werden dann mit einem isotropen Ätzprozess verdünnt, der auch die Spacer50 entfernt, um Räume51 zu definieren, die in Verbindung mit den Räumen32 stehen. - Unter Bezugnahma auf die
14 ,14A ,14B , in denen sich gleiche Bezugszeichen auf gleiche Merkmale in den13 ,13A ,13B beziehen, und in einem nachfolgenden Fertigungsstadium, werden die Ersatz-Kanal-Schichten34 und die Schicht36 , die aus einem zweidimensionalen Material zusammengesetzt sind, gebildet, wie vorstehend beschrieben. Bei der alternativen Ausführungsform werden die Mandrels56 gebildet, bevor die Ersatz-Kanal-Schichten34 und die Schicht36 gebildet werden, und die Ersatz-Kanal-Schichten34 werden auf den äußeren Oberflächen der Mandrels56 und der inneren Spacer30 gebildet. Die Beziehung zwischen den Ersatz-Kanal-Schichten34 und den Seitenoberflächen59 der Mandrels56 ist ähnlich der Beziehung zwischen den Ersatz-Kanal-Schichten34 und den Seitenoberflächen39 der Mandrels38 , wie vorstehend beschrieben. Jedoch umgeben nicht die Erstreckungsbereiche72 der Ersatz-Kanal-Schichten34 die Mandrels56 . Stattdessen sind die Erstreckungsbereiche72 der Ersatz-Kanal-Schichten34 kurze Segmente, die die durch die Enfernung der Nanosheet-Kanalschichten10 zwischen den inneren Spacern30 gebildeten Räume32 und die Räume51 vollständig füllen. Die gegenüberliegenden Endoberflächen57 jedes Mandrels56 enden an einem, und kontaktieren direkt, einen der inneren Spacer30 . - Unter Bezugnahme auf die
15 ,15A ,15B , in denen sich gleiche Bezugszeichen auf gleiche Merkmale in den14 ,14A ,14B beziehen, und in einem nachfolgenden Fertigungsstadium, werden Verbundstopfen45 in den Räumen32 zwischen den Mandrels56 gebildet und können in direktem Kontakt mit den Ersatz-Kanal-Schichten34 stehen. Die Verbundstopfen45 können die konform abgeschiedene Gate-Dielektrikums-Schicht der Gate-Struktur42 , eine beispielsweise aus Titannitrid zusammengesetzte Deckschicht und einen beispielsweise aus einem p-Typ-Polisilizium zusammengesetzten zentralen Kern umfassen. Wenn die Verbundstopfen42 vorhanden sind, kann ein Ausheilen durchgeführt werden, um die physikalischen Eigenschaften und die Zuverlässigkeit der Gate-Dielektrikums-Schicht zu verbessern. - In dem Raum über dem obersten Mandrel
56 sind Abschnitte des zweidimensionalen Materials der Schicht36 exponiert und werden mit einem Ätzprozess entfernt. Die Entfernung dieser exponierten Abschnitte des zweidimensionalen Materials der Schicht36 definiert eine Aussparung57 über jedem der obersten inneren Spacer30 . Die Verbundstopfen42 schützen die Ersatz-Kanal-Schichten34 während der Bildung der Aussparungen57 . - Unter Bezugnahme auf die
16 ,16A ,16B , in denen sich gleiche Bezugszeichen auf gleiche Merkmale in den15 ,15A ,15B beziehen, und in einem nachfolgenden Fertigungsstadium, sind die Aussparungen57 über den obersten inneren Spacern30 mit einem dielektrischen Material gefüllt, das das gleiche dielektrische Material sein kann (z.B. Siliziumnitrid), das die inneren Spacer30 darstellt. Die Deckschicht und der zentrale Kern der Verbundstopfen45 werden anschließend mit einem Ätzprozess entfernt, der die Gate-Dielektrikums-Schicht der Gate-Strukturen42 zurücklässt. Die Gate-Elektroden der Gate-Strukturen42 werden gebildet, wie vorstehend beschrieben. Die Gate-ElektrodenAbschnitte43 jeder Gate-Struktur42 sind in den Räumen zwischen den Mandrels56 positioniert und hüllen sich um die Kanalbereiche70 der Ersatz-Kanal-Schichten34 und der zugehörigen Mandrels56 . Dann werden die Gate-Elektroden der Gate-Strukturen42 und die selbstausrichtenden Kontaktkappen44 gebildet. - Die dielektrische Zwischenlagenschicht
52 wird entfernt, was die Schicht36 exponiert. Das zweidimensionale Material in der Schicht36 kann dann, wie vorstehend beschrieben, dotiert werden um seine elektrische Leitfähigkeit zu erhöhen. Dann werden die Source/Drain-Kontakte40 , die durch die Schicht36 mit den Erstreckungsbereichen der Ersatz-Kanal-Schichten34 gekoppelt sind, in den Aussparungen25 gebildet. - Die oben beschriebenen Verfahren werden bei der Fertigung von Chips mit integriertem Schaltkreis verwendet. Die resultierenden Chips mit integriertem Schaltkreis können durch den Fertiger in Roh-Wafer-Form (das heißt, als einzelner Wafer, der mehrere ungehäuste Chips aufweist), als nackter Chip (bare die), oder in einer gehäusten Form vertrieben werden. Der Chip kann mit anderen Chips, diskreten Schaltelementen und/oder anderen Signalverarbeitungsvorrichtungen als Teil von entweder einem Zwischenprodukt oder einem Endprodukt integriert sein. Das Endprodukt kann irgendein Produkt sein, das Chips mit integriertem Schaltkreis umfasst, wie etwa Computerprodukte, die einen zentralen Prozessor aufweisen, oder Smartphones.
- Bezugnahmen hierin auf Ausdrücke, die durch eine Annäherungssprache modifiziert sind, wie „etwa“, „ungefähr“, und „im Wesentlichen“, sollen nicht auf den spezifizierten präzisen Wert beschränkt sein. Die Annäherungssprache kann der Präzision eines Instruments entsprechen, das verwendet wird, um den Wert zu messen, und kann, falls nicht anderweitig abhängig von der Präzision des Instruments, +/- 10% des(der) angegebenen Werts(Werte) sein.
- Bezugnahmen hierin auf Ausdrücke wie „vertikal“, „horizontal“, etc. erfolgen beispielhaft und nicht zur Beschränkung, um einen Referenzrahmen zu festzulegen. Der Ausdruck „horizontal“ wie hierin verwendet, ist als eine Ebene definiert, die parallel zu einer konventionellen Ebene eines Halbleitersubstrats ist, ungeachtet seiner tatsächlichen dreidimensionalen räumlichen Ausrichtung. Die Begriffe „vertikal“ and „normal“ beziehen sich auf eine Richtung, die senkrecht zur Horizontalen, wie gerade definiert, ist. Der Begriff „lateral“ bezieht sich auf eine Richtung innerhalb der horizontalen Ebene.
- Ein Merkmal „verbunden“ oder „gekoppelt“ an ein anderes oder mit einem anderen Merkmal kann an das oder mit dem anderen Merkmal direkt verbunden oder gekoppelt sein oder stattdessen kann eines oder können mehrere dazwischenkommende Merkmale vorhanden sein. Ein Merkmal kann an ein anderes oder mit einem anderen Merkmal „direkt verbunden“ oder „direkt gekoppelt“ sein, falls dazwischenkommende Merkmale nicht vorhanden sind. Ein Merkmal kann an ein anderes oder mit einem anderen Merkmal „indirekt verbunden“ oder „indirekt gekoppelt“ sein, falls wenigstens ein dazwischenkommendes Merkmal vorhanden ist. Ein Merkmal „an“ einem anderen Merkmal oder es „kontaktierend“ kann direkt an oder in direktem Kontakt mit dem anderen Merkmal sein, oder stattdessen kann eines oder können mehrere dazwischenkommende Merkmale vorhanden sein. Ein Merkmal kann „direkt an“ oder in „direktem Kontakt“ mit einem anderen Merkmal sein, falls dazwischenkommende Merkmale nicht vorhanden sind. Ein Merkmal kann „indirekt an“ oder in „indirektem Kontakt“ mit einem anderen Merkmal sein, falls wenigstens ein dazwischenkommendes Merkmal vorhanden ist.
- Die Beschreibungen der verschiedenen Ausführungsformen der vorliegenden Erfindung wurden zum Zwecke der Veranschaulichung präsentiert, sollen aber nicht erschöpfend oder auf die offenbarten Ausführungsformen beschränkt sein. Viele Modifikationen und Variationen sind für die gewöhnlichen Fachleute offensichtlich, ohne dass vom Umfang und der Idee der beschriebenen Ausführungsformen abgewichen würde. Die hierin verwendete Terminologie wurde gewählt, um die Prinzipien der Ausführungsformen, die praktische Anwendung oder technische Verbesserung gegenüber auf dem Markt erhältlichen Technologien am besten zu erklären, oder es anderen gewöhnlichen Fachleuten zu ermöglichen, die hierin offenbarten Ausführungsformen zu verstehen.
Claims (20)
- Struktur für einen Feldeffekttransistor, wobei die Struktur umfasst: einen ersten Mandrel, der von einem dielektrischen Material umfasst ist, wobei der erste Mandrel eine erste Seitenoberfläche und eine zweite Seitenoberfläche umfasst; eine Gate-Elektrode, die einen Abschnitt aufweist, der um die erste Seitenoberfläche und die zweite Seitenoberfläche des ersten Mandrels gehüllt ist; und eine erste Kanalschicht umfassend einen Kanalbereich, wobei der Kanalbereich der ersten Kanalschicht teilweise zwischen der ersten Seitenoberfläche des ersten Mandrels und dem Abschnitt der Gate-Elektrode positioniert ist, wobei die erste Kanalschicht von einem zweidimensionalen Material umfasst ist.
- Struktur nach
Anspruch 1 , wobei der Kanalbereich der ersten Kanalschicht teilweise zwischen der zweiten Seitenoberfläche des ersten Mandrels und dem Abschnitt der Gate-Elektrode positioniert ist. - Struktur nach
Anspruch 2 , wobei die erste Seitenoberfläche und die zweite Seitenoberfläche des ersten Mandrels in jeweiligen Ebenen enthalten sind, die im Wesentlichen parallel sind. - Struktur nach
Anspruch 1 , wobei die erste Seitenoberfläche und die zweite Seitenoberfläche in einer Vielzahl von Seitenoberflächen der ersten Kanalschicht umfasst sind, und sich der Kanalbereich der ersten Kanalschicht um alle der Seitenoberflächen des ersten Mandrels erstreckt. - Struktur nach
Anspruch 1 , ferner umfassend: einen zweiten Mandrel, der von dem dielektrischen Material umfasst ist, wobei der zweite Mandrel eine Seitenoberfläche umfasst, und der zweite Mandrel über dem ersten Mandrel angeordnet ist; and eine zweite Kanalschicht umfassend einen Kanalbereich, der teilweise zwischen der Seitenoberfläche des zweiten Mandrels und dem Abschnitt der Gate-Elektrode positioniert ist, wobei die zweite Kanalschicht von dem zweidimensionalen Material umfasst ist. - Struktur nach
Anspruch 5 , wobei die erste Kanalschicht einen Erstreckungsbereich umfasst, die zweite Kanalschicht einen Erstreckungsbereich umfasst, und ferner umfassend: einen Source/Drain-Kontakt, der durch den Erstreckungsbereich der ersten Kanalschicht mit dem Kanalbereich der ersten Kanalschicht verbunden ist und durch den Erstreckungsbereich der zweiten Kanalschicht mit dem Kanalbereich der zweiten Kanalschicht verbunden ist. - Struktur nach
Anspruch 6 , wobei der erste Mandrel und der zweite Mandrel jeweils an dem Source/Drain-Kontakt in direktem Kontakt mit dem Source/Drain-Kontakt enden, der Erstreckungsbereich der ersten Kanalschicht sich vollständig um den ersten Mandrel herum erstreckt, und der Erstreckungsbereich der zweiten Kanalschicht sich vollständig um den zweiten Mandrel herum erstreckt. - Struktur nach
Anspruch 7 , ferner umfassend: einen inneren Spacer, der in einer ersten Richtung zwischen dem Abschnitt der Gate-Elektrode und dem Source/Drain-Kontakt positioniert ist, wobei der innere Spacer in einer zweiten Richtung zwischen dem Erstreckungsbereich der ersten Kanalschicht und dem Erstreckungsbereich der zweiten Kanalschicht positioniert ist. - Struktur nach
Anspruch 1 , wobei die erste Kanalschicht einen ersten Erstreckungsbereich umfasst, und ferner umfassend: einen ersten Source/Drain-Kontakt, der durch den ersten Erstreckungsbereich der ersten Kanalschicht mit dem Kanalbereich der ersten Kanalschicht verbunden ist. - Struktur nach
Anspruch 9 , wobei die erste Kanalschicht einen zweiten Erstreckungsbereich umfasst, der Kanalbereich der ersten Kanalschicht zwischen dem ersten Erstreckungsbereich und dem zweiten Erstreckungsbereich der ersten Kanalschicht positioniert ist, und ferner umfassend: einen zweiten Source/Drain-Kontakt, der durch den zweiten Erstreckungsbereich der ersten Kanalschicht mit dem Kanalbereich der ersten Kanalschicht verbunden ist. - Struktur nach
Anspruch 10 , wobei die erste Seitenoberfläche und die zweite Seitenoberfläche in einer Vielzahl von Seitenoberflächen umfasst sind, und der Kanalbereich, der erste Erstreckungsbereich und der zweite Erstreckungsbereich der ersten Kanalschicht sich um alle der Seitenoberflächen des ersten Mandrels erstrecken. - Struktur nach
Anspruch 9 , ferner umfassend: eine Schicht des zweidimensionalen Materials, die den ersten Erstreckungsbereich der ersten Kanalschicht mit dem ersten Source/Drain-Kontakt koppelt. - Struktur nach
Anspruch 12 , wobei die Schicht des zweidimensionalen Materials einen Dotierstoff enthält, der effektiv zum Erhöhen einer elektrischen Leitfähigkeit des zweidimensionalen Materials ist. - Struktur nach
Anspruch 9 , ferner umfassend: einen ersten inneren Spacer und einen zweiten inneren Spacer, die in einer ersten Richtung zwischen dem Abschnitt der Gate-Elektrode und dem ersten Source/Drain-Kontakt positioniert sind, wobei der erste Erstreckungsbereich in einer zweiten Richtung zwischen dem ersten inneren Spacer und dem zweiten inneren Spacer positioniert ist, und der erste Mandrel an dem ersten inneren Spacer und dem zweiten inneren Spacer endet. - Struktur nach
Anspruch 1 , wobei das zweidimensionale Material ein Übergangsmetall-Dichalkogenid ist. - Struktur nach
Anspruch 1 , wobei das zweidimensionale Material Molybdändisulfid, Hafniumdisulfid, Zirkondisulfid, Wolframdisulfid, Zinnsulfid, oder Wolframdiselenid ist. - Verfahren zum Bilden eines Feldeffekttransistors, wobei das Verfahren umfasst: Bilden einer Kanalschicht umfassend einen Kanalbereich; Bilden eines dielektrischen Mandrels, der eine erste Seitenoberfläche und eine zweite Seitenoberfläche umfasst; und Bilden einer Gate-Elektrode, die einen Abschnitt aufweist, der um die erste Seitenoberfläche und die zweite Seitenoberfläche des dielektrischen Mandrels gehüllt ist, wobei der Kanalbereich der Kanalschicht teilweise zwischen der ersten Seitenoberfläche des dielektrischen Mandrels und dem Abschnitt der Gate-Elektrode positioniert ist, und die Kanalschicht von einem zweidimensionalen Material umfasst ist.
- Verfahren nach
Anspruch 17 , wobei die Kanalschicht gebildet wird, bevor der dielektrische Mandrel gebildet wird. - Verfahren nach
Anspruch 17 , wobei die Kanalschicht gebildet wird, nachdem der dielektrische Mandrel gebildet wird. - Verfahren nach
Anspruch 17 , wobei die erste Seitenoberfläche und die zweite Seitenoberfläche in einer Vielzahl von Seitenoberflächen der Kanalschicht umfasst sind, und der Kanalbereich der Kanalschicht sich um alle der Seitenoberflächen des dielektrischen Mandrels erstreckt.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US16/668,763 | 2019-10-30 | ||
US16/668,763 US11069819B2 (en) | 2019-10-30 | 2019-10-30 | Field-effect transistors with channel regions that include a two-dimensional material on a mandrel |
Publications (1)
Publication Number | Publication Date |
---|---|
DE102020126167A1 true DE102020126167A1 (de) | 2021-05-06 |
Family
ID=75485768
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE102020126167.5A Pending DE102020126167A1 (de) | 2019-10-30 | 2020-10-07 | Feldeffekttransistoren mit kanalbereichen, die ein zweidimensionales material umfassen, auf einem mandrel |
Country Status (4)
Country | Link |
---|---|
US (1) | US11069819B2 (de) |
CN (1) | CN112750908B (de) |
DE (1) | DE102020126167A1 (de) |
TW (1) | TWI758890B (de) |
Families Citing this family (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US11387319B2 (en) * | 2019-09-11 | 2022-07-12 | International Business Machines Corporation | Nanosheet transistor device with bottom isolation |
US11476333B2 (en) * | 2020-03-31 | 2022-10-18 | Taiwan Semiconductor Manufacturing Co., Ltd. | Dual channel structure |
US11908950B2 (en) * | 2020-06-15 | 2024-02-20 | Intel Corporation | Charge-transfer spacers for stacked nanoribbon 2D transistors |
US11482423B2 (en) * | 2021-01-28 | 2022-10-25 | Tokyo Electron Limited | Plasma etching techniques |
US20230093343A1 (en) * | 2021-09-23 | 2023-03-23 | International Business Machines Corporation | Stacked planar field effect transistors with 2d material channels |
US11935930B2 (en) | 2021-11-30 | 2024-03-19 | International Business Machines Corporation | Wrap-around-contact for 2D-channel gate-all-around field-effect-transistors |
Family Cites Families (16)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US9337210B2 (en) * | 2013-08-12 | 2016-05-10 | Micron Technology, Inc. | Vertical ferroelectric field effect transistor constructions, constructions comprising a pair of vertical ferroelectric field effect transistors, vertical strings of ferroelectric field effect transistors, and vertical strings of laterally opposing pairs of vertical ferroelectric field effect transistors |
US9711647B2 (en) | 2014-06-13 | 2017-07-18 | Taiwan Semiconductor Manufacturing Company, Ltd. | Thin-sheet FinFET device |
US9425324B2 (en) * | 2014-09-30 | 2016-08-23 | Taiwan Semiconductor Manufacturing Company Limited | Semiconductor device and channel structure thereof |
US9627395B2 (en) * | 2015-02-11 | 2017-04-18 | Sandisk Technologies Llc | Enhanced channel mobility three-dimensional memory structure and method of making thereof |
US9852923B2 (en) * | 2015-04-02 | 2017-12-26 | Applied Materials, Inc. | Mask etch for patterning |
US9461110B1 (en) * | 2015-04-30 | 2016-10-04 | Taiwan Semiconductor Manufacturing Company, Ltd. | FETs and methods of forming FETs |
CN107735864B (zh) | 2015-06-08 | 2021-08-31 | 美商新思科技有限公司 | 衬底和具有3d几何图形上的2d材料沟道的晶体管 |
KR102465353B1 (ko) * | 2015-12-02 | 2022-11-10 | 삼성전자주식회사 | 전계 효과 트랜지스터 및 이를 포함하는 반도체 소자 |
US10134915B2 (en) | 2016-12-15 | 2018-11-20 | Taiwan Semiconductor Manufacturing Co., Ltd. | 2-D material transistor with vertical structure |
US10651291B2 (en) * | 2017-08-18 | 2020-05-12 | Globalfoundries Inc. | Inner spacer formation in a nanosheet field-effect transistor |
KR102608959B1 (ko) * | 2017-09-04 | 2023-12-01 | 삼성전자주식회사 | 2차원 물질을 포함하는 소자 |
CN109473398B (zh) * | 2017-09-07 | 2022-06-07 | 联华电子股份有限公司 | 半导体元件及其制造方法 |
US10290681B2 (en) * | 2017-09-21 | 2019-05-14 | Sandisk Technologies Llc | Array of hole-type surround gate vertical field effect transistors and method of making thereof |
US10734525B2 (en) * | 2018-03-14 | 2020-08-04 | Globalfoundries Inc. | Gate-all-around transistor with spacer support and methods of forming same |
US10388732B1 (en) | 2018-05-30 | 2019-08-20 | Globalfoundries Inc. | Nanosheet field-effect transistors including a two-dimensional semiconducting material |
US11888034B2 (en) * | 2019-06-07 | 2024-01-30 | Intel Corporation | Transistors with metal chalcogenide channel materials |
-
2019
- 2019-10-30 US US16/668,763 patent/US11069819B2/en active Active
-
2020
- 2020-09-30 CN CN202011060512.9A patent/CN112750908B/zh active Active
- 2020-09-30 TW TW109134158A patent/TWI758890B/zh active
- 2020-10-07 DE DE102020126167.5A patent/DE102020126167A1/de active Pending
Also Published As
Publication number | Publication date |
---|---|
US11069819B2 (en) | 2021-07-20 |
TWI758890B (zh) | 2022-03-21 |
US20210135015A1 (en) | 2021-05-06 |
CN112750908B (zh) | 2023-10-24 |
TW202118068A (zh) | 2021-05-01 |
CN112750908A (zh) | 2021-05-04 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
DE102019205650B4 (de) | Struktur für einen Feldeffekttransistor und Verfahren | |
DE102018202897B4 (de) | Austauschmetallgatestrukturierung für Nanosheet-Vorrichtungen | |
DE102018218518B4 (de) | Epitaktische Strukturen in komplementären Feldeffekttransistoren | |
DE102018115909B4 (de) | Struktur und Verfahren für Finfet-Vorrichtung mit Kontakt über dielektrischem Gate | |
DE102020126167A1 (de) | Feldeffekttransistoren mit kanalbereichen, die ein zweidimensionales material umfassen, auf einem mandrel | |
DE102014219912B4 (de) | Verfahren zum Bilden von FinFET-Halbleitervorrichtungen unter Verwendung einer Austauschgatetechnik und die resultierenden Vorrichtungen | |
DE102020107101B3 (de) | Verfahren zur Herstellung einer Halbleitervorrichtung | |
DE112012001220B4 (de) | Halbleiterstruktur mit lokaler zu einer Gate-Struktur selbstjustierten Zwischenverbindungsstruktur und statische Speicherzelle diese beinhaltend und Verfahren diese zu bilden | |
DE102014019360B4 (de) | Halbleiterstruktur und ihr herstellungsverfahren | |
DE112013001404B4 (de) | Verfahren zum Verhindern eines Kurzschließens von benachbarten Einheiten | |
DE102019116859A1 (de) | Verfahren zum herstellen einer halbleitervorrichtung, und eine halbleitervorrichtung | |
DE102019123629B4 (de) | Gate-all-around-feldeffekttransistorvorrichtung und herstellungsverfahren | |
DE102018115901A1 (de) | Dielektrischer Abstandshalter zur Vermeidung von Kurzschlüssen | |
DE102020118388A1 (de) | Ferroelektrische direktzugriffsspeichervorrichtungen und verfahren | |
DE102019124526B4 (de) | Designprozess für ein Herstellungsverfahren eines Halbleiterbauelements | |
DE102018100297A1 (de) | FinFET-Bauelemente mit eingebetteten Luftspalten und ihre Fertigung | |
DE102017123047B4 (de) | Herstellungsverfahren für FINFETs mit unterschiedlichen Finnenkanalhöhen | |
DE102020119976A1 (de) | Halbleitervorrichtung und verfahren | |
DE102019206113A1 (de) | Feldeffekttransistoren mit multiplen Gatelängen | |
DE102019119806A1 (de) | Verfahren zum herstellen eines feldeffekttransistors mit kohlenstoff-nanoröhren und ein feldeffekttransistor | |
DE102021100674A1 (de) | Speicherarray mit epitaktischer sourceleitung und bitleitung | |
DE102018108821A1 (de) | Verfahren zur herstellung einer halbleitervorrichtung, und halbleitervorrichtung | |
DE102021109770B4 (de) | Hybrid-halbleitervorrichtung | |
DE102020110678B4 (de) | Halbleitervorrichtung und -verfahren | |
DE102021118124A1 (de) | Transistorisolationsbereiche und Verfahren zum Bilden derselben |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
R012 | Request for examination validly filed | ||
R081 | Change of applicant/patentee |
Owner name: GLOBALFOUNDRIES U.S. INC., MALTA, US Free format text: FORMER OWNER: GLOBALFOUNDRIES INC., GRAND CAYMAN, KY |
|
R082 | Change of representative |
Representative=s name: V. FUENER EBBINGHAUS FINCK HANO, DE |
|
R081 | Change of applicant/patentee |
Owner name: GLOBALFOUNDRIES U.S. INC., MALTA, US Free format text: FORMER OWNER: GLOBALFOUNDRIES U.S. INC., SANTA CLARA, CA, US |
|
R016 | Response to examination communication |