DE10133537C2 - Verfahren zur Herstellung einer nitridierten Oxidschicht auf einem Silizium-Halbleitersubstrat - Google Patents

Verfahren zur Herstellung einer nitridierten Oxidschicht auf einem Silizium-Halbleitersubstrat

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Description

Die vorliegende Erfindung betrifft ein Verfahren zur Herstel­ lung einer nitridierten Oxidschicht auf einem Silizium- Halbleitersubstrat.
Obwohl prinzipiell auf beliebige Oxide anwendbar, werden die vorliegende Erfindung sowie die ihr zugrundeliegende Proble­ matik in bezug auf Tunneloxide in integrierten DRAM- Schaltungen in Silizium-Technologie erläutert.
Zur Herstellung von nitridiertem Tunneloxid, beispielsweise für Flash-Speicherbauelemente, ist der definierte Einbau von Stickstoff nahe der Silizium-Siliziumoxid-Grenzfläche erfor­ derlich, um den Anforderungen an eine lange Oxidfunktionali­ tät (häufiges Tunneln, sehr viele Schreib-/Lösch-Zyklen) zu entsprechen.
Im Zuge der fortschreitenden Miniaturisierung dieser integ­ rierten Schaltungen ist es weiterhin erforderlich, das ther­ mische Budget dieses Verfahrens gering zu halten, um die Aus­ diffusion der zu diesem Prozessierungszeitpunkt bereits ein­ gebrachten Dotierstoffe gering zu halten.
Für eine enge Ausbeuteverteilung auf hohem Niveau sind insbe­ sondere die Gleichmäßigkeit der Oxiddicke und des Stickstoff­ einbaus bedeutsam.
Fig. 3 zeigt eine schematische Darstellung einer Halbleiter­ struktur mit einem nitridierten Tunneloxid zur Illustration der der vorliegenden Erfindung zugrundeliegenden Problematik.
In Fig. 3 bezeichnet 1 ein Silizium-Halbleitersubstrat, 10 ein erstes aktives Gebiet, 20 ein zweites aktives Gebiet, 15 einen dazwischenliegenden Kanalbereich, 30 ein über dem Ka­ nalbereich 15 liegendes nitridiertes Tunneloxid und 40 einen üblichen Gatestapel, der beispielsweise ein FloatingGate und ein Control-Gate enthält.
Der Bereich A ist separat vergrößert dargestellt. Hier be­ zeichnet G die Grenzfläche zwischen dem Silizium-Halb­ leitersubstrat 1 und dem nitridierten Tunneloxid 30. Deutlich erkennbar ist der definierte Einbau von Stickstoff in das Kristallgitter des Siliziumdioxids.
Fig. 4 zeigt einen beispielhaften Temperaturverlauf für ei­ nen üblichen RTP-Prozess zur Herstellung eines nitridierten Tunneloxids.
Beim gezeigten Beispiel erfolgt die Nitridierung mittels NH3 wodurch sich Tunneloxide mit besonders hohen Zyklusfestigkei­ ten von typischer Weise 106 Schreib-/Lösch-Zyklen herstellen lassen. Der RTP-Prozess bedingt eine Lampenheizung im Einzel­ scheibenverfahren, wobei die einzelnen Siliziumscheiben auf die entsprechende Prozesstemperatur gebracht werden und bei wechselnden Temperaturen und Gasflüssen nacheinander oxi­ diert, nitridiert und reoxidiert werden. Der Reoxidationspro­ zess dient insbesondere der Entfernung von Wasserstoff.
Die Produktivität eines solchen Prozesses ist sehr gering, da die Bearbeitung einer Einzelscheibe einige Minuten dauert. Um zumindest in diesem Zeitrahmen zum Prozessergebnis zu gelan­ gen, sind sehr hohe Prozesstemperaturen erforderlich, was zu einer hohen Temperatur-Zeit-Belastung der Prozessscheiben führt. Da sich der prozessierte Wafer und die Prozesskammer während des gesamten Prozesses nicht im thermodynamischen Gleichgewicht befinden, ist die Temperaturverteilung über der Scheibe nur mit großem technischen Aufwand zu kontrollieren und zu optimieren. Weitere störende Eigenschaften des RTP- Prozesses sind dadurch erzeugte mechanische Spannungen, welche von einem durch die Lampenheizung verursachten Tempera­ turgradienten herrühren.
Beim vorliegenden Beispiel erfolgt die Oxidation bei einer Temperatur von 1100°C in einem Zeitintervall von 60 Sekunden. Danach erfolgt eine Abkühlung auf 750°C und ein erneutes Auf­ heizen auf 1040°C, wo ein NH3-Anneal für 20 Sekunden durchge­ führt wird. Nach einem erneuten Abkühlen auf 750°C erfolgt eine Reoxidation bei 1170°C für eine Zeitdauer von 60 Sekun­ den. Bei dem in Fig. 4 gezeigten Verfahren beträgt die Ge­ samtprozesszeit ca. 400 Sekunden. Allerdings wird, wie ge­ sagt, jeder Wafer einzeln prozessiert, was einen erheblichen Zeitaufwand zur Fertigungsstellung einer gesamten Charge von circa 100 bis 150 Wafern mit sich bringt.
Bei weiteren bekannten Verfahren wird statt NH3 NO oder N2O in einem RTP-Prozess eingesetzt. Ebenfalls möglich ist eine Nitridierung in einem atmosphärischen Oxidationsofen mit NO oder N2O bzw. eine Nitridierung in einem LPCVD-Ofen mit NH3 als Nitridierungsgas.
Ein Verfahren zur Herstellung einer nitridierten Oxidschicht auf einem Silizium-Halbleitersubstrat, das einen Oxidations­ schritt, einen Nitridierungsschritt und einen Reoxidati­ onsschritt aufweist, ist aus GROSS, B. J., (u. a.): An optimi­ zed 850°C Low-Pressure-Furnance Reoxidized Nitrided Oxide (ROXNOX) Process. In: IEEE Trans. Electron Devices, 1991, Vol 38 No. 9 S. 2036-2041 bekannt.
Die DE 195 01 388 A1 beschreibt ein Multiformkristall und ein Gerät für dessen Herstellung.
Aus WIDMANN, D., Mader, H., Friedrich, H.: Technologie hoch­ integrierter Schaltungen, 2. Auflage, Springer, Berlin, 1996, S. 20-29 ist ein Verfahren zur thermischen Oxidation von Sil­ zium-Halbleitersubstraten bekannt.
YANG, W., (u. a.): Optimization of Low-Pressure Nitridati­ on/Reoxidation of SiO2 for Scaled MOS Devices, In: IEEE Trans. Electron Devices, 1988, Vol. 35, No. 7, S. 935-944 beschreiben den Effekt von Niederdruck-Nitridierung bei 950°C und Niederdruck-Reoxidation auf die elektrischen Eigenschaf­ ten von dünnen Siliziumdioxidfilmen.
LAI, S. K., (u. a.): Electrical Properties of Nitrided-Oxide Systems for Use in Gate Dielectrics and EEPROM. In: IEDM In­ ternational Electron Devices Meeting Technical Digest, New York, USA, IEEE, 1983, S. 190-193 beschreibt die elektrischen Eigenschaften von nitridierten und zum Teil reoxidierten Oxidsystemen als Funktion der Prozessbedingungen bei Temperaturen zwischen 900 und 1000°C für die Nitridierung und (Re)Oxidation.
MA, Z. J., LAI, P. T., CHENG; Y. C.: Electrical Characterization and Simulation of Substrate Current in n-MOSFETs with Nitri­ ded/Reoxidized-Nitrided/Reoxidized-Nitrided Oxides as Gate Dielectrics. In: Solid-Strate Electronics, 1992, Vol. 35, No. 10, S. 1433-1439 beschreibt das Verhalten von Gateoxiden bei einer Oxidation von 1.000°C eine Nitridierung von 1.000°C und einer Reoxidation bei 1.000°C.
US 5,198,392 beschreibt ein Verfahren zum Bilden eines nitri­ dierten Siliziumdioxydfilms.
Die DE 198 32 271 A1 beschreibt eine Halbleitervorrichtung mit einer Silizium-Nitridoxidschicht, die auf einem Silizium­ substrat ausgebildet ist, wobei Stickstoff nur in einer Umge­ bung einer Grenzfläche zwischen dem Siliziumsubstrat und der Siliziumnitridoxidschicht verteilt ist.
US 5,891,809 beschreibt die Herstellung eines Dielektrikums unter Verwendung mehrerer Oxidationsschritte und Tem­ perschritte in Stickstoffatmosphäre.
Die US 6,204,125 B1 offenbart ein Verfahren zum Bilden eines nitridierten Tunneloxids, wobei eine Oxidschicht auf einem Tunnelbereich des Substrats gebildet wird, danach eine Nit­ ridschicht in einem LPCVD-Prozess auf der Oxidschicht gebil­ det wird, dann ein Reoxidationsprozess durchgeführt wird und schließlich die Nitridschicht entfernt wird.
Die US 5,258,333 offenbart ein Verfahren zur Herstellung eines nitridierten Tunneloxids, wobei eine über einem Kanal­ bereich liegende Siliziumoberfläche zuerst nitridiert wird, dann eine Oxidschicht auf der nitridierten Siliziumoberfläche gebildet wird, und danach die Oxidschicht und die nitridierte Siliziumoberfläche zur Bildung einer zusammengesetzten die­ lektrischen Schicht oxidiert werden. Insbesondere erfolgt da­ bei die Nitridierung durch einen thermischen Prozess in rei­ nem Ammoniak (NH3).
Temperaturerhöhungen zwischen Oxidation, Nitridierung und Reoxidation sind bei diesen bekannten Verfahren nicht vorgesehen.
Daher ist es Aufgabe der vorliegenden Erfindung, ein verbes­ sertes Verfahren zur Herstellung einer nitridierten Oxid­ schicht auf einem Silizium-Halbleitersubstrat zu schaffen, welches eine Gleichmäßigkeit der Oxiddicke und des Stick­ stoffeinbaus gewährleistet und ein geringes thermisches Budget benötigt.
Erfindungsgemäß wird diese Aufgabe durch das im Anspruch an­ gegebene Herstellungsverfahren gelöst.
Die der vorliegenden Erfindung zugrundeliegende Technik besteht in der Verwendung von NH3 als Nitridierungsgas in einem atmo­ sphärischen Batchofen, welcher gleichzeitig zur Oxidation und zur Reoxidation verwendet wird.
Das erfindungsgemäße Herstellungsverfahren weist gegenüber dem bekannten Lösungsansatz den Vorteil auf, daß mit den (im wesentlichen gleichmäßigen) Temperatur­ erhöhungen zwischen Oxidation, Nitridierung und Reoxidation, die ohne eine Abkühlung dazwischen durchgeführt werden, zunächst eine Verbesserung der Gleichmäßigkeit des Stickstoffeinbaus im Vergleich zu üblichen Verfahren erreichbar ist. Als Folge dessen führt die anschließende Reoxidation ebenfalls zu einer verbesserten Gleichmäßigkeit der Gesamtoxiddicke, da das Oxidwachstum maßgeblich vom Grad der Nitridierung abhängig ist.
Ausführungsbeispiele der Erfindung sind in den Zeichnungen dargestellt und in der nachfolgenden Beschreibung näher er­ läutert.
Es zeigen:
Fig. 1 einen Temperaturverlauf eines Ausführungsbeispiels des erfindungsgemäßen Verfahrens zur Herstellung eines nitridierten Tunneloxids;
Fig. 2 Schichtdicke-Verteilungen für durch einen RTP-Prozess hergestelltes nitridiertes Tunneloxid (A) sowie für gemäß der obigen Ausführungsform mit NH3 in einem Batchofen hergestelltes nitridiertes Tunneloxid (B);
Fig. 3 eine schematische Darstellung einer Halbleiter­ struktur mit einem nitridierten Tunneloxid zur Il­ lustration der der vorliegenden Erfindung zugrunde­ liegenden Problematik; und
Fig. 4 einen beispielhaften Temperaturverlauf für einen üblichen RTP-Prozess zur Herstellung eines nitri­ dierten Tunneloxids.
Fig. 1 zeigt einen Temperaturverlauf eines Ausführungsbei­ spiels des erfindungsgemäßen Verfahrens zur Herstellung eines nitridierten Tunneloxids.
Die vorliegende Ausführungsform wird mit einer Vielzahl von Wafern in einem sogenannten atmosphärischen Batchofen durchge­ führt. Zunächst erfolgt eine Erhöhung der Temperatur auf ein erstes Temperaturplateau bei einer ersten Temperatur T1 von ca. 850°C, wo für ca. 30 Minuten eine Oxidation durchgeführt wird. Anschließend wird die Temperatur weiter auf ein zweites Temperaturplateau bei einer zweiten Temperatur T2 von ca. 900°C erhöht; wo ein NH3-Anneal während ca. 10 Minuten statt­ findet. Eine weitere Temperaturerhöhung führt zu einem drit­ ten Temperaturplateau bei einer dritten Temperatur T3 von ca. 950°C, wo eine Reoxidation für ca. 30 Minuten durchgeführt wird.
Im Gegensatz zu den bekannten Verfahren befinden sich sämtli­ che Wafer während der Hauptprozessschritte Oxidation, NH3- Nitridierung und Reoxidation im thermischen Gleichgewicht, wodurch die Dicke und Zusammensetzung der hergestellten Schicht gleichmäßiger werden als beim bekannten RTP-Prozess, was wiederum zu einer erheblichen Verbesserung der Ausbeute­ stabilität führt. Durch die Nutzung eines derartigen atmo­ sphärischen Batchofens können typischerweise 150-200 Wafer gleichzeitig prozessiert werden, und so kann trotz einer Er­ höhung der Gesamtprozesszeit von 400 Sekunden auf circa 300 Minuten ein höherer Durchsatz erzielt werden.
Typische Dickenbereiche für die nitridierten Tunneloxide lie­ gen zwischen 6,5 nm und 15 nm.
Fig. 2 zeigt Schichtdicke-Verteilungen (in %) für durch einen RTP-Prozess hergestelltes nitridiertes Tunneloxid (A) sowie für gemäß der obigen Ausführungsform mit NH3 in einem Batchofen hergestelltes nitridiertes Tunneloxid (B).
Deutlich ersichtlich ist, dass beim herkömmlichen Verfahren die mit 1 bis 4 bezeichneten Wafer alle eine Schichtdickevertei­ lung aufweisen, die etwa viermal so groß ist wie eine ent­ sprechende Schichtdickeverteilung der Wafer 1' bis 4' bei der oben erläuterten Ausführungsform des erfindungsgemäßen Ver­ fahrens.
Die vorliegende Ausführungsform ist nicht nur auf nitridierte Tunneloxide anwendbar, sondern auch auf ande­ re nitridierte Oxide, beispielsweise auf nitridierte Logik- Gateoxide, welche beispielsweise im Dickenbereich 0,8 nm bis 5 nm liegen.
Bezugszeichenliste
10
,
20
aktive Gebiete
15
Kanalgebiet
30
nitridiertes Oxid
40
Gatestapel
G Grenzfläche
A Ausschnitt

Claims (1)

1. Verfahren zur Herstellung einer nitridierten Oxidschicht auf einem Silizium-Halbleitersubstrat mit den Schritten:
  • a) Einbringen einer Vielzahl von Wafern in einen atmosphärischen Batchofen;
  • b) Durchführen eines Oxidationsschritts bei einer ersten vorbe­ stimmten Temperatur (T1);
  • c) Durchführen eines Nitridierungsschritts bei einer zweiten vorbestimmten Temperatur (T2);
  • d) Durchführen eines Reoxidationsschritts bei einer dritten vor­ bestimmten Temperatur (T3);
  • e) Abkühlen und Entfernen der Wafer aus dem atmosphärischen Bat­ chofen
wobei
der Oxidationsschritt b) bei einer Temperatur (T1) von 830-870°C stattfindet;
der Nitridierungsschritt c) in einer NH3-Atmosphäre bzw. NH3/N2- Atmosphäre bei einer Temperatur (T2) von 880-920°C stattfin­ det;
der Reoxidationsschritt d) bei einer Temperatur (T3) von 930-­ 970°C stattfindet, und
zwischen den Schritten b), c) und d) keine Abkühlung durchgeführt wird.
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Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2004253777A (ja) * 2003-01-31 2004-09-09 Nec Electronics Corp 半導体装置及び半導体装置の製造方法

Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5198392A (en) * 1989-11-20 1993-03-30 Oki Electric Industry Co., Ltd. Method of forming a nitrided silicon dioxide (SiOx Ny) film
US5258333A (en) * 1992-08-18 1993-11-02 Intel Corporation Composite dielectric for a semiconductor device and method of fabrication
DE19501388A1 (de) * 1994-01-27 1995-08-03 Trw Inc Multiformkristall und Gerät zu dessen Herstellung
US5891809A (en) * 1995-09-29 1999-04-06 Intel Corporation Manufacturable dielectric formed using multiple oxidation and anneal steps
DE19832271A1 (de) * 1998-01-14 1999-07-15 Mitsubishi Electric Corp Halbleitervorrichtung und Herstellungsverfahren derselben
US6204125B1 (en) * 1999-06-28 2001-03-20 Hyundai Electronics Industries Co., Ltd. Method of forming a gate in a stack gate flash EEPROM cell

Family Cites Families (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5851892A (en) * 1997-05-07 1998-12-22 Cypress Semiconductor Corp. Fabrication sequence employing an oxide formed with minimized inducted charge and/or maximized breakdown voltage
US6541394B1 (en) * 1999-01-12 2003-04-01 Agere Systems Guardian Corp. Method of making a graded grown, high quality oxide layer for a semiconductor device

Patent Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5198392A (en) * 1989-11-20 1993-03-30 Oki Electric Industry Co., Ltd. Method of forming a nitrided silicon dioxide (SiOx Ny) film
US5258333A (en) * 1992-08-18 1993-11-02 Intel Corporation Composite dielectric for a semiconductor device and method of fabrication
DE19501388A1 (de) * 1994-01-27 1995-08-03 Trw Inc Multiformkristall und Gerät zu dessen Herstellung
US5891809A (en) * 1995-09-29 1999-04-06 Intel Corporation Manufacturable dielectric formed using multiple oxidation and anneal steps
DE19832271A1 (de) * 1998-01-14 1999-07-15 Mitsubishi Electric Corp Halbleitervorrichtung und Herstellungsverfahren derselben
US6204125B1 (en) * 1999-06-28 2001-03-20 Hyundai Electronics Industries Co., Ltd. Method of forming a gate in a stack gate flash EEPROM cell

Non-Patent Citations (5)

* Cited by examiner, † Cited by third party
Title
GROSS, B.J., (u.a.): An optimized 850C Low- Pressure-Frunace Reoxidized Nitrided Oxide (ROXNOX) Process, in: IEEE Trans. Elektron Devices, 1991, Vol. 38, No. 9, S. 2036-2041 *
LAI, S.K., (u.a.): Electrical Properties of Nitrided-Oxide Systems for Use in Gate Dielectricsand EEPROM, in: IEDM International Electron Devices Meeting Technical Digest, New York, USA IEEE, 1983, S. 190-193 *
MA, Z.J., LAI, P.T., CHENG, Y.C.: Electrical Characterization and Simulation of Substrate Current in n-MOSFETs with Nitrided/Reoxidized- Nitrited Oxides as Gate Dielectrics, in: *
WIDMANN, D., MADER, H., FRIEDRICH, H.: Technologie hochintegrierter Schaltungen, 2. Aufl., Springer, Berlin, 1996, S. 20-29 *
YANG, W., (u.a.): Optimization of Low-Pressure Nitridation/Reoxidation of SiO2 for Scaled MOS Devices, in: IEEE Trans. Electron Devices, 1988, Vol. 35, No. 7, S. 935-944 *

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