DE10127580B4 - In-situ-Maskentechnik zur Produktion von III-V Halbleiter-Bauelementen - Google Patents
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Abstract
Verfahren
zur Herstellung von III-V Halbleiterbauelementen, wobei
in einem Maskierungsschritt eine Maske auf eine Probe aufgebracht wird,
mindestens ein Maskenmaterial ein einkristallines III-V Halbleitermaterial ist,
in oder auf der Probe in einem Ätzschritt (3) unter der Verwendung der Maske eine Struktur geätzt wird,
dadurch gekennzeichnet, daß
die Ätzrate beim Ätzschritt (3) in Abhängigkeit von der Zusammensetzung des Maskenmaterials so gewählt wird, daß die Maske während des Ätzens aufgelöst wird.
in einem Maskierungsschritt eine Maske auf eine Probe aufgebracht wird,
mindestens ein Maskenmaterial ein einkristallines III-V Halbleitermaterial ist,
in oder auf der Probe in einem Ätzschritt (3) unter der Verwendung der Maske eine Struktur geätzt wird,
dadurch gekennzeichnet, daß
die Ätzrate beim Ätzschritt (3) in Abhängigkeit von der Zusammensetzung des Maskenmaterials so gewählt wird, daß die Maske während des Ätzens aufgelöst wird.
Description
- Bei der Herstellung von III-V Halbleiter-Bauelementen werden in der Regel Maskierungsschritte zur Strukturierung der Oberfläche einer Probe verwendet. Dabei wird die Oberfläche der Probe teilweise mit einer Maske, z.B. aus SiO2 als amorphem Material, abgedeckt. Anschließend wird das Probenmaterial im nicht von der Maske abgedeckten Bereich durch einen Ätzschritt (trocken- oder naßchemisch) entfernt.
- Unter Probe wird hier jedes Material verstanden, das im Rahmen der Herstellung von Halbleiter-Bauelementen strukturiert wird.
- Beispielsweise ist aus dem Dokument
US 5 316 640 ein Verfahren zum Ätzen von Halbleiterstrukturen bekannt, das die Verwendung einer Ätzmaske aus SiO2 vorsieht. - Nachteilig ist dabei, daß die Probe zur Entfernung der SiO2 Maske von der Oberfläche aus der Epitaxie-Anlage genommen werden muß, so daß die Probe Luftverunreinigungen und dem Sauerstoff der Luft ausgesetzt wird. Die Kontaminierung ist besonders bei Strukturen negativ, die Aluminium enthalten, da dieser eine hohe Bindungsaffinität zu Sauerstoff aufweist. Da solche Strukturen gerade für die Halbleiter-Laser Herstellung von großer Bedeutung sind, wirkt sich die Kontaminierung besonders negativ aus.
- Das Dokument
US 5 372 675 beschreibt ein Verfahren zur Erzeugung feiner Halbleiterstrukturen, das die Strukturierung einer Halbleiterprobe unter Verwendung einer Ätzmaske vorsieht, die eine aus einem III-V-Halbleitermaterial gebildete Schicht aufweist. - Aus dem Dokument „In-Situ Etching of InP based BH Laser structures in MOVPE", R. Gessner et al, Proc. IPRM 2001, S. 398-400 ist ein Verfahren zum in-situ-Ätzen von InP zur Herstellung von Laserstrukturen bekannt.
- Weiter wird in dem Dokument „MOVPE-based in-situ etching of In(GaAs)P/InP using tertiarybutylchloride", P. Wolfram et al. J. of Chryst. Growth 221, 2000, S. 177-182 ein Verfahren zum in-situ-Ätzen von InP- und InGaAsP-Schichten beschrieben.
- Der vorliegenden Erfindung liegt die Aufgabe zugrunde, ein Verfahren zu schaffen, mit dem bei der Herstellung von III-V Halbleiter-Bauelementen das Entfernen der Maske vom Halbleitermaterial und ein weiteres Aufbringen von Schichten in einfacher Weise in-situ möglich ist.
- Diese Aufgabe wird erfindungsgemäß durch ein Verfahren mit den Merkmalen des Anspruchs 1 gelöst.
- Danach wird in einem Maskierungsschritt eine Maske auf die Probe aufgebracht, wobei mindestens ein Maskenmaterial ein einkristallines III-V-Halbleitermaterial ist und in oder auf der Probe in einem Ätzschritt unter der Verwendung der Maske eine Struktur geätzt wird. Dabei wird die Ätzrate beim Ätzschritt in Abhängigkeit von der Zusammensetzung des Maskenmaterials so gewählt, daß die Maske während des Ätzens aufgelöst wird. Durch die Verwendung von einkristallinem III-V-Halbleitermaterial in mindestens einem Maskenmaterial kann eine „selbstauflösende Maske" geschaffen werden, die in-situ von der Probe entfernbar ist. Die Maske wird beim Ätzen mit aufgelöst, was eine erhebliche Einsparung an Prozesszeit bedeutet.
- Dabei ist es vorteilhaft, wenn mindestens ein Maskenmaterial GaxIn1-yAsyP1-y oder AlGaInAs ist. Diese Materialein lassen sich in besonders kontrollierter Weise durch Ätzen von der Probe entfernen.
- Besonders vorteilhaft ist es, wenn nach Erzeugen einer Struktur auf und/oder in der Maske, insbesondere durch Lithographie, ein Ätzschritt erfolgt, bei dem als Ätzmittel Tertiärbutylchlorid (TBCl) verwendet wird. Dieses Ätzmittel ist deutlich milder als die üblicherweise bei in-situ Verfahren verwendeten Halogenwasserstoffe (z.B. HCl). Auch läßt sich die Ätzrate dieses Ätzmittels in besonders einfacher Weise steuern.
- Mit Vorteil wird der Ätzschritt in-situ in der gleichen Vorrichtung durchgeführt, in der zuvor die Struktur in und/oder auf der Probe aufgebracht wurde.
- Vorteilhafterweise wird nach dem Ätzschritt mindestens eine epitaktische Schicht, insbesondere eine Schutzschicht auf die Oberfläche aufgebracht. Auch dies erfolgt in-situ.
- Vorteilhafterweise ist nach Abschluß des Verfahrens das entstandene Halbleiterbauelement in einem Halbleiterlaser einsetzbar.
- Die Erfindung wird nachfolgend unter Bezugnahme auf die Figur der Zeichnungen an einem Ausführungsbeispiel näher erläutert.
- Es zeigen:
-
1 einen Ablauf einer Ausführungsform des erfindungsgemäßen Verfahrens; -
2 eine graphische Darstellung von Meßwerten betreffend die Abhängigkeit der Ätzrate von der Zusammensetzung des Maskenmaterials. - Die Herstellung von Halbleiter-Bauelementen mittels Epitaxie und Maskierung sind grundsätzlich bekannt, so daß in
1 nur die wesentlichen Schritte zur Erläuterung der Erfindung dargestellt sind. Dabei dient ein Wafer als Substrat. Das Substrat mit dem Schichtenaufbau des Halbleiterbauelements wird als Probe bezeichnet. Die Maske wird dabei über dem Schichtensystem angeordnet. - Im ersten Verfahrensschritt
1 wird eine Bauelement-Grundstruktur auf einem Wafer epitaktisch aufgebracht. Dabei wird auch das Maskenmaterial epitaktisch aufgebracht. Erfindungsgemäß ist dies hier GaxIn1-yAsyP1-y. Alternativ kann auch AlGaInAs verwendet werden. - Im zweiten Verfahrensschritt
2 wird die Oberfläche der Probe und der Maske in an sich bekannter Weise, z.B. durch Lithographie ex-situ strukturiert. - Im dritten Verfahrensschritt
3 , dem Ätzschritt, wird in der Epitaxie-Anlage eine Struktur auf und/oder in der Probe geätzt. Dabei wird Tertiärbutylchlorid (2-Chlor-2- methylpropan; TBCl) als Ätzgas verwendet. TBCl ist chemisch weniger aggressiv als die üblicherweise verwendeten Ätzgase, wie z.B. Chlorwasserstoff basieren. - Es hat sich überraschenderweise gezeigt, daß die Ätzrate von TBCl bei dem Maskenmaterial GaxIn1-yAsyP1-y von der Zusammensetzung des Maskenmaterials, also von x und y abhängt. Dies wird in
2 näher beschrieben. - Im vorliegenden Fall wird die Zusammensetzung des Maskenmaterials gerade so gewählt, daß nach dem Ende des Ätzschrittes
3 das Maskenmaterial gerade von der Probe entfernt ist. Alternativ kann das Maskenmaterial bis auf eine vorbestimmbare Menge entfernt werden. - Da diese Ätzung in-situ in der Epitaxie-Anlage erfolgt, wird eine Kontaminierung der Oberfläche vermieden und wertvolle Prozesszeit eingespart.
- Anschließend werden in einem vierten Verfahrensschritt
4 weitere Schichten übergewachsen, insbesondere epitaktische Schutzschichten. Dies ist besonders bei aluminiumhaltigen Probenmaterialien von Vorteil, da diese besonders kontaminationsempfindlich sind. - Nach der Beendigung des erfindungsgemäßen Verfahrens kann die erzeugte Halbleiterstruktur z.B. in einem Halbleiter-Laser verwendet werden.
- In
2 sind Meßwerte graphisch dargestellt, in denen die Abhängigkeit der Ätzrate (in nm/h) auf der Ordinate aufgetragen ist. Der Gallium-Anteil x im Maskenmaterial GaxIn1-yAsyP1-y (in %) ist auf der Abszisse aufgetragen. Die Meßwerte wurden bei einer Temperatur von 580 °C und einem TBCl-Fluß von 8,2 × 10–5 mol/min (ohne PH3) erreicht. Der Wasserstoffträgergasstrom betrug 16 l/min. - Aus
2 ist zu erkennen, daß bei niedrigem Gallium-Anteil eine hohe Ätzrate erreicht wird. Bei einem Gallium-Anteil von 10 % ist die Ätzrate auf etwa die Hälfte gefallen. Eine Erhöhung auf 15 % halbiert diesen Wert nochmals. Somit hängt die Ätzrate in etwa linear vom Gallium-Anteil ab. - Durch eine solche funktionale Abhängigkeit kann die Ätzrate so eingestellt werden, daß eine Maske vorgegebener Dicke nach Abschluß des Ätzens von der Probe gänzlich entfernt ist. Sollte die Ätzrate vorgegeben sein, so kann die Dicke des Maskenmaterials entsprechend bestimmt werden, um das gleiche Ziel zu erreichen.
- Die Erfindung beschränkt sich in ihrer Ausführung nicht auf die vorstehend angegebenen bevorzugten Ausführungsbeispiele. Vielmehr ist eine Anzahl von Varianten denkbar, die von dem erfindungsgemäßen Verfahren und der erfindungsgemäßen Vorrichtung auch bei grundsätzlich anders gearteten Ausführungen Gebrauch machen.
-
- 1
- Erste Verfahrensschritt: Wachsen der Grundstruktur und des
- Maskenmaterials
- 2
- Zweiter Verfahrensschritt: Strukturierung der Maske (z.B.
- Lithographie)
- 3
- Dritter Verfahrensschritt: Ätzschritt
- 4
- Vierter Verfahrensschritt: Überwachsen
Claims (8)
- Verfahren zur Herstellung von III-V Halbleiterbauelementen, wobei in einem Maskierungsschritt eine Maske auf eine Probe aufgebracht wird, mindestens ein Maskenmaterial ein einkristallines III-V Halbleitermaterial ist, in oder auf der Probe in einem Ätzschritt (
3 ) unter der Verwendung der Maske eine Struktur geätzt wird, dadurch gekennzeichnet, daß die Ätzrate beim Ätzschritt (3 ) in Abhängigkeit von der Zusammensetzung des Maskenmaterials so gewählt wird, daß die Maske während des Ätzens aufgelöst wird. - Verfahren nach Anspruch 1, dadurch gekennzeichnet daß mindestens ein Maskenmaterial GaxIn1-yAsyP1-y oder AlGaInAs ist.
- Verfahren nach Anspruch 1 oder 2, dadurch gekennzeichnet daß nach einem Erzeugen einer Struktur auf und/oder in der Maske (
2 ), insbesondere durch Lithographie, der Ätzschritt (3 ) erfolgt. - Verfahren nach mindestens einem der vorhergehenden Ansprüche, dadurch gekennzeichnet daß beim Ätzschritt (
3 ) als Ätzmittel Tertiärbutylchlorid verwendet wird, das die Maske auflöst. - Verfahren nach Anspruch 4, dadurch gekennzeichnet daß die Ätzrate so gewählt wird, daß die Maske mit dem Ende des Ätzschrittes (
3 ) zum Ätzen der Struktur in oder auf der Probe von der Probe entfernt ist. - Verfahren nach Anspruch 4 oder 5, dadurch gekennzeichnet, daß der Ätzschritt (
3 ) in-situ in der selben Vorrichtung durchgeführt wird, in der zuvor die Struktur in und/oder auf der Probe geätzt wurde. - Verfahren nach mindestens einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, daß nach dem Ätzschritt (
3 ) mindestens eine epitaktische Schicht, insbesondere eine Schutzschicht auf die Oberfläche aufgebracht wird. - Verfahren nach mindestens einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, daß nach Abschluß des Verfahrens die Probe in einem Halbleiterbauelement, insbesondere einem Halbleiterlaser einsetzbar ist.
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Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
GB2411520A (en) * | 2004-02-25 | 2005-08-31 | Agilent Technologies Inc | Method of forming laser mesa by reactive ion etching followed by in situ etching in regrowth reactor |
KR20180014903A (ko) | 2016-08-01 | 2018-02-12 | 삼성디스플레이 주식회사 | 전자 소자, 이의 실장 방법 및 이를 포함하는 표시 장치의 제조 방법 |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4676863A (en) * | 1985-01-25 | 1987-06-30 | Kabushiki Kaisha Toshiba | Method of fabricating a mesa stripe on a semiconductor wafer plane |
US5316640A (en) * | 1991-06-19 | 1994-05-31 | Matsushita Electric Industrial Co., Ltd. | Fabricating method of micro lens |
US5372675A (en) * | 1992-08-26 | 1994-12-13 | Matsushita Electric Industrial Co., Ltd. | Method for producing fine structure for electronic device |
Family Cites Families (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE3215410A1 (de) * | 1982-04-24 | 1983-10-27 | Licentia Patent-Verwaltungs-Gmbh, 6000 Frankfurt | Verfahren zum herstellen von oeffnungen mit hilfe einer maske in einer auf einer unterlage befindlichen schicht |
US4595454A (en) * | 1984-06-15 | 1986-06-17 | At&T Bell Laboratories | Fabrication of grooved semiconductor devices |
US4661204A (en) * | 1985-10-25 | 1987-04-28 | Tandem Computers Inc. | Method for forming vertical interconnects in polyimide insulating layers |
DE3776325D1 (de) * | 1987-04-16 | 1992-03-05 | Ibm | Verfahren zur herstellung von kontaktoeffnungen in einer doppellagenisolation. |
JP2757642B2 (ja) * | 1991-12-20 | 1998-05-25 | 日本電気株式会社 | ドライエッチング方法 |
JPH05217995A (ja) | 1992-02-04 | 1993-08-27 | Fujitsu Ltd | 半導体装置の製造方法 |
JP3129510B2 (ja) * | 1992-03-19 | 2001-01-31 | 富士通株式会社 | InGaPのエッチング方法及びそのエッチング方法を用いた半導体装置の製造方法 |
JPH05299764A (ja) * | 1992-04-23 | 1993-11-12 | Matsushita Electric Ind Co Ltd | 半導体レーザの製造方法 |
JP2500443B2 (ja) * | 1993-06-01 | 1996-05-29 | 日本電気株式会社 | 化合物半導体のドライエッチング方法 |
KR0161430B1 (ko) * | 1995-08-31 | 1999-02-01 | 김광호 | 스페이서를 이용한 트렌치 형성방법 |
JP3323389B2 (ja) * | 1996-02-01 | 2002-09-09 | 株式会社テラテック | 半導体素子の製造方法 |
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2001
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- 2001-07-30 EP EP01969202A patent/EP1390970A1/de not_active Withdrawn
- 2001-07-30 WO PCT/DE2001/002915 patent/WO2002097873A1/de not_active Application Discontinuation
-
2002
- 2002-01-18 US US10/052,950 patent/US6699778B2/en not_active Expired - Lifetime
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4676863A (en) * | 1985-01-25 | 1987-06-30 | Kabushiki Kaisha Toshiba | Method of fabricating a mesa stripe on a semiconductor wafer plane |
US5316640A (en) * | 1991-06-19 | 1994-05-31 | Matsushita Electric Industrial Co., Ltd. | Fabricating method of micro lens |
US5372675A (en) * | 1992-08-26 | 1994-12-13 | Matsushita Electric Industrial Co., Ltd. | Method for producing fine structure for electronic device |
Non-Patent Citations (7)
Title |
---|
GESSNER R. et al.: In-situ Etching of InP Based BH Laser Structures in MOVPE. In: Int.Conf. on In- dium Phosphide and Related Materials, Nara, Japan, 14-18, May 2001, IEEE 2001, pp. 398-400 |
GESSNER R. et al.: In-situ Etching of InP Based BH Laser Structures in MOVPE. In: Int.Conf. on In-dium Phosphide and Related Materials, Nara, Japan, 14-18, May 2001, IEEE 2001, pp. 398-400 * |
IMANAKA K. et al.: A novel technique to fabricate GaInAsP/InP buried heterostructure laser diodes. In: Appl.Phys.Lett. 44(10), 15. May 1984, pp. 975- 7 |
IMANAKA K. et al.: A novel technique to fabricate GaInAsP/InP buried heterostructure laser diodes. In: Appl.Phys.Lett. 44(10), 15. May 1984, pp. 975-7 * |
JP 05-217 995 A. In: Patent Abstracts of Japan |
JP 05217995 A. In: Patent Abstracts of Japan * |
WOLFRAM P. et al.: MOVPE-based in situ etching of In(GaAs)P/InP using tertiarybutylchloride. In: J. Crystal Crowth 221, Dec. 2000, pp. 177-82 * |
Also Published As
Publication number | Publication date |
---|---|
DE10127580A1 (de) | 2002-12-05 |
US20020182879A1 (en) | 2002-12-05 |
EP1390970A1 (de) | 2004-02-25 |
US6699778B2 (en) | 2004-03-02 |
WO2002097873A1 (de) | 2002-12-05 |
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