CN206388700U - 一种可靠性高的封装体 - Google Patents
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Abstract
本实用新型提供一种可靠性高的封装体，包括基板、设置在所述基板表面的金属层及通过导电焊料粘贴在所述金属层上的芯片，所述金属层表面具有图形化的沟槽，以限制所述导电焊料的流动。本实用新型的优点在于，在基板的金属层的表面设置图形化的沟槽，所述沟槽可容纳导电焊料，进而在立面上增加了溢胶空间，有效避免导电焊料横向溢出，且沟槽会阻碍导电焊料的流动，导电焊料横向溢出的距离大大减小，从而提高封装体的可靠性。
Description
技术领域
本实用新型涉及半导体封装领域，尤其涉及一种可靠性高的封装体。
背景技术
在半导体封装中，粘贴芯片后，导电焊料在基板表面会存在溢出。参见图1所示，芯片10通过导电焊料13粘贴在基板11的金属层12上，导电焊料13(例如，银浆)会从芯片10与金属层12的粘贴处溢出，其溢出范围大约在200～300微米。目前有一些小尺寸的封装结构，封装体积小却需要塑封一颗大芯片或几颗较大芯片，这使得芯片外侧与封装边缘距离较近。如图1所示，在一些半导体封装中，芯片外侧与封装边缘的距离仅为250微米，导致导电焊料很容易溢出到封装边缘，甚至从封装体中漏出。在后续切割操作时，上述封装结构易露出银浆，由此会引发较为严重的可靠性问题，且也易在做可靠性测试时出现分层或失效。同时，由于芯片底部是有背金，需要导电，且对导电性要求较高，无法用薄膜(film)等导电性性差的粘结剂作为黏晶材料，且底部必须有金属导通。
因此，需要设法管控导电焊料的溢出范围，以在小尺寸的封装结构中塑封相对较大的芯片。
实用新型内容
本实用新型所要解决的技术问题是，提供一种可靠性高的封装体，其能够在立面上增加了溢胶空间，有效避免导电焊料横向溢出，提高封装体的可靠性。
为了解决上述问题，本实用新型提供了一种可靠性高的封装体，包括基板、设置在所述基板表面的金属层及通过导电焊料粘贴在所述金属层上的芯片，所述金属层表面具有图形化的沟槽，以限制所述导电焊料的流动。
进一步，所述沟槽贯穿所述金属层。所述图形化的沟槽由多个子图形排列形成。多个所述子图形排列成矩阵，以形成图形化的沟槽。多个所述子图形均匀分布，以形成图形化的沟槽。每一子图形为矩形、圆形或叉形凹槽。所述图形化的沟槽为回型结构。所述导电焊料为导电银浆。所述芯片朝向所述基板的表面具有金属层，所述导电焊料连接所述芯片的金属层及所述基板表面的金属层。
本实用新型的优点在于，在基板的金属层的表面设置图形化的沟槽，所述沟槽可容纳导电焊料，进而在立面上增加了溢胶空间，有效避免导电焊料横向溢出，且沟槽会阻碍导电焊料的流动，导电焊料横向溢出的距离大大减小，从而提高封装体的可靠性。
附图说明
图1现有的封装结构的结构示意图；
图2是本实用新型封装体的结构示意图；
图3是本实用新型封装体的沟槽的形状示意图；
图4是本实用新型封装体的沟槽的另一形状示意图；
图5是本实用新型封装体的沟槽的另一形状示意图。
具体实施方式
下面结合附图对本实用新型提供的一种可靠性高的封装体的具体实施方式做详细说明。
参见图2所示，本实用新型可靠性高的封装体包括基板20、设置在所述基板20表面的金属层21及通过导电焊料22粘贴在所述金属层21上的芯片23。为了清楚描述本实用新型技术方案，全文以封装体封装一个芯片为例进行说明，当然，本实用新型并不限于此。
优选地，所述导电焊料可以为导电银奖等本领域技术人员熟知的导电焊料，所述芯片23朝向所述基板20的表面具有金属层25，所述导电焊料22连接所述芯片的金属层25及所述基板20表面的金属层21。
参见图2及图3所示，所述金属层21表面具有图形化的沟槽24，以限制所述导电焊料22的流动。其优点在于，图形化的沟槽24可容纳导电焊料，进而在立面上增加了溢胶空间，有效避免导电焊料横向溢出，且沟槽24会阻碍导电焊料22的流动，导电焊料横向溢出的距离大大减小，从而提高封装体的可靠性。
优选地，所述沟槽24可贯穿所述金属层21或者不贯穿所述金属层21。例如，对于导电性要求较高的封装体或者导电焊料22用量少的封装体，其沟槽24可不贯穿金属层21，对于其他类型的封装体，所述沟槽24可贯穿所述金属层21。参见图2所示，在本具体实施方式中，所述凹槽24贯穿所述金属层21。
优选地，所述沟槽24的图形可多种多样，只要满足本实用新型的目的即可。参见图3所示，在本具体实施方式中，所述沟槽24为回形结构。所述沟槽24边缘至所述金属层21的边缘的距离W可根据芯片的大小进行调整，进一步限制导电焊料横向溢出的距离。优选地，所述沟槽24的图形应均匀或近似均匀地分布，以使导电焊料22在金属层21表面均匀分布，提高可靠性。
优选地，所述图形化的沟槽24由多个子图形排列形成。所述子图形有规律或者无规律、均匀或者不均匀地排列，在满足本实用新型目的的前提下，本实用新型对子图形的形状及排列不进行限定。其优点在于，多个子图形可进一步减慢导电焊料的流动，从而进一步减小导电焊料横向流动距离；同时，多个子图形规律排列可使导电焊料22在金属层21表面均匀分布，避免由于导电焊料22不均匀分布而带来的芯片23与基板20接触不良的问题。进一步，每一子图形为矩形、圆形或叉形凹槽。例如，参见图4所示，多个矩形子图形均匀排列成矩阵，以形成图形化的沟槽24，所述矩形可以为方形；参见图5所示，多个叉形子图形均匀排列成矩阵，以形成图形化的沟槽24。
本实用新型可靠性高的封装体在基板20的金属层21的表面设置图形化的沟槽24，导电焊料22可填充所述凹槽24，进而在立面上增加了溢胶空间，有效避免导电焊料横向溢出，且沟槽24会阻碍导电焊料22的流动，导电焊料横向溢出的距离大大减小，从而提高封装体的可靠性，进而可实现在小尺寸的封装结构中封装大尺寸的芯片或子小尺寸的封装结构中封装多个较大尺寸芯片的目的。
以上所述仅是本实用新型的优选实施方式，应当指出，对于本技术领域的普通技术人员，在不脱离本实用新型原理的前提下，还可以做出若干改进和润饰，这些改进和润饰也应视为本实用新型的保护范围。
Claims (9)
1.一种可靠性高的封装体，包括基板、设置在所述基板表面的金属层及通过导电焊料粘贴在所述金属层上的芯片，其特征在于，所述金属层表面具有图形化的沟槽，以限制所述导电焊料的流动。
2.根据权利要求1所述的可靠性高的封装体，其特征在于，所述沟槽贯穿所述金属层。
3.根据权利要求1所述的可靠性高的封装体，其特征在于，所述图形化的沟槽由多个子图形排列形成。
4.根据权利要求3所述的可靠性高的封装体，其特征在于，多个所述子图形排列成矩阵，以形成图形化的沟槽。
5.根据权利要求3所述的可靠性高的封装体，其特征在于，多个所述子图形均匀分布，以形成图形化的沟槽。
6.根据权利要求3所述的可靠性高的封装体，其特征在于，每一子图形为矩形、圆形或叉形凹槽。
7.根据权利要求1所述的可靠性高的封装体，其特征在于，所述图形化的沟槽为回型结构。
8.根据权利要求1所述的可靠性高的封装体，其特征在于，所述导电焊料为导电银浆。
9.根据权利要求1所述的可靠性高的封装体，其特征在于，所述芯片朝向所述基板的表面具有金属层，所述导电焊料连接所述芯片的金属层及所述基板表面的金属层。
Priority Applications (1)
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| CN201621455504.3U CN206388700U (zh) | 2016-12-28 | 2016-12-28 | 一种可靠性高的封装体 |
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Publications (1)
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| CN201621455504.3U Active CN206388700U (zh) | 2016-12-28 | 2016-12-28 | 一种可靠性高的封装体 |
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Cited By (1)
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|---|---|---|---|---|
| US20220044988A1 (en) * | 2020-08-05 | 2022-02-10 | Hyundai Motor Company | Soldering structure and power module comprising the same |
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2016
- 2016-12-28 CN CN201621455504.3U patent/CN206388700U/zh active Active
Cited By (2)
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| US20220044988A1 (en) * | 2020-08-05 | 2022-02-10 | Hyundai Motor Company | Soldering structure and power module comprising the same |
| US11862537B2 (en) * | 2020-08-05 | 2024-01-02 | Hyundai Motor Company | Soldering structure with groove portion and power module comprising the same |
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