CN204667021U - 阵列基板和显示装置 - Google Patents

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Abstract

本实用新型提供一种阵列基板和一种显示装置，所述阵列基板包括多条栅线和用于向多条栅线依次提供扫描信号的栅极驱动电路，所述阵列基板还包括用于释放电荷的放电信号线和设置在放电信号线与所述栅线之间的放电电路，所述放电电路用于在所述栅极驱动电路关闭时将所述栅线和所述放电信号线导通。本实用新型能够在栅极驱动电路关闭时对栅线进行放电，从而减少残像的产生。

Description

阵列基板和显示装置
技术领域
本实用新型涉及显示技术领域，具体涉及一种阵列基板和一种包括该阵列基板的显示装置。
背景技术
液晶显示装置因具有与低辐射、厚度薄等特点，而被广泛应用于手机、电视、笔记本电脑等电子显示设备。显示面板被多条栅线和多条数据线划分为多个像素单元，每个像素单元内设置有薄膜晶体管。驱动电路对显示面板进行驱动时，依次向栅线上加载扫描信号，从而将被扫描的栅线对应的一行像素单元中的薄膜晶体管导通，数据上的电压信号通过导通的薄膜晶体管加载在像素电极。
但是在驱动电路关闭时，像素单元内的薄膜晶体管往往不会同时关闭，从而导致显示面板出现一定的残像。
实用新型内容
本实用新型的目的在于提供一种阵列基板和一种包括该阵列基板的显示装置，从而减少驱动电路关闭时出现的残像。
为了实现上述目的，本实用新型提供一种阵列基板，包括多条栅线和用于向多条栅线依次提供扫描信号的栅极驱动电路，所述阵列基板还包括用于释放电荷的放电信号线和设置在该放电信号线与所述栅线之间的放电电路，所述放电电路用于在所述栅极驱动电路关闭时将所述栅线和所述放电信号线导通。
优选地，所述放电电路包括控制线和与多条栅线一一对应的多个第一薄膜晶体管，所述第一薄膜晶体管的栅极与所述控制线相连，所述第一薄膜晶体管的第一极与所述栅线相连，所述第一薄膜晶体管的第二极与所述放电信号线相连。
优选地，所述放电电路还包括与所述第一薄膜晶体管的第二极同层设置的传输部，所述传输部的一端与所述放电信号线形成交叠区，所述交叠区的部分设置有过孔，所述传输部通过所述过孔与所述放电信号线相连，所述传输部的另一端至少与一个所述第一薄膜晶体管的第二极相连。
优选地，所述放电电路均设置在所述阵列基板的非显示区，所述第一薄膜晶体管的栅极和第一极、第二极之间设置有绝缘层，所述第一薄膜晶体管的栅极与所述控制线形成为一体结构。
优选地，每个所述传输部连接一个第一薄膜晶体管的第二极。
优选地，每个所述传输部与相邻的两个第一薄膜晶体管的第二极均相连。
优选地，所述阵列基板还包括与多条栅线一一对应的多个防静电部，每个防静电部连接在相应的栅线和所述放电信号线之间，以将所述栅线上的静电释放至所述放电信号线。
优选地，所述防静电部包括第二薄膜晶体管和第三薄膜晶体管，所述第二薄膜晶体管和第三薄膜晶体管的栅极和第一极均与所述栅线相连，所述第二薄膜晶体管和第三薄膜晶体管的第二极均与所述放电信号线相连，所述第二薄膜晶体管为N型薄膜晶体管，所述第三薄膜晶体管为P型薄膜晶体管。
相应地，本实用新型还提供一种显示装置，包括本实用新型所提供的上述阵列基板。
在本实用新型中，阵列基板上设置有放电电路，当栅极驱动电路关闭而没有扫描信号输出时，放电电路可以将栅线与放电信号线导通，从而将栅线上残留的电荷释放至放电信号线，使得像素单元内的薄膜晶体管关闭，从而减少了残像的出现，提高了显示装置的图像显示质量；并且，阵列基板上还设置有防静电部，能够将栅线上的静电进行释放，防静电部和放电电路共用一个放电信号线，从而在实现对栅线的放电和防静电的同时尽可能地简化了阵列基板的结构。
附图说明
附图是用来提供对本实用新型的进一步理解，并且构成说明书的一部分，与下面的具体实施方式一起用于解释本实用新型，但并不构成对本实用新型的限制。在附图中：
图1是本实用新型的实施方式中阵列基板的等效电路示意图；
图2是本实用新型的一种实施方式中阵列基板的结构示意图；
图3是图2中A-A剖视图；
图4是本实用新型的另一种实施方式中阵列基板的结构示意图。
其中，附图标记为：1、栅线；2、栅极驱动电路；3、放电电路；31、第一薄膜晶体管；311、第一薄膜晶体管的第一极；312、第一薄膜晶体管的第二极；313、第一薄膜晶体管的栅极；314、绝缘层；315、有源层；32、控制线；33、放电信号线；out、放电信号线的输出端；34、传输部；35、过孔；36、导电材料层；4、防静电部；42、第二薄膜晶体管；43、第三薄膜晶体管；5、衬底基板。
具体实施方式
以下结合附图对本实用新型的具体实施方式进行详细说明。应当理解的是，此处所描述的具体实施方式仅用于说明和解释本实用新型，并不用于限制本实用新型。
作为本实用新型的一方面，提供一种阵列基板，如图1所示，包括多条栅线1和用于向多条栅线1依次提供扫描信号的栅极驱动电路2，所述阵列基板还包括用于释放电荷的放电信号线33和设置在放电信号线33与栅线1之间的放电电路3，放电电路3用于在栅极驱动电路2关闭时将栅线1与放电信号线33导通。
所述阵列基板用于显示图像时，栅极驱动电路向每条依次提供扫描信号。所述栅极驱动电路关闭时，所述栅极驱动电路没有信号输出，不需要进行图像显示。
本实用新型中，放电信号线33的输出端out可以与公共电极、接地线等结构相连，以便放电信号线在接收大量电荷后，可以将其导入到整个显示面板的电路回路中，达到释放电荷的目的。
本实用新型通过放电电路的设置，当栅极驱动电路关闭时，放电电路将栅线与放电信号线33导通，以将栅线上的电荷释放至放电信号线33，使得像素单元内与栅线相连的薄膜晶体管关闭，从而减少了残像的产生，提高了显示质量。
为了防止放电电路对显示图像的影响，放电电路3和放电信号线33设置在所述阵列基板的非显示区。
作为本实用新型的一种具体实施方式，如图1至4所示，放电电路3包括控制线32和与多条栅线一一对应的多个第一薄膜晶体管31，第一薄膜晶体管31的栅极与控制线32相连，第一薄膜晶体管31的第一极与栅线1相连，第一薄膜晶体管31的第二极与放电信号线33相连，以便于对多个第一薄膜晶体管的控制。可以理解的是，控制线32和多条栅线1绝缘交叉，在显示面板不显示图像的情况下，即栅极驱动电路关闭时，可以向控制线32加载开启电平，以使得每个第一薄膜晶体管的第一极和第二极之间导通，从而将每条栅线1上残留的电荷通过放电信号线33释放至显示面板的回路中。
在包括上述阵列基板的显示装置中，还可以包括控制电路，该控制电路可以输出控制栅极驱动电路2开启或关闭的控制信号，所述控制电路可以同时与放电电路3相连，用于在输出控制栅极驱动电路2开启的控制信号的同时向控制线输出关断电平；在输出控制栅极驱动电路2关闭的控制信号的同时向控制线输出开启电平，从而使得栅极驱动电路对栅线进行扫描以显示完整的一帧图像时，放电电路3不对栅线进行放电，当不需要显示图像而将栅线驱动电路2关闭时，放电电路3将栅线与放电信号线33导通，以进行放电。
如图3所示，放电信号线33与第一薄膜晶体管31的栅极313同层设置，放电电路3还包括与第一薄膜晶体管的第二极312同层设置的传输部34，传输部34的一端与放电信号线33形成交叠区，所述交叠区的部分设置有过孔35，传输部34通过过孔35与放电信号线33相连，传输部34的另一端至少与一个第一薄膜晶体管的第二极312相连。所述控制线上加载开启电压时，栅线1上的电荷通过第一薄膜晶体管31、传输部34释放至放电信号线33。
具体地，如图3所示，第一薄膜晶体管31的栅极313和第一极311、第二极312之间设置有覆盖整个非显示区的绝缘层314，第一薄膜晶体管31的栅极313与所述控制线形成为一体结构，第一薄膜晶体管31的第一极311与栅线1形成为一体结构。绝缘层314将控制线32和栅线1绝缘间隔开。如图3所示，在传输部34和放电信号线33形成的交叠区域，所述过孔同时贯穿传输部34和绝缘层314，可以设置透明电极(ITO)等导电材料层36将传输部34和放电信号线33相连。上述形成为一体结构是指，同层设置并相连。在阵列基板的制作过程中，可以在衬底基板5对应于非显示区的部分形成金属层，并通过构图工艺形成包括控制线32和栅极313的图形；然后形成在整个非显示区或整个衬底基板5上形成绝缘层314，再在绝缘层的上方形成包括有源层315的图形，最后形成包括第二极312以及相连的第一极311和栅线1的图形。
具体地，如图2所示，传输部34的数量与第一薄膜晶体管的数量相同，每个第一薄膜晶体管均对应一个传输部34，每个传输部34连接一个第一薄膜晶体管31的第二极。传输部34的一端通过过孔35与放电信号线33相连，另一端与相对应的第一薄膜晶体管的第二极相连。
为了简化放电电路的结构，如图4所示，传输部的34的数量为第一薄膜晶体管31的数量的一半，每个传输部34与相邻的两个第一薄膜晶体管31的第二极312均相连。
为了减少阵列基板在使用的过程中，栅线上产生的静电，如图1、图2和图4所示，所述阵列基板还包括与多条栅线一一对应的多个防静电部4，每个防静电部4连接在相应的栅线1和放电信号线33之间，以将栅线1上的静电释放至放电信号线33，并且放电电路3和防静电部4共用同一个放电信号线33，简化了阵列基板的结构。
具体地，如图1所示，防静电部4包括第二薄膜晶体管42和第三薄膜晶体管43，第二薄膜晶体管42和第三薄膜晶体管43的栅极和第一极均与栅线1相连，第二薄膜晶体管42和第三薄膜晶体管43的第二极均与放电信号线33相连，第二薄膜晶体管42为N型薄膜晶体管，第三薄膜晶体管43为P型薄膜晶体管。当栅线1上产生较高的静电时，且静电为正极性时，第二薄膜晶体管42导通，从而将静电通过放电信号线33释放至与放电信号线连接的显示面板电路回路中；当栅线1上产生负极性的静电，且绝对值较大时，第三薄膜晶体管43导通，从而将静电通过放电信号线33释放至与放电信号线连接的显示面板电路回路中。
作为本实用新型的另一方面，提供一种显示装置，包括上述阵列基板。
上述为对本实用新型提供的阵列基板和显示装置的描述，可以看出，阵列基板上设置有放电电路，当栅极驱动电路关闭而没有扫描信号输出时，放电电路可以将栅线与放电信号线导通，从而将栅线与放电信号线导通，而放电信号线可以与接地线、公共电极等相连，以使栅线上残留的电荷释放至与放电信号线连接的显示面板电路回路中，使得像素单元内的薄膜晶体管关闭，从而减少了残像的出现，提高了显示装置的图像显示质量；并且，阵列基板上还设置有防静电部，能够将栅线上的静电进行释放，防静电部和放电电路共用一个放电信号线，从而在实现对栅线的放电和防静电的同时尽可能地简化了阵列基板的结构。
可以理解的是，以上实施方式仅仅是为了说明本实用新型的原理而采用的示例性实施方式，然而本实用新型并不局限于此。对于本领域内的普通技术人员而言，在不脱离本实用新型的精神和实质的情况下，可以做出各种变型和改进，这些变型和改进也视为本实用新型的保护范围。

Claims (9)

1.一种阵列基板，包括多条栅线和用于向多条栅线依次提供扫描信号的栅极驱动电路，其特征在于，所述阵列基板还包括用于释放电荷的放电信号线和设置在该放电信号线与所述栅线之间的放电电路，所述放电电路用于在所述栅极驱动电路关闭时将所述栅线和所述放电信号线导通。
2.根据权利要求1所述的阵列基板，其特征在于，所述放电电路包括控制线和与多条栅线一一对应的多个第一薄膜晶体管，所述第一薄膜晶体管的栅极与所述控制线相连，所述第一薄膜晶体管的第一极与所述栅线相连，所述第一薄膜晶体管的第二极与所述放电信号线相连。
3.根据权利要求2所述的阵列基板，其特征在于，所述放电电路还包括与所述第一薄膜晶体管的第二极同层设置的传输部，所述传输部的一端与所述放电信号线形成交叠区，所述交叠区的部分设置有过孔，所述传输部通过所述过孔与所述放电信号线相连，所述传输部的另一端至少与一个所述第一薄膜晶体管的第二极相连。
4.根据权利要求3所述的阵列基板，其特征在于，所述放电电路均设置在所述阵列基板的非显示区，所述第一薄膜晶体管的栅极和第一极、第二极之间设置绝缘层，所述第一薄膜晶体管的栅极与所述控制线形成为一体结构，所述第一薄膜晶体管的第一极与所述栅线形成为一体结构。
5.根据权利要求3所述的阵列基板，其特征在于，每个所述传输部连接一个第一薄膜晶体管的第二极。
6.根据权利要求3所述的阵列基板，其特征在于，每个所述传输部与相邻的两个第一薄膜晶体管的第二极均相连。
7.根据权利要求1至6中任意一项所述的阵列基板，其特征在于，所述阵列基板还包括与多条栅线一一对应的多个防静电部，每个防静电部连接在相应的栅线和所述放电信号线之间，以将所述栅线上的静电释放至所述放电信号线。
8.根据权利要求7所述的阵列基板，其特征在于，所述防静电部包括第二薄膜晶体管和第三薄膜晶体管，所述第二薄膜晶体管和第三薄膜晶体管的栅极和第一极均与所述栅线相连，所述第二薄膜晶体管和第三薄膜晶体管的第二极均与所述放电信号线相连，所述第二薄膜晶体管为N型薄膜晶体管，所述第三薄膜晶体管为P型薄膜晶体管。
9.一种显示装置，其特征在于，包括权利要求1至8中任意一项所述的阵列基板。
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