CN1808554B - 利用最少布线将信号路由到显示设备的驱动器 - Google Patents

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Abstract

一种显示设备，包括耦合于定时控制器与第一线路驱动器之间的第一组数据总线。另外，该显示设备还包括耦合于第一线路驱动器与第二线路驱动器之间的第二组的至少一条数据总线。所述第二组具有比第一组少的至少一条数据总线。因此使用最少布线从定时控制器将数据信号发送至显示板的线路驱动器，从而减少功耗和电磁干扰。

Description

利用最少布线将信号路由到显示设备的驱动器 
根据35U.S.C§119(a)，本申请要求于2004年12月1日提交的韩国专利申请第10-2004-0099723号的优先权，其整体内容通过引用结合于此。 
技术领域
本发明通常涉及诸如液晶显示(LCD)板的显示设备，尤其涉及在具有大显示板的显示设备中将到驱动器的信号布线减至最少，以便转而将电磁干扰(EMI)和功耗减至最少。 
背景技术
图1示出了诸如薄膜晶体管液晶显示(TFT-LCD)设备的显示设备10的组成部分的方框图。显示设备10包括显示板12、源极驱动器块14、栅极驱动器16、定时控制器18和电源20。 
显示板12包括多条源极(即，数据)线S1、S2、...到SN。显示板12还包括多条栅极(即，扫描)线G1、G2、...到GM。显示板12还包括N×M个像素电极的阵列。每个像素电极和相应的薄膜晶体管(TFT)位于各条源极线与各条栅极线的交叉处。显示板12的每个TFT具有耦合到相应栅极线的栅极、耦合到相应源极线的源极、和耦合到相应像素电极的漏极。 
源极驱动器块14包括多个源极驱动器，用于使用来自定时控制器18的显示数据(DATA)来驱动源极线S1、S2、...到SN。定时控制器18还产生时钟信号(CLK)、数据启动信号(DIO)、加载信号(LOAD)、和极性信号(POL)，作为到源极驱动器块14的控制信号。CLK信号用于定时控制器与源极驱动器块14之间的信号同步。DIO信号用于表示DATA信号具有有效的RGB彩色数据的时间。LOAD信号表示源极线S1、S2、...到SN将被RGB彩色数据驱动的时间。POL信号表示源极驱动器块是否应当对RGB彩色数据执行反转。 
电源20响应来自定时控制器18的控制信号而产生由源极驱动器块14、栅极驱动器16和显示板使用的偏压。栅极驱动器16响应来自定时控制器18 的控制信号而依次驱动栅极线G1、G2、...到GM。以这种方式，在显示图像的适当定时用RGB彩色数据驱动显示板12的像素电极。 
随着显示技术的提高，期望显示板12更大。因此，源极驱动器块14由用于驱动大显示板12的大量源极线的多个源极驱动器组成。使用许多布线将来自定时控制器18的信号路由到所述多个源极驱动器。通过这种增加的布线的这种信号传输导致功耗增加和EMI(电磁干扰)增加。 
图2示出了从定时控制器18到多个源极驱动器的示例信号路由，所述源极驱动器包括第一源极驱动器52、第二源极驱动器54和第三源极驱动器56。所述源极驱动器52、54和56中的每一个被放置在由填充材料组成的各个薄膜62、64和66上。所述填充材料对本领域的普通技术人员来说是公知的。薄膜62、64和66被放置在显示板12与PCB基板72之间，在所述PCB基板72上安装有定时控制器18。每个源极驱动器52、54和56驱动显示板12的各组源极线。 
在图2的示例中，定时控制器1 8经由源自定时控制器18的总共9条线而产生三位红色数据R[2:0]、三位绿色数据G[2:0]、和三位蓝色数据B[2:0]。定时控制器18也产生用于时钟信号CLK和数据启动信号DIO1的控制信号。当数据信号R[2:0]、G[2:0]和B[2:0]为单端时，定时控制器18还产生由源极驱动器52、54和56使用的基准信号IREF。 
另外在图2中，GAMMA电压——其是每个源极驱动器52、54和56中的各个DAC(数模转换器)使用的基准电压——耦合到所述源极驱动器52、54和56。另外，至少一个POWER电压耦合到每个源极驱动器52、54和56。 
在图2的现有技术中，每个信号R[2:0]、G[2:0]、B[2:0]、CLK、DIO1和IREF被路由到每个源极驱动器52、54和56。具体地，RBG数据R[2:0]、G[2:0]和B[2:0]中的每一位以级联方式依次路由通过源极驱动器52、54和56。因此，九条线将九个颜色位R[2:0]、G[2:0]和B[2:0]从定时控制器18路由到第一源极驱动器52。另九条线将九个颜色位R[2:0]、G[2:0]和B[2:0]从第一源极驱动器52路由到第二源极驱动器54。而且，再九条线将九个颜色位R[2:0]、G[2:0]和B[2:0]从第二源极驱动器54路由到第三源极驱动器56。 
在现有技术中，经由定时控制器18与第一源极驱动器52之间的相应九条线以及源极驱动器52、54和56中的每个相邻对之间的相应九条线将RGB数据发送至源极驱动器52、54和56。因此在图2的现有技术中，对于具有 大量源极驱动器的较大显示板12，增加了用于RGB彩色数据的布线。在所述RGB彩色数据的传输期间，这种增加的布线转而不利地增加了功耗和EMI(电磁干扰)。 
因此，期望对于大显示板用最少的布线、经由多个源极驱动器来发送RGB彩色数据。 
发明内容
从而，在本发明的一个总的方面，最小化了将彩色数据从定时控制器发送到源极驱动器的布线，尤其当源极驱动器被放置得离定时控制器较远时。 
根据本发明实施例的显示设备包括耦合于定时控制器与第一线路驱动器之间的第一组数据总线。另外，该显示设备还包括耦合于第一线路驱动器与第二线路驱动器之间的第二组的至少一条数据总线。所述第二组具有比第一组少的至少一条数据总线。 
在本发明的一个示例中，第一和第二线路驱动器是以级联方式串联连接的源极驱动器。 
在本发明的另一实施例中，所述第一组数据总线发送将被第一和第二线路驱动器使用的数据，并且所述第二组的至少一条数据总线发送将被第二线路驱动器使用的数据。例如，所述第二组的至少一条数据，总线不发送第一线路驱动器使用的数据。在本发明的另一实施例中，所述第二组的至少一条数据总线发送将被与第二线路驱动器耦合的第三线路驱动器使用的数据。 
在本发明的再一实施例中，在预定时间周期期间，第一和第二组每组中的一条数据总线发送至少一个控制信号。例如，至少一个控制信号表示用于第一和第二线路驱动器的LATCH状态、LOAD状态、和POLARITY状态中的至少一个。 
在一种根据本发明另一方面的在显示设备中发送数据信号的方法中，将第一组数据信号从定时控制器发送到第一线路驱动器。另外，将第二组的至少一个数据信号从第一线路驱动器发送至第二线路驱动器。第二组中的至少一个数据信号的数量小于第一组中的数据信号的数量。 
这样，使用最少的布线将数据信号从定时控制器发送到显示板的线路驱动器。这种最少的布线有利于转而最小化功耗和EMI(电磁干扰)，其对于具有大量线路驱动器的大显示板尤其有利。 
具体来讲，根据本发明的一个方面，提供了一种显示设备，该显示设备包括：耦合于定时控制器与第一线路驱动器之间的第一组数据总线；和耦合于第一线路驱动器与第二线路驱动器之间的第二组数据总线，其中所述第二组具有比第一组少的数据总线并且该第二组的总线数量为至少一条，其中，第一和第二组每组中的相应数据总线在预定时间周期期间发送至少一个控制信号，其中，所述预定时间周期是数据总线的操作周期的第一、第二或第四时间周期，并且，所述第一和第二组每组中的相应数据总线在所述数据总线的操作周期的第三时间周期内发送彩色数据，所述至少一个控制信号表示用于第一和第二线路驱动器的锁存LATCH状态、加载LOAD状态、和极性POLARITY状态中的至少一个。 
根据本发明的另一个方面，提供了一种在显示设备中发送数据信号的方法，该方法包括：将第一组数据信号从定时控制器发送到第一线路驱动器；和将第二组数据信号从第一线路驱动器发送至第二线路驱动器，其中第二组数据信号的数量小于第一组中的数据信号的数量，所述第二组数据信号的数量为至少一个，其中第一组数据总线将数据信号从定时控制器发送至第一线路驱动器，第二组数据总线在第一和第二线路驱动器之间发送数据信号，其中该第二组具有比第一组少的数据总线并且该第二组的总线数量为至少一条，以及其中，在预定时间周期期间经由第一和第二组每组中的相应数据总线将至少一个控制信号从定时控制器发送至第一和第二线路驱动器，其中，所述预定时间周期是数据总线的操作周期的第一、第二或第四时间周期，并且，经由所述第一和第二组每组中的相应数据总线在所述数据总线的操作周期的第三时间周期内发送彩色数据，所述至少一个控制信号表示锁存LATCH状态、加载LOAD状态、和极性POLARITY状态中的至少一个。 
附图说明
通过考虑附图中所展示的本发明的下列详细描述，本发明的这些和其他特征和优势将得到更好理解。 
图1示出了根据现有技术的显示设备的组成部分； 
图2图解说明了根据现有技术的显示设备中用于从定时控制器到源极驱动器的信号传输的增加的布线； 
图3示出了根据本发明实施例的、对于从定时控制器到源极驱动器的信 号传输具有最少布线的显示设备； 
图4示出了根据本发明实施例的、在图3的显示设备中发送的信号的时序图； 
图5示出了根据本发明另一实施例的、在图3的显示设备中延迟发送的信号的时序图； 
图6示出了根据本发明另一实施例的、具有从定时控制器到源极驱动器的最少信号传输的显示设备；和 
图7示出了根据本发明实施例的、具有T结构和具有用于从定时控制器到源极驱动器的信号传输的最少布线的显示设备的组成部分。 
此处参考的附图被绘制用来使图解清楚，而不必按比例绘制。图1、2、3、4、5、6和7中具有相同附图标记的元件表示具有类似结构和功能的元件。 
具体实施方式
图3示出了根据本发明实施例的、具有最少信号布线的显示设备100的方框图。该显示设备包括显示板102，并且还包括安装在印刷电路板(PCB)基板106上的定时控制器104。该显示设备另外包括多个源极驱动器，包括第一源极驱动器112、第二源极驱动器114、和第三源极驱动器116。 
每个源极驱动器112、114和116被放置在相应的薄膜122、124和126上。薄膜122、124和126由填充材料构成，以便在PCB基板106与显示板102之间连接源极驱动器112、114和116。这种填充材料对本领域的普通技术人员来说是公知的。 
另外在图3中，GAMMA电压——其是每个源极驱动器112、114和116中的各个DAC(数模转换器)使用的基准电压——耦合到所述源极驱动器 112、114和116。另外，至少一个POWER电压耦合到每个源极驱动器112、114和116。 
定时控制器产生第一RGB彩色数据D1[2:0]、第二RGB彩色数据D2[2:0]、和第三RGB彩色数据D3[2:0]。第一RGB彩色数据D1[2:0]被第一源极驱动器112用来驱动显示板102的第一组源线。第二RGB彩色数据D2[2:0]被第二源极驱动器114用来驱动显示板102的第二组源线。第三RGB彩色数据D3[2:0]被第三源极驱动器116用来驱动显示板102的第三组源线。另外，定时控制器104产生包括时钟信号CLK、第一数据启动信号DIO1、和基准电压信号IREF的控制信号。 
再参考图3，将第一、第二和第三RGB彩色数据D1[2:0]、D2[2:0]和D3[2:0]从定时控制器104发送至第一源极驱动器112。在本发明的一个实施例中，使用每组三条线来发送第一、第二和第三RGB彩色数据D1[2:0]、D2[2:0]和D3[2:0]中的每一个。因此，使用由例如总共9条线组成的第一组数据总线将第一、第二和第三RGB彩色数据D1[2:0]、D2[2:0]和D3[2:0]从定时控制器104发送至图3中的第一源极驱动器112。 
第一源极驱动器112根据第一RGB彩色数据D1[2:0]来驱动显示板102的各组源线。另外，第一源极驱动器112还发送将被第二和第三源极驱动器114和116使用的第二和第三RGB彩色数据D2[2:0]和D3[2:0]。因此，使用由例如总数为6条线组成的第二组数据总线将第二和第三RGB彩色数据D2[2:0]和D3[2:0]从第一源极驱动器112发送至第二源极驱动器114。 
第二源极驱动器114根据第二RGB彩色数据D2[2:0]来驱动显示板102的各组源线。另外，第二源极驱动器114还发送将被第三源极驱动器116使用的第三RGB彩色数据D3[2:0]。因此，使用由例如总共3条线组成的第三组数据总线将第三RGB彩色数据D3[2:0]从第二源极驱动器114发送至第三源极驱动器116。 
另外，将时钟信号CLK和基准电压IREF从定时控制器104发送至第一源极驱动器112，随后发送至第二源极驱动器114，并且随后发送至第三源极驱动器116。而且，将第一数据启动信号DIO1从定时控制器104发送至第一源极驱动器112。另外，将第二数据启动信号DIO2从第一源极驱动器112发送至第二源极驱动器114，并且将第三数据启动信号DIO3从第二源极驱动器114发送至第三源极驱动器116。 
从定时控制器104发送IREF电压经过源极驱动器112、114和116。IREF电压是当数据信号D1[2:0]、D2[2:0]和D3[2:0]是单端信号时由源极驱动器112、114和116使用的基准电压。 
图4示出了图3的组成部分的操作期间的信号的时序图。参考图4，从定时控制器104中产生的时钟信号CLK被用来同步图3中的组成部分的操作的定时。在时钟信号CLK的时间周期A期间，定时控制器104将第一数据启动信号DIO1和第一红色数据信号D10的每一个都无效为逻辑低状态“L”。另外在时间周期A期间，定时控制器104将第一绿色数据信号D11设定为与第一数据信号D1[2:0]的极性对应的逻辑状态，以便在时间周期C期间跟随。 
另外在时间周期A期间，第一源极驱动器112复制第一数据启动信号DIO1、第一红色数据信号D10、和第一绿色数据信号D11，以便分别产生第二数据启动信号DIO2、第二红色数据信号D20和第二绿色数据信号D21并且将它们发送至第二源极驱动器112。而且在时间周期A期间，第二源极驱动器114复制第二数据启动信号DIO2、第二红色数据信号D20、和第二绿色数据信号D21，以便分别产生第三数据启动信号DIO3、第三红色数据信号D30和第三绿色数据信号D31并且将它们发送至第三源极驱动器116。因此，在逻辑状态方面，在时间周期A期间，DIO1＝DIO2＝DIO3处于逻辑低状态“L”；D10＝D20＝D30处于逻辑高状态“H”；并且D11＝D21＝D31处于极性状态“POL”。 
都处于逻辑低状态“L”的各个数据启动信号DIO和各个红色信号的组合表示时间周期B期间每个源极驱动器112、114和116处的LATCH状态的启动。之后，在时间周期C期间，每个驱动器112、114和116锁存各个RGB数据。 
例如在时间周期C期间，经由第一红色数据线D10在第一源极驱动器112内锁存红色数据位R0、R1、...、至R127；经由第一绿色数据线D11在第一源极驱动器112内锁存绿色数据位G0、G1、...、至G127；和经由第一蓝色数据线D12在第一源极驱动器112内锁存蓝色数据位B0、B1、...、至B127。 
而且在时间周期C期间，经由第二红色数据线D20在第二源极驱动器114内锁存红色数据位R128、R129、...、至R255；经由第二绿色数据线D21在第二源极驱动器114内锁存绿色数据位G128、G129、...、至G255；和经由第二蓝色数据线D22在第二源极驱动器114内锁存蓝色数据位B128、 B129、...、至B255。 
类似地在时间周期C期间，经由第三红色数据线D30在第三源极驱动器116内锁存红色数据位R256、R257、...、至R383；经由第三绿色数据线D31在第三源极驱动器116内锁存绿色数据位G256、G257、...、至G383；和经由第三蓝色数据线D32在第三源极驱动器116内锁存蓝色数据位B256、B257、...、至B383。 
在时间周期C期间，第一、第二和第三数据启动信号DIO1、DIO2和DIO3被设定为逻辑高状态。之后在时间周期D期间，定时控制器104将第一数据启动信号DIO1设定为逻辑低状态“L”。而且在时间周期D期间，第一源极驱动器112根据第一数据启动信号DIO1将第二数据启动信号DIO2复制到逻辑低状态“L”，并且第二源极驱动器114根据第二数据启动信号DIO2将第三数据启动信号DIO3复制到逻辑低状态“L”。 
类似地在时间周期D期间，定时控制器104将第一红色数据信号D10设定为逻辑高状态“H”。而且在时间周期D期间，第一源极驱动器112根据第一红色数据信号D10将第二红色数据信号D20复制到逻辑高状态“H”，并且第二源极驱动器114根据第二红色数据信号D20将第三红色数据信号D30复制到逻辑高状态“H”。 
被设定在逻辑低状态“L”的各个数据启动信号DIO和被设定在逻辑高状态“H”的各个红色信号的组合表示时间周期D期间每个源极驱动器112、114和116处的LOAD状态。在这种LOAD状态期间，每个源极驱动器112、114和116用在时间周期C期间被锁存的各个RGB数据来驱动显示板102的各组源线。 
图5示出了根据本发明另一实施例的图3的组成部分的操作期间的信号的时序图。图4和5是类似的，但是图5还示出了当复制和发送数据启动信号和RGB数据信号经过以级联方式串联连接的源极驱动器112、114和116时，在所述数据启动信号和RGB信号之间的延迟。这样的延迟可能由在源极驱动器复制所述信号以便发送到串联级联连接的随后源极驱动器所需的时间而产生。 
例如在图5中，根据在第一源极驱动器112处的第一数据启动信号DIO1和第一RGB数据信号D10、D11和D12将在第二源极驱动器114接收到的第二数据启动信号DIO2和第二RGB数据信号D20、D21和D22延迟一个延迟 量T1。类似地，根据在第二源极驱动器114处的第二数据启动信号DIO2和第二RGB数据信号D20、D21和D22将在第三源极驱动器116接收到的第三数据启动信号DIO3和第三RGB数据信号D30、D31和D32延迟一个延迟量T2。 
为了方便解释，在图5中将所述延迟T1和T2图解为时钟信号CLK的周期的1/2。然而，现实中所述延迟T1和T2通常为有限个数的时钟信号CLK的周期。使用图5中所述的延迟，在第二和第三源极驱动器114和116中用所述相应的延迟来执行上述锁存和加载。 
在图4或5的任意情形中，对于图3中的RGB数据信号而将信号布线减至最少。这种最少的信号布线使得功耗减少。例如，假设对于从定时控制器104到第一源极驱动器112的RGB数据信号D1[2:0]、D2[2:0]和D3[2:0]，通过数据总线的信号传输消耗了总电流I。在这种情况下，对于从第一源极驱动器112到第二源极驱动器114的RGB数据信号D2[2:0]和D3[2:0]，通过数据总线的信号传输消耗的总电流是(2/3)*I。而且，对于从第二源极驱动器114到第三源极驱动器116的RGB数据信号D3[2:0]，通过数据总线的信号传输消耗的总电流是(1/3)*I。 
因此，对于通过图3中的第一、第二和第三源极驱动器112、114和116的RGB数据信号的信号传输，消耗了总电流2*I。相反，对于通过图2中的第一、第二和第三源极驱动器52、54和56的RGB数据信号的信号传输，消耗了总电流3*I。而且，通过图3中的连续源极驱动器114和116的减少的信号布线转而最小化了EMI(电磁干扰)。 
另外，在预定时间周期A、B和D期间，数据总线用于在图3的显示设备中传输表示锁存、加载和极性的控制信号，用以减少用于控制信号的布线。控制信号布线的减少还减少了功耗和EMI(电磁干扰)。 
在图3的实施例中，在第一和第二源极驱动器112与114之间不存在用于第一RGB数据信号D1[2:0]的物理线(或者数据总线)。类似地在图3中，在第二和第三源极驱动器114与116之间不存在用于第一和第二RGB数据信号D1[2:0]和D2[2:0]的物理线(或者数据总线)。 
图6示出了与图3的显示设备100类似的显示设备200的另一实施例。然而在图6中，物理线(或者数据总线)与图2中所示的一样，但是这种线不用于在其中没有信号发送的情况。例如，图6中第一和第二源极驱动器112和 114之间的虚线表示能够发送第一RGB数据信号D1[2:0]的布线。然而在图6中，尽管被放置在PCB基板106上，但是这种布线不用于任意信号的传输。 
类似地，图6中第二与第三源极驱动器114与116之间的虚线表示能够发送第一和第二RGB数据信号D1[2:0]和D2[2:0]的布线。然而在图6中，尽管被放置在PCB基板106上，但是这种布线不用于任意信号的传输。由于不用于所述信号传输，因此在图6的实施例中也最小化了功耗和EMI(电磁干扰)。 
图7示出了根据本发明另一实施例的、具有T结构的显示设备300。在图7中，第一级联的三个源极驱动器112A、114A和116A被放置到定时控制器104的右边，而第二级联的三个源极驱动器112B、114B和116B被放置到定时控制器104的左边。源极驱动器112A、114A、116A、112B、114B和116B中的每一个被放置在相应薄膜122A、124A、126A、122B、124B和126B上。 
在图7的T结构中，与参考图3描述的类似，对于依次通过第一级联的三个源极驱动器112A、114A和116A到定时控制器104的右侧的右数据信号RD1[2:0]、RD2[2:0]和RD3[2:0]，最小化了信号布线。在图7中类似地，与参考图3描述的类似，对于依次通过第二级联的三个源极驱动器112B、114B和116B到定时控制器104的左侧的左数据信号LD1[2:0]、LD2[2:0]和LD3[2:0]，最小化了信号布线。因此，图7的显示设备300也具有最少的功耗和EMI(电磁干扰)。 
上面描述只是举例而不是限制。例如，本发明被描述为用于图3、6和7中的显示设备100、200和300，它们用于与放置在相应薄膜上的每个源极驱动器封装的薄膜上芯片(COF，chip on film)。然而本发明也可被实现为其他类型的封装，例如屏上芯片(COG，chip on glass)和带载芯片封装(TCP，tape carrierpackage)。另外，此处所举例和描述的任意数量的元件仅仅是举例。而且，本发明被描述为用于将显示设备中到源极驱动器的布线减至最少。然而，本发明可被概括用来将显示设备中各种类型的线路驱动器的布线减至最少。另外，此处的术语“线”可被概括为任意类型的“数据总线”。 
本发明的范围由所附权利要求及其等效物来限定。 

Claims (18)

1.一种显示设备，包括：
耦合于定时控制器与第一线路驱动器之间的第一组数据总线；和
耦合于第一线路驱动器与第二线路驱动器之间的第二组数据总线，其中所述第二组具有比第一组少的数据总线并且该第二组的总线数量为至少一条，
其中，第一和第二组每组中的相应数据总线在预定时间周期期间发送至少一个控制信号，其中，所述预定时间周期是数据总线的操作周期的第一、第二或第四时间周期，并且，所述第一和第二组每组中的相应数据总线在所述数据总线的操作周期的第三时间周期内发送彩色数据，所述至少一个控制信号表示用于第一和第二线路驱动器的锁存LATCH状态、加载LOAD状态、和极性POLARITY状态中的至少一个。
2.如权利要求1所述的显示设备，其中所述第一和第二线路驱动器是源极驱动器。
3.如权利要求1所述的显示设备，其中所述第一和第二线路驱动器以级联方式串联耦合。
4.如权利要求1所述的显示设备，其中所述第一组数据总线发送将被第一和第二线路驱动器使用的数据。
5.如权利要求4所述的显示设备，其中所述第二组数据总线发送将被第二线路驱动器使用的数据。
6.如权利要求5所述的显示设备，其中所述第二组数据总线不发送由第一线路驱动器使用的数据。
7.如权利要求6所述的显示设备，其中所述第二组数据总线发送将被与第二线路驱动器耦合的第三线路驱动器使用的数据。
8.如权利要求1所述的显示设备，还包括：
耦合于定时控制器与第一线路驱动器之间的第一组的至少一条控制总线；和
耦合于第一线路驱动器与第二线路驱动器之间的第二组的至少一条控制总线；
其中第一和第二组的控制总线将至少一个控制信号从定时控制器发送到第一和第二线路驱动器。
9.如权利要求1所述的显示设备，其中所述定时控制器以及第一和第二线路驱动器是具有T型串联级联结构的显示设备的一部分。
10.如权利要求1所述的显示设备，其中所述显示设备是液晶显示器，并且其中第一和第二组的数据总线形成在印刷电路板基板上，并且其中第一和第二线路驱动器放置在填充材料上。
11.一种在显示设备中发送数据信号的方法，包括：
将第一组数据信号从定时控制器发送到第一线路驱动器；和
将第二组数据信号从第一线路驱动器发送至第二线路驱动器，
其中第二组数据信号的数量小于第一组中的数据信号的数量，所述第二组数据信号的数量为至少一个，
其中第一组数据总线将数据信号从定时控制器发送至第一线路驱动器，第二组数据总线在第一和第二线路驱动器之间发送数据信号，其中该第二组具有比第一组少的数据总线并且该第二组的总线数量为至少一条，以及
其中，在预定时间周期期间经由第一和第二组每组中的相应数据总线将至少一个控制信号从定时控制器发送至第一和第二线路驱动器，其中，所述预定时间周期是数据总线的操作周期的第一、第二或第四时间周期，并且，经由所述第一和第二组每组中的相应数据总线在所述数据总线的操作周期的第三时间周期内发送彩色数据，所述至少一个控制信号表示锁存LATCH状态、加载LOAD状态、和极性POLARITY状态中的至少一个。
12.如权利要求11所述的方法，其中第一组数据信号包括将被第一和第二线路驱动器中的至少一个使用的数据。
13.如权利要求12所述的方法，其中第二组数据信号包括将被第二线路驱动器使用的数据，而不包括将被第一线路驱动器使用的数据。
14.如权利要求11所述的方法，其中所述第一和第二线路驱动器是源极驱动器。
15.如权利要求11所述的方法，还包括：
经由耦合于定时控制器与第一线路驱动器之间的第一组的至少一条控制总线发送至少一个控制信号；和
经由耦合于第一线路驱动器与第二线路驱动器之间的第二组的至少一条控制总线发送至少一个控制信号。
16.如权利要求11所述的方法，其中第一和第二线路驱动器以级联方式串联耦合。
17.如权利要求11所述的方法，所述定时控制器以及第一和第二线路驱动器是具有T型串联级联结构的显示设备的一部分。
18.如权利要求11所述的方法，其中所述显示设备是液晶显示器，并且其中第一和第二组的数据总线形成在印刷电路板的基板上，并且其中第一和第二线路驱动器放置在填充材料上。
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