CN115588397A - 显示面板及其驱动方法、显示装置 - Google Patents

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Abstract

本申请公开了一种显示面板及其驱动方法、显示装置。显示面板包括：像素电路和发光元件；像素电路包括驱动模块和数据写入模块，驱动模块包括驱动晶体管；显示面板的一帧画面时间内，像素电路的工作过程包括前置阶段和发光阶段；在至少一帧画面时间内，像素电路的前置阶段包括数据写入阶段和n1个偏置阶段，n1≥1，且n1为整数；数据写入模块用于在数据写入阶段为驱动晶体管的栅极提供数据信号，数据写入模块用于在偏置阶段为驱动晶体管提供偏置信号；n1个偏置阶段中包括第一偏置阶段，第一偏置阶段在数据写入阶段之前，且在第一偏置阶段偏置信号写入驱动晶体管的栅极。根据本申请实施例，有利于改善拖影现象，提高显示效果。

Description

显示面板及其驱动方法、显示装置
技术领域
本申请涉及显示技术领域，具体涉及一种显示面板及其驱动方法、显示装置。
背景技术
显示面板中，通常设置有像素电路和发光元件，像素电路中的驱动晶体管能够依据其所接收到的数据信号为发光元件提供驱动电流，进而驱动发光元件进行发光，使得显示面板呈现出相应亮度的显示画面。
然而，在低频显示时，画面切换存在严重的拖影问题，影响显示效果。
发明内容
本申请实施例提供一种显示面板及其驱动方法、显示装置，有利于改善拖影现象，提高显示效果。
第一方面，本申请实施例提供一种显示面板，包括：像素电路和发光元件；像素电路包括驱动模块和数据写入模块，驱动模块包括驱动晶体管；显示面板的一帧画面时间内，像素电路的工作过程包括前置阶段和发光阶段；在至少一帧画面时间内，像素电路的前置阶段包括数据写入阶段和n1个偏置阶段，n1≥1，且n1为整数；数据写入模块用于在数据写入阶段为驱动晶体管的栅极提供数据信号，数据写入模块用于在偏置阶段为驱动晶体管提供偏置信号；n1个偏置阶段中包括第一偏置阶段，第一偏置阶段在数据写入阶段之前，且在第一偏置阶段偏置信号写入驱动晶体管的栅极。
第二方面，基于相同的发明构思，本申请实施例提供一种显示面板的驱动方法，显示面板包括像素电路和发光元件；
像素电路包括驱动模块和数据写入模块，驱动模块包括驱动晶体管；
显示面板的一帧画面时间内，像素电路的工作过程包括前置阶段和发光阶段，在至少一帧画面时间内，像素电路的前置阶段包括数据写入阶段和n1个偏置阶段，n1≥1，且n1为整数；
其中，驱动方法包括：
在数据写入阶段，数据写入模块为驱动晶体管的栅极提供数据信号；
在偏置阶段，数据写入模块用于为驱动晶体管提供偏置信号，且n1个偏置阶段中包括第一偏置阶段，第一偏置阶段在数据写入阶段之前，在第一偏置阶段偏置信号写入驱动晶体管的栅极。
第三方面，基于相同的发明构思，本申请实施例提供一种显示装置，包括如上述第一方面实施例的显示面板。
根据本申请实施例提供的显示面板及其驱动方法、显示装置，由于第一偏置阶段在数据写入阶段之前，偏置信号写入驱动晶体管的栅极可以提前对驱动晶体管的特性进行修正，将各像素电路中驱动晶体管的特性在写入当前画面的数据信号之前，进行统一的偏置信号的写入，确保各像素电路中驱动晶体管在数据信号写入前的特性更加接近，以消除前一画面对驱动晶体管的偏压影响，改善显示画面切换时的拖影问题，提高显示效果。
附图说明
通过阅读以下参照附图对非限制性实施例所作的详细描述，本申请的其它特征、目的和优点将会变得更明显，其中，相同或相似的附图标记表示相同或相似的特征，附图并未按照实际的比例绘制。
图1示出本申请实施例提供的显示面板中像素电路的一种结构示意图；
图2示出图1中像素电路的一种时序示意图；
图3示出图1中像素电路的另一种时序示意图；
图4示出本申请实施例提供的显示面板中像素电路的一种结构示意图；
图5示出本申请实施例提供的显示面板中像素电路的一种结构示意图；
图6示出本申请实施例提供的显示面板中像素电路的一种结构示意图；
图7示出本申请实施例提供的显示面板中像素电路的另一种结构示意图；
图8示出图7中像素电路的一种时序示意图；
图9示出图7中像素电路的另一种时序示意图；
图10示出图1中像素电路的又一种时序示意图；
图11示出图1中像素电路的又一种时序示意图；
图12示出图1中像素电路的又一种时序示意图；
图13示出图1中像素电路的又一种时序示意图；
图14示出图1中像素电路的又一种时序示意图；
图15示出图1中像素电路的又一种时序示意图；
图16示出图1中像素电路的又一种时序示意图；
图17示出图1中像素电路的又一种时序示意图；
图18示出本申请实施例提供的显示面板的驱动方法的一种流程示意图；
图19示出本申请实施例提供的显示面板的驱动方法的另一种流程示意图；
图20示出本申请实施例提供的显示面板的驱动方法的又一种流程示意图；
图21示出本申请实施例提供的显示面板的驱动方法的又一种流程示意图；
图22示出本申请实施例提供的显示装置的一种结构示意图。
具体实施方式
下面将详细描述本申请的各个方面的特征和示例性实施例，为了使本申请的目的、技术方案及优点更加清楚明白，以下结合附图及具体实施例，对本申请进行进一步详细描述。应理解，此处所描述的具体实施例仅被配置为解释本申请，并不被配置为限定本申请。对于本领域技术人员来说，本申请可以在不需要这些具体细节中的一些细节的情况下实施。下面对实施例的描述仅仅是为了通过示出本申请的示例来提供对本申请更好的理解。
需要说明的是，在本文中，诸如第一和第二等之类的关系术语仅仅用来将一个实体或者操作与另一个实体或操作区分开来，而不一定要求或者暗示这些实体或操作之间存在任何这种实际的关系或者顺序。而且，术语“包括”、“包含”或者其任何其他变体意在涵盖非排他性的包含，从而使得包括一系列要素的过程、方法、物品或者设备不仅包括那些要素，而且还包括没有明确列出的其他要素，或者是还包括为这种过程、方法、物品或者设备所固有的要素。在没有更多限制的情况下，由语句“包括……”限定的要素，并不排除在包括所述要素的过程、方法、物品或者设备中还存在另外的相同要素。
应当理解，在描述部件的结构时，当将一层、一个区域称为位于另一层、另一个区域“上面”或“上方”时，可以指直接位于另一层、另一个区域上面，或者在其与另一层、另一个区域之间还包含其它的层或区域。并且，如果将部件翻转，该一层、一个区域将位于另一层、另一个区域“下面”或“下方”。
应当理解，本文中使用的术语“和/或”仅仅是一种描述关联对象的关联关系，表示可以存在三种关系，例如，A和/或B，可以表示：单独存在A，同时存在A和B，单独存在B这三种情况。另外，本文中字符“/”，一般表示前后关联对象是一种“或”的关系。
在本申请实施例中，术语“电连接”可以是指两个组件直接电连接，也可以是指两个组件之间经由一个或多个其它组件电连接。
在不脱离本申请的精神或范围的情况下，在本申请中能进行各种修改和变化，这对于本领域技术人员来说是显而易见的。因而，本申请意在覆盖落入所对应权利要求(要求保护的技术方案)及其等同物范围内的本申请的修改和变化。需要说明的是，本申请实施例所提供的实施方式，在不矛盾的情况下可以相互组合。
在阐述本申请实施例所提供的技术方案之前，为了便于对本申请实施例理解，本申请首先对相关技术中存在的问题进行具体说明：
如背景技术介绍的，在低频显示时，画面切换存在严重的拖影问题，影响显示效果。
为了解决上述技术问题，本申请的发明人首先对于导致上述技术问题的根因进行了研究和分析，具体的研究和分析过程如下：
显示面板在显示两幅不同画面时，由于画面亮度的差异，在画面切换过程中，比如黑白画面切换时，画面亮度会存在缓慢变化的过程，即初始时间段亮度无法达到目标亮度，导致第一帧亮度偏低，并且该亮度变化过程时间较长，人眼容易察觉，从而会导致画面产生拖影问题，使得画面显示效果较差。
基于上述问题，本申请提供一种显示面板及其驱动方法、显示装置，有利于改善拖影现象，提高显示效果。
下面首先介绍本申请实施例提供的显示面板。
图1示出本申请实施例提供的显示面板中像素电路的一种结构示意图。如图1所示，显示面板可包括像素电路10和发光元件20。像素电路10可包括驱动模块11和数据写入模块12。驱动模块12用于为发光元件20提供驱动电流，驱动模块11可包括驱动晶体管T1。发光元件20包括但不限于有机发光二极管(Organic Light-Emitting Diode，OLED)。
数据写入模块12可以向驱动晶体管T1提供数据信号Vdata及偏置信号DVH。
如图2或图3所示，显示面板的一帧画面时间内，像素电路的工作过程可以包括前置阶段和发光阶段。在至少一帧画面时间内，像素电路的前置阶段可以包括数据写入阶段d和n1个偏置阶段，n1≥1，且n1为整数。图2和图3以n1＝3为例，且为了便于区分，各个偏置阶段分别标记为p1、p2、p3。图2和图3所示的偏置阶段的数量并不用于限定本申请。
数据写入模块12可用于在数据写入阶段d为驱动晶体管T1的栅极提供数据信号Vdata，且数据写入模块12可用于在各个偏置阶段为驱动晶体管T1提供偏置信号DVH。驱动晶体管T1可根据数据信号Vdata产生相应的驱动电流，进而驱动发光元件20发光。在偏置阶段，偏置信号DVH可用于调节驱动晶体管T1的偏压情况。
n1个偏置阶段中可至少包括一个第一偏置阶段p1，第一偏置阶段p1在数据写入阶段d之前。在第一偏置阶段p1偏置信号DVH写入驱动晶体管T1的栅极。可理解的是，第一偏置阶段p1与数据写入阶段d在时间上无重叠。
本申请实施例中，由于第一偏置阶段在数据写入阶段之前，偏置信号写入驱动晶体管的栅极可以提前对驱动晶体管的特性进行修正，将各像素电路中驱动晶体管的特性在写入当前画面的数据信号之前，进行统一的偏置信号的写入，确保各像素电路中驱动晶体管在数据信号写入前的特性更加接近，以消除前一画面对驱动晶体管的偏压影响，改善显示画面切换时的拖影问题，提高显示效果。
作为一个示例，如图1、图4至图6中的任意一个附图所示，数据写入模块12可包括第一子模块121和第二子模块122。第一子模块121可与数据信号端电连接，数据信号端可用于提供数据信号Vdata。第一子模块121可用于在第一控制信号SP1的控制下，向驱动晶体管T1传输数据信号Vdata。第二子模块122可与偏置信号端电连接，偏置信号端可用于提供偏置信号DVH。第二子模块122可用于在第二控制信号SP2的控制下，向驱动晶体管T1传输偏置信号DVH。
第一子模块121可包括第二晶体管T2，第二晶体管T2的栅极接收第一控制信号SP1，第二晶体管T2的第一极接收数据信号Vdata，第二晶体管T2的第二极与驱动晶体管T1的第一极或第二极电连接。
第二子模块122可包括第三晶体管T3，第三晶体管T3的栅极接收第二控制信号SP2，第三晶体管T3的第一极接收偏置信号DVH，第三晶体管T3的第二极与驱动晶体管T1的第一极或第二极电连接。
第一控制信号SP1和第二控制信号SP2可为脉冲信号，通过脉冲信号的高低电平控制第二晶体管T2、第三晶体管T3导通或关闭。
作为另一个示例，也可利用同一个晶体管分时传输数据信号Vdata和偏置信号DVH。如图7所示，数据写入模块12可以包括晶体管T9，晶体管T9的第一极可以电连接数据信号端，数据信号端可以分时提供数据信号Vdata和偏置信号DVH，晶体管T9的第二极与驱动晶体管T1的源极电连接。在其它示例中，晶体管T9的第二极可与驱动晶体管T1的漏极电连接。晶体管T9的栅极可接收控制信号SP。控制信号SP可为脉冲信号，通过脉冲信号的高低电平控制晶体管T9导通或关闭。
如图8或图9所示，在共用晶体管T9分时传输数据信号Vdata和偏置信号DVH的情况下，在n1个偏置阶段，晶体管T9导通，向驱动晶体管T1传输偏置信号DVH，在数据写入阶段d，晶体管T9导通，向驱动晶体管T1传输数据信号Vdata。
需要说明的是，当驱动晶体管T1的第一极为其源极S时，该驱动晶体管T1的第二极为其漏极D，当驱动晶体管T1的第二极为其源极S时，该驱动晶体管T1的第二极为其漏极D。可以理解，晶体管的源漏极并非恒定不变，而是会随着晶体管驱动状态变化而改变。
图1、图4、图7示例性示出了像素电路10的驱动晶体管T1为PMOS型晶体管，此时驱动晶体管T1的漏极D与发光元件20耦接，而驱动晶体管T1的源极S接收数据信号Vdata，并将所接收到的数据信号Vdata传输至其栅极。而本申请实施例还可以如图5和图6所示，像素电路10的驱动晶体管T1还可以为NMOS型晶体管，此时驱动晶体管T1的源极S接收数据信号Vdata的同时，还与发光元件20耦接。
另外，本申请附图中，以驱动晶体管T1的栅极电连接节点N1，驱动晶体管T1的源极S电连接节点N2，驱动晶体管T1的漏极D电连接节点N3，发光元件20的阳极电连接节点N4示意。
为便于描述，在没有特殊说明的前提下，本申请实施例均以图1示出的像素电路，对本申请实施例的技术方案进行示例性的说明。
示例性的，在数据写入模块12与驱动晶体管T1的第一极或第二极电连接的情况下，如图1、图4至图7任一项附图所示，像素电路10还可以包括补偿模块14，补偿模块14的电连接于驱动晶体管T1的栅极和驱动晶体管T1的第一极或第二极之间。补偿模块14可在第三控制信号S2N1的控制下导通或关闭。补偿模块14可包括第五晶体管T5，第五晶体管T5的第一极电连接驱动晶体管T1的栅极，第五晶体管T5的第一极电连接驱动晶体管T1的第一极或第二极，第五晶体管T5的栅极接收第三控制信号S2N1。第三控制信号S2N1为脉冲信号，通过脉冲信号的高低电平控制第五晶体管T5导通或关闭。
可理解的是，以图1为例，在数据写入阶段d，第三控制信号S2N1可控制第五晶体管T5导通，此阶段第二晶体管T2、驱动晶体管T1也可导通，以确保数据信号Vdata经第二晶体管T2传输至驱动晶体管T1的源极S，然后经驱动晶体管T1传输至驱动晶体管T1的漏极D，然后经第五晶体管T5传输至驱动晶体管T1的栅极。另外，在第一偏置阶段p1，第三控制信号S2N1可控制第五晶体管T5导通，此阶段第三晶体管T3、驱动晶体管T1也可导通，以确保偏置信号DVH经第三晶体管T3传输至驱动晶体管T1的源极S，然后经驱动晶体管T1传输至驱动晶体管T1的漏极D，然后经第五晶体管T5传输至驱动晶体管T1的栅极。
在一些可选的实施例中，如图1、图4至图7任一项附图所示，像素电路10还可以包括第一初始化模块13。如图2或图3所示，在至少一帧画面时间内，像素电路的前置阶段还包括第一初始化阶段c1，第一初始化阶段c1在任意一个偏置阶段之前。可理解的是，第一初始化阶段c1在第一偏置阶段p1之前。第一初始化模块13用于在第一初始化阶段c1将第一初始化信号Vref1写入驱动晶体管T1的栅极。
第一初始化模块13可电连接于第一初始化信号端与驱动晶体管T1的栅极之间，第一初始化模块13可在第四控制信号S1N1的控制下导通或者关闭。第一初始化信号端用于提供第一初始化信号Vref1。
作为一个示例，第一初始化模块13可包括第四晶体管T4，第四晶体管T4的第一极接收第一初始化信号Vref1，第四晶体管T4的第二极与驱动晶体管T1的栅极电连接，第四晶体管T4的栅极接收第四控制信号S1N1。第四控制信号S1N1为脉冲信号，通过脉冲信号的高低电平控制第四晶体管T4导通或关闭。
由于前一帧画面各驱动晶体管T1的电压可能不同，比如两个发光元件的其中一个发光元件在前一帧对应白画面，另一个发光元件在前一帧对应黑画面，在第一偏置阶段p1之前如果没有第一初始化阶段c1，那么在偏置信号DVH写入两个发光元件对应的两个驱动晶体管的栅极时，两个驱动晶体管的栅极电位不同，导致偏置信号DVH写入的过程不同，因此两个驱动晶体管的偏压情况会不同，进而导致不同驱动晶体管之间存在差异。而本申请实施例中，在第一偏置阶段p1有第一初始化阶段c1，如此一来，可将驱动晶体管的栅极初始化为一个统一电位之后，再将偏置信号DVH写入驱动晶体管的栅极，从而使得不同驱动晶体管经历相同的偏置信号DVH写入过程，进而进一步消除前一画面对驱动晶体管的偏压影响。
本申请发明人研究发现，像素电路在发光阶段等非偏置阶段，对于PMOS型驱动晶体管而言，可能存在栅极电位比漏极电位还要高的情况，对于NMOS型驱动晶体管而言，可能存在栅极电位比漏极电位还要低的情况；长期保持上述这种情况就会导致驱动晶体管内部的离子极性化，进而驱动晶体管内部形成内建电场，导致驱动晶体管的阈值电压不断偏移，从而影响流入发光元件的驱动电流。例如在黑画面切换成白画面时，显示亮度会缓慢上升，需要经历4-5帧的数据刷新，亮度才能趋于稳定，由于该恢复时间较长，因此人眼就能察觉到画面拖影。
在一些可选的实施例中，n1≥2的情况下，如图2或者图3所示，n1个偏置阶段中可包括第二偏置阶段p2，第二偏置阶段p2在数据写入阶段d之前且在第一初始化阶段c1之后，在第二偏置阶段p2偏置信号DVH写入驱动晶体管T1的第一极和/或第二极。
在第二偏置阶段p2，补偿模块14可关断。
可理解的是，若驱动晶体管T1在第二偏置阶段p2导通，则偏置信号DVH可写入驱动晶体管T1的第一极和第二极；若驱动晶体管T1在第二偏置阶段p2关断，偏置信号DVH可写入驱动晶体管T1的第一极或第二极。例如，驱动晶体管T1在第二偏置阶段p2关断，在用于传输偏置信号DVH的晶体管T3与驱动晶体管T1的第一极连接的情况下，偏置信号DVH可写入驱动晶体管T1的第一极，在用于传输偏置信号DVH的晶体管T3与驱动晶体管T1的第二极连接的情况下，偏置信号DVH可写入驱动晶体管T1的第二极。
本申请实施例中，由于在第二偏置阶段p2偏置信号DVH可写入驱动晶体管T1的第一极和/或第二极，从而使得驱动晶体管T1处于导通-偏置(On-bias，OBS)状态，进而改善驱动晶体管T1的栅极和其第一极或第二极之间的电势差，减弱驱动晶体管T1内部离子极性化程度，实现对驱动晶体管T1的阈值电压Vth的调节，进一步减弱前一个画面对驱动晶体管T1的偏压影响。
作为一个示例，如图2所示，第二偏置阶段p2可在第一偏置阶段p1之后。
在一些可选的实施例中，如图2所示，在至少一帧画面时间内，像素电路的前置阶段还可包括第二初始化阶段c2，第二初始化阶段c2位于第一偏置阶段p1和第二偏置阶段p2之间。第一初始化模块13还用于在第二初始化阶段c2将第一初始化信号Vref1写入驱动晶体管T1的栅极。
本文中，对于PMOS型的驱动晶体管，第一初始化信号Vref1可为负电压，偏置信号DVH可为高电压。
本申请实施例中，一方面，第二初始化阶段c2在数据写入阶段d之前，通过设置第二初始化阶段c2，可保证在数据写入阶段d数据信号Vdata能够有效的写入驱动晶体管的栅极；另一方面，结合参考图1和图2，第二初始化阶段c2在第二偏置阶段p2之前，这样在第二初始化阶段c2驱动晶体管T1的栅极被初始化为负电位，在第二偏置阶段p2，驱动晶体管T1的栅极维持负电位，驱动晶体管T1的第一极和第二极为偏置信号DVH的高电位，这样对驱动晶体管T1的栅极与其第一极和第二极之间的电位差为负，从而对驱动晶体管T1施加负的OBS偏压，进一步减弱前一个画面对驱动晶体管T1的偏压影响。
作为一个示例，如图3所示，第二偏置阶段p2可在第一偏置阶段p1之前。
可理解的是，第一初始化阶段c1在第二偏置阶段p2之前。同理，结合参考图1和图3，第一初始化阶段c1在第二偏置阶段p2之前，这样在第一初始化阶段c1驱动晶体管T1的栅极被初始化为负电位，在第二偏置阶段p2，驱动晶体管T1的栅极维持负电位，驱动晶体管T1的第一极和第二极为偏置信号DVH的高电位，这样对驱动晶体管T1的栅极与其第一极和第二极之间的电位差为负，从而对驱动晶体管T1施加负的OBS偏压，从而减弱前一个画面对驱动晶体管T1的偏压影响。
可理解的是，在第二偏置阶段p2，驱动晶体管T1的栅极电位等于第一初始化信号Vref1的低电位，驱动晶体管T1的第一极和第二极电位为偏置信号DVH的高电位，这样对驱动晶体管T1进行OBS处理的偏压很大，驱动晶体管T1的特性向统一方向偏移，之后驱动晶体管T1的栅极电位向目标画面对应的电位移动，发光元件的亮度会发生变化，引起闪烁。而通过将第一偏置阶段p1设置在第二偏置阶段p2之后，偏置信号DVH的高电压写入驱动晶体管T1的栅极，从而进行新一轮写入动作，使得驱动晶体管T1的偏压状态由于偏置信号DVH写入驱动晶体管T1栅极而发生变化，进而减弱第二偏置阶段p2的强偏压影响，改善闪烁问题。
在一些可选的实施例中，如图3所示，在至少一帧画面时间内，像素电路的前置阶段还可包括第二初始化阶段c2，第二初始化阶段c2位于第一偏置阶段p1和数据写入阶段d之间。第一初始化模块13还用于在第二初始化阶段c2将第一初始化信号Vref1写入驱动晶体管T1的栅极。
由于第一偏置阶段p1会将偏置信号DVH的高电压写入驱动晶体管的栅极，通过在第一偏置阶段p1和数据写入阶段d之间设置第二初始化阶段c2，可保证在数据写入阶段d数据信号Vdata能够有效的写入驱动晶体管的栅极。
在一些可选的实施例中，n1≥3的情况下，如图2或图3所示，n1个偏置阶段中还可包括第三偏置阶段p3，第三偏置阶段p3在数据写入阶段d之后，在第三偏置阶段p3偏置信号DVH写入驱动晶体管T1的第一极和/或第二极。
本申请实施例中，通过设置第三偏置阶段p3，可再次对驱动晶体管T1进行OBS处理，从而减弱前一个画面对驱动晶体管T1的偏压影响。
在第三偏置阶段p3，补偿模块14可关断。
可理解的是，若驱动晶体管T1在第三偏置阶段p3导通，则偏置信号DVH可写入驱动晶体管T1的第一极和第二极；若驱动晶体管T1在第三偏置阶段p3关断，偏置信号DVH可写入驱动晶体管T1的第一极或第二极。例如，驱动晶体管T1在第三偏置阶段p3关断，在用于传输偏置信号DVH的晶体管T3与驱动晶体管T1的第一极连接的情况下，偏置信号DVH可写入驱动晶体管T1的第一极，在用于传输偏置信号DVH的晶体管T3与驱动晶体管T1的第二极连接的情况下，偏置信号DVH可写入驱动晶体管T1的第二极。
作为一个示例，第一偏置阶段p1的时长可大于第二偏置阶段p2和第三偏置阶段p3中至少一者的时长。
作为另一个示例，第一偏置阶段p1的时长可大于或等于第二偏置阶段p2和第三偏置阶段p3的总时长。
在第二偏置阶段p2和第三偏置阶段p3，均是将偏置信号写入驱动晶体管的第一极和/或第二极，两者对驱动晶体管的偏压调节过程可认为是相同的，而在第一偏置阶段p1是将偏置信号写入驱动晶体管的栅极，不同于第二偏置阶段p2和第三偏置阶段p3。通过将第一偏置阶段p1的时长设置的适当长一些，可以实现对驱动晶体管N1更好的补偿，从而更好的消除驱动晶体管的特性差异。
示例性的，第二偏置阶段p2和第三偏置阶段p3的时长可以相等。
在第一偏置阶段p1的时长较长的情况下，在第一偏置阶段p1、第二偏置阶段p2和第三偏置阶段p3，偏置信号DVH的电压可保持不变。
作为一个示例，偏置信号DVH的电压在不同偏置阶段也可以不同。例如，在第一偏置阶段p1，偏置信号DVH的电压为V1，在第二偏置阶段p2，偏置信号DVH的电压为V2，在第三偏置阶段p3，偏置信号DVH的电压为V3，V1＜V2，和/或，V1＜V3。
作为又一个示例，V2＝V3，且V1＜V2，V1＜V3。
在第二偏置阶段p2和第三偏置阶段p3，是对驱动晶体管进行OBS处理，偏置信号DVH在第二偏置阶段p2和第三偏置阶段p3的电压更高的情况下，可以对驱动晶体管进行更高的偏压处理，从而更好的消除驱动晶体管的特性差异。
示例性的，偏置信号DVH的电压在不同偏置阶段不同的情况下，前置阶段中n1个偏置阶段的时长可以均相等。例如，第一偏置阶段p1的时长、第二偏置阶段p2的时长和第三偏置阶段p3的时长相等。
示例性的，如图1所示，像素电路10还可以包括第二初始化模块15、发光控制模块16和存储电容Cst。
第二初始化模块15用于将第二初始化信号Vref2传输至发光元件20的阳极。第二初始化模块15可在第二控制信号SP2的控制下导通或者关闭。图1中以第二初始化模块15和第二子模块122接收的控制信号相同为例，在其他实施例中，第二初始化模块15也可接收和第二子模块122的第二控制信号SP2不同的控制信号。
第二初始化模块15可包括第六晶体管T6，第六晶体管T6的第一极接收第二初始化信号Vref2，第六晶体管T6的第二极电连接发光元件20的阳极，第六晶体管T6的栅极接收第二控制信号SP2。
发光控制模块16可包括第一发光控制模块161和第二发光控制模块162。第一发光控制模块161可包括第七晶体管T7，第七晶体管T7的栅极可接收第五控制信号EM，第七晶体管T7的第一极与正性的第一电源信号PVDD电连接，第七晶体管T7的第二极可与驱动晶体管T1的第一极电连接。第二发光控制模块162可包括第八晶体管T8，第八晶体管T8的栅极可接收第五控制信号EM，第八晶体管T8的第一极与驱动晶体管T1的第二极电连接，第八晶体管T8的第二极可与发光元件20的阳极电连接。发光元件20的阴极与负性的第二电源信号PVEE电连接。
第五控制信号EM可为脉冲信号，通过脉冲信号的高低电平控制第七晶体管T7和第八晶体管T8导通或关闭。
如图1所示，存储电容Cst的一端与正性的第一电源信号PVDD电连接，存储电容Cst的另一端与驱动晶体管T1的栅极电连接于节点N1。或者，如图5所示，存储电容Cst的一端与发光元件20的阳极电连接于节点N4，存储电容Cst的另一端与驱动晶体管T1的栅极电连接于节点N1。存储电容Cst对驱动晶体管T1的栅极电压进行存储，确保驱动晶体管T1的栅极电压的准确性。
需要说明的是，本申请实施例中的晶体管可以为NMOS型晶体管，也可以为PMOS型晶体管。对于NMOS型晶体管来说，导通电平为高电平，截止电平为低电平。即，NMOS型晶体管的栅极为高电平时，其第一极和第二极之间导通，NMOS型晶体管的栅极为低电平时，其第一极和第二极之间关断。对于PMOS型晶体管来说，导通电平为低电平，截止电平为高电平。即，PMOS型晶体管的控制极为低电平时，其第一极和第二极之间导通，PMOS型晶体管的控制端为高电平时，其第一极和第二极之间关断。在具体实施时，上述各晶体管的栅极作为其控制极，并且，根据各晶体管的栅极的信号以及其类型，可以将其第一极作为源极，第二极作为漏极，或者将其第一极作为漏极，第二极作为源极，在此不做区分，另外本发明实施例中的导通电平和截止电平均为泛指，导通电平是指任何能够使晶体管导通的电平，截止电平是指任何能够使晶体管截止/关断的电平。
本申请实施例及附图中，仅示意了第二晶体管T2、第三晶体管T3、第六晶体管T6、第七晶体管T7、第八晶体管T8以及晶体管T9为PMOS型晶体管，这些晶体管也可以为NMOS型晶体管，本申请对此不作限定。另外，本申请实施例及附图中，仅示意了第四晶体管T4和第五晶体管T5为NMOS型晶体管，这些晶体管也可以为PMOS型晶体管，本申请对此也不作限定。
在一些可选的实施例中，结合参考图1和图10至图15中的任一个附图，显示面板的一个数据写入周期共包括S帧刷新画面，S>0。数据写入周期可包括数据写入帧和保持帧，保持帧不包含数据写入阶段。帧是以一个发光阶段的最小周期而计算的，在数据写入帧，数据写入模块12向驱动晶体管T1提供数据信号Vdata，在保持帧，数据写入模块12不再向驱动晶体管T1提供数据信号Vdata。
数据写入帧可包括上文介绍的前置阶段，也就是说数据写入帧可包括上文介绍的n1个偏置阶段，保持帧也可包括偏置阶段，例如保持帧内偏置阶段的数据可包括n2个，n2≥1，且n2为整数。如此一来，在数据写入帧和保持帧均对驱动晶体管进行偏置调节，使得数据写入帧中驱动晶体管的特性与保持帧中驱动晶体管的特性差异较小，从而减小数据写入帧的亮度与保持帧的亮度差异。
示例性的，保持帧可包括非发光阶段和发光阶段。非发光阶段可包括n2个偏置阶段。
另外，在保持帧内的非发光阶段，第一初始化模块13、补偿模块14和发光控制模块16均关断，第二初始化模块15可以选择性导通。在保持帧内的发光阶段，第一初始化模块13、补偿模块14和第二初始化模块15均关断，发光控制模块16导通，驱动晶体管T1产生的驱动电流传输至发光元件20，发光元件20发光。
在一些可选的实施例中，n1≥n2。
作为一个示例，如图10或图11所示，n1＝n2＝3。保持帧内的3个偏置阶段分别为第四偏置阶段p4、第五偏置阶段p5和第六偏置阶段p6。
作为另一个示例，如图12或图13所示，n1＝n2＝2。保持帧内的2个偏置阶段分别为第五偏置阶段p5和第六偏置阶段p6。
作为又一个示例，如图14或图15所示，n1＝n2＝1。保持帧内的1个偏置阶段为第六偏置阶段p6。
第四偏置阶段p4在保持帧内的相对位置可等同于第一偏置阶段p1在数据写入帧内的相对位置，第五偏置阶段p5在保持帧内的相对位置可等同于第二偏置阶段p2在数据写入帧内的相对位置，第六偏置阶段p6在保持帧内的相对位置可等同于第三偏置阶段p3在数据写入帧内的相对位置。
在一些可选的实施例中，数据写入帧内的n1个偏置阶段的总时长和保持帧内的n2个偏置阶段的总时长相等。如此一来，可进一步减小数据写入帧中驱动晶体管的特性与保持帧中驱动晶体管的特性差异，从而进一步减小数据写入帧的亮度与保持帧的亮度差异。
作为一个示例，如图10或图11所示，n1＝n2＝3，第四偏置阶段p4的时长等于第一偏置阶段p1的时长，第五偏置阶段p5的时长等于第二偏置阶段p2的时长，第六偏置阶段p6的时长等于第三偏置阶段p3的时长。
在一些可选的实施例中，显示面板可包括多行像素电路。如图1和图16或图17所示，数据写入模块12包括第一子模块121和第二子模块122的情况下，第一控制信号SP1可以驱动一行像素电路，除第一控制信号SP1之外的其它控制信号可以驱动多行像素电路。
例如，至少n3行像素电路在同一时刻所接收的第二控制信号SP2可以相同，且n3行像素电路在同一帧画面时间内，依次进入数据写入阶段，n3≥2，且n3为整数。
显示面板可以包括驱动电路，驱动电路可包括级联的多个驱动电路单元，级联的多个驱动电路单元可产生级传的控制信号。多行像素电路共用控制信号，如此一来，可减少驱动电路单元的数量。
图16和图17以n3等于2为例，第i行和第i+1行像素电路在同一时刻所接收的第二控制信号SP2可以相同，第i行和第i+1行像素电路在同一时刻所接收的第三控制信号S2N1可相同，第i行和第i+1行像素电路在同一时刻所接收的第四控制信号S1N1可相同，第i行和第i+1行像素电路在同一时刻所接收的第五控制信号EM可相同。第i行和第i+1行像素电路在同一帧画面时间内接收的第一控制信号SP1(i)、SP1(i+1)依次为导通电平，这样第i行像素电路和第i+1行像素电路可以依次进入其分别对应的数据写入阶段d(i)、d(i+1)。
基于与上述实施例提供的显示面板相同的技术构思，相应地，本申请实施例还提供了一种显示面板的驱动方法，该显示面板的驱动方法可以应用于如上述实施例提供的显示面板。
如图1所示，显示面板可以包括像素电路10和发光元件20，像素电路10可包括驱动模块11和数据写入模块12。驱动模块12用于为发光元件20提供驱动电流，驱动模块11可包括驱动晶体管T1。发光元件20包括但不限于有机发光二极管(Organic Light-EmittingDiode，OLED)。
数据写入模块12可以向驱动晶体管T1提供数据信号Vdata及偏置信号DVH。
如图2或图3所示，显示面板的一帧画面时间内，像素电路的工作过程可以包括前置阶段和发光阶段。在至少一帧画面时间内，像素电路的前置阶段可以包括数据写入阶段d和n1个偏置阶段，n1≥1，且n1为整数。
图18为本申请实施例提供的显示面板的驱动方法的一种流程示意图。如图18所示，显示面板的驱动方法包括步骤S101、S102。
步骤S101，在数据写入阶段，数据写入模块为驱动晶体管的栅极提供数据信号；
步骤S102，在偏置阶段，数据写入模块用于为驱动晶体管提供偏置信号，且n1个偏置阶段中包括第一偏置阶段，第一偏置阶段在数据写入阶段之前，在第一偏置阶段偏置信号写入驱动晶体管的栅极。
根据本申请实施例提供的显示面板的驱动方法，由于第一偏置阶段在数据写入阶段之前，偏置信号写入驱动晶体管的栅极可以提前对驱动晶体管的特性进行修正，将各像素电路中驱动晶体管的特性在写入当前画面的数据信号之前，进行统一的偏置信号的写入，确保各像素电路中驱动晶体管在数据信号写入前的特性更加接近，以消除前一画面对驱动晶体管的偏压影响，改善显示画面切换时的拖影问题，提高显示效果。
在一些可选的实施例中，如图1、图4至图7任一项附图所示，像素电路10还可以包括第一初始化模块13。
如图19所示，显示面板的驱动方法还可以包括步骤S103。
步骤S103，在至少一帧画面时间内，在前置阶段的第一初始化阶段，第一初始化模块将初始化信号写入驱动晶体管的栅极，其中，第一初始化阶段在任意一个偏置阶段之前。
由于前一帧画面各驱动晶体管的电压可能不同，比如两个发光元件的其中一个发光元件在前一帧对应白画面，另一个发光元件在前一帧对应黑画面，在第一偏置阶段之前如果没有第一初始化阶段，那么在偏置信号写入两个发光元件对应的两个驱动晶体管的栅极时，两个驱动晶体管的栅极电位不同，导致偏置信号写入的过程不同，因此两个驱动晶体管的偏压情况会不同，进而导致不同驱动晶体管之间存在差异。而本申请实施例中，在第一偏置阶段有第一初始化阶段，如此一来，可将驱动晶体管的栅极初始化为一个统一电位之后，再将偏置信号写入驱动晶体管的栅极，从而使得不同驱动晶体管经历相同的偏置信号写入过程，进而进一步消除前一画面对驱动晶体管的偏压影响。
在一些可选的实施例中，n1≥2，如图20所示，显示面板的驱动方法还可以包括步骤S104。
步骤S104，n1个偏置阶段中包括第二偏置阶段，第二偏置阶段在数据写入阶段之前且在第一初始化阶段之后，在第二偏置阶段偏置信号写入驱动晶体管的第一极和/或第二极。
本申请实施例中，由于在第二偏置阶段偏置信号可写入驱动晶体管T1的第一极和/或第二极，从而使得驱动晶体管处于OBS状态，进而改善驱动晶体管的栅极和其第一极或第二极之间的电势差，减弱驱动晶体管内部离子极性化程度，实现对驱动晶体管的阈值电压Vth的调节，进一步减弱前一个画面对驱动晶体管的偏压影响。
在一些可选的实施例中，n1≥2，如图21所示，显示面板的驱动方法还可以包括步骤S105。
步骤S105，n1个偏置阶段中包括第三偏置阶段，第三偏置阶段在数据写入阶段之后，在第三偏置阶段偏置信号写入驱动晶体管的第一极和/或第二极。
本申请实施例中，通过设置第三偏置阶段，可再次对驱动晶体管进行OBS处理，从而减弱前一个画面对驱动晶体管的偏压影响。
本申请实施例提供的显示面板。因此，该显示装置具备本申请实施例提供的显示面板及其驱动方法的技术特征，能够达到本申请实施例提供的显示面板的有益效果，相同之处可参照上述对本申请实施例提供的显示面板的描述，在此不再赘述。
示例性的，图22示出根据本申请实施例提供的显示装置的一种结构示意图。如图22所示，本申请实施例提供的显示装置200包括本申请上述任一实施例提供的显示面板100。图22实施例仅以手机为例，对显示装置200进行说明，可以理解的是，本申请实施例提供的显示装置，本发明实施例提供的显示装置200可以为任何具有显示功能的电子产品，包括但不限于以下类别：手机、电视机、笔记本电脑、桌上型显示器、平板电脑、数码相机、智能手环、智能眼镜、车载显示器、医疗设备、工控设备、触摸交互终端等，本发明实施例对此不作特殊限定。
依照本申请如上文所述的实施例，这些实施例并没有详尽叙述所有的细节，也不限制该申请仅为所述的具体实施例。显然，根据以上描述，可作很多的修改和变化。本说明书选取并具体描述这些实施例，是为了更好地解释本申请的原理和实际应用，从而使所属技术领域技术人员能很好地利用本申请以及在本申请基础上的修改使用。本申请仅受权利要求书及其全部范围和等效物的限制。

Claims (22)

1.一种显示面板，其特征在于，包括：
像素电路和发光元件；
所述像素电路包括驱动模块和数据写入模块，所述驱动模块包括驱动晶体管；
所述显示面板的一帧画面时间内，所述像素电路的工作过程包括前置阶段和发光阶段；
在至少一帧画面时间内，所述像素电路的前置阶段包括数据写入阶段和n1个偏置阶段，n1≥1，且n1为整数；
所述数据写入模块用于在所述数据写入阶段为所述驱动晶体管的栅极提供数据信号，所述数据写入模块用于在所述偏置阶段为所述驱动晶体管提供偏置信号；
所述n1个偏置阶段中包括第一偏置阶段，所述第一偏置阶段在所述数据写入阶段之前，且在所述第一偏置阶段所述偏置信号写入所述驱动晶体管的栅极。
2.根据权利要求1所述的显示面板，其特征在于，所述像素电路还包括第一初始化模块，在至少一帧画面时间内，所述像素电路的前置阶段还包括第一初始化阶段，所述第一初始化阶段在任意一个所述偏置阶段之前；
所述第一初始化模块用于在所述第一初始化阶段将第一初始化信号写入所述驱动晶体管的栅极。
3.根据权利要求2所述的显示面板，其特征在于，n1≥2，所述n1个偏置阶段中包括第二偏置阶段，所述第二偏置阶段在所述数据写入阶段之前且在所述第一初始化阶段之后，在所述第二偏置阶段所述偏置信号写入所述驱动晶体管的第一极和/或第二极。
4.根据权利要求3所述的显示面板，其特征在于，所述第二偏置阶段在所述第一偏置阶段之后。
5.根据权利要求4所述的显示面板，其特征在于，在至少一帧画面时间内，所述像素电路的前置阶段还包括第二初始化阶段，所述第二初始化阶段位于所述第一偏置阶段和所述第二偏置阶段之间；
所述第一初始化模块还用于在所述第二初始化阶段将第一初始化信号写入所述驱动晶体管的栅极。
6.根据权利要求3所述的显示面板，其特征在于，所述第二偏置阶段在所述第一偏置阶段之前。
7.根据权利要求6所述的显示面板，其特征在于，在至少一帧画面时间内，所述像素电路的前置阶段还包括第二初始化阶段，所述第二初始化阶段位于所述第一偏置阶段和所述数据写入阶段之间；
所述第一初始化模块还用于在所述第二初始化阶段将第一初始化信号写入所述驱动晶体管的栅极。
8.根据权利要求3所述的显示面板，其特征在于，n1≥3，所述n1个偏置阶段中包括第三偏置阶段，所述第三偏置阶段在所述数据写入阶段之后，在所述第三偏置阶段所述偏置信号写入所述驱动晶体管的第一极和/或第二极。
9.根据权利要求8所述的显示面板，其特征在于，所述第一偏置阶段的时长大于所述第二偏置阶段和所述第三偏置阶段中至少一者的时长。
10.根据权利要求8所述的显示面板，其特征在于，所述第一偏置阶段的时长大于或等于所述第二偏置阶段和所述第三偏置阶段的总时长。
11.根据权利要求8所述的显示面板，其特征在于，在所述第一偏置阶段，所述偏置信号的电压为V1，在所述第二偏置阶段，所述偏置信号的电压为V2，在所述第三偏置阶段，所述偏置信号的电压为V3；
V1＜V2，和/或，V1＜V3。
12.根据权利要求11所述的显示面板，其特征在于，V2＝V3。
13.根据权利要求1所述的显示面板，其特征在于，
所述显示面板的一个数据写入周期共包括S帧刷新画面，包括数据写入帧和保持帧，S＞0；
所述数据写入帧包括所述数据写入阶段，所述保持帧不包括所述数据写入阶段；
所述数据写入帧包括所述n1个偏置阶段，所述保持帧包括n2个偏置阶段，n2≥1，且n2为整数。
14.根据权利要求13所述的显示面板，其特征在于，n1≥n2。
15.根据权利要求13所述的显示面板，其特征在于，所述数据写入帧内的所述n1个偏置阶段的总时长和所述保持帧内的n2个偏置阶段的总时长相等。
16.根据权利要求1所述的显示面板，其特征在于，所述数据写入模块包括第一子模块和第二子模块；
所述第一子模块与数据信号端电连接，用于在第一控制信号的控制下，传输所述数据信号端提供的所述数据信号；
所述第二子模块与偏置信号端电连接，用于在第二控制信号的控制下，传输所述偏置信号端提供的所述偏置信号。
17.根据权利要求16所述的显示面板，其特征在于，所述显示面板包括多行所述像素电路；
至少n3行所述像素电路在同一时刻所接收的所述第二控制信号相同，且所述n3行所述像素电路在同一帧画面时间内，依次进入所述数据写入阶段，n3≥2，且n3为整数。
18.一种显示面板的驱动方法，其特征在于，
所述显示面板包括像素电路和发光元件；
所述像素电路包括驱动模块和数据写入模块，所述驱动模块包括驱动晶体管；
所述显示面板的一帧画面时间内，所述像素电路的工作过程包括前置阶段和发光阶段，在至少一帧画面时间内，所述像素电路的前置阶段包括数据写入阶段和n1个偏置阶段，n1≥1，且n1为整数；
其中，所述驱动方法包括：
在所述数据写入阶段，所述数据写入模块为所述驱动晶体管的栅极提供数据信号；
在所述偏置阶段，所述数据写入模块用于为所述驱动晶体管提供偏置信号，且所述n1个偏置阶段中包括第一偏置阶段，所述第一偏置阶段在所述数据写入阶段之前，在所述第一偏置阶段所述偏置信号写入所述驱动晶体管的栅极。
19.根据权利要求18所述的方法，其特征在于，所述像素电路还包括第一初始化模块，所述驱动方法还包括：
在至少一帧画面时间内，在所述前置阶段的第一初始化阶段，所述第一初始化模块将初始化信号写入所述驱动晶体管的栅极，其中，所述第一初始化阶段在任意一个所述偏置阶段之前。
20.根据权利要求19所述的方法，其特征在于，n1≥2，所述驱动方法还包括：
所述n1个偏置阶段中包括第二偏置阶段，所述第二偏置阶段在所述数据写入阶段之前且在所述第一初始化阶段之后，在所述第二偏置阶段所述偏置信号写入所述驱动晶体管的第一极和/或第二极。
21.根据权利要求19所述的方法，其特征在于，n1≥3，所述驱动方法还包括：
所述n1个偏置阶段中包括第三偏置阶段，所述第三偏置阶段在所述数据写入阶段之后，在所述第三偏置阶段所述偏置信号写入所述驱动晶体管的第一极和/或第二极。
22.一种显示装置，其特征在于，包括如权利要求1至17任一项所述的显示面板。
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