CN114420574A - 一种柔性封装构件及其形成方法 - Google Patents

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Abstract

本发明涉及一种柔性封装构件及其形成方法,涉及半导体封装领域。通过在牺牲材料层上设置多层柔性互连图案层,进而设置牺牲材料层的牺牲图案块、各柔性互连图案层的开孔以及各所述半导体芯片的第一焊盘对应重叠设置,进而利用第一导电通孔实现多层柔性互连图案层与各半导体芯片的第一焊盘的电连接,上述结构的设置有效提高相邻各半导体芯片之间的电连接结构的稳固性,在柔性封装构件的折叠弯折过程中,由于多层柔性互连图案层的存在,即使出现某层线路损坏,也不会影响相邻芯片之间的电连接的稳固性。

Description

一种柔性封装构件及其形成方法
技术领域
本发明涉及半导体封装领域,特别是涉及一种柔性封装构件及其形成方法。
背景技术
在现有的半导体封装结构中,为了提高半导体封装的集成度,通常需要设置柔性封装构件,以便于其折叠弯曲。而在柔性封装构件中,为了实现相邻芯片之间的电连接,需要设置额外的布线结构,而由于柔性封装构件在多次折叠的过程中,容易导致布线结构的损坏,因此,需要进一步改善柔性封装构件中布线结构的形成方式和结构,进而提高电连接的稳固性。
发明内容
本发明的目的是克服上述现有技术的不足,提供一种柔性封装构件及其形成方法。
为实现上述目的,本发明采用的技术方案是:
一种柔性封装构件的形成方法,该柔性封装构件的形成方法包括以下步骤:
提供第一基板,在所述第一基板上设置第一半导体管芯,并在所述第一基板上形成包裹所述第一半导体管芯的第一树脂封装件。
接着在所述第一树脂封装件上形成第一电路图案,所述第一电路图案电连接至所述第一基板。
接着在所述第一树脂封装构件上形成第二树脂封装件,所述第二树脂封装件包裹所述第一树脂封装件且具有暴露所述第一电路图案的环形凹槽,以形成第一封装件。
提供第二封装件,所述第二封装件具有第一半导体芯片、第二半导体芯片和第三半导体芯片,且所述第二封装件的底面具有多个导电凸块,接着将所述第二封装件设置在所述第一封装件上,弯折并压合所述第二封装件,所述第二封装件的多个所述导电凸块分别嵌入到所述环形凹槽,所述第一半导体芯片和所述第三半导体芯片分别贴设在所述第一封装件的相对的两个侧面上,所述第二半导体芯片贴设在所述第一封装件的上表面上。
在更优选的技术方案中,所述第一、第二树脂封装件的材质是环氧树脂,所述第一电路图案嵌入到所述第一树脂封装件中,所述环形凹槽的个数可以为1-4个,相邻所述环形凹槽之间的间距大于所述环形凹槽的宽度。
在更优选的技术方案中,所述第二封装件的形成方法具体包括:提供一临时衬底,在所述临时衬底上形成牺牲图案块以及包裹所述牺牲图案块的牺牲材料层;接着在所述牺牲材料层上形成交替层叠的柔性互连图案层和柔性保护层,每层所述柔性互连图案层均具有开孔,每层所述柔性保护层包裹相应的所述柔性互连图案层且填充相应的所述柔性互连图案层的开孔,接着在最上层的所述柔性保护层上分离设置所述第一、第二、第三半导体芯片,所述第一、第二、第三半导体芯片分别包括第一焊盘和第二焊盘,所述第一焊盘与所述第三开孔对应设置,接着形成一柔性封装层以包裹所述第一、第二、第三半导体芯片,接着去除所述临时衬底,接着在所述牺牲图案块的位置形成贯穿所述牺牲材料层和各所述柔性保护层的第一通孔,所述第一通孔暴露所述第一焊盘,接着在所述第一通孔中沉积导电材料以形成第一导电通孔,接着通过平坦化工艺去除所述牺牲材料层和所述第一导电通孔中突出于所述第一柔性保护层的部分,接着在最底层的所述柔性保护层上形成第四柔性保护层,接着形成暴露所述第二焊盘的第二通孔,并在所述第二通孔中沉积导电材料以形成第二导电通孔,并在所述第二导电通孔上形成导电凸块。
在更优选的技术方案中,所述在所述牺牲材料层上形成交替层叠的柔性互连图案层和柔性保护层的具体步骤包括:在所述牺牲材料层上形成第一柔性互连图案层,所述第一柔性互连图案中具有第一开孔,所述第一开孔与所述牺牲图案块对应设置,接着在所述牺牲材料层上形成第一柔性保护层,所述第一柔性保护层完全包裹所述第一柔性互连图案层且填充所述第一开孔,接着在所述第一柔性保护层上形成第二柔性互连图案层,所述第二柔性互连图案中具有第二开孔,所述第二开孔与所述第一开孔对应设置,接着在所述第一柔性保护层上形成第二柔性保护层,所述第二柔性保护层完全包裹所述第二柔性互连图案层且填充所述第二开孔,接着在所述第二柔性保护层上形成第三柔性互连图案层,所述第三柔性互连图案中具有第三开孔,所述第三开孔与所述第二开孔对应设置,接着在所述第二柔性保护层上形成第三柔性保护层,所述第三柔性保护层完全包裹所述第三柔性互连图案层且填充所述第三开孔。
在更优选的技术方案中,所述牺牲图案块的尺寸大于所述第一开孔的孔径。
在更优选的技术方案中,所述柔性保护层的材质包括聚酰亚胺、苯并环丁烯、聚二甲基硅氧烷、派瑞林中的一种。
在更优选的技术方案中,所述第一、第二、第三半导体芯片各自的所述第一焊盘的尺寸大于所述牺牲图案块的尺寸。
在更优选的技术方案中,所述柔性互连图案层通过交替旋涂金属纳米线溶液和沉积金属铜形成。
在更优选的技术方案中,形成第二通孔的同时形成暴露所述柔性互连图案层的第三通孔,进而在所述第三通孔中沉积导电材料以形成第三导电通孔,并在所述第三导电通孔上形成导电凸块。
在更优选的技术方案中,一种柔性封装构件,其采用上述方法形成的。
相较于现有技术,本发明的柔性封装构件及其形成方法有如下的有益效果:
通过在牺牲材料层上设置多层柔性互连图案层,进而设置牺牲材料层的牺牲图案块、各柔性互连图案层的开孔以及各所述半导体芯片的第一焊盘对应重叠设置,进而利用第一导电通孔实现多层柔性互连图案层与各半导体芯片的第一焊盘的电连接,上述结构的设置有效提高相邻各半导体芯片之间的电连接结构的稳固性,在柔性封装构件的折叠弯折过程中,由于多层柔性互连图案层的存在,即使出现某层线路损坏,也不会影响相邻芯片之间的电连接的稳固性。
附图说明
图1为在第一基板上设置第一半导体管芯和第一树脂封装件的示意图。
图2为在第一树脂封装构件上形成第二树脂封装件的示意图。
图3为在临时衬底上形成牺牲图案块和牺牲材料层的示意图。
图4为在牺牲材料层上形成第一柔性互连图案层的示意图。
图5为在牺牲材料层上形成第一柔性保护层的示意图。
图6为在第一柔性保护层上形成第二柔性互连图案层的示意图。
图7为在第一柔性保护层上形成第二柔性保护层的示意图。
图8为在第二柔性保护层上形成第三柔性互连图案层的示意图。
图9为在第二柔性保护层上形成第三柔性保护层的示意图。
图10为在第三柔性保护层上分离设置第一、第二、第三半导体芯片的示意图。
图11为形成贯穿牺牲材料层和第一、第二、第三柔性保护层的第一通孔的示意图。
图12为形成第一导电通孔的示意图。
图13为形成第二导电通孔和导电凸块的示意图。
图14为在第一封装件上设置第二封装件的示意图。
具体实施方式
为了更好的理解本发明的技术方案,下面结合附图对本发明实施例进行详细描述。基于本发明中的实施例,本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其 它实施例,都属于本发明保护的范围。
本发明提出一种柔性封装构件的形成方法,该柔性封装构件的形成方法包括以下步骤:
提供第一基板,在所述第一基板上设置第一半导体管芯,并在所述第一基板上形成包裹所述第一半导体管芯的第一树脂封装件。
接着在所述第一树脂封装件上形成第一电路图案,所述第一电路图案电连接至所述第一基板。
接着在所述第一树脂封装构件上形成第二树脂封装件,所述第二树脂封装件包裹所述第一树脂封装件且具有暴露所述第一电路图案的环形凹槽,以形成第一封装件。
提供第二封装件,所述第二封装件具有第一半导体芯片、第二半导体芯片和第三半导体芯片,且所述第二封装件的底面具有多个导电凸块,接着将所述第二封装件设置在所述第一封装件上,弯折并压合所述第二封装件,所述第二封装件的多个所述导电凸块分别嵌入到所述环形凹槽,所述第一半导体芯片和所述第三半导体芯片分别贴设在所述第一封装件的相对的两个侧面上,所述第二半导体芯片贴设在所述第一封装件的上表面上。
其中,所述第一、第二树脂封装件的材质是环氧树脂,所述第一电路图案嵌入到所述第一树脂封装件中,所述环形凹槽的个数可以为1-4个,相邻所述环形凹槽之间的间距大于所述环形凹槽的宽度。
其中,所述第二封装件的形成方法具体包括:提供一临时衬底,在所述临时衬底上形成牺牲图案块以及包裹所述牺牲图案块的牺牲材料层;接着在所述牺牲材料层上形成交替层叠的柔性互连图案层和柔性保护层,每层所述柔性互连图案层均具有开孔,每层所述柔性保护层包裹相应的所述柔性互连图案层且填充相应的所述柔性互连图案层的开孔,接着在最上层的所述柔性保护层上分离设置所述第一、第二、第三半导体芯片,所述第一、第二、第三半导体芯片分别包括第一焊盘和第二焊盘,所述第一焊盘与所述第三开孔对应设置,接着形成一柔性封装层以包裹所述第一、第二、第三半导体芯片,接着去除所述临时衬底,接着在所述牺牲图案块的位置形成贯穿所述牺牲材料层和各所述柔性保护层的第一通孔,所述第一通孔暴露所述第一焊盘,接着在所述第一通孔中沉积导电材料以形成第一导电通孔,接着通过平坦化工艺去除所述牺牲材料层和所述第一导电通孔中突出于所述第一柔性保护层的部分,接着在最底层的所述柔性保护层上形成第四柔性保护层,接着形成暴露所述第二焊盘的第二通孔,并在所述第二通孔中沉积导电材料以形成第二导电通孔,并在所述第二导电通孔上形成导电凸块。
其中,所述在所述牺牲材料层上形成交替层叠的柔性互连图案层和柔性保护层的具体步骤包括:在所述牺牲材料层上形成第一柔性互连图案层,所述第一柔性互连图案中具有第一开孔,所述第一开孔与所述牺牲图案块对应设置,接着在所述牺牲材料层上形成第一柔性保护层,所述第一柔性保护层完全包裹所述第一柔性互连图案层且填充所述第一开孔,接着在所述第一柔性保护层上形成第二柔性互连图案层,所述第二柔性互连图案中具有第二开孔,所述第二开孔与所述第一开孔对应设置,接着在所述第一柔性保护层上形成第二柔性保护层,所述第二柔性保护层完全包裹所述第二柔性互连图案层且填充所述第二开孔,接着在所述第二柔性保护层上形成第三柔性互连图案层,所述第三柔性互连图案中具有第三开孔,所述第三开孔与所述第二开孔对应设置,接着在所述第二柔性保护层上形成第三柔性保护层,所述第三柔性保护层完全包裹所述第三柔性互连图案层且填充所述第三开孔。
其中,所述牺牲图案块的尺寸大于所述第一开孔的孔径。
其中,所述柔性保护层的材质包括聚酰亚胺、苯并环丁烯、聚二甲基硅氧烷、派瑞林中的一种。
其中,所述第一、第二、第三半导体芯片各自的所述第一焊盘的尺寸大于所述牺牲图案块的尺寸。
其中,所述柔性互连图案层通过交替旋涂金属纳米线溶液和沉积金属铜形成。
其中,形成第二通孔的同时形成暴露所述柔性互连图案层的第三通孔,进而在所述第三通孔中沉积导电材料以形成第三导电通孔,并在所述第三导电通孔上形成导电凸块。
进一步的,一种柔性封装构件,其采用上述方法形成的。
如图1~图14所示,本实施例提供一种柔性封装构件的形成方法,该形成方法包括以下步骤:
如图1所示,提供第一基板100,在所述第一基板100上设置第一半导体管芯101,并在所述第一基板100上形成包裹所述第一半导体管芯101的第一树脂封装件102。
在具体的实施例中,所述第一基板100可以为电路基板,更具体的,可以是具有绝缘基底和设置在绝缘基底上的导电层,还可以是层叠设置的金属基底、绝缘保护层和导电布线层。
在具体的实施例中,所述第一树脂封装件102为环氧树脂层。
如图1所示,接着在所述第一树脂封装件102上形成第一电路图案(未图示),所述第一电路图案电连接至所述第一基板100。
在具体的实施例中,可以通过在电镀铜的方式在所述第一树脂封装件102的上表面和四个侧面形成所述第一电路图案,更进一步的,所述第一电路图案可以嵌入到所述第一树脂封装件102中,以提高其接合稳固性。
如图2所示,接着在所述第一树脂封装构件102上形成第二树脂封装件103,所述第二树脂封装件103包裹所述第一树脂封装件102且具有暴露所述第一电路图案的环形凹槽104,以形成第一封装件105。
在具体的实施例中,所述第二树脂封装件103的材质是环氧树脂,所述环形凹槽104的个数可以为1-4个,相邻所述环形凹槽104之间的间距大于所述环形凹槽的宽度。
如图3所示,提供一临时衬底200,在所述临时衬底200上形成牺牲图案块203以及包裹所述牺牲图案块203的牺牲材料层202。
在具体的实施例中,所述临时衬底200为刚性衬底,所述解离层201为可降低粘性的粘结层,所述牺牲材料层202为氧化硅、氮化硅、氮氧化硅、PC、PMMA、PET、BCB、PI中的一种。
在具体的实施例中,所述牺牲图案块203位于所述牺牲材料层202与所述解离层201接触的一侧,所述牺牲图案块203的材质与所述牺牲材料层202不同,具体的所述牺牲图案块203可以为铜、铝、银等合适的金属材料,进而通过电镀或物理气相沉积工艺形成,以便于区分所述牺牲图案块203和所述牺牲材料层202,所述牺牲图案块203的个数为多个。
如图4所示,接着在所述牺牲材料层202上形成第一柔性互连图案层204,所述第一柔性互连图案204中具有第一开孔205,所述第一开孔205与所述牺牲图案块203对应设置。
在具体的实施例中,所述第一柔性互连图案层204通过交替旋涂金属纳米线溶液和沉积金属铜形成。
在更具体的实施例中,所述金属纳米线溶液中的金属纳米线为银纳米线、金纳米线、铂纳米线、铜纳米线、铜镍合金纳米线中的一种,所述金属纳米线的直径为10-50纳米,所述金属纳米线的长度为5-50微米,所述金属铜的厚度为1-4纳米。具体的,所述金属纳米线为银纳米线或铜镍合金纳米线。交替的次数为5-10次。
更具体的,可以通过设置掩膜,进而在交替旋涂金属纳米线溶液和沉积金属铜之后去除所述掩膜,以形成所述第一开孔205。
更具体的,所述牺牲图案块203的尺寸大于所述第一开孔205的孔径。
如图5所示,接着在所述牺牲材料层202上形成第一柔性保护层206,所述第一柔性保护层206完全包裹所述第一柔性互连图案层204且填充所述第一开孔205。
在具体的实施例中,所述第一柔性保护层206的材质包括聚酰亚胺、苯并环丁烯、聚二甲基硅氧烷、派瑞林中的一种。更具体的,通过旋涂、喷涂或印刷等合适的工艺形成。
如图6所示,接着在所述第一柔性保护层206上形成第二柔性互连图案层301,所述第二柔性互连图案301中具有第二开孔302,所述第二开孔302与所述第一开孔205对应设置。
在具体的实施例中,所述第二柔性互连图案层301与所述第一柔性互连图案层204的制备工艺相同。
如图7所示,接着在所述第一柔性保护层206上形成第二柔性保护层303,所述第二柔性保护层303完全包裹所述第二柔性互连图案层301且填充所述第二开孔302。
在具体的实施例中,所述第二柔性保护层303的材质包括聚酰亚胺、苯并环丁烯、聚二甲基硅氧烷、派瑞林中的一种。更具体的,通过旋涂、喷涂或印刷等合适的工艺形成。
如图8所示,接着在所述第二柔性保护层303上形成第三柔性互连图案层304,所述第三柔性互连图案304中具有第三开孔305,所述第三开孔305与所述第二开孔302对应设置。
在具体的实施例中,所述第三柔性互连图案层304与所述第一柔性互连图案层204的制备工艺相同。
如图9所示,接着在所述第二柔性保护层303上形成第三柔性保护层306,所述第三柔性保护层306完全包裹所述第三柔性互连图案层304且填充所述第三开孔305。
在具体的实施例中,所述第三柔性保护层306的材质包括聚酰亚胺、苯并环丁烯、聚二甲基硅氧烷、派瑞林中的一种。更具体的,通过旋涂、喷涂或印刷等合适的工艺形成。
如图10所示,接着在所述第三柔性保护层306上分离设置第一、第二、第三半导体芯片401、402、403,所述第一、第二、第三半导体芯片401、402、403分别包括第一焊盘404和第二焊盘405,所述第一焊盘404与所述第三开孔305对应设置,接着形成一柔性封装层406以包裹所述第一、第二、第三半导体芯片401、402、403。
在具体的实施中,所述第一、第二、第三半导体芯片各自的所述第一焊盘404的尺寸大于所述牺牲图案块203的尺寸。
在具体的实施例中,所述柔性封装层406可以为任何合适的柔性树脂材料。
如图11所示,接着去除所述临时衬底200,接着在牺牲图案块203的位置形成贯穿所述牺牲材料层202和所述第一、第二、第三柔性保护层206、303、306的第一通孔501,所述第一通孔501暴露所述第一焊盘404。
在具体的实施例中,通过激光烧蚀工艺形成所述第一通孔501。
如图12所示,接着在所述第一通孔501中沉积导电材料以形成第一导电通孔502,接着通过平坦化工艺去除所述牺牲材料层202和所述第一导电通孔502中突出于所述第一柔性保护层206的部分。
如图13所示,接着在所述第一柔性保护层206上形成第四柔性保护层503,接着形成暴露所述第二焊盘的第二通孔,并在所述第二通孔中沉积导电材料以形成第二导电通孔504,并在所述第二导电通孔上形成导电凸块505,以形成第二封装件600。
在具体的实施例中,所述第四柔性保护层503的材质包括聚酰亚胺、苯并环丁烯、聚二甲基硅氧烷、派瑞林中的一种。更具体的,通过旋涂、喷涂或印刷等合适的工艺形成。
在具体的实施例中,形成第二通孔的同时形成暴露所述第一柔性互连图案层204的第三通孔,进而在所述第三通孔中沉积导电材料以形成第三导电通孔506,并在所述第三导电通孔506上形成导电凸块505。
如图14所示,接着将所述第二封装件600设置在所述第一封装件105上,弯折并压合所述第二封装件600,使得所述第二封装件600的各导电凸块505分别嵌入到所述环形凹槽104,并使得所述第一半导体芯片401和所述第三半导体芯片403分别贴设在所述第一封装件105的相对的两个侧面上。
如图14所示,本发明还提出一种柔性封装构件,其采用上述方法形成的。
通过在牺牲材料层上设置多层柔性互连图案层,进而设置牺牲材料层的牺牲图案块、各柔性互连图案层的开孔以及各所述半导体芯片的第一焊盘对应重叠设置,进而利用第一导电通孔实现多层柔性互连图案层与各半导体芯片的第一焊盘的电连接,上述结构的设置有效提高相邻各半导体芯片之间的电连接结构的稳固性,在柔性封装构件的折叠弯折过程中,由于多层柔性互连图案层的存在,即使出现某层线路损坏,也不会影响相邻芯片之间的电连接的稳固性。
上述实施例仅例示性说明本发明的原理及其功效,而非用于限制本发明。任何熟悉此技术的人士皆可在不违背本发明的精神及范畴下,对上述实施例进行修饰或改变。因此,举凡所属技术领域中具有通常知识者在未脱离本发明所揭示的精神与技术思想下所完成的一切等效修饰或改变,仍应由本发明的权利要求所涵盖。

Claims (10)

1.一种柔性封装构件的形成方法,其特征在于:该柔性封装构件的形成方法包括以下步骤:
提供第一基板,在所述第一基板上设置第一半导体管芯,并在所述第一基板上形成包裹所述第一半导体管芯的第一树脂封装件;
接着在所述第一树脂封装件上形成第一电路图案,所述第一电路图案电连接至所述第一基板;
接着在所述第一树脂封装构件上形成第二树脂封装件,所述第二树脂封装件包裹所述第一树脂封装件且具有暴露所述第一电路图案的环形凹槽,以形成第一封装件;
提供第二封装件,所述第二封装件具有第一半导体芯片、第二半导体芯片和第三半导体芯片,且所述第二封装件的底面具有多个导电凸块,接着将所述第二封装件设置在所述第一封装件上,弯折并压合所述第二封装件,所述第二封装件的多个所述导电凸块分别嵌入到所述环形凹槽,所述第一半导体芯片和所述第三半导体芯片分别贴设在所述第一封装件的相对的两个侧面上,所述第二半导体芯片贴设在所述第一封装件的上表面上。
2.根据权利要求1所述的柔性封装构件的形成方法,其特征在于:所述第一、第二树脂封装件的材质是环氧树脂,所述第一电路图案嵌入到所述第一树脂封装件中,所述环形凹槽的个数可以为1-4个,相邻所述环形凹槽之间的间距大于所述环形凹槽的宽度。
3.根据权利要求1所述的柔性封装构件的形成方法,其特征在于:所述第二封装件的形成方法具体包括:提供一临时衬底,在所述临时衬底上形成牺牲图案块以及包裹所述牺牲图案块的牺牲材料层,
接着在所述牺牲材料层上形成交替层叠的柔性互连图案层和柔性保护层,每层所述柔性互连图案层均具有开孔,每层所述柔性保护层包裹相应的所述柔性互连图案层且填充相应的所述柔性互连图案层的开孔,
接着在最上层的所述柔性保护层上分离设置所述第一、第二、第三半导体芯片,所述第一、第二、第三半导体芯片分别包括第一焊盘和第二焊盘,所述第一焊盘与所述第三开孔对应设置,接着形成一柔性封装层以包裹所述第一、第二、第三半导体芯片,
接着去除所述临时衬底,接着在所述牺牲图案块的位置形成贯穿所述牺牲材料层和各所述柔性保护层的第一通孔,所述第一通孔暴露所述第一焊盘;
接着在所述第一通孔中沉积导电材料以形成第一导电通孔,接着通过平坦化工艺去除所述牺牲材料层和所述第一导电通孔中突出于所述第一柔性保护层的部分,
接着在最底层的所述柔性保护层上形成第四柔性保护层,接着形成暴露所述第二焊盘的第二通孔,并在所述第二通孔中沉积导电材料以形成第二导电通孔,并在所述第二导电通孔上形成导电凸块。
4.根据权利要求3所述的柔性封装构件的形成方法,其特征在于:所述在所述牺牲材料层上形成交替层叠的柔性互连图案层和柔性保护层的具体步骤包括:在所述牺牲材料层上形成第一柔性互连图案层,所述第一柔性互连图案中具有第一开孔,所述第一开孔与所述牺牲图案块对应设置,接着在所述牺牲材料层上形成第一柔性保护层,所述第一柔性保护层完全包裹所述第一柔性互连图案层且填充所述第一开孔,接着在所述第一柔性保护层上形成第二柔性互连图案层,所述第二柔性互连图案中具有第二开孔,所述第二开孔与所述第一开孔对应设置,接着在所述第一柔性保护层上形成第二柔性保护层,所述第二柔性保护层完全包裹所述第二柔性互连图案层且填充所述第二开孔,接着在所述第二柔性保护层上形成第三柔性互连图案层,所述第三柔性互连图案中具有第三开孔,所述第三开孔与所述第二开孔对应设置,接着在所述第二柔性保护层上形成第三柔性保护层,所述第三柔性保护层完全包裹所述第三柔性互连图案层且填充所述第三开孔。
5.根据权利要求4所述的柔性封装构件的形成方法,其特征在于:所述牺牲图案块的尺寸大于所述第一开孔的孔径。
6.根据权利要求3所述的柔性封装构件的形成方法,其特征在于:所述柔性保护层的材质包括聚酰亚胺、苯并环丁烯、聚二甲基硅氧烷、派瑞林中的一种。
7.根据权利要求3所述的柔性封装构件的形成方法,其特征在于:所述第一、第二、第三半导体芯片各自的所述第一焊盘的尺寸大于所述牺牲图案块的尺寸。
8.根据权利要求3所述的柔性封装构件的形成方法,其特征在于:所述柔性互连图案层通过交替旋涂金属纳米线溶液和沉积金属铜形成。
9.根据权利要求4所述的柔性封装构件的形成方法,其特征在于:形成第二通孔的同时形成暴露所述柔性互连图案层的第三通孔,进而在所述第三通孔中沉积导电材料以形成第三导电通孔,并在所述第三导电通孔上形成导电凸块。
10.一种柔性封装构件,其特征在于,采用权利要求1-9任一项所述的方法形成的。
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Citations (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0897312A (ja) * 1994-09-21 1996-04-12 Nec Corp 半導体パッケージおよびその製造方法
US20060273435A1 (en) * 2005-06-06 2006-12-07 Mou-Shiung Lin Chip Package
CN101569008A (zh) * 2007-09-19 2009-10-28 日本电气株式会社 半导体装置及其制造方法
WO2011065544A1 (ja) * 2009-11-27 2011-06-03 日本電気株式会社 半導体装置、3次元実装型半導体装置、半導体モジュール、電子機器、及びその製造方法
JP2013074025A (ja) * 2011-09-27 2013-04-22 Shin Etsu Polymer Co Ltd 導電パターン形成基板の製造方法及び導電パターン形成基板
CN112053960A (zh) * 2020-09-10 2020-12-08 山东傲天环保科技有限公司 一种高堆叠封装结构及其形成方法
CN112053962A (zh) * 2020-09-14 2020-12-08 山东傲天环保科技有限公司 一种系统级堆叠封装及其制备方法
CN112655285A (zh) * 2018-10-05 2021-04-13 株式会社东芝 半导体封装
CN113169075A (zh) * 2021-02-08 2021-07-23 广东省科学院半导体研究所 一种芯片互连封装结构及方法
CN114121680A (zh) * 2021-10-21 2022-03-01 广东佛智芯微电子技术研究有限公司 一种多芯片立体化封装结构及封装方法

Patent Citations (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0897312A (ja) * 1994-09-21 1996-04-12 Nec Corp 半導体パッケージおよびその製造方法
US20060273435A1 (en) * 2005-06-06 2006-12-07 Mou-Shiung Lin Chip Package
CN101569008A (zh) * 2007-09-19 2009-10-28 日本电气株式会社 半导体装置及其制造方法
WO2011065544A1 (ja) * 2009-11-27 2011-06-03 日本電気株式会社 半導体装置、3次元実装型半導体装置、半導体モジュール、電子機器、及びその製造方法
JP2013074025A (ja) * 2011-09-27 2013-04-22 Shin Etsu Polymer Co Ltd 導電パターン形成基板の製造方法及び導電パターン形成基板
CN112655285A (zh) * 2018-10-05 2021-04-13 株式会社东芝 半导体封装
CN112053960A (zh) * 2020-09-10 2020-12-08 山东傲天环保科技有限公司 一种高堆叠封装结构及其形成方法
CN112053962A (zh) * 2020-09-14 2020-12-08 山东傲天环保科技有限公司 一种系统级堆叠封装及其制备方法
CN113169075A (zh) * 2021-02-08 2021-07-23 广东省科学院半导体研究所 一种芯片互连封装结构及方法
CN114121680A (zh) * 2021-10-21 2022-03-01 广东佛智芯微电子技术研究有限公司 一种多芯片立体化封装结构及封装方法

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