CN113611247A - 一种显示基板和显示面板 - Google Patents

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Abstract

本发明提供一种显示基板和显示面板。该显示基板包括：基底；设置于基底上的像素驱动电路；像素驱动电路包括第一复位子电路、驱动子电路和第二复位子电路；第一复位子电路，被配置为响应于第一复位控制信号，通过第一初始化信号对待驱动的发光器件进行初始化；驱动子电路，被配置为根据其第一端和控制端的电压为待驱动的发光器件提供驱动电流；第二复位子电路，被配置为响应于第二复位控制信号，通过第二初始化信号对驱动子电路的控制端的电压进行复位；被配置为提供第一初始化信号的第一复位电源信号线和被配置为提供第二初始化信号的第二复位电源信号线在基底上的正投影互不交叠。

Description

一种显示基板和显示面板
技术领域
本发明属于显示技术领域，具体涉及一种显示基板和显示面板。
背景技术
目前市场上对高帧频AMOLED(Active-matrix organic light-emitting diode，有源矩阵有机发光二极体或主动矩阵有机发光二极体)显示面板有较大的需求，特别是双数据线驱动和双初始化信号对发光器件的阳极和驱动晶体管的控制端分别进行复位的方案，可以在保证显示效果的前提下实现120Hz的高帧频驱动，同时还能改善低灰阶显示不良。
发明内容
本发明针对上述的问题，提供一种显示基板和显示面板。该显示基板，通过设置第一复位电源信号线和第二复位电源信号线，能更好地改善低灰阶显示不良；还能改善或避免驱动晶体管栅极与数据线之间的纵向串扰，从而提升显示基板的显示效果。
本发明提供一种显示基板，包括：基底；设置于所述基底上的像素驱动电路；
所述像素驱动电路包括第一复位子电路、驱动子电路和第二复位子电路；
所述第一复位子电路，被配置为响应于第一复位控制信号，通过第一初始化信号对待驱动的发光器件进行初始化；
所述驱动子电路，被配置为根据其第一端和控制端的电压为待驱动的发光器件提供驱动电流；
所述第二复位子电路，被配置为响应于第二复位控制信号，通过第二初始化信号对所述驱动子电路的控制端的电压进行复位；
被配置为提供所述第一初始化信号的第一复位电源信号线和被配置为提供所述第二初始化信号的第二复位电源信号线在所述基底上的正投影互不交叠。
可选地，多个所述像素驱动电路呈阵列排布；
所述第一复位电源信号线在所述基底上的正投影位于同一行所述像素驱动电路中所述驱动子电路与所述第一复位子电路和所述第二复位子电路在所述基底上的正投影之间。
可选地，所述像素驱动电路还包括数据写入子电路，被配置为响应于扫描信号，将数据电压信号传输至所述驱动子电路的第一端；
所述驱动子电路包括驱动晶体管；
所述驱动晶体管的栅极位于第一导电层；所述第一复位电源信号线和所述第二复位电源信号线位于第二导电层；数据线位于所述第三导电层，被配置为提供所述数据电压信号；
所述第一导电层、所述第二导电层和所述第三导电层依次远离所述基底叠置。
可选地，所述驱动晶体管的有源层位于第四导电层；所述第四导电层位于所述第一导电层靠近所述基底的一侧；
所述驱动晶体管的栅极还走线至所述第四导电层并形成第一栅极走线；所述第一栅极走线与所述第四导电层采用相同材料；
所述第一复位电源信号线在所述基底上的正投影至少部分覆盖所述第一栅极走线。
可选地，还包括第五导电层，位于所述第二导电层的背离所述第一导电层的一侧，且位于所述第三导电层的靠近所述第二导电层的一侧；
所述驱动晶体管的栅极还走线至所述第五导电层并形成第二栅极走线；所述第二栅极走线与所述第五导电层采用相同材料；
所述第三导电层还包括第一图形，所述第一图形连接电源电压线；
所述第一图形在所述基底上的正投影至少部分覆盖所述第二栅极走线。
可选地，所述第一图形在所述基底上的正投影至少部分覆盖所述第一栅极走线。
可选地，所述数据线的数量为多条，多条所述数据线相互平行；
所述第一图形位于至少部分相邻所述数据线之间。
可选地，所述第一初始化信号和所述第二初始化信号均为直流电压信号；
所述第一初始化信号大于所述第二初始化信号。
可选地，所述像素驱动电路还包括阈值补偿子电路和存储子电路；
所述阈值补偿子电路，被配置为响应于所述扫描信号，对所述驱动子电路的阈值电压进行补偿；
所述存储子电路，被配置为对所述数据电压信号进行存储；
扫描信号线位于所述第一导电层，被配置为提供所述扫描信号；所述扫描信号线与所述第一复位电源信号线和所述第二复位电源信号线相互平行。
可选地，所述扫描信号线的数量为多条；
部分所述扫描信号线在所述基底上的正投影一一对应地位于所述第一复位电源信号线和所述第二复位电源信号线在所述基底上的正投影之间；
部分所述扫描信号线在所述基底上的正投影一一对应地位于相邻两行所述像素驱动电路在所述基底上的正投影之间；
部分所述扫描信号线在所述基底上的正投影一一对应地位于同一行所述像素驱动电路中所述驱动子电路和所述第一复位电源信号线在所述基底上的正投影之间。
可选地，一列所述像素驱动电路中，奇数个所述像素驱动电路连接一条所述数据线；偶数个所述像素驱动电路连接另一条所述数据线；
所述数据线沿所述像素驱动电路的列方向延伸；
与一列所述像素驱动电路连接的两条所述数据线在所述基底上的正投影分别位于该列所述像素驱动电路在所述基底上正投影的两侧。
可选地，所述像素驱动电路还包括第一发光控制子电路和第二发光控制子电路；
所述第一发光控制子电路，被配置为响应于第一发光控制信号，控制第一电压是否能够被写入所述驱动子电路的第一端；
所述第二发光控制子电路，被配置为响应于第二发光控制信号，导通或断开所述驱动子电路和所述待驱动的发光器件之间的连接；
所述电源电压线沿所述像素驱动电路的列方向延伸，被配置为提供所述第一电压；
所述电源电压线在所述基底上的正投影位于相邻两列所述像素驱动电路之间的相邻两条所述数据线在所述基底上的正投影之间。
可选地，所述电源电压线包括位于所述第三导电层的第一子层和位于所述第五导电层的第二子层；
所述第一子层和所述第二子层在所述基底上的正投影交叠；
所述第一子层和所述第二子层连接。
本发明还提供一种显示面板，包括上述显示基板。
本发明的有益效果：本发明所提供的显示基板，通过设置第一复位电源信号线和第二复位电源信号线，便于第一复位电源信号线和第二复位电源信号线分别提供不同的第一初始化信号和第二初始化信号，从而更好地实现对待驱动的发光器件进行初始化和对驱动子电路的控制端的电压进行复位，进而更好地改善低灰阶显示不良；通过使第一复位电源信号线在基底上的正投影位于同一行像素驱动电路中驱动子电路与第一复位子电路和第二复位子电路在基底上的正投影之间，第一复位电源信号线在提供第一初始化信号的情况下，还能屏蔽驱动晶体管栅极和数据线之间的纵向串扰，即用作驱动晶体管栅极和数据线之间的屏蔽层，从而改善或避免驱动晶体管栅极与数据线之间的纵向串扰，进而提升显示基板的显示效果；另外，第一复位电源信号线的设置，使显示基板上无需再单独制备屏蔽驱动晶体管栅极与数据线之间纵向串扰的屏蔽层图形，从而降低了显示基板的制备成本。
本发明所提供的显示面板，通过采用上述显示基板，提升了该显示面板的显示效果。
附图说明
图1a为一种示例性的显示基板结构示意图；
图1b为本发明实施例显示基板中像素驱动电路的电路图；
图2为本发明实施例显示基板中像素驱动电路的版图；
图3为本发明实施例中第一导电层的版图；
图4为本发明实施例中第二导电层的版图；
图5为本发明实施例中第三导电层的版图；
图6为本发明实施例中第四导电层的版图；
图7为本发明实施例中第二导电层与第四导电层的覆叠示意图；
图8为本发明实施例中第五导电层的版图；
图9为本发明实施例中第三导电层与第五导电层的覆叠示意图；
图10为本发明实施例中第三导电层与第四导电层的覆叠示意图；
图11为本发明实施例中同层的第一图形位于至少部分相邻数据线之间的示意图；
图12为本发明实施例中中间介电层的版图；
图13为本发明实施例中第一有机绝缘层的版图；
图14为本发明实施例中无机绝缘层的版图；
图15为本发明实施例中第二有机绝缘层的版图；
图16为图1b中像素驱动电路工作时序图。
其中附图标记为：
1、像素驱动电路；100、像素单元；11、第一复位子电路；12、驱动子电路；13、第二复位子电路；14、数据写入子电路；15、阈值补偿子电路；16、存储子电路；17、第一发光控制子电路；18、第二发光控制子电路；2、第一复位电源信号线；3、第二复位电源信号线；4、栅极；41、第一栅极走线；42、第二栅极走线；5、第一导电层；6、第二导电层；7、数据线；8、第三导电层；9、有源层；10、第四导电层；20、第五导电层；200、第二图形；22、扫描信号线；23、电源电压线；230、第一图形；231、第一子层；232、第二子层；24、中间介电层；25、第一有机绝缘层；26、无机绝缘层；27、第二有机绝缘层；201、第一过孔；202、第二过孔；203、第三过孔。
具体实施方式
为使本领域技术人员更好地理解本发明的技术方案，下面结合附图和具体实施方式对本发明一种显示基板和显示面板作进一步详细描述。
目前，双数据线驱动和双初始化信号复位的高帧频AMOLED显示面板的像素驱动电路中，驱动晶体管的栅极与数据线分别位于不同的导电层，但二者之间的纵向串扰较为严重，严重影响显示面板的显示效果。
针对上述驱动晶体管的栅极与数据线之间纵向串扰较为严重的问题，本发明实施例提供一种显示基板，参照图1a、图1b和图2，显示基板包括呈阵列排布的多个像素单元100，每个像素单元100中均包括像素驱动电路1和待驱动的发光器件D。其中，该显示基板还包括基底；像素驱动电路1设置于基底上；像素驱动电路1包括第一复位子电路11、驱动子电路12和第二复位子电路13；第一复位子电路11，被配置为响应于第一复位控制信号reset1，通过第一初始化信号vinit1对待驱动的发光器件D进行初始化；驱动子电路12，被配置为根据其第一端和控制端的电压为待驱动的发光器件D提供驱动电流；第二复位子电路13，被配置为响应于第二复位控制信号reset2，通过第二初始化信号vinit2对驱动子电路12的控制端的电压进行复位；被配置为提供第一初始化信号vinit1的第一复位电源信号线2和被配置为提供第二初始化信号vinit2的第二复位电源信号线3在基底上的正投影互不交叠。
其中，第一复位控制信号reset1和第二复位控制信号reset2可以为同一信号，也可以为不同信号。发光器件D可以是微型无机发光二极管，进一步地，可以为电流型发光二极管，如微型发光二极管(Micro Light Emitting Diode，Micro LED)或者迷你发光二极管(Mini Light Emitting Diode，Mini LED)，当然，在发明实施例中的发光器件D还可以是有机电致发光二极管(Organic Light Emitting Diode，OLED)。发光器件D的第一电极和第二电极中的一者为阳极，另一者为阴极；在本发明实施例中以发光器件D的第一电极为阳极，第二电极为阴极为例进行说明。
本实施例中，驱动子电路12包括驱动晶体管T3。第一初始化信号vinit1和第二初始化信号vinit2均为直流电压信号；第一初始化信号vinit1大于第二初始化信号vinit2。第一初始化信号vinit1电压较高，能使发光器件D在复位后快速充电，从而确保其在复位后点亮时的发光亮度足够高，进而在帧频较低时避免相邻两帧画面出现闪烁现象。第二初始化信号vinit2电压较低，能够使驱动子电路12的控制端电压较低，从而保证驱动晶体管T3处于强开启状态，为下一帧数据电压的写入做好准备，从而更好地驱动发光器件D发光。
需要说明的是，第一初始化信号和第二初始化信号也可以为相同的直流电压信号。
公开技术中，提供第一初始化信号和第二初始化信号的复位电源信号线设置为一条；本实施例中，将提供第一初始化信号和第二初始化信号的复位电源信号线分别设置为一条，即将复位电源信号线拆分为第一复位电源信号线2和第二复位电源信号线3。如此设置，便于第一复位电源信号线2和第二复位电源信号线3分别提供不同的第一初始化信号和第二初始化信号，从而更好地实现对待驱动的发光器件D进行初始化和对驱动子电路12的控制端的电压进行复位，进而更好地改善低灰阶显示不良。
本实施例中，像素驱动电路1的数量为多个，多个像素驱动电路1呈阵列排布；第一复位电源信号线2在基底上的正投影位于同一行像素驱动电路1中驱动子电路12与第一复位子电路11和第二复位子电路13在基底上的正投影之间。
本实施例中，第二复位电源信号线3在基底上的正投影位于相邻两行像素驱动电路1中上一行的驱动子电路12与下一行的第一复位子电路11和第二复位子电路13在基底上的正投影之间。第一复位电源信号线2和第二复位电源信号线3的上述排布，能够有效利用显示基板上的空间，提高显示基板的分辨率。
公开技术中，复位电源信号线在基底上的正投影位于相邻两行像素驱动电路在基底上的正投影之间，而像素驱动电路中位于不同导电层的驱动子电路中驱动晶体管的栅极与数据线之间没有设置屏蔽层，使得驱动晶体管栅极与数据线之间存在较为严重的纵向串扰，严重影响显示效果；为了避免驱动晶体管栅极与数据线之间的纵向串扰，公开技术中是在驱动晶体管栅极与数据线之间单独制备屏蔽层图形，以减小或避免二者之间的纵向串扰。本实施例中，通过使第一复位电源信号线2在基底上的正投影位于同一行像素驱动电路1中驱动子电路12与第一复位子电路11和第二复位子电路13在基底上的正投影之间，第一复位电源信号线2在提供第一初始化信号的情况下，还能屏蔽驱动晶体管T3栅极4和数据线7之间的纵向串扰，即用作驱动晶体管T3栅极4和数据线7之间的屏蔽层，从而改善或避免驱动晶体管T3栅极4与数据线7之间的纵向串扰，进而提升显示基板的显示效果；另外，第一复位电源信号线2的设置，使显示基板上无需再单独制备屏蔽驱动晶体管T3栅极4与数据线7之间纵向串扰的屏蔽层图形，从而降低了显示基板的制备成本。
本实施例中，如图3-图5所示，像素驱动电路1还包括数据写入子电路14，被配置为响应于扫描信号gate，将数据电压信号Vdata传输至驱动子电路12的第一端；驱动子电路12包括驱动晶体管T3；驱动晶体管T3的栅极4位于第一导电层5；第一复位电源信号线2和第二复位电源信号线3位于第二导电层6；数据线7位于第三导电层8，被配置为提供数据电压信号；第一导电层5、第二导电层6和第三导电层8依次远离基底叠置。如此设置，第一复位电源信号线2在远离基底的纵向方向上介于驱动晶体管T3栅极4与数据线7之间，能很好地屏蔽驱动晶体管T3栅极4与数据线7之间的纵向串扰，提升显示基板的显示效果。
其中，第一导电层5、第二导电层6和第三导电层8采用金属导电材料，如钼、铝等。
本实施例中，如图6和图7所示，驱动晶体管T3的有源层9位于第四导电层10；第四导电层10位于第一导电层5靠近基底的一侧；驱动晶体管T3的栅极4还走线至第四导电层10并形成第一栅极走线41；第一栅极走线41与第四导电层10采用相同材料；第一复位电源信号线2在基底上的正投影至少部分覆盖第一栅极走线41。如此设置，第一复位电源信号线2在远离基底的纵向方向上介于驱动晶体管T3的第一栅极走线41与数据线7之间，能很好地屏蔽驱动晶体管T3栅极4与数据线7之间的纵向串扰，提升显示基板的显示效果。
其中，第四导电层10采用低温多晶硅材料。需要说明的是，第四导电层10也可以采用非晶硅材料或者氧化物半导体材料，如IGZO、ZnO、CdO、TiO2等。
本实施例中，如图8和图9所示，显示基板还包括第五导电层20，位于第二导电层6的背离第一导电层5的一侧，且位于第三导电层8的靠近第二导电层6的一侧；驱动晶体管T3的栅极4还走线至第五导电层20并形成第二栅极走线42；第二栅极走线42与第五导电层20采用相同材料；第三导电层8还包括第一图形230，第一图形230连接电源电压线23；第一图形230在基底上的正投影至少部分覆盖第二栅极走线42。如此设置，第一图形230与数据线7位于同一导电层即第三导电层8；第一图形230在远离基底的纵向方向上位于驱动晶体管T3的第二栅极走线42的远离基底的一侧，第一图形230上加载电源电压线23上提供的第一电压ELVDD信号，第一图形230在基底上的正投影覆盖第二栅极走线42的部分能很好地屏蔽驱动晶体管T3栅极4与数据线7之间的纵向串扰，提升显示基板的显示效果。
其中，第五导电层20采用导电金属材料。
本实施例中，如图10所示，第一图形230在基底上的正投影至少部分覆盖第一栅极走线41。如此设置，第一图形230与数据线7位于同一导电层即第三导电层8；第一栅极走线41位于第四导电层10；第一图形230在远离基底的纵向方向上位于驱动晶体管T3的第一栅极走线41的远离基底的一侧，第一图形230在基底上的正投影覆盖第一栅极走线41的部分能很好地屏蔽驱动晶体管T3栅极4与数据线7之间的纵向串扰，提升显示基板的显示效果。
本实施例中，如图11所示，数据线7的数量为多条，多条数据线7相互平行；第一图形230位于至少部分相邻数据线7之间。第一图形230与数据线7位于同一导电层即第三导电层8，第一图形230介于相邻数据线7之间，能够屏蔽相邻数据线7之间的寄生电容，降低HLine串扰(即H型线串扰)，提升显示基板显示效果。
另外，如图12所示，为第二导电层6与第五导电层20之间的中间介电层24的版图，图中包括第一过孔201的图形，第一过孔201可以用于连接第五导电层20与第二导电层6、第一导电层5以及第四导电层10中的导电结构。如图13和图14所示，为第五导电层20和第三导电层8之间的第一有机绝缘层25和无机绝缘层26的版图，图中包括第二过孔202的图形，第二过孔202可以用于连接第三导电层8与第五导电层20、第二导电层6、第一导电层5以及第四导电层10中的导电结构。如图15所示，为第三导电层8背离基底一侧的第二有机绝缘层27的版图，图中包括第三过孔203的图形，第三过孔203可以用于连接第三导电层8与发光器件D的第一电极。
本实施例中，如图1b和图2所示，像素驱动电路1还包括阈值补偿子电路15和存储子电路16；阈值补偿子电路15，被配置为响应于扫描信号gate，对驱动子电路12的阈值电压进行补偿；存储子电路16，被配置为对数据电压信号Vdata进行存储；扫描信号线22位于第一导电层5，被配置为提供扫描信号gate；扫描信号线22与第一复位电源信号线2和第二复位电源信号线3相互平行。
其中，提供给阈值补偿子电路15的扫描信号和提供给数据写入子电路14的扫描信号可以为同一信号，也可以为不同信号；即可以通过同一条扫描信号线22分别向一行像素驱动电路1中的阈值补偿子电路15和数据写入子电路14提供扫描信号；也可以通过不同的扫描信号线22分别向一行像素驱动电路1中的阈值补偿子电路15和数据写入子电路14提供扫描信号。
本实施例中，扫描信号线22的数量为多条；部分扫描信号线22在基底上的正投影一一对应地位于第一复位电源信号线2和第二复位电源信号线3在基底上的正投影之间；部分扫描信号线22在基底上的正投影一一对应地位于相邻两行像素驱动电路1在基底上的正投影之间；部分扫描信号线22在基底上的正投影一一对应地位于同一行像素驱动电路1中驱动子电路12和第一复位电源信号线2在基底上的正投影之间。如此设置，能够有效利用显示基板上的空间，提高显示基板的分辨率。
本实施例中，一列像素驱动电路1中，奇数个像素驱动电路1连接一条数据线7；偶数个像素驱动电路1连接另一条数据线7；数据线7沿像素驱动电路1的列方向延伸；与一列像素驱动电路1连接的两条数据线7在基底上的正投影分别位于该列像素驱动电路1在基底上正投影的两侧。即一列像素驱动电路1采用双数据线7驱动，如此在实现显示基板高帧频显示的情况下，还能够改善低灰阶显示不良。另外，双数据线7的排布还有利于提高显示基板的分辨率。
本实施例中，如图1b和图2所示，像素驱动电路1还包括第一发光控制子电路17和第二发光控制子电路18；第一发光控制子电路17被配置为响应于第一发光控制信号EM1，控制第一电压ELVDD是否能够被写入驱动子电路12的第一端；第二发光控制子电路18，被配置为响应于第二发光控制信号EM2，导通或断开驱动子电路12和待驱动的发光器件D之间的连接；电源电压线23沿像素驱动电路1的列方向延伸，被配置为提供第一电压ELVDD；电源电压线23在基底上的正投影位于相邻两列像素驱动电路1之间的相邻两条数据线7在基底上的正投影之间。电源电压线23的排布有利于提高显示基板的分辨率。
其中，第一发光控制信号EM1和第二发光控制信号EM2可以为同一信号，也可以为不同信号。
本实施例中，如图5和图8所示，电源电压线23包括位于第三导电层8的第一子层231和位于第五导电层20的第二子层232；第一子层231和第二子层232在基底上的正投影交叠；第一子层231和第二子层232连接。如此设置，能够增大电源电压线23的垂直于基底的截面面积，从而降低电源电压线23的走线电阻，进而减小电源电压线23上的信号衰减，提升显示基板的显示效果。
其中，第五导电层20还包括与第二子层232连接且从第二子层232延伸而出的第二图形200，第二图形200通过开设在第一有机绝缘层25和无机绝缘层26中的第二过孔202与第三导电层8中的第一图形230连接，从而实现第一图形230与电源电压线23的连接。
本实施例中，如图1b所示，第二复位子电路13与驱动子电路12的控制端连接，且被配置为在第二复位控制信号的控制下对驱动子电路12的控制端的电压进行复位。阈值补偿子电路15分别与驱动子电路12的控制端和第二端电连接，且被配置为对驱动子电路12进行阈值补偿。数据写入子电路14与驱动子电路12的第一端电连接，且被配置为在扫描信号的控制下将数据电压信号写入存储子电路16。存储子电路16分别与驱动子电路12的控制端和电源电压线23电连接，且被配置为存储数据电压信号。第一发光控制子电路17分别与电源电压线23以及驱动子电路12的第一端相连，且被配置为实现驱动子电路12和电源电压线23间的连接导通或断开，第二发光控制子电路18分别与驱动子电路12的第二端和发光器件D的第一电极电连接，且被配置为实现驱动子电路12和发光器件D之间的连接导通或断开。第一复位子电路11与发光器件D的第一电极电连接，且被配置为在第一复位控制信号的控制下对驱动子电路12的控制端和发光器件D的第一电极进行复位。
本实施例中，如图1b所示，第二复位子电路13包括第一晶体管T1，阈值补偿子电路15包括第二晶体管T2，驱动子电路12包括驱动晶体管T3，驱动子电路12的控制端包括驱动晶体管T3的控制极，驱动子电路12的第一端包括驱动晶体管T3的第一极，驱动子电路12的第二端包括驱动晶体管T3的第二极。数据写入子电路14包括第四晶体管T4，存储子电路16包括存储电容C1，第一发光控制子电路17包括第五晶体管T5，第二发光控制子电路18包括第六晶体管T6，第一复位子电路11包括第七晶体管T7。
在此需要说明的是，按照晶体管的特性，晶体管可以分为N型晶体管和P型晶体管，为了清楚起见，本公开的实施例以晶体管为N型晶体管(例如，N型MOS晶体管)为例详细阐述了本公开的技术方案，也就是说，在本公开的描述中，驱动晶体管T3、第四晶体管T4、第二晶体管T2、第五晶体管T5、第六晶体管T6、第一晶体管T1和第七晶体管T7等均可以为N型晶体管。然而本公开的实施例的晶体管不限于N型晶体管，本领域技术人员还可以根据实际需要利用P型晶体管(例如，P型MOS晶体管)实现本公开的实施例中的一个或多个晶体管的功能。
另外，本公开的实施例中采用的晶体管可以为薄膜晶体管或场效应晶体管或其他特性相同的开关器件，薄膜晶体管可以包括氧化物半导体薄膜晶体管、非晶硅薄膜晶体管或多晶硅薄膜晶体管等。对于每个晶体管其均包括第一极、第二极和控制极；其中，控制极作为晶体管的栅极，第一极和第二极中的一者作为晶体管的源极，另一者作为晶体管的漏极；而晶体管的源极、漏极在结构上可以是对称的，所以其源极、漏极在物理结构上可以是没有区别的。在本公开的实施例中，为了区分晶体管，除作为控制极的栅极，直接描述了其中第一极为源极，第二极为漏极，所以本公开的实施例中全部或部分晶体管的源极和漏极根据需要是可以互换的。
如图1b所示，第四晶体管T4漏极的与驱动晶体管T3的源极电连接，第四晶体管T4的源极被配置为与数据线7电连接以接收数据电压信号Vdata，第四晶体管T4的栅极被配置为与扫描信号线22电连接以接收扫描信号；存储电容C1的第二极板与电源电压线23电连接，存储电容C1的第一极板与驱动晶体管T3的栅极电连接；第二晶体管T2的源极与驱动晶体管T3的栅极电连接，第二晶体管T2的漏极与驱动晶体管T3的漏极电连接，第二晶体管T2的栅极被配置为与扫描信号线22电连接以接收补偿控制信号；第一晶体管T1的源极被配置为与第二复位电源信号线3电连接以接收第二初始化信号，第一晶体管T1的漏极与驱动晶体管T3的栅极电连接，第一晶体管T1的栅极被配置为与第二复位控制信号线电连接以接收第二复位控制信号；第七晶体管T7的漏极被配置为与第一复位电源信号线2电连接以接收第一初始化信号，第七晶体管T7的源极与发光器件D的第一电极电连接，第七晶体管T7的栅极被配置为与第一复位控制信号线电连接以接收第一复位控制信号；第五晶体管T5的源极与电源电压线23电连接，第五晶体管T5的漏极与驱动晶体管T3的源极电连接，第五晶体管T5的栅极被配置为与第一发光控制信号线电连接以接收第一发光控制信号；第六晶体管T6的源极与驱动晶体管T3的漏极电连接，第六晶体管T6的漏极与发光器件D的第一电极电连接，第六晶体管T6的栅极被配置为与第二发光控制信号线电连接以接收第二发光控制信号；发光器件D的第二电极接入第二电压ELVSS。
其中，第一电压ELVDD和第二电压ELVSS之一为高压，另一个为低压。例如，第一电压ELVDD为恒定正电压；第二电压ELVSS为恒定负电压。在一些示例中，第二电压ELVSS也可以为接地电压。
本实施例中，像素驱动电路1为7T1C(即七个晶体管和一个电容)电路，像素驱动电路1也可以为其他数量的晶体管和电容的电路结构，如7T2C电路、6T1C电路、6T2C电路或者9T2C电路，本公开实施例对此不作限定。
如图16所示，上述的像素驱动电路的驱动方法可以包括如下阶段：
复位阶段(t1)：第一复位控制信号和第二复位控制信号reset为低电平信号，扫描信号gate、第一发光控制信号和第二发光控制信号EM为高电平信号；第一晶体管T1和第七晶体管T7打开，驱动晶体管T3栅极被写入第二初始化信号，为下一帧写入数据电压信号做准备。发光器件D的阳极通过第七晶体管T7写入第一初始化信号(vinit1≤VSS)，使发光器件D不再处于正向导通状态，使发光器件D内杂质离子定向移动形成的内部电场逐渐消失，从而恢复发光器件D的特性。
数据写入及阈值补偿阶段(t2)：扫描信号gate为低电平信号，第一复位控制信号和第二复位控制信号reset、第一发光控制信号和第二发光控制信号EM均为高电平信号；第四晶体管T4和第二晶体管T2打开。驱动晶体管T3被第二晶体管T2连成二极管结构，数据线上写入的数据电压信号Vdata通过第四晶体管T4和第二晶体管T2写入驱动晶体管T3的栅极，直到驱动晶体管T3截止。驱动晶体管T3的栅极电压为Vdata+Vth(Vth<0，Vth为驱动晶体管T3的阈值电压)，并存储在存储电容中。存储电容的第一极板和第二极板的电压分别为Vdata+Vth和Vd。
发光阶段(t3)：第一发光控制信号和第二发光控制信号EM均为低电平信号，扫描信号gate与第一复位控制信号和第二复位控制信号reset均为高电平信号，第五晶体管T5和第六晶体管T6均打开，驱动晶体管T3的源极接入第一电压ELVDD连接，驱动晶体管T3的源极电压由上一阶段的Vdata瞬时变化为Vdd。发光器件D在驱动晶体管T3的驱动下发光，此时驱动晶体管T3工作在饱和区，驱动晶体管T3的栅极电压为Vdata+Vth，驱动晶体管T3的源极电压为Vdd，故，驱动晶体管T3的栅源电压为：Vgs＝(Vdata+Vth)-Vdd，直到下一帧的复位阶段。
发光器件D的发光电流等于流过驱动晶体管T3的电流，其表达式如下：
ID＝β(Vgs-Vth)2
＝β(Vdata+Vth-dd-Vth)2
＝β(Vdata-Vdd)2 (1)
其中，
Figure BDA0003195752340000151
μn是驱动晶体管T3的电子迁移率，Cox是单位面积的绝缘电容，
Figure BDA0003195752340000152
是驱动晶体管T3的宽长比。
本公开实施例中所提供的显示基板，通过设置第一复位电源信号线和第二复位电源信号线，便于第一复位电源信号线和第二复位电源信号线分别提供不同的第一初始化信号和第二初始化信号，从而更好地实现对待驱动的发光器件进行初始化和对驱动子电路的控制端的电压进行复位，进而更好地改善低灰阶显示不良；通过使第一复位电源信号线在基底上的正投影位于同一行像素驱动电路中驱动子电路与第一复位子电路和第二复位子电路在基底上的正投影之间，第一复位电源信号线在提供第一初始化信号的情况下，还能屏蔽驱动晶体管栅极和数据线之间的纵向串扰，即用作驱动晶体管栅极和数据线之间的屏蔽层，从而改善或避免驱动晶体管栅极与数据线之间的纵向串扰，进而提升显示基板的显示效果；另外，第一复位电源信号线的设置，使显示基板上无需再单独制备屏蔽驱动晶体管栅极与数据线之间纵向串扰的屏蔽层图形，从而降低了显示基板的制备成本。
本发明实施例还提供一种显示面板，包括上述实施例中的显示基板。
通过采用上述实施例中的显示基板，提升了该显示面板的显示效果。
本发明所提供的显示面板可以为OLED面板、OLED电视、Mini LED面板、Mini LED电视、Micro LED面板、Micro LED电视、显示器、手机、导航仪等任何具有显示功能的产品或部件。
可以理解的是，以上实施方式仅仅是为了说明本发明的原理而采用的示例性实施方式，然而本发明并不局限于此。对于本领域内的普通技术人员而言，在不脱离本发明的精神和实质的情况下，可以做出各种变型和改进，这些变型和改进也视为本发明的保护范围。

Claims (14)

1.一种显示基板，包括：基底；设置于所述基底上的像素驱动电路；
所述像素驱动电路包括第一复位子电路、驱动子电路和第二复位子电路；
所述第一复位子电路，被配置为响应于第一复位控制信号，通过第一初始化信号对待驱动的发光器件进行初始化；
所述驱动子电路，被配置为根据其第一端和控制端的电压为待驱动的发光器件提供驱动电流；
所述第二复位子电路，被配置为响应于第二复位控制信号，通过第二初始化信号对所述驱动子电路的控制端的电压进行复位；
其特征在于，被配置为提供所述第一初始化信号的第一复位电源信号线和被配置为提供所述第二初始化信号的第二复位电源信号线在所述基底上的正投影互不交叠。
2.根据权利要求1所述的显示基板，其特征在于，多个所述像素驱动电路呈阵列排布；
所述第一复位电源信号线在所述基底上的正投影位于所述像素驱动电路中所述驱动子电路与所述第一复位子电路和所述第二复位子电路在所述基底上的正投影之间。
3.根据权利要求2所述的显示基板，其特征在于，所述像素驱动电路还包括数据写入子电路，被配置为响应于扫描信号，将数据电压信号传输至所述驱动子电路的第一端；
所述驱动子电路包括驱动晶体管；
所述驱动晶体管的栅极位于第一导电层；所述第一复位电源信号线和所述第二复位电源信号线位于第二导电层；数据线位于所述第三导电层，被配置为提供所述数据电压信号；
所述第一导电层、所述第二导电层和所述第三导电层依次远离所述基底叠置。
4.根据权利要求3所述的显示基板，其特征在于，所述驱动晶体管的有源层位于第四导电层；所述第四导电层位于所述第一导电层靠近所述基底的一侧；
所述驱动晶体管的栅极还走线至所述第四导电层并形成第一栅极走线；所述第一栅极走线与所述第四导电层采用相同材料；
所述第一复位电源信号线在所述基底上的正投影至少部分覆盖所述第一栅极走线。
5.根据权利要求4所述的显示基板，其特征在于，还包括第五导电层，位于所述第二导电层的背离所述第一导电层的一侧，且位于所述第三导电层的靠近所述第二导电层的一侧；
所述驱动晶体管的栅极还走线至所述第五导电层并形成第二栅极走线；所述第二栅极走线与所述第五导电层采用相同材料；
所述第三导电层还包括第一图形，所述第一图形连接电源电压线；
所述第一图形在所述基底上的正投影至少部分覆盖所述第二栅极走线。
6.根据权利要求5所述的显示基板，其特征在于，所述第一图形在所述基底上的正投影至少部分覆盖所述第一栅极走线。
7.根据权利要求6所述的显示基板，其特征在于，所述数据线的数量为多条，多条所述数据线相互平行；
所述第一图形位于至少部分相邻所述数据线之间。
8.根据权利要求1所述的显示基板，其特征在于，所述第一初始化信号和所述第二初始化信号均为直流电压信号；
所述第一初始化信号大于所述第二初始化信号。
9.根据权利要求7所述的显示基板，其特征在于，所述像素驱动电路还包括阈值补偿子电路和存储子电路；
所述阈值补偿子电路，被配置为响应于所述扫描信号，对所述驱动子电路的阈值电压进行补偿；
所述存储子电路，被配置为对所述数据电压信号进行存储；
扫描信号线位于所述第一导电层，被配置为提供所述扫描信号；所述扫描信号线与所述第一复位电源信号线和所述第二复位电源信号线相互平行。
10.根据权利要求9所述的显示基板，其特征在于，所述扫描信号线的数量为多条；
部分所述扫描信号线在所述基底上的正投影一一对应地位于所述第一复位电源信号线和所述第二复位电源信号线在所述基底上的正投影之间；
部分所述扫描信号线在所述基底上的正投影一一对应地位于相邻两行所述像素驱动电路在所述基底上的正投影之间；
部分所述扫描信号线在所述基底上的正投影一一对应地位于同一行所述像素驱动电路中所述驱动子电路和所述第一复位电源信号线在所述基底上的正投影之间。
11.根据权利要求10所述的显示基板，其特征在于，一列所述像素驱动电路中，奇数个所述像素驱动电路连接一条所述数据线；偶数个所述像素驱动电路连接另一条所述数据线；
所述数据线沿所述像素驱动电路的列方向延伸；
与一列所述像素驱动电路连接的两条所述数据线在所述基底上的正投影分别位于该列所述像素驱动电路在所述基底上正投影的两侧。
12.根据权利要求11所述的显示基板，其特征在于，所述像素驱动电路还包括第一发光控制子电路和第二发光控制子电路；
所述第一发光控制子电路，被配置为响应于第一发光控制信号，控制第一电压是否能够被写入所述驱动子电路的第一端；
所述第二发光控制子电路，被配置为响应于第二发光控制信号，导通或断开所述驱动子电路和所述待驱动的发光器件之间的连接；
所述电源电压线沿所述像素驱动电路的列方向延伸，被配置为提供所述第一电压；
所述电源电压线在所述基底上的正投影位于相邻两列所述像素驱动电路之间的相邻两条所述数据线在所述基底上的正投影之间。
13.根据权利要求12所述的显示基板，其特征在于，所述电源电压线包括位于所述第三导电层的第一子层和位于所述第五导电层的第二子层；
所述第一子层和所述第二子层在所述基底上的正投影交叠；
所述第一子层和所述第二子层连接。
14.一种显示面板，其特征在于，包括权利要求1-13任意一项所述的显示基板。
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