CN112435629A - 一种显示基板、显示装置 - Google Patents

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Abstract

本发明提供一种显示基板、显示装置，涉及显示技术领域，为解决现有技术无法实现高分辨率的OLED显示装置的问题。显示基板中多个子像素划分为多个子像素组，子像素组包括至少两个子像素，至少两个子像素复用同一个像素驱动电路，像素驱动电路中的至少两个发光控制子电路与至少两个子像素中包括的至少两个发光元件对应，至少两个发光控制子电路与至少两条发光控制信号线对应，每个发光控制子电路分别与补偿驱动子电路的输出端，对应的发光元件和对应的发光控制信号线耦接；每个发光控制子电路用于在对应的发光控制信号线的控制下，控制导通或断开补偿驱动子电路的输出端和对应的发光元件之间的连接。本发明提供的显示基板用于显示。

Description

一种显示基板、显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种显示基板、显示装置。
背景技术
有机发光二极管(英文：Organic Light-Emitting Diode，简称：OLED)显示装置以其亮度高、功耗低、响应快、清晰度高、柔性好和发光效率高等优点被广泛应用在各个领域。
OLED显示装置包括多个子像素，每个子像素均包括像素驱动电路和发光元件，像素驱动电路用于驱动发光元件发光。由于OLED显示装置中的全部像素驱动电路呈阵列分布在基底，因此，受制于线宽、线距及过孔大小等因素，在一定区域内，布局像素驱动电路的数量受限，从而导致难以实现高分辨率的OLED显示装置。
发明内容
本发明的目的在于提供一种显示基板、显示装置，用于解决现有技术无法实现高分辨率的OLED显示装置的问题。
为了实现上述目的，本发明提供如下技术方案：
本发明的第一方面提供一种显示基板，包括基底和设置于所述基底上的多个子像素，每个子像素均包括发光元件；
所述多个子像素划分为多个子像素组，所述子像素组包括至少两个子像素，所述至少两个子像素复用同一个像素驱动电路，所述像素驱动电路包括：
至少两条发光控制信号线，每条所述发光控制信号线的至少部分沿第一方向延伸，至少两条发光控制信号线沿第二方向排列，所述第二方向与所述第一方向相交；
补偿驱动子电路，所述补偿驱动子电路的输出端用于输出驱动信号；
至少两个发光控制子电路，所述至少两个发光控制子电路与所述至少两个子像素中包括的至少两个发光元件对应，所述至少两个发光控制子电路与所述至少两条发光控制信号线对应，每个所述发光控制子电路分别与所述补偿驱动子电路的输出端，对应的发光元件和对应的发光控制信号线耦接；每个所述发光控制子电路用于在对应的发光控制信号线的控制下，控制导通或断开所述补偿驱动子电路的输出端和对应的发光元件之间的连接。
可选的，所述像素驱动电路还包括：
基准信号线，所述基准信号线的至少部分沿第一方向延伸；
第一复位信号线，所述第一复位信号线的至少部分沿第一方向延伸；
栅线，所述栅线的至少部分沿所述第一方向延伸；
电源线，所述电源线的至少部分沿第二方向延伸；以及，
数据线，所述数据线的至少部分沿所述第二方向延伸；
所述补偿驱动子电路包括：
驱动子电路，所述驱动子电路的第一端与所述电源线耦接，所述驱动子电路的第二端作为所述补偿驱动子电路的输出端；
存储子电路，所述存储子电路的第一端与所述驱动子电路的控制端耦接，所述存储子电路的第二端与所述驱动子电路的第二端耦接；
第一复位子电路，分别与第一复位信号线，基准信号线和所述驱动子电路的控制端耦接；
数据写入子电路，分别与栅线，数据线和所述驱动子电路的控制端耦接。
可选的，所述至少两条发光控制信号线包括第一发光控制信号线和第二发光控制信号线；所述至少两个发光控制子电路包括第一发光控制子电路和第二发光控制子电路；所述至少两个发光元件包括第一发光元件和第二发光元件；
所述第一发光控制子电路分别与所述驱动子电路的第二端，所述第一发光控制信号线和所述第一发光元件耦接；所述第二发光控制子电路分别与所述驱动子电路的第二端，所述第二发光控制信号线和所述第二发光元件耦接。
可选的，所述第一发光控制子电路包括第一晶体管，所述第二发光控制子电路包括第二晶体管，所述驱动子电路包括驱动晶体管；所述存储子电路包括存储电容；
所述驱动晶体管的栅极复用为所述存储电容的第一极板；
所述存储电容的第二极板位于所述第一极板背向所述基底的一侧，所述第二极板与所述驱动晶体管的第二极耦接；
所述第一晶体管的第一极与所述驱动晶体管的第二极耦接，所述第一晶体管的第二极与第一发光元件耦接；
所述第二晶体管的第一极与所述第二极板耦接，所述第二晶体管的第二极与所述第二发光元件耦接。
可选的，所述第一晶体管包括第一有源图形，所述第一有源图形沿所述第二方向延伸；所述第一有源图形的第一端与所述驱动晶体管的第二极耦接；所述第一有源图形的第二端与所述第一发光元件耦接；
所述第一有源图形的第二端在所述基底上的正投影，位于所述第一发光控制信号线在所述基底上的正投影和所述第二发光控制信号线在所述基底上的正投影之间。
可选的，所述第二极板包括主体部和延伸部；
所述主体部在所述基底上的正投影与所述驱动晶体管的栅极在所述基底上的正投影至少部分交叠；
所述延伸部沿所述第二方向延伸，所述延伸部在所述基底上的正投影，分别与所述第一发光控制信号线在所述基底上的正投影和所述第二发光控制信号线在所述基底上的正投影交叠。
可选的，所述第二晶体管包括第二有源图形，所述第二有源图形的至少部分沿所述第二方向延伸，所述第二有源图形的第一端与所述延伸部耦接，所述第二有源图形的第二端与所述第二发光元件耦接；
所述第二有源图形的第一端在所述基底上的正投影，位于所述第一发光控制信号线在所述基底上的正投影和所述第二发光控制信号线在所述基底上的正投影之间。
可选的，所述像素驱动电路还包括：
初始化信号线，所述初始化信号线的至少部分沿所述第一方向延伸；
第二复位信号线，所述第二复位信号线的至少部分沿所述第一方向延伸；所述第一复位信号线，所述栅线，所述第一发光控制信号线，所述第二发光控制信号线和所述第二复位信号线沿所述第二方向依次排列；
第二复位子电路，分别与第二复位信号线，初始化信号线和所述延伸部耦接。
可选的，所述第二复位子电路包括第五晶体管，所述第五晶体管包括第五有源图形，所述第五有源图形沿所述第二方向延伸；
所述第五有源图形的第一端与所述延伸部耦接，所述第五有源图形的第一端在所述基底上的正投影，位于所述第二发光控制信号线在所述基底上的正投影和所述第二复位信号线在所述基底上的正投影之间。
可选的，所述第五有源图形与所述初始化信号线形成为一体结构。
可选的，所述第一复位信号线在所述基底上的正投影，位于所述基准信号线在所述基底上的正投影和所述栅线在所述基底上的正投影之间；
所述第一复位子电路包括第三晶体管，所述第三晶体管包括第三有源图形，所述第三有源图形沿所述第二方向延伸，所述第三有源图形的第一端与所述基准信号线耦接，所述第三有源图形的第二端在所述基底上的正投影，位于所述第一复位信号线在所述基底上的正投影和所述栅线在所述基底上的正投影之间。
可选的，所述栅线包括栅主体部和两个栅突出部，所述栅主体部沿所述第一方向延伸，所述两个栅突出部沿所述第一方向间隔设置，所述两个栅突出部位于所述栅主体部和所述第一复位信号线之间；
所述数据写入子电路包括第四晶体管，所述第四晶体管包括第四有源图形，所述第四有源图形沿第一方向延伸，所述第四有源图形在所述基底上的正投影，分别与两个栅突出部在所述基底上的正投影交叠；
所述第四有源图形的第一端与所述数据线耦接，所述第四有源图形的第二端与所述第三有源图形的第二端耦接。
可选的，所述像素驱动电路包括导电连接部，所述导电连接部的至少部分沿所述第二方向延伸，所述导电连接部在所述基底上的正投影与所述栅线在所述基底上的正投影交叠；
所述导电连接部的第一端与所述第三有源图形的第二端耦接，所述导电连接部的第二端与所述驱动子电路的控制端耦接。
基于上述显示基板的技术方案，本发明的第二方面提供一种显示装置，包括上述显示基板。
可选的，所述显示基板中至少两条发光控制信号线包括第一发光控制信号线和第二发光控制信号线；至少两个发光控制子电路包括第一发光控制子电路和第二发光控制子电路；至少两个发光元件包括第一发光元件和第二发光元件；
所述显示基板中的多个子像素组中包括的多个像素驱动电路呈阵列分布，所述多个像素驱动电路划分为沿所述第二方向排列的多行像素驱动电路，每行像素驱动电路中的第一发光控制信号线依次耦接，每行像素驱动电路中的第二发光控制信号线依次耦接；
所述显示装置还包括：位于显示基板的周边区域的栅极驱动电路，所述栅极驱动电路包括多个第一移位寄存器单元和多个第二移位寄存器单元；所述多个第一移位寄存器单元与所述多行像素驱动电路一一对应，所述多个第二移位寄存器单元与所述多行像素驱动电路一一对应；
所述第一移位寄存器单元的输出端与对应的一行像素驱动电路中的第一发光控制信号线耦接，所述第二移位寄存器单元的输出端与对应的一行像素驱动电路中的第二发光控制信号线耦接。
本发明提供的技术方案中，至少两个子像素能够复用一个像素驱动电路，且该像素驱动电路能够独立控制所述至少两个子像素中各子像素包括的发光元件独立发光或同时发光，因此，本发明提供的技术方案能够在布局有限数量的像素驱动电路的情况下，实现高分辨率的显示。
附图说明
此处所说明的附图用来提供对本发明的进一步理解，构成本发明的一部分，本发明的示意性实施例及其说明用于解释本发明，并不构成对本发明的不当限定。在附图中：
图1为本发明实施例提供的像素驱动电路的布局示意图；
图2为图1中有源层的示意图；
图3为图1中第一栅金属层的示意图；
图4为图1中第二栅金属层的示意图；
图5为图1中第一源漏金属层的示意图；
图6为本发明实施例提供的像素驱动电路的第一基本结构图；
图7为本发明实施例提供的像素驱动电路的第一具体结构图；
图8为本发明实施例提供的像素驱动电路的第二基本结构图；
图9为本发明实施例提供的像素驱动电路的第二具体结构图；
图10为本发明实施例提供的一帧显示时间内像素驱动电路的工作时序图；
图11为本发明实施例提供的信号写入时段内的工作时序图；
图12为本发明实施例提供的栅极驱动电路的示意图。
具体实施方式
为了进一步说明本发明实施例提供的显示基板、显示装置，下面结合说明书附图进行详细描述。
本发明实施例提供了一种显示基板，包括基底和设置于所述基底上的多个子像素，每个子像素均包括发光元件；
所述多个子像素划分为多个子像素组，所述子像素组包括至少两个子像素，所述至少两个子像素复用同一个像素驱动电路，所述像素驱动电路包括：
至少两条发光控制信号线，每条所述发光控制信号线的至少部分沿第一方向延伸，至少两条发光控制信号线沿第二方向排列，所述第二方向与所述第一方向相交；
补偿驱动子电路，所述补偿驱动子电路的输出端用于输出驱动信号；
至少两个发光控制子电路，所述至少两个发光控制子电路与所述至少两个子像素中包括的至少两个发光元件对应，所述至少两个发光控制子电路与所述至少两条发光控制信号线对应，每个所述发光控制子电路分别与所述补偿驱动子电路的输出端，对应的发光元件和对应的发光控制信号线耦接；每个所述发光控制子电路用于在对应的发光控制信号线的控制下，控制导通或断开所述补偿驱动子电路的输出端和对应的发光元件之间的连接。
示例性的，所述至少两个发光控制子电路与所述至少两个子像素中包括的至少两个发光元件一一对应，所述至少两个发光控制子电路与所述至少两条发光控制信号线一一对应。
示例性的，所述发光元件包括相对设置的阳极和阴极，以及位于所述阳极和所述阴极之间的有机发光材料层。
示例性的，每个子像素组中包括沿所述第一方向相邻的至少两个子像素。
示例性的，每个子像素组中包括沿所述第二方向相邻的至少两个子像素。
示例性的，每个子像素组中包括多个子像素，所述多个子像素包括沿所述第一方向相邻的子像素和沿所述第二方向相邻的子像素。
示例性的，所述子像素组中包括的各子像素复用同一个像素驱动电路。
示例性的，所述第一方向包括水平方向，所述第二方向包括竖直方向。
示例性的，所述补偿驱动子电路用于产生驱动发光元件发光的电流信号。
示例性的，在同一时段，在所述至少两条发光控制信号线的控制下，所述至少两个发光控制子电路中，仅有一个发光控制子电路能够控制导通所述补偿驱动子电路的输出端和对应的发光元件之间的连接，其余发光控制子电路均控制断开所述补偿驱动子电路的输出端和对应的发光元件之间的连接。
示例性的，在同一时段，在所述至少两条发光控制信号线的控制下，所述至少两个发光控制子电路中，有多个发光控制子电路能够控制导通所述补偿驱动子电路的输出端和对应的发光元件之间的连接。
根据上述显示基板的具体结构可知，本发明实施例提供的显示基板中，至少两个子像素能够复用一个像素驱动电路，且该像素驱动电路能够独立控制所述至少两个子像素中各子像素包括的发光元件独立发光或同时发光，因此，本发明实施例提供的显示基板，能够在布局有限数量的像素驱动电路的情况下，实现高分辨率的显示。
如图1～图6、图8所示，在一些实施例中，所述像素驱动电路还包括：
基准信号线31，所述基准信号线31的至少部分沿第一方向延伸；
第一复位信号线32，所述第一复位信号线32的至少部分沿第一方向延伸；
栅线33，所述栅线33的至少部分沿所述第一方向延伸；
电源线38，所述电源线38的至少部分沿第二方向延伸；以及，
数据线39，所述数据线39的至少部分沿所述第二方向延伸；
所述补偿驱动子电路包括：
驱动子电路10，所述驱动子电路10的第一端与所述电源线38耦接，所述驱动子电路10的第二端作为所述补偿驱动子电路的输出端；
存储子电路11，所述存储子电路11的第一端与所述驱动子电路10的控制端耦接，所述存储子电路11的第二端与所述驱动子电路10的第二端耦接；
第一复位子电路12，分别与第一复位信号线32，基准信号线31和所述驱动子电路10的控制端耦接；
数据写入子电路13，分别与栅线33，数据线39和所述驱动子电路10的控制端耦接。
示例性的，所述基准信号线31用于提供基准信号Vref，该基准信号Vref为直流信号。
示例性的，所述基准信号线31在所述基底上的正投影，所述第一复位信号线32在所述基底上的正投影以及所述栅线33在所述基底上的正投影沿所述第二方向依次排列。
示例性的，所述电源线38与所述数据线39沿所述第一方向排列。
示例性的，所述电源线38与所述数据线39同层同材料设置。
示例性的，所示电源线38提供正电源信号ELVDD，发光元件的阴极接收负电源信号ELVSS。
示例性的，所述第一复位子电路12与所述驱动子电路10沿所述第二方向排列。
示例性的，所述驱动子电路10在所述基底上的正投影，所述存储子电路11在所述基底上的正投影，以及所述第一复位子电路12在所述基底上的正投影，均位于所述电源线38在所述基底上的正投影与所述数据线39在所述基底上的正投影之间。
如图1～图6、图8所示，在一些实施例中，所述至少两条发光控制信号线包括第一发光控制信号线34和第二发光控制信号线35；所述至少两个发光控制子电路包括第一发光控制子电路15和第二发光控制子电路16；所述至少两个发光元件包括第一发光元件EL1和第二发光元件EL2；
所述第一发光控制子电路15分别与所述驱动子电路10的第二端，所述第一发光控制信号线34和所述第一发光元件EL1耦接；所述第二发光控制子电路16分别与所述驱动子电路10的第二端，所述第二发光控制信号线35和所述第二发光元件EL2耦接。
示例性的，所述第一发光控制信号线34和所述第二发光控制信号线35均沿所述第一方向延伸，所述第一发光控制信号线34和所述第二发光控制信号线35沿所述第二方向排列。
示例性的，所述第一发光元件EL1的有机发光材料层和所述第二发光元件EL2的有机发光材料层沿所述第一方向排列；或者所述第一发光元件EL1的有机发光材料层和所述第二发光元件EL2的有机发光材料层沿所述第二方向排列。
所述第一发光控制子电路15能够在所述第一发光控制信号线34的控制下，控制导通或断开所述驱动子电路10的第二端与所述第一发光元件EL1之间的连接。所述第二发光控制子电路16能够在所述第二发光控制信号线35的控制下，控制导通或断开所述驱动子电路10的第二端与所述第二发光元件EL2之间的连接。
示例性的，在同一显示时段，所述第一发光控制子电路15控制导通所述驱动子电路10的第二端与对应的第一发光元件EL1之间的连接，所述第二发光控制子电路16控制导通所述驱动子电路10的第二端与对应的第一发光元件EL1之间的连接。
示例性的，如图10所示，将一帧显示时间分为前半帧和后半帧，所述前半帧和所述后半帧均包括信号写入时段P11和发光时段P12。在前半帧中的信号写入时段，所述补偿驱动子电路完成对应第一发光元件EL1的灰阶写入和补偿的过程。在前半帧中的发光时段，在第一发光控制信号线34的控制下，所述第一发光控制子电路15控制导通所述补偿驱动子电路的输出端与对应的第一发光元件EL1之间的连接，使所述第一发光元件EL1发光；在第二发光控制信号线35的控制下，所述第二发光控制子电路16控制断开所述补偿驱动子电路的输出端与对应的第二发光元件EL2之间的连接，使所述第二发光元件EL2不发光。
在后半帧中的信号写入时段，所述补偿驱动子电路完成对应第二发光元件EL2的灰阶写入和补偿的过程。在后半帧中的发光时段，在第一发光控制信号线34的控制下，所述第一发光控制子电路15控制断开所述补偿驱动子电路的输出端与对应的第一发光元件EL1之间的连接，使所述第一发光元件EL1不发光；在第二发光控制信号线35的控制下，所述第二发光控制子电路16控制导通所述补偿驱动子电路的输出端与对应的第二发光元件EL2之间的连接，使所述第二发光元件EL2发光。
需要说明，当每个子像素组包括N个子像素时，N为大于或等于2的整数，可以将每一帧显示时间划分为N个子帧，在每个子帧对对应的发光元件实现灰阶写入，补偿和显示的过程。在将每一帧显示时间划分为N个子帧时，每个子帧对应的灰阶写入和信号补偿过孔能够实现互不干扰，从而实现对N个发光元件的独立控制。
上述实施例提供的显示基板中，N个子像素可以共用一个像素驱动电路，实现各子像素的分时显示或同时显示，避免了每个像素都设置独立的像素驱动电路，从而很好的提高了显示基板中像素驱动电路的布局空间利用率。
如图1～图5、图7和图9所示，在一些实施例中，所述第一发光控制子电路15包括第一晶体管T1，所述第二发光控制子电路16包括第二晶体管T2，所述驱动子电路10包括驱动晶体管DTFT；所述存储子电路11包括存储电容Cst；
所述驱动晶体管DTFT的栅极g复用为所述存储电容Cst的第一极板Cst1；
所述存储电容Cst的第二极板Cst2位于所述第一极板Cst1背向所述基底的一侧，所述第二极板Cst2与所述驱动晶体管DTFT的第二极耦接；
所述第一晶体管T1的第一极与所述驱动晶体管DTFT的第二极耦接，所述第一晶体管T1的第二极与第一发光元件EL1耦接；
所述第二晶体管T2的第一极与所述第二极板Cst2耦接，所述第二晶体管T2的第二极与所述第二发光元件EL2耦接。
示例性的，如图2所示，所述驱动晶体管DTFT包括驱动有源图形56，所述驱动有源图形56包括沿所述第一方向延伸的部分和沿所述第二方向延伸的部分，所述驱动有源图形56在所述基底上的正投影与所述驱动晶体管DTFT的栅极在所述基底上的正投影部分交叠，所述驱动有源图形56的第一端作为所述驱动晶体管DTFT的第一极，所述驱动有源图形56的第二端作为驱动晶体管DTFT的第二极，所述驱动有源图形56的第一端在所述基底上的正投影与所述电源线38在所述基底上的正投影交叠，在该交叠处，所述驱动有源图形56的第一端与所述电源线38通过第一过孔21耦接，所述驱动有源图形56的第二端与所述第一晶体管T1的第一极耦接。
示例性的，所述驱动有源图形56的第二端在所述基底上的正投影与所述第二极板Cst2在所述基底上的正投影交叠，在该交叠处，所述驱动有源图形56的第二端与所述第二极板Cst2通过第二过孔22耦接。
如图1、图2、图7和图9所示，在一些实施例中，所述第一晶体管T1包括第一有源图形51，所述第一有源图形51沿所述第二方向延伸；所述第一有源图形51的第一端与所述驱动晶体管DTFT的第二极耦接；所述第一有源图形51的第二端与所述第一发光元件EL1耦接；
所述第一有源图形51的第二端在所述基底上的正投影，位于所述第一发光控制信号线34在所述基底上的正投影和所述第二发光控制信号线35在所述基底上的正投影之间。
示例性的，所述第一有源图形51沿所述第二方向延伸，所述第一有源图形51在所述基底上的正投影与所述第一发光控制信号线34在所述基底上的正投影部分交叠，所述第一发光控制信号线34复用为所述第一晶体管T1的栅极，所述第一有源图形51的第一端作为所述第一晶体管T1的第一极，所述第一有源图形51的第二端作为所述第一晶体管T1的第二极。
示例性的，所述第一有源图形51的第一端和第二端均不与所述第一发光控制信号34线交叠。
示例性的，所述第一有源图形51的第一端与所述驱动有源图形56的第二端形成为一体结构。
示例性的，所述第一有源图形51的第二端通过第三过孔23与所述第一发光元件EL1的阳极耦接。
如图1、图3、图4所示，在一些实施例中，所述第二极板Cst2包括主体部Cst21和延伸部Cst22；
所述主体部Cst21在所述基底上的正投影与所述驱动晶体管DTFT的栅极在所述基底上的正投影至少部分交叠；
所述延伸部Cst22沿所述第二方向延伸，所述延伸部Cst22在所述基底上的正投影，分别与所述第一发光控制信号线34在所述基底上的正投影和所述第二发光控制信号线35在所述基底上的正投影交叠。
示例性的，所述主体部和所述延伸部Cst22形成为一体结构。
示例性的，所述主体部为块状，所述延伸部Cst22为条状。
示例性的，所述驱动有源图形56的第二端在所述基底上的正投影与所述主体部Cst21在所述基底上的正投影交叠，在该交叠处，所述驱动有源图形56的第二端与所述主体部Cst21通过第二过孔22耦接。
示例性的，所述延伸部Cst22远离所述主体部的一端在所述基底上的正投影，位于所述第二发光控制信号线35在所述基底上的正投影和第二复位信号线36在所述基底上的正投影之间。
如图1、图2、图4所示，在一些实施例中，所述第二晶体管T2包括第二有源图形52，所述第二有源图形52的至少部分沿所述第二方向延伸，所述第二有源图形52的第一端与所述延伸部Cst22耦接，所述第二有源图形52的第二端与所述第二发光元件EL2耦接；
所述第二有源图形52的第一端在所述基底上的正投影，位于所述第一发光控制信号线34在所述基底上的正投影和所述第二发光控制信号线35在所述基底上的正投影之间。
示例性的，所述第二有源图形52呈“┓”形。
示例性的，所述第二有源图形52包括一体结构的第一部分和第二部分，所述第一部分沿所述第二方向延伸，所述第二部分沿所述第一方向延伸，所述第一部分在所述基底上的正投影与所述第二发光控制信号线35在所述基底上的正投影部分交叠。
示例性的，所述第二有源图形52的第一端作为所述第二晶体管T2的第一极，所述第二有源图形52的第二端作为所述第二晶体管T2的第二极。所述第二有源图形52的第一端在所述基底上的正投影，与所述延伸部Cst22在所述基底上的正投影交叠，在该交叠处，所述第二有源图形52的第一端与所述延伸部Cst22通过第四过孔24耦接。所述第二有源图形52的第二端与所述第二发光元件EL2的阳极通过第五过孔25耦接。
示例性的，所述第二有源图形52的第二端在所述基底上的正投影，位于所述第二发光控制信号线35在所述基底上的正投影和第二复位信号线36在所述基底上的正投影之间。
如图1～图3、图6和图8所示，在一些实施例中，所述像素驱动电路还包括：
初始化信号线37，所述初始化信号线37的至少部分沿所述第一方向延伸；
第二复位信号线36，所述第二复位信号线36的至少部分沿所述第一方向延伸；所述第一复位信号线32，所述栅线33，所述第一发光控制信号线34，所述第二发光控制信号线35和所述第二复位信号线36沿所述第二方向依次排列；
第二复位子电路14，分别与第二复位信号线36，初始化信号线37和所述延伸部Cst22耦接。
示例性的，所述初始化信号线37用于提供具有固定电位的基准信号Vref。
示例性的，所述初始化信号线37与各晶体管中的有源图形同层同材料设置。
示例性的，所述初始化信号线37与所述栅线33同层同材料设置。
示例性的，所述初始化信号线37与存储电容Cst的第二极板Cst2同层同材料设置。
示例性的，所述第二复位信号线36在所述基底上的正投影，位于所述第二发光控制信号线35在所述基底上的正投影和所述初始化信号线37在所述基底上的正投影之间。
所述第二复位子电路14能够在所述第二复位信号线36的控制下，控制导通或断开所述初始化信号线37与所述延伸部Cst22之间的连接。
如图1～图3、图7和图9所示，在一些实施例中，所述第二复位子电路14包括第五晶体管T5，所述第五晶体管T5包括第五有源图形55，所述第五有源图形55沿所述第二方向延伸；
所述第五有源图形55的第一端与所述延伸部Cst22耦接，所述第五有源图形55的第一端在所述基底上的正投影，位于所述第二发光控制信号线35在所述基底上的正投影和所述第二复位信号线36在所述基底上的正投影之间。
示例性的，所述第五有源图形55在所述基底上的正投影与所述第二复位信号线36在所述基底上的正投影交叠，所述第五有源图形55的第一端作为所述第五晶体管T5的第二极，所述第五有源图形55的第二端作为所述第五晶体管T5的第一极。
示例性的，所述第五有源图形55的第一端在所述基底上的正投影与所述延伸部Cst22在所述基底上的正投影交叠，在该交叠处，所述第五有源图形55的第一端与所述延伸部Cst22通过第六过孔26耦接。
如图2所示，在一些实施例中，设置所述第五有源图形55与所述初始化信号线37形成为一体结构。
上述设置方式使得所述第五有源图形55与所述初始化信号线37能够在同一次构图工艺中形成，有效简化了显示基板的制作流程，降低了制作成本。
如图1～图3、图7和图9所示，在一些实施例中，所述第一复位信号线32在所述基底上的正投影，位于所述基准信号线31在所述基底上的正投影和所述栅线33在所述基底上的正投影之间；
所述第一复位子电路12包括第三晶体管T3，所述第三晶体管T3包括第三有源图形53，所述第三有源图形53沿所述第二方向延伸，所述第三有源图形53的第一端与所述基准信号线31耦接，所述第三有源图形53的第二端在所述基底上的正投影，位于所述第一复位信号线32在所述基底上的正投影和所述栅线33在所述基底上的正投影之间。
示例性的，所述第三有源图形53在所述基底上的正投影与所述第一复位信号线32在所述基底上的正投影部分交叠。所述第三有源图形53的第一端作为所述第三晶体管T3的第一极，所述第三有源图形53的第二端作为所述第三晶体管T3的第二极，所述第三有源图形53的第一端在所述基底上的正投影，与所述基准信号线31在所述基底上的正投影交叠，在该交叠处，所述第三有源图形53的第一端与所述基准信号线31通过第七过孔27耦接。
如图1～图3、图7和图9所示，在一些实施例中，所述栅线33包括栅主体部331和两个栅突出部332，所述栅主体部331沿所述第一方向延伸，所述两个栅突出部332沿所述第一方向间隔设置，所述两个栅突出部332位于所述栅主体部331和所述第一复位信号线32之间；
所述数据写入子电路13包括第四晶体管T4，所述第四晶体管T4包括第四有源图形54，所述第四有源图形54沿第一方向延伸，所述第四有源图形54在所述基底上的正投影，分别与两个栅突出部332在所述基底上的正投影交叠；
所述第四有源图形54的第一端与所述数据线39耦接，所述第四有源图形54的第二端与所述第三有源图形53的第二端耦接。
示例性的，所述栅主体部331和所述两个栅突出部332形成为一体结构。
示例性的，所述栅突出部332沿所述第二方向延伸。
示例性的，所述两个栅突出部332在所述基底上的正投影，位于所述栅主体部331在所述基底上的正投影和所述第一复位信号线32在所述基底上的正投影之间。
示例性的，所述两个栅突出部332复用为所述第四晶体管T4的栅极，所述第四晶体管T4为双栅结构。
示例性的，所述第四晶体管T4也可以形成为普通的只有一个栅极的结构。
示例性的，所述第四有源图形54的第一端作为所述第四晶体管T4的第一极，所述第四有源图形54的第二端作为所述第四晶体管T4的第二极。
示例性的，所述第四有源图形54的第一端在所述基底上的正投影与所述数据线39在所述基底上的正投影交叠，在该交叠处，所述第四有源图形54的第一端与所述数据线39通过第八过孔28耦接。
示例性的，所述第四有源图形54的第二端与所述第三有源图形53的第二端形成为一体结构。
示例性的，所述第三有源图形53和所述第四有源图形54共同形成为L形。
需要说明，所述第一晶体管T1、所述第二晶体管T2、所述第三晶体管T3、所述第四晶体管T4、所述第五晶体管T5和所述驱动晶体管DTFT的具体类型多种多样，示例性的，均选用NMOS晶体管。
当所述像素驱动电路包括：所述第一晶体管T1、所述第二晶体管T2、所述第三晶体管T3、所述第四晶体管T4、所述第五晶体管T5和所述驱动晶体管DTFT时，如图11所示，所述像素驱动电路在信号写入时段的工作过程如下：
在所述信号写入时段的P111阶段，在所述第一复位信号线32写入的第一复位信号G1的控制下，第三晶体管T3导通，向驱动晶体管DTFT的栅极(即g点)写入基准信号Vref；在所述第二复位信号线36写入的第二复位信号G2的控制下，第五晶体管T5导通，向驱动晶体管DTFT的源极(即s点)写入初始化信号Vint。
在所述信号写入时段的P112阶段，基准信号Vref的电压高于初始化信号Vint的电压，驱动晶体管DTFT导通，s点电压上升，当s点电压上升到Vref-Vth时，Vth位驱动晶体管DTFT的阈值电压，驱动晶体管DTFT的Vgs-Vth＝0，Vgs为驱动晶体管DTFT的栅极和源极之间的电压差值，从而驱动晶体管DTFT截止。
在所述信号写入时段的P113阶段，在栅线33写入的扫描信号G3的控制下，第四晶体管T4导通，将数据线39传输的数据信号DA写入g点，由于存储电容Cst和OLED本身固有电容Coled的耦合作用，s点电压变化为Vref-Vth+a(Vdata-Vref)，其中a＝C1/(C1+Coled)，C1为存储电容Cst的容值，Vdata为数据信号DA的电压值。流经驱动晶体管DTFT的最终驱动电流为I＝k*(Vgs-Vth)^2＝k*[(1-a)*(Vdata-Vref)]^2，驱动电流大小与Vth无关，从而实现Vth的补偿。
如图1和图5所示，在一些实施例中，所述像素驱动电路包括导电连接部40，所述导电连接部40的至少部分沿所述第二方向延伸，所述导电连接部40在所述基底上的正投影与所述栅线33在所述基底上的正投影部分交叠；
所述导电连接部40的第一端与所述第三有源图形53的第二端耦接，所述导电连接部40的第二端与所述驱动子电路10的控制端耦接。
示例性的，所述导电连接部40的第一端在所述基底上的正投影与第三有源图形53的第二端在所述基底上的正投影交叠，在该交叠处，所述导电连接部40的第一端与第三有源图形53的第二端通过第九过孔29耦接。所述导电连接部40的第二端在所述基底上的正投影与所述驱动晶体管DTFT的栅极在所述基底上的正投影交叠，所述导电连接部40的第二端与所述驱动晶体管DTFT的栅极通过第十过孔20耦接。
示例性的，所述导电连接部40在所述基底上的正投影与所述第二极板Cst2在所述基底上的正投影不交叠。
需要说明，所述显示基板包括沿远离所述基底的方向，依次层叠设置的有源层、第一栅绝缘层、第一栅金属层、第二栅绝缘层、第二栅金属层、层间绝缘层、第一源漏金属层和平坦层等。
示例性的，所述有源层用于形成各晶体管包括的有源图形，初始化信号线37；所述第一栅金属层用于形成所述第一复位信号线32，所述栅极，所述第一发光控制信号线34、所述第二发光控制信号线35和所述第二复位信号线36；所述第二栅金属层用于形成所述基准信号线31，所述第二极板Cst2和一些导电连接部40；所述第一源漏金属层用于形成所述电源线38，所述数据线39和一些导电连接部40。
需要说明，所述第一过孔21至所述第十过孔20能够贯穿一层或多层膜层。
所述第一晶体管T1的第二极和所述第二晶体管T2的第二极，可以通过由所述第二栅金属层和所述第一源漏金属层形成的连接部(如标记41和42)，以及对应的过孔，与对应的发光元件的阳极耦接。
上述实施例提供的显示基板中，在采用上述布局方式时，能够有效利用布局空间，实现显示基板的分辨率最大化。
本发明实施还提供了一种显示装置，包括上述实施例提供的显示基板。
上述施例提供的显示基板中，至少两个子像素能够复用一个像素驱动电路，且该像素驱动电路能够独立控制所述至少两个子像素中各子像素包括的发光元件独立发光或同时发光，因此，上述实施例提供的显示基板，能够在布局有限数量的像素驱动电路的情况下，实现高分辨率的显示。
本发明实施例提供的显示装置在包括上述显示基板时同样具有上述有益效果，此处不再赘述。
需要说明的是，所述显示装置可以为：电视、显示器、数码相框、手机、平板电脑等任何具有显示功能的产品或部件。
在一些实施例中，所述显示基板中至少两条发光控制信号线包括第一发光控制信号线34和第二发光控制信号线35；至少两个发光控制子电路包括第一发光控制子电路15和第二发光控制子电路16；至少两个发光元件包括第一发光元件EL1和第二发光元件EL2；
所述显示基板中的多个子像素组中包括的多个像素驱动电路呈阵列分布，所述多个像素驱动电路划分为沿所述第二方向排列的多行像素驱动电路，每行像素驱动电路中的第一发光控制信号线34依次耦接，每行像素驱动电路中的第二发光控制信号线35依次耦接；
所述显示装置还包括：位于显示基板的周边区域的栅极驱动电路，所述栅极驱动电路包括多个第一移位寄存器单元和多个第二移位寄存器单元；所述多个第一移位寄存器单元与所述多行像素驱动电路一一对应，所述多个第二移位寄存器单元与所述多行像素驱动电路一一对应；
所述第一移位寄存器单元的输出端与对应的一行像素驱动电路中的第一发光控制信号线34耦接，所述第二移位寄存器单元的输出端与对应的一行像素驱动电路中的第二发光控制信号线35耦接。
示例性的，所述显示基板中，多个子像素组中包括多个像素驱动电路呈阵列分布，所述多个像素驱动电路能够划分为多行像素驱动电路和多列像素驱动电路。
所述多行像素驱动电路沿所述第二方向依次排列，每行像素驱动电路均包括沿所述第一方向排列的多个像素驱动电路。所述多列像素驱动电路沿所述第一方向依次排列，每列像素驱动电路均包括沿所述第二方向排列的多个像素驱动电路。
在同一行像素驱动电路中，所述基准信号线31依次耦接形成为一体结构，所述第一复位信号线32依次耦接形成为一体结构，所述栅线33依次耦接形成为一体结构，所述第一发光控制信号线34依次耦接形成为一体结构，所述第二发光控制信号线35依次耦接形成为一体结构，所述第二复位信号线36依次耦接形成为一体结构，所述初始化信号线37依次耦接形成为一体结构。
在同一列像素驱动电路中，所述电源线38依次耦接形成为一体结构，所述数据线39依次耦接形成为一体结构。
如图12所示，示例性的，所述栅极驱动电路包括多个第一移位寄存器单元EM1 GOA和多个第二移位寄存器单元EM2 GOA；所述多个第一移位寄存器单元与所述多行像素驱动电路一一对应，所述多个第二移位寄存器单元与所述多行像素驱动电路一一对应；所述第一移位寄存器单元的输出端与对应的一行像素驱动电路中的第一发光控制信号线34耦接，所述第二移位寄存器单元的输出端与对应的一行像素驱动电路中的第二发光控制信号线35耦接。
示例性的，所述栅极驱动电路包括多个第三移位寄存器单元G3 GOA，所述多个第三移位寄存器单元与所述多行像素驱动电路一一对应，所述第三移位寄存器单元的输出端与对应的一行像素驱动电路中的栅线33耦接。
示例性的，所述栅极驱动电路包括多个第四移位寄存器单元G1 GOA，所述多个第四移位寄存器单元与所述多行像素驱动电路一一对应，所述第四移位寄存器单元的输出端与对应的一行像素驱动电路中的第一复位信号线32耦接。
示例性的，所述栅极驱动电路包括多个第五移位寄存器单元G2 GOA，所述多个第五移位寄存器单元与所述多行像素驱动电路一一对应，所述第五移位寄存器单元的输出端与对应的一行像素驱动电路中的第二复位信号线36耦接。
示例性的，对应一行像素驱动电路的一种移位寄存器单元可以设置在显示基板的一侧，即实现单侧驱动；或者对应一行像素驱动电路的一种移位寄存器单元也可以设置在显示基板相对的两侧，即实现双侧驱动。
示例性的，所述栅极驱动电路包括N个第一移位寄存器单元EM1 GOA，所述N个第一移位寄存器单元EM1 GOA级联，即第N-1个第一移位寄存器单元EM1 GOA的输出端与对应的一行像素驱动电路中的第一发光控制信号线34耦接，第N-1个第一移位寄存器单元EM1 GOA的输出端还同时与第N个第一移位寄存器单元EM1 GOA的输入信号端耦接，第N-1个第一移位寄存器单元EM1 GOA同时向对应的一行像素驱动电路中的第一发光控制信号线34，以及第N个第一移位寄存器单元EM1 GOA的输入信号端写入第一发光控制信号。
同样的，所述多个第二移位寄存器单元EM2 GOA，所述多个第三移位寄存器单元G3GOA，多个第四移位寄存器单元G1 GOA，多个第五移位寄存器单元G2 GOA也均满足上述级联关系，此处不再赘述。
如图6所示，本发明实施例还提供了一种像素驱动电路，用于驱动至少两个发光元件发光，所述像素驱动电路包括：
驱动子电路10，所述驱动子电路10的第一端与第一电平信号输入端耦接；
存储子电路11，所述存储子电路11的第一端与所述驱动子电路10的控制端耦接，所述存储子电路11的第二端与所述驱动子电路10的第二端耦接；
第一复位子电路12，分别与第一复位信号输入端，基准信号输入端和所述驱动子电路10的控制端耦接；
数据写入子电路13，分别与扫描信号输入端，数据信号输入端和所述驱动子电路10的控制端耦接；以及，
至少两个发光控制子电路，所述至少两个发光控制子电路与所述至少两个发光元件一一对应，所述至少两个发光控制子电路与至少两个控制信号输出端一一对应；每个所述发光控制子电路分别与所述驱动子电路10的第二端，对应的控制信号输出端和对应的发光元件耦接；每个所述发光控制子电路用于在对应的控制信号输出端的控制下，控制导通或断开所述驱动子电路10的第二端与对应的发光元件之间的连接。
在一些实施例中，所述至少两个发光元件包括第一发光元件EL1和第二发光元件EL2；所述至少两个控制信号输出端包括第一控制信号输出端和第二控制信号输出端；所述至少两个发光控制子电路包括第一发光控制子电路15和第二发光控制子电路16；
所述第一发光控制子电路15分别与所述驱动子电路10的第二端，所述第一控制信号输出端和所述第一发光元件EL1耦接；用于在所述第一控制信号输出端的控制下，控制导通或断开所述驱动子电路10的第二端与所述第一发光元件EL1之间的连接；
所述第二发光控制子电路16分别与所述驱动子电路10的第二端，所述第二控制信号输出端和所述第二发光元件EL2耦接；用于在所述第二控制信号输出端的控制下，控制导通或断开所述驱动子电路10的第二端与所述第二发光元件EL2之间的连接。
如图7所示，在一些实施例中，所述第一发光控制子电路15包括第一晶体管T1，所述第一晶体管T1的栅极与所述第一控制信号输出端耦接，所述第一晶体管T1的第一极与所述驱动子电路10的第二端耦接，所述第一晶体管T1的第二极与所述第一发光元件EL1耦接。
如图7所示，在一些实施例中，所述第二发光控制子电路16包括第二晶体管T2，所述第二晶体管T2的栅极与所述第二控制信号输出端耦接，所述第二晶体管T2的第一极与所述驱动子电路10的第二端耦接，所述第二晶体管T2的第二极与所述第二发光元件EL2耦接。
如图7所示，在一些实施例中，所述驱动子电路10包括驱动晶体管DTFT，所述驱动晶体管DTFT的第一极与所述第一电平信号输入端耦接；
所述存储子电路11包括存储电容Cst，所述存储电容Cst的第一极板Cst1与所述驱动晶体管DTFT的栅极耦接，所述存储电容Cst的第二极板Cst2与所述驱动晶体管DTFT的第二极耦接；
所述第一复位子电路12包括第三晶体管T3，所述第三晶体管T3的栅极与所述第一复位信号输入端耦接，所述第三晶体管T3的第一极与所述基准信号输入端耦接，所述第三晶体管T3的第二极与所述驱动晶体管DTFT的栅极耦接；
所述数据写入子电路13包括第四晶体管T4，所述第四晶体管T4的栅极与所述扫描信号输入端耦接，所述第四晶体管T4的第一极与所述数据信号输入端耦接，所述第四晶体管T4的第二极与所述驱动晶体管DTFT的栅极耦接。
如图8所示，在一些实施例中，所述像素驱动电路还包括：
第二复位子电路14，分别与第二复位信号输入端，初始化信号输入端和所述驱动子电路10的第二端耦接；用于在所述第二复位信号输入端的控制下，控制导通或断开所述初始化信号输入端与所述驱动子电路10的第二端之间的连接。
如图9所示，在一些实施例中，所述第二复位子电路14包括第五晶体管T5，所述第五晶体管T5的栅极与所述第二复位信号输入端耦接，所述第五晶体管T5的第一极与所述初始化信号输入端耦接，所述第五晶体管T5的第二极与所述驱动子电路10的第二端耦接。
本发明实施例还提供了一种像素驱动电路的驱动方法，其特征在于，用于驱动上述实施例提供的像素驱动电路，所述驱动方法包括：
在发光阶段，至少两个控制信号输出端分别控制对应的至少两个发光控制子电路，以使各发光控制子电路控制导通或断开所述驱动子电路10的第二端与对应的发光元件之间的连接。
在一些实施例中，至少两个发光元件包括第一发光元件EL1和第二发光元件EL2；所述至少两个控制信号输出端包括第一控制信号输出端和第二控制信号输出端；所述至少两个发光控制子电路包括第一发光控制子电路15和第二发光控制子电路16；
在第一发光阶段，所述第一发光控制子电路15在所述第一控制信号输出端的控制下，控制导通所述驱动子电路10的第二端与所述第一发光元件EL1之间的连接；所述第二发光控制子电路16在所述第二控制信号输出端的控制下，控制断开所述驱动子电路10的第二端与所述第二发光元件EL2之间的连接；
在第二发光阶段，所述第一发光控制子电路15在所述第一控制信号输出端的控制下，控制断开所述驱动子电路10的第二端与所述第一发光元件EL1之间的连接；所述第二发光控制子电路16在所述第二控制信号输出端的控制下，控制导通所述驱动子电路10的第二端与所述第二发光元件EL2之间的连接。
需要说明，本说明书中的各个实施例均采用递进的方式描述，各个实施例之间相同相似的部分互相参见即可，每个实施例重点说明的都是与其他实施例的不同之处。尤其，对于方法实施例而言，由于其基本相似于产品实施例，所以描述得比较简单，相关之处参见产品实施例的部分说明即可。
除非另外定义，本公开使用的技术术语或者科学术语应当为本发明所属领域内具有一般技能的人士所理解的通常意义。本公开中使用的“第一”、“第二”以及类似的词语并不表示任何顺序、数量或者重要性，而只是用来区分不同的组成部分。“包括”或者“包含”等类似的词语意指出现该词前面的元件或者物件涵盖出现在该词后面列举的元件或者物件及其等同，而不排除其他元件或者物件。“连接”、“耦接”或者“相连”等类似的词语并非限定于物理的或者机械的连接，而是可以包括电性的连接，不管是直接的还是间接的。“上”、“下”、“左”、“右”等仅用于表示相对位置关系，当被描述对象的绝对位置改变后，则该相对位置关系也可能相应地改变。
可以理解，当诸如层、膜、区域或基板之类的元件被称作位于另一元件“上”或“下”时，该元件可以“直接”位于另一元件“上”或“下”，或者可以存在中间元件。
在上述实施方式的描述中，具体特征、结构、材料或者特点可以在任何的一个或多个实施例或示例中以合适的方式结合。
以上所述，仅为本发明的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应以所述权利要求的保护范围为准。

Claims (15)

1.一种显示基板，其特征在于，包括基底和设置于所述基底上的多个子像素，每个子像素均包括发光元件；
所述多个子像素划分为多个子像素组，所述子像素组包括至少两个子像素，所述至少两个子像素复用同一个像素驱动电路，所述像素驱动电路包括：
至少两条发光控制信号线，每条所述发光控制信号线的至少部分沿第一方向延伸，至少两条发光控制信号线沿第二方向排列，所述第二方向与所述第一方向相交；
补偿驱动子电路，所述补偿驱动子电路的输出端用于输出驱动信号；
至少两个发光控制子电路，所述至少两个发光控制子电路与所述至少两个子像素中包括的至少两个发光元件对应，所述至少两个发光控制子电路与所述至少两条发光控制信号线对应，每个所述发光控制子电路分别与所述补偿驱动子电路的输出端，对应的发光元件和对应的发光控制信号线耦接；每个所述发光控制子电路用于在对应的发光控制信号线的控制下，控制导通或断开所述补偿驱动子电路的输出端和对应的发光元件之间的连接。
2.根据权利要求1所述的显示基板，其特征在于，所述像素驱动电路还包括：
基准信号线，所述基准信号线的至少部分沿第一方向延伸；
第一复位信号线，所述第一复位信号线的至少部分沿第一方向延伸；
栅线，所述栅线的至少部分沿所述第一方向延伸；
电源线，所述电源线的至少部分沿第二方向延伸；以及，
数据线，所述数据线的至少部分沿所述第二方向延伸；
所述补偿驱动子电路包括：
驱动子电路，所述驱动子电路的第一端与所述电源线耦接，所述驱动子电路的第二端作为所述补偿驱动子电路的输出端；
存储子电路，所述存储子电路的第一端与所述驱动子电路的控制端耦接，所述存储子电路的第二端与所述驱动子电路的第二端耦接；
第一复位子电路，分别与第一复位信号线，基准信号线和所述驱动子电路的控制端耦接；
数据写入子电路，分别与栅线，数据线和所述驱动子电路的控制端耦接。
3.根据权利要求2所述的显示基板，其特征在于，所述至少两条发光控制信号线包括第一发光控制信号线和第二发光控制信号线；所述至少两个发光控制子电路包括第一发光控制子电路和第二发光控制子电路；所述至少两个发光元件包括第一发光元件和第二发光元件；
所述第一发光控制子电路分别与所述驱动子电路的第二端，所述第一发光控制信号线和所述第一发光元件耦接；所述第二发光控制子电路分别与所述驱动子电路的第二端，所述第二发光控制信号线和所述第二发光元件耦接。
4.根据权利要求3所述的显示基板，其特征在于，所述第一发光控制子电路包括第一晶体管，所述第二发光控制子电路包括第二晶体管，所述驱动子电路包括驱动晶体管；所述存储子电路包括存储电容；
所述驱动晶体管的栅极复用为所述存储电容的第一极板；
所述存储电容的第二极板位于所述第一极板背向所述基底的一侧，所述第二极板与所述驱动晶体管的第二极耦接；
所述第一晶体管的第一极与所述驱动晶体管的第二极耦接，所述第一晶体管的第二极与第一发光元件耦接；
所述第二晶体管的第一极与所述第二极板耦接，所述第二晶体管的第二极与所述第二发光元件耦接。
5.根据权利要求4所述的显示基板，其特征在于，所述第一晶体管包括第一有源图形，所述第一有源图形沿所述第二方向延伸；所述第一有源图形的第一端与所述驱动晶体管的第二极耦接；所述第一有源图形的第二端与所述第一发光元件耦接；
所述第一有源图形的第二端在所述基底上的正投影，位于所述第一发光控制信号线在所述基底上的正投影和所述第二发光控制信号线在所述基底上的正投影之间。
6.根据权利要求4所述的显示基板，其特征在于，所述第二极板包括主体部和延伸部；
所述主体部在所述基底上的正投影与所述驱动晶体管的栅极在所述基底上的正投影至少部分交叠；
所述延伸部沿所述第二方向延伸，所述延伸部在所述基底上的正投影，分别与所述第一发光控制信号线在所述基底上的正投影和所述第二发光控制信号线在所述基底上的正投影交叠。
7.根据权利要求6所述的显示基板，其特征在于，所述第二晶体管包括第二有源图形，所述第二有源图形的至少部分沿所述第二方向延伸，所述第二有源图形的第一端与所述延伸部耦接，所述第二有源图形的第二端与所述第二发光元件耦接；
所述第二有源图形的第一端在所述基底上的正投影，位于所述第一发光控制信号线在所述基底上的正投影和所述第二发光控制信号线在所述基底上的正投影之间。
8.根据权利要求6所述的显示基板，其特征在于，所述像素驱动电路还包括：
初始化信号线，所述初始化信号线的至少部分沿所述第一方向延伸；
第二复位信号线，所述第二复位信号线的至少部分沿所述第一方向延伸；所述第一复位信号线，所述栅线，所述第一发光控制信号线，所述第二发光控制信号线和所述第二复位信号线沿所述第二方向依次排列；
第二复位子电路，分别与第二复位信号线，初始化信号线和所述延伸部耦接。
9.根据权利要求8所述的显示基板，其特征在于，所述第二复位子电路包括第五晶体管，所述第五晶体管包括第五有源图形，所述第五有源图形沿所述第二方向延伸；
所述第五有源图形的第一端与所述延伸部耦接，所述第五有源图形的第一端在所述基底上的正投影，位于所述第二发光控制信号线在所述基底上的正投影和所述第二复位信号线在所述基底上的正投影之间。
10.根据权利要求9所述的显示基板，其特征在于，所述第五有源图形与所述初始化信号线形成为一体结构。
11.根据权利要求2所述的显示基板，其特征在于，所述第一复位信号线在所述基底上的正投影，位于所述基准信号线在所述基底上的正投影和所述栅线在所述基底上的正投影之间；
所述第一复位子电路包括第三晶体管，所述第三晶体管包括第三有源图形，所述第三有源图形沿所述第二方向延伸，所述第三有源图形的第一端与所述基准信号线耦接，所述第三有源图形的第二端在所述基底上的正投影，位于所述第一复位信号线在所述基底上的正投影和所述栅线在所述基底上的正投影之间。
12.根据权利要求11所述的显示基板，其特征在于，所述栅线包括栅主体部和两个栅突出部，所述栅主体部沿所述第一方向延伸，所述两个栅突出部沿所述第一方向间隔设置，所述两个栅突出部位于所述栅主体部和所述第一复位信号线之间；
所述数据写入子电路包括第四晶体管，所述第四晶体管包括第四有源图形，所述第四有源图形沿第一方向延伸，所述第四有源图形在所述基底上的正投影，分别与两个栅突出部在所述基底上的正投影交叠；
所述第四有源图形的第一端与所述数据线耦接，所述第四有源图形的第二端与所述第三有源图形的第二端耦接。
13.根据权利要求12所述的显示基板，其特征在于，所述像素驱动电路包括导电连接部，所述导电连接部的至少部分沿所述第二方向延伸，所述导电连接部在所述基底上的正投影与所述栅线在所述基底上的正投影交叠；
所述导电连接部的第一端与所述第三有源图形的第二端耦接，所述导电连接部的第二端与所述驱动子电路的控制端耦接。
14.一种显示装置，其特征在于，包括如权利要求1～13中任一项所述的显示基板。
15.根据权利要求14所述的显示装置，其特征在于，所述显示基板中至少两条发光控制信号线包括第一发光控制信号线和第二发光控制信号线；至少两个发光控制子电路包括第一发光控制子电路和第二发光控制子电路；至少两个发光元件包括第一发光元件和第二发光元件；
所述显示基板中的多个子像素组中包括的多个像素驱动电路呈阵列分布，所述多个像素驱动电路划分为沿所述第二方向排列的多行像素驱动电路，每行像素驱动电路中的第一发光控制信号线依次耦接，每行像素驱动电路中的第二发光控制信号线依次耦接；
所述显示装置还包括：位于显示基板的周边区域的栅极驱动电路，所述栅极驱动电路包括多个第一移位寄存器单元和多个第二移位寄存器单元；所述多个第一移位寄存器单元与所述多行像素驱动电路一一对应，所述多个第二移位寄存器单元与所述多行像素驱动电路一一对应；
所述第一移位寄存器单元的输出端与对应的一行像素驱动电路中的第一发光控制信号线耦接，所述第二移位寄存器单元的输出端与对应的一行像素驱动电路中的第二发光控制信号线耦接。
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