CN112530333A - 显示装置 - Google Patents

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Abstract

公开了一种显示装置，并且该显示装置包括：显示面板，包括多个像素并且配置为显示图像；驱动控制器，包括时序控制器和由时序控制器控制的驱动器，驱动控制器配置为将电信号供给到显示面板；存储器，配置为从驱动控制器接收静止图像数据并且存储静止图像数据；以及接口，配置为将驱动控制器联接到存储器，以便传输和接收静止图像数据，其中，驱动控制器和存储器是独立的单独的组件。

Description

显示装置
相关申请的交叉引用
本申请要求于2019年9月18日提交的10-2019-0114798号韩国专利申请的优先权和权益，该韩国专利申请的全部公开内容通过引用整体地并入本文。
技术领域
本公开的一些示例性实施例的各方面涉及显示装置。
背景技术
随着信息社会的发展，对用于显示图像的显示装置的需求正在以各种形式增长。近来，已经使用了各种类型的平面显示装置，诸如液晶显示器(LCD)、等离子显示面板(PDP)、有机电致发光显示装置(OELD)(或有机发光二极管(OLED)显示器)和类似物。
由显示装置显示的图像在很大程度上归类为静止(例如，静态)图像和运动(例如，视频)图像。显示装置通常每秒显示多帧图像。当多个帧具有相同的图像数据时，显示装置显示观看者感知为静态图像的图像。相反，当多个帧具有不同的图像数据时，显示装置显示观看者可感知为运动图像或视频图像的图像。
通常，即使当显示面板显示静态图像(不是运动图像或视频图像)时，显示驱动集成电路(IC)也从图形处理设备为每帧接收相同的图像数据，这可会导致过量的功率被消耗。
为了降低功耗，可利用如下方法，在显示驱动IC中添加帧存储器作为其内部存储器，以便为静止图像存储图像数据并且在显示静止图像的同时将存储的图像数据供给到显示面板。这个方法可归类为面板自刷新(PSR)方法，并且在显示静止图像的同时，因为不需要从图形处理设备接收图像数据，因此可禁用图形处理设备，从而使功耗能够被降低。
然而，当显示装置通过使用PSR方法来操作时，为帧存储器增加的面积可增加，特别是当图像分辨率较高时，这可导致显示驱动IC的尺寸增加。相应地，空间和功耗可增加。
在本背景技术部分中公开的以上信息仅用于增强对本发明的背景技术的理解，并且因此，其可包含不构成现有技术的信息。
发明内容
本公开的一些示例性实施例的各方面包括显示装置，而在该显示装置中，存储器位于显示驱动IC的外面(例如，相对于显示驱动IC在外部)。
根据本公开的实施例的特征不限于上述特征，并且然而，通过下面的描述，本领域技术人员可更加清楚地理解这里未描述的其他特征。
根据本公开的一些示例性实施例的各方面可包括显示装置。该显示装置可包括：显示部，包括多个像素并且配置为显示图像；驱动控制器，包括时序控制器和驱动器，驱动器由时序控制器控制并且配置为将电信号供给到显示部；存储器部，配置为从驱动控制器接收静止图像数据并且存储静止图像数据；以及接口，配置为将驱动控制器联接到存储器部，以便传输和接收静止图像数据。驱动控制器和存储器部可实现为单独的组件。
根据一些示例性实施例，接口可通过使用差分信令方法来传输和接收静止图像数据。
根据一些示例性实施例，接口可通过使用串行方法来传输和接收命令、地址和静止图像数据。
根据一些示例性实施例，显示部可显示具有全高清(FHD)或更高的分辨率的高品质图像。
根据一些示例性实施例，接口可包括第一信道和第二信道，命令和地址可在第一间隔期间通过第一信道传输，静止图像数据可在第二间隔期间通过第二信道传输，并且第二间隔可是在第一间隔之后的间隔。
根据一些示例性实施例，接口的引脚的数量可是12。
根据一些示例性实施例，配置为传输静止图像数据的引脚的数量可是8。
根据一些示例性实施例，存储器部的资源可是64MB或更小。
根据一些示例性实施例，存储器部的功耗可是10mW或更小。
根据一些示例性实施例，存储器部可包括帧存储器，帧存储器配置为当图像处于静止状态时存储图像数据，并且在显示部显示静止图像的同时将存储的图像数据供给到驱动控制器。
根据一些示例性实施例，存储器部还可包括存储有污渍补偿数据的第一补偿存储器以及存储有包括多个像素的寿命数据的余像补偿数据的第二补偿存储器。
根据一些示例性实施例，存储器部可在驱动控制器的外面。
根据一些示例性实施例，接口可将时序控制器联接到存储器部。
根据本公开的一些示例性实施例的各方面可包括显示装置。显示装置可包括：显示面板，限定有包括配置为显示图像的多个像素的显示部，显示面板包括包含薄膜晶体管的下基板以及配置为保护下基板的多个组件的上基板；附接到下基板的柔性膜；附接到柔性膜的印刷电路板；显示驱动集成电路(IC)，配置为向显示部施加数据电压和扫描信号；以及第一存储器，位于显示驱动IC的外面并且配置为从显示驱动IC接收数据并且存储数据。
根据一些示例性实施例，显示驱动IC可以玻璃上芯片(COG)的形式安装在下基板上，并且第一存储器可安装在柔性膜或印刷电路板上。
根据一些示例性实施例，在显示装置中，第一存储器是可替换的，但不被显示驱动IC替换。
根据一些示例性实施例，污渍补偿数据可存储在第一存储器中，并且显示驱动IC可包括第二存储器，第二存储器配置为存储处于静止状态的图像数据，并且在显示部显示静止数据的同时将存储的图像数据供给到显示驱动IC。
根据一些示例性实施例，第二存储器可是显示驱动IC的内部存储器。
根据一些示例性实施例，显示装置还可包括第三存储器，第三存储器位于显示驱动IC的外面并且配置为存储多个像素的寿命数据。
根据一些示例性实施例，第一存储器和第三存储器可是单独的组件。
下面在详细描述和附图中，描述和示出了根据本公开的一些示例性实施例的进一步细节。
附图说明
图1是示出根据本公开的一些示例性实施例的显示装置的框图。
图2是示意性地示出根据本公开的一些示例性实施例的显示装置的透视图。
图3至图5是示出基于图2中所示的示例性特征的一些示例性实施例的进一步细节的透视图。
图6是示出基于图2中示出的示例性特征的一些示例性实施例的进一步细节的透视图。
图7是示出根据本公开的一些示例性实施例的显示装置的驱动控制器和存储器部的电路图。
图8是更详细地示出图7的一个信道的电路图。
图9是示出根据本公开的一些示例性实施例的在显示装置的驱动控制器与存储器部之间的每间隔数据流的时序图。
图10是示出根据本公开的一些示例性实施例的显示装置的框图。
图11是示出根据本公开的一些示例性实施例的显示装置的框图。
具体实施方式
参照后面更详细地描述的示例性实施例以及附图，根据本公开的一些示例性实施例的特征和特点以及用于实现它们的方法将变得更加清楚。然而，根据本公开的实施例可以各种形式实现而不限于后面将描述的示例性实施例，并且提供这些示例性实施例以使得本公开将更加透彻以及更加完整，并且将向本领域技术人员更加充分地传达根据本公开的实施例的范围。根据本公开的实施例应该由所附的权利要求书及其等同物的范围来限定。
将理解的是，当元件或层被称为在另外的元件或层“上”时，其可直接在另外的元件或层上，或者在中间的元件或层介入其间的情况下，元件或层可在另外的元件或层上。在整个说明书中，相同的附图标记用于指定相同的组件。
尽管术语“第一”和“第二”用于描述各种组件，但是显而易见的是，那些组件不受术语的限制。这些术语仅用于将一个组件与另一组件区分开。因此，显而易见的是，在不脱离本公开的技术精神的情况下，下面将描述的第一组件也可是第二组件。在本公开中，除非上下文另外清楚地指示，否则单数形式也旨在包括复数形式。
在下文中，将参照附图描述本公开的一些示例性实施例。在整个附图中，相同或相似的附图标记用于指定相同的组件。
图1是示出根据本公开的一些示例性实施例的显示装置1的框图。
参照图1，显示装置1包括驱动控制器10、显示部(或显示面板)20、存储器部(或存储器或者存储器组件)30和主处理器40。
本实施例涉及显示装置1，并且可应用于各种类型的电子装置，诸如有机电致发光显示(或有机发光二极管(OLED)显示)装置、液晶显示装置、等离子显示装置、场发射显示装置、电泳装置和类似物。
根据一些示例性实施例，驱动控制器10、显示部20、存储器部30和主处理器40可是显示装置1内的单独的(例如，独立的并且不同的)组件。相应地，依据显示装置1所需的单独的规格，驱动控制器10、显示部20、存储器部30和主处理器40中的每个可被相对容易地替换(和/或与具有不同规格的其他组件交换)。
主处理器40可控制驱动控制器10的整体操作。例如，主处理器40可被实现为芯片上系统，或者可是设置在移动设备中的应用处理器(AP)。
主处理器40包括第一接口IF1(例如，数据通信信道或介质)，并且可通过使用第一接口IF1来向驱动控制器10传输数据和从驱动控制器10接收数据，即直接向驱动控制器10传输数据和直接从驱动控制器10接收数据。根据一些示例性实施例，第一接口IF1可是移动工业处理器接口(MIPI)，并且可符合用于显示串行接口的MIPI联盟规范和用于D-PHY的MIPI联盟规范。然而，这仅是一个实例，并且主处理器40与驱动控制器10之间的通信接口不限于此。例如，第一接口IF1可是用于支持nHD(n-high definition)或更高的高品质图像的高速串行接口。
主处理器40可输出数据加载命令，并且输出通过补偿图像数据而获取的图像数据。根据一些示例性实施例，主处理器40可通过第一接口IF1将用于从存储器部30读取(加载)补偿数据的数据加载命令供给到驱动控制器10。驱动控制器10将数据加载命令的分组结构改变为存储器部30可解释的合适格式，并且将其供给到存储器部30。即，主处理器40可经由驱动控制器10与存储器部30间接通信。
此外，主处理器40可通过第一接口IF1将图像数据或补偿的图像数据供给到驱动控制器10。驱动控制器10可将图像数据或补偿的图像数据改变为对图像显示适合的数据信号或数据电压，并且将数据信号或数据电压供给到显示部20。
根据一些示例性实施例，驱动控制器10可以显示驱动IC的形式实现。
驱动控制器10可包括时序控制器11和由时序控制器11控制的驱动器12。
时序控制器11可通过第一接口IF1接收经处理的图像数据，从而生成用于图像显示的数据信号、栅极控制信号和数据控制信号。
驱动器12可基于数据信号和数据控制信号来生成数据电压。此外，驱动器12可基于扫描控制信号来生成扫描信号。根据一些示例性实施例，驱动器12可基于高压模拟信号来生成数据电压和扫描信号。
可从驱动器12向显示部20供给数据电压和扫描信号。显示部20可包括多个像素21并且显示图像。多个像素21中的每个可基于数据电压和扫描信号来发射光。根据一些示例性实施例，显示部20可显示具有FHD(例如1920×1080)或更高的分辨率的高品质图像。
显示装置1包括第二接口IF2，该第二接口IF2配置为将存储器部30联接到驱动控制器10，并且可通过使用第二接口IF2来直接向驱动控制器10传输数据和直接从驱动控制器10接收数据。根据一些示例性实施例，第二接口IF2可是T2M(Tcon-to-memory)接口，并且下面将参照图3进行其进一步的描述。
存储器部30可以位于显示驱动IC的外面(或相对于显示驱动IC在外部)的外部存储器的形式来实现。例如，存储器部30可以易失性存储器或非易失性存储器的形式来实现。易失性存储器可包括动态随机存取存储器(Dynamic Random Access Memory,DRAM)、移动DRAM、静态随机存取存储器(Static Random Access Memory,SRAM)、FRAM、MRAM和类似物，并且非易失性存储器可包括只读存储器(Read-Only Memory,ROM)、NOR闪存、NAND闪存、相变随机存取存储器(Resistive Random Access Memory,PRAM)、电阻式随机存取存储器(Resistive Random Access Memory,RRAM)、自旋转移扭矩随机存取存储器(Spin-Transfer Torque Random Access Memory,STTRAM)、磁性随机存取存储器(MagneticRandom Access Memory,MRAM)和类似物。
根据一些示例性实施例，存储器部30可包括帧存储器31、存储有污渍补偿数据的第一补偿存储器32、存储有包括多个像素21的寿命数据的余像补偿数据的第二补偿存储器33和类似物。存储器部30中的帧存储器31、第一补偿存储器32和第二补偿存储器33可通过块来区分。
帧存储器31从驱动控制器10接收图像数据并且将其存储，而该图像数据将被输入到驱动控制器10。例如，帧存储器31存储静止图像的图像数据，并且可在显示静止图像的同时将存储的图像数据供给到驱动控制器10。
当显示部20显示运动(例如，视频)图像时，可不使用帧存储器31。当显示部20显示静止(或静态)图像时，输入图像数据存储在帧存储器31中，并且存储在帧存储器31中的图像数据可输出到显示部20。帧存储器31可通过驱动控制器10将存储的图像数据输出到显示部20。
根据一些示例性实施例，帧存储器31可包括驱动频率选择器，该驱动频率选择器配置为当显示部20显示运动图像时选择第一频率，并且当显示部20显示静止图像时选择第二频率。当显示运动图像时，输入图像数据从驱动控制器10接收，并以第一频率输出到显示部20。当显示静止图像时，存储的图像数据从帧存储器31接收，并以第二频率输出到显示部20。这里，第二频率可具有比第一频率低的值。
例如，第一频率可是60赫兹(Hz)，而该60赫兹指示通过每秒播放(或显示)60帧来显示图像。此外，第二频率可是10Hz，而10Hz指示通过每秒播放(或显示)10帧来显示图像。在这种情况下，当显示静止图像时，消耗的功率可降低到当显示运动图像时消耗的功率的约1/6。相应地，当显示静止图像时，频率设置为等于或小于当显示运动图像时设置的频率的一定百分比，并且由此，功耗可降低的量多于通过增加帧存储器31而增加的消耗的功率的量。
当在运动图像的显示期间将频率设置为低的时，观看者可感知图像的运动为不自然的或劣化的。但是，当显示静止图像时，因为具有相同图像数据的帧被重复显示，因此即使将频率设置为低的，观看者也可未感知任何不自然或劣化的图像品质。但是，当频率为低的时，闪烁可被增加。因此，可期望仅将频率降低到闪烁对用户是视觉上无法检测到或无法感知的程度。
在第一补偿存储器32中，可存储污渍补偿数据。
当像素21包括诸如有机发光二极管的发光元件时，依据驱动时间和驱动电流的量，像素21可随时间劣化。当像素21劣化时，像素21的亮度可降低，并且由此，显示品质可降低或者可出现余像。用于补偿像素21的劣化的污渍补偿数据可存储在第一补偿存储器32中。
在第二补偿存储器33中，可存储对每个像素21的寿命数据。
当像素21包括诸如有机发光二极管的发光元件时，因为多个元件单独地发光，因此多个元件中的每个使用的频率可不同，并且由此，多个元件的寿命可彼此不同。相应地，即使元件输出与由与其相邻的另外的元件输出的数据相同的数据，其也发射具有较低亮度的光，并且不同的亮度可在屏幕上造成余像。通过依据像素21的寿命的补偿，可稍微减少余像。对于补偿，每个像素21的寿命数据可存储在第二补偿存储器33中。
因为存储器部30位于驱动控制器10的外面，所以存储器部30可具有低资源。例如，存储器部30的资源可等于或小于大约64MB。
图2是示意性地示出根据本公开的一些示例性实施例的显示装置1的透视图。图3至图5是示出基于图2中所示的示例性特征的一些示例性实施例的进一步细节的透视图。图6是示出基于图2中示出的示例性特征的一些示例性实施例的进一步细节的透视图。
参照图2，显示装置1包括显示面板110、柔性膜140和印刷电路板(PCB)150，而在显示面板110中，限定有配置为显示图像的显示部20。在下文中，为了解释的便利，将通过利用有机电致发光(或OLED)显示装置来在显示装置1的上下文中描述显示装置1的进一步细节，但是如上所讨论的，实施例不限于此。在本领域中具有普通技术的人员将认识到，在不脱离根据本发明的实施例的精神和范围的情况下，可利用各种其他显示装置。
显示面板110包括下基板111和上基板112。下基板111可是由塑料或玻璃形成的薄膜晶体管基板。下基板111可包括联接到薄膜晶体管的发光元件。
上基板112可是由塑料膜、玻璃基板或保护膜形成的封装基板或窗口基板。上基板112可起到保护包括在下基板111中的元件免受外部湿气或空气的影响的作用。
根据一些示例性实施例，配置为显示图像的显示区域和围绕显示区域的非显示区域可在下基板111中由多个像素21限定。显示区域是设置有像素21的区域，以便显示图像。施加有扫描信号的扫描线、施加有数据电压的数据线以及施加有功率信号的线可位于下基板111中。
通过使用膜上芯片(COF)方法或塑料上芯片(COP)方法，可设置柔性膜140。膜上芯片可包括诸如聚酰亚胺的基膜以及设置在基膜上的多个导电引线。柔性膜140可被扭曲或被弯折。柔性膜140可附接到显示面板110的下基板111和印刷电路板150。
根据一些示例性实施例，显示驱动IC 130的形式的驱动器12可安装在柔性膜140上。通过使用各向异性导电膜(Anisotropic Conductive Film，ACF)，柔性膜140可通过使用胶带自动接合(Tape Automated Bonding，TAB)方法来附接到设置在下基板111上的焊盘。焊盘联接到扫描线和数据线，并且由此，驱动器12可电联接到扫描线和数据线。
印刷电路板150可附接到柔性膜140。外部存储器160的形式的存储器部30可安装在印刷电路板150上。印刷电路板150可是柔性印刷电路板(FPCB)。
然而，安装有驱动控制器10和存储器部30的位置不限于图中所示的那些。如图3至图5中所示，驱动控制器10和存储器部30中的每个可位于印刷电路板150和柔性膜140中的任何一个上。
此外，如图6中所示，可通过使用玻璃上芯片(COG)方法来将驱动控制器10安装在下基板111上。例如，下基板111可由柔性塑料材料形成。例如，下基板111可由选自集群中的任何一个来形成，而该集群包括Kapton、聚醚砜(PES)、聚碳酸酯(PC)、聚酰亚胺(PI)、聚对苯二甲酸乙二醇酯(PET)、聚萘二甲酸乙二醇酯(PEN)、聚丙烯酸酯(PAR)、纤维增强塑料(FRP)和类似物。
接下来，将描述驱动控制器10和存储器部30之间的接口。该接口对应于上述的第二接口(图1中的IF2)。
图7是示出根据本公开的一些示例性实施例的显示装置的驱动控制器和存储器部的电路图。图8是更详细地示出图7的一个信道的电路图。图9是示出根据本公开的一些示例性实施例的在显示装置的驱动控制器与存储器部之间的每间隔数据流的时序图。
参照图7至图9，驱动控制器10和存储器部30可通过第二接口IF2传输和接收数据。例如，驱动控制器10的时序控制器11可向存储器部30的多个存储设备传输数据和从存储器部30的多个存储设备接收数据。根据一些示例性实施例，数据可包括在帧存储器31和时序控制器11之间传输和接收的静止图像数据。驱动控制器10和存储器部30可实现并行链接系统，而通过该并行链接系统，它们通过第二接口IF2经由多个信道来联接。
在下文中，描述了驱动控制器10起到传输器的作用和存储器部30起到接收器的作用的示例，但是存储器部30可起到传输器的作用以及驱动控制器10可起到接收器的作用，或者存储器部30和驱动控制器10可在它们之间传输和接收数据。因此，可对其应用下面的描述。
通过第二接口IF2从驱动控制器10传输到存储器部30的数据可是差分信号。当从驱动控制器10传输到存储器部30的信号是差分信号时，存储器部30可接收从驱动控制器10传输的一对传输信号，感测这对传输信号之间的电压差，并且以差分输入模式和用于恢复接收到的信号的伪差分输入模式中的任何一种操作。
第二接口IF2可包括多个信道CH1至CHn。多个信道CH1至CHn中的至少一个可用于传输差分信号。第二接口IF2可包括用于传输数据信号和差分信号的第一引脚Pin1和用于传输单端信号的第二引脚Pin2。这里，引脚指示配置信道CH的一个端部的端子。用于以差分输入模式和伪差分输入模式来传输信号的引脚可包括两个输入端子或输出端子。用于通过使用单端信令方法来传输信号的引脚可包括一个输入端子或输出端子。图8中所示的输入电阻Rn指示第一引脚Pin1联接到的输入端子的等效电阻。
根据一些示例性实施例，第二接口IF2可包括12个引脚。即，第二接口IF2可包括12个信道CH1至CHn。例如，第一引脚Pin1的数量可是8，并且第二引脚Pin2的数量可是4。然而，第二接口IF2对引脚数量没有限制。
第一引脚Pin1可以如上所描述的差分输入模式和伪差分输入模式中的任何一个传输信号。第二引脚Pin2可基于单端信令方法来传输信号。多个第二引脚Pin2可包括配置为从驱动控制器10向存储器部30传输辅助信号AUX的至少一个引脚以及配置为传输时钟CLK的至少一个引脚。
依据联接到存储器部30的驱动控制器10的信号传输模式来设置存储器部30的操作模式。例如，当驱动控制器10以诸如第三代双倍数据速率同步DRAM(double data rate3synchronous DRAM，DDR3)的伪差分信令模式操作时，存储器部30设置为差分模式，从而以伪差分模式操作。当驱动控制器10以差分信令模式(诸如低功率双倍数据速率同步DRAM(low-power double data rate synchronous DRAM，LPDDR)、低压差分信令(low-voltagedifferential signaling，LVDS)、串行高级技术附件(serial advanced technologyattachment，S-ATA)或移动工业处理器接口(Mobile Industry Processor Interface，MIPI))操作时，存储器部30可设置为差分模式。
根据一些示例性实施例，两个输入电压可同时输入到第一引脚Pin1。可依据两个输入电压之间的电压差来传输信息。第一引脚Pin1用于高速差分信号，并且具有为一对传输线设置的单一单位的带宽，并且可以并行添加传输线。例如，单一单位可具有在约0.90Gbps至约6.00Gbps范围内的比特率。然而，根据本发明的实施例的单一单位不限于上述比特率。
在任何单位间隔1ui中，任何一个输入电压可具有第一逻辑电平LL1，并且另外的输入电压可具有第二逻辑电平LL2。
根据一些示例性实施例，第一逻辑电平LL1和第二逻辑电平LL2可代表不同的信号，而其幅度具有相同的绝对值但是不同的符号。例如，第一逻辑电平LL1可对应于p型信号，并且第二逻辑电平LL2可对应于n型信号。
驱动控制器10的输出差分信号的一个驱动信号输出部TX和存储器部30的被供给差分信号的一个感测信号输入部RX通过至少两条线彼此联接。
通过成对的线彼此联接的多个驱动信号输出部TX1至TXn中的一个和多个感测信号输入部RX1至RXn中的对应的一个可具有相同的输入/输出结构。相应地，驱动控制器10与存储器部30之间的双向通信是可能的。
根据一些示例性实施例，当传输和接收差分信号时，可减少由外部噪声引起的干扰，并且与传输和接收单端信号时相比，长距离信号传输可更容易。此外，可减少存储器部30消耗的功率。例如，当传输和接收差分信号时，存储器部30消耗的功率可是传输和接收单端信号时的功率的约1/18，如下面的等式(1)中所示：
Figure BDA0002668813750000121
这里，P1表示传输和接收差分信号时的功耗，P2表示传输和接收单端信号时的功耗，αT表示信号转换率(数据切换率)，CL表示线电容，Vswing表示差分信号电压电平，并且F表示频率。
因为当差分信号用于静止图像数据的传输时的电压电平约为使用单端信号时的电压电平的1/6，所以功耗可降低到约1/18。例如，第二接口IF2消耗的功率可降低到约10mW或更小。
根据一些示例性实施例，第二接口IF2可通过使用串行方法来传输命令、地址和图像数据DATA。例如，在第一间隔T1期间，可通过第一信道CH1来传输命令和地址。在传输命令和地址之后，可在第二间隔T2期间通过第二信道CH2来传输图像数据DATA。这里，第二间隔T2可是在第一间隔T1之后的间隔。此外，可重复第一间隔T1和第二间隔T2。为了描述的便利，第一信道CH1和第二信道CH2是第二接口IF2的示例性信道。
同时，当通过使用串行方法传输图像数据DATA时，第一间隔T1可用作基于第二间隔T2的延迟时间。然而，当图像数据DATA的分组大小等于或大于特定水平时，延迟时间几乎等于通过使用并行方法来执行传输时的延迟时间。当传输和接收高分辨率的图像数据DATA(例如，具有FHD或更高分辨率的图像数据)时，即使通过使用串行方法来传输图像数据DATA，延迟时间也可几乎等于通过使用并行方法来传输数据时的延迟时间。
接下来，将描述根据一些示例性实施例的显示装置的进一步的细节。在下文中，可省略图1至图9中相同的组件的描述，并且将因此使用相同或相似的附图标记。
图10是示出根据本公开的一些示例性实施例的显示装置2的框图。
参照图10，根据本实施例的显示装置2与根据图1的实施例的显示装置1的不同之处在于，帧存储器31包括在驱动控制器10_1中，而不在存储器部30_1中。
存储器部30_1可包括第一补偿存储器32和第二补偿存储器33。根据一些示例性实施例，帧存储器31可以驱动控制器10_1的内部存储器的形式实现。
图11是示出根据本公开的一些示例性实施例的显示装置3的框图。
参照图11，根据本实施例的显示装置3与根据图10的实施例的显示装置2的不同之处在于，第一补偿存储器32和第二补偿存储器33实现为单独的组件。
显示装置3可包括包含第一补偿存储器32的第一存储器部30_2和包括第二补偿存储器33的第二存储器部30_3，而第一存储器部30_2和第二存储器部30_3实现为单独的组件。
根据本公开的一些示例性实施例，因为配置显示装置以使得存储器位于显示驱动IC的外面(例如，相对于显示驱动IC在外部)，所以可减小显示驱动IC的尺寸，从而使死区能够被降低。
此外，根据本公开的一些示例性实施例，因为配置显示装置以使得存储器位于显示驱动IC的外面(例如，相对于显示驱动IC在外部)，从而使功耗能够被降低。
根据本公开的示例性实施例的特征不受前述限制。
尽管已经公开了本公开的示例性实施例，但是本领域技术人员将意识到，可以其他具体形式来实现本公开，而不脱离如在所附权利要求及其等同物中公开的本公开的技术精神或范围。因此，应当理解，上述实施例在所有方面仅是示例，而不是限制性的。

Claims (10)

1.一种显示装置，包括：
显示面板，包括多个像素并且配置为显示图像；
驱动控制器，包括时序控制器和由所述时序控制器控制的驱动器，所述驱动控制器配置为将电信号供给到所述显示面板；
存储器，配置为从所述驱动控制器接收静止图像数据并且存储所述静止图像数据；以及
接口，配置为将所述驱动控制器联接到所述存储器，以便传输和接收所述静止图像数据，
其中，所述驱动控制器和所述存储器是独立的单独的组件。
2.根据权利要求1所述的显示装置，其中，所述接口配置为通过使用差分信令方法来传输和接收所述静止图像数据。
3.根据权利要求1所述的显示装置，其中，所述接口配置为通过使用串行方法来传输和接收命令、地址和所述静止图像数据。
4.根据权利要求3所述的显示装置，其中，
所述接口包括第一信道和第二信道，
所述第一信道配置为在第一间隔期间传输所述命令和所述地址；
所述第二信道配置为在第二间隔期间传输所述静止图像数据；并且
所述第二间隔是在所述第一间隔之后的间隔。
5.根据权利要求1所述的显示装置，其中，所述存储器包括帧存储器，所述帧存储器配置为当所述图像处于静止状态时存储图像数据并且在所述显示面板显示静止图像的同时将存储的所述图像数据供给到所述驱动控制器。
6.根据权利要求5所述的显示装置，其中，所述存储器包括：
第一补偿存储器，污渍补偿数据存储在所述第一补偿存储器中；以及
第二补偿存储器，包括所述多个像素的寿命数据的余像补偿数据存储在所述第二补偿存储器中。
7.根据权利要求1所述的显示装置，其中，所述存储器相对于所述驱动控制器在外部。
8.根据权利要求1所述的显示装置，其中，所述接口将所述时序控制器联接到所述存储器。
9.一种显示装置，包括：
包括配置为显示图像的多个像素的显示面板，所述显示面板包括下基板以及配置为保护所述下基板的多个组件的上基板，所述下基板包括薄膜晶体管；
附接到所述下基板的柔性膜；
附接到所述柔性膜的印刷电路板；
配置为向所述显示面板施加数据电压和扫描信号的显示驱动集成电路；以及
相对于所述显示驱动集成电路在外部的并且配置为从所述显示驱动集成电路接收数据以及存储所述数据的存储器。
10.根据权利要求9所述的显示装置，其中，所述存储器是可替换的，但无需所述显示驱动集成电路替换的替换。
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