CN111312177B - Goa驱动电路、显示面板及显示装置 - Google Patents

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Abstract

本申请公开了一种GOA驱动电路、显示面板及显示装置，该GOA驱动电路包括多个级联的GOA单元，其中，GOA单元包括输出控制模块，稳压模块，第一下拉模块，第二下拉模块，第三下拉模块，第四下拉模块，用于根据恒压高电位信号控制GOA驱动电路进行正向扫描的正向扫描控制模块，用于控制GOA驱动电路在非工作阶段输出低电位的栅极驱动信号的节点信号控制模块，以及用于根据下一级GOA单元的栅极驱动信号，在第一节点处于充电阶段时维持第二节点的电平的开关模块。本申请通过采用较少的薄膜晶体管，并且只需用到2个CK信号，减少了信号线数量，极大地降低GOA宽度，实现窄边框的设计。制程风险和稳定性也得到提高，使得效率和稳定性提高。

Description

GOA驱动电路、显示面板及显示装置
技术领域
本申请涉及显示驱动技术领域，更具体地说，涉及一种GOA驱动电路、显示面板及显示装置。
背景技术
当今社会科技迅猛发展，手机、电脑和电视等电子产品广泛应用于生活中的各个方面。因此，液晶显示面板和OLED显示面板等电子显示屏被广泛采用，而Gate Driver OnArray(GOA)电路是显示面板中的一个重要组成部分。它是在阵列基板上制作薄膜晶体管(TFT)作为开关，从而将栅级驱动制作在阵列基板上，实现栅极的逐行扫描。
根据面板内采用的薄膜晶体管(TFT)类型，可以分为NMOS型，PMOS型，以及CMOS。类似的，根据采用的TFT类型，GOA电路分为NMOS电路，PMOS电路以及CMOS电路。比于CMOS电路，NMOS电路无需进行P掺杂这一工序，对于提高良率以及降低成本都大有裨益，因此开发稳定的NMOS电路成为广大研发人员的共同目标。
随着全面屏成为一种潮流趋势，这就对手机，平板电脑和电视等的边框提出了越来越高的要求，因此压缩GOA的宽度成为降低左右border的一种常见手段。
在实现过程中，发明人发现传统技术中至少存在如下问题：传统的GOA电路结构复杂，GOA宽度大，GOA的宽度压缩率低。
发明内容
基于此，有必要传统的GOA电路结构复杂，GOA宽度大，GOA的宽度压缩率低的问题，提供一种GOA驱动电路、显示面板及显示装置。
为了实现上述目的，本发明实施例提供了一种GOA驱动电路，包括多个级联的GOA单元，其中，GOA单元包括：
正向扫描控制模块，用于根据恒压高电位信号控制GOA驱动电路进行正向扫描；
节点信号控制模块，用于控制GOA驱动电路在非工作阶段输出低电位的栅极驱动信号；
输出控制模块，用于根据本级时钟信号控制本级栅极驱动信号的输出；
稳压模块，用于维持第一节点的电平；
第一下拉模块，用于下拉第一节点的电平；
第二下拉模块，用于下拉第二节点的电平；
第三下拉模块，用于下拉本级GOA单元的栅极驱动信号的电平；
第四下拉模块，用于根据全局信号在GOA驱动电路处于工作阶段时下拉本级栅极驱动信号的电平；
开关模块，电性连接在第三下拉模块与节点信号控制模块之间，用于根据下一级GOA单元的栅极驱动信号，在第一节点处于充电阶段时维持第二节点的电平。
在其中一个实施例中，GOA单元还包括：
第一电容，用于存储第一节点的电荷；第一电容的一端与第一节点连接，第一电容的另一端用于接入恒压低电位信号；
其中，第一节点为正向扫描控制模块与稳压模块之间的连接点。
在其中一个实施例中，开关模块包括第十五薄膜晶体管；
第十五薄膜晶体管的源极与第二节点连接，漏极与第三下拉模块连接，栅极用于接入下一级GOA单元的栅极驱动信号；
其中，第二节点为节点信号控制模块、开关模块和第二下拉模块之间的连接点。
在其中一个实施例中，正向扫描控制模块包括第一薄膜晶体管；第一薄膜晶体管的栅极用于接入上一级GOA单元的栅极驱动信号，源极接入正向直流扫描控制信号，漏极与稳压模块连接；
节点信号控制模块包括第八薄膜晶体管；第八薄膜晶体管的栅极用于接入下一级时钟信号，源极接入恒压高电位信号，漏极与第二节点连接。
在其中一个实施例中，第二下拉模块包括第六薄膜晶体管；
第六薄膜晶体管的栅极与第一薄膜晶体管的漏极连接，源极接入恒压低电位信号，漏极与第二节点连接。
在其中一个实施例中，第一下拉模块包括第五薄膜晶体管；
第五薄膜晶体管的栅极与第三下拉模块连接，漏极与第一节点连接，源极接入恒压低电位信号。
在其中一个实施例中，输出控制模块包括第九薄膜晶体管；
第九薄膜晶体管的栅极与稳压模块连接，源极接入本级时钟信号，漏极与第三下拉模块连接。
在其中一个实施例中，第四下拉模块包括第十四薄膜晶体管；
第十四薄膜晶体管的栅极用于接入全局信号的漏极连接，源极接入恒压低电位信号，漏极与输出控制模块的漏极连接。
另一方面，本发明实施例还提供了一种显示面板，包括如上述任意一项的GOA驱动电路。
另一方面，本发明实施例还提供了一种显示装置，包括如上述的显示面板。
上述技术方案中的一个技术方案具有如下优点和有益效果：
上述的GOA驱动电路的各实施例中，无需增加反向扫描控制模块、上拉模块和复位模块，只需要采用2个CK信号即可完成正常级传工作，同时简化了GOA驱动电路，进一步降低了GOA宽度，进而能够实现窄边框。其中，第一CK信号用于拉高第一节点电位，第二CK信号用于拉高第二节点电位。通过增加开关模块，进而能够避免第一节点充电阶段，与第二节点发生竞争冲突，能够实现第二节点与第一节点充电阶段错开，互不影响。本申请通过采用较少的薄膜晶体管，并且只需用到2个CK信号，减少信号线数量，极大地降低GOA宽度，实现窄边框的设计。制程风险和稳定性也得到提高，使得效率和稳定性提高。
附图说明
下面将结合附图及实施例对本申请作进一步说明，附图中：
图1为传统GOA电路的结构示意图；
图2为传统GOA电路中的第N级GOA单元的结构示意图；
图3为传统GOA电路中的第N+2级GOA单元的结构示意图；
图4为传统4CK架构的显示面板的GOA电路的时序图；
图5为一个实施例中GOA驱动电路的第一结构示意图；
图6为一个实施例中GOA驱动电路的第二结构示意图。
具体实施方式
以下各实施例的说明是参考附加的图示，用以例示本申请可用以实施的特定实施例。本申请所提到的方向用语，例如[上]、[下]、[前]、[后]、[左]、[右]、[内]、[外]、[侧面]等，仅是参考附加图式的方向。因此，使用的方向用语是用以说明及理解本发明，而非用以限制本发明。在图中，结构相似的单元是用以相同标号表示。
为了对本申请的技术特征、目的和效果有更加清楚的理解，现对照附图详细说明本申请的具体实施方式。
如图1所示，传统的GOA电路为14T2C架构(包括14个薄膜晶体管(NT1-NT14)和2个电容(C1和C2))。其中，薄膜晶体管NT1-NT10、两个电容及其网络，构成基本电路工作架构；薄膜晶体管NT11和薄膜晶体管NT12构成在All gate On模块(即上拉模块)；薄膜晶体管NT13构成All Gate Off模块(第四下拉模块)；NT14构成Reset模块(即复位模块)；薄膜晶体管NT1和薄膜晶体管NT2构成正反向扫描控制模块，具有正反扫功能，正向扫描控制信号U2D为高电平，反向扫描控制信号D2U为低电平则由上向下逐行扫描，反之，正向扫描控制信号U2D为低电平，反向扫描控制信号D2U为高电平，则由下向上逐行扫描。
具体地，该电路包括m个级联的GOA单元，第n级GOA单元包括：正反向扫描控制模块100、节点信号控制模块200、输出控制模块300、稳压模块400、第一下拉模块500、第二下拉模块600、第三下拉模块700、第四下拉模块800、上拉模块900、复位模块110以及第一电容C1和第二电容C2，其中m≥n≥1。
正反向扫描控制模块100，用于根据正向扫描控制信号U2D或反向扫描控制信号D2U控制GOA电路进行正向扫描或反向扫描。节点信号控制模块200，用于根据第n+1级时钟信号CK(n+1)和第n-1级时钟信号CK(n-1)控制本级GOA单元在非工作阶段输出低电位的栅极驱动信号；输出控制模块300，用于根据本级时钟信号CK(n)控制本级栅极驱动信号的输出；稳压模块400，用于维持第一节点Q的电平；第一下拉模块500，用于下拉所述第一节点Q的电平；第二下拉模块600，用于下拉第二节点P的电平；第三下拉模块700，用于下拉本级栅极驱动信号G(n)的电平；第四下拉模块800用于根据第二全局信号GAS2在显示面板处于第二工作状态时下拉本级栅极驱动信号G(n)的电平。上拉模块900、用于根据第一全局信号GAS1在显示面板处于第一工作状态时控制本级GOA单元输出高电平的栅极驱动信号。复位模块110，用于根据复位信号对第二节点进行复位。第一工作状态为黑屏触控工作期间或者异常断电时。可以理解的，当显示面板处于第一工作状态时，第一全局信号GAS1为高电平，所有GOA单元都输出高电平的栅极驱动信号。第二工作状态为显示触控工作期间，此时第二全局信号GAS2为高电平。
当显示面板处于正向扫描状态时，U2D为高电平，D2U为低电平，此时GOA电路则由上向下逐行扫描。反之，当显示面板处于反向扫描状态时，U2D为低电平，D2U为高电平，此时GOA电路则由下向上逐行扫描。
当显示面板为4CK架构时，GOA驱动架构可以采用Interlace(交错)架构或者双驱架构，GOA电路以2个基本单元为最小重复单元进行循环。如图2和3所示，第n级GOA单元和第n+2级GOA单元可以共同构成一个GOA重复单元。结合图4，GOA电路中共有4个时钟信号CK；第1时钟信号CK1至第4条时钟信号CK4，当第n级GOA单元的第n级时钟信号为第1时钟信号CK1时，第n级GOA单元的第n+1级时钟信号为第2时钟信号CK2，第n级GOA单元的第n-1级时钟信号为第4时钟信号CK4，当第n+2级GOA单元的第n级时钟信号为第3时钟信号CK3时，第n+2级GOA单元的第n+1级时钟信号为第4时钟信号，第n+2级GOA单元的第n-1级时钟信号为第2时钟信号。可以理解的，如果第n级GOA单元的节点信号控制模块200对应接入的是第2和第4时钟信号，输出控制模块300接入的是第1时钟信号，那么第n+1级GOA单元的节点信号控制模块200接入的就是第1条和第3条时钟信号，输出控制模块300接入的是第2时钟信号。
需要说明的是，4个CK信号的占空比可以是25％或以下；显示面板也可使用6CK或8CK架构，最小重复单元为3或4个基本单元，基本原理与4CK架构的类似。
图4所示为4CK架构的显示面板对应的GOA电路的时序图；STVL、STVR为启动信号，第一全局信号GAS1和第二全局信号GAS2在显示面板正常工作时都为低电平。第二全局信号GAS2在显示期间T1(显示期间)转换为触控期间T2(触控期间)由低电平变为高电平。进一步的，第一全局信号GAS1在TP Term期间(即T2期间)在低电平信号上叠加一个高电平信号，第二全局信号GAS2在TP Term期间(即T2期间)在高电平信号上叠加一个高电平信号。
其中GATE_1至GATE_4分别表示第1至4条扫描信号，分别对应第1至4级GOA单元的栅极驱动信号。
可以理解的，如果第1级GOA单元的输出控制模块300接入的是第1时钟信号，第2级GOA单元输出控制模块300接入的是第2时钟信号。第3级GOA单元的输出控制模块300接入的是第3时钟信号，第4级GOA单元输出控制模块300接入的是第4时钟信号，因此当CK1为高点平时，G(1)为高电平，因而GATE_1也为高电平。其余GATE_2与GATE_4与此类似。
如图1所示，在TP Term期间，扫描线暂停输入扫描信号，也即暂停处对应扫描线的GOA单元暂停输出，此时该GOA单元的G(n-2)以及U2D为高电平，Q点处于高电位，然而虽然薄膜晶体管NT2处于断开状态，但是也会存在一定的漏电流，降低了GOA电路的级传稳定性，影响了GOA单元的工作稳定性。
可知，传统GOA电路，除了正常GOA级传功能外，还具有具体复位功能的复位模块，异常断电(Abnormal Power Off，APO)模式，以及TP器件的All gate off模式。但是这个GOA架构所采用的TFT数量较多，并且CK信号线数量也较多，进而GOA电路结构复杂，GOA宽度大，GOA的宽度压缩率低。
为了传统的GOA电路结构复杂，GOA宽度大，GOA的宽度压缩率低的问题。在一个实施例中，如图5所示，提供了一种GOA驱动电路，包括多个级联的GOA单元，其中，GOA单元包括：
正向扫描控制模块510，用于根据恒压高电位信号VGH控制GOA驱动电路进行正向扫描；
节点信号控制模块520，用于控制GOA驱动电路在非工作阶段输出低电位的栅极驱动信号；
输出控制模块530，用于根据本级时钟信号CK(n)控制本级栅极驱动信号的输出；
稳压模块540，用于维持第一节点的电平；
第一下拉模块550，用于下拉第一节点的电平；
第二下拉模块560，用于下拉第二节点的电平；
第三下拉模块570，用于下拉本级GOA单元的栅极驱动信号的电平；
第四下拉模块580，用于根据全局信号在GOA驱动电路处于工作阶段时下拉本级栅极驱动信号的电平；
开关模块590，电性连接在第三下拉模块570与节点信号控制模块520之间，用于根据下一级GOA单元的栅极驱动信号，在第一节点处于充电阶段时维持第二节点的电平。
具体地，基于正向扫描控制模块510连接稳压模块540的输入端，稳压模块540的输出端连接输出控制模块530的控制端；节点信号控制模块520连接开关模块590的输入端，开关模块590的输出端连接第三下拉模块570的控制端；第三下拉模块570的输入端用于接入低电位信号VGL，输出端连接输出控制模块530的输出端；第二下拉模块560的控制端连接正向扫描控制模块510，输入端用于接入低电位信号VGL，输出端连接节点信号控制模块520；第一下拉模块550的控制端连接第三下拉模块570的控制端，输入端用于接入低电位信号VGL，输出端连接正向扫描控制模块510；第四下拉模块580的控制端用于接入全局信号GAS2，输入端用于接入低电位信号VGL，输出端连接输出控制模块530的输出端。
正向扫描控制模块510根据恒压高电位信号VGH控制GOA驱动电路进行正向扫描，通过节点信号控制模块520来控制GOA驱动电路在非工作阶段输出低电位的栅极驱动信号；稳压模块540用来维持第一节点的电平；第一下拉模块550用来下拉第一节点的电平；第二下拉模块560用来下拉第二节点的电平；第三下拉模块570用来下拉本级GOA单元的栅极驱动信号的电平；第四下拉模块580用来根据全局信号在GOA驱动电路处于工作阶段时下拉本级栅极驱动信号的电平；开关模块590用来根据下一级GOA单元的栅极驱动信号，在第一节点处于充电阶段时维持第二节点的电平；进而输出控制模块540根据本级时钟信号控制本级栅极驱动信号的输出，实现GOA单元的正常级传工作。
进一步的，由于在显示面板实际使用过程中极少发生异常断电的现象，并且异常断电时开机会重新复位，画面正常显示，不影响正常的GOA功能。上述实施例中，无需增加上拉模块，进而精简了GOA电路。
在显示面板实际使用过程中，只需要从一个方向进行扫描，通常GOA开启都是从面板上部到下部的逐行开启，反扫功能更多用于检测的时候，或正扫模块发生异常，用于替代正扫。上述实施例中，无需增加反向扫描控制模块，进而进一步的简化电路架构，实现窄边框。
在显示面板实际使用过程中，复位模块只在第一帧的时候起作用，后面显示的时候各个节点会自动复位，因此实际作用较小，上述实施例中，无需增加反向扫描控制模块，进而可进一步的简化GOA电路。
上述的GOA驱动电路的各实施例中，无需增加反向扫描控制模块、上拉模块和复位模块，只需要采用2个CK信号即可完成正常级传工作，降低了使用的信号线数量，同时简化了GOA驱动电路，进一步降低了GOA宽度，进而能够实现窄边框。其中，第一CK信号用于拉高第一节点电位，第二CK信号用于拉高第二节点电位。通过增加开关模块，进而能够避免第一节点充电阶段，与第二节点发生竞争冲突，能够实现第二节点与第一节点充电阶段错开，互不影响。本申请通过采用较少的薄膜晶体管，并且只需用到2个CK信号，减少了信号线数量，极大地降低GOA宽度，实现窄边框的设计。制程风险和稳定性也得到提高，使得效率和稳定性提高。
在一个示例中，GOA单元还包括第一电荷存储模块，其中，第一电荷存储模块的一端与第一节点连接，另一端用于接入低电位信号。第一电荷存储模块可用来存储第一节点的电荷。
在一个示例中，GOA单元还包括第二电荷存储模块，其中，第二电荷存储模块的一端连接在第一下拉模块与第三下拉模块之间，另一端用于接入低电位信号。第一电荷存储模块可用来存储第二节点的电荷。
在一个实施例中，如图6所示，提供了一种GOA驱动电路，包括多个级联的GOA单元，其中，GOA单元包括正向扫描控制模块610，节点信号控制模块620，输出控制模块630，稳压模块640，第一下拉模块650，第二下拉模块660，第三下拉模块670，第四下拉模块680，以及电性连接在第三下拉模块670与节点信号控制模块620之间开关模块690。GOA单元还包括第一电容C1；第一电容C1可用于存储第一节点的电荷；第一电容C1的一端与第一节点连接，第一电容C1的另一端用于接入恒压低电位信号VGL。其中，第一节点Q为正向扫描控制模块610与稳压模块340之间的连接点。
具体地，基于第一电容C1的一端连接第一节点，第一电容C1的另一端用于接入恒压低电位信号VGL，进而第一电容C1可存储第一节点的电荷，第一电容C1还可用来向第一节点供电，有利于GOA单元的G(n)输出。
在一个实施例中，如图6所示，开关模块690包括第十五薄膜晶体管NT15；第十五薄膜晶体管NT15的源极与第二节点连接，漏极与第三下拉模块670连接，栅极用于接入下一级GOA单元的栅极驱动信号。其中，第二节点(P)为节点信号控制模块620、开关模块690和第二下拉模块660之间的连接点。
其中，第十五薄膜晶体管NT15可以是NMOS(N-Metal-Oxide-Semiconductor，N型金属-氧化物-半导体)型TFT(Thin Film Transistor，薄膜晶体管)器件。
具体地，基于第十五薄膜晶体管NT15的源极与第二节点连接，第十五薄膜晶体管NT15的漏极与第三下拉模块670连接，第十五薄膜晶体管NT15的栅极接入下一级GOA单元的栅极驱动信号G(n+1)，由于第十五薄膜晶体管NT15的栅极是由G(n+1)控制，从而能够实现第二节点与第一节点充电阶段错开，互不影响，且在本级级传之后，再拉高第二节点。
上述实施例中，通过增加了一个第十五薄膜晶体管，进而可通过第十五薄膜晶体管控制第二节点的上拉，避免与第一节点的充电阶段发生冲突。
在一个实施例中，如图6所示，正向扫描控制模块610包括第一薄膜晶体管NT1；第一薄膜晶体管NT1的栅极用于接入上一级GOA单元的栅极驱动信号G(n-1)，源极接入正向直流扫描控制信号VGH，漏极与稳压模块连接。
其中，第一薄膜晶体管NT1可以是NMOS型TFT器件。
具体地，基于第一薄膜晶体管NT1的栅极接入上一级GOA单元的栅极驱动信号G(n-1)，第一薄膜晶体管NT1的源极接入正向直流扫描控制信号VGH，第一薄膜晶体管NT1的漏极与稳压模块640连接，进而能够实现面板上部到下部的逐行扫描开启，简化了GOA驱动电路结构，在不影响正常的GOA功能，同时进一步的降低了GOA的宽度。
在一个实施例中，如图6所示，节点信号控制模块620包括第八薄膜晶体管NT8；第八薄膜晶体管NT8的栅极用于接入下一级时钟信号(CK(n+1))，源极接入恒压高电位信号(VGH)，漏极与第二节点连接。
其中，第八薄膜晶体管NT8可以是NMOS型TFT器件。
具体地，基于第八薄膜晶体管NT8的栅极用于接入下一级时钟信号(CK(n+1))，第八薄膜晶体管NT8的源极接入恒压高电位信号(VGH)，第八薄膜晶体管NT8的漏极与第二节点连接，进而在第八薄膜晶体管NT8导通时，能够向第二节点供电。
在一个实施例中，如图6所示，第二下拉模块660包括第六薄膜晶体管NT6；第六薄膜晶体管NT6的栅极与第一薄膜晶体管NT1的漏极连接，源极接入恒压低电位信号VGL，漏极与第二节点连接。
其中，第六薄膜晶体管NT6可以是NMOS型TFT器件。
具体地，基于第六薄膜晶体管NT6的栅极与第一薄膜晶体管NT1的漏极连接，第六薄膜晶体管NT6的源极接入恒压低电位信号VGL，第六薄膜晶体管NT6的漏极与第二节点连接，进而可通过第六薄膜晶体管NT6下拉第二节点的电平。
在一个实施例中，如图6所示，第一下拉模块650包括第五薄膜晶体管NT5；第五薄膜晶体管NT5的栅极与第三下拉模块670连接，漏极与第一节点连接，源极接入恒压低电位信号VGL。
其中，第五薄膜晶体管NT5可以是NMOS型TFT器件。
具体地，基于第五薄膜晶体管NT5的栅极与第三下拉模块670连接，第五薄膜晶体管NT5的漏极与第一节点连接，第五薄膜晶体管NT5的源极接入恒压低电位信号VGL，进而可通过第五薄膜晶体管NT5下拉第一节点的电平。
在一个实施例中，如图6所示，输出控制模块630包括第九薄膜晶体管NT9；第九薄膜晶体管NT9的栅极与稳压模块640连接，源极接入本级时钟信号CK(n)，漏极与第三下拉模块670连接。
其中，第九薄膜晶体管NT9可以是NMOS型TFT器件。
具体地，基于第九薄膜晶体管NT9的栅极与稳压模块640连接，第九薄膜晶体管NT9的源极接入本级时钟信号CK(n)，第九薄膜晶体管NT9的漏极连接第三下拉模块670，进而输出控制模块630可根据本级时钟信号CK(n)，控制本级栅极驱动信号的输出。
在一个实施例中，如图6所示，第四下拉模块680包括第十四薄膜晶体管NT14；第十四薄膜晶体管NT14的栅极用于接入全局信号GAS2的漏极连接，源极接入恒压低电位信号VGL，漏极与输出控制模块630的漏极连接。
其中，第十四薄膜晶体管NT14可以是NMOS型TFT器件。
具体地，基于第十四薄膜晶体管NT14的栅极接入全局信号GAS2的漏极连接，第十四薄膜晶体管NT14的源极接入恒压低电位信号VGL，第十四薄膜晶体管NT14的漏极连接输出控制模块630的漏极，进而第四下拉模块680可根据全局信号GAS2，在GOA驱动电路处于工作阶段时下拉本级栅极驱动信号的电平；
进一步的，在TP Term(触控)阶段，全局信号(GAS2)拉高，第十四薄膜晶体管打开，VGH跳变成VGL，电压拉低，从而第一节点和第二节点关闭，实现不干扰第十四薄膜晶体管的输出。
在一个示例中，如图6所示，第三下拉模块670包括第十薄膜晶体管NT10；第十薄膜晶体管NT10的栅极连接第五薄膜晶体管NT5的栅极，第十薄膜晶体管NT10的源极接入恒压低电位信号VGL，第十薄膜晶体管NT10的漏极连接第九薄膜晶体管NT9的漏极，进而可通过第十薄膜晶体管NT10可下拉本级栅极驱动信号G(n)。
在一个示例中，如图6所示，稳压模块640包括第七薄膜晶体管NT7；第七薄膜晶体管NT7的栅极接入恒压高电位信号VGH，第七薄膜晶体管NT7的源极连接第一节点Q，第七薄膜晶体管NT7的漏极连接第九薄膜晶体管NT9的栅极，进而可通过第七薄膜晶体管NT7可维持第一节点Q的电平。
在一个示例中，如图6所示，GOA单元还包括第二电容C2；第二电容C2可用于存储第二节点的电荷；第二电容C2的一端与第十五薄膜晶体管NT15的漏极连接，第二电容C2的另一端用于接入恒压低电位信号VGL。
具体地，基于第二电容C2的一端与第十五薄膜晶体管NT15的漏极连接，第二电容C2的另一端接入恒压低电位信号VGL，进而第二电容C2可存储第二节点的电荷，第二电容C2还可用来向第二节点供电，有利于GOA单元的G(n)输出。
具体而言，本申请的GOA驱动电路无需增加反向扫描控制模块、上拉模块和复位模块，只需要采用2个CK信号即可完成正常级传工作，同时简化了GOA驱动电路，进一步降低了GOA宽度，进而能够实现窄边框。其中，第一CK信号用于拉高第一节点电位，第二CK信号用于拉高第二节点电位。通过增加第十五薄膜晶体管，进而能够避免第一节点充电阶段，与第二节点发生竞争冲突，能够实现第二节点与第一节点充电阶段错开，互不影响。本申请通过采用较少的薄膜晶体管，并且只需用到2个CK信号，极大地降低GOA宽度，实现窄边框的设计。制程风险和稳定性也得到提高，使得效率和稳定性提高。
在一个实施例中，还提供了一种显示面板，该显示面板包括如上述任意一项的GOA驱动电路。
其中，该显示面板可以是液晶显示面板，还可以是OLED(Organic Light-EmittingDiode，有机发光二极管)显示面板。
上述的显示面板实施例中，通过采用较少的薄膜晶体管，并且只需用到2个CK信号，在实现GOA驱动电路的gate逐行正常打开功能，同时极大地降低GOA宽度，实现窄边框的设计，且制程风险和稳定性也得到提高，使得效率和稳定性提高。
关于显示面板的具体限定可以参见上文中对于GOA驱动电路的限定，在此不再赘述。
在一个实施例中，还提供了一种显示装置，包括如上述的显示面板。
其中，显示装置可以但不限于是手机，电视和平板电脑。
上述的显示装置实施例中，通过采用较少的薄膜晶体管，并且只需用到2个CK信号，降低了信号线数量，在实现GOA驱动电路的gate逐行正常打开功能，同时极大地降低GOA宽度，实现窄边框的设计，且制程风险和稳定性也得到提高，使得效率和稳定性提高。
关于显示装置的具体限定可以参见上文中对于显示面板以及GOA驱动电路的限定，在此不再赘述。
以上所述实施例的各技术特征可以进行任意的组合，为使描述简洁，未对上述实施例中的各个技术特征所有可能的组合都进行描述，然而，只要这些技术特征的组合不存在矛盾，都应当认为是本说明书记载的范围。
以上所述实施例仅表达了本申请的几种实施方式，其描述较为具体和详细，但并不能因此而理解为对发明专利范围的限制。应当指出的是，对于本领域的普通技术人员来说，在不脱离本申请构思的前提下，还可以做出若干变形和改进，这些都属于本申请的保护范围。因此，本申请专利的保护范围应以所附权利要求为准。

Claims (10)

1.一种GOA驱动电路，其特征在于，包括多个级联的GOA单元，其中，所述GOA单元包括：
正向扫描控制模块，用于根据恒压高电位信号控制所述GOA驱动电路进行正向扫描；
节点信号控制模块，具有：
输入端，用于接收所述恒压高电位信号；
输出端；
其中所述节点信号控制模块用于根据所述恒压高电位信号控制所述GOA驱动电路在非工作阶段输出低电位的栅极驱动信号；
稳压模块，具有：
输入端，与所述正向扫描控制模块连接于第一节点；
输出端；
其中所述稳压模块用于维持第一节点的电平；
输出控制模块，具有：
输入端，用于接收本级时钟信号；
控制端，电性连接所述稳压模块的输出端；
输出端，用于输出本级栅极驱动信号；
其中所述输出控制模块用于根据本级时钟信号控制本级栅极驱动信号的输出；
第一下拉模块，具有：
控制端；
输出端，电性连接所述第一节点；
其中所述第一下拉模块用于下拉所述第一节点的电平；
第二下拉模块，具有：
控制端，电性连接所述第一节点；
输出端，与所述节点信号控制模块的输出端电性连接于第二节点；
其中所述第二下拉模块用于下拉第二节点的电平；
第三下拉模块，具有：
控制端，电性连接所述第一下拉模块的控制端；
输出端，电性连接所述输出控制模块的输出端；
其中所述第三下拉模块用于下拉本级所述GOA单元的栅极驱动信号的电平；
第四下拉模块，用于根据全局信号在所述GOA驱动电路处于工作阶段时下拉本级栅极驱动信号的电平；
开关模块，具有：
输入端，电性连接于所述第二节点；
控制端，用于接收下一级所述GOA单元的栅极驱动信号；
输出端，与所述第三下拉模块的控制端电性连接；
其中所述开关模块用于根据所述下一级所述GOA单元的栅极驱动信号，在所述第一节点处于充电阶段时维持所述第二节点的电平。
2.根据权利要求1所述的GOA驱动电路，其特征在于，所述GOA单元还包括：
第一电容，用于存储所述第一节点的电荷；所述第一电容的一端与所述第一节点连接，所述第一电容的另一端用于接入恒压低电位信号；
其中，所述第一节点为所述正向扫描控制模块与所述稳压模块之间的连接点。
3.根据权利要求1所述的GOA驱动电路，其特征在于，所述开关模块包括第十五薄膜晶体管；
所述第十五薄膜晶体管的源极与所述第二节点连接，漏极与所述第三下拉模块连接，栅极用于接入下一级所述GOA单元的栅极驱动信号；
其中，所述第二节点为所述节点信号控制模块、所述开关模块和所述第二下拉模块之间的连接点。
4.根据权利要求3所述的GOA驱动电路，其特征在于，所述正向扫描控制模块包括第一薄膜晶体管；所述第一薄膜晶体管的栅极用于接入上一级所述GOA单元的栅极驱动信号，源极接入所述正向直流扫描控制信号，漏极与所述稳压模块连接；
所述节点信号控制模块包括第八薄膜晶体管；所述第八薄膜晶体管的栅极用于接入下一级时钟信号，源极接入所述恒压高电位信号，漏极与所述第二节点连接。
5.根据权利要求4所述的GOA驱动电路，其特征在于，所述第二下拉模块包括第六薄膜晶体管；
所述第六薄膜晶体管的栅极与所述第一薄膜晶体管的漏极连接，源极接入恒压低电位信号，漏极与所述第二节点连接。
6.根据权利要求4所述的GOA驱动电路，其特征在于，所述第一下拉模块包括第五薄膜晶体管；
所述第五薄膜晶体管的栅极与所述第三下拉模块连接，漏极与所述第一节点连接，源极接入恒压低电位信号。
7.根据权利要求1所述的GOA驱动电路，其特征在于，所述输出控制模块包括第九薄膜晶体管；
所述第九薄膜晶体管的栅极与所述稳压模块连接，源极接入本级时钟信号，漏极与所述第三下拉模块连接。
8.根据权利要求7所述的GOA驱动电路，其特征在于，所述第四下拉模块包括第十四薄膜晶体管；
所述第十四薄膜晶体管的栅极用于接入所述全局信号的漏极连接，源极接入恒压低电位信号，漏极与所述输出控制模块的漏极连接。
9.一种显示面板，其特征在于，包括如权利要求1至8中任意一项所述的GOA驱动电路。
10.一种显示装置，其特征在于，包括如权利要求9所述的显示面板。
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