CN109584809B - 栅极驱动器和包括其的平板显示装置 - Google Patents

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Abstract

在此公开了一种能够通过去除虚设的面板内栅极(GIP)来实现窄边框的栅极驱动器和包括其的平板显示装置。所述栅极驱动器包括与多条栅极线在数量上相等的面板内栅极(GIP)，以向多条栅极线顺序地提供扫描脉冲。第k个GIP由来自第k‑a级的GIP的进位脉冲使能并且由来自第k+b级的GIP的进位脉冲禁能(a和b是自然数)，最初a个GIP由从时序控制器输出的栅极起始信号使能，并且最后b个GIP由从时序控制器输出的复位信号禁能。

Description

栅极驱动器和包括其的平板显示装置
本申请要求于2017年9月29日提交的韩国专利申请号10-2017-0127630的优先权，通过引用将其并入本文，如同全文在此叙述一样。
技术领域
本发明涉及一种显示装置的栅极驱动器，更具体地，涉及一种能够通过去除虚设的面板内栅极(GIP)来实现窄边框的栅极驱动器和包括其的平板显示装置。
背景技术
随着信息化社会的发展和诸如移动通信终端和笔记本电脑之类的各种便携式电子设备的发展，对平板显示装置的需求已逐渐增加。
作为平板显示装置，利用液晶的液晶显示(LCD)装置和利用OLED的有机发光二极管(OLED)显示装置得到使用。
这样的平板显示装置包括显示面板和用于驱动显示面板的驱动器，显示面板包括用于显示图像的多条栅极线和多条数据线。
驱动器包括用于驱动多条栅极线的栅极驱动器、用于驱动多条数据线的数据驱动器以及向栅极驱动器和数据驱动器提供图像数据和各种控制信号的时序控制器。
显示面板由用于向用户显示图像的有效区域A/A和作为有效区域A/A的外围区域的无效区域N/A限定。
此外，栅极驱动器和数据驱动器设置在无效区域中或显示面板外部，以提供用于驱动像素和显示面板的多条栅极线和多条数据线的扫描脉冲和数据信号。
栅极驱动器可由至少一个栅极驱动器IC构成或可在形成显示面板的多条信号线(栅极线和数据线)和子像素的工艺中同时形成在显示面板的无效区域NA中。因此，栅极驱动器被包括在显示面板中。这称为面板内栅极(GIP)。
栅极驱动器包括在数量上大于栅极线数量的多个级(以下称为GIP)，以顺序地向栅极线提供扫描脉冲。
也就是说，如果栅极线的数量为n，则GIP的数量大于n。
图1是示出以六个相位驱动的常规栅极驱动器(GIP)的配置的示图。
尽管图中未示出，每一个级(GIP)包括用于根据置位信号和复位信号来控制Q节点和Qb节点的节点控制器、用于根据Q节点和Qb节点的电压来输出作为扫描脉冲的输入时钟信号的扫描脉冲输出端子、以及用于根据Q节点和Qb节点的电压来输出作为进位脉冲(carry pulse)的输入时钟信号的进位脉冲输出端子。
在此，置位信号是从第三个前序级(GIP)输出的进位脉冲或从时序控制器输出的起始信号VST，复位信号是从第三个后序级(GIP)输出的进位脉冲或从时序控制器输出的复位信号RST。
因此，如图1所示，在常规栅极驱动器中，当n条栅极线布置在显示面板的有效区域A/A中时，包括了用于向设置在显示面板的有效区域A/A中的n条栅极线顺序地提供扫描信号的n个A/A GIP GIP(1)至GIP(n)和设置在n个A/A GIP GIP(1)至GIP(n)前侧和后侧处的虚设GIP DGIP(1)至DGIP(6)。虚设GIP DGIP(1)至DGIP(6)不向设置在显示面板的有效区域A/A中的n条栅极线提供扫描脉冲。
设置在n个A/A GIP GIP(1)至GIP(n)前侧处的虚设GIP DGIP(1)至DGIP(3)通过从时序控制器输出的起始信号VST产生进位脉冲DCP(1)、DCP(2)和DCP(3)，并且输出进位脉冲作为用于使能A/A GIP GIP(1)至GIP(n)当中的第一至第三GIP GIP(1)、GIP(2)和GIP(3)的置位脉冲。
此外，虚设GIP DGIP(1)至DGIP(3)被从A/A GIP GIP(1)至GIP(n)当中的第一至第三GIP GIP(1)、GIP(2)和GIP(3)输出的进位脉冲CP(1)、CP(2)和CP(3)复位(禁能)。
同时，设置在n个A/A GIP GIP(1)至GIP(n)后侧处的虚设GIP DGIP(4)至DGIP(6)被从A/A GIP GIP(1)至GIP(n)当中的后三个GIP GIP(n-2)、GIP(n-1)和GIP(n)输出的进位脉冲CP(n-2)、CP(n-1)和CP(n)使能以产生进位脉冲DCP(4)、DCP(5)和DCP(6)，并且输出进位脉冲作为用于禁能A/A GIP GIP(1)至GIP(n)当中的后三个GIP GIP(n-2)、GIP(n-1)和GIP(n)的复位脉冲。
设置在n个A/A GIP GIP(1)至GIP(n)后侧处的虚设GIP DGIP(4)至DGIP(6)被从时序控制器输出的复位信号RST禁能(复位)。
在常规栅极驱动器中，不向设置在显示面板的有效区域A/A中的栅极线提供扫描脉冲的虚设GIP的存在增加了显示装置的边框尺寸。
发明内容
因此，本发明涉及一种基本上克服了由于相关技术的局限性和缺点而导致的一个或更多个问题的显示装置的栅极驱动器。
本发明的一个目的是提供一种能够通过去除栅极驱动器的虚设的面板内栅极(GIP)来减小边框尺寸的栅极驱动器及包括其的平板显示装置。
在下面的描述中将部分列出本发明的其它优点、目的和特征，这些优点、目的和特征的一部分在研究以下内容时对于本领域普通技术人员将变得显而易见或者可通过本发明的实践领会到。本发明的这些目的和其他优点可通过说明书及所附权利要求书以及附图中具体指出的结构来实现和获得。
为了实现这些目的和其他优点并根据本发明的目的，如在此具体和概括描述的，栅极驱动器包括与多条栅极线在数量上相等的面板内栅极(GIP)，以向该多条栅极线顺序地提供扫描脉冲。第k个GIP由来自第k-n级的GIP的进位脉冲使能并且由来自第k+m级的GIP的进位脉冲禁能(n和m是自然数)，最初n个GIP由从时序控制器输出的栅极起始信号使能，并且最后m个GIP由从时序控制器输出的复位信号禁能。
在根据本发明的第一实施方式的栅极驱动器中，第一个GIP包括：消隐时间节点控制器，所述消隐时间节点控制器用于根据行选择信号选择性地存储进位脉冲，并且在消隐时间内根据实时补偿信号用第一恒定电压对第一节点充电且用第二恒定电压对第二节点放电；驱动时间节点控制器，所述驱动时间节点控制器用于在驱动时间内根据所述栅极起始信号用所述栅极起始信号对所述第一节点充电并用所述第二恒定电压对所述第二节点放电，根据后序第m个GIP的进位脉冲用所述第二恒定电压对所述第一节点和第三节点放电，并且根据所述第一节点的电压用所述第一恒定电压对所述第三节点充电；转换器，所述转换器用于转换所述第一节点的所述电压并将转换的电压施加至所述第二节点；输出缓冲器，所述输出缓冲器用于接收多个进位脉冲输出时钟信号中的一个和多个扫描脉冲输出时钟信号中的一个，并且根据所述第一节点和所述第二节点的电压输出进位脉冲和扫描脉冲；以及复位单元，所述复位单元用于在所述消隐时间内根据从所述时序控制器输出的所述复位信号用所述第二恒定电压对所述第一节点放电。
在根据本发明的第一实施方式的栅极驱动器中，最后一个GIP包括：消隐时间节点控制器，所述消隐时间节点控制器用于根据行选择信号选择性地存储进位脉冲，并且在消隐时间内根据实时补偿信号用第一恒定电压对第一节点充电且用第二恒定电压对第二节点放电；驱动时间节点控制器，所述驱动时间节点控制器用于在驱动时间内根据从前序第n个GIP输出的进位脉冲用从所述前序第n个GIP输出的所述进位脉冲对所述第一节点充电并用所述第二恒定电压对所述第二节点放电，根据从时序控制器输出的所述复位信号用所述第二恒定电压对所述第一节点和第三节点放电，并且根据所述第一节点的电压用所述第一恒定电压对所述第三节点充电；转换器，所述转换器用于转换所述第一节点的所述电压并将转换的电压施加至所述第二节点；输出缓冲器，所述输出缓冲器用于接收多个进位脉冲输出时钟信号中的一个和多个扫描脉冲输出时钟信号中的一个，并且根据所述第一节点和所述第二节点的电压输出进位脉冲和扫描脉冲；以及复位单元，所述复位单元用于在所述消隐时间内根据从所述时序控制器输出的所述复位信号用所述第二恒定电压对所述第一节点放电。
在根据本发明的第一实施方式的栅极驱动器中，第k个GIP包括：消隐时间节点控制器，所述消隐时间节点控制器用于根据行选择信号选择性地存储进位脉冲，并且在消隐时间内根据实时补偿信号用第一恒定电压对第一节点充电且用第二恒定电压对第二节点放电；驱动时间节点控制器，所述驱动时间节点控制器用于在驱动时间内根据从第k-n个GIP输出的进位脉冲用从所述第k-n个GIP输出的所述进位脉冲对所述第一节点充电并用所述第二恒定电压对所述第二节点放电，根据第k+m个GIP输出的进位脉冲用所述第二恒定电压对所述第一节点和第三节点放电，并且根据所述第一节点的电压用所述第一恒定电压对所述第三节点充电；转换器，所述转换器用于转换所述第一节点的所述电压并将转换的电压施加至所述第二节点；输出缓冲器，所述输出缓冲器用于接收多个进位脉冲输出时钟信号中的一个和多个扫描脉冲输出时钟信号中的一个，并且根据所述第一节点和所述第二节点的电压输出进位脉冲和扫描脉冲；以及复位单元，所述复位单元用于在所述消隐时间内根据从所述时序控制器输出的所述复位信号用所述第二恒定电压对所述第一节点放电。在根据本发明的第一实施方式的栅极驱动器中，所有GIP具有相同的电路配置。
在根据本发明的第一实施方式的栅极驱动器中，在消隐时间内，实时补偿信号的使能时序相对于复位信号的使能时序延迟。
在根据本发明的第二实施方式的栅极驱动器中，第一个GIP包括：消隐时间节点控制器，所述消隐时间节点控制器用于根据行选择信号选择性地存储进位脉冲，并且在消隐时间内根据实时补偿信号用第一恒定电压对第一节点充电且用第二恒定电压对第二节点放电；驱动时间节点控制器，所述驱动时间节点控制器用于在驱动时间内根据所述栅极起始信号用所述栅极起始信号对所述第一节点充电并用所述第二恒定电压对所述第二节点放电，根据后序第m个GIP的进位脉冲用所述第二恒定电压对所述第一节点和第三节点放电，并且根据所述第一节点的电压用所述第一恒定电压对所述第三节点充电；转换器，所述转换器用于转换所述第一节点的所述电压并将转换的电压施加至所述第二节点；以及输出缓冲器，所述输出缓冲器用于接收多个进位脉冲输出时钟信号中的一个和多个扫描脉冲输出时钟信号中的一个，并且根据所述第一节点和所述第二节点的电压输出进位脉冲和扫描脉冲。
在根据本发明的第二实施方式的栅极驱动器中，最后一个GIP包括：消隐时间节点控制器，所述消隐时间节点控制器用于根据行选择信号选择性地存储进位脉冲，并且在消隐时间内根据实时补偿信号用第一恒定电压对第一节点充电且用第二恒定电压对第二节点放电；驱动时间节点控制器，所述驱动时间节点控制器用于在驱动时间内根据从前序第n个GIP输出的进位脉冲用从所述前序第n个GIP输出的所述进位脉冲对所述第一节点充电并用所述第二恒定电压对所述第二节点放电，根据从时序控制器输出的所述复位信号用所述第二恒定电压对所述第一节点和第三节点放电，并且根据所述第一节点的电压用所述第一恒定电压对所述第三节点充电；转换器，所述转换器用于转换所述第一节点的所述电压并将转换的电压施加至所述第二节点；输出缓冲器，所述输出缓冲器用于接收多个进位脉冲输出时钟信号中的一个和多个扫描脉冲输出时钟信号中的一个，并且根据所述第一节点和所述第二节点的电压输出进位脉冲和扫描脉冲；以及复位单元，所述复位单元用于在所述消隐时间内根据从所述时序控制器输出的所述复位信号用所述第二恒定电压对所述第一节点放电。
在根据本发明的第二实施方式的栅极驱动器中，第k个GIP包括：消隐时间节点控制器，所述消隐时间节点控制器用于根据行选择信号选择性地存储进位脉冲，并且在消隐时间内根据实时补偿信号用第一恒定电压对第一节点充电且用第二恒定电压对第二节点放电；驱动时间节点控制器，所述驱动时间节点控制器用于在驱动时间内根据从第k-n个GIP输出的进位脉冲用从所述第k-n个GIP输出的所述进位脉冲对所述第一节点充电并用所述第二恒定电压对所述第二节点放电，根据第k+m个GIP输出的进位脉冲用所述第二恒定电压对所述第一节点和第三节点放电，并且根据所述第一节点的电压用所述第一恒定电压对所述第三节点充电；转换器，所述转换器用于转换所述第一节点的所述电压并将转换的电压施加至所述第二节点；输出缓冲器，所述输出缓冲器用于接收多个进位脉冲输出时钟信号中的一个和多个扫描脉冲输出时钟信号中的一个，并且根据所述第一节点和所述第二节点的电压输出进位脉冲和扫描脉冲；以及复位单元，所述复位单元用于在所述消隐时间内根据从所述时序控制器输出的所述复位信号用所述第二恒定电压对所述第一节点放电。
在根据本发明的第二实施方式的栅极驱动器中，最初n个GIP具有与其余的GIP的电路配置不同的电路配置。
在根据本发明的第二实施方式的栅极驱动器中，复位信号和实时补偿信号在消隐时间内同时使能。
根据本发明的另一方面，平板显示装置，包括：显示面板，所述显示面板包括多条栅极线和多条数据线以及以矩阵形式形成的多个子像素，以响应于向所述栅极线提供的扫描脉冲向所述多条数据线提供数据电压来显示图像；栅极驱动器，所述栅极驱动器用于向所述栅极线顺序地提供所述扫描脉冲；数据驱动器，所述数据驱动器用于向所述多条数据线提供所述数据电压；以及时序控制器，所述时序控制器用于向所述栅极控制器和所述数据控制器分别提供多个栅极控制信号和多个数据控制信号。
所述栅极控制器包括与栅极线在数量上相等的GIP。
第k个GIP由来自第k-n个GIP的进位脉冲使能并且由来自第k+m个GIP的进位脉冲禁能(n和m是自然数)，最初n个GIP由从时序控制器输出的栅极起始信号使能，并且最后m个GIP由从所述时序控制器输出的复位信号禁能。
应当理解，本发明前面的概括描述和下面的详细描述都是例示性的和解释性的，旨在对要求保护的发明提供进一步的解释。
附图说明
给本发明提供进一步理解且并入本申请组成本申请一部分的附图图解了本发明的实施方式，并与说明书一起用于解释本发明的原理。在附图中：
图1是示出以六个相位驱动的常规栅极驱动器的配置的图；
图2是示意性地示出根据本发明的实施方式的平板显示装置的图；
图3示出根据本发明的栅极驱动器的图；
图4是根据本发明的第一实施方式的栅极驱动器的第一个GIP的电路图；
图5是图4的GIP电路的工作的时序图；
图6是根据本发明的第一实施方式的栅极驱动器的第二个GIP的电路图；
图7是根据本发明的第一实施方式的栅极驱动器的第三个GIP的电路图；
图8是根据本发明的第一实施方式的栅极驱动器的最后一个GIP的电路图；
图9是图8的GIP电路的工作的时序图；
图10是根据本发明的第一实施方式的栅极驱动器的第k个GIP的电路图；
图11是图10的GIP电路的工作的时序图；
图12是根据本发明的第二实施方式的栅极驱动器的第一个GIP的电路图；
图13是图12的GIP电路的工作的时序图；
图14是根据本发明的第二实施方式的栅极驱动器的最后一个GIP的电路图；
图15是根据本发明的第二实施方式的栅极驱动器的第k个GIP的电路图。
具体实施方式
以下，将参照附图更详细地描述具有上述特征的根据本发明的栅极驱动器及包括其的平板显示装置。
图2是示意性地示出根据本发明的实施方式的平板显示装置的图。
根据本发明的平板显示装置包括显示面板1、栅极驱动器2、数据驱动器3和时序控制器4。
在显示面板1上，布置多条栅极线GL和多条数据线DL并且在多条栅极线GL与多条数据线DL之间的交叉点处以矩阵形式布置多个子像素P。多个子像素P响应于从栅极线GL接收到的扫描脉冲G根据从多条数据线DL接收到的图像信号(数据电压)显示图像。
在显示面板1是液晶显示装置的显示面板(液晶显示面板)时，液晶显示面板包括其中在玻璃基板上形成薄膜晶体管阵列的薄膜晶体管阵列基板、其中在玻璃基板上形成滤色器阵列的滤色器阵列基板、以及填充在薄膜晶体管阵列基板与滤色器阵列基板之间的液晶层。
薄膜晶体管阵列基板包括在第一方向上延伸的多条栅极线GL和在与第一方向垂直的第二方向上延伸的多条数据线DL，并且子像素区域P由各栅极线和各数据线限定。薄膜晶体管和像素电极形成在子像素区域P中。
液晶面板向电场产生电极(像素电极和公共电极)施加电压以在液晶层中产生电场，并且通过电场来调整液晶层的液晶分子的取向以控制入射光的偏振，由此显示图像。
此外，在显示面板1是OLED显示装置的显示面板(OLED显示面板)时，OLED显示面板包括由多条栅极线与多条数据线之间的交叉点限定的子像素，每一个子像素包括由阳极、阴极和在阳极与阴极之间的有机发光层构成的OLED以及用于独立驱动OLED的像素电路。
像素电路可以被各种配置并且包括至少一个开关TFT、电容器和驱动TFT。
至少一个开关TFT响应于扫描脉冲用数据电压给电容器充电。驱动TFT根据在电容器中充电的数据电压控制向OLED提供的电流的量，以调整从OLED发出的光的量。
显示面板1由用于向用户显示图像的有效区域A/A和作为有效区域A/A的外围区域的无效区域N/A限定。
栅极驱动器2是面板内栅极(GIP)型栅极驱动器并且布置在显示面板1的无效区域中。
栅极驱动器2包括用于根据从时序控制器4接收到的多个栅极控制信号GCS向各栅极线GL顺序地提供扫描脉冲(栅极驱动信号)SP的栅极移位寄存器。
多个栅极控制信号GCS包括具有不同相位的多个时钟信号CLK1-8、表示栅极驱动器2的驱动起始的栅极起始信号VST、复位信号RST、行选择脉冲LSP、栅极高电压VGH和GVDD以及栅极低电压VGL、GVSS0、GVSS1和GVSS2。
数据驱动器3使用基准伽马电压将从时序控制器4接收到的数字图像数据RGB转换为模拟数据电压并且将转换的模拟数据电压提供到多条数据线DL。根据从时序控制器4接收到的多个数据控制信号DCS来控制数据驱动器3。
时序控制器4根据显示面板1的尺寸和分辨率排列(align)从外部接收到的图像数据RGB并且将图像数据提供到数据驱动器3。此外，时序控制器4利用诸如点时钟DCLK、数据使能信号DE、水平同步信号Hsync和垂直同步信号Vsync之类的从外部接收到的同步信号SYNC产生多个栅极控制信号GCS和多个数据控制信号DCS，并且分别向栅极驱动器2和数据驱动器3提供栅极控制信号和数据控制信号。
栅极驱动器2包括多个级(GIP)，以向多条栅极线GL中的每一条顺序地提供扫描脉冲(栅极驱动信号)SP(n)。
根据本发明的栅极驱动器2不包括常规栅极驱动器的虚设GIP。
也就是说，在显示面板1的有效区域A/A中设置n条栅极线时，根据本发明的栅极驱动器2仅包括n个GIP。
图3是示出根据本发明的栅极驱动器的图。
如图3所示，根据本发明的栅极驱动器2包括级联连接的多个级GIP。每个GIP连接至一条栅极线GL，以根据时钟信号SCCLK和CRCLK以及从时序控制器4接收到的栅极控制信号GCS顺序地产生扫描脉冲SP和进位脉冲CP，并向对应的栅极线输出扫描脉冲SP且输出进位脉冲CP作为前级和后级GIP的复位脉冲和置位脉冲。
在显示面板1的有效区域A/A中设置n条栅极线时，根据本发明的栅极驱动器2仅包括n个GIP GIP(1)至GIP(n)，如图3所示。
GIP GIP(1)至GIP(n)中的每一个的电路配置与常规GIP的电路配置不同。
图3示出了以六个相位驱动的栅极驱动器2。因此，第一个至第三个GIP GIP(1)至GIP(3)被从时序控制器4输出的栅极起始信号VST使能(置位)，并且被从第三个后序级的GIP GIP(4)、GIP(5)和GIP(6)输出的进位脉冲CP(4)、CP(5)和CP(6)禁能(复位)。
最后三个GIP GIP(n)、GIP(n-1)和GIP(n-2)被从第三个前序级GIP GIP(n-3)、GIP(n-4)和GIP(n-5)输出的进位脉冲CP(n-3)、CP(n-4)和CP(n-5)使能(置位)，并且被从时序控制器4输出的复位信号RST禁能(复位)。
其余的GIP(4)至GIP(n-3)被从第三个前序级GIP GIP(1)至GIP(n-6)输出的进位脉冲CP(1)至CP(n-6)使能(置位)，并且被从第三个后序级GIP GIP(7)至GIP(n)输出的进位脉冲CP(7)至CP(n)禁能(复位)。
在此，栅极起始信号VST同时施加至第一个至第三个GIP GIP(1)至GIP(3)，并且复位信号RST同时施加至最后三个GIP GIP(n)、GIP(n-1)和GIP(n-2)。
虽然在图3中第一个至第三个GIP GIP(1)至GIP(3)被从时序控制器4输出的栅极起始信号VST使能(置位)并且最后三个GIP GIP(n)、GIP(n-1)和GIP(n-2)被从时序控制器4输出的复位信号RST禁能(复位)，但是本发明不限于此并且可被各种配置。
也就是说，虽然未在图中示出，但是仅第一个GIP GIP(1)和第二个GIP GIP(2)可被从时序控制器4输出的栅极起始信号VST使能(置位)，仅最后两个GIP GIP(n)和GIP(n-1)可被从时序控制器4输出的复位信号RST禁能(复位)，其余的GIP GIP(3)至GIP(n-2)可被从第二个前序级的GIP GIP(1)至GIP(n-4)输出的进位脉冲CP(1)至CP(n-4)使能(置位)并且可被从第二个后序级的GIP GIP(5)至GIP(n)输出的进位脉冲CP(5)至CP(n)禁能(复位)。
也就是说，仅第一个GIP GIP(1)和第二个GIP GIP(2)可被从时序控制器4输出的栅极起始信号VST使能(置位)并且可被从第二个后序级的GIP GIP(3)和GIP(4)输出的进位脉冲CP(3)和CP(4)禁能(复位)。
此外，最后两个GIP GIP(n)和GIP(n-1)可被第二个前序级的GIP GIP(n-2)和GIP(n-3)输出的进位脉冲CP(n-2)和CP(n-3)使能(置位)，并且可被从时序控制器4输出的复位信号禁能(复位)。
此外，作为另一方法，仅第一个GIP GIP(1)可被从时序控制器4输出的栅极起始信号VST使能(置位)，仅最后一个GIP GIP(n)可被从时序控制器4输出的复位信号RST禁能(复位)，其余的GIP GIP(2)至GIP(n-1)可分别被第一个前序级的GIP GIP(1)至GIP(n-2)输出的进位脉冲CP(1)至CP(n-2)使能(置位)并且可分别被第一个后序级的GIP GIP(3)至GIP(n)输出的进位脉冲CP(3)至CP(n)禁能(复位)。
也就是说，仅第一个GIP GIP(1)可被从时序控制器4输出的栅极起始信号VST使能(置位)并且可被从后一级的GIP GIP(2)输出的进位脉冲CP(2)禁能(复位)。
此外，最后一个GIP GIP(n)可被从前一级的GIP GIP(n-1)输出的进位脉冲CP(n-1)使能(置位)并且可被从时序控制器4输出的复位信号RST禁能(复位)。
此外，作为另一方法，仅第一个至第三个GIP GIP(1)至GIP(3)可被从时序控制器4输出的栅极起始信号VST使能(置位)，并且仅最后两个GIP GIP(n)至GIP(n-1)可被从时序控制器4输出的复位信号RST禁能(复位)。
其余的GIP GIP(4)至GIP(n-2)可被从第三个前序级的GIP GIP(1)至GIP(n-5)输出的进位脉冲CP(1)至CP(n-5)使能(置位)并且可被从第二个后续级的GIP GIP(6)至GIP(n)输出的进位脉冲CP(6)至CP(n)禁能(复位)。
此外，作为另一方法，仅第一个GIP GIP(1)和第二个GIP GIP(2)可被从时序控制器4输出的栅极起始信号VST使能(置位)，最后三个GIP GIP(n)、GIP(n-1)和GIP(n-2)可被从时序控制器4输出的复位信号RST禁能(复位)，其余的GIP GIP(3)至GIP(n-3)可分别被从第二个前序级的GIP GIP(1)至GIP(n-5)输出的进位脉冲CP(1)至CP(n-5)使能(置位)并且可分别被从第三个后序级的GIP GIP(6)至GIP(n)输出的进位脉冲CP(6)至CP(n)禁能(复位)。
也就是说，取决于自最初一个GIP起有多少个GIP被从时序控制器4输出的栅极起始信号VST使能并且自最后一个GIP起有多少个GIP被从时序控制器4输出的复位信号RST禁能，各种配置是可能的。
例如，在被从时序控制器4输出的栅极起始信号VST使能的GIP的数量为n且被从时序控制器4输出的复位信号RST禁能的GIP的数量为m时，第k个GIP GIP(k)被从第k-n个前序级的GIP GIP(k-n)输出的进位脉冲CP(k-n)使能并且被从第k+m个后序级的GIP GIP(k+m)输出的进位脉冲CP(k+m)禁能。
图4是根据本发明的第一实施方式的栅极驱动器的第一个GIP的电路图，图5是图4的GIP电路的工作的时序图。
也就是说，图4是以六个相位驱动的栅极驱动器的第一个GIP的电路图，图5是GIP的工作的时序图。
如图4所示，根据本发明的实施方式的栅极驱动器的第一个GIP GIP(1)包括消隐时间(blank-time)节点控制器21和26，消隐时间节点控制器21和26包括晶体管TA、TB、T3qA、T1B、T1C、T5A和T5B以及电容器C1，用以根据行选择信号(LSP)选择性地存储进位脉冲CP(1)于电容器C1，并且在消隐时间内根据实时补偿信号VRT(垂直实时)和存储在电容器C1中的进位脉冲CP(1)用第一恒定电压GVDD对相应级的第一节点Q充电且用第二恒定电压GVSS2对第二节点Qb放电；驱动时间节点控制器23和25，驱动时间节点控制器23和25包括晶体管T1、T1A、T3n、T3nA、T3q、T3、T3A和T5，用以在驱动时间内根据栅极起始信号VST用栅极起始信号VST对相应级的第一节点Q充电，根据第三个后序级的进位脉冲CP(4)用第二恒定电压GVSS2对第一节点Q和第三节点Qh放电，根据栅极起始信号VST用第二恒定电压GVSS2对第二节点Qb放电，并且根据第一节点Q的电压用第一恒定电压GVDD对第三节点Qh充电；转换器24，转换器24包括晶体管T4、T41、T4q和T5q以及电容器C2，用以转换第一节点Q的电压并将转换后的电压施加到第二节点Qb；输出缓冲器27，输出缓冲器27包括上拉晶体管T6cr和T6、下拉晶体管T7cr和T7以及自举电容器C3，用以接收多个进位脉冲输出时钟信号中的一个CRCLK(1)和多个扫描脉冲输出时钟信号中的一个SCCLK(1)，并且根据第一节点Q和第二节点Qb的电压输出进位脉冲CP(1)和扫描脉冲SP(1)；以及复位单元22，复位单元22包括晶体管T3nB和T3nC，用以在消隐时间内根据从时序控制器4输出的复位信号RST用第二恒定电压GVSS2对第一节点Q放电。
在消隐时间节点控制器21和26中，当行选择信号LSP处于高电平时，晶体管TA、TB和T3q打开，以在电容器C1中存储进位脉冲CP(1)。
当实时补偿信号VRT在消隐时间内处于高电平时，晶体管T1C和T5B打开，以用第一恒定电压GVDD对第一节点Q充电并用第二恒定电压GVSS2对第二节点Qb放电。
在驱动时间节点控制器23和25中，当栅极起始信号VST在驱动时间内处于高电平时，晶体管T1、T1A和T5打开，以用栅极起始信号VST的电压对第一节点Q充电并用第二恒定电压GVSS2对第二节点Qb放电。在第一节点Q被充电且第二节点Qb被放电时，晶体管T3q打开，以用第一恒定电压GVDD对第三节点Qh充电。
当第三个后序级的进位脉冲CP4处于高电平时，晶体管T3n和T3nA打开，以用第二恒定电压GVSS2对第一节点Q和第三节点Qh放电。
转换器24转换第一节点Q的电压并将转换的电压施加到第二节点Qb。
在输出缓冲器27中，当第一节点Q处于高电平并且第二节点Qb处于低电平时，上拉晶体管T6cr打开并且下拉晶体管T7cr关断，以输出多个进位脉冲输出时钟信号中的一个CRCLK(1)作为进位脉冲CP(1)。此外，当第一节点Q处于高电平并且第二节点Qb处于低电平时，上拉晶体管T6打开并且下拉晶体管T7关断，以输出多个扫描脉冲输出时钟信号中的一个SCCLK(1)作为扫描脉冲SP(1)。
此时，当施加具有高电平的扫描脉冲输出时钟信号SCCLK(1)时，第一节点Q由输出缓冲器27的自举电容器C3自举(或耦合)，由此具有更高的电压。
在第一节点Q被自举的状态下，输出缓冲器27输出进位脉冲输出时钟信号CRCLK(1)和扫描脉冲输出时钟信号SCCLK(1)作为进位脉冲CP(1)和扫描脉冲SP(1)，由此防止输出损失。
在复位单元22中，在消隐时间内，当从时序控制器4输出的复位信号RST处于高电平时，晶体管T3nB和T3nC打开，以用第二恒定电压GVSS2对第一节点Q放电。
将参照图5描述根据本发明的实施方式的栅极驱动器的第一GIP GIP(1)的工作。
首先，如图5所示，在帧的开始处同时输入具有高电平的栅极起始信号VST和行选择信号LSP。因此，如上所述，通过驱动时间节点控制器23和25，用栅极起始信号VST的电压对第一节点Q充电，用第二恒定电压GVSS2对第二节点Qb放电，并且用第一恒定电压GVDD对第三节点Qh充电。此外，转换器24转换第一节点Q的电压并将转换的电压施加至第二节点Qb。
因此，第一节点Q和第三节点Qh变成高电平状态并且第二节点Qb变成低电平状态。
同时，在同时输入具有高电平的栅极起始信号VST和行选择信号LSP时，晶体管TA、TB和T3qA打开。此时，由于进位脉冲CP(1)维持在低电平，电容器C1被放电并初始化。
此外，在栅极起始信号VST处于低电平、进位脉冲CP(1)被同步、并且再次输入具有高电平的行选择信号LSP时，晶体管TA、TB和T3qA打开，以用进位脉冲CP(1)对电容器C1充电。因此，消隐时间节点控制器21和26的M节点维持在高电平直到下一帧开始为止。
在第一节点Q处于高电平并且第二节点Qb处于低电平时，输出缓冲器27的上拉晶体管T6cr打开并且下拉晶体管的T7cr关断，以输出多个进位脉冲输出时钟信号中的一个CRCLK(1)作为进位脉冲CP(1)，上拉晶体管T6打开并且下拉晶体管T7关断，以输出多个扫描脉冲输出时钟信号中的一个SCCLK(1)作为扫描脉冲SP(1)。
此时，在施加具有高电平的扫描脉冲输出时钟信号SCCLK(1)时，第一节点Q通过输出缓冲器27的自举电容器C3而自举(或耦合)，由此具有更高的电压。
在第一节点Q处于自举的状态下，输出缓冲器27输出进位脉冲输出时钟信号CRCLK(1)和扫描脉冲输出时钟信号SCCLK(1)作为进位脉冲CP(1)和扫描脉冲SP(1)，由此防止了输出损失。
在第三个后序级的GIP GIP(4)输出具有高电平的进位脉冲CP(4)时，驱动时间节点控制器23的晶体管T3n和T3nA打开，以用第二恒定电压GVSS2对第一节点Q和第三节点Qh放电。
因此，第一节点Q和第三节点Qh变成低电平状态并且第二节点Qb变成高电平状态。
同时，在消隐时间内，在从时序控制器4输出的复位信号RST处于高电平时，复位单元22的晶体管T3nB和T3nC打开，以用第二恒定电压GVSS2对第一节点Q放电，由此执行初始化。在消隐时间内，在实时补偿信号VRT处于高电平时，消隐时间节点控制器21和26的晶体管T1C和T5B打开，以用第一恒定电压GVDD对第一节点Q充电并用第二恒定电压GVSS2对第二节点Qb放电。
因此，在消隐时间内，第一节点Q变成高电平状态且第二节点Qb变成低电平状态。此时，由于输出具有高电平的多个扫描脉冲输出时钟信号中的一个SCCLK(1)，不输出进位脉冲CP(1)而是输出扫描脉冲SP(1)。维持此状态直到输入具有高电平的复位信号为止。在输入具有高电平的复位信号时，复位单元22的晶体管T3nB和T3nC打开，以用第二恒定电压GVSS2对第一节点Q放电，由此执行初始化。因此，第一节点Q和第三节点Qh变成低电平状态并且第二节点Qb变成高电平状态。
在下一帧中，当同时输入具有高电平的栅极起始信号VST和行选择信号LSP时，电容器C1被初始化并且M节点维持在低电平状态。
籍此方法，在消隐时间内执行了实时补偿。
虽然在图4和图5中描述了第一个GIP GIP(1)，但是除了所施加的信号不同之外，图3中示出的第二个GIP GIP(2)和第三个GIP GIP(3)与第一个GIP具有相同的电路配置并与第一个GIP使用相同的方法来驱动。
图6是根据本发明的第一实施方式的栅极驱动器的第二个GIP的电路图。图7是根据本发明的第一实施方式的栅极驱动器的第三个GIP的电路图。
如图6和图7中所示，除了所施加的信号不同之外，根据本发明的第一实施方式的栅极驱动器的第二个GIP GIP(2)和第三个GIP GIP(3)与图4中示出的第一个GIP GIP(1)具有相同的电路配置并与第一个GIP GIP(1)使用相同的方法来驱动。
也就是说，在施加至消隐时间节点控制器21的行选择信号LSP在栅极起始信号VST处于低电平时的高电平相位与施加至输出缓冲器27的进位脉冲输出时钟信号CRCLK(1)和扫描脉冲输出时钟信号SCCLK(1)的相位中存在差异。
此外，在施加至驱动时间节点控制器23的晶体管T3n和T3nA的后序级的进位脉冲中存在差异。
也就是说，施加至第二个GIP GIP(2)的输出缓冲器27的进位脉冲输出时钟信号CRCLK(2)和扫描脉冲输出时钟信号SCCLK(2)相对于施加至第一个GIP GIP(1)的输出缓冲器27的进位脉冲输出时钟信号CRCLK(1)和扫描脉冲输出时钟信号SCCLK(1)相位偏移(延迟)了一个时钟。
此外，施加至第三个GIP GIP(3)的输出缓冲器27的进位脉冲输出时钟信号CRCLK(3)和扫描脉冲输出时钟信号SCCLK(3)相对于施加至第二个GIP GIP(2)的输出缓冲器27的进位脉冲输出时钟信号CRCLK(2)和扫描脉冲输出时钟信号SCCLK(2)相位偏移(延迟)了一个时钟。
因此，由于将顺序地偏移的进位脉冲输出时钟信号和扫描脉冲输出时钟信号施加至第一个GIP GIP(1)、第二个GIP GIP(2)和第三个GIP GIP(3)，第一个GIP GIP(1)、第二个GIP GIP(2)和第三个GIP GIP(3)被从时序控制器4输出的栅极起始信号VST同时使能，由此顺序地输出进位脉冲和扫描脉冲。
此外，行选择信号LSP在栅极起始信号VST处于低电平时的高电平与时钟信号类似地偏移和施加。
此外，从第五个GIP GIP(5)输出的进位脉冲CP(5)施加至第二个GIP GIP(2)的驱动时间节点控制器23的晶体管T3n和T3nA，并且从第六个GIP GIP(6)输出的进位脉冲CP(6)施加至第三个GIP GIP(3)的驱动时间节点控制器23的晶体管T3n和T3nA。
接下来，将描述最后一个GIP GIP(n)的配置。
图8是根据本发明的第一实施方式的栅极驱动器的最后一个GIP的电路图，图9是图8的GIP电路的工作的时序图。
如图8所示，除了所施加的信号不同之外，根据本发明的第一实施方式的栅极驱动器的最后一个GIP GIP(n)具有与图4所示的第一个GIP GIP(1)相同的配置并与图4所示的第一个GIP GIP(1)使用相同的方法驱动。
在施加至消隐时间节点控制器21的行选择信号LSP在栅极起始信号VST处于低电平时的高电平的相位与施加至输出缓冲器27的进位脉冲输出时钟信号CRCLK(n)和扫描脉冲输出时钟信号SCCLK(n)的相位中存在差异。
此外，在施加至驱动时间节点控制器23的晶体管T3n和T3nA的信号中存在差异。
也就是说，施加至最后一个GIP GIP(n)的输出缓冲器27的进位脉冲输出时钟信号CRCLK(n)和扫描脉冲输出时钟信号SCCLK(n)与施加至第一个GIP GIP(1)的输出缓冲器27的进位脉冲输出时钟信号CRCLK(1)和扫描脉冲输出时钟信号SCCLK(1)具有不同的相位。
此外，行选择信号LSP在栅极起始信号VST处于低电平时的高电平状态与时钟信号类似地偏移和施加。
此外，从第三个前序级的GIP GIP(n-3)输出的进位脉冲CP(n-3)施加至最后一个GIP GIP(n)的驱动时间节点控制器23和25的晶体管T1、T1A和T5，并且从时序控制器4输出的复位信号RST施加至驱动时间节点控制器23和25的晶体管T3n和T3nA。
现在将参照图9来描述根据本发明的第一实施方式的栅极驱动器的最后的GIPGIP(n)。
首先，如图9所示，在其中具有高电平的栅极起始信号VST和行选择信号LSP同时输入的帧的开始处，晶体管TA、TB和T3qA打开以对电容器C1放电，由此执行初始化。
如上所述，在从第三个前序级的GIP GIP(n-3)输出的进位脉冲CP(n-3)以高电平状态输入时，通过驱动时间节点控制器23和25，用进位脉冲CP(n-3)的电压对第一节点Q充电，用第二恒定电压GVSS2对第二节点Qb放电，并且用第一恒定电压GVDD对第三节点Qh放电。此外，转换器24转换第一节点Q的电压并将转换的电压施加至第二节点Qb。
因此，第一节点Q和第三节点Qh变成高电平状态并且第二节点变成低电平状态。
在栅极起始信号VST处于低电平的状态下，当再次输入具有高电平的行选择信号LSP时，晶体管TA、TB和T3qA打开，以用进位脉冲CP(n)对电容器C1充电。因此，消隐时间节点控制器21和26的M节点维持在高电平直到下一帧开始为止。
在第一节点Q处于高电平并且第二节点Qb处于低电平时，输出缓冲器27的上拉晶体管T6cr打开并且下拉晶体管的T7cr关断，以输出多个进位脉冲输出时钟信号中的一个CRCLK(n)作为进位脉冲CP(n)，上拉晶体管T6打开并且下拉晶体管T7关断，以输出多个扫描脉冲输出时钟信号中的一个SCCLK(n)作为扫描脉冲SP(n)。
此时，在施加具有高电平的扫描脉冲输出时钟信号SCCLK(n)时，第一节点Q通过输出缓冲器27的自举电容器C3而自举(或耦合)，由此具有更高的电压。
在第一节点Q处于自举的状态下，输出缓冲器27输出进位脉冲输出时钟信号CRCLK(n)和扫描脉冲输出时钟信号SCCLK(n)作为进位脉冲CP(n)和扫描脉冲SP(n)，由此防止了输出损失。
当从时序控制器4输出的复位信号RST在高电平状态下输出时，驱动时间节点控制器23的晶体管T3n和T3nA打开，以用第二恒定电压GVSS2对第一节点Q和第三节点Qh放电。
因此，第一节点Q和第三节点Qh变成低电平状态并且第二节点Qb变成高电平状态。
同时，在消隐时间内，当从时序控制器4输出的复位信号RST处于高电平时，复位单元22的晶体管T3nB和T3nC打开，以用第二恒定电压GVSS2对第一节点Q放电，由此执行初始化。此外，在消隐时间内，当实时补偿信号VRT处于高电平时，消隐时间节点控制器21和26的晶体管T1C和T5B打开，以用第一恒定电压GVDD对第一节点Q充电并用第二恒定电压GVSS2对第二节点Qb放电。
因此，在消隐时间内，第一节点Q变成高电平状态且第二节点Qb变成低电平状态。此时，由于在高电平状态下输出多个扫描脉冲输出时钟信号中的一个SCCLK(n)，不输出进位脉冲CP(n)而是输出扫描脉冲SP(n)。维持此状态直到输入具有高电平的复位信号为止。在输入具有高电平的复位信号时，复位单元22的晶体管T3nB和T3nC打开，以用第二恒定电压GVSS2对第一节点Q放电，由此执行初始化。因此，第一节点Q和第三节点Qh变成低电平状态并且第二节点Qb变成高电平状态。
此外，在下一帧中，当同时输入具有高电平的栅极起始信号VST和行选择信号LSP时，电容器C1被初始化并且M节点维持在低电平状态。
籍此方法，在消隐时间内执行了实时补偿。
虽然在图8和图9中描述了根据本发明的第一实施方式的栅极驱动器的最后一个GIP GIP(n)，但是除了所施加的信号不同之外，图3中示出的第n-1个GIP GIP(n-1)和第n-2个GIP GIP(n-2)与最后一个GIP具有相同的电路配置并与最后一个GIP使用相同的方法来驱动。
如上所述，在施加至消隐时间节点控制器21的行选择信号LSP的相位与施加至输出缓冲器27的进位脉冲输出时钟信号和扫描脉冲输出时钟信号的相位中存在差异。
此外，在施加至驱动时间节点控制器23和25的晶体管T1、T1A和T5的进位脉冲CP(n-4)或CP(n-5)中存在差异。
现在将描述图3中示出的根据本发明的第一实施方式的栅极驱动器的其余的GIPGIP(4)至GIP(n-3)的配置。
图10是根据本发明的第一实施方式的栅极驱动器的第k个GIP的电路图。图11是图10的GIP电路的工作的时序图。
如图10所示，除了所施加的信号不同之外，根据本发明的第一实施方式的栅极驱动器的其余的GIP GIP(4)至GIP(n-3)与图4中示出的第一个GIP GIP(1)具有相同的电路配置并与第一个GIP GIP(1)使用相同的方法来驱动。
也就是说，在施加至消隐时间节点控制器21的行选择信号LSP的相位与施加至输出缓冲器27的进位脉冲输出时钟信号CRCLK(k)和扫描脉冲输出时钟信号SCCLK(k)的相位中存在差异。
此外，在施加至驱动时间节点控制器23的晶体管T3n和T3nA的进位脉冲中存在差异。
也就是说，施加至第k个GIP GIP(k)的输出缓冲器27的进位脉冲输出时钟信号CRCLK(k)和扫描脉冲输出时钟信号SCCLK(k)与施加至第一个GIP GIP(1)的输出缓冲器27的进位脉冲输出时钟信号CRCLK(1)和扫描脉冲输出时钟信号SCCLK(1)具有不同的相位。
此外，行选择信号LSP在栅极起始信号VST处于低电平时的高电平状态与时钟信号类似地偏移和施加。
此外，从第三个前序级的GIP GIP(k-3)输出的进位脉冲CP(k-3)施加至第k个GIPGIP(k)的驱动时间节点控制器23和25的晶体管T1、T1A和T5，并且从第三个后序级的GIPGIP(k+3)输出的进位脉冲CP(K+3)施加至驱动时间节点控制器23和25的晶体管T3n和T3nA。
现在将参照图11描述根据本发明的第一实施方式的栅极驱动器的第k个GIP GIP(k)的工作。
首先，如图11所示，在帧的开始处同时输入具有高电平的栅极起始信号VST和行选择信号LSP，晶体管TA、TB和T3qA打开，以对电容器C1放电，由此执行初始化。
如上所述，当在高电平状态下输入第三个前序级的GIP GIP(k-3)输出的进位脉冲CP(k-3)时，通过驱动时间节点控制器23和25，用进位脉冲CP(k-3)的电压对第一节点Q充电，用第二恒定电压GVSS2对第二节点Qb放电，并且用第一恒定电压GVDD对第三节点Qh充电。此外，转换器24转换第一节点Q的电压并将转换的电压施加至第二节点Qb。
因此，第一节点Q和第三节点Qh变成高电平状态并且第二节点Qb变成低电平状态。
在栅极起始信号VST处于低电平的状态下，当再次输入具有高电平的行选择信号LSP时，晶体管TA、TB和T3qA打开，以用进位脉冲CP(k)对电容器C1充电。因此，消隐时间节点控制器21和26的M节点维持在高电平直到下一帧开始为止。
在第一节点Q处于高电平并且第二节点Qb处于低电平时，输出缓冲器27的上拉晶体管T6cr打开并且下拉晶体管的T7cr关断，以输出多个进位脉冲输出时钟信号中的一个CRCLK(k)作为进位脉冲CP(k)，上拉晶体管T6打开并且下拉晶体管T7关断，以输出多个扫描脉冲输出时钟信号中的一个SCCLK(k)作为扫描脉冲SP(k)。
此时，在施加具有高电平的扫描脉冲输出时钟信号SCCLK(k)时，第一节点Q通过输出缓冲器27的自举电容器C3而自举(或耦合)，由此具有更高的电压。
在其中第一节点Q处于自举的状态下，输出缓冲器27输出进位脉冲输出时钟信号CRCLK(k)和扫描脉冲输出时钟信号SCCLK(k)作为进位脉冲CP(k)和扫描脉冲SP(k)，由此防止了输出损失。
当在高电平状态下输出从第三个后序级的GIP GIP(k+3)输出的进位脉冲CP(k+3)时，驱动时间节点控制器23的晶体管T3n和T3nA打开，以用第二恒定电压GVSS2对第一节点Q和第三节点Qh放电。
因此，第一节点Q和第三节点Qh变成低电平状态并且第二节点Qb变成高电平状态。
同时，在消隐时间内，在从时序控制器4输出的复位信号RST处于高电平时，复位单元22的晶体管T3nB和T3nC打开，以用第二恒定电压GVSS2对第一节点Q放电，由此执行初始化。此外，在消隐时间内，当实时补偿信号VRT处于高电平时，消隐时间节点控制器21和26的晶体管T1C和T5B打开，以用第一恒定电压GVDD对第一节点Q充电并用第二恒定电压GVSS2对第二节点Qb放电。
因此，在消隐时间内，第一节点Q变成高电平状态且第二节点Qb变成低电平状态。此时，由于在高电平状态下输出多个扫描脉冲输出时钟信号中的一个SCCLK(k)，不输出进位脉冲CP(k)而是输出扫描脉冲SP(k)。维持此状态直到输入具有高电平的复位信号为止。在输入具有高电平的复位信号时，复位单元22的晶体管T3nB和T3nC打开，以用第二恒定电压GVSS2对第一节点Q放电，由此执行初始化。因此，第一节点Q和第三节点Qh变成低电平状态并且第二节点Qb变成高电平状态。
此外，在下一帧中，当同时输入具有高电平的栅极起始信号VST和行选择信号LSP时，电容器C1被初始化并且M节点维持在低电平状态。
籍此方法，在消隐时间内执行了实时补偿。
在根据本发明的第一实施方式的栅极驱动器的GIP GIP(1)至GIP(n)中，实时补偿信号VRT和复位信号RST的不同之处在于在消隐时间内的使能时序。
也就是说，在消隐时间内，通过实时补偿信号VRT用第一恒定电压GVDD对图4、图6至图8和图10中示出的根据本发明的第一实施方式的栅极驱动器的GIP GIP(1)至GIP(n)的第一节点Q充电，并且通过复位信号RST用第二恒定电压对图4、图6至图8和图10中示出的根据本发明的第一实施方式的栅极驱动器的GIP GIP(1)至GIP(n)的第一节点Q放电。
因此，在实时补偿信号VRT和复位信号RST同时使能(同时具有高电平)时，不对GIPGIP(1)至GIP(n)的第一节点Q充电并且在消隐时间内未实现实时补偿。
因此，如图5、图9和图11所示，实时补偿信号VRT在消隐时间内相对于复位信号RST延迟。
同时，在参照图4至图11描述的根据本发明的第一实施方式的栅极驱动器中，可省略第一GIP GIP(1)的复位单元22或者可保留复位单元22并可由复位信号RST以外的信号VSTP来驱动复位单元22。
图12是根据本发明的第二实施方式的栅极驱动器的第一GIP的电路图，图13是图12的GIP电路的工作的时序图。
如图12所示，除了省去复位单元22之外，根据本发明的第二实施方式的栅极驱动器的第一个GIP GIP(1)的配置与图4中示出的根据本发明的第一实施方式的栅极驱动器的第一个GIP GIP(1)的配置相同。
也就是说，如图12所示，根据本发明的第二实施方式的栅极驱动器的第一个GIPGIP(1)包括消隐时间节点控制器21和26，消隐时间节点控制器21和26包括晶体管TA、TB、T3qA、T1B、T1C、T5A和T5B以及电容器C1，用以根据行选择信号(LSP)选择性地存储进位脉冲CP(1)，并在消隐时间内根据实时补偿信号VRT(垂直实时)用第一恒定电压GVDD对相应级的第一节点Q充电且用第二恒定电压GVSS2对第二节点放电；驱动时间节点控制器23和25，驱动时间节点控制器23和25包括晶体管T1、T1A、T3n、T3nA、T3q、T3、T3A和T5，用以在驱动时间内根据栅极起始信号VST用栅极起始信号VST对相应的级的第一节点Q充电，根据第三个后序级的进位脉冲CP4用第二恒定电压GVSS2对第一节点Q和第三节点Qh放电，根据栅极起始信号VST用第二恒定电压GVSS2对第二节点Qb放电，并且根据第一节点Q的电压用第一恒定电压GVDD对第三节点Qh充电；转换器24，转换器24包括晶体管T4、T41、T4q和T5q以及电容器C2，用以转换第一节点Q的电压并将转换的电压施加至第二节点Qb；输出缓冲器27，输出缓冲器27包括上拉晶体管T6cr和T6、下拉晶体管T7cr和T7以及自举电容器C3，用以接收多个进位脉冲输出时钟信号中的一个CRCLK(1)和多个扫描脉冲输出时钟信号中的一个SCCLK(1)，并且根据第一节点Q和第二节点Qb的电压输出进位脉冲CP(1)和扫描脉冲SP(1)。
参照图13描述驱动根据本发明的第二实施方式的栅极驱动器的第一个GIP GIP(1)的方法。
图5与图13的不同之处在于在消隐时间内实时补偿信号VRT和复位信号RST同时使能(同时具有高电平)。
因此，以与根据本发明的第一实施方式的栅极驱动器的第一个GIP GIP(1)相同的方式施加栅极起始信号VST、行选择信号LSP和复位信号RST。即使在实时补偿信号VRT和复位信号RST同时使能(同时具有高电平)的情况下，图12示出的根据本发明的第二实施方式的栅极驱动器的第一个GIP GIP(1)不包括复位单元22并由此可对第一个GIP GIP(1)的第一节点Q充电。
因此，与图4示出的根据本发明的第一实施方式的栅极驱动器的第一个GIP GIP(1)相比，在图12示出的根据本发明的第二实施方式的栅极驱动器的第一个GIP GIP(1)中，在消隐时间内可增加实时补偿时间。
虽然参照图12和图13描述了根据本发明的第二实施方式的栅极驱动器的第一个GIP GIP(1)，但是根据本发明的第二实施方式的栅极驱动器的第二个GIP GIP(2)和第三个GIP GIP(3)具有与第一个GIP相同的配置并使用与第一GIP相同的方法来驱动。
也就是说，如图6和图7所示，在施加至消隐时间节点控制器21的行选择信号LSP在栅极起始信号VST处于低电平时的高电平的相位与施加至输出缓冲器27的进位脉冲输出时钟信号CRCLK(1)和扫描脉冲输出时钟信号SCCLK(1)的相位中存在差异，并且在施加至驱动时间节点控制器23的晶体管T3n和T3nA的后序级的进位脉冲中存在差异。
除了在本发明的第一实施方式中由复位信号RST驱动复位单元22而在本发明的第二实施方式中由栅极起始信号VST驱动复位单元22之外，根据本发明的第二实施方式的栅极驱动器的最后三个GIP GIP(n-2)、GIP(n-1)和GIP(n)以及其余的GIP GIP(4)至GIP(n-3)的配置和工作与第一实施方式的配置和工作相同。
图14是根据本发明的第二实施方式的栅极驱动器的最后一个GIP的电路图。
如图14所示，除了施加至复位单元22的信号不同之外，根据本发明的第二实施方式的栅极驱动器的最后一个GIP GIP(n)具有与图8中示出的根据本发明的第一实施方式的栅极驱动器的最后一个GIP GIP(n)相同的配置，并使用与图8中示出的根据本发明的第一实施方式的栅极驱动器的最后一个GIP GIP(n)相同的方法来驱动。
也就是说，复位单元22根据从时序控制器4输出的栅极起始信号VST用第二恒定电压GVSS2对第一节点Q放电。
此外，虽然图14中描述了根据本发明的第二实施方式的栅极驱动器的最后一个GIP GIP(n)，但是除了所施加的信号不同之外，图3中示出的第n-1个GIP GIP(n-1)和第n-2个GIP GIP(n-2)具有与最后一个GIP相同的配置，并使用与最后一个GIP相同的方法来驱动。
图15是根据本发明的第二实施方式的栅极驱动器的第k个GIP的电路图。
如图15所示，除了施加至复位单元22的信号不同之外，根据本发明的第二实施方式的栅极驱动器的第k个GIP GIP(k)具有与图10中示出的根据本发明的第一实施方式的栅极驱动器的第k个GIP GIP(k)相同的配置，并使用与图10中示出的根据本发明的第一实施方式的栅极驱动器的第k个GIP GIP(k)相同的方法来驱动。
也就是说，复位单元22根据从时序控制器4输出的起始信号VST用第二恒定电压GVSS2对第一节点Q放电。如上所述，由于虚设GIP未形成在根据本发明的第一实施方式和第二实施方式的栅极驱动器中，所以可减小显示设备的上边框和下边框。
此外，由于根据本发明的第一实施方式的栅极驱动器可调整所施加的信号的时序并均等地配置所有GIP的电路配置，所以可减小GIP之间的差异。
此外，在根据本发明的第二实施方式的栅极驱动器中，由于第一GIP和其余的GIP在电路配置上不同，但实时补偿信号VRT和复位信号RST的使能时序在消隐时间内相等，所以可在消隐时间内增加实时补偿时间。
本发明不限于上述实施方式和附图。本领域技术人员将会理解，在不脱离本发明的技术范围和精神的情况下，可以做出各种替换、修改和变化。

Claims (11)

1.一种栅极驱动器，包括：
多个GIP级，所述多个GIP级用于向显示面板的多条栅极线顺序地提供扫描脉冲，所述多个GIP级与所述多条栅极线在数量上相等，所述多个GIP级包括：
第一组GIP级，包括由从时序控制器输出栅极起始信号使能的第一个GIP级至第n个GIP级；
第二组GIP级，包括由从所述时序控制器输出的复位信号禁能的第m-n-1个GIP级至第m个GIP级；和
第三组GIP级，位于所述第一组GIP级和所述第二组GIP级之间，
其中所述第三组GIP级中的第k个GIP级由从第k-n个GIP级输出的进位脉冲使能并且由从第k+n个GIP级输出的进位脉冲禁能，
其中n是等于大于2的自然数，k是大于n且小于m-n-1的自然数，并且第m个GIP级是最后一级。
2.根据权利要求1所述的栅极驱动器，其中所述多个GIP级的每一个GIP级包括：
输出缓冲器，用于接收多个进位脉冲输出时钟信号中的一个和多个扫描脉冲输出时钟信号中的一个，并且根据相应GIP级中的第一节点和第二节点的电压输出进位脉冲和扫描脉冲。
3.根据权利要求2所述的栅极驱动器，其中所述第一组GIP级中的第i个GIP级包括：
驱动时间节点控制器，用于在驱动时间内，根据所述栅极起始信号对所述第一节点充电并对所述第二节点放电以将所述第一组GIP级中的所述第i个GIP级使能，根据从第i+n个GIP级输出的进位脉冲对所述第一节点放电并对所述第二节点充电以将所述第一组GIP级中的所述第i个GIP级禁能。
4.根据权利要求2所述的栅极驱动器，其中所述第二组GIP级中的第j个GIP级包括：
驱动时间节点控制器，用于在驱动时间内，根据从第j-n个GIP级输出的进位脉冲对所述第一节点充电并对所述第二节点放电以将所述第二组GIP级中的所述第j个GIP级使能，根据所述复位信号对所述第一节点放电并对所述第二节点充电以将所述第二组GIP级中的所述第j个GIP级禁能。
5.根据权利要求2所述的栅极驱动器，其中第k个GIP级包括：
驱动时间节点控制器，用于在驱动时间内，根据从第k-n个GIP级输出的进位脉冲对所述第一节点充电并对所述第二节点放电以将所述第k个GIP级使能，根据从第k+n个GIP级输出的进位脉冲对所述第一节点放电并对所述第二节点充电以将所述第k个GIP级禁能。
6.根据权利要求2所述的栅极驱动器，其中所述多个GIP级的每一个GIP级还包括：
消隐时间节点控制器，用于根据行选择信号选择性地存储从相应GIP级的所述输出缓冲器输出的进位脉冲，并且在消隐时间内根据实时补偿信号对所述第一节点充电并对所述第二节点放电以执行实时补偿。
7.根据权利要求6所述的栅极驱动器，其中所述多个GIP级的每一个GIP级还包括：
复位单元，用于在所述消隐时间内根据从所述时序控制器输出的所述复位信号对所述第一节点放电。
8.根据权利要求7所述的栅极驱动器，其中所述实时补偿信号的使能时序在所述消隐时间内相对于所述复位信号的使能时序延迟。
9.根据权利要求6所述的栅极驱动器，其中输出至所述第一组GIP级的每一个GIP级的所述复位信号和所述实时补偿信号在所述消隐时间内同时使能。
10.根据权利要求9所述的栅极驱动器，其中所述多个GIP级中除所述第一组GIP级以外的其余GIP级各自包括：
复位单元，用于在所述消隐时间内根据从所述时序控制器输出的所述栅极起始信号对所述第一节点放电。
11.一种平板显示装置，包括：
显示面板，所述显示面板包括多条栅极线和多条数据线以及以矩阵形式形成的多个子像素，以响应于向所述栅极线提供的扫描脉冲向所述多条数据线提供数据电压来显示图像；
根据权利要求1至10中任一项所述的栅极驱动器，用于向所述多条栅极线顺序地提供所述扫描脉冲；
数据驱动器，用于向所述多条数据线提供所述数据电压；以及
时序控制器，用于向所述栅极驱动器和所述数据驱动器分别提供多个栅极控制信号和多个数据控制信号。
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