CN108132568A - 显示装置 - Google Patents

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Abstract

公开了显示装置,该显示装置可包括第一类型栅极线、第二类型栅极线、数据线和像素。第一类型栅极线包括第一栅极线。第二类型栅极线包括第二栅极线,并且与第一栅极线交叉。像素包括第一开关晶体管和第二开关晶体管。第一开关晶体管包括第一栅电极、第一源电极和第一漏电极。第一栅电极电连接至第一栅极线。第一源电极电连接至数据线。第二开关晶体管包括第二栅电极、第二源电极和第二漏电极。第二栅电极电连接至第二栅极线。第二源电极电连接至第一漏电极。

Description

显示装置
技术领域
本技术领域涉及显示装置。
背景技术
诸如液晶显示器或有机发光二极管显示器的显示装置可包括用于显示图像的多个像素。通常,多个像素以矩阵布置,连接至在行方向上延伸的多个栅极线以及连接至在列方向上延伸的多个数据线。像素接收通过栅极线施加的栅极信号和与栅极信号同步且通过数据线施加的数据信号。
用于顺序地输出栅极信号的栅极驱动电路可安装在包括多个像素的显示面板中。与栅极驱动电路相比,用于将多个数据信号同时输出至多个数据线的数据驱动电路是复杂的。因此,数据驱动电路不安装在显示面板中,而是配置成显示面板的外部IC。数据驱动电路可通过柔性电路板连接至显示面板。驱动电路结构可能限制显示装置的形状。
在背景部分中公开的上述信息是用于增强对本申请的背景的理解。背景部分可包含不形成这个国家中本领域普通技术人员已知的现有技术的信息。
发明内容
实施方式可涉及具有最小数量的数据线和具有期望的形状的显示装置。
实施方式可涉及显示装置,该显示装置包括以下元件:在第一方向上延伸的多个第一栅极线;在与第一方向交叉的第二方向上延伸的多个第二栅极线;以及连接至第一栅极线和第二栅极线的多个像素,其中,像素分别包括第一开关晶体管和第二开关晶体管,第一开关晶体管包括连接至第一栅极线的栅电极和连接至数据线的第一电极,第二开关晶体管包括连接至第二栅极线的栅电极和连接至第一开关晶体管的第一电极。
显示装置还可包括连接至第二开关晶体管的液晶电容器。
显示装置还可包括连接至第二开关晶体管的驱动晶体管,以及连接至驱动晶体管的发光二极管(LED)。
第一方向可以是行方向,以及第二方向可以是列方向。
第一方向可以是列方向,以及第二方向可以是行方向。
数据线可共同地连接至设置在不同行和列中的像素。
显示装置还可包括连接至第一栅极线并输出第一栅极信号的多个第一栅极驱动块,以及连接至第二栅极线并输出第二栅极信号的多个第二栅极驱动块。
当第一栅极驱动块分别将第一栅极信号输出为栅极导通电压时,第二栅极驱动块可将第二栅极信号顺序地输出至第二栅极线。
当第二栅极驱动块分别将第二栅极信号输出为栅极导通电压时,第一栅极驱动块可将第一栅极信号顺序地输出至第一栅极线。
在第一栅极驱动块中的一个输出第一栅极信号的每个栅极导通周期内,第二栅极驱动块可在第一顺序与第二顺序之间交替地改变将第二栅极信号施加到第二栅极线的顺序,其中第二顺序是第一顺序的逆顺序。
实施方式可涉及显示装置,该显示装置包括以下元件:在第一方向上延伸的多个第一栅极线;在与第一方向交叉的第二方向上延伸的多个第二栅极线;连接至第一栅极线的多个第一栅极驱动块;以及连接至第二栅极线的多个第二栅极驱动块。
在第一栅极驱动块中的一个输出第一栅极信号的栅极导通周期期间,第二栅极驱动块可将第二栅极信号顺序地输出至第二栅极线。
在一个帧内,第一栅极驱动块可将第一栅极信号顺序地输出至第一栅极线。
当第一栅极驱动块分别输出第一栅极信号时,第二栅极驱动块可将第二栅极信号顺序地输出至第二栅极线。
在第二栅极信号被施加到第二栅极线的每个栅极导通周期内,第二栅极驱动块可在第一顺序与第二顺序之间交替地改变将第二栅极信号施加到第二栅极线的顺序,其中,第二顺序是第一顺序的逆顺序。
显示装置还可包括连接至第一栅极线和第二栅极线的多个像素,以及连接至像素的数据线。
数据线可共同地连接至设置在不同行和列中的像素。
数据线可包括第一数据线和第二数据线,第一数据线可共同地连接至多个第一像素,以及第二数据线可共同地连接至多个第二像素,其中,多个第一像素设置在包括像素的显示区域之中的为第一区的部分中,多个第二像素设置在显示区域之中的为第二区的另一部分中。
像素可包括第一颜色的多个第一像素、第二颜色的多个第二像素以及第三颜色的多个第三像素,并且数据线可包括共同地连接至第一像素的第一数据线、共同地连接至第二像素的第二数据线以及共同地连接至第三像素的第三数据线。
显示装置还可包括连接至第一栅极线和第二栅极线并且布置在第一方向和第二方向上的多个像素,其中,布置在第一方向上的像素的数量可根据第二方向变化。
实施方式可涉及显示装置。显示装置可包括第一类型栅极线、第二类型栅极线、第一数据线和第一像素。第一类型栅极线可包括第一栅极线,并且可彼此平行地延伸。第二类型栅极线包括第二栅极线,并且与第一栅极线交叉(在显示装置的平面图中)。第一像素包括第一开关晶体管和第二开关晶体管。第一开关晶体管包括第一栅电极、第一源电极和第一漏电极。第一栅电极电连接至第一栅极线。第一源电极电连接至第一数据线。第二开关晶体管包括第二栅电极、第二源电极和第二漏电极。第二栅电极电连接至第二栅极线。第二源电极电连接至第一漏电极。
显示装置可包括电连接至第二漏电极的液晶电容器。
显示装置可包括以下元件:电连接至第二开关晶体管的驱动晶体管;以及电连接至驱动晶体管的发光二极管。
第一栅极线可在像素行方向上延伸。第二栅极线可在像素列方向上延伸。
第一栅极线可在像素列方向上延伸。第二栅极线可在像素行方向上延伸。
第一类型栅极线可包括第三栅极线。电连接至第一栅极线的所有像素的总数量可不等于电连接至第三栅极线的所有像素的总数量。
显示装置可包括电连接至第一数据线的第二像素。第一类型栅极线可包括电连接至第二像素的第三栅极线。第二类型栅极线可包括电连接至第二像素的第四栅极线。
显示装置可包括以下元件:第一类型栅极驱动单元,分别电连接至第一类型栅极线以用于将第一类型栅极信号分别输出至第一类型栅极线;以及第二类型栅极驱动单元,分别电连接至第二类型栅极线以用于将第二类型栅极信号分别输出至第二类型栅极线。
当第一栅极线在第一栅极导通周期内继续将栅极导通电压的第一副本(copy)传输至第一像素时,第二类型栅极驱动单元中的一些或全部可在第一多个连续水平周期中顺序地输出栅极导通信号的第一多个副本。第一栅极导通周期的长度可等于第一多个连续水平周期的总长度。
第一类型栅极线可包括与第一栅极线紧邻的第三栅极线。当第三栅极线在第二栅极导通周期内继续传输栅极导通电压的第二副本时,第二类型栅极驱动单元中的一些或全部可在第二多个连续水平周期中顺序地输出栅极导通信号的第二多个副本。第二栅极导通周期的长度可等于第二多个连续水平周期的总长度。
第二类型栅极驱动单元中的一些或全部可以以第一顺序顺序地输出栅极导通信号的第一多个副本。第二类型栅极驱动单元中的一些或全部可以以第二顺序顺序地输出栅极导通信号的第二多个副本,其中,第二顺序是第一顺序的逆顺序。
实施方式可涉及显示装置。显示装置可包括以下元件:多个第一类型栅极线;与第一类型栅极线交叉的多个第二类型栅极线;分别电连接至第一类型栅极线的第一类型栅极驱动单元;以及分别电连接至第二类型栅极线的第二类型栅极驱动单元。
在第一类型栅极驱动单元中的一个输出第一栅极信号的第一副本的栅极导通周期期间,第二类型栅极驱动单元可将第二栅极信号的第一多个副本顺序地输出至第二类型栅极线。
在一个帧内,第一类型栅极驱动单元可将第一栅极信号的副本顺序地输出至第一类型栅极线。
当第一类型栅极驱动单元中的每个输出第一栅极信号的副本时,第二类型栅极驱动单元可将第二栅极信号的多个副本顺序地输出至第二类型栅极线。
在连续的栅极导通周期中,第二类型栅极驱动单元可以使将第二栅极信号的多个副本施加到第二类型栅极线的顺序在第一顺序与第二顺序之间交替,其中,第二顺序是第一顺序的逆顺序。
显示装置可包括以下元件:多个像素,具有电连接至第一类型栅极线和第二类型栅极线的栅电极,布置在像素行和像素列中并且包括第一像素,第一像素电连接至第一类型栅极线中的一个和第二类型栅极线中的一个二者;以及第一数据线,电连接至一些或全部所述像素的源电极。
第一数据线可电连接至位于像素行中的不同行中的像素,并且可电连接至位于像素列中的不同列中的像素。
显示装置可包括与第一数据线电绝缘(并且不电连接至第一数据线)的第二数据线。像素可包括第一区像素和第二区像素。第一区像素可位于显示装置的第一区中。第二区像素可位于显示装置的第二区域中。第一数据线可电连接至第一区像素中的每个。第二数据线可电连接至第二区像素中的每个。
显示装置可包括以下元件:与第一数据线电绝缘的第二数据线;以及与第一数据线和第二数据线中的每个电绝缘的第三数据线。像素可包括第一颜色的多个第一颜色像素、第二颜色的多个第二颜色像素和第三颜色的多个第三颜色像素。第一数据线可电连接至第一颜色像素中的每个的源电极。第二数据线可电连接至第二颜色像素中的每个的源电极。第三数据线可电连接至第三颜色像素中的每个的源电极。
显示装置可包括多个像素。像素中的每个可电连接至第一类型栅极线中的至少一个和第二类型栅极线中的至少一个。第一类型栅极线可包括第一栅极线和第二栅极线。电连接至第一栅极线的所有像素的总数量可以不等于电连接至第二栅极线的所有像素的总数量。
根据实施方式,显示装置可具有最小数量的数据线,可具有最小宽度的柔性电路板以及可具有期望的形状。
附图说明
图1示出根据实施方式的显示装置的框图。
图2示出根据实施方式的显示装置中包括的像素的电路图。
图3示出根据实施方式的显示装置的像素区域的俯视平面图。
图4示出根据实施方式的图3相对于线IV-IV的剖视图。
图5示出根据实施方式的显示装置中包括的第一栅极驱动器的框图。
图6示出根据实施方式的第一栅极驱动器中包括的第一栅极驱动块的电路图。
图7示出根据实施方式的显示装置中包括的第二栅极驱动器的框图。
图8示出根据实施方式的第二栅极驱动器中包括的第二栅极驱动块的电路图。
图9示出根据实施方式的用于驱动显示装置的方法的时序图。
图10示出根据实施方式的用于驱动显示装置的方法的时序图。
图11示出根据实施方式的显示装置的框图。
图12示出根据实施方式的像素的电路图。
图13示出根据实施方式的像素的电路图。
图14示出根据实施方式的像素的电路图。
图15示出根据实施方式的显示装置的框图。
图16示出根据实施方式的用于驱动显示装置的方法的时序图。
图17示出根据实施方式的根据用于驱动显示装置的方法的用于将数据信号输入到多个像素的顺序。
图18示出根据实施方式的用于驱动图15的显示装置的方法的时序图。
图19示出根据实施方式的根据用于驱动显示装置的方法的用于将数据信号输入到多个像素的顺序。
图20示出根据实施方式的用于驱动图15的显示装置的方法的时序图。
图21示出根据实施方式的根据用于驱动显示装置的方法的用于将数据信号输入到多个像素的顺序。
图22示出根据实施方式的用于驱动图15的显示装置的方法的时序图。
图23示出根据实施方式的根据用于驱动显示装置的方法的用于将数据信号输入到多个像素的顺序。
图24示出根据实施方式的显示装置的框图。
图25示出根据实施方式的用于驱动显示装置的方法的时序图。
图26示出根据实施方式的根据用于驱动显示装置的方法的用于将数据信号输入到多个像素的顺序。
图27示出根据实施方式的用于驱动显示装置的方法的时序图。
图28示出根据实施方式的根据用于驱动显示装置的方法的用于将数据信号输入到多个像素的顺序。
图29示出根据实施方式的显示装置的框图。
图30示出根据实施方式的用于驱动显示装置的方法的时序图。
图31示出根据实施方式的根据用于驱动显示装置的方法的用于将数据信号输入到多个像素的顺序。
图32示出根据实施方式的用于驱动显示装置的方法的时序图。
图33示出根据实施方式的根据用于驱动显示装置的方法的用于将数据信号输入到多个像素的顺序。
图34示出根据实施方式的显示装置的框图。
具体实施方式
参照附图描述实施方式。本领域技术人员将认识到,所描述的实施方式可以以各种方式进行修改。
尽管术语“第一”、“第二”等在本文中可用于描述各种元件,但这些元件不应受这些术语的限制。这些术语可用于将一个元件与另一元件区分开。因此,在不背离一个或多个实施方式的教导的情况下,以下论述的第一元件也可称为为第二元件。将元件描述为“第一”元件可不需要或暗示存在第二元件或其它元件。术语“第一”、“第二”等还可在本文中用于区分元件的不同类别或组。为了简明,术语“第一”、“第二”等可分别表示“第一类别(或第一组)”、“第二类别(或第二组)”等。
附图和描述本质上将被认为是说明性的而非限制性的。相同的附图标记可表示相同的元件。
附图中示出的尺寸和厚度是为了理解和描述,并且为了清楚可能被夸大。
当第一元件(诸如,层、膜、区或基板)被称作为“在”第二元件“上”时,第一元件可直接在第二元件上,或者第一元件与第二元件之间可存在至少一个中间元件。当第一元件被称作为“直接在”第二元件“上”时,第一元件与第二元件之间不存在预期的中间元件(除了诸如空气的环境元件之外)。词语“在……上”或“在……上方”意指位于对象上或对象上方,并且并不一定意指基于重力方向位于对象的上侧。
除非明确地做出相反描述,否则词语“包括(comprise)”和诸如“包括(comprises)”或“包括(comprising)”的变型可暗示包括所阐述的元件,但不排除任何其它元件。术语“连接”可意指“电连接”。
参照图1至图10描述根据本发明的示例性实施方式的显示装置。
图1示出根据实施方式的显示装置的框图。
参照图1,显示装置10包括信号控制器100、第一栅极驱动器210、第二栅极驱动器220、数据驱动器300和显示单元600。
信号控制器100从外部装置接收图像信号ImS和同步信号。图像信号ImS包括关于多个像素的亮度信息。亮度可具有1024(=210)、256(=28)或64(=26)灰度级。同步信号包括水平同步信号Hsync、竖直同步信号Vsync和主时钟信号MCLK。
信号控制器100根据图像信号ImS、水平同步信号Hsync、竖直同步信号Vsync和主时钟信号MCLK生成第一驱动控制信号CONT1、第二驱动控制信号CONT2和图像数据信号ImD。
信号控制器100根据每一帧的竖直同步信号Vsync区分图像信号ImS以及根据每一栅极线的水平同步信号Hsync区分图像信号ImS以生成图像数据信号ImD。信号控制器100将图像数据信号ImD连同第一驱动控制信号CONT1传输至数据驱动器300。
显示单元600是包括多个像素PX的显示区域。在显示单元600上,在第一方向x上延伸以基本上彼此平行的多个第一栅极线Gx1、Gx2、Gx3和Gx4、在第二方向y上延伸以基本上彼此平行的多个第二栅极线Gy1、Gy2、Gy3和Gy4以及数据线DL形成为连接至多个像素PX。数据线DL可包括在第一方向x上延伸的第一子数据线Dx和在第二方向y上从第一子数据线Dx延伸的多个第二子数据线Dy。多个像素PX可连接至多个第二子数据线Dy。第一子数据线Dx和多个第二子数据线Dy互相连接,使得多个像素PX可共同连接至一个数据线DL。换言之,设置在不同行和列中的像素PX可连接至相同的数据线DL。
第二方向y可以是与第一方向x交叉(traverse)的方向。第一方向x可以是行方向,以及第二方向y可以是列方向。第一方向x被示出为行方向以及第二方向y被示出为列方向,但是第一方向x可以是列方向以及第二方向y可以是行方向。为了便于描述,第一方向x可以是行方向,以及第二方向y可以是列方向。
多个像素PX可分别发射原色中的一种的光。原色可包括红色、绿色和蓝色,并且所期望的颜色可通过三原色的空间总和或时间总和来显示。颜色可通过红色像素、绿色像素和蓝色像素来显示,并且红色像素、绿色像素和蓝色像素的组合可被称作为像素。
第一栅极驱动器210连接至多个第一栅极线Gx1、Gx2、Gx3和Gx4,并且根据第二驱动控制信号CONT2生成多个第一栅极信号。第一栅极驱动器210可将具有栅极导通电压的多个第一栅极信号施加到多个第一栅极线Gx1、Gx2、Gx3和Gx4。
第二栅极驱动器220连接至多个第二栅极线Gy1、Gy2、Gy3和Gy4,并且根据第二驱动控制信号CONT2生成多个第二栅极信号。第二栅极驱动器220可将具有栅极导通电压的多个第二栅极信号施加到多个第二栅极线Gy1、Gy2、Gy3和Gy4。
在第一栅极驱动器210将具有栅极导通电压的第一栅极信号输出至多个第一栅极线Gx1、Gx2、Gx3和Gx4之一的第一栅极导通周期期间,第二栅极驱动器220可将具有栅极导通电压的多个第二栅极信号顺序地输出至多个第二栅极线Gy1、Gy2、Gy3和Gy4。
在实施方式中,在第二栅极驱动器220将具有栅极导通电压的第二栅极信号输出至多个第二栅极线Gy1、Gy2、Gy3和Gy4的第二栅极导通周期期间,第一栅极驱动器210可将具有栅极导通电压的多个第一栅极信号顺序地输出至多个第一栅极线Gx1、Gx2、Gx3和Gx4。
在本说明书的后面部分中将详细描述用于驱动第一栅极驱动器210和第二栅极驱动器220的方法。
数据驱动器300连接至数据线DL,根据第一驱动控制信号CONT1采样以及保持图像数据信号ImD,并且将数据信号施加到数据线DL。数据驱动器300在与施加到多个第一栅极线Gx1、Gx2、Gx3和Gx4和多个第二栅极线Gy1、Gy2、Gy3和Gy4的多个第一栅极信号和多个第二栅极信号变为栅极导通电压时的时间同步的时间将由图像数据信号ImD引起的数据信号施加到数据线DL。
为了便于描述,图1中示出了多个像素PX以四个设置在第一方向x和第二方向y上,并且连接至其的第一栅极线和第二栅极线设置为四个,但是在本发明中,像素PX的数量、第一栅极线的数量和第二栅极线的数量不受限制。
图2示出图1的显示装置中包括的像素的电路图。图2的电路图表示图1的显示装置10中包括的随机像素PX。
参照图2,像素PX包括第一开关晶体管M1、第二开关晶体管M2、液晶电容器Clc和存储电容器Cst。
第一开关晶体管M1包括连接至第一栅极线Gx(此处,第一栅极线Gx表示多个第一栅极线中的任意一个)的栅电极、连接至数据线DL的第一电极(或源电极)以及连接至第二开关晶体管M2的第二电极(或漏电极)。第一开关晶体管M1由施加到第一栅极线Gx的具有栅极导通电压的第一栅极信号导通,以将施加到数据线DL的数据信号传输至第二开关晶体管M2。
第二开关晶体管M2包括连接至第二栅极线Gy(此处,第二栅极线Gy表示多个第二栅极线中的任意一个)的栅电极、连接至第一开关晶体管M1的第一电极(或源电极)以及连接至液晶电容器Clc的第二电极(或漏电极)。第二开关晶体管M2由施加到第二栅极线Gy的具有栅极导通电压的第二栅极信号导通,以将通过第一开关晶体管M1传输的数据信号传输至液晶电容器Clc。
第一开关晶体管M1和第二开关晶体管M2可以是N-沟道电场效应晶体管。用于使N-沟道电场效应晶体管导通的栅极导通电压是高电平电压,以及用于使N-沟道电场效应晶体管截止的栅极截止电压是低电平电压。
在实施方式中,第一开关晶体管M1和第二开关晶体管M2可以是P-沟道电场效应晶体管。用于使P-沟道电场效应晶体管导通的栅极导通电压是低电平电压,以及用于使P-沟道电场效应晶体管截止的栅极截止电压是高电平电压。
第一开关晶体管M1和第二开关晶体管M2可以是N-沟道电场效应晶体管。
液晶电容器Clc包括将参照图3和图4描述的像素电极618、公共电极624和液晶层3。像素电极618可连接至第二开关晶体管M2,并且其可通过第二开关晶体管M2接收数据信号。公共电极624接收公共电压Vcom。液晶电容器Clc包括作为两个端子的像素电极618和公共电极624,并且像素电极618与公共电极624之间的液晶层3用作介电材料。
存储电容器Cst包括连接至液晶电容器Clc的第一电极和连接至公共电压Vcom的第二电极。
图3示出图1的显示装置的像素区域的俯视平面图。图4示出图3相对于线IV-IV的剖视图。图3可示出图1中示出的显示装置10中包括的一个像素PX的阵列。
参照图3和图4,显示装置10包括彼此面对的第一显示面板610和第二显示面板620以及设置在第一显示面板610与第二显示面板620之间的液晶层3。
描述第一显示面板610。
第一显示面板610包括设置在第一基板611上的第一栅极线Gx以及第二栅极线Gy、数据线DL、第一开关晶体管M1、第二开关晶体管M2、像素电极618和存储电极线StL。此处,第一基板611的顶部表示面对第二基板621的方向。
第一基板611可包括透明的玻璃或塑料。
第一栅极线Gx设置在第一基板611上,并且在第一方向x上延伸。第一栅极线Gx可包括第一栅电极612a。第一栅电极612a连接至第一栅极线Gx。第二栅电极612b可设置在与第一栅电极612a相同的层上,并且第二栅电极612b可在第一栅极线Gx和第一栅电极612a形成时一起形成。
栅极绝缘层613设置在第一栅极线Gx、第一栅电极612a和第二栅电极612b上。
半导体层614设置在栅极绝缘层613上。半导体层614可包括第一半导体614a和第二半导体614b。
数据线DL、第二栅极线Gy、存储电极线StL、第一开关晶体管M1的第一电极615a和第二电极616a以及第二开关晶体管M2的第一电极615b和第二电极616b设置在半导体层614上。
第一栅电极612a、第一电极615a、第二电极616a和第一半导体614a可配置第一开关晶体管M1。第一电极615a面对第二电极616a,且第一半导体614a的一部分位于第一电极615a与第二电极616a之间。第一电极615a和第二电极616a可与第一栅电极612a重叠,且第一半导体614a位于第一电极615a和第二电极616a中的每个与第一栅电极612a之间。第一开关晶体管M1的沟道形成在第一电极615a与第二电极616a之间的第一半导体614a上。
第二栅极线Gy在第二方向y上延伸,并且通过第二接触孔CH2连接至第二栅电极612b。第二接触孔CH2可设置在第二栅极线Gy与第二栅电极612b重叠的位置上。
第二栅电极612b、第一电极615b、第二电极616b和第二半导体614b可配置第二开关晶体管M2。第一电极615b面对第二电极616b,且第二半导体614b的一部分位于第一电极615b与第二电极616b之间。第一电极615b和第二电极616b可与第二栅电极612b重叠,且第二半导体614b位于第一电极615b和第二电极616b中的每个与第二栅电极612b之间。第二开关晶体管M2的沟道形成在第一电极615b与第二电极616b之间的第二半导体614b上。
第一开关晶体管M1的第一电极615a连接至在第二方向y上延伸的数据线DL。第一开关晶体管M1的第二电极616a连接至第二开关晶体管M2的第一电极615b。
存储电极线StL可在第二方向y上延伸。公共电压Vcom可施加到存储电极线StL,并且存储电极线StL可与像素电极618重叠以形成存储电容器Cst。此处,存储电极线StL在第二方向y上延伸。在实施方式中,存储电极线StL可具有在第一方向x上延伸的或与像素电极618重叠的特定图案。
钝化层617设置在数据线DL、第二栅极线Gy、存储电极线StL、第一开关晶体管M1的第一电极615a和第二电极616a以及第二开关晶体管M2的第一电极615b和第二电极616b上。钝化层617可以是无机绝缘层或有机绝缘体。钝化层617包括与第二开关晶体管M2的第二电极616b重叠的第一接触孔CH1。
像素电极618设置在钝化层617上。像素电极618通过第一接触孔CH1连接至第二开关晶体管M2的第二电极616b。像素电极618可包括诸如ITO(铟锡氧化物)或IZO(铟锌氧化物)的透明导电材料。像素电极618在图3中示出为包括多个分支电极,但是本发明不限于此,并且像素电极618可具有各种形式。
描述第二显示面板620。
第二显示面板620包括设置在第二基板621上的遮光构件622、滤色器623和公共电极624。此处,第二基板621的顶部表示面对第一基板611的方向。
遮光构件622设置成与数据线DL、第一栅极线Gx、第二栅极线Gy、第一开关晶体管M1和第二开关晶体管M2重叠。遮光构件622防止可能在数据线DL、第一栅极线Gx、第二栅极线Gy、第一开关晶体管M1和第二开关晶体管M2周围出现的光的泄露。
滤色器623可通常与像素电极618重叠,并且可与遮光构件622的一部分重叠。
公共电极624设置在滤色器623上。公共电极624可设置在第二基板621的整个侧面上,并且公共电压Vcom被施加到公共电极624。
液晶层3包括具有正介电各向异性或负介电各向异性的液晶分子,并且液晶分子通过像素电极618与公共电极624之间生成的电场而重新排列。
图5示出图1的显示装置中包括的第一栅极驱动器的框图。
参照图5,第一栅极驱动器210包括多个第一栅极驱动块210-1、210-2、210-3和210-4。
多个第一栅极驱动块210-1、210-2、210-3和210-4分别包括第一输入端IN1、第二输入端IN2、时钟信号输入端CK、驱动电压输入端Voff和输出端OUT。
多个第一栅极驱动块210-1、210-2、210-3和210-4可分别连接至多个第一栅极线Gx1、Gx2、Gx3和Gx4。多个第一栅极驱动块210-1、210-2、210-3和210-4可接收第一驱动电压VSS,并且可顺序地输出与第一时钟信号CKV1和第二时钟信号CKVB1同步的多个第一栅极信号Sx[1]、Sx[2]、Sx[3]和Sx[4]。第二时钟信号CKVB1可以是第一时钟信号CKV1的逆时钟信号。
多个第一栅极驱动块210-1、210-2、210-3和210-4的第一输入端IN1接收第一栅极起始信号STV1或先前输出的第一栅极信号Sx[1]、Sx[2]或Sx[3]。连接至第一行中的第一栅极线Gx1的第一栅极驱动块210-1的第一输入端IN1可接收第一栅极起始信号STV1,以及剩余的第一栅极驱动块210-2、210-3和210-4的第一输入端IN1可接收前一级的第一栅极驱动块210-1、210-2和210-3的第一栅极信号Sx[1]、Sx[2]和Sx[3]。
多个第一栅极驱动块210-1、210-2和210-3的第二输入端IN2接收下一级的第一栅极驱动块210-2、210-3和210-4的第一栅极信号Sx[2]、Sx[3]和Sx[4]。最后级的第一栅极驱动块210-4的第二输入端IN2可从下一级的虚设第一栅极驱动块(未示出)接收第一栅极信号。
虚设第一栅极驱动块可接收第一栅极信号Sx[4]、第一时钟信号CKV1和第一驱动电压VSS以生成第一栅极信号。
多个第一栅极驱动块210-1、210-2、210-3和210-4的时钟信号输入端CK接收第一时钟信号CKV1或第二时钟信号CKVB1。奇数行中的第一栅极驱动块210-1和210-3的时钟信号输入端CK接收第一时钟信号CKV1,以及偶数行中的第一栅极驱动块210-2和210-4的时钟信号输入端CK可接收第二时钟信号CKVB1。
多个第一栅极驱动块210-1、210-2、210-3和210-4的各驱动电压输入端Voff可接收第一驱动电压VSS。第一驱动电压VSS可以是栅极截止电压。
多个第一栅极驱动块210-1、210-2、210-3和210-4的输出端OUT分别连接至多个第一栅极线Gx1、Gx2、Gx3和Gx4。
图6示出图5的第一栅极驱动器中包括的第一栅极驱动块的电路图。图6的电路图表示多个第一栅极驱动块之中的一个第一栅极驱动块210-k。
参照图6,第一栅极驱动块210-k包括第一晶体管M11、第二晶体管M12、第三晶体管M13、第四晶体管M14和第一电容器C11。
第一晶体管M11包括连接至第一节点N11的栅电极、连接至时钟信号输入端CK的第一电极以及连接至输出端OUT的第二电极。
第二晶体管M12包括连接至第二输入端IN2的栅电极、连接至驱动电压输入端Voff的第一电极以及连接至输出端OUT的第二电极。
第三晶体管M13包括连接至第一输入端IN1的栅电极、连接至第一输入端IN1的第一电极以及连接至第一节点N11的第二电极。
第四晶体管M14包括连接至第二输入端IN2的栅电极、连接至驱动电压输入端Voff的第一电极以及连接至第一节点N11的第二电极。
第一晶体管M11、第二晶体管M12、第三晶体管M13和第四晶体管M14可以是N-沟道电场效应晶体管。在实施方式中,第一晶体管M11、第二晶体管M12、第三晶体管M13和第四晶体管M14可以是P-沟道电场效应晶体管。
第一电容器C11包括连接至第一节点N11的第一电极和连接至输出端OUT的第二电极。
当第一输入端IN1接收第一栅极起始信号STV1或具有栅极导通电压的第一栅极信号Sx[k-1]时,第三晶体管M13导通,并且栅极导通电压传输至第一节点N11。通过第一节点N11处的栅极导通电压,第一晶体管M11导通,并且输入到时钟信号输入端CK的时钟信号作为具有栅极导通电压的第一栅极信号Sx[k]输出至输出端OUT。第一电容器C11可存储第一节点N11处的栅极导通电压,以维持第一晶体管M11的导通状态。在此情况中,第二输入端IN2接收栅极截止电压以使第二晶体管M12和第四晶体管M14截止。
当输出端OUT输出第一栅极信号Sx[k]以及第二输入端IN2接收具有栅极导通电压的第一栅极信号Sx[k+1]时,第二晶体管M12和第四晶体管M14导通,并且具有栅极截止电压的第一驱动电压VSS传输至输出端OUT和第一节点N11。输出端OUT输出具有栅极截止电压的第一栅极信号Sx[k]。第一晶体管M11通过第一节点N11处的栅极截止电压截止。
图7示出图1的显示装置中可包括的第二栅极驱动器的框图。
参照图7,第二栅极驱动器220包括多个第二栅极驱动块220-1、220-2、220-3和220-4。
多个第二栅极驱动块220-1、220-2、220-3和220-4分别包括第一输入端IN1'、第二输入端IN2'、时钟信号输入端CK'、驱动电压输入端Voff'和输出端OUT'。
多个第二栅极驱动块220-1、220-2、220-3和220-4可分别连接至多个第二栅极线Gy1、Gy2、Gy3和Gy4。多个第二栅极驱动块220-1、220-2、220-3和220-4可接收第一驱动电压VSS,并且可顺序地输出与第三时钟信号CKV2和第四时钟信号CKVB2同步的多个第二栅极信号Sy[1]、Sy[2]、Sy[3]和Sy[4]。第四时钟信号CKVB2可以是第三时钟信号CKV2的逆时钟信号。
多个第二栅极驱动块220-1、220-2、220-3和220-4的第一输入端IN1'接收第二栅极起始信号STV2或先前输出的第二栅极信号Sy[1]、Sy[2]或Sy[3]。连接至第一列的第二栅极线Gy1的第二栅极驱动块220-1的第一输入端IN1'可接收第二栅极起始信号STV2,以及剩余的第二栅极驱动块220-2、220-3和220-4的第一输入端IN1'可接收前一级的第二栅极驱动块220-1、220-2和220-3的第二栅极信号Sy[1]、Sy[2]和Sy[3]。
多个第二栅极驱动块220-1、220-2和220-3的第二输入端IN2'接收下一级的第二栅极驱动块220-2、220-3和220-4的第二栅极信号Sy[2]、Sy[3]和Sy[4]。最后级的第二栅极驱动块220-4的第二输入端IN2'可从下一级的虚设第二栅极驱动块未示出接收第二栅极信号。
虚设第二栅极驱动块可接收第二栅极信号Sy[4]、第三时钟信号CKV2和第一驱动电压VSS以生成第二栅极信号。
多个第二栅极驱动块220-1、220-2、220-3和220-4的时钟信号输入端CK'接收第三时钟信号CKV2或第四时钟信号CKVB2。奇数列中的第二栅极驱动块220-1和220-3的时钟信号输入端CK'可接收第三时钟信号CKV2,以及偶数列中的第二栅极驱动块220-2和210-4的时钟信号输入端CK'可接收第四时钟信号CKVB2。
多个第二栅极驱动块220-1、220-2、220-3和220-4的驱动电压输入端Voff'可接收第一驱动电压VSS。第一驱动电压VSS可以是栅极截止电压。
多个第二栅极驱动块220-1、220-2、220-3和220-4的输出端OUT'分别连接至多个第二栅极线Gy1、Gy2、Gy3和Gy4。
图8示出图7的第二栅极驱动器中包括的第二栅极驱动块的电路图。图8的电路图表示多个第二栅极驱动块中的一个第二栅极驱动块220-k。
参照图8,第二栅极驱动块220-k包括第一晶体管M21、第二晶体管M22、第三晶体管M23、第四晶体管M24和第一电容器C21。
第一晶体管M21包括连接至第一节点N21的栅电极、连接至时钟信号输入端CK'的第一电极以及连接至输出端OUT'的第二电极。
第二晶体管M22包括连接至第二输入端IN2'的栅电极、连接至驱动电压输入端Voff'的第一电极以及连接至输出端OUT'的第二电极。
第三晶体管M23包括连接至第一输入端IN1'的栅电极、连接至第一输入端IN1'的第一电极以及连接至第一节点N21的第二电极。
第四晶体管M24包括连接至第二输入端IN2'的栅电极、连接至驱动电压输入端Voff'的第一电极以及连接至第一节点N21的第二电极。
第一晶体管M21、第二晶体管M22、第三晶体管M23和第四晶体管M24可以是N-沟道电场效应晶体管。在实施方式中,第一晶体管M21、第二晶体管M22、第三晶体管M23和第四晶体管M24可以是P-沟道电场效应晶体管。
第一电容器C21包括连接至第一节点N21的第一电极和连接至输出端OUT'的第二电极。
当第一输入端IN1'接收第二栅极起始信号STV2或具有栅极导通电压的第二栅极信号Sy[k-1]时,第三晶体管M23导通,并且栅极导通电压传输至第一节点N21。通过第一节点N21处的栅极导通电压,第一晶体管M21导通,并且输入到时钟信号输入端CK'的时钟信号作为具有栅极导通电压的第二栅极信号Sy[k]输出至输出端OUT'。第一电容器C21可存储第一节点N21处的栅极导通电压,以维持第一晶体管M21的导通状态。在此情况中,第二输入端IN2'接收栅极截止电压以使第二晶体管M22和第四晶体管M24截止。
当输出端OUT'输出第二栅极信号Sy[k]并且第二输入端IN2'接收具有栅极导通电压的第二栅极信号Sy[k+1]时,第二晶体管M22和第四晶体管M24导通,并且具有栅极截止电压的第一驱动电压VSS传输至输出端OUT'和第一节点N21。输出端OUT'输出具有栅极截止电压的第二栅极信号Sy[k]。第一晶体管M21通过第一节点N21处的栅极截止电压截止。
参照图9描述用于参照图1至图8描述的显示装置10通过数据线DL向多个像素PX施加数据信号的方法。
图9示出根据实施方式的用于驱动图1的显示装置的方法的时序图。
参照图9,第一时钟信号CKV1和第二时钟信号CKVB1可以是在每一个水平周期1H内具有可改变为栅极导通电压或栅极截止电压的电平的时钟信号。在此情况中,第一时钟信号CKV1和第二时钟信号CKVB1的相位可以是相反的。一个水平周期1H可以与水平同步信号Hsync的一个周期相同。
第三时钟信号CKV2和第四时钟信号CKVB2可以是在每个栅极导通周期OnP内具有可改变为栅极导通电压或栅极截止电压的电平的时钟信号。在此情况中,第三时钟信号CKV2和第四时钟信号CKVB2的相位可以是相反的。
栅极导通周期OnP可建立为其中向多个第一栅极线Gx1、Gx2、Gx3和Gx4输出一次具有栅极导通电压的第一栅极信号Sx[1]、Sx[2]、Sx[3]和Sx[4]的周期。多个第二栅极驱动块220-1、220-2、220-3和220-4可顺序地分别输出在栅极导通周期OnP期间具有栅极导通电压的第二栅极信号Sy[1]、Sy[2]、Sy[3]和Sy[4]。
图1中示出的显示装置10包括四个第一栅极线Gx1、Gx2、Gx3和Gx4,并且在一个水平周期1H内具有栅极导通电压的第一栅极信号Sx[1]、Sx[2]、Sx[3]和Sx[4]分别施加到四个第一栅极线Gx1、Gx2、Gx3和Gx4,因而栅极导通周期OnP变为四个水平周期。
第一时钟信号CKV1和第二时钟信号CKVB1的周期可变为两个水平周期,以及第三时钟信号CKV2和第四时钟信号CKVB2的周期可变为八个水平周期。当第一栅极线的数量设置为n时,第三时钟信号CKV2和第四时钟信号CKVB2的周期变为第一时钟信号CKV1和第二时钟信号CKVB1的周期的n倍。
在每个栅极导通周期OnP内,第一栅极起始信号STV1与栅极导通周期OnP的起始点同步地增大为栅极导通电压,并且其可根据第一时钟信号CKV1或第二时钟信号CKVB1的栅极导通电压的占空(duty)将栅极导通电压维持至少一个水平周期1H。
在每个帧内,第二栅极起始信号STV2与一个帧的起始点同步地增大为栅极导通电压,并且其可根据第三时钟信号CKV2或第四时钟信号CKVB2的栅极导通电压的占空将栅极导通电压维持至少四个水平周期。
在一个帧期间,通过第二栅极起始信号STV2、第三时钟信号CKV2和第四时钟信号CKVB2,多个第二栅极驱动块220-1、220-2、220-3和220-4可顺序地输出在每个栅极导通周期OnP单元内具有栅极导通电压的第二栅极信号Sy[1]、Sy[2]、Sy[3]和Sy[4]。
在每个栅极导通周期OnP内,通过第一栅极起始信号STV1、第一时钟信号CKV1和第二时钟信号CKVB1、多个第一栅极驱动块210-1、210-2、210-3和210-4可顺序地输出在连续的水平周期1H内各自具有栅极导通电压的第一栅极信号Sx[1]、Sx[2]、Sx[3]和Sx[4]。
数据信号DATA与具有栅极导通电压的多个第一栅极信号Sx[1]、Sx[2]、Sx[3]和Sx[4]同步地施加到数据线DL。数据信号DATA可通过像素PX的由具有栅极导通电压的第一栅极信号Sx[1]、Sx[2]、Sx[3]和Sx[4]和具有栅极导通电压的第二栅极信号Sy[1]、Sy[2]、Sy[3]和Sy[4]导通的第一开关晶体管M1和第二开关晶体管M2传输至液晶电容器Clc。
图10示出根据实施方式的用于驱动图1的显示装置的方法的时序图。
参照图10,第三时钟信号CKV2和第四时钟信号CKVB2可以是在每一个水平周期1H内具有可改变为栅极导通电压或栅极截止电压的电平的时钟信号。在此情况中,第三时钟信号CKV2和第四时钟信号CKVB2的相位可以是相反的。
第一时钟信号CKV1和第二时钟信号CKVB1可以是在每个栅极导通周期OnP'内具有可改变为栅极导通电压或栅极截止电压的电平的时钟信号。在此情况中,第一时钟信号CKV1和第二时钟信号CKVB1的相位可以是相反的。
栅极导通周期OnP'可建立为其中向多个第二栅极线Gy1、Gy2、Gy3和Gy4输出一次具有栅极导通电压的第二栅极信号Sy[1]、Sy[2]、Sy[3]和Sy[4]的周期。多个第一栅极驱动块210-1、210-2、210-3和210-4可顺序地输出在栅极导通周期OnP'期间具有栅极导通电压的第一栅极信号Sx[1]、Sx[2]、Sx[3]和Sx[4]。
图1中示出的显示装置10包括四个第二栅极线Gy1、Gy2、Gy3和Gy4,并且在一个水平周期1H内具有栅极导通电压的第二栅极信号Sy[1]、Sy[2]、Sy[3]和Sy[4]分别施加到四个第二栅极线Gy1、Gy2、Gy3和Gy4,因而栅极导通周期OnP'变为四个水平周期。
第一时钟信号CKV1和第二时钟信号CKVB1的周期可变为八个水平周期,以及第三时钟信号CKV2和第四时钟信号CKVB2的周期可变为两个水平周期。当第二栅极线的数量设置为m时,第一时钟信号CKV1和第二时钟信号CKVB1的周期变为第三时钟信号CKV2和第四时钟信号CKVB2的周期的m倍。
在每个帧内,第一栅极起始信号STV1与一个帧的起始点同步地增大为栅极导通电压,并且其可根据第一时钟信号CKV1或第二时钟信号CKVB1的占空将栅极导通电压维持至少四个水平周期。
在每个栅极导通周期OnP'内,第二栅极起始信号STV2与栅极导通周期OnP'的起始点同步地增大为栅极导通电压,并且其可根据第三时钟信号CKV2或第四时钟信号CKVB2的栅极导通电压的占空将栅极导通电压维持至少一个水平周期1H。
在一个帧内,通过第一栅极起始信号STV1、第一时钟信号CKV1和第二时钟信号CKVB1,多个第一栅极驱动块210-1、210-2、210-3和210-4可顺序地输出在每个栅极导通周期OnP'内具有栅极导通电压的第一栅极信号Sx[1]、Sx[2]、Sx[3]和Sx[4]。
在每个栅极导通周期OnP'内,通过第二栅极起始信号STV2、第三时钟信号CKV2和第四时钟信号CKVB2,多个第二栅极驱动块220-1、220-2、220-3和220-4可顺序地输出在相应的水平周期1H单元内各自具有栅极导通电压的第二栅极信号Sy[1]、Sy[2]、Sy[3]和Sy[4]。
数据信号DATA与具有栅极导通电压的多个第二栅极信号Sy[1]、Sy[2]、Sy[3]和Sy[4]同步地施加到数据线DL。数据信号DATA可通过像素PX的由具有栅极导通电压的第一栅极信号Sx[1]、Sx[2]、Sx[3]和Sx[4]及具有栅极导通电压的第二栅极信号Sy[1]、Sy[2]、Sy[3]和Sy[4]导通的第一开关晶体管M1和第二开关晶体管M2传输至液晶电容器Clc。
如上所述,以矩阵形式布置的多个像素PX连接至一个数据线DL,并且数据信号DATA可通过一个数据线DL施加到多个像素PX。因此,当数据驱动器300和显示单元600与柔性电路板连接时,一个数据线DL可通过柔性电路板连接至显示单元600,从而减小柔性电路板的宽度。
参照图11描述根据实施方式的显示装置。
图11示出根据实施方式的显示装置的框图。
参照图11,第二子数据线Dy在第二方向y上沿着一个像素列延伸,第一子数据线Dx在第一方向x上从第二子数据线Dy的端部延伸至下一像素列。以这种方式,第一子数据线Dx可交替地布置在像素列的端部处,并且相同像素列中的像素PX可共同连接至相同的第二子数据线Dy。
除了上述说明的差异之外,参照图1至图10描述的实施方式的特征可适用于参照图11描述的实施方式。
参照图12至图14描述根据实施方式的像素。
图12示出根据实施方式的像素的电路图。
参照图12,像素PX包括第一开关晶体管M1、第二开关晶体管M2、液晶电容器Clc和存储电容器Cst。
第一开关晶体管M1包括连接至第二栅极线Gy的栅电极、连接至数据线DL的第一电极以及连接至第二开关晶体管M2的第二电极。第一开关晶体管M1由施加到第二栅极线Gy的具有栅极导通电压的第二栅极信号导通,以将施加到数据线DL的数据信号传输至第二开关晶体管M2。
第二开关晶体管M2包括连接至第一栅极线Gx的栅电极、连接至第一开关晶体管M1的第一电极以及连接至液晶电容器Clc的第二电极。第二开关晶体管M2由施加到第一栅极线Gx的具有栅极导通电压的第一栅极信号导通,以将通过第一开关晶体管M1传输的数据信号传输至液晶电容器Clc。
除了上述说明的差异之外,参照图2描述的实施方式的特征可适用于参照图12描述的实施方式。
图13示出根据实施方式的像素的电路图。
参照图13,像素PX包括第一开关晶体管M1、第二开关晶体管M2、驱动晶体管M3、存储电容器Cst'和发光二极管LED。
第一开关晶体管M1包括连接至第一栅极线Gx的栅电极、连接至数据线DL的第一电极以及连接至第二开关晶体管M2的第二电极。第一开关晶体管M1由施加到第一栅极线Gx的具有栅极导通电压的第一栅极信号导通,以将通过数据线DL传输的数据信号传输至第二开关晶体管M2。
第二开关晶体管M2包括连接至第二栅极线Gy的栅电极、连接至第一开关晶体管M1的第一电极以及连接至驱动晶体管M3的第二电极。第二开关晶体管M2由施加到第二栅极线Gy的具有栅极导通电压的第二栅极信号导通,以将通过第一开关晶体管M1传输的数据信号传输至驱动晶体管M3。
驱动晶体管M3包括连接至第二开关晶体管M2的栅电极、连接至第一电源电压ELVDD的第一电极以及连接至发光二极管LED的第二电极。驱动晶体管M3将来自第一电源电压ELVDD的与通过第二开关晶体管M2传输的数据信号对应的电流传输至发光二极管LED。驱动晶体管M3可以是N-沟道电场效应晶体管。在实施方式中,驱动晶体管M3可以是P-沟道电场效应晶体管。
存储电容器Cst'包括连接至驱动晶体管M3的栅电极的第一电极和连接至第一电源电压ELVDD的第二电极。
发光二极管LED包括连接至驱动晶体管M3的阳极和连接至第二电源电压ELVSS的阴极。发光二极管LED可通过从驱动晶体管M3传输的电流来发射原色中的一种的光。发光二极管LED可以是包括有机化合物的发射层的有机发光二极管。在实施方式中,发光二极管LED可以是包括无机化合物的发射层的无机发光二极管。
图14示出根据实施方式的像素的电路图。
参照图14,像素PX包括第一开关晶体管M1、第二开关晶体管M2、驱动晶体管M3、存储电容器Cst'和发光二极管LED。
第一开关晶体管M1包括连接至第二栅极线Gy的栅电极、连接至数据线DL的第一电极以及连接至第二开关晶体管M2的第二电极。第一开关晶体管M1由施加到第二栅极线Gy的具有栅极导通电压的第二栅极信号导通,以将通过数据线DL传输的数据信号传输至第二开关晶体管M2。
第二开关晶体管M2包括连接至第一栅极线Gx的栅电极、连接至第一开关晶体管M1的第一电极以及连接至驱动晶体管M3的第二电极。第二开关晶体管M2由施加到第一栅极线Gx的具有栅极导通电压的第一栅极信号导通,以将通过第一开关晶体管M1传输的数据信号传输至驱动晶体管M3。
除了上述说明的差异之外,参照图13描述的实施方式的的特征可适用于参照图14描述的实施方式。
以图15的显示装置作为示例描述用于驱动显示装置的各种方法和用于将数据信号输入到多个像素的顺序。
图15示出根据实施方式的显示装置的框图。
参照图15,显示装置10包括在第一方向x上延伸的多个第一栅极线Gx1至Gx6、在第二方向y上延伸的多个第二栅极线Gy1至Gy15、连接至多个第一栅极线Gx1至Gx6的第一栅极驱动器210、连接至多个第二栅极线Gy1至Gy15的第二栅极驱动器220、多个像素PX和连接至多个像素PX的数据线DL。第一栅极驱动器210包括连接至多个第一栅极线Gx1至Gx6的多个第一栅极驱动块210-1至210-6。第二栅极驱动器220包括连接至多个第二栅极线Gy1至Gy15的多个第二栅极驱动块220-1至220-15。数据线DL从数据驱动器300延伸并且连接至多个像素PX中的每个像素PX。
在该图中,示出为与第一栅极线Gx1至Gx6、第二栅极线Gy1至Gy15和数据线DL重叠的相应像素PX表示连接至第一栅极线Gx1至Gx6、第二栅极线Gy1至Gy15和数据线DL的像素PX。
除了多个第一栅极线的数量、多个第二栅极线的数量、多个第一栅极驱动块的数量、多个第二栅极驱动块的数量和像素PX的数量之外,图15的显示装置10可与图1的显示装置10基本上对应。
图16示出根据实施方式的用于驱动图15的显示装置的方法的时序图。图17示出根据图16的用于驱动显示装置的方法的用于将数据信号输入到多个像素的顺序。
参照图16和图17,在一个帧内,多个第二栅极驱动块220-1至220-15顺序地输出在每个栅极导通周期OnP内具有栅极导通电压的第二栅极信号Sy[1]至Sy[15]。
在每个栅极导通周期OnP内,多个第一栅极驱动块210-1至210-6顺序地输出在连续的水平周期1H内各自具有栅极导通电压的第一栅极信号Sx[1]至Sx[6]。多个数据信号DATA与具有栅极导通电压的多个第一栅极信号Sx[1]至Sx[6]同步地施加。
如图17中所示,根据用于驱动显示装置10的方法,数据信号DATA可以以从每个列的第一行x1到最后行x6的第一顺序顺序地输入。
在实施方式中,第一顺序表示列方向上的顺序,即,在第二方向y上的从上至下的顺序。在实施方式中,第一顺序可表示从施加到第一行x1的第一栅极线Gx1的第一栅极信号Sx[1]至施加到最后行x6的第一栅极线Gx6的第一栅极信号Sx[6]顺序。
数据信号DATA在第一列y1中以第二方向y上从第一行x1和第一列y1的像素PX至第六行x6和第一列y1的像素PX的第一顺序输入,并且然后在第二列y2中以第二方向y上从第一行x1和第二列y2的像素PX至第六行x6和第二列y2的像素PX的第一顺序输入。以这种方式,数据信号DATA可以以第一顺序输入到最后列y15。换言之,数据信号DATA可以按图17中示出的箭头的前进方向顺序地输入到多个像素PX。
图18示出根据实施方式的用于驱动图15的显示装置的方法的时序图。图19示出根据图18的用于驱动显示装置的方法的用于将数据信号输入到多个像素的顺序。
参照图18和图19,在一个帧内,多个第二栅极驱动块220-1至220-15顺序地输出在每个栅极导通周期OnP内具有栅极导通电压的第二栅极信号Sy[1]至Sy[15]。
在每个栅极导通周期OnP内,多个第一栅极驱动块210-1至210-6顺序地输出在所有连续的水平周期1H内具有栅极导通电压的第一栅极信号Sx[1]至Sx[6],并且在连续的栅极导通周期OnP内,用于将多个第一栅极信号Sx[1]至Sx[6]施加到多个第一栅极线Gx1至Gx6的顺序在第一顺序与第二顺序之间交替。
下文中,第二顺序将表示列方向,即,在第二方向y上的从下至上的顺序。在实施方式中,第二顺序可以是从施加到最后行x6的第一栅极线Gx6的第一栅极信号Sx[6]至施加到第一行x1的第一栅极线Gx1的第一栅极信号Sx[1]的顺序。第二顺序是第一顺序的逆顺序。
数据信号DATA与具有栅极导通电压的多个第一栅极信号Sx[1]至Sx[6]同步地施加。
如图19中所示,根据用于驱动显示装置的方法,数据信号DATA在奇数列y1、y3、y5......y15中以从第一行x1至最后行x6的第一顺序输入到像素PX,其在偶数列y2、y4、y6......y14中以从最后行x6至第一行x1的第二顺序输入到像素PX,并且可从第一列y1至最后列y15执行数据信号DATA的输入。换言之,数据信号DATA可以按图19中示出的箭头的前进方向顺序地输入到多个像素PX。
另一方面,用于交替地以第一顺序和第二顺序输出多个第一栅极信号Sx[1]至Sx[6]的第一栅极驱动器210可使用用于以第一顺序和第二顺序输出栅极信号的双向栅极驱动装置。
图20示出根据实施方式的用于驱动图15的显示装置的方法的时序图。图21示出根据图20的用于驱动显示装置的方法的用于将数据信号输入到多个像素的顺序。
参照图20和图21,在一个帧内,多个第一栅极驱动块210-1至210-6顺序地输出在每个栅极导通周期OnP'内各自具有栅极导通电压的第一栅极信号Sx[1]至Sx[6]。
在每个栅极导通周期OnP'内,多个第二栅极驱动块220-1至220-15顺序地输出在相应的水平周期1H内各自具有栅极导通电压的第二栅极信号Sy[1]至Sy[15]。多个数据信号DATA与具有栅极导通电压的多个第二栅极信号Sy[1]至Sy[15]同步地施加。
如图21中所示,根据用于驱动显示装置10的方法,数据信号DATA可以以从每一行的第一列y1至最后列y15的第三顺序输入。
下文中,第三顺序表示在行方向上的从左至右的顺序。在实施方式中,第三顺序可表示从施加到第一列y1的第二栅极线Gy1的第二栅极信号Sy[1]至施加到最后列y15的第二栅极线Gy15的第二栅极信号Sy[15]的顺序。
数据信号DATA在第一行x1中以第一方向x上从第一行x1和第一列y1的像素PX至第一行x1和第十五列y15的像素PX的第三顺序输入,并且数据信号DATA在第二行x2中以第一方向x上从第二行x2和第一列y1的像素PX至第二行x2和第十五列y15的像素PX的第三顺序输入。以这种方式,数据信号DATA可以以第三顺序输入到最后行x6。换言之,数据信号DATA可以按图21中示出的箭头的前进方向顺序地输入到多个像素PX。
图22示出根据实施方式的用于驱动图15的显示装置的方法的时序图。图23示出根据用于驱动图15的显示装置的方法的用于将数据信号输入到多个像素的顺序。
参照图22和图23,在一个帧内,多个第一栅极驱动块210-1至210-6顺序地输出在每个栅极导通周期OnP'内具有栅极导通电压的第一栅极信号Sx[1]至Sx[6]。
在每个栅极导通周期OnP'内,多个第二栅极驱动块220-1至220-15顺序地输出在连续的水平周期1H内各自具有栅极导通电压的第二栅极信号Sy[1]至Sy[15],并且在每个栅极导通周期OnP'内,用于将多个第二栅极信号Sy[1]至Sy[15]施加到多个第二栅极线Gy1至Gy15的顺序在第三顺序与第四顺序之间交替地变化。
在实施方式中,第四顺序表示行方向,即,第一方向x上的从右至左的顺序。在实施方式中,第四顺序可以是从施加到最后列y15的第二栅极线Gy15的第二栅极信号Sy[15]至施加到第一列y1的第二栅极线Gy1的第二栅极信号Sy[1]的顺序。第四顺序是第三顺序的逆顺序。
数据信号DATA与具有栅极导通电压的多个第二栅极信号Sy[1]至Sy[15]同步地施加。
如图23中所示,根据用于驱动显示装置的方法,数据信号DATA在奇数行x1、x3和x5中以从第一列y1至最后列y15的第三顺序输入到像素PX,其在偶数行x2、x4和x6中以从最后列y15至第一列y1的第四顺序输入到像素PX,以及可从第一行x1至最后行x6执行数据信号DATA的输入。换言之,数据信号DATA可以按图23中示出的箭头的前进方向输入到多个像素PX。
以图24的显示装置作为示例描述用于驱动显示装置的方法和用于将数据信号输入到多个像素的顺序。
图24示出根据实施方式的显示装置的框图。描述与参照图15描述的显示装置的差异。
参照图24,第二栅极驱动器220包括第一子栅极驱动器220A、第二子栅极驱动器220B和第三子栅极驱动器220C。
多个第二栅极线Gy1至Gy15之中的第二栅极线Gy1至Gy5可连接至第一子栅极驱动器220A,第二栅极线Gy6至Gy10可连接至第二子栅极驱动器220B以及第二栅极线Gy11至Gy15可连接至第三子栅极驱动器220C。
第一子栅极驱动器220A可包括连接至多个第二栅极线Gy1至Gy15的多个第二栅极驱动块220A-1至220A-5。第二子栅极驱动器220B可包括连接至多个第二栅极线Gy6至Gy10的多个第二栅极驱动块220B-1至220B-5。第三子栅极驱动器220C可包括连接至第二栅极线Gy11至Gy15的多个第二栅极驱动块220C-1至220C-5。
连接至数据驱动器300的数据线可包括第一数据线DL1、第二数据线DL2和第三数据线DL3,其中,第一数据线DL1连接至连接至第二栅极线Gy1至Gy5的多个像素PX,第二数据线DL2连接至连接至第二栅极线Gy6至Gy10的多个像素PX,第三数据线DL3连接至连接至第二栅极线Gy11至Gy15的多个像素PX。
连接至第一数据线DL1和第二栅极线Gy1至Gy5的多个像素PX可占据显示区域中为第一区A的部分。连接至第第二数据线DL2和第二栅极线Gy6至Gy10的多个像素PX可占据显示区域中为第二区B的另一部分。连接至第三数据线DL3和第二栅极线Gy11至Gy15的多个像素PX可占据显示区域中为第三区C的其它部分。
换言之,第一数据线DL1可连接至设置在第一区A中的所有像素PX,第二数据线DL2可连接至设置在第二区B中的所有像素PX,以及第三数据线DL3可连接至设置在第三区C中的所有像素PX。另外,第一子栅极驱动器220A可通过第二栅极线Gy1至Gy5连接至设置在第一区A中的多个像素PX,第二子栅极驱动器220B可通过第二栅极线Gy6至Gy10连接至设置在第二区B中的多个像素PX,以及第三子栅极驱动器220C可通过第二栅极线Gy11至Gy15连接至设置在第三区C中的多个像素PX。
除了上述说明的差异之外,参照图15描述的实施方式的特征适用于参照图24描述的实施方式。
图25示出根据实施方式的用于驱动图24的显示装置的方法的时序图。图26示出根据图25的用于驱动显示装置的方法的用于将数据信号输入到多个像素的顺序。
参照图25和图26,在一个帧内,第一子栅极驱动器220A的多个第二栅极驱动块220A-1至220A-5顺序地输出在每个栅极导通周期OnP内具有栅极导通电压的第二栅极信号SyA[1]至SyA[5]。在一个帧内,第二子栅极驱动器220B的多个第二栅极驱动块220B-1至220B-5顺序地输出在每个栅极导通周期OnP内具有栅极导通电压的第二栅极信号SyB[1]至SyB[5]。在一个帧内,第三子栅极驱动器220C的多个第二栅极驱动块220C-1至220C-5顺序地输出在每个栅极导通周期OnP内具有栅极导通电压的第二栅极信号SyC[1]至SyC[5]。如所描述的,第一子栅极驱动器220A、第二子栅极驱动器220B和第三子栅极驱动器220C可在相同的栅极导通周期OnP中分别输出具有栅极导通电压的第二栅极信号SyA[1]至SyA[5]、SyB[1]至SyB[5]和SyC[1]至SyC[5]。
在每个栅极导通周期OnP内,多个第一栅极驱动块210-1至210-6顺序地输出在相应的水平周期1H内各自具有栅极导通电压的第一栅极信号Sx[1]至Sx[6]。
与具有栅极导通电压的多个第一栅极信号Sx[1]至Sx[6]同步,数据驱动器300可将多个第一数据信号data1施加到第一数据线DL1,将多个第二数据信号data2施加到第二数据线DL2以及将多个第三数据信号data3施加到第三数据线DL3。
相应地,如图26中所示,多个第一数据信号data1可以对于每个列以第一顺序输入到设置在第一区A中的多个像素PX。多个第二数据信号data2可以对于每个列以第一顺序输入到设置在第二区B中的多个像素PX。多个第三数据信号data3可以对于每个列以第一顺序输入到设置在第三区C中的多个像素PX。换言之,按图26中示出的箭头的前进方向,第一数据信号data1顺序地输入到设置在第一区A中的多个像素PX,第二数据信号data2顺序地输入到设置在第二区B中的多个像素PX以及第三数据信号data3顺序地输入到设置在第三区C中的多个像素PX。
图27示出根据实施方式的用于驱动图24的显示装置的方法的时序图。图28示出根据图27的用于驱动显示装置的方法的用于将数据信号输入到多个像素的顺序。
参照图27和图28,在一个帧内,第一子栅极驱动器220A的多个第二栅极驱动块220A-1至220A-5顺序地输出在每个栅极导通周期OnP内具有栅极导通电压的第二栅极信号SyA[1]至SyA[5]。在一个帧内,第二子栅极驱动器220B的多个第二栅极驱动块220B-1至220B-5顺序地输出在每个栅极导通周期OnP内具有栅极导通电压的第二栅极信号SyB[1]至SyB[5]。在一个帧内,第三子栅极驱动器220C的多个第二栅极驱动块220C-1至220C-5顺序地输出在每个栅极导通周期OnP内具有栅极导通电压的第二栅极信号SyC[1]至SyC[5]。
在每个栅极导通周期OnP内,多个第一栅极驱动块210-1至210-6在连续的水平周期1H内顺序地输出各自具有栅极导通电压的第一栅极信号Sx[1]至Sx[6],并且在每个栅极导通周期OnP内,用于将多个第一栅极信号Sx[1]至Sx[6]施加到多个第一栅极线Gx1至Gx6的顺序在第一顺序与第二顺序之间交替。
与具有栅极导通电压的多个第一栅极信号Sx[1]至Sx[6]同步,多个第一数据信号data1施加到第一数据线DL1,多个第二数据信号data2施加到第二数据线DL2,以及多个第三数据信号data3施加到第三数据线DL3。
因此,如图28中所示,对于设置在第一区A中的多个像素PX,第一数据信号data1在奇数列y1、y3和y5中以第一顺序输入,其在偶数列y2和y4中以第二顺序输入,并且可从第一列y1至第五列y5执行第一数据信号data1的输入。对于设置在第二区B中的多个像素PX,第二数据信号data2在偶数列y6、y8和y10中以第一顺序输入,其在奇数列y7和y9中以第二顺序输入,并且可从第六列y6至第十列y10执行第二数据信号data2的输入。对于设置在第三区C中的多个像素PX,第三数据信号data3在奇数列y11、y13和y15中以第一顺序输入,其在偶数列y12和y14中以第二顺序输入,并且可从第十一列y11至第十五列y15执行第三数据信号data3的输入。
以图29的显示装置作为示例描述用于驱动显示装置的方法和用于将数据信号输入到多个像素的顺序。
图29示出根据实施方式的显示装置的框图。将大体描述与参照图15描述的显示装置的差异。
参照图29,多个像素包括具有不同颜色的多个第一像素PX1、多个第二像素PX2和多个第三像素PX3。第一像素PX1可以是用于发射红光的红色像素,第二像素PX2可以是用于发射绿光的绿色像素,以及第三像素PX3可以是用于发射蓝光的蓝色像素。多个第一像素PX1可布置为第二方向y上的第一颜色阵列,多个第二像素PX2可设置在第一颜色阵列附近并且可布置为第二方向y上的第二颜色阵列,以及多个第三像素PX3可设置在第二颜色阵列附近并且可布置为第二方向y上的第三颜色阵列。第一像素PX1的第一颜色阵列、第二像素PX2的第二颜色阵列和第三像素PX3的第三颜色阵列可在第一方向x上重复地设置。
多个第二栅极线Gy1至Gy5可分别分成三个导线以在第二方向y上沿着三个附近的颜色阵列延伸并且连接至第一颜色阵列的多个第一像素PX1、第二颜色阵列的多个第二像素PX2和第三颜色阵列的多个第三像素PX3。
第二栅极驱动器220包括连接至多个第二栅极线Gy1至Gy5的多个第二栅极驱动块220-1至220-5。
连接至数据驱动器300的数据线可包括连接至多个第一像素PX1的第一数据线DL1、连接至多个第二像素PX2的第二数据线DL2和连接至多个第三像素PX3的第三数据线DL3。第一数据线DL1可连接至所有第一像素PX1,第二数据线DL2可连接至所有第二像素PX2,以及第三数据线DL3可连接至所有第三像素PX3。
除了上述说明的差异之外,参照图15描述的实施方式的特征适用于参照图29描述的实施方式。
图30示出根据实施方式的用于驱动图29的显示装置的方法的时序图。图31示出根据图30的用于驱动显示装置的方法的用于将数据信号输入到多个像素的顺序。
参照图30和图31,在一个帧内,多个第二栅极驱动块220-1至220-5顺序地输出在每个栅极导通周期OnP内具有栅极导通电压的第二栅极信号Sy[1]至Sy[5]。
在每个栅极导通周期OnP内,多个第一栅极驱动块210-1至210-6顺序地输出在相应的水平周期1H内各自具有栅极导通电压的第一栅极信号Sx[1]至Sx[6]。
与具有栅极导通电压的多个第一栅极信号Sx[1]至Sx[6]同步,数据驱动器300可将多个第一数据信号data1施加到第一数据线DL1,将多个第二数据信号data2施加到第二数据线DL2,以及将多个第三数据信号data3施加到第三数据线DL3。多个第一数据信号data1可以是与多个第一像素PX1对应的数据信号,多个第二数据信号data2可以是与多个第二像素PX2对应的数据信号,以及多个第三数据信号data3可以是与多个第三像素PX3对应的数据信号。
相应地,如图31中所示,对于多个第一像素PX1的每个第一颜色阵列,多个第一数据信号data1可以以第一顺序输入到多个第一像素PX1。第一颜色阵列包括第一列y1、第四列y4、第七列y7、第十列y10和第十三列y13。第一数据信号data1可以以第一列y1、第四列y4、第七列y7、第十列y10和第十三列y13的顺序输入。
对于多个第二像素PX2的每个第二颜色阵列,多个第二数据信号data2可以以第一顺序输入到多个第二像素PX2。第二颜色阵列包括第二列y2、第五列y5、第八列y8、第十一列y11和第十四列y14。第二数据信号data2可以以第二列y2、第五列y5、第八列y8、第十一列y11和第十四列y14的顺序输入。
对于多个第三像素PX3的每个第三颜色阵列,多个第三数据信号data3可以以第一顺序输入到多个第三像素PX3。第三颜色阵列包括第三列y3、第六列y6、第九列y9、第十二列y12和第十五列y15。第三数据信号data3可以以第三列y3、第六列y6、第九列y9、第十二列y12和第十五列y15的顺序输入。
换言之,第一数据信号data1、第二数据信号data2和第三数据信号data3可以按图31中示出的箭头的前进方向顺序地输入到多个第一像素PX1、多个第二像素PX2和多个第三像素PX3。
图32示出根据实施方式的用于驱动图29的显示装置的方法的时序图。图33示出根据图32的用于驱动显示装置的方法的用于将数据信号输入到多个像素的顺序。
参照图32和图33,在一个帧内,多个第二栅极驱动块220-1至220-5顺序地输出在每个栅极导通周期OnP内具有栅极导通电压的第二栅极信号Sy[1]至Sy[5]。
在每个栅极导通周期OnP内,多个第一栅极驱动块210-1至210-6顺序地输出在相应的水平周期1H内各自具有栅极导通电压的第一栅极信号Sx[1]至Sx[6],并且在每个栅极导通周期OnP内,它们在第一顺序与第二顺序之间交替地改变将多个第一栅极信号Sx[1]至Sx[6]施加到多个第一栅极线Gx1至Gx6的顺序。
与具有栅极导通电压的多个第一栅极信号Sx[1]至Sx[6]同步,多个第一数据信号data1施加到第一数据线DL1,多个第二数据信号data2施加到第二数据线DL2,以及多个第三数据信号data3施加到第三数据线DL3。
因此,如图33中所示,多个第一数据信号data1可以在奇数列y1、y7和y13中以第一顺序输入到设置在第一颜色阵列中的多个第一像素PX1,并且可以在偶数列y4和y10中以第二顺序输入到设置在第一颜色阵列中的多个第一像素PX1。第一数据信号data1可以以第一列y1、第四列y4、第七列y7、第十列y10和第十三列y13的顺序输入。
多个第二数据信号data2可以在偶数列y2、y8和y14中以第一顺序输入到设置在第二颜色阵列中的多个第二像素PX2,并且可以在奇数列y5和y11中以第二顺序输入。第二数据信号data2可以以第二列y2、第五列y5、第八列y8、第十一列y11和第十四列y14的顺序输入。
多个第三数据信号data3可以在奇数列y3、y9和y15中以第一顺序输入到设置在第三颜色阵列中的多个第三像素PX3,并且可以在偶数列y6和y12中以第二顺序输入到设置在第三颜色阵列中的多个第三像素PX3。第三数据信号data3可以以第三列y3、第六列y6、第九列y9、第十二列y12和第十五列y15的顺序输入。
换言之,第一数据信号data1、第二数据信号data2和第三数据信号data3可以按图33中示出的箭头的前进方向顺序地输入到多个第一像素PX1、多个第二像素PX2和多个第三像素PX3。
参照图34描述其中的显示区域未形式化为四边形的显示装置。
图34示出根据实施方式的显示装置的框图。
参照图34,包括多个像素PX的显示区域可以为不是四边形的圆形或任意多边形。在此情况中,多个像素PX布置在第一方向x和第二方向y上,并且布置在第一方向x上的像素PX的数量可根据第二方向y变化,以及布置在第二方向y上的像素PX的数量可根据第一方向x变化。
可全部连接至多个像素PX的若干第一栅极线Gx1至Gx10在第一方向x上延伸。可全部连接至多个像素PX的若干第二栅极线Gy1至Gy9在第二方向y上延伸。
多个第一栅极驱动块210-1至210-10设置在其中设置有多个像素PX的显示区域的边缘上,并且连接至多个第一栅极线Gx1至Gx10。多个第一栅极驱动块210-1至210-10的数量可与多个第一栅极线Gx1至Gx10的数量对应。
第二栅极驱动块220-1至220-9设置在显示区域的边缘上,并且连接至多个第二栅极线Gy1至Gy9。第二栅极驱动块220-1至220-9的数量可与第二栅极线Gy1至Gy9的数量对应。
数据线DL可在第一方向x和第二方向y上沿着多个像素PX的排列方向延伸,并且可连接至显示区域中的每个像素PX。数据线DL的端部连接至数据驱动器300,并且数据驱动器300可通过一个数据线DL将数据信号施加到多个像素PX。
如所描述的,当包括多个像素PX的显示区域具有圆形形状或特定多边形形状时,数据信号可通过使用一个数据线DL而被施加到多个像素PX。因此,用于连接具有期望的圆形形状或期望的多边形形状的显示装置10中的数据驱动器300的柔性电路板的宽度可最小化。
附图和实施方式是说明性的示例并且不限制由所附权利要求限定的范围。在不背离由所附权利要求限定的范围的情况下,可产生各种修改和实施方式。

Claims (20)

1.显示装置,包括:
多个第一类型栅极线,包括第一栅极线并且彼此平行地延伸;
多个第二类型栅极线,包括第二栅极线并且与所述第一栅极线交叉;
第一数据线;以及
第一像素,包括第一开关晶体管和第二开关晶体管,
其中,所述第一开关晶体管包括第一栅电极、第一源电极和第一漏电极,
其中,所述第一栅电极电连接至所述第一栅极线,
其中,所述第一源电极电连接至所述第一数据线,
其中,所述第二开关晶体管包括第二栅电极、第二源电极和第二漏电极,
其中,所述第二栅电极电连接至所述第二栅极线,以及
其中,所述第二源电极电连接至所述第一漏电极。
2.根据权利要求1所述的显示装置,还包括:
液晶电容器,电连接至所述第二漏电极。
3.根据权利要求1所述的显示装置,还包括:
驱动晶体管,电连接至所述第二开关晶体管;以及
发光二极管,电连接至所述驱动晶体管。
4.根据权利要求1所述的显示装置,
其中,所述第一栅极线在像素行方向和像素列方向中的一个方向上延伸,以及
其中,所述第二栅极线在所述像素行方向和所述像素列方向中的另一方向上延伸。
5.根据权利要求1所述的显示装置,
其中,所述第一类型栅极线包括第三栅极线,以及
其中,电连接至所述第一栅极线的所有像素的总数量不等于电连接至所述第三栅极线的所有像素的总数量。
6.根据权利要求1所述的显示装置,还包括:
第二像素,电连接至所述第一数据线,
其中,所述第一类型栅极线包括电连接至所述第二像素的第三栅极线,以及
其中,所述第二类型栅极线包括电连接至所述第二像素的第四栅极线。
7.根据权利要求1所述的显示装置,还包括:
第一类型栅极驱动单元,分别电连接至所述第一类型栅极线以用于将第一类型栅极信号分别输出至所述第一类型栅极线;以及
第二类型栅极驱动单元,分别电连接至所述第二类型栅极线以用于将第二类型栅极信号分别输出至所述第二类型栅极线。
8.根据权利要求7所述的显示装置,
其中,当所述第一栅极线在第一栅极导通周期内继续将栅极导通电压的第一副本传输至所述第一像素时,所述第二类型栅极驱动单元中的一些或全部在第一多个连续水平周期中顺序地输出栅极导通信号的第一多个副本,以及
其中,所述第一栅极导通周期的长度等于所述第一多个连续水平周期的总长度。
9.根据权利要求8所述的显示装置,其中,
所述第一类型栅极线包括与所述第一栅极线紧邻的第三栅极线,
其中,当所述第三栅极线在第二栅极导通周期内继续传输所述栅极导通电压的第二副本时,所述第二类型栅极驱动单元中的所述一些或全部在第二多个连续水平周期中顺序地输出所述栅极导通信号的第二多个副本,以及
其中,所述第二栅极导通周期的长度等于所述第二多个连续水平周期的总长度。
10.根据权利要求9所述的显示装置,
其中,所述第二类型栅极驱动单元中的所述一些或全部以第一顺序顺序地输出所述栅极导通信号的所述第一多个副本,以及
其中,所述第二类型栅极驱动单元中的所述一些或全部以第二顺序顺序地输出所述栅极导通信号的所述第二多个副本,所述第二顺序是所述第一顺序的逆顺序。
11.显示装置,包括:
多个第一类型栅极线;
多个第二类型栅极线,与所述第一类型栅极线交叉;
第一类型栅极驱动单元,分别电连接至所述第一类型栅极线;以及
第二类型栅极驱动单元,分别电连接至所述第二类型栅极线。
12.根据权利要求11所述的显示装置,其中,在所述第一类型栅极驱动单元中的一个输出第一栅极信号的第一副本的栅极导通周期期间,所述第二类型栅极驱动单元将第二栅极信号的第一多个副本顺序地输出至所述第二类型栅极线。
13.根据权利要求12所述的显示装置,其中,
在一个帧内,所述第一类型栅极驱动单元将所述第一栅极信号的副本顺序地输出至所述第一类型栅极线。
14.根据权利要求13所述的显示装置,其中,当所述第一类型栅极驱动单元中的每个输出所述第一栅极信号的副本时,所述第二类型栅极驱动单元将所述第二栅极信号的多个副本顺序地输出至所述第二类型栅极线。
15.根据权利要求13所述的显示装置,其中,在连续栅极导通周期中,所述第二类型栅极驱动单元使将所述第二栅极信号的多个副本施加到所述第二类型栅极线的顺序在第一顺序与第二顺序之间交替,所述第二顺序是所述第一顺序的逆顺序。
16.根据权利要求11所述的显示装置,还包括:
多个像素,具有电连接至所述第一类型栅极线和所述第二类型栅极线的栅电极,布置在像素行和像素列中,并且包括第一像素,所述第一像素电连接至所述第一类型栅极线中的一个和所述第二类型栅极线中的一个二者;以及
第一数据线,电连接至一些或全部所述像素的源电极。
17.根据权利要求16所述的显示装置,其中,所述第一数据线电连接至所述多个像素中位于所述像素行中的不同行中的像素,并且电连接至所述多个像素中位于所述像素列中的不同列中的像素。
18.根据权利要求17所述的显示装置,还包括:
第二数据线,与所述第一数据线电绝缘,
其中,所述像素包括第一区像素和第二区像素,
其中,所述第一区像素位于所述显示装置的第一区中,
其中,所述第二区像素位于所述显示装置的第二区中,
其中,所述第一数据线电连接至所述第一区像素中的每个,以及
其中,所述第二数据线电连接至所述第二区像素中的每个。
19.根据权利要求16所述的显示装置,还包括:
第二数据线,与所述第一数据线电绝缘;以及
第三数据线,与所述第一数据线和所述第二数据线中的每个电绝缘,
其中,所述像素包括第一颜色的多个第一颜色像素、第二颜色的多个第二颜色像素和第三颜色的多个第三颜色像素,
其中,所述第一数据线电连接至所述第一颜色像素中的每个的源电极,
其中,所述第二数据线电连接至所述第二颜色像素中的每个的源电极,以及
其中,所述第三数据线电连接至所述第三颜色像素中的每个的源电极。
20.根据权利要求11所述的显示装置,还包括:
多个像素,所述像素中的每个电连接至所述第一类型栅极线中的至少一个和所述第二类型栅极线中的至少一个,
其中,所述第一类型栅极线包括第一栅极线和第二栅极线,
其中,电连接至所述第一栅极线的所有像素的总数量不等于电连接至所述第二栅极线的所有像素的总数量。
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