CN107993620A - 一种goa电路 - Google Patents

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Abstract

本发明提供一种GOA电路，包括m个级联的GOA单元，第n级GOA单元包括：正反向扫描控制模块、第一栅极信号输出模块、第二栅极信号输出模块；正反向扫描控制模块控制GOA电路进行正向扫描或反向扫描；第一栅极信号输出模块包括：第七薄膜晶体管、第九薄膜晶体管和第十六薄膜晶体管；第十六薄膜晶体管的第二端接入高电位信号，第一端和第三端分别与所述第七薄膜晶体管的第一端和第二端连接；第二栅极信号输出模块包括：第十二薄膜晶体管、第十三薄膜晶体管和第十五薄膜晶体管；第十五薄膜晶体管的第二端接入高电位信号，第一端和第三端分别与第十二薄膜晶体管的第一端和第二端连接。本发明可以减小GOA电路级传失效的风险。

Description

一种GOA电路
技术领域
本发明涉及显示技术领域，尤其涉及一种GOA电路。
背景技术
如图1和图2所示，在常规的级传(1to2)GOA(Gate Driver On Array，简称GOA，也就是利用现有薄膜晶体管液晶显示器阵列制程将栅极行扫描驱动信号电路制作在阵列基板上，实现对栅极逐行扫描的驱动方式的一项技术)电路(即不同GOA单元之间有信号的传递)下，如果图1中所示的电路Q节点受到信号干扰，Q点受到信号干扰的波形图如图2所示。
Qa和Qb节点电位在boost(抬升电位)期间会通过薄膜晶体管NT7和NT12反向漏入Q点，导致Qa和Qb节点的boost电位下滑，原因是Q节点受信号干扰后同高电位信号VGH的延迟不匹配，导致薄膜晶体管NT7和NT12的栅极与源极之间的电位差Vgs>0V，出现Qa和Qb节点boost电位下滑。如图2所示，Qa和Qb节点boost电位下滑后，薄膜晶体管NT9和NT13的栅极电位下滑，栅极信号G(n)和G(n+2)输出波形异常，出现GOA电路级传失效风险。
发明内容
为解决上述技术问题，本发明提供一种GOA电路，可以减小GOA电路级传失效的风险。
本发明提供的一种GOA电路，用于液晶显示面板中，包括m个级联的GOA单元，第n级GOA单元包括：正反向扫描控制模块、第一栅极信号输出模块、第二栅极信号输出模块，其中，m≥n≥1；
所述正反向扫描控制模块，用于根据正向扫描控制信号或反向扫描控制信号控制GOA电路进行正向扫描或反向扫描；
所述第一栅极信号输出模块包括：第七薄膜晶体管、第九薄膜晶体管和第十六薄膜晶体管；所述第七薄膜晶体管的第三端接入高电位信号，第一端和第二端分别与所述正反向扫描控制模块的输出端以及所述第九薄膜晶体管的第三端连接；所述第九薄膜晶体管的第一端接入第n条时钟信号，第二端作为第n级栅极驱动信号的输出端；所述第十六薄膜晶体管的第二端接入高电位信号，第一端和第三端分别与所述第七薄膜晶体管的第一端和第二端连接；
所述第二栅极信号输出模块包括：第十二薄膜晶体管、第十三薄膜晶体管和第十五薄膜晶体管；所述第十二薄膜晶体管的第三端接入高电位信号，第一端和第二端分别与所述正反向扫描控制模块的输出端以及所述第十三薄膜晶体管的第三端连接；所述第十三薄膜晶体管的第一端接入第n+2条时钟信号，第二端作为第n+2级栅极驱动信号的输出端；所述第十五薄膜晶体管的第二端接入高电位信号，第一端和第三端分别与所述第十二薄膜晶体管的第一端和第二端连接；
其中，第一端为源极和漏极中的一个，第二端为源极和漏极中的另一个，第三端为栅极。
优选地，所述正反向扫描控制模块包括第一薄膜晶体管和第二薄膜晶体管；
所述第一薄膜晶体管的第一端和所述第二薄膜晶体管的第一端分别接入正向扫描控制信号和反向扫描控制信号，所述第一薄膜晶体管的第二端与所述第二薄膜晶体管的第二端以及所述第七薄膜晶体管的第一端连接，所述第一薄膜晶体管的第三端和所述第二薄膜晶体管的第三端分别接入第n-2级栅极驱动信号和第n+4级栅极驱动信号。
优选地，所述GOA单元还包括第三薄膜晶体管、第四薄膜晶体管、第八薄膜晶体管、第十薄膜晶体管和第十四薄膜晶体管；
所述第三薄膜晶体管的第一端和所述第四薄膜晶体管的第一端分别接入第n+1条时钟信号和第n-1条时钟信号；
所述第三薄膜晶体管的第二端与所述第四薄膜晶体管的第二端以及所述第八薄膜晶体管的第三端连接；
所述第三薄膜晶体管的第三端和所述第四薄膜晶体管的第三端分别接入正向扫描控制信号和反向扫描控制信号；
所述第八薄膜晶体管的第一端接入高电位信号，第二端与所述第十薄膜晶体管的第三端以及所述第十四薄膜晶体管的第三端连接；
所述第十薄膜晶体管的第一端和所述第十四薄膜晶体管的第一端分别与所述第九薄膜晶体管的第二端以及所述第十三薄膜晶体管的第二端连接，所述第十薄膜晶体管的第二端和所述第十四薄膜晶体管的第二端均接入低电位信号。
优选地，所述GOA单元还包括第十一薄膜晶体管，所述第十一薄膜晶体管的第二端和第三端连接且所述第十一薄膜晶体管的第二端接入复位信号，所述第十一薄膜晶体管的第一端与所述第十薄膜晶体管的第三端和所述第十四薄膜晶体管的第三端连接。
优选地，所述GOA单元还包括第六薄膜晶体管，所述第六薄膜晶体管的第三端与所述第二薄膜晶体管的第二端连接，所述第六薄膜晶体管的第一端与所述第十薄膜晶体管的第三端以及所述第十四薄膜晶体管的第三端连接，所述第六薄膜晶体管的第二端接入低电位信号。
优选地，所述GOA单元还包括第一电容和第二电容；
所述第一电容的第一端与所述第七薄膜晶体管的第一端连接，所述第二电容的第二端接入低电位信号；
所述第二电容的两端分别与所述第十薄膜晶体管的第二端和第三端连接。
优选地，所述GOA单元还包括第五薄膜晶体管，所述第五薄膜晶体管的第二端接入低电位信号，第一端和第三端分别与所述第七薄膜晶体管的第一端以及所述第八薄膜晶体管的第二端连接。
优选地，所述GOA单元的所有薄膜晶体管均为N沟道的薄膜晶体管。
实施本发明，具有如下有益效果：在正反向扫描控制模块的输出端与第七薄膜晶体管的第一端以及第十二薄膜晶体管的第一端之间的连接点Q点受到信号干扰时，即使有Qa和Qb节点电位在boost期间会通过第七薄膜晶体管和第十二薄膜晶体管反向漏入Q节点的风险，但可以在Qa和Qb节点boost期间，将第十五薄膜晶体管和第十六薄膜晶体管打开，将高电位信号VGH的电位冲入Q节点，将Q节点所受到的信号干扰降低，保持Qa和Qb节点处于正常准位，第九薄膜晶体管和第十三薄膜晶体管的栅极电位也保持正常boost电位，最终，第n级栅极驱动信号G(n)和第n+2级栅极驱动信号G(n+2)输出波形正常，减小了GOA单元级传失效的风险。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1是本发明提供的背景技术中的GOA电路图。
图2是本发明提供的背景技术中的GOA电路图中的Q、Qa、Qb节点的波形图以及输出的栅极驱动信号的波形图。
图3是本发明提供的GOA电路图。
图4是本发明提供的GOA电路图中的Q、Qa、Qb节点的波形图以及输出的栅极驱动信号的波形图。
具体实施方式
本发明提供一种GOA电路，用于液晶显示面板中，如图3所示，该GOA电路包括m个级联的GOA单元，第n级GOA单元包括：正反向扫描控制模块300、第一栅极信号输出模块100、第二栅极信号输出模块200，其中，m≥n≥1。
正反向扫描控制模块300用于根据正向扫描控制信号U2D或反向扫描控制信号D2U控制GOA电路进行正向扫描或反向扫描。
第一栅极信号输出模块100包括：第七薄膜晶体管NT7、第九薄膜晶体管NT9和第十六薄膜晶体管NT16；第七薄膜晶体管NT7的第三端接入高电位信号VGH，第七薄膜晶体管NT7的第一端和第二端分别与正反向扫描控制模块300的输出端以及第九薄膜晶体管NT9的第三端连接；第九薄膜晶体管NT9的第一端接入第n条时钟信号CK(n)，第九薄膜晶体管NT9的第二端作为第n级栅极驱动信号G(n)的输出端；第十六薄膜晶体管NT16的第二端接入高电位信号VGH，第十六薄膜晶体管NT16的第一端和第三端分别与第七薄膜晶体管NT7的第一端和第二端连接。第七薄膜晶体管NT7与第九薄膜晶体管NT9之间的连接点作为Qa节点。
第二栅极信号输出模块200包括：第十二薄膜晶体管NT12、第十三薄膜晶体管NT13和第十五薄膜晶体管NT15；第十二薄膜晶体管NT12的第三端接入高电位信号VGH，第十二薄膜晶体管NT12的第一端和第二端分别与正反向扫描控制模块300的输出端以及第十三薄膜晶体管NT13的第三端连接；第十三薄膜晶体管NT13的第一端接入第n+2条时钟信号，第二端作为第n+2级栅极驱动信号G(n+2)的输出端；第十五薄膜晶体管NT15的第二端接入高电位信号VGH，第十五薄膜晶体管NT15的第一端和第三端分别与第十二薄膜晶体管NT12的第一端和第二端连接。第十二薄膜晶体管NT12与第十三薄膜晶体管NT13之间的连接点作为Qb节点。
正反向扫描控制模的输出端与第七薄膜晶体管NT7和第十二薄膜晶体管NT12之间的连接点作为Q节点。
其中，第一端为源极和漏极中的一个，第二端为源极和漏极中的另一个，第三端为栅极。
GOA电路中共有4条时钟信号CK：第1条时钟信号、第2条时钟信号、第3条时钟信号、第4条时钟信号，当第n+1条时钟信号CK(n+1)为第4条时钟信号时，第n+2条时钟信号为第1条时钟信号，当第n+1条时钟信号CK(n+1)为第2条时钟信号时，第n-1条时钟信号CK(n-1)为第4条时钟信号。进一步地，正反向扫描控制模块300包括第一薄膜晶体管NT1和第二薄膜晶体管NT2。
第一薄膜晶体管NT1的第一端和第二薄膜晶体管NT2的第一端分别接入正向扫描控制信号U2D和反向扫描控制信号D2U，第一薄膜晶体管NT1的第二端与第二薄膜晶体管NT2的第二端以及第七薄膜晶体管NT7的第一端连接，第一薄膜晶体管NT1的第三端和第二薄膜晶体管NT2的第三端分别接入第n-2级栅极驱动信号G(n-2)和第n+4级栅极驱动信号G(n+4)。第一薄膜晶体管NT1的第二端还与第十二薄膜晶体管NT12的第一端连接，第一薄膜晶体管NT1与第七薄膜晶体管NT7以及第十二薄膜晶体管NT12之间的连接点即为Q节点。
当n≤2时，第一薄膜晶体管NT1的第三端接入的是扫描启动信号STV；当n+4＞m时，第二薄膜晶体管NT2的第三端接入的是扫描启动信号STV。第一薄膜晶体管NT1的第三端接入的扫描启动信号STV与第二薄膜晶体管NT2的第三端接入的扫描启动信号STV可以相同或者不相同。
进一步地，GOA单元还包括第三薄膜晶体管NT3、第四薄膜晶体管NT4、第八薄膜晶体管NT8、第十薄膜晶体管NT10和第十四薄膜晶体管NT14。
第三薄膜晶体管NT3的第一端和第四薄膜晶体管NT4的第一端分别接入第n+1条时钟信号CK(n+1)和第n-1条时钟信号CK(n-1)。
第三薄膜晶体管NT3的第二端与第四薄膜晶体管NT4的第二端以及第八薄膜晶体管NT8的第三端连接。
第三薄膜晶体管NT3的第三端和第四薄膜晶体管NT4的第三端分别接入正向扫描控制信号U2D和反向扫描控制信号D2U。
第八薄膜晶体管NT8的第一端接入高电位信号VGH，第二端与第十薄膜晶体管NT10的第三端以及第十四薄膜晶体管NT14的第三端连接。
第十薄膜晶体管NT10的第一端和第十四薄膜晶体管NT14的第一端分别与第九薄膜晶体管NT9的第二端以及第十三薄膜晶体管NT13的第二端连接，第十薄膜晶体管NT10的第二端和第十四薄膜晶体管NT14的第二端均接入低电位信号VGL。
进一步地，GOA单元还包括第十一薄膜晶体管NT11，第十一薄膜晶体管NT11的第二端和第三端连接且第十一薄膜晶体管NT11的第二端接入复位信号Reset，第十一薄膜晶体管NT11的第一端与第十薄膜晶体管NT10的第三端和第十四薄膜晶体管NT14的第三端连接。
进一步地，GOA单元还包括第六薄膜晶体管NT6，第六薄膜晶体管NT6的第三端与第二薄膜晶体管NT2的第二端连接，第六薄膜晶体管NT6的第一端与第十薄膜晶体管NT10的第三端以及第十四薄膜晶体管NT14的第三端连接，第六薄膜晶体管NT6的第二端接入低电位信号VGL。
进一步地，GOA单元还包括第一电容C1和第二电容C2。
第一电容C1的第一端与第七薄膜晶体管NT7的第一端以及第十二薄膜晶体管NT12的第一端连接，第二电容C2的第二端接入低电位信号VGL。
第二电容C2的两端分别与第十薄膜晶体管NT10的第二端和第三端连接。
进一步地，GOA单元还包括第五薄膜晶体管NT5，第五薄膜晶体管NT5的第二端接入低电位信号VGL，第一端和第三端分别与第七薄膜晶体管NT7的第一端以及第八薄膜晶体管NT8的第二端连接。
进一步地，GOA单元的所有薄膜晶体管均为N沟道的薄膜晶体管。
本发明提供的GOA电路，如果电路Q节点受到信号干扰，同样会有Qa和Qb节点电位在boost期间会通过第七薄膜晶体管NT7和第十二薄膜晶体管NT12反向漏入Q节点的风险，但本发明在GOA单元中新增了第十五薄膜晶体管NT15和第十六薄膜晶体管NT16，在Qa和Qb节点boost期间，通过boost产生抬升电位，第十五薄膜晶体管NT15和第十六薄膜晶体管NT16打开，将高电位信号VGH的电位冲入Q节点，补偿充电，将Q节点所受到的信号干扰降低，Q节点的信号波形图如图4所示，保持Qa和Qb节点处于正常准位，第九薄膜晶体管NT9和第十三薄膜晶体管NT13的栅极电位也保持正常boost电位，最终，第n级栅极驱动信号G(n)和第n+2级栅极驱动信号G(n+2)输出波形正常，减小了GOA单元之间级传失效的风险。
以上内容是结合具体的优选实施方式对本发明所作的进一步详细说明，不能认定本发明的具体实施只局限于这些说明。对于本发明所属技术领域的普通技术人员来说，在不脱离本发明构思的前提下，还可以做出若干简单推演或替换，都应当视为属于本发明的保护范围。

Claims (8)

1.一种GOA电路，用于液晶显示面板中，其特征在于，包括m个级联的GOA单元，第n级GOA单元包括：正反向扫描控制模块、第一栅极信号输出模块、第二栅极信号输出模块，其中，m≥n≥1；
所述正反向扫描控制模块，用于根据正向扫描控制信号或反向扫描控制信号控制GOA电路进行正向扫描或反向扫描；
所述第一栅极信号输出模块包括：第七薄膜晶体管、第九薄膜晶体管和第十六薄膜晶体管；所述第七薄膜晶体管的第三端接入高电位信号，第一端和第二端分别与所述正反向扫描控制模块的输出端以及所述第九薄膜晶体管的第三端连接；所述第九薄膜晶体管的第一端接入第n条时钟信号，第二端作为第n级栅极驱动信号的输出端；所述第十六薄膜晶体管的第二端接入高电位信号，第一端和第三端分别与所述第七薄膜晶体管的第一端和第二端连接；
所述第二栅极信号输出模块包括：第十二薄膜晶体管、第十三薄膜晶体管和第十五薄膜晶体管；所述第十二薄膜晶体管的第三端接入高电位信号，第一端和第二端分别与所述正反向扫描控制模块的输出端以及所述第十三薄膜晶体管的第三端连接；所述第十三薄膜晶体管的第一端接入第n+2条时钟信号，第二端作为第n+2级栅极驱动信号的输出端；所述第十五薄膜晶体管的第二端接入高电位信号，第一端和第三端分别与所述第十二薄膜晶体管的第一端和第二端连接；
其中，第一端为源极和漏极中的一个，第二端为源极和漏极中的另一个，第三端为栅极。
2.根据权利要求1所述的GOA电路，其特征在于，所述正反向扫描控制模块包括第一薄膜晶体管和第二薄膜晶体管；
所述第一薄膜晶体管的第一端和所述第二薄膜晶体管的第一端分别接入正向扫描控制信号和反向扫描控制信号，所述第一薄膜晶体管的第二端与所述第二薄膜晶体管的第二端以及所述第七薄膜晶体管的第一端连接，所述第一薄膜晶体管的第三端和所述第二薄膜晶体管的第三端分别接入第n-2级栅极驱动信号和第n+4级栅极驱动信号。
3.根据权利要求1所述的GOA电路，其特征在于，所述GOA单元还包括第三薄膜晶体管、第四薄膜晶体管、第八薄膜晶体管、第十薄膜晶体管和第十四薄膜晶体管；
所述第三薄膜晶体管的第一端和所述第四薄膜晶体管的第一端分别接入第n+1条时钟信号和第n-1条时钟信号；
所述第三薄膜晶体管的第二端与所述第四薄膜晶体管的第二端以及所述第八薄膜晶体管的第三端连接；
所述第三薄膜晶体管的第三端和所述第四薄膜晶体管的第三端分别接入正向扫描控制信号和反向扫描控制信号；
所述第八薄膜晶体管的第一端接入高电位信号，第二端与所述第十薄膜晶体管的第三端以及所述第十四薄膜晶体管的第三端连接；
所述第十薄膜晶体管的第一端和所述第十四薄膜晶体管的第一端分别与所述第九薄膜晶体管的第二端以及所述第十三薄膜晶体管的第二端连接，所述第十薄膜晶体管的第二端和所述第十四薄膜晶体管的第二端均接入低电位信号。
4.根据权利要求3所述的GOA电路，其特征在于，所述GOA单元还包括第十一薄膜晶体管，所述第十一薄膜晶体管的第二端和第三端连接且所述第十一薄膜晶体管的第二端接入复位信号，所述第十一薄膜晶体管的第一端与所述第十薄膜晶体管的第三端和所述第十四薄膜晶体管的第三端连接。
5.根据权利要求3所述的GOA电路，其特征在于，所述GOA单元还包括第六薄膜晶体管，所述第六薄膜晶体管的第三端与所述第二薄膜晶体管的第二端连接，所述第六薄膜晶体管的第一端与所述第十薄膜晶体管的第三端以及所述第十四薄膜晶体管的第三端连接，所述第六薄膜晶体管的第二端接入低电位信号。
6.根据权利要求3所述的GOA电路，其特征在于，所述GOA单元还包括第一电容和第二电容；
所述第一电容的第一端与所述第七薄膜晶体管的第一端连接，所述第二电容的第二端接入低电位信号；
所述第二电容的两端分别与所述第十薄膜晶体管的第二端和第三端连接。
7.根据权利要求3所述的GOA电路，其特征在于，所述GOA单元还包括第五薄膜晶体管，所述第五薄膜晶体管的第二端接入低电位信号，第一端和第三端分别与所述第七薄膜晶体管的第一端以及所述第八薄膜晶体管的第二端连接。
8.根据权利要求1所述的GOA电路，其特征在于，所述GOA单元的所有薄膜晶体管均为N沟道的薄膜晶体管。
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