CN107505792A - 阵列基板、显示面板以及显示装置 - Google Patents

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Abstract

本发明公开了一种阵列基板、显示面板以及显示装置。该阵列基板包括多条扫描线、多条数据线、多个移位寄存器和多个开关单元，每个移位寄存器用于向对应的扫描线的一端输入扫描信号，每条扫描线的另一端连接对应的开关单元的第一端，开关单元的第二端接收第一参考电压，开关单元的控制端接收第一控制信号，移位寄存器和开关单元同时将扫描线的电位拉到低电位。本发明能够实现窄边框，提高用户的体验效果，并且保证扫描线被拉到低电位的时间相同。

Description

阵列基板、显示面板以及显示装置
技术领域
本发明涉及显示技术领域，特别是涉及一种阵列基板、显示面板以及显示装置。
背景技术
液晶显示器以其高显示品质、价格低廉、携带方便等优点，应用在移动通讯设备、PC(Personal Compute，电脑)、TV(Television，电视)等的显示终端。目前普遍采用的TV液晶显示器的面板驱动技术逐渐趋向于采用GOA(Gate Driver on Array，阵列基板栅极驱动)技术，其运用平板显示面板的原有制程将面板水平扫描线的驱动电路制作在显示区周围的基板上，GOA技术能简化平板显示面板的制作工序，省去水平扫描线方向的bonding(焊接)工艺，可提升产能并降低产品成本。
如图1所示，现有的液晶显示装置的多个移位寄存器10用于为阵列基板的多条扫描线Gn提供扫描信号，其包括多个第一移位寄存器11和多个第二移位寄存器12。多个第一移位寄存器11设置在阵列基板的显示区域AA的左侧，分别与多条扫描线Gn的一端连接。多个第二移位寄存器12设置在阵列基板的显示区域AA的右侧，分别与多条扫描线Gn的另一端连接。
其中，第一级的第一移位寄存器11和第一级的第二移位寄存器12均与启动信号STV连接，多个第一移位寄存器11和多个第二移位寄存器12分别与第一低频时钟信号LC1、第二低频时钟信号LC2、直流低电压VSS以及高频时钟信号CK1-CK4中的一个高频时钟信号连接。在显示区域AA的两侧均需要设置至少四条信号线用于传输第一低频时钟信号LC1、第二低频时钟信号LC2、直流低电压VSS以及高频时钟信号CK1-CK4中的一个高频时钟信号，因此多个移位寄存器10需要占用阵列基板的空间大，无法实现窄边框。
发明内容
本发明主要解决的技术问题是提供一种阵列基板、显示面板以及显示装置，能够减低移位寄存器所占用的空间，实现窄边框，提高用户的体验效果。
为解决上述技术问题，本发明采用的一个技术方案是：提供一种阵列基板，其包括多条扫描线、多条数据线、多个移位寄存器和多个开关单元，所述多条扫描线和所述多条数据线相交设置，以形成多个像素单元；每个所述移位寄存器用于向对应的所述扫描线的一端输入扫描信号，每条所述扫描线的另一端连接对应的所述开关单元的第一端，所述开关单元的第二端接收第一参考电压，所述开关单元的控制端接收第一控制信号，所述移位寄存器和所述开关单元同时将所述扫描线的电位拉到低电位。
为解决上述技术问题，本发明采用的另一个技术方案是：提供一种显示面板，其包括上述的阵列基板。
为解决上述技术问题，本发明采用的另一个技术方案是：提供一种显示装置，其包括上述的阵列基板。
本发明的有益效果是：区别于现有技术的情况，本发明的每个移位寄存器用于向对应的扫描线的一端输入扫描信号，每条扫描线的另一端连接对应的开关单元的第一端，开关单元的第二端接收第一参考电压，开关单元的控制端接收第一控制信号，移位寄存器和开关单元同时将扫描线的电位拉到低电位，其中每条扫描线对应一个移位寄存器，进而减少多个移位寄存器所占用空间，实现窄边框，提高用户的体验效果；此外，移位寄存器和开关单元同时将扫描线的电位拉到低电位，能够保证扫描线被拉到低电位的时间相同。
附图说明
为了更清楚地说明本发明实施例中的技术方案，下面将对实施例描述中所需要采用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。其中：
图1是现有技术的阵列基板的结构示意图；
图2是第一实施例的阵列基板的结构示意图；
图3是图2中的时序图；
图4是第二实施例的阵列基板的结构示意图；
图5是图4中的时序图；
图6是第一实施例的显示面板的结构示意图；
图7是第一实施例的显示装置的结构示意图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性的劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
请参见图2所示，图2是第一实施例的阵列基板的结构示意图。本实施例的阵列基板20包括多条扫描线21、多条数据线22、多个移位寄存器23以及多个开关单元24，其中多个移位寄存器23的数量和多个开关单元24的数量均与多条扫描线21的数量一一对应。例如，阵列基板20包括1080条扫描线21，对应设置有1080个移位寄存器23和1080个开关单元24。
其中，多条扫描线21和多条数据线22相交设置，以形成多个像素单元25。每个移位寄存器23与对应的扫描线21的一端连接，用于向该扫描线21输入扫描信号。在扫描线21输入扫描信号时，与该扫描线21连接的像素单元25从对应的数据线22获取数据信号。该扫描线21的另一端连接对应的开关单元24的第一端，该开关单元24的第二端接收第一参考电压VSS(即下文的直流低电压VSS)，该开关单元24的控制端接收第一控制信号，在移位寄存器23和对应的开关单元24同时工作时，移位寄存器23和该开关单元24同时将扫描线21的电位拉到低电位，使得扫描线21两侧连接的像素单元25的同时关闭。
本实施例的多个移位寄存器23包括多个奇数级移位寄存器231和多个偶数级移位寄存器232，多个奇数级移位寄存器231设置在阵列基板20的显示区域AA的左侧，多个偶数级移位寄存器232设置在阵列基板20的显示区域AA的右侧，多个奇数级移位寄存器231分别与奇数级的扫描线21的一端连接，多个偶数级移位寄存器232分别与偶数级的扫描线21的一端连接。
其中，多个开关单元24包括多个第一开关单元241和多个第二开关单元242，多个第一开关单元241设置在显示区域AA的右侧，多个第二开关单元242设置在显示区域AA的左侧。其中，多个第一开关单元241分别与奇数级的扫描线21的另一端连接，多个第二开关单元242分别与偶数级的扫描线21的另一端连接。
多个奇数级移位寄存器231远离显示区域AA的一侧设置有信号线261，信号线261用于传输启动信号STV、第一低频时钟信号LC1、第二低频时钟信号LC2、直流低电压VSS以及高频时钟信号CK1-CK4中的一个高频时钟信号，多个奇数级移位寄存器231与信号线261连接，例如第一个的奇数级移位寄存器231通过信号线261接收启动信号STV、第一低频时钟信号LC1、第二低频时钟信号LC2、直流低电压VSS以及高频时钟信号CK1；第n个的奇数级移位寄存器231通过信号线261接收第一低频时钟信号LC1、第二低频时钟信号LC2、直流低电压VSS以及高频时钟信号CK1-CK4中的一个高频时钟信号，其中n大于1。
多个偶数级移位寄存器232远离显示区域AA的一侧设置有信号线262，信号线262用于传输启动信号STV、第一低频时钟信号LC1、第二低频时钟信号LC2、直流低电压VSS以及高频时钟信号CK1-CK4中的一个高频时钟信号，多个偶数级移位寄存器232与信号线262连接，例如第一个的偶数级移位寄存器232通过信号线262接收启动信号STV、第一低频时钟信号LC1、第二低频时钟信号LC2、直流低电压VSS以及高频时钟信号CK2；第n个的偶数级移位寄存器232通过信号线262接收第一低频时钟信号LC1、第二低频时钟信号LC2、直流低电压VSS以及高频时钟信号CK1-CK4中的一个高频时钟信号。
本实施例的每个移位寄存器23均可以包括GOA电路，第一控制信号可以为高频时钟信号CK1、高频时钟信号CK2、高频时钟信号CK3以及高频时钟信号CK4中的任意一个。
其中，每个移位寄存器23输入第二控制信号，第二控制信号可以为高频时钟信号CK1、高频时钟信号CK2、高频时钟信号CK3以及高频时钟信号CK4中的任意一个。移位寄存器23根据第二控制信号产生扫描信号，其中第一控制信号的相位与第二控制信号的相位相反；例如奇数级移位寄存器231连接的第二控制信号为高频时钟信号CK1，则对应的第一开关单元241连接的第一控制信号为高频时钟信号CK3，或者偶数级移位寄存器232连接的第二控制信号为高频时钟信号CK2，则对应的第二开关单元242连接的第一控制信号为高频时钟信号CK4。
如图3所示，第一低频时钟信号LC1、第二低频时钟信号LC2、直流低电压VSS、高频时钟信号CK1、高频时钟信号CK2、高频时钟信号CK3以及高频时钟信号CK4的时序图，G(n)和G(n+1)为扫描信号的时序图。在多个奇数级移位寄存器231将奇数级的扫描线21拉到低电位时，多个第一开关单元241用于将所述奇数级的扫描线21拉到低电位；具体地，在奇数级移位寄存器231输入第二控制信号为低电平时，奇数级移位寄存器231输出的扫描信号为低电平，因此多个奇数级移位寄存器231将奇数级的扫描线21拉到低电位；第一开关单元241的控制端输入第一控制信号为高电平，第一开关单元241工作，以将奇数级的扫描线21的电平拉低至直流低电压VSS，因此多个奇数级移位寄存器231和多个第一开关单元241同时将奇数级的扫描线21两端的电平拉到低电平。在多个偶数级移位寄存器232将偶数级的扫描线21拉到低电位时，多个第二开关单元242用于将偶数级的扫描线21拉到低电位；具体地，在偶数级移位寄存器232输入第二控制信号为低电平时，偶数级移位寄存器232输出的扫描信号为低电平，因此多个偶数级移位寄存器232将偶数级的扫描线21拉到低电位；第二开关单元242的控制端输入第一控制信号为高电平，第二开关单元242工作，以将偶数级的扫描线21的电平拉低至直流低电压VSS，因此多个偶数级移位寄存器232和多个第二开关单元242同时将偶数级的扫描线21两端的电平拉到低电平。
其中，多个开关单元24均可以为薄膜晶体管，开关单元24的控制端为薄膜晶体管的栅极，开关单元24的第一端为薄膜晶体管的漏极，开关单元24的第二端为薄膜晶体管的源极。
因此，本实施例的扫描线21在被移位寄存器23下拉到低电位时，第一控制信号控制开关单元24正常工作，此时开关单元24同时将扫描线21下拉到低电位，进而保证阵列基板20的左右两侧同时关闭像素单元25。
与图1所示的多个移位寄存器10相比较，本实施例的每条扫描线21对应一个移位寄存器23，多个移位寄存器23的数量减少，进而减少多个移位寄存器23所占用空间，实现窄边框，提高用户的体验效果；此外，移位寄存器23和开关单元24同时将扫描线21的电位拉到低电位，能够保证扫描线21被拉到低电位的时间相同。
更进一步，在其他实施例中，开关单元24的控制端接收第二控制信号，扫描线21的另一端连接对应的开关单元24的第一端，该开关单元24的第二端接收高电平。在第二控制信号为高电平时，开关单元24和移位寄存器23同时工作，此时移位寄存器23输出的扫描信号为高电平，并且开关单元24将扫描线21的电平拉至高电平，以使扫描线21两侧连接的像素单元25的同时开启。
如图4所示，第二实施例的阵列基板40与第一实施例所揭示的阵列基板20的不同之处在于：多个移位寄存器43设置在阵列基板40的显示区域AA的左侧，多个开关单元44设置在显示区域AA的右侧，多个移位寄存器43远离显示区域AA的一侧设置有信号线461，多个开关单元44远离显示区域AA的一侧设置有信号线462。
其中，信号线461用于传输启动信号STV、第一低频时钟信号LC1、第二低频时钟信号LC2、直流低电压VSS以及高频时钟信号CK1-CK4中的一个高频时钟信号。信号线462用于传输直流低电压VSS、高频时钟信号CK1-CK4中的一个高频时钟信号。本实施例的移位寄存器43对应的时序图，如图5所示。
与图1所示的多个移位寄存器10相比较，本实施例的每条扫描线41对应一个移位寄存器43，且多个移位寄存器43设置在阵列基板40的显示区域AA的左侧，进而减少多个移位寄存器43所占用空间，实现窄边框，提高用户的体验效果；此外，移位寄存器43和开关单元44同时将扫描线41的电位拉到低电位，能够保证扫描线被拉到低电位的时间相同。
在其他实施例中，本领域的普通技术人员完全可以将多个移位寄存器设置在阵列基板的显示区域的右侧，多个开关单元设置在显示区域的左侧。
如图6所示，本实施例的显示面板60包括阵列基板61、彩膜基板62以及液晶层63，彩膜基板62与阵列基板61相对设置，液晶层63设置在彩膜基板62与阵列基板61之间，该阵列基板61为上述实施例所揭示的阵列基板，在此不再赘述。
如图7所示，本实施例的显示装置70包括显示面板71和背光模组72，显示面板71设置在背光模组72的出光方向，显示面板71包括阵列基板711、彩膜基板712以及液晶层713，彩膜基板712与阵列基板711相对设置，液晶层713设置在彩膜基板712与阵列基板711之间，该阵列基板711为上述实施例所揭示的阵列基板，在此不再赘述。
综上所述，每个移位寄存器用于向对应的扫描线的一端输入扫描信号，每条扫描线的另一端连接对应的开关单元的第一端，开关单元的第二端接收第一参考电压，开关单元的控制端接收第一控制信号，移位寄存器和开关单元同时将扫描线的电位拉到低电位，其中每条扫描线对应一个移位寄存器，进而减少多个移位寄存器所占用空间，实现窄边框，提高用户的体验效果；此外，移位寄存器和开关单元同时将扫描线的电位拉到低电位，能够保证扫描线被拉到低电位的时间相同。
以上所述仅为本发明的实施方式，并非因此限制本发明的专利范围，凡是利用本发明说明书及附图内容所作的等效结构或等效流程变换，或直接或间接运用在其他相关的技术领域，均同理包括在本发明的专利保护范围内。

Claims (10)

1.一种阵列基板，其特征在于，所述阵列基板包括多条扫描线、多条数据线、多个移位寄存器和多个开关单元，所述多条扫描线和所述多条数据线相交设置，以形成多个像素单元；每个所述移位寄存器用于向对应的所述扫描线的一端输入扫描信号，每条所述扫描线的另一端连接对应的所述开关单元的第一端，所述开关单元的第二端接收第一参考电压，所述开关单元的控制端接收第一控制信号，所述移位寄存器和所述开关单元同时将所述扫描线的电位拉到低电位。
2.根据权利要求1所述的阵列基板，其特征在于，所述多个移位寄存器包括多个奇数级移位寄存器和多个偶数级移位寄存器，所述多个奇数级移位寄存器设置在所述阵列基板的显示区域的左侧，所述多个偶数级移位寄存器设置在所述显示区域的右侧，所述多个奇数级移位寄存器分别与奇数级的扫描线的一端连接，所述多个偶数级移位寄存器分别与偶数级的扫描线的一端连接。
3.根据权利要求2所述的阵列基板，其特征在于，所述多个开关单元包括多个第一开关单元和多个第二开关单元，所述多个第一开关单元设置在所述显示区域的右侧，所述多个第二开关单元设置在所述显示区域的左侧，所述多个第一开关单元分别与所述奇数级的扫描线的另一端连接，所述多个第二开关单元分别与所述偶数级的扫描线的另一端连接。
4.根据权利要求3所述的阵列基板，其特征在于，在所述多个奇数级移位寄存器将所述奇数级的扫描线拉到低电位时，所述多个第一开关单元用于将所述奇数级的扫描线拉到低电位；在所述多个偶数级移位寄存器将所述偶数级的扫描线拉到低电位时，所述多个第二开关单元用于将所述偶数级的扫描线拉到低电位。
5.根据权利要求1所述的阵列基板，其特征在于，所述多个移位寄存器设置在所述阵列基板的显示区域的左侧，所述多个开关单元设置所述显示区域的右侧。
6.根据权利要求1所述的阵列基板，其特征在于，所述多个移位寄存器设置在所述阵列基板的显示区域的右侧，所述多个开关单元设置所述显示区域的左侧。
7.根据权利要求1所述的阵列基板，其特征在于，所述移位寄存器输入第二控制信号，所述移位寄存器根据所述第二控制信号产生扫描信号，所述第一控制信号的相位与所述第二控制信号的相位相反。
8.根据权利要求1所述的阵列基板，其特征在于，所述开关单元包括薄膜晶体管，所述开关单元的控制端为所述薄膜晶体管的栅极，所述开关单元的第一端为所述薄膜晶体管的漏极，所述开关单元的第二端为所述薄膜晶体管的源极。
9.一种显示面板，其特征在于，所述显示面板包括如权利要求1-8任意一项所述的阵列基板。
10.一种显示装置，其特征在于，所述显示装置包括如权利要求1-8任意一项所述的阵列基板。
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