CN105719593A - 一种栅极驱动电路、显示面板以及电子设备 - Google Patents

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CN105719593A CN201610284482.7A CN201610284482A CN105719593A CN 105719593 A CN105719593 A CN 105719593A CN 201610284482 A CN201610284482 A CN 201610284482A CN 105719593 A CN105719593 A CN 105719593A
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Abstract

本发明公开了一种栅极驱动电路、显示面板以及电子设备，所述栅极驱动电路将所有扫描移位寄存器分为n组，能够降低时钟信号频率，降低功耗。且各个扫描移位寄存器组的第一个扫描移位寄存器共用一个第一虚拟移位寄存器，所述栅极驱动电路在进行正向扫描时，通过所述第一虚拟移位寄存器为所有扫描移位寄存器组提供扫描起始信号，相对于各个扫描移位寄存器组均需要单独的虚拟移位寄存器的实施方式，降低了虚拟移位寄存器的数量，进而使得电路结构简单，可以降低显示面板的边框区的宽度，便于电子设备的窄边框设计。本发明所述显示面板采用上述栅极驱动电路，可以减小边框区的宽度。采用所述显示面板的电子设备，便于窄边框的设计。

Description

一种栅极驱动电路、显示面板以及电子设备
技术领域
本发明涉及显示装置技术领域，更具体的说，涉及一种栅极驱动电路、显示面板以及电子设备。
背景技术
随着科学技术的不断发展，越来越多的具有显示功能的电子设备被广泛的应用于人们的日常生活以及工作当中，为人们的日常生活以及工作带来了巨大的便利，成为当今人们不可或缺的重要工具。
电子设备实现显示功能的主要部件是显示面板。显示面板需要栅极驱动电路对栅极线进行扫描，以驱动显示面板进行图像显示。传统的栅极驱动电路一般需要多个虚拟移位寄存器，导致显示面板的边框区较宽，不便于电子设备实现窄边框设计。
发明内容
为了解决上述问题，本发明技术方案提供了一种栅极驱动电路、显示面板以及电子设备，所述栅极驱动电路中，各个扫描移位寄存器组的第一个扫描移位寄存器共用一个第一虚拟移位寄存器，电路结构简单，可以降低显示面板的边框区的宽度，便于电子设备的窄边框设计。
为了实现上述目的，本发明提供如下技术方案：
一种栅极驱动电路，用于显示面板，所述显示面板具有在第一方向上依次排列的相互平行的N条栅极线，该栅极驱动电路包括：
N个扫描移位寄存器，所述N个扫描移位寄存器在所述第一方向上依次排列，所述N个扫描移位寄存器的输出端与所述N条栅极线一一对应连接，所述N个扫描移位寄存器分为n个扫描移位寄存器组，每一所述扫描移位寄存器组具有多个在所述第一方向上依次排列的扫描移位寄存器；N与n均为正整数，且n为小于N；
1个第一虚拟移位寄存器，所述第一虚拟移位寄存器与每个扫描移位寄存器组的第一个扫描移位寄存器均连接，用于为所述扫描移位寄存器组提供正向扫描起始信号；
其中，所述扫描移位寄存器具有时钟信号线接口，用于输入时钟信号；当所述栅极驱动电路进行正向扫描时，所述时钟信号用于控制所述N个扫描移位寄存器输出信号的时序。
本发明还提供了一种显示面板，所述显示面板具有显示区以及边框区；所述显示区设置有在第一方向上平行设置的N条栅极线，N为正整数；
所述边框区设置有第一栅极驱动电路，所述第一栅极驱动电路具有N个扫描移位寄存器，在所述第一方向上，所述N个扫描移位寄存器的输出端与所述N条栅极线一一对应连接；
所述第一栅极驱动电路为权利要求1-7中任一项所述的栅极驱动电路。
本发明还提供了一种电子设备，该电子设备包括上述显示面板。
通过上述描述可知，在本发明技术方案所述栅极驱动电路中，各个扫描移位寄存器组的第一个扫描移位寄存器共用一个第一虚拟移位寄存器，所述栅极驱动电路在进行正向扫描时，通过所述第一虚拟移位寄存器为所有扫描移位寄存器组提供扫描起始信号，相对于各个扫描移位寄存器组均需要单独的虚拟移位寄存器的实施方式，降低了虚拟移位寄存器的数量，进而使得电路结构简单，可以降低显示面板的边框区的宽度，便于电子设备的窄边框设计。
本发明技术方案提供的显示面板采用上述栅极驱动电路，可以减小边框区的宽度。因此，采用所述显示面板的电子设备，便于窄边框的设计。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据提供的附图获得其他的附图。
图1为现有技术中一种常见的栅极驱动电路；
图2为本发明实施例提供的一种栅极驱动电路的结构示意图；
图3为本发明实施例提供的另一种栅极驱动电路的结构示意图；
图4为本发明实施例提供的另一种栅极驱动电路的结构示意图；
图5为图4所示栅极驱动电路进行正向扫描时的时序图；
图6为本发明实施例提供的一种显示面板的结构示意图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
显示面板具有多条平行排布的栅极线，需要通过栅极驱动电路为栅极线提供扫描信号，以便于对显示面板的像素单元进行显示驱动。
传统的栅极驱动电路包括多个级联的扫描移位寄存器，扫描移位寄存器与栅极线一一对应连接，上一级的扫描移位寄存器的输出信号作为下一级的扫描移位寄存器的输入信号，通过时钟信号控制各个扫描移位寄存器的输出信号的移位输出，该实施方式需要两条使用信号线提供两个频率相同，相位相反的时钟信号。设定此时的时钟信号频率为F0。如果栅极驱动电路用于逐一扫描各条栅极线时，上述栅极电路的级联方式会导致移位寄存器的时钟信号的频率较高，进而导致栅极驱动电路的功耗较大。
如果栅极驱动电路用于逐一扫描各条栅极线时，可以通过改变栅极驱动电路的扫描移位寄存器的级联方式来降低时钟信号的频率，如可以将栅极驱动电路的扫描移位寄存器分为多个扫描移位寄存器组，每个扫描移位寄存器组。
参考图1，图1为现有技术中一种常见的栅极驱动电路，该栅极驱动电路具有2n个扫描移位寄存器，n为正整数。2n个扫描移位寄存器在第一方向X上依次排布。所有扫描移位寄存器分为两个扫描移位寄存器组。图1中仅示出了栅极驱动电路的前四个扫描移位寄存器，前四个扫描移位寄存器依次包括：第一级扫描栅极移位寄存器ASG1、第二级扫描移位寄存器ASG2、第三级扫描移位寄存器ASG3以及第四级扫描移位寄存器ASG4。
两个扫描移位寄存器组中，所有的第2i-1级扫描移位寄存器位于同一扫描移位寄存器组，所有的第2i级扫描移位寄存器位于同一扫描移位寄存器组，i为不大于n的正整数。第2i-1级扫描移位寄存器的输出信号作为第2i+1级扫描移位寄存器的输入信号，第2i级扫描移位寄存器的输出信号作为第2i+2级扫描移位寄存器的输入信号。如第一级扫描栅极移位寄存器ASG1的输出信号Gout1作为第三级扫描移位寄存器ASG3的输入信号，第二级扫描移位寄存器ASG2的输出信号Gout2作为第四级扫描移位寄存器ASG4输入信号。
在第一方向上对栅极线进行逐一扫描时，第一级扫描栅极移位寄存器ASG1的输出信号Gout1用于扫描第一条栅极线，第三级扫描移位寄存器ASG3的输出信号Gout3用于扫描第三条栅极线，第一级扫描栅极移位寄存器ASG1的输出信号Gout1用于扫描第一条栅极线，第四级扫描移位寄存器ASG4的输出信号Gout4用于扫描第四条栅极线。上一条栅极线扫描完成以后，开始扫描下一条栅极，逐一对栅极线进行扫描，以完成所有栅极线的扫描。
图1所示栅极驱动电路需要四条时钟信号线，分别用于提供时钟信号ck1、时钟信号ck2、时钟信号ck3以及时钟信号ck4，连接同一扫描移位寄存器组的两个时钟信号相位相反。四个时钟信号的频率相同，设定频率为F1。图1所示栅极驱动电路中时钟信号的频率为具有两条时钟信号线的栅极驱动电路中时钟信号的频率的一半。虽然，图1所示栅极驱动电路能够降低时钟信号线的频率，但是，每一组扫描移位寄存器需要单独的设置一个虚拟移位寄存器DummyASG。如图1所示，其中一个虚拟移位寄存器DummyASG用于为一组扫描移位寄存器提供扫描其实信号STV1，另一个虚拟移位寄存器DummyASG用于为另一组扫描移位寄存器提供扫描其实信号STV2。
如果栅极驱动电路采用两条时钟信号线的级联方式，每个扫描移位寄存器完成一次信号输出，则需要时钟信号进行一次高低电平的翻转。而图1所示实施方式，由于将所有的扫描移位寄存器分为两组，如果从第一级扫描栅极移位寄存器ASG1开始扫描，ck3以及ck4控制第一级扫描栅极移位寄存器ASG1输出输出信号Gout1后，ck1以及ck3控制第二级扫描移位寄存器ASG2输出输出信号Gout2，在此过程中，由于第一级扫描栅极移位寄存器ASG1与第二级扫描移位寄存器ASG2位于不同的扫描移位寄存器组，二者采用不同的时钟信号线，因此ck3以及ck4需要第二级扫描移位寄存器ASG2完成输出再进行高低电平翻转，以控制第三级扫描栅极移位寄存器ASG3输出输出信号Gout3，可见时钟信号间隔一级扫描栅极移位寄存器进行一次高低电平翻转，将时钟信号的频率降低了一倍，即F0＝2*F1。可见，上述栅极驱动电路通过分组扫描移位寄存器能够有效降低时钟信号线的频率，降低功耗。但是，虚拟移位寄存器以及扫描其实信号线的数量较多，占用的布线空间较大，而且栅极驱动电路划分的扫描移位寄存器组的个数越多，虚拟移位寄存器以及扫描其实信号线的数量越多。
可见，传统的栅极驱动电路在降低时钟信号频率的时候，会使得显示面板的边框宽度较大，不便窄边框设计。因此，如何在降低时钟信号频率的同时，保证显示面板具有较小的边框区宽度，是一个亟待解决的问题。
为了解决上述问题，本发明实施例提供了一种栅极驱动电路，用于显示面板，所述显示面板具有在第一方向上依次排列的相互平行的N条栅极线，该栅极驱动电路包括：
N个扫描移位寄存器，所述N个扫描移位寄存器在所述第一方向上依次排列，所述N个扫描移位寄存器的输出端与所述N条栅极线一一对应连接，所述N个扫描移位寄存器分为n个扫描移位寄存器组，每一所述扫描移位寄存器组具有多个在所述第一方向上依次排列的扫描移位寄存器；N与n均为正整数，且n为小于N；
1个第一虚拟移位寄存器，所述第一虚拟移位寄存器与每个扫描移位寄存器组的第一个扫描移位寄存器均连接，用于为所述扫描移位寄存器组提供正向扫描起始信号；
其中，所述扫描移位寄存器具有时钟信号线接口，用于输入时钟信号；当所述栅极驱动电路进行正向扫描时，所述时钟信号用于控制所述N个扫描移位寄存器输出信号的时序。
所述栅极驱动电路中，各个扫描移位寄存器组的第一个扫描移位寄存器共用一个第一虚拟移位寄存器，所述栅极驱动电路在进行正向扫描时，通过所述第一虚拟移位寄存器为所有扫描移位寄存器组提供扫描起始信号，相对于各个扫描移位寄存器组均需要单独的虚拟移位寄存器的实施方式，降低了虚拟移位寄存器的数量，进而使得电路结构简单，可以降低显示面板的边框区的宽度，便于电子设备的窄边框设计。
为了使本发明实施例提供的技术方案更加清楚，下面结合附图对上述方案进行详细描述。
参考图2，图2为本发明实施例提供的一种栅极驱动电路的结构示意图，该栅极驱动电路用于显示面板，所述显示面板具有第一方向X上依次排列的相互平行的N条栅极线。
图2所示栅极驱动电路包括：N个扫描移位寄存器21以及1个第一虚拟移位寄存器22。
所述N个扫描移位寄存器21在所述第一方向X上依次排列，所述N个扫描移位寄存器21的输出端与所述N条栅极线一一对应连接，所述N个扫描移位寄存器21分为n个扫描移位寄存器组，每一所述扫描移位寄存器组具有多个在所述第一方向X上依次排列的扫描移位寄存器21；N与n均为正整数，且n为小于N。
所述第一虚拟移位寄存器22与每个扫描移位寄存器组的第一个扫描移位寄存器均连接，用于为所述扫描移位寄存器组提供正向扫描起始信号STV3；
其中，所述扫描移位寄存器21具有时钟信号线接口，用于输入时钟信号；当所述栅极驱动电路进行正向扫描时，所述时钟信号用于控制所述N个扫描移位寄存器21输出信号的时序。
可见，所述栅极驱动电路只需要通过一个第一虚拟移位寄存器22同时为所有n个扫描移位寄存器组的第一个扫描移位寄存器提供正向扫描其实信号，进而只需要一条正向扫描其实信号数据线，相对于单独为每一个扫描移位寄存器组单独设置虚拟移位寄存器的实施方式，大大简化了电路结构，从而减少了栅极驱动电路的移位寄存器的布线空间，减小了显示面板的边框区的宽度，便于窄边框设计。
需要说明的是，所述正向扫描是指栅极驱动电路逐一扫描栅极线的顺序是沿着第一方向X，从第一条栅极线开始逐一向下扫描各个栅极线。在扫描过程中，栅极驱动电路从第一个扫描移位寄存器ASG1开始，到第N个扫描移位寄存器ASGN结束，依次输出输出信号。
本发明实施例所述栅极驱动电路还包括：1个第二虚拟移位寄存器23，所述第二虚拟移位寄存器23与所述n个扫描移位寄存器组的最后一个扫描移位寄存器连接，用于为所述扫描移位寄存器组提供反向扫描起始信号STV4；当所述栅极驱动电路进行反向扫描时，所述时钟信号还用于控制所述N个扫描移位寄存器输出信号的时序。
需要说明的是，所述反向扫描是指栅极驱动电路逐一扫描栅极线的顺序是沿着第一方向X的反方向，从第N条栅极线开始逐一向上扫描各个栅极线。在扫描过程中，栅极驱动电路从第N个扫描移位寄存器ASGN开始，到第一个扫描移位寄存器ASG1结束，依次输出输出信号。
如果N个扫描移位寄存器分为n个扫描移位寄存器组，优选的，N为n的整数倍。则每个扫描移位寄存器组具有N/n个扫描移位寄存器。
设定n个扫描移位寄存器组依次为第一扫描移位寄存器组至第n扫描移位寄存器组。第一扫描移位寄存器组至至第n扫描移位寄存器组的第m个扫描移位寄存器在第一方向X上依次排布，m为不大于N/n的正整数。第一扫描移位寄存器组至至第n扫描移位寄存器组的第m个扫描移位寄存器为n个在第一方向上连续排布的扫描移位寄存器。
图2所示实施方式中，n＝2，即栅极驱动电路的N个扫描移位寄存器分为两个扫描移位寄存器组。图2所示栅极驱动电路中，栅极驱动电路中后三个扫描移位寄存器与时钟信号线的连接关系是以N为偶数为例进行图示说明的。N也可以为奇数，此时，只需要调节最后三个扫描移位寄存器的与时钟信号线的连接关系即可。
如图2所示，所述栅极驱动电路还包括：2*n条时钟信号线，所述时钟信号线用于提供所述时钟信号。各个时钟信号线中时钟信号的频率相同。当n＝2时，所述栅极驱动电路的时钟信号线包括：用于提供第一时钟信号CK1的第一时钟信号线，用于提供第二时钟信号CK2的第二时钟信号线，用于提供第三时钟信号CK3的第三时钟信号线以及用于提供第四时钟信号CK4的第四时钟信号线。其中，所有时钟信号的频率相同，第一时钟信号CK1与第三时钟信号CK3的相位相反，第二时钟信号CK2与第时钟信号CK4的相位相反。
所述时钟信号线接口包括：第一接口以及第二接口，即任意扫描移位寄存器的具有两个用于连接时钟信号线的接口。同一所述扫描移位寄存器21的第一接口与所述第二接口均单独连接一条所述时钟信号线，这样，每一扫描移位寄存器组均对应有两条时钟信号线。不同的扫描移位寄存器组的对应的两条时钟信号线不同。
同一所述扫描移位寄存器组中，所有扫描移位寄存器21的第一接口与该扫描移位寄存器组对应的两条时钟信号线交替的连接，所有扫描移位寄存器21的第二接口与该扫描移位寄存器组对应的两条时钟信号线交替的连接，第1个扫描移位寄存器ASG1的两个时钟信号线接口依次连接第一时钟信号线以及第三时钟信号线，第2个扫描移位寄存器ASG2的两个时钟信号线接口依次连接第二时钟信号线以及第四时钟信号线。不同的所述扫描移位寄存器组与不同的时钟信号线连接。
一条所述时钟信号线与所述扫描移位寄存器21的一个时钟信号线接口连接。不同的所述扫描移位寄存器组与不同的时钟信号线连接。即每一扫描移位寄存器组均单独的对应两条时钟信号线。
如上述，连接同一所述扫描移位寄存器组的两条时钟信号线中的时钟信号的相位差为180°，即连接同一扫描移位寄存器组的两条时钟信号线中的时钟信号相位相反，其中一个时钟信号为高电平时，另一个时钟信号为低电平。
图2所示实施方式中，以n＝2为例进行说明。所述N个扫描移位寄存器21分为第一扫描移位寄存器组以及第二扫描移位寄存器组。
在所述第一方向X上，所述第一扫描移位寄存器组中的扫描移位寄存器21与所述第二扫描移位寄存器组中的扫描移位寄存器21交替排列。同一所述扫描移位寄存器组中，对于在所述第一方向X上相邻的两个扫描移位寄存器21，前一个扫描移位寄存器的输出信号作为后一个扫描移位寄存器的输入信号。
具体的，在第1个扫描移位寄存器ASG1至第N个扫描移位寄存器ASGN中，第2j个扫描移位寄存器ASG2j位于一个扫描移位寄存器组，第2j-1个扫描移位寄存器ASG2j-1位于另一个扫描移位寄存器组。j为正整数。
以N为偶数为例，一个扫描移位寄存器组中，第1个扫描移位寄存器ASG1的输出信号Gout1为第3个扫描移位寄存器ASG3的输入信号，第3个扫描移位寄存器ASG3的输出信号Gout3为第5个扫描移位寄存器ASG5的输入信号，…，第N-3个扫描移位寄存器ASGN-3的输出信号GoutN-3为第N-1个扫描移位寄存器ASGN-1的输入信号；在另一个扫描移位寄存器组中，第2个扫描移位寄存器ASG2的输出信号Gout2为第4个扫描移位寄存器ASG4的输入信号，第4个扫描移位寄存器ASG4的输出信号Gout4为第6个扫描移位寄存器ASG6的输入信号，…，第N-2个扫描移位寄存器ASGN-2的输出信号GoutN-2为第N个扫描移位寄存器ASGN的输入信号。第N-1个扫描移位寄存器ASGN-1的输出信号GoutN-1的输出信号GoutN-1为所在扫描移位寄存器组的最后一个扫描输出信号。第N个扫描移位寄存器ASGN的输出信号GoutN的输出信号GoutN为所在扫描移位寄存器组的最后一个扫描输出信号。
图2所示栅极驱动电路中，如要实现一个方向的扫描驱动，只需要设置一个虚拟移位寄存器，如果需要实现两个方向的扫描驱动，只需要设置两个虚拟移位寄存器即可。栅极驱动电路结构简单，虚拟移位寄存器的布线空间小，降低了边框区的宽度，便于窄边框设计。如上述，当将扫描移位寄存器21分为两组时，可以将时钟信号的频率降低一倍。参考图3，图3为本发明实施例提供的另一种栅极驱动电路的结构示意图，在图3所示实施方式中，n＝3，显示面板的N个扫描移位寄存器31分为第一扫描移位寄存器组、第二扫描移位寄存器组以及第三扫描移位寄存器组；
所述第一扫描移位寄存器组的第i个扫描移位寄存器、所述第二扫描移位寄存器组的第i个扫描移位寄存器以及所述第三扫描移位寄存器组的第i个扫描移位寄存器在所述第一方向X上依次排列，i为正整数。同一所述扫描移位寄存器组中，对于在所述第一方向X上相邻的两个扫描移位寄存器，前一个扫描移位寄存器的输出信号作为后一个扫描移位寄存器的输入信号。
如图3所示，扫描移位寄存器ASG1为第一扫描移位寄存器组的第一个扫描移位寄存器，依次连接时钟信号CK4以及CK1；扫描移位寄存器ASG2为第二扫描移位寄存器组的第一个扫描移位寄存器，依次连接时钟信号CK5以及CK2；扫描移位寄存器ASG3为第三扫描移位寄存器组的第一个扫描移位寄存器，依次连接时钟信号CK6以及CK3。扫描移位寄存器ASG4为第一扫描移位寄存器组的第二个扫描移位寄存器，依次连接时钟信号CK1以及CK4；扫描移位寄存器ASG5为第二扫描移位寄存器组的第二个扫描移位寄存器，依次连接时钟信号CK2以及CK5；扫描移位寄存器ASG6为第三扫描移位寄存器组的第二个扫描移位寄存器，依次连接时钟信号CK3以及CK6。
此时，CK4以及CK1相位相反，时钟信号CK5以及CK2相位相反，时钟信号CK6以及CK3相位相反。
在图3所示实施方法中，能够将时钟信号的频率降低为F0的三分之一。且在一个扫描方向上，所有扫描移位寄存器组公用一个虚拟移位寄存器32，虚拟移位寄存器32的数量少，移位寄存器的布线空间小，因此，相对于每个扫描移位寄存器组均单独设置虚拟移位寄存器的实施方式，能够降低显示面板的边框区宽度。参考图4，图4为本发明实施例提供的另一种栅极驱动电路的结构示意图，在图4所示实施方式中，n＝4，显示面板的N个扫描移位寄存器41分为第一扫描移位寄存器组、第二扫描移位寄存器组、第三扫描移位寄存器组以及第四扫描移位寄存器组；
所述第一扫描移位寄存器组、所述第二扫描移位寄存器组、所述第三扫描移位寄存器组以及所述第四扫描移位寄存器组的第i个扫描移位寄存器在所述第一方向X上依次排列，i为正整数；同一所述扫描移位寄存器组中，对于在所述第一方向X上相邻的两个扫描移位寄存器41，前一个扫描移位寄存器的输出信号作为后一个扫描移位寄存器的输入信号。
如图4所示，扫描移位寄存器ASG1为第一扫描移位寄存器组的第一个扫描移位寄存器，依次连接时钟信号CK5以及CK1；扫描移位寄存器ASG2为第二扫描移位寄存器组的第一个扫描移位寄存器，依次连接时钟信号CK6以及CK2；扫描移位寄存器ASG3为第三扫描移位寄存器组的第一个扫描移位寄存器，依次连接时钟信号CK7以及CK3；扫描移位寄存器ASG4为第四扫描移位寄存器组的第一个扫描移位寄存器，依次连接时钟信号CK8以及CK4。扫描移位寄存器ASG5为第一扫描移位寄存器组的第二个扫描移位寄存器，依次连接时钟信号CK1以及CK5；扫描移位寄存器ASG6为第二扫描移位寄存器组的第二个扫描移位寄存器，依次连接时钟信号CK2以及CK6。
此时，时钟信号CK5以及CK1相位相反，时钟信号CK6以及CK2相位相反，时钟信号CK7以及CK3相位相反，时钟信号CK8以及CK4相位相反。
在图4所示实施方法中，能够将时钟信号的频率降低为F0的四分之一。且在一个扫描方向X上，所有扫描移位寄存器组公用一个虚拟移位寄存器42，虚拟移位寄存器42的数量少，移位寄存器的布线空间小，因此，相对于每个扫描移位寄存器组均单独设置虚拟移位寄存器的实施方式，能够降低显示面板的边框区宽度。
参考图5，图5为图4所示栅极驱动电路进行正向扫描时的时序图，DMY为虚拟移位寄存器的波形图，图5中仅示出了CK1、CK2、CK3以及CK4这四个时钟信号。ASG1-P为扫描移位寄存器ASG1的节点电压波形图，ASG2-P为扫描移位寄存器ASG2的节点电压波形图，ASG3-P为扫描移位寄存器ASG3的节点电压波形图，ASG4-P为扫描移位寄存器ASG4的节点电压波形图。
通过上述描述可知，本发明实施例所述栅极驱动电路将所有扫描移位寄存器分为n组，能够将时钟信号的频率降低为F0的1/n,大大降低功耗。且在同一扫描方向上，所有扫描移位寄存器组采用同一虚拟移位寄存器提供扫描起始信号，相对于各个扫描移位寄存器组均需要单独的虚拟移位寄存器的实施方式，降低了虚拟移位寄存器的数量，进而使得电路结构简单，可以降低显示面板的边框区的宽度，便于电子设备的窄边框设计。
基于上述实施例，本发明另一实施例还提供了一种显示面板，该显示面板如图6所述，图6为本发明实施例提供的一种显示面板的结构示意图，该显示面板具有显示区611以及边框区612。可选的，边框区612包围显示区611。
所述显示区611设置有在第一方向X上平行设置的N条栅极线62，N为正整数。
所述边框区612设置有第一栅极驱动电路63，所述第一栅极驱动电路63具有N个扫描移位寄存器，在所述第一方向X上，所述N个扫描移位寄存器的输出端与所述N条栅极线62一一对应连接。
所述第一栅极驱动电路63为上述实施例所述的栅极驱动电路。所述显示面板采用上述实施例所述的栅极驱动电路，边框区较窄，便于窄边框设计，且时钟信号的频率低，功耗小。
可选的，所述边框区612具有第一边框区以及第二边框区，所述第一边框区与所述第二边框区位于所述显示区611相对的两侧。所述第一栅极驱动电路63设置在所述第一边框区；所述显示面板61还包括：设置在所述第二边框区的第二栅极驱动电路64，所述第二栅极驱动电路64与所述第一栅极驱动电路63相同。在所述第一方向X上，所述第一栅极驱动电路63的第j个扫描移位寄存器的输出端与第j条栅极线的一端连接，所述第二栅极驱动电路64的第j个扫描移位寄存器的输出端与第j条栅极线的另一端连接，j为小于N的正整数。
随着显示面板分辨率的不断提升，显示面板每条栅极线62上连接的像素单元越来越多，如果仅通过答疑栅极驱动电路63从栅极线62的一端扫描栅极线62，远端像素单元的响应速度较慢，通过设置第二栅极驱动电路64，可以提高响应速度。
本发明另一实施例还提供了一种电子设备，该电子设备包括上述实施例所述的显示面板。
所述电子设备可以为手机、电脑以及可穿戴电子设备等具有显示功能的电子设备。由于所述电子设备采用上述实施例所述显示面板，因此，所述电子设备的扫描响应速度快，边框区窄，功耗低。
对所公开的实施例的上述说明，使本领域专业技术人员能够实现或使用本发明。对这些实施例的多种修改对本领域的专业技术人员来说将是显而易见的，本文中所定义的一般原理可以在不脱离本发明的精神或范围的情况下，在其它实施例中实现。因此，本发明将不会被限制于本文所示的这些实施例，而是要符合与本文所公开的原理和新颖特点相一致的最宽的范围。

Claims (10)

1.一种栅极驱动电路，用于显示面板，所述显示面板具有在第一方向上依次排列的相互平行的N条栅极线，其特征在于，包括：
N个扫描移位寄存器，所述N个扫描移位寄存器在所述第一方向上依次排列，所述N个扫描移位寄存器的输出端与所述N条栅极线一一对应连接，所述N个扫描移位寄存器分为n个扫描移位寄存器组，每一所述扫描移位寄存器组具有多个在所述第一方向上依次排列的扫描移位寄存器；N与n均为正整数，且n为小于N；
1个第一虚拟移位寄存器，所述第一虚拟移位寄存器与每个扫描移位寄存器组的第一个扫描移位寄存器均连接，用于为所述扫描移位寄存器组提供正向扫描起始信号；
其中，所述扫描移位寄存器具有时钟信号线接口，用于输入时钟信号；当所述栅极驱动电路进行正向扫描时，所述时钟信号用于控制所述N个扫描移位寄存器输出信号的时序。
2.根据权利要求1所述的栅极驱动电路，其特征在于，还包括：
1个第二虚拟移位寄存器，所述第二虚拟移位寄存器与所述n个扫描移位寄存器组的最后一个扫描移位寄存器连接，用于为所述扫描移位寄存器组提供反向扫描起始信号；
当所述栅极驱动电路进行反向扫描时，所述时钟信号还用于控制所述N个扫描移位寄存器输出信号的时序。
3.根据权利要求1所述的栅极驱动电路，其特征在于，所述栅极驱动电路还包括：2*n条时钟信号线，所述时钟信号线用于提供所述时钟信号；
所述时钟信号线接口包括：第一接口以及第二接口；同一所述扫描移位寄存器的第一接口与所述第二接口均单独连接一条所述时钟信号线；
同一所述扫描移位寄存器组中，所有扫描移位寄存器的第一接口与该扫描移位寄存器组对应的两条时钟信号线交替的连接，所有扫描移位寄存器的第二接口与该扫描移位寄存器组对应的两条时钟信号线交替的连接；
不同的所述扫描移位寄存器组与不同的时钟信号线连接。
4.根据权利要求3所述的栅极驱动电路，其特征在于，连接同一所述扫描移位寄存器组的两条时钟信号线中的时钟信号的相位差为180°。
5.根据权利要求3所述的栅极驱动电路，其特征在于，n＝2，所述N个扫描移位寄存器分为第一扫描移位寄存器组以及第二扫描移位寄存器组；
在所述第一方向上，所述第一扫描移位寄存器组中的扫描移位寄存器与所述第二扫描移位寄存器组中的扫描移位寄存器交替排列；
同一所述扫描移位寄存器组中，对于在所述第一方向上相邻的两个扫描移位寄存器，前一个扫描移位寄存器的输出信号作为后一个扫描移位寄存器的输入信号。
6.根据权利要求3所述的栅极驱动电路，其特征在于，n＝3，所述N个扫描移位寄存器分为第一扫描移位寄存器组、第二扫描移位寄存器组以及第三扫描移位寄存器组；
所述第一扫描移位寄存器组的第i个扫描移位寄存器、所述第二扫描移位寄存器组的第i个扫描移位寄存器以及所述第三扫描移位寄存器组的第i个扫描移位寄存器在所述第一方向上依次排列，i为正整数；
同一所述扫描移位寄存器组中，对于在所述第一方向上相邻的两个扫描移位寄存器，前一个扫描移位寄存器的输出信号作为后一个扫描移位寄存器的输入信号。
7.根据权利要求3所述的栅极驱动电路，其特征在于，n＝4，所述N个扫描移位寄存器分为第一扫描移位寄存器组、第二扫描移位寄存器组、第三扫描移位寄存器组以及第四扫描移位寄存器组；
所述第一扫描移位寄存器组、所述第二扫描移位寄存器组、所述第三扫描移位寄存器组以及所述第四扫描移位寄存器组的第i个扫描移位寄存器在所述第一方向上依次排列，i为正整数；
同一所述扫描移位寄存器组中，对于在所述第一方向上相邻的两个扫描移位寄存器，前一个扫描移位寄存器的输出信号作为后一个扫描移位寄存器的输入信号。
8.一种显示面板，所述显示面板具有显示区以及边框区；其特征在于，所述显示区设置有在第一方向上平行设置的N条栅极线，N为正整数；
所述边框区设置有第一栅极驱动电路，所述第一栅极驱动电路具有N个扫描移位寄存器，在所述第一方向上，所述N个扫描移位寄存器的输出端与所述N条栅极线一一对应连接；
所述第一栅极驱动电路为权利要求1-7中任一项所述的栅极驱动电路。
9.根据权利要求8所述的显示面板，其特征在于，所述边框区具有第一边框区以及第二边框区，所述第一边框区与所述第二边框区位于所述显示区相对的两侧；
所述第一栅极驱动电路设置在所述第一边框区；
所述显示面板还包括：设置在所述第二边框区的第二栅极驱动电路，所述第二栅极驱动电路与所述第一栅极驱动电路相同；
在所述第一方向上，所述第一栅极驱动电路的第j个扫描移位寄存器的输出端与第j条栅极线的一端连接，所述第二栅极驱动电路的第j个扫描移位寄存器的输出端与第j条栅极线的另一端连接，j为小于N的正整数。
10.一种电子设备，其特征在于，包括如权利要求8或9所述的显示面板。
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