CN104050935B - 移位寄存器、双向移位暂存装置及应用其的液晶显示面板 - Google Patents

移位寄存器、双向移位暂存装置及应用其的液晶显示面板 Download PDF

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Abstract

一种移位寄存器、双向移位暂存装置及应用其的液晶显示面板。移位寄存器包括预充电单元、上拉单元以及下拉单元。预充电单元接收对应所述移位寄存器的前二级与后二级移位寄存器的输出，并据以输出预充电信号。上拉单元接收预充电信号与第一输入时钟信号，并据以输出扫描信号。下拉单元耦接预充电单元与上拉单元并且接收预充电信号、第一输入时钟信号以及第二输入时钟信号以控制扫描信号的电平，其中第一输入时钟信号与第二输入时钟信号互为反相。

Description

移位寄存器、双向移位暂存装置及应用其的液晶显示面板
技术领域
本发明是有关于一种平面显示技术，且特别是有关于一种移位寄存器、双向移位暂存装置及应用其的液晶显示面板。
背景技术
近年来，随着半导体科技蓬勃发展，携带型电子产品及平面显示器产品也随之兴起。而在众多平面显示器的类型当中，液晶显示器(Liquid Crystal Display,LCD)基于其低电压操作、无辐射线散射、重量轻以及体积小等优点，随即已成为各显示器产品的主流。也亦因如此，无不驱使着各家厂商针对液晶显示器的开发技术要朝向更微型化及低制作成本发展。
为了要降低液晶显示器的制作成本，已有部分厂商研发出在液晶显示面板采用非晶硅(amorphous silicon,a-Si)制程的条件下，可将原先配置于液晶显示面板的扫描侧所使用的扫描驱动IC内部的移位寄存器(shift register)转移直接配置在液晶显示面板的玻璃基板(glass substrate)上。因此，原先配置于液晶显示面板的扫描侧所使用的扫描驱动IC即可省略，藉以达到降低液晶显示器的制作成本的目的。
发明内容
本发明提供一种移位寄存器、双向移位暂存装置及应用其的液晶显示面板，其可利用较少的控制信号来实现双向扫描的驱动机制，并且具有较高的可靠度。
本发明的移位寄存器包括预充电单元、上拉单元以及下拉单元。预充电单元接收对应所述移位寄存器的前二级与后二级移位寄存器的输出，并据以输出预充电信号。上拉单元耦接预充电单元，接收预充电信号与第一输入时钟信号，并据以输出扫描信号。下拉单元耦接预充电单元与上拉单元并且接收预充电信号、第一输入时钟信号以及第二输入时钟信号以控制扫描信号的电平，其中第一输入时钟信号与第二输入时钟信号互为反相。
本发明的双向移位暂存装置适用于一液晶显示面板，且包括N级如上所述的移位寄存器，其中各级移位寄存器彼此串接在一起，且配置于液晶显示面板的显示区的左侧。
本发明的右侧双向移位暂存装置适用于一液晶显示面板，且包括M级如上所述的移位寄存器，其中各级移位寄存器彼此串接在一起，且配置于液晶显示面板的显示区的右侧。
本发明的液晶显示面板包括显示区以及如上所述的两双向移位暂存装置，其中两双向移位暂存装置分别配置于显示区的左侧与右侧。
基于上述，本发明实施例提出一种移位寄存器、双向移位暂存装置及应用其的液晶显示面板，其中所述移位寄存器可利用动态反相器的电路架构来进行节点放电，并藉以所输出的扫描信号的电平，进而有效地提高整体双向移位暂存装置的可靠度。此外，基于本发明实施例的双向移位暂存装置的电路架构下，所述双向移位暂存装置可利用较少的控制信号来实现顺向扫描与逆向扫描的驱动机制，进而减少应用其的液晶显示面板的电路布局面积。
为让本发明的上述特征和优点能更明显易懂，下文特举实施例，并配合所附图式作详细说明如下。
附图说明
图1为本发明一实施例的液晶显示器的示意图。
图2A与2B为依照图1实施例的双向移位暂存装置的示意图。
图3A为依照图2A实施例的移位寄存器的示意图。
图3B～3E为依照图3A实施例的第1级至第4级移位寄存器的电路操作示意图。
图4为依照图3A实施例的移位寄存器的电路示意图。
图5A与5B为本发明一实施例的双向移位暂存装置的信号时序示意图。
图6A与6B为本发明另一实施例的双向移位暂存装置的信号时序示意图。
[标号说明]
100：液晶显示器 110：液晶显示面板
112_L、112_R：双向移位暂存装置 120：驱动电路
122：时序控制器 124：移位寄存器
130：背光模块 310、310_1～310_4：预充电单元
320、320_1～320_4：上拉单元 330、330_1～330_4：下拉单元
332、332_1～332_4：第一放电单元 334、334_1～334_4：第二放电单元
AA：显示区 BW：逆向输入信号
C1～C3：电容
CLK1_L～CLK4_L、CLK1_R～CLK4_R：时钟信号
FW：顺向输入信号 M1～M9：晶体管
PCS：预充电信号 RCK1：第一输入时钟信号
RCK2：第二输入时钟信号
SS1_L～SSN_L、SS1_R～SSM_R、SSi_L、SSj_R：扫描信号
STV1_L、STV2_L、STV1_R、STV2_R：起始信号
SR11～SR1N、SR21～SR2M、SR1i、SR2j：移位寄存器
Vss：参考电位 o、x：节点
t1～t9：时间
具体实施方式
本发明实施例提出一种移位寄存器、双向移位暂存装置及应用其的液晶显示面板，其中所述移位寄存器可利用动态反相器的电路架构来进行节点放电，并藉以控制所输出的扫描信号的电平，进而有效地提高整体双向移位暂存装置的可靠度。此外，基于本发明实施例的双向移位暂存装置的电路架构下，所述双向移位暂存装置可利用较少的控制信号来实现顺向扫描与逆向扫描的驱动机制，进而减少应用其的液晶显示面板的电路布局面积。为了使本发明的内容更容易明了，以下特举实施例作为本发明确实能够据以实施的范例。另外，凡可能之处，在图式及实施方式中使用相同标号的元件/构件/步骤代表相同或类似部分。
图1为本发明一实施例的液晶显示器的示意图。请参照图1，液晶显示器100包括液晶显示面板110、驱动电路120以及用以提供液晶显示面板110所需的(背)光源的背光模块130。
液晶显示面板110包括基板(未绘示，例如为玻璃基板)、多个像素(未绘示)以及双向移位暂存装置112_L与112_R。在液晶显示面板110中，所述像素配置于基板上且以阵列排列于显示区(display area)AA内。双向移位暂存装置112_L与112_R分别直接配置于显示区AA的两侧，并且经由对应的扫描线分别耦接至奇数行像素与偶数行像素。
驱动电路120包括时序控制器122以及源极驱动器124。在驱动电路120中，时序控制器120可提供多个预设时钟信号(如STV1_L、STV2_L、STV1_R、STV2_R、CLK1_L～CLK4_L、CLK1_R～CLK4_R)来控制源极驱动器124以及双向移位暂存装置112_L与112_R的操作。源极驱动器124受控于时序控制器122而输出多个像素电压来驱动液晶显示面板110显示画面。
详细而言，左侧双向移位暂存装置112_L会反应于时序控制器122所提供的起始信号STV1_L与STV2_L以及时钟信号CLK1_L～CLK4_L而输出多个扫描信号SS1_L～SSN_L，其中扫描信号SS1_L、SS2_L、SSN-1_L及SSN_L为冗余(dummy)扫描信号(不提供至液晶显示面板110，仅作为产生其它扫描信号的依据)，扫描信号SS3_L～SSN-2_L则会经由对应的扫描线提供至液晶显示面板110的奇数行像素，藉以序列地开启奇数行像素。在此，N为对应奇数行像素的行数的一预设正整数(在本实施例中N值等于奇数行像素的行数加4)。
相似地，右侧双向移位暂存装置112_R会反应于时序控制器122所提供的起始信号STV1_R与STV2_R以及时钟信号CLK1_R～CLK4_R而输出多个扫描信号SS1_R～SSM_R，其中扫描信号SS1_R、SS2_R、SSM-1_R及SSM_R为冗余扫描信号，扫描信号SS3_R～SSM-2_R则会经由对应的扫描线提供至液晶显示面板110的偶数行像素，藉以序列地开启偶数行像素。在此，Ｍ为对应偶数行像素的行数的一预设正整数(在本实施例中M值等于偶数行像素的行数加4)。
根据上述的驱动方式，液晶显示面板110的每一行像素会依据对应的扫描信号SS3_L～SSN-2_L与SS3_R～SSM-2_R而依序被开启，使得液晶显示面板110可据以显示画面。在本实施例中，时序控制器122可通过提供不同的预设时钟信号来控制双向移位暂存装置112_L与112_R的扫描顺序，使得双向移位暂存装置112_L与112_R以顺向(即由第一行至最后一行)或逆向(即由最后一行至第一行)的扫描顺序来依序开启每一行像素。
更清楚来说，图2A与2B分别为双向移位暂存装置112_L与112_R的示意图。请先参照图2A，左侧双向移位暂存装置112_L包括N级实质上相同且彼此串接在一起的移位寄存器SR11～SR1N，其中第1级、第2级、第N-1级与第N级移位寄存器SR11、SR12、SR1N-1、SR1N皆为输出冗余扫描信号的冗余移位寄存器，且第3级移位寄存器SR13至第N-2级移位寄存器SR1N-2分别经由对应的扫描线耦接至奇数行像素。相似地，请参照图2B，右侧双向移位暂存装置112_R包括M级实质上相同且彼此串接再依起的移位寄存器SR21～SR2M，其中第1级、第2级、第M-1级与第M级移位寄存器SR21、SR22、SR2M-1、SR2M皆为输出冗余扫描信号的冗余移位寄存器，且第3级移位寄存器SR23至第M-2级移位寄存器SR2M-2分别经由对应的扫描线耦接至偶数行像素。
在本实施例中，双向移位暂存装置112_L与112_R可依据顺向输入信号FW与逆向输入信号BW而以顺向或逆向的扫描顺序分别序列地输出扫描信号SS1_L～SSN_L与SS1_R～SSM_R，其中顺向输入信号FW与逆向输入信号BW可为时序控制器122所提供的预设时钟信号的其中之二，或者可由额外的信号产生单元所提供，本发明不以此为限。
在以下的实施例说明中，由于各级移位寄存器SR11～SR1N与SR21～SR2M的运作原理与电路架构大致相同，故主要以左侧双向移位暂存装置112_L的第i级移位寄存器SR1i为例来进行说明。于本领域技术人员应可从下述说明中直接而无歧异地推知右侧双向移位暂存装置112_R及其各级移位寄存器SR21～SR2M的运作原理与电路架构，故后述实施例中仅会针对右侧双向移位暂存装置112_R与左侧双向移位暂存装置112_L的不同之处加以说明，重复之处将不再赘述。
图3A为依照图2A实施例的移位寄存器的示意图。请同时参照图2A与图3A，第i级移位寄存器SR1i包括预充电单元310、上拉单元320以及下拉单元330。预充电单元310接收第(i-2)级与第(i+2)级移位寄存器SR1i-2与SR1i+2的输出，并据以输出预充电信号PCS，其中3≦i≦N-2。换言之，除了冗余移位寄存器之外的各个移位寄存器SR1i的预充电单元310会分别接收前二级与后二级移位寄存器SR1i-2与SR1i+2所输出的扫描信号SSi-2_L与SSi+2_L而据以产生对应的预充电信号PCS。
冗余移位寄存器则是分别利用时序控制器122所提供的起始信号STV1_L与STV2_L以产生对应的预充电信号PCS。举例来说，第1级移位寄存器SR11的预充电单元接收起始信号STV1_L与第3级移位寄存器SR13所输出的扫描信号SS3_L，第2级移位寄存器SR12的预充电单元接收起始信号STV2_L与第4级移位寄存器SR14所输出的扫描信号SS4_L，第N-1级移位寄存器SR1N-1的预充电单元接收第N-3级移位寄存器SR1N-3所输出的扫描信号SSN-3_L与起始信号STV1_L，且第N级移位寄存器SR1N的预充电单元接收第N-2级移位寄存器SR1N-2所输出的扫描信号SSN-2_L与起始信号STV2_L。
此外，每一级移位寄存器SR1i～SR1N的预充电单元还接收顺向输入信号FW与逆向输入信号BW，以使左侧双向移位暂存装置112_L依据顺向输入信号FW与逆向输入信号BW而利用顺向扫描或逆向扫描的扫描顺序来驱动显示区AA中的奇数行像素。举例来说，左侧双向移位暂存装置112_L可依据致能的顺向输入信号FW与禁能的逆向输入信号BW而依照第一行至最后一行的顺序来驱动奇数行像素(顺向扫描)，并且依据禁能的顺向输入信号FW与致能的逆向输入信号BW而依照最后一行至第一行的顺序来驱动奇数行像素(逆向扫描)。
上拉单元320耦接预充电单元310，接收预充电信号PCS与第一输入时钟信号RCK1，并据以输出扫描信号SSi_L。下拉单元330耦接预充电单元310与上拉单元320，且包括第一放电单元332以及第二放电单元334。其中，第一放电单元332接收预充电信号PCS与第二输入时钟信号RCK2，并据以决定是否将扫描信号SSi_L下拉至参考电位Vss(例如为一个负电压，但并不限制于此)。第二放电单元334接收预充电信号PCS与第一输入时钟信号RCK1，并据以决定是否将扫描信号SSi_L维持于参考电位Vss。
详细而言，时序控制器122会将不同的时钟信号CLK1_L～CLK4_L依序提供至每一级移位寄存器SR11～SR1N以作为对应的第一输入时钟信号RCK1与第二输入时钟信号RCK2，以使每一级移位寄存器SR11～SR1N可利用顺向扫描或逆向扫描的扫描顺序来驱动显示区AA中的奇数行像素。其中，时序控制器122所提供的起始信号STV1_L与STV2_L以及时钟信号CLK1_L～CLK4_L的信号波形会基于顺向扫描或逆向扫描的驱动方式而有所不同(此部分可在后述实施例的信号时序示意图中明显看出)。
在顺向扫描的驱动状态下，以第1级至第4级移位寄存器SR11～SR14为例，如图3B～3E所示。请参阅图3B，移位寄存器SR11的预充电单元310_1会接收起始信号STV1_L与扫描信号SS3_L，移位寄存器SR11的上拉单元320_1与第二放电单元334_1会接收时钟信号CLK3_L以作为第一输入时钟信号RCK1，且移位寄存器SR11的第一放电单元332_1则会接收时钟信号CLK1_L以作为第二时钟信号RCK2。
请参阅图3C，移位寄存器SR12的预充电单元310_2会接收起始信号STV2_L与扫描信号SS4_L，移位寄存器SR12的上拉单元320_2与第二放电单元334_2会接收时钟信号CLK4_L以作为第一输入时钟信号RCK1，且移位寄存器SR12的第一放电单元332_2则会接收时钟信号CLK2_L以作为第二时钟信号RCK2。
请参阅图3D，移位寄存器SR13的预充电单元310_3会接收扫描信号SS1_L与SS5_L，移位寄存器SR13的上拉单元320_3与第二放电单元334_3会接收时钟信号CLK1_L以作为第一输入时钟信号RCK1，且移位寄存器SR13的第一放电单元332_3则会接收时钟信号CLK3_L以作为第二时钟信号RCK2。
请参阅图3E，移位寄存器SR14的预充电单元310_4会接收扫描信号SS2_L与SS6_L，移位寄存器SR14的上拉单元320_4与第二放电单元334_4会接收时钟信号CLK2_L以作为第一输入时钟信号RCK1，且移位寄存器SR14的第一放电单元332_4则会接收时钟信号CLK4_L以作为第二时钟信号RCK2。
第5级移位寄存器SR15则会类似于第1级移位寄存器SR11，分别利用时钟信号CLK3_L与CLK1_L作为第一输入时钟信号RCK1与第二输入时钟信号RCK2，并且后续的移位寄存器SR16～SR1N皆会依据上述规律而利用对应的时钟信号CLK1_L～CLK4_L来作为第一输入时钟信号RCK1与第二输入时钟信号RCK2。
换言之，第4k-3级移位寄存器SR1i(i=4k-3，k为正整数)会分别以CLK3_L与CLK1_L作为第一输入时钟信号RCK1与第二输入时钟信号RCK2。第4k-2级移位寄存器SR1i(i=4k-2)会分别以CLK4_L与CLK2_L作为第一输入时钟信号RCK1与第二输入时钟信号RCK2。第4k-1级移位寄存器SR1i(i=4k-1)会分别以CLK1_L与CLK3_L作为第一输入时钟信号RCK1与第二输入时钟信号RCK2。第4k级移位寄存器SR1i(i=4k)会分别以CLK2_L与CLK4_L作为第一输入时钟信号RCK1与第二输入时钟信号RCK2。亦即，各级移位寄存器SR11～SR1N会依序以时钟信号CLK3_L、CLK4_L、CLK1_L及CLK2_L作为第一输入时钟信号RCK1，并且依序以时钟信号CLK1_L、CLK2_L、CLK3_L及CLK4_L作为第二输入时钟信号RCK2。
为了更清楚地说明本发明实施例，图4为依照图3A实施例的移位寄存器的电路示意图。请参照图4，预充电单元310包括晶体管M1与M2，上拉单元320包括晶体管M3与电容C1，下拉单元330的第一放电单元332包括晶体管M4～M6以及电容C2，且下拉单元330的第二放电单元334包括晶体管M7～M9以及电容C3。其中，在本实施例中所述的各个晶体管M1～M9是以N型晶体管为例，但本发明并不以此为限。
在第i级移位寄存器SR1i的预充电单元310中，晶体管M1的栅极接收第i-2级移位寄存器SR1i-2所输出的扫描信号SSi-2_L，且晶体管M1的漏极接收顺向输入信号FW。晶体管M2的栅极接收第i+2级移位寄存器SR1i+2所输出的扫描信号SSi+2_L，晶体管M2的漏极耦接晶体管M1的源极并且共同耦接至节点x以输出预充电信号PCS，且晶体管M2的源极接收逆向输入信号BW。
在第i级移位寄存器SR1i的上拉单元310中，晶体管M3的栅极经由节点x接收预充电信号PCS，晶体管M3的漏极接收第一输入时钟信号RCK1，且晶体管M3的源极输出扫描信号SSi_L。电容C1的第一端耦接晶体管M3的栅极与节点x，且电容C1的第二端耦接晶体管M3的源极。
在第i级移位寄存器SR1i的第一放电单元332中，电容C2的第一端接收第二输入时钟信号RCK2。晶体管M4的栅极耦接至节点x并且接收预充电信号PCS，晶体管M4的漏极耦接电容C2的第二端，且晶体管M4的源极耦接参考电位Vss。晶体管M5的栅极耦接电容C2的第二端与晶体管M4的漏极，晶体管M5的漏极耦接晶体管M4的栅极与节点x，且晶体管M5的源极耦接参考电位Vss。晶体管M6的栅极耦接电容C2的第二端、晶体管M4的漏极以及晶体管M5的栅极，晶体管M6的漏极耦接晶体管M3的源极与电容C1的第二端，且晶体管M6的源极耦接参考电位Vss。
在第i级移位寄存器SR1i的第二放电单元334中，电容C3的第一端接收第一输入时钟信号RCK1。晶体管M7的栅极耦接至节点x并且接收预充电信号PCS，晶体管M7的漏极耦接电容C3的第二端，且晶体管M7的源极耦接参考电位Vss。晶体管M8的栅极耦接电容C3的第二端与晶体管M7的源极，晶体管M8的漏极耦接晶体管M7的栅极与节点x，且晶体管M8的源极耦接参考电位Vss。晶体管M9的栅极耦接电容C3的第二端、晶体管M7的源极以及晶体管M8的栅极，晶体管M9的漏极耦接晶体管M3与M6的源极以及电容C1的第二端，且晶体管M9的源极耦接参考电位Vss。
于此，为了要清楚说明图4的移位寄存器SR1i的运作原理，图5A绘示左侧双向移位暂存装置112_L对显示区AA中的奇数行像素进行顺向扫描的信号时序示意图。
请先参照图5A，从图5A中可清楚地看出，在顺向扫描的驱动状态下，时序控制器122会提供具有特定责任周期(duty cycle)且具有不同相位差的时钟信号CLK3_L、CLK4_L、CLK1_L以及CLK2_L。在本实施例中，各个时钟信号CLK1_L～CLK4_L的责任周期是以50%为例，且时序控制器122是依照CLK3_L→CLK4_L→CLK1_L→CLK2_L的顺序而产生相位依序落后前一信号90度的时钟信号CLK1_L～CLK4_L，亦即每个时钟信号CLK3_L、CLK4_L、CLK1_L以及CLK2_L的致能时间(信号提升至高电位的时间，亦为每一脉冲的脉冲宽度)依序与前一时钟信号有50%的重迭，但本发明并不以此为限。举例来说，时钟信号CLK4_L的相位会落后于时钟信号CLK3_L并且具有90度的相位差，时钟信号CLK1_L的相位会落后于时钟信号CLK4_L并且具有90度的相位差，时钟信号CLK2_L的相位会落后于时钟信号CLK1_L并且具有90度的相位差。
另外，在本实施例中，时钟信号CLK3_L在一个帧期间(frame period)内的第一个脉冲(pulse)的致能时间会晚于起始信号STV2_L的致能时间，并且与起始信号STV2_L的致能时间有50%的重迭。此外，起始信号STV2_L的相位落后于起始信号STV1_L，并且起始信号STV2_L的致能时间会与起始信号STV1_L的致能时间有50%的重迭。
请合并参照图2A、图4以及图5A，以第1级移位寄存器SR11为例，在时间t1～t3的期间，预充电单元310的晶体管M1反应于致能的起始信号STV1_L而导通，并且晶体管M2反应于禁能的扫描信号SS3而截止，使得预充电单元310输出对应的预充电信号PCS来对节点x进行预充电。在此期间内，由于上拉单元320是接收禁能的时钟信号CLK3_L，故无论晶体管M3是否会被预充电信号PCS所导通，扫描信号SS1_L皆会位于参考电位Vss。
在时间t3～t5的期间，预充电单元310的晶体管M1与M2分别反应于禁能的起始信号STV1与禁能的扫描信号SS3而截止。上拉单元320与第二放电单元334接收到致能的时钟信号CLK3_L，且第一放电单元332接收到禁能的时钟信号CLK1_L。在此期间内，节点x会通过晶体管M3的漏极与栅极间的耦合效应(coupling effect)而被拉升至高电位，使得晶体管M3被导通而输出高电位的扫描信号SS1_L。另一方面，第一放电单元332的晶体管M5与M6会反应于禁能的时钟信号CLK1_L而截止，且第二放电单元334的晶体管M7会被节点x的高电位导通而使晶体管M8与M9被截止，故扫描信号SS1_L会在时间t3时从参考电位Vss拉升至高电位，并且在时间t3～t5的期间内维持在高电位。
此外，在时钟信号CLK1_L与CLK3之间具有相位偏移而使时钟信号CLK1与CLK3的致能期间有重迭的情况下，第一放电单元334的晶体管M4会反应于节点x的高电位及致能的时钟信号CLK1而被导通，以使晶体管M5与M6维持于被截止的状态，因此扫描信号SS1_L较不会受到时钟信号CLK1与CLK3之间的相位偏移的影响。
在时间t5～t7的期间，预充电单元310的晶体管M1反应于禁能的起始信号STV1_L而截止，并且晶体管M2反应于致能的扫描信号SS3而导通。上拉单元320与第二放电单元334接收到禁能的时钟信号CLK3_L，且第一放电单元332接收到致能的时钟信号CLK1_L。在此期间内，预充电单元310会经由导通的晶体管M2对节点x进行放电。此外，第一放电单元332的晶体管M5与M6会反应于致能的时钟信号CLK1_L而导通，以分别对节点x与节点o进行放电。因此，扫描信号SS1_L可在时间t5迅速地被下拉至参考电位Vss，并且在时间t5～t7的期间内维持在参考电位Vss。在此，节点x可在时间t5～t7的期间内经由多条放电路径(晶体管M2、M4、M5)进行放电，因此上拉单元320的晶体管M3较不会有误操作发生。
在时间t7～t9的期间，预充电单元310的晶体管M1与M2分别反应于禁能的起始信号STV1与禁能的扫描信号SS3而截止。上拉单元320与第二放电单元334接收到致能的时钟信号CLK3_L，且第一放电单元332接收到禁能的时钟信号CLK1_L。由于节点x已经在前一期间被放电至参考电位Vss，因此晶体管M7在此期间内并不会被导通，使得晶体管M8与M9分别反应于致能的时钟信号CLK3_1而导通，进而使节点o在时间t5～t7的期间内持续地被维持在参考电位Vss。
基此，在同一帧期间内的移位寄存器SR11的后续操作皆可参照上述时间t5～t7与t7～t9的操作说明，于此不再赘述。此外，其它移位寄存器SR12～SR1N的操作亦可根据上述说明推知，故亦不再赘述。
具体而言，在上述实施例中，第一放电单元332中的晶体管M4～M6与第二放电单元334中的晶体管M7～M9分别类似于动态反相器(dynamic inverter)的功能，其可分别依据对应的输入时钟信号RCK1与RCK2而在不同期间内交替地对节点x及节点o放电，藉以使上拉单元330不会有误动作的发生。
此外，基于图4的架构下，第一放电单元332与第二放电单元334分别仅需利用两个信号(预充电信号PCS及第一/第二输入时钟信号RCK1/RCK2)即可实现移位寄存器SR11～SR1N的控制，相较于传统的移位寄存器大大地降低了控制的复杂度。
另一方面，在逆向扫描的驱动状态下，时序控制器122所提供的起始信号STV1_L与STV2_L以及时钟信号CLK1_L～CLK4_L的信号波形可如图6A所示。图6A与图5A实施例的差异在于时序控制器122是依照CLK2_L→CLK1_L→CLK4_L→CLK3_L的顺序而产生相位依序落后前一信号90度的时钟信号CLK1_L～CLK4_L(顺向扫描的驱动状态下是依照CLK3_L→CLK4_L→CLK1_L→CLK2_L的顺序)。另外，在本实施例中，时钟信号CLK2_L在一个帧期间内的第一个脉冲的致能时间会早于起始信号STV1_L的致能时间，并且与起始信号STV1_L的致能时间有50%的重迭。
更进一步地说，对于在逆向扫描的驱动状态下的移位寄存器SR11～SR1N而言，以移位寄存器SRN～SRN-3为例，移位寄存器SRN、SRN-1、SRN-2以及SRN-3会依序以时钟信号CLK2_L、CLK1_L、CLK4_L及CLK3_L作为第一输入时钟信号RCK1，并且依序以时钟信号CLK4_L、CLK3_L、CLK2_L及CLK1_L作为第二输入时钟信号RCK2。除此之外，其余作动及说明皆可参照上述图2A、图3A～3E、图4以及图5A的说明，故于此不再赘述。
另一方面，图5B与图6B分别绘示右侧双向移位暂存装置112_R在顺向扫描与逆向扫描的驱动状态下的信号时序示意图。请合并参照图2B与图5B，在本实施例中，右侧双向移位暂存装置112_R及其移位寄存器SR21～SR2M的架构与操作原理均与左侧双向移位暂存装置112_L相同。双向移位暂存装置112_L与112_R的不同之处仅在于右侧双向移位暂存装置112_R是依据起始信号STV1_R与STV2_R以及时钟信号CLK1_R～CLK4_R来依序驱动显示区AA内的偶数行像素。
详细而言，请同时参照图5A与图5B，在顺向扫描的驱动状态下，起始信号STV1_R与STV2_R分别对应于起始信号STV1_L与STV2_L，两者间的差异仅在于起始信号STV1_R与STV2_R的相位分别落后于起始信号STV1_L与STV2_L，并且分别具有45度的相位差，亦即起始信号STV1_L与STV1_R的致能时间有75%的重迭，且起始信号STV2_L与STV2_R的致能时间亦有75%的重迭。相似地，时钟信号CLK1_R～CLK4_R分别依序对应于时钟信号CLK1_L～CLK4_L，两者间的差异亦仅在于时钟信号CLK1_R～CLK4_R的相位分别落后于时钟信号CLK1_L～CLK4_L，并且分别具有45度的相位差，亦即时钟信号CLK1_L～CLK4_L的致能时间分别与对应的时钟信号CLK1R～CLK4_R的致能时间有75%的重迭。基于所述的信号时序的差异，右侧双向移位暂存装置112_R可依序产生分别与扫描信号SS1_L～SSN_L具有一定相位差的扫描信号SS1_R～SSM_R来驱动偶数行像素，进而使得每一行相邻的像素可依据特定的间隔时间(如时间t1～t2的一半)依序开启。
此外，基于上述图2A至图6A实施例的说明后，本领域技术人员在参照图6B后，应可直接而无歧异地推知有关于在逆向扫描的驱动状态下的右侧双向移位暂存装置112_R极其移位寄存器SR21～SR2M的操作，故于此不再赘述。
综上所述，本发明实施例提出一种移位寄存器、双向移位暂存装置及应用其的液晶显示面板，其中所述移位寄存器可利用动态反相器的电路架构来进行节点放电，并藉以控制所输出的扫描信号的电平，进而有效地提高整体双向移位暂存装置的可靠度。此外，基于本发明实施例的双向移位暂存装置的电路架构下，所述双向移位暂存装置可利用较少的控制信号来实现顺向扫描与逆向扫描的驱动机制，进而使应用其的液晶显示面板的电路布局面积减少。
虽然本发明已以实施例揭露如上，然其并非用以限定本发明，任何所属技术领域中具有通常知识者，在不脱离本发明的精神和范围内，当可作些许的更动与润饰，故本发明的保护范围当视所附的权利要求范围所界定者为准。

Claims (9)

1.一种移位寄存器，其特征在于，包括：
一预充电单元，接收对应该移位寄存器的前二级与后二级移位寄存器的输出，并据以输出一预充电信号；
一上拉单元，耦接该预充电单元，接收该预充电信号与一第一输入时钟信号，并据以输出一扫描信号；以及
一下拉单元，耦接该预充电单元与该上拉单元，接收该预充电信号、该第一输入时钟信号以及一第二输入时钟信号以控制该扫描信号的电平，其中该第一输入时钟信号与该第二输入时钟信号互为反相，
其中该下拉单元包括：
一第一放电单元，接收该预充电信号与该第二输入时钟信号，并据以决定是否将该扫描信号下拉至一参考电位；以及
一第二放电单元，接收该预充电信号与该第一输入时钟信号，并据以决定是否将该扫描信号维持于该参考电位。
2.根据权利要求1所述的移位寄存器，其中该预充电单元还接收一顺向输入信号与一逆向输入信号，该移位寄存器依据该顺向输入信号与该逆向输入信号，输出所述扫描信号。
3.根据权利要求2所述的移位寄存器，其中该预充电单元包括：
一第一晶体管，其栅极接收对应该移位寄存器的前二级移位寄存器所输出的该扫描信号，其第一源/漏极接收该顺向输入信号，且其第二源/漏极输出该预充电信号；以及
一第二晶体管，其栅极接收对应该移位寄存器的后二级移位寄存器所输出的该扫描信号，其第一源/漏极耦接该第一晶体管的第二源/漏极，且其第二源/漏极接收该逆向输入信号。
4.根据权利要求3所述的移位寄存器，其中该上拉单元包括：
一第三晶体管，其栅极接收该预充电信号，其第一源/漏极接收该第一输入时钟信号，且其第二源/漏极输出该扫描信号：以及
一第一电容，其第一端耦接该第三晶体管的栅极，且其第二端耦接该第三晶体管的第二源/漏极。
5.根据权利要求4所述的移位寄存器，其中该第一放电单元包括：
一第二电容，其第一端接收该第二输入时钟信号；
一第四晶体管，其栅极耦接该第一晶体管的第二源/漏极与该第二晶体管的第一源/漏极以接收该预充电信号，其第一源/漏极耦接该第二电容的第二端，且其第二源/漏极耦接该参考电位；
一第五晶体管，其栅极耦接该第二电容的第二端与该第四晶体管的第一源/漏极，其第一源/漏极耦接该第四晶体管的栅极，且其第二源/漏极耦接该参考电位；以及
一第六晶体管，其栅极耦接该第二电容的第二端与该第四晶体管的第一源/漏极，其第一源/漏极耦接该第三晶体管的第二源/漏极，且其第二源/漏极耦接该参考电位。
6.根据权利要求4所述的移位寄存器，其中该第二放电单元包括：
一第三电容，其第一端接收该第一输入时钟信号；
一第七晶体管，其栅极耦接该第一晶体管的第二源/漏极与该第二晶体管的第一源/漏极以接收该预充电信号，其第一源/漏极耦接该第三电容的第二端，且其第二源/漏极耦接该参考电位；
一第八晶体管，其栅极耦接该第三电容的第二端与该第七晶体管的第二源/漏极，其第一源/漏极耦接该第七晶体管的栅极，且其第二源/漏极耦接该参考电位；以及
一第九晶体管，其栅极耦接该第三电容的第二端与该第七晶体管的第二源/漏极，其第一源/漏极耦接该第三晶体管的第二源/漏极，且其第二源/漏极耦接该参考电位。
7.一种双向移位暂存装置，适用于一液晶显示面板，其特征在于，该双向移位暂存装置包括：
N级如权利要求1所述的移位寄存器，该些移位寄存器彼此串接在一起，且配置于该液晶显示面板的一显示区的左侧，其中N为一预设正整数。
8.一种双向移位暂存装置，适用于一液晶显示面板，其特征在于，该双向移位暂存装置包括：
M级如权利要求1所述的移位寄存器，该些移位寄存器彼此串接在一起，且配置于该液晶显示面板的一显示区的右侧，其中M为一预设正整数。
9.一种液晶显示面板，其特征在于，包括：
一显示区；以及
一如权利要求7所述的双向移位暂存装置与一如权利要求8所述的双向移位暂存装置。
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