CN111696483A - 显示面板及其驱动方法、显示装置 - Google Patents

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Abstract

本发明涉及显示技术领域，提出一种显示面板及其驱动方法、显示装置，所述显示面板包括源极驱动电路、栅极驱动电路，所述方法包括：控制所述源极驱动电路输出数据信号，所述数据信号的每一帧时段包括有效时段和无效时段；向所述栅极驱动电路输入时钟信号，所述时钟信号在所述数据信号的至少部分无效时段的频率小于所述时钟信号在所述数据信号有效时段的频率。该显示面板驱动方法能够减小显示面板的功耗。

Description

显示面板及其驱动方法、显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种显示面板及其驱动方法、显示装置。
背景技术
现有技术中，显示面板调节刷新频率时会出现显示面板亮度的变化，相关技术中，通常采用延长数据信号无效时长的方法避免显示面板亮度的变化，然而，该方法会产生较大的无效功耗。
需要说明的是，在上述背景技术部分公开的信息仅用于加强对本发明的背景的理解，因此可以包括不构成对本领域普通技术人员已知的现有技术的信息。
发明内容
本发明的目的在于提供一种显示面板及其驱动方法、显示装置，该显示面板驱动方法能够减小显示面板的无效功耗。
本发明的其他特性和优点将通过下面的详细描述变得显然，或区分地通过本发明的实践而习得。
根据本发明的一个方面，提供一种显示面板驱动方法，所述显示面板包括源极驱动电路、栅极驱动电路，所述方法包括：
控制所述源极驱动电路输出数据信号，所述数据信号的每一帧时段包括有效时段和无效时段；
向所述栅极驱动电路输入时钟信号，所述时钟信号在所述数据信号的至少部分无效时段的频率小于所述时钟信号在所述数据信号有效时段的频率。
本公开一种示例性实施例中，该方法还包括：
获取所述显示面板的当前刷新频率和目标刷新频率；
控制所述源极驱动电路按照所述目标刷新频率输出数据信号，控制所述栅极驱动电路按照目标刷新频率输出栅极驱动信号，同时调节所述数据信号的无效时长，以使所述数据信号的一帧时长等于当前刷新频率对应的一帧时长。
本公开一种示例性实施例中，向所述栅极驱动电路输入时钟信号，包括：
向所述栅极驱动电路输入一个或多个时钟信号。
本公开一种示例性实施例中，所述当前刷新频率小于所述目标刷新频率，调节所述数据信号的无效时长，包括；
延长所述无效时长。
本公开一种示例性实施例中，所述无效时段按照时序位于所述有效时段的前端或后端。
本公开一种示例性实施例中，所述数据信号的无效时段包括位于所述无效时段前端的无效前沿和位于所述无效时段后端的无效后沿；
所述时钟信号在所述数据信号无效前沿、无效后沿的频率等于所述时钟信号在所述数据信号有效时段的频率。
本公开一种示例性实施例中，所述无效时段按照时序包括位于所述有效时段前端的第一无效时段和位于所述有效时段后端的第二无效时段。
本公开一种示例性实施例中，所述显示面板还包括时钟控制电路，向所述栅极驱动电路输入时钟信号，包括：
利用所述时钟控制电路向所述栅极驱动电路输入时钟信号。
根据本发明的一个方面，提供一种显示面板，该显示面板包括：源极驱动电路、栅极驱动电路、时钟控制电路、判断模块、第一控制模块，源极驱动电路用于输出数据信号，所述数据信号的每一帧时段包括有效时段和无效时段；栅极驱动电路用于输出栅极驱动信号；时钟控制电路用于向所述栅极驱动电路提供至少一个时钟信号；判断模块用于判断所述数据信号的有效时段和无效时段；第一控制模块用于控制所述时钟控制电路向所述栅极驱动电路输入至少一个时钟信号，所述时钟信号在所述数据信号的至少部分无效时段的频率小于所述时钟信号在所述数据信号有效时段的频率。
本公开一种示例性实施例中，该显示面板还包括：获取模块、第二控制模块。获取模块用于获取所述显示面板的当前刷新频率和目标刷新频率；第二控制模块用于控制所述源极驱动电路按照所述目标刷新频率输出数据信号，控制所述栅极驱动电路按照目标刷新频率输出栅极驱动信号，同时调节所述数据信号的无效时长，以使所述数据信号的一帧时长等于当前刷新频率对应的一帧时长。
根据本发明的一个方面，提供一种显示装置，该显示装置包括上述的显示面板。
本公开提出一种显示面板及其驱动方法、显示装置，所述显示面板包括源极驱动电路、栅极驱动电路，所述方法包括：控制所述源极驱动电路输出数据信号，所述数据信号的每一帧时段包括有效时段和无效时段；向所述栅极驱动电路输入时钟信号，所述时钟信号在所述数据信号的至少部分无效时段的频率小于所述时钟信号在所述数据信号有效时段的频率。该显示面板驱动方法通过在数据信号的无效时段减小时钟信号的频率，从而能够在不影响正常显示的情况下减小显示面板的功耗。
应当理解的是，以上的一般描述和后文的细节描述仅是示例性和解释性的，并不能限制本发明。
附图说明
此处的附图被并入说明书中并构成本说明书的一区分，示出了符合本发明的实施例，并与说明书一起用于解释本发明的原理。显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为相关技术中一种子像素单元中像素驱动电路的结构示意图；
图2为图1中像素驱动电路一种示例性实施例中各个节点的时序图；
图3为相关技术中一种移位寄存器电路的结构示意图；
图4为图3所示移位寄存器单元一种驱动方法中各节点的时序图；
图5为本公开显示面板驱动方法中数据信号和时钟信号的时序图；
图6为本公开显示面板一种示例性实施例的结构示意图。
具体实施方式
现在将参考附图更全面地描述示例实施例。然而，示例实施例能够以多种形式实施，且不应被理解为限于在此阐述的范例；相反，提供这些实施例使得本发明将更加全面和完整，并将示例实施例的构思全面地传达给本领域的技术人员。图中相同的附图标记表示相同或类似的结构，因而将省略它们的详细描述。
虽然本说明书中使用相对性的用语，例如“上”“下”来描述图标的一个组件对于另一组件的相对关系，但是这些术语用于本说明书中仅出于方便，例如根据附图中所述的示例的方向。能理解的是，如果将图标的装置翻转使其上下颠倒，则所叙述在“上”的组件将会成为在“下”的组件。其他相对性的用语，例如“高”“低”“顶”“底”“左”“右”等也作具有类似含义。当某结构在其它结构“上”时，有可能是指某结构一体形成于其它结构上，或指某结构“直接”设置在其它结构上，或指某结构通过另一结构“间接”设置在其它结构上。
用语“一个”、“一”、“所述”用以表示存在一个或多个要素/组成区分/等；用语“包括”和“具有”用以表示开放式的包括在内的意思并且是指除了列出的要素/组成区分/等之外还可存在另外的要素/组成区分/等。
相关技术中，显示面板通常包括有多个阵列分布的子像素单元、源极驱动电路以及栅极驱动电路，栅极驱动电路的多个输出端可以分别通过栅线向同一行子像素单元中的栅极驱动信号端提供栅极驱动信号，源极驱动电路的多个输出端分别通过数据线向同一列子像素单元中的数据信号端提供数据信号。从而显示面板可以通过源极驱动电路和栅极驱动电路逐行驱动多个子像素单元。
例如，如图1所示，为相关技术中一种子像素单元中像素驱动电路的结构示意图，该像素驱动电路包括开关晶体管T、驱动晶体管DT、电容C，发光二极管OLED，开关晶体管T的第一端连接数据信号端Data，控制端连接栅极驱动信号端Gate；驱动晶体管DT的控制端连接开关晶体管T的第二端，第一端连接第一电源端VDD；发光二极管OLED连接于驱动晶体管DT第二端和第二电源端VSS之间；电容C连接于驱动晶体管DT控制端和驱动晶体管DT控制端第二端之间。如图2所示，为图1中像素驱动电路一种示例性实施例中各个节点的时序图，Data为数据信号端Data的时序图，Gate为栅极驱动信号端Gate的时序图。该像素驱动电路的驱动方式可以包括两个阶段：数据写入时段T1和发光时段T2。在数据写入时段，栅极驱动信号端Gate为低电平，数据信号端Data为低电平，开关晶体管T在栅极驱动信号端Gate低电平作用下导通，以将数据信号端的低电平信号传输到驱动晶体管DT的控制端，并存储在电容C上；在发光时段T2，驱动晶体管DT在电容C作用下导通，发光二极管OLED发光。
相关技术中，栅极驱动电路可以由多个级联的移位寄存器单元组成，每个移位寄存器单元的输出端可以通过栅线向像素驱动电路中的栅极驱动信号端提供栅极驱动信号。
如图3所示，为相关技术中一种移位寄存器电路的结构示意图，该移位寄存器单元包括第一晶体管T1到第八晶体管T8、第一电容C1、第二电容C2。第一晶体管T1的控制端连接所述第一时钟信号端CLK1，第一端连接所述输入端Vin，第二端连接所述第一节点N1。第二晶体管T2的控制端连接所述第一时钟信号端CLK1，第一端连接连接第一电源端VGL，第二端连接所述第二节点N2；第三晶体管T3的控制端连接所述第一节点N1，第一端连接所述第二时钟信号端CLK2，第二端连接所述第一输出端OUT1；第一电容C1连接于所述第三晶体管控制端和所述第一输出端OUT1之间。第四晶体管T4的控制端连接所述第二节点N2，第一端连接所述第二电源端VGH，第二端连接所述第一输出端OUT1；第二电容C2连接于所述第四晶体管T4控制端和所述第一输出端OUT1之间；第五晶体管T5的控制端连接所述第一节点N1、第一端连接所述第一时钟信号端CLK1，第二端连接所述第二节点N2；第六晶体管T6的控制端连接所述第二节点N2，第一端连接所述第二电源端VGH；第七晶体管T7的控制端连接所述第二时钟信号端CLK2，第一端连接所述第六晶体管T6的第二端，第二端连接所述第一节点N1；第八晶体管T8的控制端连接所述第二电源端VGH，第一端连接所述第一节点N1，第二端连接所述第三晶体管T3的控制端。
如图3所示，第一到第八晶体管可以为P型晶体管，第一电源端VGL的电平可以为低电平，第二电源端VGH的电平可以为高电平。该移位寄存器电路输出的移位信号的有效电平为低电平。如图4所示，为图3所示移位寄存器单元一种驱动方法中各节点的时序图。其中，CLK1为第一时钟信号端CLK1的时序图，CLK2为第二时钟信号端CLK2的时序图，Vin为输入端Vin的时序图，OUT1为第一输出端OUT1的时序图，N1为第一节点N1的时序图，N2为第二节点N2的时序图。该移位寄存器电路的驱动包括三个阶段：充电阶段T1、输出阶段T2、下拉阶段T3。在充电阶段T1，第一时钟信号端CLK1和输入端Vin为低电平，第二时钟信号端CLK2为高电平，第一晶体管T1、第二晶体管T2导通，第一节点N1和第二节点N2为低电平，第五晶体管T5、第四晶体管T4、第八晶体管T8、第三晶体管T3、第六晶体管T6导通，第一输出端输出高电平信号。在输出阶段T2，输入端Vin、第一时钟信号端CLK1输出高电平，第二时钟信号端CLK2输出低电平，第一晶体管T1关断，第一节点在第一电容C1作用下保持低电平，第五晶体管T5在第一节点作用下导通，第一时钟信号端CLK1向第二节点N2传输高电平信号，第六晶体管T6、第四晶体管T4在第二节点N2作用下关断，第二时钟信号端CLK2向第一输出端输出低电平信号。在下拉阶段T3，第一时钟信号端CLK1输出低电平信号，第二时钟信号端CLK2输出高电平信号，输入端输出高电平信号，第一晶体管T1导通，输入端Vin向第一节点输入高电平信号，第二晶体管T2导通，第一电源端向第二节点输入低电平信号，第三晶体管T3在第一节点作用下关断，第四晶体管T4在第二节点作用下导通，第一输出端OUT1输出高电平。此后，当第二时钟信号端CLK2为低电平时，第七晶体管T7导通，以通过第二电源端向第一节点N1输入高电平信号，从而进一步避免第二时钟信号端的低电平向第一输出端OUT1漏电。此外，第八晶体管T8能够用于避免第一输出端OUT1电压变化对输入端Vin造成影响。
相关技术中，数据信号的每一帧时段包括有效时段和无效时段。在有效时段，数据信号输出有效脉冲信号以向各行像素驱动电路写入有效数据信号；在无效时段，数据信号不输出有效脉冲信号。
相关技术中，显示面板在改变刷新频率时，由于单位时间内发光时长的改变，显示面板的亮度也会发生变化。为了避免上述亮度变化，相关技术中通过采用改变数据信号无效时段的方法。例如，当显示面板刷新频率从而60Hz变为90Hz时，源极驱动电路输出数据信号的脉冲频率以及栅极驱动电路输出有效脉冲的频率会相应的增加，显示面板一帧扫描的时长会减短，从而显示面板的亮度会增强。为了避免显示面板亮度增强，可以通过延长数据信号无效时段时长的方法，从而保持显示面板一帧的时长不变。然而，由于数据信号无效时段时长较长，从而使得显示面板产生了较大的无效功耗。
基于此，本示例性实施例提供一种显示面板驱动方法，如图5所示，为本公开显示面板驱动方法中数据信号和时钟信号的时序图。所述显示面板可以包括源极驱动电路、栅极驱动电路，其中，该显示面板栅极驱动电路中移位寄存器单元的结构可以如图3所示，Vsync表示帧同步信号，CLK1表示向图3中第一时钟信号端输入的时钟信号的时序，CLK2表示向图3中第二时钟信号端输入的时钟信号的时序，Data表示向图1中像素驱动电路输入数据信号的时序。所述方法包括：
控制所述源极驱动电路输出数据信号，所述数据信号的每一帧时段T包括有效时段T1和无效时段T2；
向所述栅极驱动电路输入时钟信号CLK1、CLK2，所述时钟信号CLK1、CLK2在所述数据信号的至少部分无效时段T22的频率小于所述时钟信号在所述数据信号有效时段T1的频率。
该显示面板驱动方法通过在数据信号的至少部分无效时段减小时钟信号的频率，即减小了生成该时钟信号的功耗，也减小了栅极驱动电路的功耗，从而能够在不影响正常显示的情况下减小显示面板的功耗。
本示例性实施例中，该显示面板中像素驱动电路可以为图1所示，栅极驱动电路中的移位寄存器单元可以为图3所示。应该理解的是，在其他示例性实施例中，该显示面板中的像素驱动电路、移位寄存器单元还可以为其他结构。相应的，时钟信号可以为一个也可以为多个。当时钟信号为多个时，本示例性实施例可以改变一个时钟信号的频率也可以改变多个时钟信号的频率。
本示例性实施例中，如图5所示，所述无效时段T2可以按照时序位于所述有效时段的后端。所述数据信号的无效时段T2可以包括位于所述无效时段前端的无效前沿T21和位于所述无效时段后端的无效后沿T23。由于时钟信号频率变化并不是瞬间完成的，时钟信号的频率变化可以在无效前沿T21和无效后沿T23完成。因而，所述时钟信号在所述数据信号无效前沿T21、无效后沿T23的频率等于所述时钟信号在所述数据信号有效时段的频率。应该理解的是，在其他示例性实施例中，时钟信号也可以在所述数据信号的整个无效时段T22的频率小于所述时钟信号在所述数据信号有效时段T1的频率。此外，所述数据信号的无效时段还可以按照时序位于所述有效时段的前端，或无效时段可以按照时序包括位于所述有效时段前端的第一无效时段和位于所述有效时段后端的第二无效时段。
本示例性实施例中，所述显示面板还包括时钟控制电路，向所述栅极驱动电路输入时钟信号可以包括：利用所述时钟控制电路向所述栅极驱动电路输入时钟信号。
本示例性实施例中，该方法还包括：
获取所述显示面板的当前刷新频率和目标刷新频率；
控制所述源极驱动电路按照所述目标刷新频率输出数据信号，控制所述栅极驱动电路按照目标刷新频率输出栅极驱动信号，同时调节所述数据信号的无效时长，以使所述数据信号的一帧时长等于当前刷新频率对应的一帧时长。
例如，当显示面板刷新频率需要从而当前频率60Hz变为目标频率90Hz时，控制所述栅极驱动电路按照90Hz刷新频率输出栅极驱动信号，控制所述源极驱动电路按照90Hz刷新频率输出数据信号。同时，通过延长数据信号无效时段的时长从而保持显示面板一帧的扫描时长不变。从而使得该显示面板在频率变化时亮度不变。
本示例性实施例还提供一种显示面板，如图6所示，为本公开显示面板一种示例性实施例的结构示意图。该显示面板包括：源极驱动电路1、栅极驱动电路2、时钟控制电路3、判断模块4、第一控制模块5，源极驱动电路1用于输出数据信号，所述数据信号的每一帧时段包括有效时段和无效时段；栅极驱动电路2用于输出栅极驱动信号；时钟控制电路3用于向所述栅极驱动电路提供至少一个时钟信号；判断模块4用于判断所述数据信号的有效时段和无效时段；第一控制模块5用于控制所述时钟控制电路向所述栅极驱动电路输入至少一个时钟信号，所述时钟信号在所述数据信号的至少部分无效时段的频率小于所述时钟信号在所述数据信号有效时段的频率。
本示例性实施例中，如图6所示，该显示面板还可以包括：获取模块6、第二控制模块7。获取模块6用于获取所述显示面板的当前刷新频率和目标刷新频率；第二控制模块7用于控制所述源极驱动电路按照所述目标刷新频率输出数据信号，控制所述栅极驱动电路按照目标刷新频率输出栅极驱动信号，同时调节所述数据信号的无效时长，以使所述数据信号的一帧时长等于当前刷新频率对应的一帧时长。
本公开的一示例性实施例还提供一种显示装置，该显示装置包括上述的显示面板。该显示装置可以为手机、电视、电脑等显示装置。
本领域技术人员在考虑说明书及实践这里公开的发明后，将容易想到本公开的其他实施例。本申请旨在涵盖本公开的任何变型、用途或者适应性变化，这些变型、用途或者适应性变化遵循本公开的一般性远离并包括本公开未公开的本技术领域中的公知常识或惯用技术手段。说明书和实施例仅被视为示例性的，本公开的真正范围和精神由权利要求指出。
应当理解的是，本公开并不局限于上面已经描述并在附图中示出的精确结构，并且可以在不脱离其范围进行各种修改和改变。本公开的范围仅由所附的权利要求来限定。

Claims (10)

1.一种显示面板驱动方法，所述显示面板包括源极驱动电路、栅极驱动电路，其特征在于，所述方法包括：
控制所述源极驱动电路输出数据信号，所述数据信号的每一帧时段包括有效时段和无效时段；
向所述栅极驱动电路输入时钟信号，所述时钟信号在所述数据信号的至少部分无效时段的频率小于所述时钟信号在所述数据信号有效时段的频率。
2.根据权利要求1所述的显示面板驱动方法，其特征在于，还包括：
获取所述显示面板的当前刷新频率和目标刷新频率；
控制所述源极驱动电路按照所述目标刷新频率输出数据信号，控制所述栅极驱动电路按照目标刷新频率输出栅极驱动信号，同时调节所述数据信号的无效时长，以使所述数据信号的一帧时长等于当前刷新频率对应的一帧时长。
3.根据权利要求2所述的显示面板驱动方法，其特征在于，向所述栅极驱动电路输入时钟信号，包括：
向所述栅极驱动电路输入一个或多个时钟信号。
4.根据权利要求1所述的显示面板驱动方法，其特征在于，所述无效时段按照时序位于所述有效时段的前端或后端。
5.根据权利要求4所述的显示面板驱动方法，其特征在于，所述数据信号的无效时段包括位于所述无效时段前端的无效前沿和位于所述无效时段后端的无效后沿；
所述时钟信号在所述数据信号无效前沿、无效后沿的频率等于所述时钟信号在所述数据信号有效时段的频率。
6.根据权利要求1所述的显示面板驱动方法，其特征在于，所述无效时段按照时序包括位于所述有效时段前端的第一无效时段和位于所述有效时段后端的第二无效时段。
7.根据权利要求1所述的显示面板驱动方法，其特征在于，所述显示面板还包括时钟控制电路，向所述栅极驱动电路输入时钟信号，包括：
利用所述时钟控制电路向所述栅极驱动电路输入时钟信号。
8.一种显示面板，其特征在于，包括：
源极驱动电路，用于输出数据信号，所述数据信号的每一帧时段包括有效时段和无效时段；
栅极驱动电路，用于输出栅极驱动信号；
时钟控制电路，用于向所述栅极驱动电路提供至少一个时钟信号；
判断模块，用于判断所述数据信号的有效时段和无效时段；
第一控制模块，用于控制所述时钟控制电路向所述栅极驱动电路输入至少一个时钟信号，所述时钟信号在所述数据信号的至少部分无效时段的频率小于所述时钟信号在所述数据信号有效时段的频率。
9.根据权利要求8所述的显示面板，其特征在于，还包括：
获取模块，用于获取所述显示面板的当前刷新频率和目标刷新频率；
第二控制模块，用于控制所述源极驱动电路按照所述目标刷新频率输出数据信号，控制所述栅极驱动电路按照目标刷新频率输出栅极驱动信号，同时调节所述数据信号的无效时长，以使所述数据信号的一帧时长等于当前刷新频率对应的一帧时长。
10.一种显示装置，其特征在于，包括权利要求8或9所述的显示面板。
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