CN108831369B - 一种显示面板和驱动方法 - Google Patents

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Abstract

本发明公开了一种显示面板和驱动方法。该显示面板的第一显示区包括N个像素单元组，第二显示区包括M个像素单元组；非显示区包括N个第一驱动模块和M个第二驱动模块。N个第一驱动模块和M个第二驱动模块用于依次循环驱动第一显示区的第i个像素单元组输出显示驱动信号、驱动第二显示区的第j个像素单元组输出显示驱动信号、驱动第一显示区的第i+1个像素单元组输出显示驱动信号和驱动第二显示区的第j+1个像素单元组输出显示驱动信号，使第一显示区和第二显示区显示画面只有一个像素单元组显示时间的延迟，有效地解决了现今VR显示技术中采用单个显示面板作为左右眼的共同显示器件时左右眼画面不同步的现象，提高了VR显示面板的显示效果。

Description

一种显示面板和驱动方法
技术领域
本发明涉及显示技术领域，尤其涉及一种显示面板和驱动方法。
背景技术
随着显示技术的发展，虚拟现实(Virtual Reality，VR)显示技术得到了长足的发展和进步，并逐渐应用在人们的日常生活中。
目前，在VR显示技术的应用中，为了节约成本，通常使用单个显示屏作为左右眼的共同显示器件。单个显示屏包括多行像素单元，每一行像素单元对应一个驱动模块，用于驱动与其对应的像素单元进行显示，多个驱动模块成一行分布。在左右眼观看单个显示屏时，单个显示屏分为左眼可视区域和右眼可视区域，左眼可视区域和右眼可视区域分别对应一行驱动模块中的前一半驱动模块和后一半驱动模块。在驱动过程中，多个驱动模块一般是自右而左扫描，而扫描完一帧需要一定时间，因此左眼可视区域和右眼可视区域显示画面有半帧时间的延迟，导致左眼可视区域和右眼可视区域显示画面不同步，对显示效果影响比较大。
发明内容
本发明提供一种显示面板和驱动方法，有效地解决了现今VR显示技术中采用单个显示屏作为左右眼的共同显示器件时左右眼画面不同步的现象，提高了VR显示屏的显示效果。
第一方面，本发明实施例提供了一种显示面板，该显示面板包括第一显示区、第二显示区和非显示区；
所述第一显示区包括N个像素单元组，所述第二显示区包括M个像素单元组，所述N个像素单元组和所述M个像素单元组中的每个像素单元组包括至少一行像素单元，其中，N和M均是大于1的整数；
所述非显示区包括N个第一驱动模块和M个第二驱动模块，所述N个第一驱动模块分别与所述第一显示区的N个像素单元组对应，所述M个第二驱动模块分别与所述第二显示区的M个像素单元组对应，用于驱动与其对应的像素单元组；
所述N个第一驱动模块和所述M个第二驱动模块用于依次循环驱动所述第一显示区的第i个像素单元组输出显示驱动信号、驱动所述第二显示区的第j个像素单元组输出显示驱动信号、驱动所述第一显示区的第i+1个像素单元组输出显示驱动信号和驱动所述第二显示区的第j+1个像素单元组输出显示驱动信号；其中，i为大于或等于1且小于N的整数，j为大于或等于1且小于M的整数。
第二方面，本发明实施例还提供了一种显示面板的驱动方法，所述显示面板包括第一显示区、第二显示区和非显示区；
提供N个第一驱动模块，用于驱动所述第一显示区的N个像素单元组，所述N个像素单元组中的每个像素单元组包括至少一行像素单元，其中，N是大于1的整数；
提供M个第二驱动模块，用于驱动所述第二显示区的M个像素单元组，所述M个像素单元组中的每个像素单元组包括一行像素单元，其中，M是大于1的整数；
驱动所述第一显示区的第i个像素单元组输出显示驱动信号；
驱动所述第二显示区的第j个像素单元组输出显示驱动信号；
驱动所述第一显示区的第i+1个像素单元组输出显示驱动信号；
驱动所述第二显示区的第j+1个像素单元组输出显示驱动信号；
其中，i为大于或等于1且小于N的整数，j为大于或等于1且小于或M的整数。
本发明的技术方案，显示面板包括第一显示区、第二显示区和非显示区；第一显示区包括N个像素单元组，第二显示区包括M个像素单元组，N个像素单元组和M个像素单元组中的每个像素单元组包括至少一行像素单元；非显示区包括N个第一驱动模块和M个第二驱动模块，N个第一驱动模块分别与第一显示区的N个像素单元组对应，M个第二驱动模块分别与第二显示区的M个像素单元组对应。N个第一驱动模块和M个第二驱动模块用于依次循环驱动第一显示区的第i个像素单元组输出显示驱动信号、驱动第二显示区的第j个像素单元组输出显示驱动信号、驱动第一显示区的第i+1个像素单元组输出显示驱动信号和驱动第二显示区的第j+1个像素单元组121输出显示驱动信号，可以实现第一显示区和第二显示区的像素单元组依次交错输出显示驱动信号，使第一显示区和第二显示区在显示画面时只有一个像素单元组显示时间的延迟，有效地解决了现今VR显示技术中采用单个显示面板作为左右眼的共同显示器件时左右眼画面不同步的现象，提高了VR显示面板的显示效果。
附图说明
图1为本发明实施例提供的一种显示面板的结构示意图；
图2为本发明实施例提供的另一种显示面板的结构示意图；
图3为本发明实施例提供的另一种显示面板的结构示意图；
图4为本发明实施例提供的另一种显示面板的结构示意图；
图5为本发明实施例提供的另一种显示面板的结构示意图；
图6为本发明实施例提供的另一种显示面板的结构示意图；
图7为本发明实施例提供的一种移位寄存器的连接示意图；
图8为本发明实施例提供的另一种移位寄存器的连接示意图；
图9为本发明实施例提供的另一种显示面板的结构示意图；
图10为本发明实施例提供的一种时钟信号线的时序图；
图11是本发明实施例提供的一种显示装置的结构示意图；
图12是本发明实施例提供的一种显示面板的驱动方法流程图。
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明，而非对本发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明相关的部分而非全部结构。
图1为本发明实施例提供的一种显示面板的结构示意图，如图1所示，该显示面板包括第一显示区110、第二显示区120和非显示区130；第一显示区110包括N个像素单元组111，第二显示区120包括M个像素单元组121，N个像素单元组111和M个像素单元组121中的每个像素单元组包括至少一行像素单元，其中，N和M均是大于1的整数。非显示区130包括N个第一驱动模块131和M个第二驱动模块132，N个第一驱动模块131分别与第一显示区110的N个像素单元组111对应，M个第二驱动模块132分别与第二显示区120的M个像素单元组121对应，用于驱动与其对应的像素单元组。N个第一驱动模块131和M个第二驱动模块132用于依次循环驱动第一显示区110的第i个像素单元组111输出显示驱动信号、驱动第二显示区120的第j个像素单元组121输出显示驱动信号、驱动第一显示区110的第i+1个像素单元组111输出显示驱动信号和驱动第二显示区120的第j+1个像素单元组121输出显示驱动信号；其中，i为大于或等于1且小于N的整数，j为大于或等于1且小于M的整数。
具体地，N和M的值可以不相等。如图1所示，第一显示区110和第二显示区120的大小不同，N和M的值不相等。N个像素单元组111和M个像素单元组121中的每个像素单元组包括至少一行像素单元。示例性地，图1中每个像素单元组包括两行像素单元，或者，图2为本发明实施例提供的另一种显示面板的结构示意图，如图2所示，每个像素单元组包括一行像素单元。而且，每个像素单元组中像素单元的行数可以相等，也可以不等。每个驱动模块包括触发信号输入端STV、次级触发信号输出端out和显示驱动信号输出端Gout。触发信号输入端STV用于触发驱动模块的显示驱动信号输出端Gout输出显示驱动信号，同时次级触发信号输出端out输出次级触发信号。N个第一驱动模块131的显示驱动信号输出端Gout分别通过显示驱动信号线112与第一显示区110的N个像素单元组111连接，M个第二驱动模块132的显示驱动信号输出端Gout分别通过显示驱动信号线112与第二显示区120的M个像素单元组121连接。当每个像素单元组包括多行像素单元时，与其对应的驱动模块包括多个显示驱动信号输出端Gout，分别与多行像素单元通过显示驱动信号线112电连接。示例性地，如图1所示，每个像素单元组包括两行像素单元，则每个驱动模块包括两个显示驱动信号输出端Gout。例如，第一个驱动模块131(1)包括两个显示驱动信号输出端Gout。
在显示面板的一帧驱动过程中，N个像素单元组111和M个像素单元组121依次交错被循环驱动。在每个周期内，第一阶段，N个第一驱动模块131中第i个驱动第一显示区110中第i个像素单元组111。第二阶段，M个第二驱动模块132中第j个驱动第二显示区120中第j个像素单元组121。第三阶段，N个第一驱动模块131中第i+1个驱动第一显示区110中第i+1个像素单元组111。第四阶段，M个第二驱动模块132中第j+1个驱动第二显示区120中第j+1个像素单元组121。以此类推，直至显示面板完成一帧的显示。
示例性地，继续参见图1，非显示区130中的第一个第一驱动模块131(1)驱动第一显示区110中第一个像素单元组111(1)输出显示驱动信号，第一个第一驱动模块131(1)同时输出次级触发信号至非显示区130的第一个第二驱动模块132(1)，触发第一个第二驱动模块132(1)驱动第二显示区120中第一个像素单元组121(1)输出显示驱动信号，第一个第二驱动模块132(1)的次级触发信号输出端out同时输出次级触发信号至非显示区130中第二个第一驱动模块131(2)，触发第二个第一驱动模块131(2)驱动第一显示区110中第二个像素单元组111(2)输出显示驱动信号，第二个第一驱动模块131(2)的次级触发信号输出端out同时输出次级触发信号至非显示区130的第二个第二驱动模块132(2)，触发第二个第二驱动模块132(2)驱动第二显示区120中第二个像素单元组121(2)输出显示驱动信号，第二个第二驱动模块132(2)的次级触发信号输出端out同时输出次级触发信号至非显示区130的第三个第一驱动模块131(3)，循环上述的驱动过程，直至显示面板完成一帧的显示。
需要说明的是，上述的驱动过程的示例，N个第一驱动模块131中第i个驱动第一显示区110中第i个像素单元组111后，M个第二驱动模块132中第j个驱动第二显示区120中第j个像素单元组121，i取值为1，j取值也为1，因此i与j相等。在本发明中i与j的取值不局限于i与j相等，也可以不等。示例性地，i取值为1，j取值为2，继续参考图1和图2，驱动过程为：非显示区130中的第一个第一驱动模块131(1)驱动第一显示区110中第一个像素单元组111(1)输出显示驱动信号，第一个第一驱动模块131(1)的次级触发信号输出端out同时输出次级触发信号至非显示区130的第二个第二驱动模块132(2)，触发第二个第二驱动模块132驱动第二显示区120中第二个像素单元组121(2)输出显示驱动信号，第二个第二驱动模块132(2)的次级触发信号输出端out同时输出次级触发信号至非显示区130中第二个第一驱动模块131(2)，触发第二个第一驱动模块131(2)驱动第一显示区110中第二个像素单元组111(1)输出显示驱动信号，第二个第一驱动模块131(2)的次级触发信号输出端out同时输出次级触发信号至非显示区130的第三个第二驱动模块132(3)，触发第三个第二驱动模块132(3)驱动第二显示区120中第三个像素单元组121(3)输出显示驱动信号，第三个第二驱动模块132(3)的次级触发信号输出端out同时输出次级触发信号至非显示区130的第三个第一驱动模块131(3)，循环上述的驱动过程，直至显示面板完成一帧的显示。在此过程中，第一个第二驱动模块132(1)未被驱动，因此第二显示区120的第一个像素单元组121(1)不进行显示，并且，在驱动过程中，第一显示区110和第二显示区120不对称。
另外，i与j的取值也不局限于1，i为大于或等于1且小于N的整数，j为大于或等于1且小于M的整数。示例性地，i取值为2，j取值为3，继续参考图1和图2，驱动过程为：非显示区130中的第二个第一驱动模块131(2)驱动第一显示区110中第二个像素单元组111(2)输出显示驱动信号，第二个第一驱动模块131(2)的次级触发信号输出端out同时输出次级触发信号至非显示区130的第三个第二驱动模块132(3)，触发第三个第二驱动模块132(3)驱动第二显示区120中第三个像素单元组121(3)输出显示驱动信号，第三个第二驱动模块132(3)的次级触发信号输出端out同时输出次级触发信号至非显示区130中第三个第一驱动模块131(3)，触发第三个第一驱动模块131(3)驱动第一显示区110中第三个像素单元组111(3)输出显示驱动信号，第三个第一驱动模块131(3)的次级触发信号输出端out同时输出次级触发信号至非显示区130的第四个第二驱动模块132(4)，触发第四个第二驱动模块132(4)驱动第二显示区120中第四个像素单元组121(4)输出显示驱动信号，第四个第二驱动模块132(4)的次级触发信号输出端out同时输出次级触发信号至非显示区130的第四个第一驱动模块131(4)，循环上述的驱动过程，直至显示面板完成一帧的显示。在此过程中，第一个第一驱动模块131未被驱动，第一个第二驱动模块132(1)和第二个第二驱动模块132(2)未被驱动，因此第一显示区110的第一个像素单元组111(1)、第二显示区120的第一个像素单元组121(1)和第二个像素单元组121(2)不进行显示，并且，在驱动过程中，第一显示区110和第二显示区120不对称。
上述的技术方案，显示面板包括第一显示区、第二显示区和非显示区；第一显示区包括N个像素单元组，第二显示区包括M个像素单元组，N个像素单元组和M个像素单元组中的每个像素单元组包括至少一行像素单元；非显示区包括N个第一驱动模块和M个第二驱动模块，N个第一驱动模块分别与第一显示区的N个像素单元组对应，M个第二驱动模块分别与第二显示区的M个像素单元组对应，用于驱动与其对应的像素单元组。N个第一驱动模块和M个第二驱动模块用于依次循环驱动第一显示区的第i个像素单元组输出显示驱动信号、驱动第二显示区的第j个像素单元组输出显示驱动信号、驱动第一显示区的第i+1个像素单元组输出显示驱动信号和驱动第二显示区的第j+1个像素单元组输出显示驱动信号，可以实现第一显示区和第二显示区的像素单元组依次交错输出显示驱动信号，使第一显示区和第二显示区显示画面只有一个像素单元组显示时间的延迟，有效地解决了现今VR显示技术中采用单个显示面板作为左右眼的共同显示器件时左右眼画面不同步的现象，提高了VR显示面板的显示效果。
图3为本发明实施例提供的另一种显示面板的结构示意图，如图3所示，第一显示区110和第二显示区120的大小相等，第一显示区110中像素单元组的个数与第二显示区120中像素单元组的个数相等，即N和M相等。
在上述技术方案的基础上，图4为本发明实施例提供的另一种显示面板的结构示意图，如图4所示，第一显示区110和第二显示区120的大小相等，N和M相等。并且第一显示区110中每个像素单元组111包括一行像素单元，第二显示区120中每个像素单元组121包括一行像素单元。
在显示面板的一帧驱动过程中，第一显示区110和第二显示区120显示画面时只有一个像素单元组的显示时间的延迟，因此可以设置一个像素单元组只包括一行像素单元，使一个像素单元组的显示时间最短，从而最大程度的缩短了第一显示区110和第二显示区120显示画面的延迟时间，提高了VR显示面板的显示效果。
在上述各技术方案的基础上，更进一步地，N个第一驱动模块131和M个第二驱动模块132用于依次循环驱动第一显示区110的第n个像素单元组111输出显示驱动信号、驱动第二显示区120的第n个像素单元组121输出显示驱动信号、驱动第一显示区110的第n+1个像素单元组111输出显示驱动信号和驱动第二显示区120的第n+1个像素单元组121输出显示驱动信号，其中，N和M的值相等，n为大于或等于1且小于N的整数。
具体地，继续参考图3和图4，N和M的值相等，第一驱动模块131和第二驱动模块132的数量相等，第一显示区110和第二显示区120对应的像素单元组相等。在显示面板的一帧驱动过程中，第n个第一驱动模块131(n)驱动第一显示区110的第n个像素单元组111(n)后，第n个第二驱动模块132(n)驱动第二显示区120的第n个像素单元组121(n)。在第一显示区110中最后一个像素单元组111输出显示驱动信号后，第二显示区120中最后一个像素单元组121输出显示驱动信号，此时第一显示区110和第二显示区120在驱动过程中对称，并且第一显示区110和第二显示区120在显示画面时只有一个像素单元组显示时间的延迟，有效地解决了现今VR显示技术中采用单个显示面板作为左右眼的共同显示器件时左右眼画面不同步的现象，提高了VR显示面板的显示效果。
在上述各技术方案的基础上，图5为本发明实施例提供的另一种显示面板的结构示意图，图6为本发明实施例提供的另一种显示面板的结构示意图。如图5和图6所示，每个第一驱动模块131包括至少一个移位寄存器Q，每个第一驱动模块131中移位寄存器Q的个数与对应的每个N个像素单元组111中像素单元的行数相等；每个第二驱动模块132包括至少一个移位寄存器P，每个第二驱动模块132中移位寄存器P的个数与对应的每个M个像素单元组121的像素单元的行数相等。
具体地，在显示面板中，每一行的像素单元需要一个移位寄存器进行驱动，因此，每个第一驱动模块131中移位寄存器的数量与每个像素单元组中像素单元的行数相等，以使每个移位寄存器驱动与其对应的一行像素单元。
示例性地，在图5中，第一显示区110和第二显示区120中的每个像素单元组仅包括一行像素单元，对应的每个驱动模块中包括一个移位寄存器，此时一个像素单元组为一行像素单元，一个驱动模块为一个移位寄存器。例如，第一显示区110中的第一个像素单元组111(1)只有一行像素单元，第一驱动模块131(1)包括一个移位寄存器Q1。第二显示区120中的第一个像素单元组121(1)只有一行像素单元，第二驱动模块132(1)包括一个移位寄存器P1。
图7为本发明实施例提供的一种移位寄存器的连接示意图。结合图5和图7，每个移位寄存器包括触发信号输入端STV、次级触发信号输出端out和显示驱动信号输出端Gout。当每个像素单元组只有一行像素单元时，此时N个第一驱动模块131为n个移位寄存器Q，M个第二驱动模块132为m个移位寄存器P。为了实现n个移位寄存器Q和m个移位寄存器P依次循环驱动第一显示区110的N个第一像素单元组111和第二显示区120的M个第二像素单元组121，第一显示区110的第m行像素单元对应的第m个移位寄存器Qm的次级触发信号输出端out与第二显示区120的第m行像素单元对应的第m个移位寄存器Pm的触发信号输入端STV电连接，第二显示区120的第m行像素单元对应的第m个移位寄存器Pm的次级触发信号输出端out与第一显示区110的第m+1行像素单元对应的第m+1个移位寄存器Qm+1的触发信号输入端STV电连接，其中，m为大于或等于1且小于N的整数。当第一显示区110的第m行像素单元对应的第m个移位寄存器Qm的显示驱动信号输出端Gout输出显示驱动信号至第一显示区110第m行像素单元后，其次级触发信号输出端out输出触发信号至第二显示区120的第m行像素单元对应的第m个移位寄存器Pm的触发信号输入端STV，触发第二显示区120的第m行像素单元对应的第m个移位寄存器Pm的显示驱动信号输出端Gout输出显示驱动信号至第二显示区120的第m行像素单元，第二显示区120的第m行像素单元对应的第m个移位寄存器Pm的次级触发信号输出端out输出触发信号至第一显示区110的第m+1行像素单元对应的第m+1个移位寄存器Qm+1的触发信号输入端STV，触发第一显示区110的第m+1行像素单元对应的第m+1个移位寄存器Qm+1的显示驱动信号输出端Gout输出显示驱动信号至第一显示区110的第m+1行像素单元，以此类推，直至显示面板完成一帧的显示。由此可知，在显示面板的一帧驱动过程中，第一显示区110和第二显示区120显示画面只有一行像素单元显示时间的延迟，有效地解决了现今VR显示技术中采用单个显示面板作为左右眼的共同显示器件时左右眼画面不同步的现象，提高了VR显示面板的显示效果。
另外，显示面板还可以包括触发信号线113，第一显示区110的第一行像素单元对应的第一个驱动模块131(1)的触发信号输入端STV与触发信号线113电连接，触发信号线113输出的触发信号用于触发第一显示区110的第一行像素单元对应的第一个驱动模块131(1)的显示驱动信号输出端Gout输出显示驱动信号，次级触发信号输出端out输出触发信号至第二显示区120的第一行像素单元对应的第一个驱动模块132(1)。
示例性地，在图6中，每个像素单元组包括两行像素单元，对应的每个驱动模块中包括两个移位寄存器，此时一个像素单元组为两行像素单元，一个驱动模块包括两个移位寄存器。
图8为本发明实施例提供的另一种移位寄存器的连接示意图。结合图6和图8，当每个像素单元组有多行像素单元时，此时N个第一驱动模块131包括2n个移位寄存器Q，M个第二驱动模块132包括2m个移位寄存器P。2n个移位寄存器Q和2m个移位寄存器P依次循环驱动第一显示区110的N个第一像素单元组111和第二显示区120的M个第二像素单元组121，第一显示区110的第i个像素单元组111对应的第一驱动模块131中最后一个移位寄存器的次级触发信号输出端out与第二显示区120的第j个像素单元组121对应的第二驱动模块132中第一个移位寄存器的触发信号输入端STV电连接，第二显示区120的第j个像素单元组121对应的第二驱动模块132中最后一个移位寄存器的次级触发信号输出端out与第一显示区110的第i+1个像素单元组111对应的第一驱动模块131中第一个移位寄存器的触发信号输入端stv电连接，第一显示区110的第i+1个像素单元组111对应的第一驱动模块131中最后一个移位寄存器的次级触发信号输出端out与第二显示区120的第j+1个像素单元组121对应的第二驱动模块132中第一个移位寄存器的触发信号输入端stv电连接；每个第一驱动模块131和第二驱动模块132中的移位寄存器级联设置。
示例性地，N个第一驱动模块131中第i个第一驱动模块131包括两个移位寄存器Qi1和Qi2，第i+1个第一驱动模块131包括两个移位寄存器Q(i+1)1和Q(i+1)2。同样，M个第二驱动模块132中第j个第二驱动模块132包括两个移位寄存器Pj1和Pj2，第j+1个第二驱动模块132包括两个移位寄存器P(j+1)1和P(j+1)2。第i个第一驱动模块131中的第一个移位寄存器Qi1的触发信号输入端，用于输入第一个第一驱动模块131的触发信号。第i个第一驱动模块131中的第一个移位寄存器Qi1的次级触发信号输出端与第i个第一驱动模块131中的第二个移位寄存器Qi2的触发信号输入端电连接，第i个第一驱动模块131中的第二个移位寄存器Qi2的次级触发信号输出端与第j个第二驱动模块132中第一个移位寄存器Pj1的触发信号输入端电连接，第j个第二驱动模块132中第二个移位寄存器Pj1的次级触发信号输出端与第j个第二驱动模块132中第二个移位寄存器Pj2的触发信号输出端电连接，第j个第二驱动模块132中第二个移位寄存器Pj2的触发信号输出端与第i+1个第一驱动模块131中第一个移位寄存器Q(i+1)1的触发信号输入端电连接，同样，第i+1个第一驱动模块131中第一个移位寄存器Q(i+1)1的次级触发信号输出端与第i+1个第一驱动模块131中第二个移位寄存器Q(i+1)2的触发信号输入端电连接，第一驱动模块N(i+1)中第二个移位寄存器Q(i+1)2的次级触发信号输出端与第j+1个第二驱动模块132中第一个移位寄存器P(j+1)1的触发信号输入端电连接，第j+1个第二驱动模块132中第一个移位寄存器P(j+1)1的次级触发信号输出端与第j+1个第二驱动模块132中第二个移位寄存器P(j+1)2的触发信号输入端电连接。以此类推，完成N个第一驱动模块和M个第二驱动模块的连接。
当第i个第一驱动模块中的第一个移位寄存器Qi1的触发信号输入端输入触发信号后，第i个第一驱动模块中的第一个移位寄存器Qi1的显示驱动信号输出端输出显示驱动信号，同时触发第i个第一驱动模块中的第二个移位寄存器Qi2输出显示驱动信号。第i个第一驱动模块中的第二个移位寄存器Qi2输出显示驱动信号后，其次级触发信号输出端输出触发信号触发第j个第二驱动模块中第一个移位寄存器Pj1，第j个第二驱动模块Mj中第一个移位寄存器Pj1的显示驱动信号输出端输出显示驱动信号后，其次级触发信号输出端输出触发信号触发第j个第二驱动模块中第二个移位寄存器Pj2。以此类推，在显示面板的一帧的驱动过程中，依次触发第i+1个第一驱动模块中第一个移位寄存器Q(i+1)1、第i+1个第一驱动模块中第二个移位寄存器Q(i+1)2、第j+1个第二驱动模块中第一个移位寄存器P(j+1)1和第j+1个第二驱动模块中第二个移位寄存器P(j+1)2，直至显示面板完成一帧的驱动。
需要说明的，i的值为1到N-1的整数，j的值为1到M-1的整数，i与j的值可以相等，也可以不等。
上述的技术方案，通过第一显示区的第i个像素单元组对应的第一驱动模块中最后一个移位寄存器的次级触发信号输出端与第二显示区的第j个像素单元组对应的第二驱动模块中第一个移位寄存器的触发信号输入端电连接，第二显示区的第j个像素单元组对应的第二驱动模块中最后一个移位寄存器的次级触发信号输出端与第一显示区的第i+1个像素单元组对应的第一驱动模块中第一个移位寄存器的触发信号输入端电连接，第一显示区的第i+1个像素单元组对应的第一驱动模块中最后一个移位寄存器的次级触发信号输出端与第二显示区的第j+1个像素单元组对应的第二驱动模块中第一个移位寄存器的触发信号输入端电连接；并且每个第一驱动模块和第二驱动模块中的移位寄存器级联设置，实现第一显示区和第二显示区的像素单元组依次交错输出显示驱动信号，使第一显示区和第二显示区显示画面时只有一个像素单元组显示时间的延迟，有效地解决了现今VR显示技术中采用单个显示面板作为左右眼的共同显示器件时左右眼画面不同步的现象，提高了VR显示面板的显示效果。
图9为本发明实施例提供的另一种显示面板的结构示意图，如图9所示，为了实现N个第一驱动模块131和M个第二驱动模块132依次循环驱动第一显示区110的N个第一像素单元组111和第二显示区120的M个第二像素单元组121，显示面板还包括第一时钟信号线CLK1、第二时钟信号线CLK2、第三时钟信号线CLK3和第四时钟信号线CLK4。第一时钟信号线CLK1和第二时钟信号线CLK2与N个第一驱动模块131电连接，第三时钟信号线CLK3和第四时钟信号线CLK4与M个第二驱动模块132电连接。
具体地，N个第一驱动模块131级联设置，下一个第一驱动模块131的触发信号输入端与上一个第一驱动模块131的次级触发信号输出端电连接。M个第二驱动模块132级联设置，下一个第二驱动模块132的触发信号输入端与上一个第二驱动模块132的次级触发信号输出端电连接。当每个驱动模块有一个移位寄存器时，则第一显示区110包括N行像素单元，N行像素单元对应的N个移位寄存器级联设置，第二显示区120包括M行像素单元，M行像素单元对应的M个移位寄存器级联设置。当每个驱动模块包括多个移位寄存器时，一个驱动模块内的多个移位寄存器级联设置。N个第一驱动模块131中，下一个第一驱动模块131内的第一个移位寄存器的触发信号输入端与上一个第一驱动模块131中最后一个移位寄存器的次级触发信号输出端电连接，实现N个第一驱动模块131级联。同理，M个第二驱动模块132中，下一个第二驱动模块132内的第一个移位寄存器的触发信号输入端与上一个第二驱动模块132中最后一个移位寄存器的次级触发信号输出端电连接，实现M个第二驱动模块132级联。
另外，显示面板还包括触发信号线113。第一显示区110的第一个像素单元组111(1)对应的第一驱动模块131(1)中第一个移位寄存器的触发信号输入端和第二显示区120的第一个像素单元组121(1)对应的第二驱动模块132(1)中第一个移位寄存器的触发信号输入端与触发信号线113电连接。当触发信号线113输出触发信号后，触发第一显示区110的第一个像素单元组111(1)对应的第一驱动模块131(1)中第一个移位寄存器和第二显示区120的第一个像素单元组121(1)对应的第二驱动模块132(1)中第一个移位寄存器，实现触发N个第一驱动模块131和M个第二驱动模块132。
需要说明的是，触发信号线113可以有两条，第一显示区110的第一个像素单元组111(1)对应的第一驱动模块131(1)中第一个移位寄存器的触发信号输入端连接一条触发信号线113，第二显示区120的第一个像素单元组121(1)对应的第二驱动模块132(1)中第一个移位寄存器的触发信号输入端连接一条触发信号线113。触发信号线113可以只有一条，如图5所示，第一显示区110的第一个像素单元组111(1)对应的第一驱动模块131(1)中第一个移位寄存器的触发信号输入端和第二显示区120的第一个像素单元组121(1)对应的第二驱动模块132(1)中第一个移位寄存器的触发信号输入端共用同一条触发信号线113。
如图9所示，每个驱动模块还包括第一信号输入端in1和第二信号输入端in2，第一时钟信号线CLK1和第二时钟信号线CLK2分别与N个第一驱动模块131的第一信号输入端in1和第二信号输入in2端依次交叠电连接，为N个第一驱动模块131提供第一输入信号和第二输入信号。第三时钟信号线CLK3和第四时钟信号线CLK4分别与M个第二驱动模块132的第一信号输入端in1和第二信号输入端in2依次交叠电连接，为M个第二驱动模块132提供第三输入信号和第四输入信号。示例性地，第一时钟信号线CLK1与N个第一驱动模块131中所有移位寄存器的奇数级的第一信号输入端in1电连接，与N个第一驱动模块131中所有移位寄存器的偶数级的第二信号输入端in2电连接，第二时钟信号线CLK2与N个第一驱动模块131中所有移位寄存器的级的第一信号输入端in1电连接，与N个第一驱动模块131中所有移位寄存器的偶数奇数级的第二信号输入端in2电连接。同理，示例性地，第三时钟信号线CLK3与M个第二驱动模块132中所有移位寄存器的奇数级的第一信号输入端in1电连接，与M个第二驱动模块132中所有移位寄存器的偶数级的第二信号输入端in2电连接，第四时钟信号线CLK4与M个第二驱动模块132中所有移位寄存器的偶数级的第一信号输入端in1电连接，与M个第二驱动模块132中所有移位寄存器的奇数级的第二信号输入端in2电连接。
图10为本发明实施例提供的一种时钟信号线的时序图，如图10所示，第一时钟信号线CLK1与第三时钟信号线CLK3输出的时钟信号差一个脉冲周期，第二时钟信号线CLK2与第四时钟信号线CLK4输出的时钟信号差一个脉冲周期；第一时钟信号线CLK1与第二时钟信号线CLK2输出的时钟信号差两个脉冲周期，第三时钟信号线CLK3与第四时钟信号线CLK4输出时钟信号差两个脉冲周期。
以下结合图9和图10说明显示面板在第一时钟信号线CLK1、第二时钟信号线CLK2、第三时钟信号线CLK3和第四时钟信号线CLK4输出的时钟信号的驱动下的工作原理。需要说明的是，此处以高电平为有效电平进行说明，并不局限于高电平。
在第一阶段t1，第一显示区110的第一个像素单元组111(1)对应的第一驱动模块131(1)中第一个移位寄存器的触发信号输入端输入触发信号，第一显示区110的第一个像素单元组111(1)对应的第一驱动模块131(1)中第一个移位寄存器的第一信号输入端in1输入高电平。在第二阶段t2，第二显示区120的第一个像素单元组121(1)对应的第二驱动模块132(1)中第一个移位寄存器的触发信号输入端输入触发信号，第二显示区120的第一个像素单元组121(1)对应的第二驱动模块132(1)中第一个移位寄存器的第一信号输入端in1输入高电平。在第三阶段t3，第一显示区110的第一个像素单元组111(1)对应的第一驱动模块131(1)中第一个移位寄存器的第二信号输入端in2和第二个移位寄存器的第一信号输入端in1输入高电平，第一个第一驱动模块131(1)的第一个移位寄存器的显示驱动信号输出端输出显示驱动信号至第一显示区110的第一像素单元组111(1)，同时其次级触发信号输出端输出触发信号至第一个第一驱动模块131(1)中的第二个移位寄存器的触发信号输入端，第一个第一驱动模块131(1)中的第二个移位寄存器的第一信号输入端in1输入高电平。在第四阶段t4，第二显示区120的第一个像素单元组121对应的第二驱动模块132(1)中第一个移位寄存器的第二信号输入端in2和第二个移位寄存器的第一信号输入端in1输入高电平，第一个第二驱动模块132(1)的第一个移位寄存器的显示驱动信号输出端输出显示驱动信号至第二显示区120的第一像素单元组121(1)，同时其次级触发信号输出端输出触发信号至第一个第二驱动模块132(1)中的第二个移位寄存器的触发信号输入端，第一个个第二驱动模块132(1)中的第二个移位寄存器的第一信号输入端in1输入高电平。在第五阶段t5，第一个第二驱动模块132(1)的第二个移位寄存器的显示驱动信号输出端输出显示驱动信号至第二显示区120的与其连接的像素单元，同时其次级触发信号输出端输出触发信号至第二个第一驱动模块131(2)中的第一个移位寄存器的触发信号输入端，第二个第一驱动模块131(2)的第一个移位寄存器的第一信号输入端in1输入高电平。在第六阶段t6，第一个第二驱动模块132(1)的第二个移位寄存器的显示驱动信号输出端输出显示驱动信号至第二显示区120的与其连接的像素单元，同时其次级触发信号输出端输出触发信号至第二个第二驱动模块132(2)中的第一个移位寄存器的触发信号输入端，第二个第二驱动模块132(2)中的第一个移位寄存器的第一信号输入端in1输入高电平。以此类推，直至显示面板完成一帧的显示。
上述的技术方案，通过在显示面板上设置第一时钟信号线、第二时钟信号线、第三时钟信号线和第四时钟信号线，第一时钟信号线和第二时钟信号线与N个第一驱动模块电连接，第三时钟信号线和第四时钟信号线与M个第二驱动模块电连接。使第一时钟信号线与第三时钟信号线输出的时钟信号差一个脉冲周期，第二时钟信号线与第四时钟信号线输出的时钟信号差一个脉冲周期；第一时钟信号线与第二时钟信号线输出的时钟信号差两个脉冲周期，第三时钟信号线与第四时钟信号线输出时钟信号差两个脉冲周期。从而实现第一显示区和第二显示区的像素单元组依次交错输出显示驱动信号，使第一显示区和第二显示区显示画面只有一个像素单元组显示时间的延迟，有效地解决了现今VR显示技术中采用单个显示面板作为左右眼的共同显示器件时左右眼画面不同步的现象，提高了VR显示面板的显示效果。
图11是本发明实施例提供的一种显示装置的结构示意图，如图11所示，本发明还提供一种显示装置10，该显示装置包括本发明任意实施例提供的显示面板。显示面板内包括第一显示区110、第二显示区120和非显示区130，非显示区130内又包括第一驱动模块131和第二驱动模块132，用于驱动第一显示区110和第二显示区120内的像素单元。
图12是本发明实施例提供的一种显示面板的驱动方法流程图，如图12所示，该显示面板包括第一显示区、第二显示区和非显示区。该驱动方法包括：
S110、提供N个第一驱动模块，用于驱动第一显示区的N个像素单元组，N个像素单元组中的每个像素单元组包括至少一行像素单元，其中，N是大于1的整数。
S120、提供M个第二驱动模块，用于驱动第二显示区的M个像素单元组，M个像素单元组中的每个像素单元组包括一行像素单元，其中，M是大于1的整数。
S130、驱动第一显示区的第i个像素单元组输出显示驱动信号。
S140、驱动第二显示区的第j个像素单元组输出显示驱动信号。
S150、驱动第一显示区的第i+1个像素单元组输出显示驱动信号。
S160、驱动第二显示区的第j+1个像素单元组输出显示驱动信号。
其中，i为大于或等于1且小于N的整数，j为大于或等于1且小于或M的整数。
具体地，在显示面板的一帧驱动过程中，N个像素单元组111和M个像素单元组121依次交错被循环驱动。示例性地，N个第一驱动模块中第i个驱动第一显示区中第i个像素单元组后，M个第二驱动模块中第j个驱动第二显示区中第j个像素单元组。M个第二驱动模块中第j个驱动第二显示区中第j个像素单元组后，N个第一驱动模块中第i+1个驱动第一显示区中第i+1个像素单元组。N个第一驱动模块中第i+1个驱动第一显示区中第i+1个像素单元组后，M个第二驱动模块中第j+1个驱动第二显示区中第j+1个像素单元组。以此类推。i与j的取值可以相等，也可以不等。
需要说明的是，S110和S120的顺序不做限定。
上述的技术方案，显示面板包括第一显示区、第二显示区和非显示区，通过提供N个第一驱动模块，用于驱动第一显示区的N个像素单元组，提供M个第二驱动模块，用于驱动第二显示区的M个像素单元组，实现驱动第一显示区的第i个像素单元组输出显示驱动信号、驱动第二显示区的第j个像素单元组输出显示驱动信号、驱动第一显示区的第i+1个像素单元组输出显示驱动信号和驱动第二显示区的第j+1个像素单元组输出显示驱动信号的驱动顺序，使第一显示区和第二显示区的像素单元组依次交错输出显示驱动信号，实现第一显示区和第二显示区显示画面只有一个像素单元组显示时间的延迟，有效地解决了现今VR显示技术中采用单个显示面板作为左右眼的共同显示器件时左右眼画面不同步的现象，提高了VR显示面板的显示效果。
上述的技术方案的基础上，优选地，i与j的取值相等。示例性地，N个第一驱动模块在驱动第一显示区的第n个像素单元组输出显示驱动信号后，M个第二驱动模块驱动第二显示区的第n个像素单元组输出显示驱动信号，其中，N和M的值相等，n为大于或等于1且小于N的整数。
上述的技术方案的基础上，提供第一驱动模块还包括：使每个第一驱动模块包括至少一个移位寄存器，每个第一驱动模块中移位寄存器的个数与对应的每个N个像素单元组中像素行数相等。提供第二驱动模块还包括：使每个第二驱动模块包括至少一个移位寄存器，每个第二驱动模块中移位寄存器的个数与对应的每个M个像素单元组的像素行数相等。
驱动方法还包括：每个移位寄存器驱动与其对应的像素单元组中的一行像素单元输出显示驱动信号。以使每个移位寄存器驱动与其对应的一行像素单元。
上述各技术方案的基础上，驱动方法还包括：
在显示面板上，提供第一时钟信号线、第二时钟信号线、第三时钟信号线和第四时钟信号线，使第一时钟信号线和第二时钟信号线与N个第一驱动模块电连接，第三时钟信号线和第四时钟信号线与M个第二驱动模块电连接。
第一时钟信号线和第二时钟信号线驱动N个第一驱动模块输出显示驱动信号，以及第三时钟信号线和第四时钟信号线驱动M个第二驱动模块输出显示驱动信号。
第一时钟信号线与第三时钟信号线输出的时钟信号差一个脉冲周期，第二时钟信号线与第四时钟信号线输出的时钟信号差一个脉冲周期；第一时钟信号线与第二时钟信号线输出的时钟信号差两个脉冲周期，第三时钟信号线与第四时钟信号线输出时钟信号差两个脉冲周期。
驱动方法还包括：在显示面板上，提供触发信号线；使第一显示区的第一个像素单元组对应的驱动模块中第一个移位寄存器的触发信号输入端和第二显示区的第一个像素单元组对应的驱动模块中第一个移位寄存器的触发信号输入端与触发信号线电连接，使触发信号线输出触发信号至第一显示区第一组像素单元对应的驱动模块中第一个移位寄存器和第二显示区第一组像素单元对应的驱动模块中第一个移位寄存器。
在显示面板的一帧驱动过程中，通过在显示面板上，提供第一时钟信号线、第二时钟信号线、第三时钟信号线和第四时钟信号线，使第一时钟信号线和第二时钟信号线与N个第一驱动模块电连接，第三时钟信号线和第四时钟信号线与M个第二驱动模块电连接。使第一时钟信号线与第三时钟信号线输出的时钟信号差一个脉冲周期，第二时钟信号线与第四时钟信号线输出的时钟信号差一个脉冲周期；第一时钟信号线与第二时钟信号线输出的时钟信号差两个脉冲周期，第三时钟信号线与第四时钟信号线输出时钟信号差两个脉冲周期。从而实现第一显示区和第二显示区的像素单元组依次交错输出显示驱动信号，使第一显示区和第二显示区显示画面只有一个像素单元组显示时间的延迟，有效地解决了现今VR显示技术中采用单个显示面板作为左右眼的共同显示器件时左右眼画面不同步的现象，提高了VR显示面板的显示效果。
注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里所述的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。

Claims (13)

1.一种显示面板，其特征在于，包括第一显示区、第二显示区和非显示区；
所述第一显示区包括N个像素单元组，所述第二显示区包括M个像素单元组，所述N个像素单元组和所述M个像素单元组中的每个像素单元组包括至少一行像素单元，其中，N和M均是大于1的整数；
所述非显示区包括N个第一驱动模块和M个第二驱动模块，所述N个第一驱动模块分别与所述第一显示区的N个像素单元组对应，所述M个第二驱动模块分别与所述第二显示区的M个像素单元组对应，用于驱动与其对应的像素单元组；
所述N个第一驱动模块和所述M个第二驱动模块用于依次循环驱动所述第一显示区的第i个像素单元组输出显示驱动信号、驱动所述第二显示区的第j个像素单元组输出显示驱动信号、驱动所述第一显示区的第i+1个像素单元组输出显示驱动信号和驱动所述第二显示区的第j+1个像素单元组输出显示驱动信号；其中，i为大于或等于1且小于N的整数，j为大于或等于1且小于M的整数；
每个所述第一驱动模块包括至少一个移位寄存器，每个所述第一驱动模块中移位寄存器的个数与对应的每个所述N个像素单元组中像素单元的行数相等；每个所述第二驱动模块包括至少一个移位寄存器，每个所述第二驱动模块中移位寄存器的个数与对应的每个所述M个像素单元组的像素单元的行数相等；
所述第一显示区的第i个像素单元组对应的第一驱动模块中最后一个移位寄存器的次级触发信号输出端与所述第二显示区的第j个像素单元组对应的第二驱动模块中第一个移位寄存器的触发信号输入端电连接，所述第二显示区的第j个像素单元组对应的第二驱动模块中最后一个移位寄存器的次级触发信号输出端与所述第一显示区的第i+1个像素单元组对应的第一驱动模块中第一个移位寄存器的触发信号输入端电连接，所述第一显示区的第i+1个像素单元组对应的第一驱动模块中最后一个移位寄存器的次级触发信号输出端与所述第二显示区的第j+1个像素单元组对应的第二驱动模块中第一个移位寄存器的触发信号输入端电连接；
每个所述第一驱动模块和第二驱动模块中的移位寄存器级联设置。
2.根据权利要求1所述的显示面板，其特征在于，所述N个第一驱动模块和所述M个第二驱动模块用于依次循环驱动所述第一显示区的第n个像素单元组输出显示驱动信号、驱动所述第二显示区的第n个像素单元组输出显示驱动信号、驱动所述第一显示区的第n+1个像素单元组输出显示驱动信号和驱动所述第二显示区的第n+1个像素单元组输出显示驱动信号，其中，N和M的值相等，n为大于或等于1且小于N的整数。
3.根据权利要求1所述的显示面板，其特征在于，所述第一显示区中每个像素单元组包括一行像素单元，所述第二显示区中每个像素单元组包括一行像素单元。
4.根据权利要求3所述的显示面板，其特征在于，所述第一显示区的第m行像素单元对应的第m个移位寄存器的次级触发信号输出端与所述第二显示区的第m行像素单元对应的第m个移位寄存器的触发信号输入端电连接，所述第二显示区的第m行像素单元对应的第m个移位寄存器的次级触发信号输出端与所述第一显示区的第m+1行像素单元对应的第m+1个移位寄存器的触发信号输入端电连接，其中，m为大于或等于1且小于N的整数。
5.根据权利要求1所述的显示面板，其特征在于，还包括第一时钟信号线、第二时钟信号线、第三时钟信号线和第四时钟信号线；
所述第一时钟信号线和所述第二时钟信号线与所述N个第一驱动模块电连接，所述第三时钟信号线和所述第四时钟信号线与所述M个第二驱动模块电连接。
6.根据权利要求5所述的显示面板，其特征在于，所述第一时钟信号线与所述第三时钟信号线输出的时钟信号差一个脉冲周期，所述第二时钟信号线与所述第四时钟信号线输出的时钟信号差一个脉冲周期；所述第一时钟信号线与所述第二时钟信号线输出的时钟信号差两个脉冲周期，所述第三时钟信号线与所述第四时钟信号线输出时钟信号差两个脉冲周期。
7.根据权利要求5所述的显示面板，其特征在于，还包括触发信号线；所述第一显示区的第一个像素单元组对应的第一驱动模块中第一个移位寄存器的触发信号输入端和所述第二显示区的第一个像素单元组对应的第二驱动模块中第一个移位寄存器的触发信号输入端与所述触发信号线电连接。
8.一种显示装置，其特征在于，包括权利要求1-7任一所述的显示面板。
9.一种显示面板的驱动方法，其特征在于，所述显示面板包括第一显示区、第二显示区和非显示区；
提供N个第一驱动模块，用于驱动所述第一显示区的N个像素单元组，所述N个像素单元组中的每个像素单元组包括至少一行像素单元，其中，N是大于1的整数；
提供M个第二驱动模块，用于驱动所述第二显示区的M个像素单元组，所述M个像素单元组中的每个像素单元组包括一行像素单元，其中，M是大于1的整数；
驱动所述第一显示区的第i个像素单元组输出显示驱动信号；
驱动所述第二显示区的第j个像素单元组输出显示驱动信号；
驱动所述第一显示区的第i+1个像素单元组输出显示驱动信号；
驱动所述第二显示区的第j+1个像素单元组输出显示驱动信号；
其中，i为大于或等于1且小于N的整数，j为大于或等于1且小于或M的整数；
所述提供第一驱动模块还包括：使每个所述第一驱动模块包括至少一个移位寄存器，每个所述第一驱动模块中移位寄存器的个数与对应的每个所述N个像素单元组中像素行数相等；
所述提供第二驱动模块还包括：使每个所述第二驱动模块包括至少一个移位寄存器，每个所述第二驱动模块中移位寄存器的个数与对应的每个所述M个像素单元组的像素行数相等；
所述驱动方法还包括：
每个所述移位寄存器驱动与其对应的所述像素单元组中的一行像素单元输出显示驱动信号，其中，
所述第一显示区的第i个像素单元组对应的第一驱动模块中最后一个移位寄存器的次级触发信号输出端与所述第二显示区的第j个像素单元组对应的第二驱动模块中第一个移位寄存器的触发信号输入端电连接，所述第二显示区的第j个像素单元组对应的第二驱动模块中最后一个移位寄存器的次级触发信号输出端与所述第一显示区的第i+1个像素单元组对应的第一驱动模块中第一个移位寄存器的触发信号输入端电连接，所述第一显示区的第i+1个像素单元组对应的第一驱动模块中最后一个移位寄存器的次级触发信号输出端与所述第二显示区的第j+1个像素单元组对应的第二驱动模块中第一个移位寄存器的触发信号输入端电连接；
每个所述第一驱动模块和第二驱动模块中的移位寄存器级联设置。
10.根据权利要求9所述的显示面板的驱动方法，其特征在于，所述N个第一驱动模块在驱动所述第一显示区的第n个像素单元组输出显示驱动信号后，所述M个第二驱动模块驱动所述第二显示区的第n个像素单元组输出显示驱动信号，其中，N和M的值相等，n为大于或等于1且小于N的整数。
11.根据权利要求9所述的显示面板的驱动方法，
其特征在于，所述驱动方法还包括：
在所述显示面板上，提供第一时钟信号线、第二时钟信号线、第三时钟信号线和第四时钟信号线，
使所述第一时钟信号线和所述第二时钟信号线与所述N个第一驱动模块电连接，所述第三时钟信号线和所述第四时钟信号线与所述M个第二驱动模块电连接；
所述第一时钟信号线和所述第二时钟信号线驱动所述N个第一驱动模块输出显示驱动信号，以及所述第三时钟信号线和所述第四时钟信号线驱动所述M个第二驱动模块输出显示驱动信号。
12.根据权利要求11所述的显示面板的驱动方法，其特征在于，所述第一时钟信号线与所述第三时钟信号线输出的时钟信号差一个脉冲周期，所述第二时钟信号线与所述第四时钟信号线输出的时钟信号差一个脉冲周期；所述第一时钟信号线与所述第二时钟信号线输出的时钟信号差两个脉冲周期，所述第三时钟信号线与所述第四时钟信号线输出时钟信号差两个脉冲周期。
13.根据权利要求12所述的显示面板的驱动方法，其特征在于，所述驱动方法还包括：在所述显示面板上，提供触发信号线；使所述第一显示区的第一个像素单元组对应的驱动模块中第一个移位寄存器的触发信号输入端和所述第二显示区的第一个像素单元组对应的驱动模块中第一个移位寄存器的触发信号输入端与所述触发信号线电连接；
使所述触发信号线输出触发信号至所述第一显示区第一组像素单元对应的驱动模块中第一个移位寄存器和所述第二显示区第一组像素单元对应的驱动模块中第一个移位寄存器。
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