CN105428426B - 一种肖特基二极管用外延片及其制备方法 - Google Patents

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Abstract

本发明提供一种肖特基二极管用外延片及其制备方法，由其制成的二极管电子器件漏电较低、击穿电压较高、寿命较长。一种肖特基二极管用外延片，包括：图形化蓝宝石衬底；AlN成核层，通过磁控溅射技术沉积于所述图形化蓝宝石衬底的上表面；GaN缓冲层，其沉积于所述AlN成核层的上表面，所述GaN缓冲层为C掺杂的GaN缓冲层；外延结构层，其沉积于所述GaN缓冲层的上表面。

Description

一种肖特基二极管用外延片及其制备方法
技术领域
本发明涉及一种二极管用外延片及其制备方法。
背景技术
目前用于二极管的外延片的衬底主要有两种，即蓝宝石衬底和碳化硅衬底。但由于碳化硅的价格昂贵，故蓝宝石衬底的使用更为广泛。现有技术中普遍使用的平片状蓝宝石衬底由于其位错密度较高，制成的二极管电子器件漏电流较高、易击穿。
发明内容
针对上述问题，本发明的目的是提供一种肖特基二极管用外延片及其制备方法，由其制成的二极管电子器件漏电较低、击穿电压较高、寿命较长。
为解决上述技术问题，本发明采用的技术方案为：
一种肖特基二极管用外延片，包括：
图形化蓝宝石衬底；
AlN成核层，通过磁控溅射技术沉积于所述图形化蓝宝石衬底的上表面；
GaN缓冲层，其沉积于所述AlN成核层的上表面，所述GaN缓冲层为C掺杂的GaN缓冲层；
外延结构层，其沉积于所述GaN缓冲层的上表面。
优选地，所述图形化蓝宝石衬底的图形高度为1~2μm，图形宽度为1.5~6μm，图形间隙为0.1~2μm。
优选地，所述AlN成核层是厚度为5~25nm的多晶AlN层。
优选地，所述GaN缓冲层中C的掺杂源为TMGa、CCl4或C2H2。
优选地，所述GaN缓冲层中C的掺杂浓度为5E15~1E19 cm-3，且所述GaN缓冲层的厚度为2~3μm。
优选地，所述外延结构层包括：
AlGaN层，其沉积于所述GaN缓冲层的上表面且厚度为30~300nm；
重掺杂nGaN层，其沉积于所述AlGaN层的上表面且掺杂浓度为5E18~2E19 cm-3，所述重掺杂nGaN层的厚度为2.5~3μm；
轻掺杂nGaN层，其沉积于所述重掺杂nGaN层的上表面且掺杂浓度为4E15~2E16cm-3，所述轻掺杂nGaN层的厚度为5~15μm。
更优选地，所述AlGaN层中Al的摩尔百分含量为5~20%。
本发明采用的又一技术方案是：
一种所述的肖特基二极管用外延片的制备方法，包括如下步骤：
A、在图形化蓝宝石衬底的上表面磁控溅射形成一层多晶AlN成核层；
B、加热升温至1040~1080℃，保持压力为30~400mbar，通过MOCVD技术在AlN成核层的上表面生长C掺杂的GaN缓冲层。
优选地，还包括如下步骤：
C、在950~1050℃下，在GaN缓冲层的上表面生长AlGaN层；
D、在1000~1080℃下，在AlGaN层的上表面生长重掺杂nGaN层；
E、保持温度不变，在重掺杂nGaN层的上表面生长轻掺杂nGaN层；
上述各步骤的顺序为依次进行。
更优选地，所述重掺杂nGaN层、轻掺杂nGaN层的生长压力均为100~700mbar，生长温度均为1000~1080℃。
本发明采用以上技术方案，相比现有技术具有如下优点：使用磁控溅射技术在图形化蓝宝石衬底沉积AlN成核层，并在AlN上生长外延结构层的掺C的GaN缓冲层，相比使用其它类型的蓝宝石衬底（如蓝宝石平片）制作的肖特基二极管，晶体质量较好，位错密度由现有技术中的1E9cm-3降低至6E7cm-3。本发明的二极管外延片制作的肖特基二极管器件漏电较低，散热较好，击穿电压较高，寿命较长。
附图说明
为了更清楚地说明本发明实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其它的附图，其中：
图1为本发明的肖特基二极管用外延片的结构示意图。
上述附图中，1、衬底；2、AlN成核层；3、GaN缓冲层；4、AlGaN层；5、重掺杂nGaN层；6、轻掺杂nGaN层。
具体实施方式
下面对本发明的较佳实施例进行详细阐述，以使本发明的优点和特征能更易于被本领域的技术人员理解。
图1所示为本发明的一种肖特基二极管用外延片。结合图1所示，该肖特基二极管用外延片包括自下至上依次层叠的衬底1、AlN成核层2、GaN缓冲层3、AlGaN层4、重掺杂nGaN层5、轻掺杂nGaN层6。其中， AlGaN层4、重掺杂nGaN层5、轻掺杂nGaN层6构成外延片的外延结构层。
衬底1为图形化蓝宝石衬底（PSS）1。图形化蓝宝石衬底1的图形高度为1~2μm，图形宽度为1.5~6μm，图形间隙为0.1~2μm。图形化蓝宝石衬底通过纳米压印光刻技术、stepper光刻技术、干法刻蚀技术或湿法刻蚀技术制备而成。图像化蓝宝石衬底1的图像为正圆锥形，或者为类圆锥形，类圆锥形是指其侧壁为向外突的弧形。
成核层2通过磁控溅射技术沉积于图形化蓝宝石衬底1的上表面。AlN成核层是厚度为5~25nm的多晶AlN层。
缓冲层为C掺杂的GaN缓冲层3，C的掺杂源为TMGa、CCl4或C2H2。GaN缓冲层中C的掺杂浓度为5E15~1E19 cm-3，GaN缓冲层的厚度为2~3μm。
层4、重掺杂nGaN层5、轻掺杂nGaN层6构成肖特基二极管用外延片的外延结构层。其中，AlGaN层沉积于GaN缓冲层的上表面且厚度为30~300nm，AlGaN层中Al的摩尔百分含量为5~20%；重掺杂nGaN层沉积于AlGaN层的上表面且掺杂浓度为5E18~2E19 cm-3，重掺杂nGaN层的厚度为2.5~3μm；轻掺杂nGaN层沉积于重掺杂nGaN层的上表面且掺杂浓度为4E15~2E16cm-3，轻掺杂nGaN层的厚度为5~15μm。
一种上述肖特基二极管用外延片的制备方法，依次包括如下步骤：
A、通过磁控溅射设备在图形化蓝宝石衬底的上表面磁控溅射形成一层多晶AlN成核层；
B、加热升温至1040~1080℃，保持压力为30~400mbar，将带有AlN成核层的图像化蓝宝石衬底放入MOCVD中，通过MOCVD技术在AlN成核层的上表面生长C掺杂的GaN缓冲层；
C、在950~1050℃下，在GaN缓冲层的上表面生长AlGaN层；
D、在1000~1080℃下，在AlGaN层的上表面生长重掺杂nGaN层；
E、保持温度不变，在重掺杂nGaN层的上表面生长轻掺杂nGaN层。
其中，重掺杂nGaN层、轻掺杂nGaN层的生长压力均为100~700mbar，生长温度均为1000~1080℃。
相比平片蓝宝石衬底制成的肖特基二极管外延片，本发明在图像化蓝宝石衬底上通过磁控溅射生长一层多晶AlN成核层，在通过MOCVD技术生长一层掺C的GaN缓冲层，在此基础上制成的二极管外延片的位错密度由现有技术中的1E9cm-3降低至6E7cm-3。
上述实施例只为说明本发明的技术构思及特点，是一种优选的实施例，其目的在于让熟悉此项技术的人士能够了解本发明的内容并据以实施，并不能以此限制本发明的保护范围。凡根据本发明的精神实质所作的等效变化或修饰，都应涵盖在本发明的保护范围之内。

Claims (8)

1.一种肖特基二极管用外延片，其特征在于，包括：
图形化蓝宝石衬底，所述图形化蓝宝石衬底的图形高度为1~2μm，图形宽度为1.5~6μm，图形间隙为0.1~2μm；
AlN成核层，通过磁控溅射技术沉积于所述图形化蓝宝石衬底的上表面，所述AlN成核层是厚度为5~25nm的多晶AlN层；
GaN缓冲层，其沉积于所述AlN成核层的上表面，所述GaN缓冲层为C掺杂的GaN缓冲层；
外延结构层，其沉积于所述GaN缓冲层的上表面。
2.根据权利要求1所述的肖特基二极管用外延片，其特征在于：所述GaN缓冲层中C的掺杂源为TMGa、CCl4或C2H2。
3.根据权利要求1所述的肖特基二极管用外延片，其特征在于：所述GaN缓冲层中C的掺杂浓度为5E15~1E19 cm-3，且所述GaN缓冲层的厚度为2~3μm。
4.根据权利要求1所述的肖特基二极管用外延片，其特征在于，所述外延结构层包括：
AlGaN层，其沉积于所述GaN缓冲层的上表面且厚度为30~300nm；
重掺杂nGaN层，其沉积于所述AlGaN层的上表面且掺杂浓度为5E18~2E19 cm-3，所述重掺杂nGaN层的厚度为2.5~3μm；
轻掺杂nGaN层，其沉积于所述重掺杂nGaN层的上表面且掺杂浓度为4E15~2E16 cm-3，所述轻掺杂nGaN层的厚度为5~15μm。
5.根据权利要求4所述的肖特基二极管用外延片，其特征在于：所述AlGaN层中Al的摩尔百分含量为5~20%。
6.一种如权利要求1-5任一项所述的肖特基二极管用外延片的制备方法，其特征在于，包括如下步骤：
A、在图形化蓝宝石衬底的上表面磁控溅射形成一层多晶AlN成核层；
B、加热升温至1040~1080℃，保持压力为30~400mbar，通过MOCVD技术在AlN成核层的上表面生长C掺杂的GaN缓冲层。
7.根据权利要求6所述的制备方法，其特征在于，还包括如下步骤：
C、在950~1050℃下，在GaN缓冲层的上表面生长AlGaN层；
D、在1000~1080℃下，在AlGaN层的上表面生长重掺杂nGaN层；
E、保持温度不变，在重掺杂nGaN层的上表面生长轻掺杂nGaN层；
上述各步骤的顺序为依次进行。
8.根据权利要求7所述的制备方法，其特征在于：所述重掺杂nGaN层、轻掺杂nGaN层的生长压力均为100~700mbar，生长温度均为1000~1080℃。
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN106098746A (zh) * 2016-06-30 2016-11-09 江苏能华微电子科技发展有限公司 一种二极管用外延片及其制备方法
CN106098796A (zh) * 2016-06-30 2016-11-09 江苏能华微电子科技发展有限公司 二极管用外延片及其制备方法
CN106098798A (zh) * 2016-06-30 2016-11-09 江苏能华微电子科技发展有限公司 肖特基二极管用外延片及其制备方法
CN106098794A (zh) * 2016-06-30 2016-11-09 江苏能华微电子科技发展有限公司 二极管用外延片及其制备方法
CN106098793A (zh) * 2016-06-30 2016-11-09 江苏能华微电子科技发展有限公司 肖特基二极管用外延片及其制备方法
CN106098797A (zh) * 2016-06-30 2016-11-09 江苏能华微电子科技发展有限公司 一种二极管用外延片及其制备方法
CN106098747A (zh) * 2016-06-30 2016-11-09 江苏能华微电子科技发展有限公司 一种肖特基二极管用外延片及其制备方法
CN106098795A (zh) * 2016-06-30 2016-11-09 江苏能华微电子科技发展有限公司 一种二极管用外延片及其制备方法
CN109860023A (zh) * 2018-12-29 2019-06-07 杭州士兰明芯科技有限公司 氮化镓晶体管及其制造方法

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN103915537A (zh) * 2013-01-09 2014-07-09 理想能源设备(上海)有限公司 硅衬底上化合物半导体外延层生长方法及其器件结构
CN104485402A (zh) * 2014-12-29 2015-04-01 厦门市三安光电科技有限公司 图形化蓝宝石衬底的制作方法

Family Cites Families (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US9245992B2 (en) * 2013-03-15 2016-01-26 Transphorm Inc. Carbon doping semiconductor devices

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN103915537A (zh) * 2013-01-09 2014-07-09 理想能源设备(上海)有限公司 硅衬底上化合物半导体外延层生长方法及其器件结构
CN104485402A (zh) * 2014-12-29 2015-04-01 厦门市三安光电科技有限公司 图形化蓝宝石衬底的制作方法

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