CN106098747A - 一种肖特基二极管用外延片及其制备方法 - Google Patents
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Abstract
本发明公开了一种肖特基二极管用外延片及其制备方法。该二极管外延片包括衬底以及沿其厚度方向依次覆盖在所述衬底一侧面上的GaN二维生长层、SiNx模板层、GaN恢复层、重掺杂nGaN层、轻掺杂nGaN层,所述外延片还包括覆盖在所述轻掺杂nGaN层的背离所述重掺杂nGaN层一侧的另一侧面上的CGaN帽层,其中,所述的衬底为带有AlN盖层的蓝宝石平片衬底,所述的SiNx模板层是由SiH4和NH3在GaN二维生长层的背离所述衬底一侧的另一侧面上原位生长形成的,所述SiNx层的厚度低于一个原子层的厚度。利用本发明的外延片制成的肖特基二极管终端器件的漏电较低、使用寿命长,减小了电流密度、提高了器件的反向击穿电压。
Description
技术领域
本发明涉及半导体制造技术领域,具体涉及一种肖特基二极管用外延片及其制备方法。
背景技术
肖特基二极管利用金属与半导体接触形成的金属-半导体接触原理制作而成,是一种热载流子二极管,具有低正向电压、超高速等特点,被广泛地应用在高频、大电流、低电压整流电路以及微波电子混频电路、检波电路、高频数字逻辑电路、交流-直流变换系统中,是电子器件中常见的分立器件。现有技术中,肖特基二极管普遍采用外延片作为其半导体部件。而用于GaN肖特基二极管的外延片的衬底主要有三种,即蓝宝石衬底、硅衬底和碳化硅衬底。其中,由于碳化硅的价格昂贵,而Si衬底不适合用于制作垂直结构的肖特基二极管,故蓝宝石衬底在垂直结构的肖特基二极管中应用更为广泛。现有技术中普遍使用的平片状蓝宝石衬底由于其位错密度较高,制成的二极管电子器件漏电流较高、易击穿、晶体质量不高。
发明内容
本发明的目的是提供一种肖特基二极管用外延片及其制备方法。
为达到上述目的,本发明采用的一种技术方案是:一种肖特基二极管用外延片,包括依次层叠设置的衬底、GaN二维生长层、SiNx模板层、GaN恢复层、重掺杂nGaN层、轻掺杂nGaN层,所述外延片还包括覆盖在所述轻掺杂nGaN层的背离所述重掺杂nGaN层一侧的另一侧面上的CGaN帽层,其中,所述的衬底为带有AlN盖层的蓝宝石平片衬底,所述的SiNx模板层是在GaN二维生长层的背离所述衬底一侧的另一侧面上使用SiH4和NH3原位生长形成的,所述SiNx层的厚度低于一个原子层的厚度。
优选地,所述CGaN帽层的掺杂源为三甲基镓中的甲基-CH3,掺杂浓度为5E18~1E20cm-3。
优选地,所述衬底中的AlN盖层厚度为5~200nm。
进一步优选地,所述衬底是由所述AlN盖层采用PVD或sputter设备在蓝宝石平片上制作而成的。
优选地,所述GaN二维生长层的厚度为0.3~1μm;所述GaN恢复层的厚度为2~5μm;所述重掺杂nGaN层的厚度为2~3.5μm;所述轻掺杂nGaN层的厚度为4~12μm,所述CGaN帽层的厚度为1~20nm。
优选地,所述重掺杂nGaN层和轻掺杂nGaN层的掺杂源均为SiH4,其掺杂浓度分别为1E18~1.5E19cm-3和3E15~1.5E16cm-3。
本发明的另一技术方案为:
一种如上述肖特基二极管用外延片的制备方法,包括如下步骤:
A、将带有AlN盖层的所述衬底放入MOCVD设备中加热升温至1040~1100℃,而后在所述衬底上直接生长所述GaN二维生长层;
B、在950~1050℃温度下,在所述GaN二维生长层上原位生长所述SiNx模板层;
C、在1000~1080℃温度下,在所述SiNx模板层上依次生长所述GaN恢复层和所述重掺杂nGaN层;
D、保持温度不变,在所述重掺杂nGaN层上生长所述轻掺杂nGaN层;
E、在700~850℃温度下,在所述轻掺杂nGaN层上生长所述CGaN帽层;
上述各步骤的顺序为依次进行。
优选地,所述GaN二维生长层的生长压力为30~400mbar。
优选地,所述重掺杂nGaN层、轻掺杂nGaN层的生长压力均为200~700mbar。
优选地,所述CGaN帽层的生长压力为30~100mbar。
本发明采用以上技术方案,相比现有技术具有如下优点:
1、本发明的衬底通过在蓝宝石平片上覆盖AlN盖层来替代低温GaN缓冲层,同时在GaN二维生长层上原位生长SiNx模板层,显著减少了刃位错密度和螺位错密度,使二极管外延片结构的XRD102和002分别降低至100arcsec和80arcsec以下,总位错密度降低至5*107/cm3以下。低位错密度减少了肖特基二极管终端器件的漏电通道,可显著提高反向击穿电压和正向导通电流,提高了外延片的晶体质量、增加了器件的使用寿命;同时还节约了生长时间。
2、本发明中还采用了CGaN帽层,该CGaN帽层中含有较高的碳含量,使得帽层中电阻率显著提升。采用该帽层使得电流横向扩展,减小电流密度,由此可有效提高器件的反向击穿电压。
附图说明
为了更清楚地说明本发明实施例中的技术方案,下面将对实施例描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本发明的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其它的附图,其中:
附图1是本发明所述的肖特基二极管用外延片的结构示意图。
上述附图中:1、衬底;11、蓝宝石平片;12、AlN盖层;2、GaN二维生长层;3、SiNx模板层;4、GaN恢复层;5、重掺杂nGaN层;6、轻掺杂nGaN层;7、CGaN帽层。
具体实施方式
下面结合附图来对本发明的技术方案作进一步的阐述。
参见图1所示,一种肖特基二极管用外延片,包括衬底以及沿其厚度方向依次覆盖在衬底一侧面上的GaN二维生长层、SiNx模板层、GaN恢复层、重掺杂nGaN层、轻掺杂nGaN层、CGaN帽层。
其中,该衬底为带有AlN盖层12的蓝宝石平片11衬底,该衬底由AlN盖层12采用PVD或sputter设备在蓝宝石平片11上制作而成,该AlN盖层12厚度为5~200nm。
该SiNx模板层是在GaN二维生长层上使用SiH4和NH3原位生长形成的,该SiNx层的厚度低于一个原子层的厚度。
这里,通过采用AlN盖层12替代了低温GaN层,同时配合SiNx模板层,可显著减少了整个外延片的刃位错密度和螺位错密度,使肖特基二极管外延片结构的XRD102和002分别降低至100arcsec和80arcsec以下,总位错密度降低至5*107/cm3以下。低位错密度减少了肖特基二极管终端器件的漏电通道,可显著提高反向击穿电压和正向导通电流,提高了外延片的晶体质量,增加了器件的使用寿命,同时还节约了外延片的生长时间。
而这里采用了CGaN帽层结构,其帽层结构中含有较高的碳含量,使得帽层中电阻率显著提升。采用该帽层使得电流横向扩展,减小电流密度,由此可有效提高器件的反向击穿电压。
本例中,该GaN二维生长层的厚度为0.3~1μm;GaN恢复层的厚度为2~5μm;重掺杂nGaN层的厚度为2~3.5μm;轻掺杂nGaN层的厚度为4~12μm,CGaN帽层的厚度为1~20nm。
这里,重掺杂nGaN层和轻掺杂nGaN层的掺杂源均为SiH4,其掺杂浓度分别为 1E18~1.5E19cm-3和3E15~1.5E16cm-3;该CGaN帽层的掺杂源为三甲基镓中的甲基-CH3,掺杂浓度为5E18~1E20cm-3。
一种上述肖特基二极管用外延片的制备方法,包括如下步骤:
A、将衬底放入MOCVD设备中加热升温至1040~1100℃,而后在衬底上直接生长GaN二维生长层;
B、在950~1050℃温度下,在GaN二维生长层上原位生长SiNx模板层;
C、在1000~1080℃温度下,在SiNx模板层上依次生长GaN恢复层和重掺杂nGaN层;
D、保持温度不变,在重掺杂nGaN层上生长轻掺杂nGaN层;
E、在700~850℃温度下,在轻掺杂nGaN层上生长CGaN帽层。
其中,GaN二维生长层的生长压力为30~400mbar;重掺杂nGaN层、轻掺杂nGaN层的生长压力均为200~700mbar;而CGaN帽层的生长压力为30~100mbar。
上述实施例只为说明本发明的技术构思及特点,其目的在于让熟悉此项技术的人士能够了解本发明的内容并加以实施,并不能以此限制本发明的保护范围,凡根据本发明精神实质所作的等效变化或修饰,都应涵盖在本发明的保护范围内。
Claims (10)
1.一种肖特基二极管用外延片,包括依次层叠设置的衬底、GaN二维生长层、SiNx模板层、GaN恢复层、重掺杂nGaN层、轻掺杂nGaN层,其特征在于,所述外延片还包括覆盖在所述轻掺杂nGaN层的背离所述重掺杂nGaN层一侧的另一侧面上的CGaN帽层,其中,所述的衬底为带有AlN盖层的蓝宝石平片衬底,所述的SiNx模板层是在GaN二维生长层的背离所述衬底一侧的另一侧面上使用SiH4和NH3原位生长形成的,所述SiNx层的厚度低于一个原子层的厚度。
2.根据权利要求1所述的肖特基二极管用外延片,其特征在于,所述CGaN帽层的掺杂源为三甲基镓中的甲基-CH3,掺杂浓度为5E18~1E20 cm-3。
3.根据权利要求1所述的肖特基二极管用外延片,其特征在于,所述衬底中的AlN盖层厚度为5~200nm。
4.根据权利要求3所述的肖特基二极管用外延片,其特征在于,所述衬底是由所述AlN盖层采用PVD或sputter设备在蓝宝石平片上制作而成的。
5.根据权利要求1所述的肖特基二极管用外延片,其特征在于,所述GaN二维生长层的厚度为0.3~1μm;所述GaN恢复层的厚度为2~5μm;所述重掺杂nGaN层的厚度为2~3.5μm;所述轻掺杂nGaN层的厚度为4~12μm,所述CGaN帽层的厚度为1~20nm。
6.根据权利要求1所述的肖特基二极管用外延片,其特征在于,所述重掺杂nGaN层和轻掺杂nGaN层的掺杂源均为SiH4,其掺杂浓度分别为1E18~1.5E19cm-3和3E15~1.5E16 cm-3。
7.一种如权利要求1至6任一项所述的肖特基二极管用外延片的制备方法,其特征在于,包括如下步骤:
A、将带有AlN盖层的所述衬底放入MOCVD设备中加热升温至1040~1100℃,而后在所述衬底上直接生长所述GaN二维生长层;
B、在950~1050℃温度下,在所述GaN二维生长层上原位生长所述SiNx模板层;
C、在1000~1080℃温度下,在所述SiNx模板层上依次生长所述GaN恢复层和所述重掺杂nGaN层;
D、保持温度不变,在所述重掺杂nGaN层上生长所述轻掺杂nGaN层;
E、在700~850℃温度下,在所述轻掺杂nGaN层上生长所述CGaN帽层;
上述各步骤的顺序为依次进行。
8.根据权利要求7所述的制备方法,其特征在于,所述GaN二维生长层的生长压力为30~400mbar。
9.根据权利要求7所述的制备方法,其特征在于,所述重掺杂nGaN层、轻掺杂nGaN层的生长压力均为200~700mbar。
10.根据权利要求7所述的制备方法,其特征在于,所述CGaN帽层的生长压力为30~100mbar。
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Citations (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN101427391A (zh) * | 2006-02-23 | 2009-05-06 | 阿祖罗半导体股份公司 | 氮化物半导体部件及其制造工艺 |
CN101894868A (zh) * | 2009-02-18 | 2010-11-24 | 万国半导体有限公司 | 改良正向传导的氮化镓半导体器件 |
CN103346083A (zh) * | 2013-07-09 | 2013-10-09 | 苏州捷芯威半导体有限公司 | 氮化镓肖特基二极管及其制造方法 |
CN103531625A (zh) * | 2012-07-05 | 2014-01-22 | 先进动力设备技术研究协会 | 氮化物系化合物半导体元件 |
CN103952683A (zh) * | 2013-06-14 | 2014-07-30 | 西安电子科技大学 | 含有SiNx插入层的半极性m面GaN基的半导体器件的制备方法 |
US20140302665A1 (en) * | 2011-09-30 | 2014-10-09 | Osram Opto Semiconductors Gmbh | Method for producing an optoelectronic nitride compound semiconductor component |
CN104821341A (zh) * | 2014-02-05 | 2015-08-05 | 意法半导体(图尔)公司 | 垂直氮化镓肖特基二极管 |
CN105428426A (zh) * | 2015-11-09 | 2016-03-23 | 江苏能华微电子科技发展有限公司 | 一种二级管用外延片及其制备方法 |
-
2016
- 2016-06-30 CN CN201610497787.6A patent/CN106098747A/zh active Pending
Patent Citations (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN101427391A (zh) * | 2006-02-23 | 2009-05-06 | 阿祖罗半导体股份公司 | 氮化物半导体部件及其制造工艺 |
CN101894868A (zh) * | 2009-02-18 | 2010-11-24 | 万国半导体有限公司 | 改良正向传导的氮化镓半导体器件 |
US20140302665A1 (en) * | 2011-09-30 | 2014-10-09 | Osram Opto Semiconductors Gmbh | Method for producing an optoelectronic nitride compound semiconductor component |
CN103531625A (zh) * | 2012-07-05 | 2014-01-22 | 先进动力设备技术研究协会 | 氮化物系化合物半导体元件 |
CN103952683A (zh) * | 2013-06-14 | 2014-07-30 | 西安电子科技大学 | 含有SiNx插入层的半极性m面GaN基的半导体器件的制备方法 |
CN103346083A (zh) * | 2013-07-09 | 2013-10-09 | 苏州捷芯威半导体有限公司 | 氮化镓肖特基二极管及其制造方法 |
CN104821341A (zh) * | 2014-02-05 | 2015-08-05 | 意法半导体(图尔)公司 | 垂直氮化镓肖特基二极管 |
CN105428426A (zh) * | 2015-11-09 | 2016-03-23 | 江苏能华微电子科技发展有限公司 | 一种二级管用外延片及其制备方法 |
Non-Patent Citations (3)
Title |
---|
F.YUN ET.AL: "Efficacy of single and double SiNx interlayers ondefect reduction in GaN overlayers grown by organometallic vapor-phaseepitaxy", 《J.APPL.PHYS》 * |
M.J.KAPPERS.ET.AL: "Low dislocationdensity GaN growth on high-temperature AIN buffer layers on(0001)sapphire", 《J.CRYST.GROWTH》 * |
S.SAKAI.ET.AL: "A New Method of Reducing Dislocation Density in GaN Layer Grown on Sapphire Substrate by MOVPE", 《J.CRYST.GROWTH》 * |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
C06 | Publication | ||
PB01 | Publication | ||
C10 | Entry into substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
RJ01 | Rejection of invention patent application after publication |
Application publication date: 20161109 |
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RJ01 | Rejection of invention patent application after publication |