CN104966500B - 降低功耗的goa电路 - Google Patents

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Abstract

本发明提供一种降低功耗的GOA电路，在第N级GOA单元电路中，上拉模块(300)的第二十二薄膜晶体管(T22)受第二上拉控制与下传模块(200)的第二十一薄膜晶体管(T21)的控制来将恒压高电位(VDD)输出至扫描驱动信号(G(N))，能够减少时钟信号的寄生电容，降低时钟信号的电压，减轻时钟信号的负载，从而降低GOA电路的功耗；通过第二十一薄膜晶体管(T21)将时钟信号(CK(m))输出至级传信号(ST(N))，采用级传信号(ST(N))进行信号的下传和对上的反馈，能够降低扫描驱动信号的负载，增强扫描驱动信号的推力，保证GOA电路功能正常；并通过在下拉维持模块(700)中增设第四十一薄膜晶体管(T41)对级传信号(ST(N))进行下拉来预防第二十二薄膜晶体管(T22)漏电。

Description

降低功耗的GOA电路
技术领域
本发明涉及显示技术领域，尤其涉及一种降低功耗的GOA电路。
背景技术
液晶显示器(Liquid Crystal Display，LCD)具有机身薄、省电、无辐射等众多优点，得到了广泛的应用。如：液晶电视、移动电话、个人数字助理(PDA)、数字相机、计算机屏幕或笔记本电脑屏幕等，在平板显示领域中占主导地位。
现有市场上的液晶显示器大部分为背光型液晶显示器，其包括液晶显示面板及背光模组(backlight module)。液晶显示面板的工作原理是在薄膜晶体管阵列基板(ThinFilm Transistor Array Substrate，TFT Array Substrate)与彩色滤光片基板(ColorFilter，CF)之间灌入液晶分子，并在两片基板上施加驱动电压来控制液晶分子的旋转方向，以将背光模组的光线折射出来产生画面。
主动矩阵式液晶显示器(Active Matrix Liquid Crystal Display，AMLCD)是目前最常用的液晶显示装置，所述主动矩阵式液晶显示器包含多个像素，每个像素具有一个薄膜晶体管(Thin Film Transistor，TFT)，该TFT的栅极连接至沿水平方向延伸的扫描线，漏极连接至沿垂直方向延伸的数据线，而该TFT的源极连接至对应的像素电极。如果在水平方向的某一扫描线上施加足够的正电压，则会使得连接在该条扫描线上的所有TFT打开，将数据线上所加载的数据信号电压写入像素电极中，控制不同液晶的透光度进而达到控制色彩的效果。
主动式液晶显示面板水平扫描线的驱动(即栅极驱动)最初由外接的集成电路(Integrated Circuit，IC)来完成，外接的IC可以控制各级水平扫描线的逐级充电和放电。GOA技术(Gate Driver on Array)即阵列基板行驱动技术，可以运用液晶显示面板的阵列制程将水平扫描线的驱动电路制作在显示区周围的基板上，使之能替代外接IC来完成水平扫描线的驱动。GOA技术能减少外接IC的焊接(bonding)工序，有机会提升产能并降低产品成本，而且可以使液晶显示面板更适合制作窄边框的显示产品。
目前，GOA技术已经广泛地应用于液晶显示面板，然而现有的GOA电路相较于外接IC有功耗增大的缺点。如图1所示，一种现有的GOA电路包括级联的多个GOA单元电路，第N级GOA单元电路中，第十一薄膜晶体管T11的栅极与源极均接入上一级第N-1级GOA单元电路的扫描驱动信号G(N-1)，负责进行上拉控制；第二十一薄膜晶体管T21的源极接入时钟信号CK(m)，当其栅极为高电位时，第二十一薄膜晶体管T21导通，其漏极将时钟信号CK(m)输出为扫描驱动信号G(N)，对扫描驱动信号G(N)进行上拉。
根据功耗的计算公式：
P＝1/2CfV2
其中P表示功耗，f表示信号的频率为，C表示信号线的电容，V表示信号线的高低电位差，在图1所示的现有GOA电路中，时钟信号CK(m)的频率最高，相当于其它信号频率的上千倍，那么GOA电路的功耗较大，且主要是由时钟信号CK(m)产生的。功耗与信号的频率、信号线的电容、信号线的高低电位差呈正比例关系，其中频率与液晶显示面板的分辨率相关，不能变更，所以只能通过减少电容或者减少电压差来降低功耗。
另外，由于扫描驱动信号G(N)还需接入下一级GOA单元电路中第十一薄膜晶体管T11的栅极与源极，扫描驱动信号G(N)的负载较大，若图1所示的现有GOA电路需要调节扫描驱动信号G(N)的高电位以增强推力和对显示区TFT的充电能力，必须通过提高时钟信号CK(m)的高电压来实现，这种情况下导致时钟信号CK(m)的高低电压差更大，GOA电路的功耗也就越高，但若不提高时钟信号CK(m)的高电压则会造成扫描驱动信号G(N)的推力不足，容易引起扫描驱动信号G(N)的时序异常。
发明内容
本发明的目的在于提供一种GOA电路，能够减少时钟信号的寄生电容，降低时钟信号的电压，减轻时钟信号的负载，从而降低GOA电路的功耗，并能够避免因为时钟信号推力不足引起的扫描驱动信号时序异常，保证GOA电路功能正常。
为实现上述目的，本发明提供一种降低功耗的GOA电路，包括级联的多个GOA单元电路，每一级GOA单元电路均包括：第一上拉控制模块、第二上拉控制与下传模块、上拉模块、第一下拉模块、第二下拉模块、自举电容模块、以及下拉维持模块，各个模块由一个或数个薄膜晶体管构成；
设N为正整数，除第一级GOA单元电路与最后一级GOA单元电路以外，在第N级GOA单元电路中：
所述第一上拉控制模块接入上一级第N-1级GOA单元电路的级传信号，电性连接于第一节点，用于对所述第一节点的电位进行控制；
所述第二上拉控制与下传模块电性连接于第一节点及上拉模块，该第二上拉控制与下传模块接入对应该第N级GOA单元电路的第m组时钟信号，用于根据第一节点的电位及第m组时钟信号的电位来控制上拉模块，同时输出级传信号；
所述上拉模块接入恒压高电位，输出扫描驱动信号，用于受第二上拉控制与下传模块的控制将恒压高电位输出至扫描驱动信号；
所述第一下拉模块接入下一级第N+1级GOA单元电路的级传信号及与下一级第N+1级GOA单元电路对应的第m+1组时钟信号，电性连接于扫描驱动信号及恒压低电位，用于在非作用期间拉低扫描驱动信号的电位；
所述第二下拉模块接入下一级第N+1级GOA单元电路的级传信号，电性连接于第一节点及恒压低电位，用于在非作用期间拉低第一节点的电位；
所述自举电容模块电性连接于第一节点与第二上拉控制与下传模块，用于对第一节点进行充放电；
所述下拉维持模块电性连接于第一节点、扫描驱动信号、级传信号、第m组时钟信号与恒压低电位，用于在非作用期间维持第一节点、扫描驱动信号、与级传信号的低电位；
所述恒压高电位高于时钟信号的高电位；
所述第m组时钟信号与第m+1组时钟信号的相位相反。
所述第一上拉控制模块包括第十一薄膜晶体管，所述第十一薄膜晶体管的栅极与源极均接入上一级第N-1级GOA单元电路的级传信号，漏极电性连接于第一节点；
所述第二上拉控制与下传模块包括第二十一薄膜晶体管，所述第二十一薄膜晶体管的栅极电性连接于第一节点，源极电性连接于对应该第N级GOA单元电路的第m组时钟信号，漏极输出级传信号；
所述上拉模块包括第二十二薄膜晶体管，所述第二十二薄膜晶体管的栅极电性连接于第二十一薄膜晶体管的漏极，源极接入恒压高电位，漏极输出扫描驱动信号；
所述第一下拉模块包括第三十一薄膜晶体管与第三十二薄膜晶体管；所述第三十一薄膜晶体管的栅极接入下一级第N+1级GOA单元电路的级传信号，源极电性连接于扫描驱动信号，漏极电性连接于恒压低电位；所述第三十二薄膜晶体管的栅极接入与下一级第N+1级GOA单元电路对应的第m+1组时钟信号，源极电性连接于扫描驱动信号，漏极电性连接于恒压低电位；
所述第二下拉模块包括第五十一薄膜晶体管，所述第五十一薄膜晶体管的栅极接入下一级第N+1级GOA单元电路的级传信号，源极电性连接于第一节点，漏极电性连接于恒压低电位；
所述自举电容模块包括第一电容，所述第一电容的一端电性连接于第一节点，另一端电性连接于第二十一薄膜晶体管的漏极；
所述下拉维持模块包括第四十一薄膜晶体管、第六十一薄膜晶体管、第五十二薄膜晶体管、第二电容、及第三十三薄膜晶体管；所述第六十一薄膜晶体管的栅极电性连接于第一节点，源极电性连接于第二节点，漏极电性连接于恒压低电位；所述第四十一薄膜晶体管的栅极电性连接于第二节点，源极电性连接于级传信号，漏极电性连接于恒压低电位；所述第五十二薄膜晶体管的栅极电性连接于第二节点，源极电性连接于第一节点，漏极电性连接于恒压低电位；所述第二电容的一端电性连接于对应该第N级GOA单元电路的第m组时钟信号，另一端电性连接于第二节点；所述第三十三薄膜晶体管的栅极电性连接于第二节点，源极电性连接于扫描驱动信号，漏极电性连接于恒压低电位。
所述时钟信号的高电位为15V；所述恒压高电位为25V。
所述时钟信号的低电位与所述恒压低电位均为-7V。
第一级GOA单元电路中，所述第十一薄膜晶体管的栅极与源极均接入扫描启动信号。
最后一级GOA单元电路中，所述第三十一薄膜晶体管的栅极与第五十一薄膜晶体管的栅极均接入扫描启动信号。
所述时钟信号共包括两组:第一组时钟信号、与第二组时钟信号；当所述第m组时钟信号为第二组时钟信号时，所述第m+1组时钟信号为第一组时钟信号。
所述第二十一薄膜晶体管的沟道宽度为500μm，第二十二薄膜晶体管的沟道宽度为2000μm。
本发明的有益效果：本发明提供的一种降低功耗的GOA电路，通过在第N级GOA单元电路中设置第一上拉控制模块、第二上拉控制与下传模块、上拉模块、第一下拉模块、第二下拉模块、自举电容模块、以及下拉维持模块，上拉模块的第二十二薄膜晶体管受第二上拉控制与下传模块的第二十一薄膜晶体管的控制来将恒压高电位输出至扫描驱动信号，相比于现有技术将时钟信号输出至扫描驱动信号，能够减少时钟信号的寄生电容，降低时钟信号的电压，减轻时钟信号的负载，从而降低GOA电路的功耗；通过第二上拉控制与下传模块的第二十一薄膜晶体管将时钟信号输出至级传信号，采用级传信号进行信号的下传和对上的反馈，相比于现有技术直接用扫描驱动信号来进行下传和对上的反馈，能够降低扫描驱动信号的负载，增强扫描驱动信号的推力，保证GOA电路功能正常；并通过在下拉维持模块中增设第四十一薄膜晶体管对级传信号进行下拉来预防第二十二薄膜晶体管漏电。
为了能更进一步了解本发明的特征以及技术内容，请参阅以下有关本发明的详细说明与附图，然而附图仅提供参考与说明用，并非用来对本发明加以限制。
附图说明
下面结合附图，通过对本发明的具体实施方式详细描述，将使本发明的技术方案及其它有益效果显而易见。
附图中，
图1为一种现有的GOA电路的第N级GOA单元电路的电路图；
图2为本发明的降低功耗的GOA电路的第N级GOA单元电路的电路图；
图3为本发明的降低功耗的GOA电路的第一级GOA单元电路的电路图；
图4为本发明的降低功耗的GOA电路的最后一级GOA单元电路的电路图；
图5为现有的GOA电路中各TFT元件的尺寸、规格表；
图6为本发明的降低功耗的GOA电路中各TFT元件的尺寸、规格表；
图7为本发明的降低功耗的GOA电路的输入信号与关键节点的波形示意图。
具体实施方式
为更进一步阐述本发明所采取的技术手段及其效果，以下结合本发明的优选实施例及其附图进行详细描述。
请参阅图2，本发明提供一种降低功耗的GOA电路，包括级联的多个GOA单元电路，每一级GOA单元电路均包括：第一上拉控制模块100、第二上拉控制与下传模块200、上拉模块300、第一下拉模块400、第二下拉模块500、自举电容模块600、以及下拉维持模块700，各个模块由一个或数个薄膜晶体管构成。
设N为正整数，除第一级GOA单元电路与最后一级GOA单元电路以外，在第N级GOA单元电路中：
所述第一上拉控制模块100包括第十一薄膜晶体管T11，所述第十一薄膜晶体管T11的栅极与源极均接入上一级第N-1级GOA单元电路的级传信号ST(N-1)，漏极电性连接于第一节点Q(N)；
所述第二上拉控制与下传模块200包括第二十一薄膜晶体管T21，所述第二十一薄膜晶体管T21的栅极电性连接于第一节点Q(N)，源极电性连接于对应该第N级GOA单元电路的第m组时钟信号CK(m)，漏极输出级传信号ST(N)；
所述上拉模块300包括第二十二薄膜晶体管T22，所述第二十二薄膜晶体管T22的栅极电性连接于第二十一薄膜晶体管T21的漏极，源极接入恒压高电位VDD，漏极输出扫描驱动信号G(N)；
所述第一下拉模块400包括第三十一薄膜晶体管T31与第三十二薄膜晶体管T32；所述第三十一薄膜晶体管T31的栅极接入下一级第N+1级GOA单元电路的级传信号ST(N+1)，源极电性连接于扫描驱动信号G(N)，漏极电性连接于恒压低电位VSS；所述第三十二薄膜晶体管T32的栅极接入与下一级第N+1级GOA单元电路对应的第m+1组时钟信号CK(m+1)，源极电性连接于扫描驱动信号G(N)，漏极电性连接于恒压低电位VSS；
所述第二下拉模块500包括第五十一薄膜晶体管T51，所述第五十一薄膜晶体管T51的栅极接入下一级第N+1级GOA单元电路的级传信号ST(N+1)，源极电性连接于第一节点Q(N)，漏极电性连接于恒压低电位VSS；
所述自举电容模块600包括第一电容C1，所述第一电容C1的一端电性连接于第一节点Q(N)，另一端电性连接于第二十一薄膜晶体管T21的漏极；
所述下拉维持模块700包括第四十一薄膜晶体管T41、第六十一薄膜晶体管T61、第五十二薄膜晶体管T52、第二电容C2、及第三十三薄膜晶体管T33；所述第六十一薄膜晶体管T61的栅极电性连接于第一节点Q(N)，源极电性连接于第二节点P(N)，漏极电性连接于恒压低电位VSS；所述第四十一薄膜晶体管T41的栅极电性连接于第二节点P(N)，源极电性连接于级传信号ST(N)，漏极电性连接于恒压低电位VSS；所述第五十二薄膜晶体管T52的栅极电性连接于第二节点P(N)，源极电性连接于第一节点Q(N)，漏极电性连接于恒压低电位VSS；所述第二电容C2的一端电性连接于对应该第N级GOA单元电路的第m组时钟信号CK(m)，另一端电性连接于第二节点P(N)；所述第三十三薄膜晶体管T33的栅极电性连接于第二节点P(N)，源极电性连接于扫描驱动信号G(N)，漏极电性连接于恒压低电位VSS。
值得一提的是，所述恒压高电位VDD高于时钟信号的高电位。所述第m组时钟信号CK(m)与第m+1组时钟信号CK(m+1)的相位相反；所述时钟信号共包括两组:第一组时钟信号CK(1)、与第二组时钟信号CK(2)，当所述第m组时钟信号CK(m)为第二组时钟信号CK(2)时，所述第m+1组时钟信号CK(m+1)为第一组时钟信号CK(1)。
特别地，请参阅图3，在第一级GOA单元电路中，所述第十一薄膜晶体管T11的栅极与源极均接入扫描启动信号STV，所述第二十一薄膜晶体管T21的源极及第二电容C2的一端均电性连接于第一组时钟信号CK(1)，第三十二薄膜晶体管T32的栅极接入第二组时钟信号CK(2)。
请参阅图4，最后一级GOA单元电路中，所述第三十一薄膜晶体管T31的栅极与第五十一薄膜晶体管T51的栅极均接入扫描启动信号STV，所述第二十一薄膜晶体管T21的源极及第二电容C2的一端均电性连接于第二组时钟信号CK(2)，第三十二薄膜晶体管T32的栅极接入第一组时钟信号CK(1)。
请同时参阅图2与图7，本发明的降低功耗的GOA电路的工作过程为：自扫描启动信号STV启动第一级GOA单元电路，依次逐级进行扫描驱动。扫描驱动进行至第N级GOA单元电路，上一级第N-1级GOA单元电路的级传信号ST(N-1)为高电位时，第十一薄膜晶体管T11导通，第一节点Q(N)被抬升到高电位，并对第一电容C1充电。随后，第N-1级GOA单元电路的级传信号ST(N-1)转为低电位，第十一薄膜晶体管T11断开，第一节点Q(N)通过第一电容C1维持在高电位，使得第二十一薄膜晶体管T21导通，接着，对应于该第N级GOA单元电路的第m组时钟信号CK(m)转为高电平，第二十一薄膜晶体管T21既将第m组时钟信号CK(m)的高电平的输出至级传信号ST(N)又将时钟信号CK(m)的高电平传输至第二十二薄膜晶体管T22的栅极，控制第二十二薄膜晶体管T22导通，从而第二十二薄膜晶体管T22将恒压高电位VDD输出至扫描驱动信号G(N)，即将扫描驱动信号G(N)上拉至恒压高电位VDD。于此同时，第m组时钟信号CK(m)通过第二十一薄膜晶体管T21继续给第一电容C1充电，使得第一节点Q(N)上升到一更高电位。然后，第二十二薄膜晶体管T22随着第m组时钟信号CK(m)转变为低电位而断开。随着对应于下一极第N+1级GOA单元电路的第m+1组时钟信号CK(m+1)、或级传信号ST(N+1)转变为高电位，第三十一薄膜晶体管T31或第三十二薄膜晶体管T32导通，将扫描驱动信号G(N)拉低至恒压低电位VSS，同时，第一节点Q(N)通过第五十一薄膜晶体管T51放电，被拉低至恒压低电位VSS。
在工作期间，第一节点Q(N)为高电位，第六十一薄膜晶体管T61导通，将第二节点P(N)的电位拉低至恒压低电位VSS。第三十三薄膜晶体管T33、第四十一薄膜晶体管T41、及第五十二薄膜晶体管T52关闭，确保扫描驱动信号G(N)和级传信号ST(N)稳定地输出高电位。
在非工作期间，第三十一薄膜晶体管T31和第三十二薄膜晶体管T32轮流对扫描驱动信号G(N)进行下拉，使有效显示(Active Area，AA)区内的TFT充电完成后保持在关闭状态。此时第六十一薄膜晶体管T61断开，第m组时钟信号CK(m)再次转变为高电位，第二节点P(N)在第二电容C2的充电作用下为高电位，控制第三十三薄膜晶体管T33、第四十一薄膜晶体管T41、及第五十二薄膜晶体管T52导通，确保扫描驱动信号G(N)、级传信号ST(N)和第一节点Q(N)稳定的输出低电位。进一步地，由于第四十一薄膜晶体管T41将级传信号ST(N)拉低至了恒压低电位VSS，可以避免第二十二薄膜晶体管T22关闭不紧将恒压高电位VDD漏电至扫描驱动信号G(N)。
特别需要说明的是，本发明的降低功耗的GOA电路增加了第二十二薄膜晶体管T22，并且所述第二十二薄膜晶体管T22的接入恒压高电位VDD，在第二十一薄膜晶体管T21导通且所述第m组时钟信号CK(m)为高电位时，第二十二薄膜晶体管T22导通，将恒压高电位VDD输出至扫描驱动信号G(N)，因此可以通过调节恒压高电位VDD来提高扫描驱动信号G(N)的电位，实现增强GOA电路的驱动能力和增加AA区内TFT的导通电流来增强充电能力，相比于现有技术中将第m组时钟信号CK(m)的高电位通过第二十一薄膜晶体管T21的输出至扫描驱动信号G(N)，可以避免通过提高时钟信号的高电位来增强推力和充电能力，从而能够降低时钟信号的电压，减轻时钟信号的负载，降低GOA电路的功耗。
本发明的降低功耗的GOA电路增加了级传信号ST(N)用于信号的下传和对上的反馈，相比于现有技术用扫描驱动信号G(N)来进行下传和对上的反馈，可以降低扫描驱动信号G(N)的负载，同时增强扫描驱动信号G(N)的推力，而且级传信号ST(N)的失真较轻微，可以避免扫描驱动信号G(N)失真而引起的上、下级GOA电路差异。
请比较图5与图6，现有GOA电路中接入时钟信号的第二十一薄膜晶体管T21的沟道宽度(width)为2000μm，而本发明的降低功耗的GOA电路中，接入时钟信号的第二十一薄膜晶体管T21的沟道宽度仅为500μm，为现有技术的1/4，所以本发明的降低功耗的GOA电路中第二十一薄膜晶体管T21与时钟信号信号线之间的寄生电容也是现有技术GOA电路的1/4，而时钟信号信号线的寄生电容大部分由第二十一薄膜晶体管T21产生，所以本发明的降低功耗的GOA电路可以减少将近3/4的时钟信号线寄生电容，依据功耗计算公式P＝1/2CfV2，可以有效的降低GOA电路的功耗。
请参阅图7，为本发明降低功耗的GOA电路的输入信号与关键节点的波形示意图，由波形可以看出，级传信号ST(N)和扫描驱动信号G(N)是同步的，只是高电位不一样。
以现有技术的GOA电路的时钟信号的高电位为25V、低电位均为-7V，本发明的降低功耗的GOA电路的恒压高电位为25V，恒压低电位VSS为-7V，时钟信号的高电位为15V，低电位均为-7V为例，由于时钟信号的高电位降低，本发明的降低功耗的GOA电路与现有技术的GOA电路中时钟信号的功耗之比可由下式计算：
(15+7)2/(25+7)2＝47.26％
相比于现有技术的GOA电路，在不影响GOA电路推力的情况下，本发明的降低功耗的GOA可降低时钟信号近50％的功耗。
综上所述，本发明提供的降低功耗的GOA电路，通过在第N级GOA单元电路中设置第一上拉控制模块、第二上拉控制与下传模块、上拉模块、第一下拉模块、第二下拉模块、自举电容模块、以及下拉维持模块，上拉模块的第二十二薄膜晶体管受第二上拉控制与下传模块的第二十一薄膜晶体管的控制来将恒压高电位输出至扫描驱动信号，相比于现有技术将时钟信号输出至扫描驱动信号，能够减少时钟信号的寄生电容，降低时钟信号的电压，减轻时钟信号的负载，从而降低GOA电路的功耗；通过第二上拉控制与下传模块的第二十一薄膜晶体管将时钟信号输出至级传信号，采用级传信号进行信号的下传和对上的反馈，相比于现有技术直接用扫描驱动信号来进行下传和对上的反馈，能够降低扫描驱动信号的负载，增强扫描驱动信号的推力，保证GOA电路功能正常；并通过在下拉维持模块中增设第四十一薄膜晶体管对级传信号进行下拉来预防第二十二薄膜晶体管漏电。
以上所述，对于本领域的普通技术人员来说，可以根据本发明的技术方案和技术构思作出其他各种相应的改变和变形，而所有这些改变和变形都应属于本发明权利要求的保护范围。

Claims (8)

1.一种降低功耗的GOA电路，其特征在于，包括级联的多个GOA单元电路，每一级GOA单元电路均包括：第一上拉控制模块(100)、第二上拉控制与下传模块(200)、上拉模块(300)、第一下拉模块(400)、第二下拉模块(500)、自举电容模块(600)、以及下拉维持模块(700)，各个模块由一个或数个薄膜晶体管构成；
设N为正整数，除第一级GOA单元电路与最后一级GOA单元电路以外，在第N级GOA单元电路中：
所述第一上拉控制模块(100)接入上一级第N-1级GOA单元电路的级传信号(ST(N-1))，电性连接于第一节点(Q(N))，用于对所述第一节点(Q(N))的电位进行控制；
所述第二上拉控制与下传模块(200)电性连接于第一节点(Q(N))及上拉模块(300)，该第二上拉控制与下传模块(200)接入对应该第N级GOA单元电路的第m组时钟信号(CK(m))，用于根据第一节点(Q(N))的电位及第m组时钟信号(CK(m))的电位来控制上拉模块(300)，同时输出级传信号(ST(N))；
所述上拉模块(300)接入恒压高电位(VDD)，输出扫描驱动信号(G(N))，用于受第二上拉控制与下传模块(200)的控制将恒压高电位(VDD)输出至扫描驱动信号(G(N))；
所述第一下拉模块(400)接入下一级第N+1级GOA单元电路的级传信号(ST(N+1))及与下一级第N+1级GOA单元电路对应的第m+1组时钟信号(CK(m+1))，电性连接于扫描驱动信号(G(N))及恒压低电位(VSS)，用于在非作用期间拉低扫描驱动信号(G(N))的电位；
所述第二下拉模块(500)接入下一级第N+1级GOA单元电路的级传信号(ST(N+1))，电性连接于第一节点(Q(N))及恒压低电位(VSS)，用于在非作用期间拉低第一节点(Q(N))的电位；
所述自举电容模块(600)电性连接于第一节点(Q(N))与第二上拉控制与下传模块(200)，用于对第一节点(Q(N))进行充放电；
所述下拉维持模块(700)电性连接于第一节点(Q(N))、扫描驱动信号(G(N))、级传信号(ST(N))、第m组时钟信号(CK(m))与恒压低电位(VSS)，用于在非作用期间维持第一节点(Q(N))、扫描驱动信号(G(N))、与级传信号(ST(N))的低电位；
所述恒压高电位(VDD)高于第m组时钟信号(CK(m))的高电位；
所述第m组时钟信号(CK(m))与第m+1组时钟信号(CK(m+1))的相位相反。
2.如权利要求1所述的降低功耗的GOA电路，其特征在于，所述第一上拉控制模块(100)包括第十一薄膜晶体管(T11)，所述第十一薄膜晶体管(T11)的栅极与源极均接入上一级第N-1级GOA单元电路的级传信号(ST(N-1))，漏极电性连接于第一节点(Q(N))；
所述第二上拉控制与下传模块(200)包括第二十一薄膜晶体管(T21)，所述第二十一薄膜晶体管(T21)的栅极电性连接于第一节点(Q(N))，源极电性连接于对应该第N级GOA单元电路的第m组时钟信号(CK(m))，漏极输出级传信号(ST(N))；
所述上拉模块(300)包括第二十二薄膜晶体管(T22)，所述第二十二薄膜晶体管(T22)的栅极电性连接于第二十一薄膜晶体管(T21)的漏极，源极接入恒压高电位(VDD)，漏极输出扫描驱动信号(G(N))；
所述第一下拉模块(400)包括第三十一薄膜晶体管(T31)与第三十二薄膜晶体管(T32)；所述第三十一薄膜晶体管(T31)的栅极接入下一级第N+1级GOA单元电路的级传信号(ST(N+1))，源极电性连接于扫描驱动信号(G(N))，漏极电性连接于恒压低电位(VSS)；所述第三十二薄膜晶体管(T32)的栅极接入与下一级第N+1级GOA单元电路对应的第m+1组时钟信号(CK(m+1))，源极电性连接于扫描驱动信号(G(N))，漏极电性连接于恒压低电位(VSS)；
所述第二下拉模块(500)包括第五十一薄膜晶体管(T51)，所述第五十一薄膜晶体管(T51)的栅极接入下一级第N+1级GOA单元电路的级传信号(ST(N+1))，源极电性连接于第一节点(Q(N))，漏极电性连接于恒压低电位(VSS)；
所述自举电容模块(600)包括第一电容(C1)，所述第一电容(C1)的一端电性连接于第一节点(Q(N))，另一端电性连接于第二十一薄膜晶体管(T21)的漏极；
所述下拉维持模块(700)包括第四十一薄膜晶体管(T41)、第六十一薄膜晶体管(T61)、第五十二薄膜晶体管(T52)、第二电容(C2)、及第三十三薄膜晶体管(T33)；所述第六十一薄膜晶体管(T61)的栅极电性连接于第一节点(Q(N))，源极电性连接于第二节点(P(N))，漏极电性连接于恒压低电位(VSS)；所述第四十一薄膜晶体管(T41)的栅极电性连接于第二节点(P(N))，源极电性连接于级传信号(ST(N))，漏极电性连接于恒压低电位(VSS)；所述第五十二薄膜晶体管(T52)的栅极电性连接于第二节点(P(N))，源极电性连接于第一节点(Q(N))，漏极电性连接于恒压低电位(VSS)；所述第二电容(C2)的一端电性连接于对应该第N级GOA单元电路的第m组时钟信号(CK(m))，另一端电性连接于第二节点(P(N))；所述第三十三薄膜晶体管(T33)的栅极电性连接于第二节点(P(N))，源极电性连接于扫描驱动信号(G(N))，漏极电性连接于恒压低电位(VSS)。
3.如权利要求1所述的降低功耗的GOA电路，其特征在于，所述第m组时钟信号(CK(m))的高电位为15V；所述恒压高电位(VDD)为25V。
4.如权利要求3所述的降低功耗的GOA电路，其特征在于，所述第m组时钟信号(CK(m))的低电位与所述恒压低电位(VSS)均为-7V。
5.如权利要求2所述的降低功耗的GOA电路，其特征在于，第一级GOA单元电路中，所述第十一薄膜晶体管(T11)的栅极与源极均接入扫描启动信号(STV)。
6.如权利要求2所述的降低功耗的GOA电路，其特征在于，最后一级GOA单元电路中，所述第三十一薄膜晶体管(T31)的栅极与第五十一薄膜晶体管(T51)的栅极均接入扫描启动信号(STV)。
7.如权利要求1所述的降低功耗的GOA电路，其特征在于，包括两组时钟信号:第一组时钟信号(CK(1))、与第二组时钟信号(CK(2))；当所述第m组时钟信号(CK(m))为第二组时钟信号(CK(2))时，所述第m+1组时钟信号(CK(m+1))为第一组时钟信号(CK(1))。
8.如权利要求2所述的降低功耗的GOA电路，其特征在于，所述第二十一薄膜晶体管(T21)的沟道宽度为500μm，第二十二薄膜晶体管(T22)的沟道宽度为2000μm。
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