CN103177680B - 显示控制器、图像数据处理系统及处理显示数据的方法 - Google Patents

显示控制器、图像数据处理系统及处理显示数据的方法 Download PDF

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Abstract

一种显示控制器包括：同步信号调整电路，其调整在显示驱动器中生成的同步信号的延迟和脉冲宽度中的至少一个，并输出调整后的同步信号；以及发送时序控制电路，其被配置成响应于调整后的同步信号控制将要被发送到显示驱动器的显示数据的发送时序。

Description

显示控制器、图像数据处理系统及处理显示数据的方法
相关申请的交叉引用
本申请要求享有于2011年12月20日提交的韩国专利申请No.10-2011-0137953的优先权，该韩国专利申请通过引用方式全部并入本文。
技术领域
本发明构思的实施例涉及一种半导体器件，并且更具体地涉及可以调整同步信号的延迟和脉冲宽度中的至少一个以防止撕裂和闪烁的器件及其方法。
背景技术
随着诸如智能电话机或平板个人计算机（PC）之类的便携式设备的显示分辨率的提高，存储器访问的带宽需求也随之增加。随着分辨率的提高，便携式设备的功耗也倾向于增加。
相应地，需要一种用于降低便携式设备的功耗的方法。并且，当便携式设备的显示分辨率提高时，可能在显示在显示器上的图像屏幕上出现闪烁。
发明内容
本发明的一个方面致力于提供一种显示控制器，所述显示控制器包括：调整电路，其被配置成（基于接收到的用于调整同步信号的信息）调整在显示驱动器中生成的所述同步信号的延迟和脉冲宽度中的至少一个，并输出调整后的同步信号；以及发送时序控制电路，其被配置成响应于所述调整后的同步信号来控制要被发送到所述显示驱动器的显示数据的发送时序。
所述同步信号可以是与所述显示数据的发送有关的信号。所述调整电路包括：信息寄存器，其被配置成存储所述用于调整所述同步信号的信息；以及调整逻辑电路，其被配置成调整所述同步信号的延迟和脉冲宽度中的至少一个。
所述发送时序控制电路响应于所述调整后的同步信号的上升沿和下降沿中的一个向所述显示驱动器发送所述显示数据。
所述显示控制器还包括：发送接口，其被配置成响应于所述调整后的同步信号的上升沿和下降沿中的一个准备发送所述显示数据，并且响应于所述上升沿和所述下降沿中的另一个向所述显示驱动器发送所述显示数据。
所述发送接口可以是CPU接口、RGB接口或串行接口。所述发送接口可以是移动显示数字接口（MDDI）、移动行业处理器接口串行外围接口（SPI）、IC间（I2C）接口、显示端口（DP）或嵌入式显示端口（eDP）。
所述显示控制器还包括：时序控制器，其被配置成响应于所述调整后的同步信号的上升沿和下降沿中的一个而生成第一控制信号，并且响应于所述上升沿和所述下降沿中的另一个而生成第二控制信号；以及发送接口，其被配置成响应于所述第一控制信号准备发送所述显示数据，并且响应于所述第二控制信号向所述显示驱动器发送所述显示数据。
所述发送时序控制电路生成差信息，所述差信息与所述调整后的同步信号的电平转变时序和所控制的转变时序之间的差相对应，并且所述调整电路通过将所述差信息用作所述用于调整所述同步信号的信息来调整所述同步信号。
所述调整电路包括：被配置成存储所述差信息的寄存器；延迟调整电路，其被配置成通过将所述差信息用作所述用于调整所述同步信号的信息来调整所述同步信号的延迟；以及脉冲宽度调整电路，其被配置成通过将所述差信息用作所述用于调整所述同步信号的信息来调整从所述延迟调整电路输出的已调整延迟的同步信号的脉冲宽度，并生成所述调整后的同步信号。
本发明构思的一个方面致力于提供一种图像数据处理系统，所述图像数据处理系统包括显示控制器，所述显示控制器包括：调整电路，其（基于接收到的用于调整同步信号的信息）调整在显示驱动器中生成的所述同步信号的延迟和脉冲宽度中的至少一个，并输出调整后的同步信号；以及发送时序控制电路，其响应于所述调整后的同步信号来控制要被发送到所述显示驱动器的显示数据的发送时序。
根据示例性实施例，所述调整电路可以被实现在所述显示驱动器的内部。根据可替换的示例性实施例，所述调整电路可以被实现在所述显示控制器的内部。
所述调整电路包括：寄存器；以及调整逻辑电路，其通过使用存储在所述寄存器中的信息（即，所述用于调整所述同步信号的信息）来调整所述延迟和所述脉冲宽度中的至少一个。
本发明构思的一个方面致力于提供一种便携式设备的显示数据处理方法，包括：接收同步信号，所述同步信号是从显示驱动器输出的并且与显示数据的发送有关；调整所述同步信号的延迟和脉冲宽度中的至少一个并生成调整后的同步信号；响应于所述调整后的同步信号（基于接收到的用于调整所述同步信号的信息）调整所述显示数据的发送时序，并向所述显示驱动器发送已控制发送时序的显示数据；以及处理所述显示数据并在显示器上显示处理后的显示数据。
生成所述调整后的同步信号的步骤通过使用从显示控制器输出的用于调整所述发送时序的信息来调整所述延迟和所述脉冲宽度中的至少一个，并生成所述调整后的同步信号。
所述用于调整所述同步信号的信息可以是根据所述调整后的同步信号的电平转变时序与调整后的发送时序之间的差而确定的信息。
所述便携式设备可以是蜂窝电话机、智能电话机和平板PC中的一个。
本发明构思的另一个方面致力于提供一种便携式设备的显示数据处理方法，包括：在CPU中检测模式改变命令；向显示驱动器发送与检测结果相对应的控制信号；接收同步信号，所述同步信号是从所述显示驱动器输出的并且与显示数据的发送有关；（基于所接收到的用于调整所述同步信号的信息）调整所述同步信号的延迟和脉冲宽度中的至少一个，并生成调整后的同步信号；响应于所述调整后的同步信号调整所述显示数据的发送时序，并向所述显示驱动器发送已调整发送时序的显示数据；以及处理所述显示数据并在显示器上显示处理后的显示数据。所述同步信号是基于控制信号生成的。生成所述调整后的同步信号的步骤通过使用从显示控制器输出的用于调整所述发送时序的信息来调整所述延迟和所述脉冲宽度中的至少一个，并生成所述调整后的同步信号。
现在将在下文中参照附图来更充分地描述本发明构思的示例性实施例。然而，这些示例性实施例可以以许多不同的形式实现，并且不应当被解释成限于本文给出的实施例。在附图中，为了清楚起见，可以夸大层和区域的尺寸以及相对尺寸。在全文中，相同的数字表示相同的元件。
将理解的是，当提及一个元件是“连接”或“耦合”到另一个元件的时，其可以是直接地连接或耦合到另一元件，或者可以存在中间元件。
根据本发明构思的各个示例性实施例的、可以调整同步信号的延迟和脉冲宽度中的至少一个的调整电路可以被实现在显示控制器内部、实现在显示控制器与显示驱动器之间、或者实现在显示驱动器内部。
附图说明
通过参照所附的附图详细地描述本发明构思的示例性实施例，本发明构思的实施例将变得更加明显，在附图中：
图1是根据本发明构思的示例性实施例的图像数据处理系统的方框图；
图2是图1中所示的调整电路的方框图；
图3是示出了图2中的调整电路的示例性操作的时序图；
图4是示出了图2中的调整电路的另一示例性操作的时序图；
图5是图1中所示的时序控制器的方框图；
图6是示出了图1中所示的调整电路和发送时序控制电路的示例性操作的时序图；
图7是示出了图1中所示的调整电路和发送时序控制电路的其它示例性操作的另一时序图；
图8是根据本发明构思的另一示例性实施例的图像数据处理系统的方框图；
图9是根据本发明构思的再一示例性实施例的图像数据处理系统的方框图；
图10是用于解释图1、图8或图9中所示的图像数据处理系统的操作的方法的流程图；
图11是根据本发明构思的示例性实施例的包括显示控制器的图像数据处理系统的方框图；以及
图12是用于解释根据本发明构思的示例性实施例的、图12中的图像数据处理系统的操作的方法的流程图，所述操作可以检测模式改变命令。
具体实施方式
图1是根据本发明构思的示例性实施例的图像数据处理系统的方框图。参照图1，该图像数据处理系统10A包括应用处理器100、外部存储器160、显示驱动器200和显示器300。可以用不同的芯片实现每个元件100、160和200。
根据用分开的芯片实现应用处理器100和显示驱动器200的示例性实施例，可以用模块、片上系统或封装（例如，多芯片封装、系统级封装（SiP）或叠加封装（PoP））实现应用处理器100和显示驱动器200。根据用分开的芯片实现应用处理器100和显示处理器200的另一示例性实施例，可以用模块实现显示驱动器200和显示器300。
可以在个人计算机（PC）或便携式设备中实现图像数据处理系统10A。
便携式设备可以被实现成膝上型计算机、蜂窝电话机、智能电话机、平板PC、个人数字助理（PDA）、便携式多媒体播放器（PMP）、MP3播放器或车辆自动导航系统。
应用处理器100控制外部存储器160和/或显示驱动器200。应用处理器100接收同步信号DSYNC，调整同步信号DSYNC的延迟和同步信号DSYNC的脉冲宽度中的至少一个以生成并输出调整后的同步信号ADSYNC，其中，同步信号DSYNC是从显示驱动器200的同步信号生成电路210输出的并与显示数据DDATA的发送有关。应用处理器100还基于调整后的同步信号ADSYNC来调整显示数据DDATA的发送时序。
从而，为了消除撕裂和闪烁，应用处理器100调整同步信号DSYNC的延迟和同步信号DSYNC的脉冲宽度中的至少一个，以生成并输出调整后的同步信号ADSYNC，并且响应于调整后的同步信号ADSYNC调整显示数据DDATA的发送时序。这里，撕裂或屏幕撕裂是指当在显示器中在屏幕上显示与两个或更多不同帧相对应的图像数据时出现的视觉伪影。
应用处理器100包括中央处理单元（CPU）110、存储器控制器112和显示控制器120A，它们通过内部总线101彼此通信。
应用处理器100的CPU 110通常控制应用处理器100的操作。
在CPU 110的控制下，存储器控制器112通过内部总线101向显示控制器120A发送从外部存储器160接收到的图像数据，例如运动图像数据或静止图像数据。外部存储器160可以被实现成诸如动态随机存取存储器（DRAM）之类的易失性存储器设备或者被实现成诸如NAND闪存之类的非易失性存储器。
在CPU 110的控制下，显示控制器120A调整从显示驱动器200输出的同步信号SDYNC的延迟和脉冲宽度中的至少一个，并响应于调整后的同步信号ADSYNC来调整显示数据（例如，运动图像数据或静止图像数据）的发送时序。
此外，显示控制器120A控制与显示数据DDATA的发送有关的至少一个同步信号的发送时序。可以在数据中或者在适合于数据发送（TX）接口143的协议的数据分组中包含显示数据DDATA。
显示控制器120A包括调整电路130、发送时序控制电路140以及图像处理逻辑电路150。
调整电路130接收并调整从显示驱动器200接收到的同步信号DSYNC，并输出调整后的同步信号ADSYNC。例如，同步信号DSYNC可以是用于消除撕裂的控制信号，例如撕裂效果控制信号。
例如，CPU 110可以检测模式改变命令，并通过显示控制器120A向显示驱动器200发送与检测结果相对应的控制信号。这里，显示驱动器200的同步信号生成电路210响应于该控制信号生成同步信号DSYNC。
模式改变命令可以通过用户的手势（例如，触摸、按压按钮、语音或手势）从外围设备（未示出）生成。例如，模式改变命令可以是用于从第一模式改变到第二模式的命令。例如，第一模式可以是向显示驱动器200发送静止图像数据的模式，而第二模式可以是向显示驱动器200发送运动图像数据的模式。
此外，第一模式可以是睡眠模式，并且第二模式可以是正常模式。睡眠模式可以是应用处理器100和显示驱动器200不处理图像数据的模式，并且正常模式可以是应用处理器100和显示驱动器200处理图像数据的模式。
图2是图1中所示的调整电路的方框图。调整电路130调整接收到的同步信号DSYNC的延迟和脉冲宽度中的至少一个。例如，可以基于输入到调整电路130的包括差信息InF的控制信号来调整延迟和脉冲宽度。
调整电路130包括信息寄存器130-1、延迟调整逻辑电路130-2和脉冲宽度调整逻辑电路103-3。例如，调整逻辑电路包括延迟调整逻辑电路130-2和脉冲宽度调整逻辑电路103-3。存储在信息寄存器130-1中的信息可以由显示控制器120A设置。可以从外部接收以及编程存储在信息寄存器130-1中的信息。
图3是示出了图2中的调整电路的示例性操作的时序图。图4是示出了图2中的调整电路的另一示例性操作的另一时序图。
可以响应于从信息寄存器130-1输出的使能信号EN来使能或禁止延迟调整逻辑电路130-2和脉冲宽度调整逻辑电路103-3。例如，当使能信号EN是第一值（例如，逻辑0或低电平）时，延迟调整逻辑电路130-2和脉冲宽度调整逻辑电路103-3变为被禁止。当被禁止时，延迟调整逻辑电路130-2和脉冲宽度调整逻辑电路103-3可以传递同步信号DSYNC而不进行调整（如图3中所示的），或者可以拦截（或阻止）同步信号DSYNC（如图4中所示的）。
然而，当使能信号EN是第二值（例如，逻辑1或高电平）时，延迟调整逻辑电路130-2和脉冲宽度调整逻辑电路103-3变为使能。相应地，延迟调整逻辑电路130-2基于从信息寄存器130-1输出的延迟调整信息DI来调整同步信号DSYNC的延迟DELAY，并输出延迟被调整的同步信号。这里，延迟调整信息DI包括一个比特或多个比特。
脉冲宽度调整逻辑电路103-3基于从信息寄存器130-1输出的脉冲宽度调整信息WI来调整从延迟调整逻辑电路130-2输出的信号的脉冲宽度WIDTH，并输出最终的调整后的同步信号ADSYNC。这里，脉冲宽度调整信息WI包括一个比特或多个比特。
在图2、图3、图4、图6和图7中，信息寄存器130-1存储用于调整同步信号DSYNC的延迟DELAY和同步信号DSYNC的脉冲宽度WIDTH中的至少一个的信息，例如差信息InF。如上面所描述的，所述信息（例如差信息InF）包括延迟调整信息DI和脉冲宽度调整信息WI，其中延迟调整信息DI可以调整同步信号DSYNC的延迟，脉冲宽度调整信息WI可以调整同步信号DSYNC的脉冲宽度。
为了便于解释，在图2中示出了存储差信息InF的信息寄存器130-1；然而，根据可替换的实施例，当调整电路130不包括信息寄存器130-1时，延迟调整逻辑电路130-2直接根据从时序控制器141输出的差信息InF中所包括的延迟调整信息DI来调整同步信号DSYNC的延迟DELAY。此外，脉冲宽度调整逻辑电路103-3可以直接根据从时序控制器141输出的差信息InF中所包括的脉冲宽度调整信息WI来调整同步信号的脉冲宽度WIDTH。
调整电路130向时序控制器141发送调整后的同步信号ADSYNC。
发送时序控制电路140响应于从调整电路130输出的调整后的同步信号ADSYNC而控制将要向显示驱动器200发送的显示数据DDATA的发送时序。
发送时序控制电路140包括时序控制器141和发送TX接口143。时序控制器141响应于调整后的同步信号ADSYNC的上升沿和下降沿中的一个（例如，上升沿）生成第一控制信号CTRL1，并响应于上升沿和下降沿中的另一个（例如，下降沿）生成第二控制信号CTRL2。
图5是图1的图像数据处理系统10A中的时序控制器141的方框图。时序控制器141的控制信号生成器141-1生成第一控制信号CTRL1和第二控制信号CTRL2。
图像处理逻辑电路150和发送TX接口143响应于第一控制信号CRTL1的电平转变而准备发送显示数据DDATA。
发送接口143根据第二控制信号CTRL2向显示驱动器200的接收RX接口220发送从图像处理逻辑电路150输出的显示数据DDATA。根据示例性实施例，以低功率接口实现的发送TX接口143可以用CPU接口、RGB接口或串行接口实现。根据另一示例性实施例，发送TX接口143可以用移动显示数字接口（MDDI）、移动行业处理器接口串行外围接口（SPI）、IC间（I2C）接口、显示端口（DP）或嵌入式显示端口（eDP）实现。
接收RX接口220可以用与发送TX接口143相同的接口实现。发送TX接口143向时序控制器141发送针对显示数据DDATA的发送时序的信息TI。
时序控制器141的差信息生成器141-2通过使用针对调整后的同步信号ADSYNC的时序的信息以及针对显示数据DDATA的发送时序的信息TI生成差信息InF，并将所生成的差信息InF写入或存储在调整电路130的信息寄存器130-1中。如上面所描述的，可以将差信息InF直接输入到调整逻辑电路130。
差信息InF可以包括延迟调整信息DI和/或脉冲宽度调整信息WI，它们作为与调整后的同步信号ADSYNC的时序和显示数据DDATA的发送时序之间的差相对应的信息。相应地，调整电路130可以调整脉冲信号DSYNC的延迟和脉冲宽度中的至少一个。
显示驱动器200接收并处理从显示控制器120A发送的显示数据DDATA，并向显示器300发送处理后的显示数据DDATA2。显示驱动器200包括同步信号生成电路210，其可以生成同步信号DSYNC。将参考图9详细地描述显示驱动器200的示例性实现的详细结构和操作。
显示器300可以被实现成液晶显示器（LCD）、发光二极管（LED）显示器、有机LED（OLED）显示器或有源矩阵OLED（AMOLED）显示器或者其它类型的显示器。
图6是示出了图1中所示的调整电路130和发送时序控制电路140的示例性操作的时序图。并且图7是示出了图1中所示的调整电路和发送时序控制电路的其它示例性操作的另一时序图。
参考图1到图7，调整电路130在第一时间点T1接收具有脉冲宽度P1的同步信号DSYNC，根据存储在信息寄存器130-1中的信息或差信息InF来调整同步信号DSYNC的延迟DELAY和脉冲宽度WIDTH中的至少一个，并生成调整后的同步信号ADSYNC。
时序控制器141的控制信号生成器141-1检测调整后的同步信号ADSYNC的电平转变，并基于检测结果生成第一控制信号CTRL1和第二控制信号CTRL2。
如图6和图7中所示的，控制信号生成器141-1在第二时间点T2响应于调整后的同步信号ADSYNC的上升沿而生成第一控制信号CTRL。这里，图像处理逻辑电路150和发送接口143基于激活的第一控制信号CTRL1准备发送显示数据DATA。之后，发送接口143在第三时间点T3基于激活的第二控制信号CTRL2向显示驱动器200发送显示数据DATA。因而，发送接口143在第三时间点T3响应于调整后的同步信号ADSYNC的下降沿而向显示驱动器200发送显示数据DATA。
如图7的情况I中所示的，在调整后的同步信号ADSYNC在第二时间点T2从低电平转变到高电平之后，一旦经过了显示数据输出时间DOT，即，当在第三时间点T3从显示控制器120A向显示驱动器200输出显示数据DATA（例如，运动图像数据）时，假定在显示器300中没有出现撕裂和闪烁。
另外，假定显示数据输出时间DOT为固定时间。因而，当将从显示控制器120A输出的显示数据DDATA从静止图像数据转换成运动图像数据时，很有可能已经出现了闪烁。
参考图7的情况II，由于显示数据DDATA（例如，运动图像数据）是从时间点T3”开始输出的，所以在显示器300中可能出现撕裂和闪烁。相应地，为了消除撕裂和闪烁，显示控制器120A应当将显示数据DDATA的输出时间点从T3”调整为T3。
调整电路130通过使用存储在信息寄存器130-1中的信息或差信息InF而将调整后的同步信号ADSYNC的生成时间点从T2”调整为T2。例如，当调整电路130调整同步信号DSYNC的在图6中的延迟DT1或DELAY时，发送时序控制电路140可以基于延迟被调整的同步信号ADSYNC正好在时间点T3输出显示数据DDATA。
参考图7的情况III，由于显示数据DDATA（例如，运动图像数据）是从时间点T3’开始输出的，所以在显示器300中可能出现撕裂和闪烁。相应地，为了消除撕裂和闪烁，显示控制器120A应当将显示数据DDATA的输出时间点从T3’调整为T3。
通过使用存储在信息寄存器130-1中的信息或差信息InF，调整电路130可以将调整后的同步信号ADSYNC的生成时间点从T2’调整为T2。例如，当调整电路130调整同步信号DSYNC的在图6中的延迟DT2或DELAY时，发送时序控制电路140可以基于延迟被调整的同步信号ASDYNC正好在时间点T3输出显示数据DDATA。
可以在每个帧处更新差信息InF。相应地，显示控制器120A可以通过使用关于先前帧的差信息InF来调整与当前帧相对应的显示数据DDATA的发送时序。
图8是根据本发明构思的另一示例性实施例的图像数据处理系统的方框图。参考图1和图8，除了调整电路130存在于显示控制器120B与显示驱动器200之间以外，图8中的图像数据处理系统10B的结构基本上与图1中的图像处理系统10A的结构相同。为了便于解释，图8并没有多余地示出每个其它元件101、110、112和160。
显示控制器120B的发送时序控制电路140基于延迟DELAY和/或脉冲宽度WIDTH被控制电路130调整了的同步信号ADSYNC，控制发送到显示驱动器200的显示数据DDATA的发送时序。
图9是根据本发明构思的另一示例性实施例的图像数据处理系统的方框图。除了调整电路130位于显示驱动器200C的内部以外，图9中的图像数据处理系统10C的结构基本上与图1中的图像数据处理系统10A的结构相同。
显示驱动器200C包括调整电路130、同步信号生成电路210、接收RX接口220、控制电路230、多个开关241和243、帧缓冲器250、存储器控制器251、选择电路260以及输出电路270。
同步信号生成电路210基于通过接收接口220输入的数据或从控制电路230输出的控制信号生成同步信号DSYNC。
控制电路230根据通过接收接口220输入的显示数据DDATA生成多个开关控制信号SW1和SW2、访问控制信号ACC和选择信号SEL。
第一开关241响应于第一开关控制信号SW1向选择电路260发送显示数据DDATA（例如，运动图像数据）。第一开关241执行对运动图像（视频）数据的发送进行控制的控制电路的功能。第二开关243响应于第二开关控制信号SW2向帧缓冲器250发送显示数据DDATA（例如，静止图像数据）。第二开关243执行对静止图像（照片）数据的发送进行控制的控制电路的功能。
因而，通过选择电路260而不通过帧缓冲器250向输出电路270发送具有第一帧速率的运动图像（视频）数据或显示数据。通过帧缓冲器250和选择电路260向输出电路270发送具有第二帧速率的静止图像数据或显示数据。因而，分别通过不同的数据路径向输出电路270发送运动图像（视频）数据和静止图像（照片）数据。
第一帧速率大于第二帧速率。例如，可以基于某个帧速率（例如，30个帧/秒（fps））来对第一帧速率和第二帧速率进行分类。
存储器控制器251基于访问控制信号ACC来控制对帧缓冲器250的数据访问操作，例如数据写入操作或数据读取操作。帧缓冲器250可以实现在图形存储器中。
选择电路（MUX）260基于选择信号SEL向输出电路270发送显示数据，例如通过第一路径（即，第一开关241）发送的视频数据，或从第二路径（即，帧缓冲器250）输出的静止图像数据。选择电路260可以被实现成复用器。
输出电路270对从选择电路260输出的显示数据进行处理，并向显示器300发送处理后的显示数据DDATA2。
图10是用于解释图1、图8或图9中所示的图像数据处理系统的操作的方法的流程图。参考图1到图10，调整电路130接收与显示数据DDATA的发送有关的同步信号DSYNC（S10）。
如图6或图7中所示的，调整电路130调整同步信号DSYNC的延迟DELAY和脉冲宽度WIDTH中的至少一个，并输出延迟DELAY和/或脉冲宽度WIDTH被调整的同步信号ADSYNC（在步骤S20中）。根据示例性实施例，调整电路130可以通过使用存储在信息寄存器130-1中的信息或差信息InF来调整延迟DELAY和脉冲宽度WIDTH中的至少一个。
如图6或图7中所示的，发送时序控制电路140可以响应于调整后的同步信号ADSYNC控制显示数据DDATA的发送时序（在步骤S30中）。发送时序控制电路140基于调整后的发送时序向显示驱动器200发送显示数据DDATA（在步骤S40中）。显示驱动器200处理显示数据DDATA，向显示器300发送处理后的显示数据DDATA2，并且显示器300显示处理后的显示数据DDATA2（在步骤S50中）。
图11是根据本发明构思的示例性实施例的包括显示控制器的图像数据处理系统的方框图。参考图11，图像数据处理系统400可以实现在可以使用或支持的便携式设备中，如个人数字助理（PDA）、便携式媒体播放器（PMP）、蜂窝电话机、智能电话机或平板个人计算机。
图像数据处理系统400包括应用处理器410、图像传感器420和显示器430。
实现在应用处理器410中的照相机串行接口（CSI）主机412可以通过照相机串行接口CSI执行与图像传感器420的CSI设备421的串行通信。根据示例性实施例，解串行化器（DES）可以实现在CSI主机412中，并且串行化器（SER）可以实现在CSI设备421中。实现在应用处理器410中的显示串行接口（DSI）主机411可以通过显示串行接口执行与显示器430的DSI设备的串行通信。根据示例性实施例，串行化器（SER）可以实现在DSI主机411中，并且解串行化器（DES）可以实现在DSI设备43 1中。
图像数据处理系统400还可以包括RF芯片440，其可以与应用处理器410进行通信。图像数据处理系统400的PHY 413和RF芯片440的PHY 441可以根据MIPI DigRF协议发送或接收数据。
图像数据处理系统400可以包括GPS 450接收机、诸如动态随机存取存储器（DRAM）之类的存储器452、用非易失性存储器（例如，NAND闪存）实现的数据存储设备454、麦克风456或扬声器458。
此外，图像数据处理系统400可以通过使用至少一个通信协议或通信标准（例如，超宽带（UWB）460、无线LAN（WLAN）462、全球微波接入互通（WiMAX）464或长期演进（LTETM））与外部设备进行通信。
根据可替换的实施例，DSI主机411可以执行图1中的显示控制器120A的功能。根据另一可替换的实施例，可以将调整电路130实现在DSI主机411的外部。根据再一可替换的实施例，可以将调整电路130实现在DSI设备431的内部，其中DSI设备431可以执行显示驱动器200的功能。
图12是用于解释根据本发明构思的示例性实施例的、图像数据处理系统的检测模式改变命令的操作方法的流程图。参考图1到图12，CPU 110检测模式改变命令，并向显示驱动器200发送与检测结果相对应的控制信号（在步骤S110中）。显示驱动器200响应于该控制信号生成同步信号DSYNC（在步骤S120中）。同步信号DSYNC是与显示数据DDATA的发送有关的信号。调整电路130接收同步信号DSYNC（在步骤S130中）。
图12中的步骤S20到S50中的每一个与图10中的每个相应的步骤S20到S50相同。根据本发明构思的示例性实施例的设备及其方法可以调整同步信号的延迟和脉冲宽度中的至少一个，并输出调整后的同步信号，使得显示控制器可以基于调整后的同步信号以精确的时序向显示驱动器输出运动图像（视频）数据。
相应地，该设备和方法可以防止或消除在将显示数据从静止图像转换成运动图像（视频）数据时可能出现的撕裂和闪烁。
虽然已经示出并描述了当前的总发明构思的示例性实施例，但是本领域技术人员将清楚的是，可以在不脱离总发明构思的原理和精神的情况下，在这些实施例中进行改变，其中总发明构思的范围由所附权利要求及其等同形式限定。

Claims (26)

1.一种显示控制器，包括：
调整电路，其被配置成基于用于调整同步信号的信息调整在显示驱动器中生成的所述同步信号的延迟和脉冲宽度中的至少一个，并被配置成输出调整后的同步信号；以及
发送时序控制电路，其被配置成响应于所述调整后的同步信号控制要被发送到所述显示驱动器的显示数据的发送时序。
2.如权利要求1所述的显示控制器，其中，所述同步信号是与所述显示数据的发送有关的信号。
3.如权利要求1所述的显示控制器，其中，所述调整电路包括：
信息寄存器，其被配置成存储所述用于调整所述同步信号的信息；以及
调整逻辑电路，其被配置成通过使用所述信息来调整所述同步信号的所述延迟和所述脉冲宽度中的所述至少一个。
4.如权利要求1所述的显示控制器，其中，所述发送时序控制电路响应于所述调整后的同步信号的上升沿和下降沿中的一个而向所述显示驱动器发送所述显示数据。
5.如权利要求1所述的显示控制器，还包括：
发送接口，其被配置成响应于所述调整后的同步信号的上升沿和下降沿中的一个而准备发送所述显示数据，并响应于所述上升沿和所述下降沿中的另一个而向所述显示驱动器发送所述显示数据。
6.如权利要求5所述的显示控制器，其中，所述发送接口是CPU接口、RGB接口或串行接口。
7.如权利要求5所述的显示控制器，其中，所述发送接口是移动显示数字接口(MDDI)、移动行业处理器接口串行外围接口(SPI)、内部IC(I2C)接口、显示端口(DP)或嵌入式显示端口(eDP)。
8.如权利要求1所述的显示控制器，还包括：
时序控制器，其被配置成响应于所述调整后的同步信号的上升沿和下降沿中的一个而生成第一控制信号，并响应于所述上升沿和所述下降沿中的另一个而生成第二控制信号；以及
发送接口，其被配置成响应于所述第一控制信号而准备发送所述显示数据，并且响应于所述第二控制信号而向所述显示驱动器发送所述显示数据。
9.如权利要求1所述的显示控制器，其中，所述发送时序控制电路生成与所述调整后的同步信号的电平转变时序和调整后的发送时序之间的差相对应的差信息，并且
其中，所述调整电路通过将所述差信息用作所述用于调整所述同步信号的信息来调整所述同步信号。
10.如权利要求9所述的显示控制器，其中，所述调整电路包括：
寄存器，其被配置成存储所述差信息；以及
延迟调整电路，其被配置成通过将所述差信息用作所述用于调整所述同步信号的信息来调整所述同步信号的延迟；以及
脉冲宽度调整电路，其被配置成通过将所述差信息用作所述用于调整所述同步信号的信息来调整从所述延迟调整电路输出的已调整延迟的同步信号的脉冲宽度，并生成所述调整后的同步信号。
11.一种图像数据处理系统，包括：
调整电路，其被配置成基于用于调整同步信号的信息来调整在显示驱动器中生成的所述同步信号的延迟和脉冲宽度中的至少一个，并输出调整后的同步信号；以及
显示控制器，其包括发送时序控制电路，所述发送时序控制电路被配置成响应于所述调整后的同步信号控制将要被发送到所述显示驱动器的显示数据的发送时序。
12.如权利要求11所述的系统，其中，所述调整电路被实现在所述显示驱动器的内部。
13.如权利要求11所述的系统，其中，所述调整电路被实现在所述显示控制器的内部。
14.如权利要求11所述的系统，其中，所述调整电路包括：
寄存器，用于存储所述用于调整所述同步信号的信息；以及
调整逻辑电路，其被配置成通过使用存储在所述寄存器中的所述信息来调整所述延迟和所述脉冲宽度中的至少一个。
15.如权利要求11所述的系统，其中，所述显示控制器还包括发送接口，所述发送接口被配置成响应于所述调整后的同步信号的上升沿和下降沿中的一个而准备发送所述显示数据，并且响应于所述上升沿和所述下降沿中的另一个而向所述显示驱动器发送所述显示数据。
16.如权利要求11所述的系统，其中，所述发送时序控制电路生成与所述调整后的同步信号的电平转变时序和所控制的发送时序之间的差相对应的差信息，
其中，所述调整电路包括：
寄存器，其被配置成存储所述差信息；
延迟调整电路，其被配置成通过将所述差信息用作所述用于调整所述同步信号的信息来调整所述同步信号的延迟；以及
脉冲宽度调整电路，其被配置成通过将所述差信息用作所述用于调整所述同步信号的信息来调整从所述延迟调整电路输出的已调整延迟的同步信号的脉冲宽度，并且生成所述调整后的同步信号。
17.一种便携式设备的用于处理显示数据的方法，包括：
接收同步信号，所述同步信号是从显示驱动器输出的并且与显示数据的发送有关；
基于用于调整所述同步信号的信息来调整所述同步信号的延迟和脉冲宽度中的至少一个，并生成调整后的同步信号；
响应于所述调整后的同步信号调整所述显示数据的发送时序，并向所述显示驱动器发送已调整发送时序的显示数据；以及
对已调整时序的显示数据进行处理，并在显示器上显示处理后的显示数据。
18.如权利要求17所述的方法，其中，所述用于调整所述同步信号的信息是从显示控制器输出的，并且其中，生成所述调整后的同步信号的步骤通过使用从所述显示控制器输出的所述信息来调整所述延迟和所述脉冲宽度中的至少一个以调整所述发送时序，并生成所述调整后的同步信号。
19.如权利要求18所述的方法，其中，所述用于调整所述同步信号的信息是基于所述调整后的同步信号的电平转变时序与调整后的发送时序之间的差确定的。
20.如权利要求17所述的方法，其中，所述便携式设备是蜂窝电话机、智能电话机和平板个人计算机中的一种。
21.一种便携式设备的用于处理显示数据的方法，包括：
在CPU中检测模式改变命令，并向显示驱动器发送与检测结果相对应的控制信号；
接收同步信号，所述同步信号是从所述显示驱动器输出的并且与显示数据的发送有关；
基于用于调整所述同步信号的信息来调整所述同步信号的延迟和脉冲宽度中的至少一个，并生成调整后的同步信号；
响应于所述调整后的同步信号调整所述显示数据的发送时序，并向所述显示驱动器发送已控制发送时序的显示数据；以及
对所述已控制发送时序的显示数据进行处理，并在显示器上显示处理后的显示数据，
其中，所述同步信号是基于所述控制信号生成的。
22.如权利要求21所述的方法，其中，生成所述调整后的同步信号的步骤通过使用从显示控制器输出的用于调整所述同步信号的信息来调整所述延迟和所述脉冲宽度中的至少一个以调整所述发送时序，并生成所述调整后的同步信号。
23.一种显示控制器，包括：
调整电路，其被配置成接收从显示驱动器输出的同步信号，其中，所述同步信号是与正从所述显示驱动器向显示器发送的显示数据的发送有关的信号，
其中，所述调整电路还被配置成基于用于调整同步信号的信息来调整在所述显示驱动器中生成的所述同步信号的延迟和脉冲宽度中的至少一个，并被配置成输出调整后的同步信号。
24.如权利要求23所述的显示控制器，还包括：
发送时序控制电路，其被配置成响应于所述调整后的同步信号来控制将要从所述显示控制器发送到所述显示驱动器的所述显示数据的发送时序。
25.如权利要求24所述的显示控制器，其中，所述发送时序控制电路生成与所述调整后的同步信号的电平转变时序和所述发送时序之间的差相对应的差信息。
26.如权利要求25所述的显示控制器，其中，所述调整电路通过将所述差信息用作所述用于调整所述同步信号的信息来调整所述同步信号。
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