CN102497710B - Led移相调光电路及其方法 - Google Patents
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Abstract
本发明公开了一种LED移相调光电路及其方法。该移相调光电路根据输入PWM信号的上升沿和下降沿分别产生至少一个置位信号和至少一个复位信号，并输出多个彼此间具有相位差的PWM移相信号，同时，该移相调光电路还可改变输出PWM延时信号的占空比。该移相调光电路成本低廉，且可任意调节PWM信号延时时间以及波形的占空比。
Description
技术领域
本发明的实施例涉及一种调光电路以及调光方法，特别是涉及一种LED移相调光电路和LED移相调光方法。
背景技术
发光二极管(Light Emitting Diode：LED)因其具有体积小、功耗低、发光效率高、寿命长等诸多优点而被广泛应用于各种电子产品的显示设备中。LED调光技术主要分为模拟调光和PWM调光，目前普遍采用PWM调光技术。PWM调光技术是通过改变占空比达到调光的目的。在现有技术中，常常是多路LED通道的驱动信号同步对应PWM输入信号，即所有的LED同步地导通和关断。这使得LED在导通和关断之间的变化太过急剧，影响显示品质。同时，现有技术中，调光电路输出的多路LED驱动信号的占空比与PWM输入信号的占空比一致，只能实现移相，而不能实现对多路LED驱动信号占空比的改变。
发明内容
考虑到现有技术的一个或者多个问题，提出了一种LED移相调光电路和LED移相调光方法。
根据本发明的一个实施例，提出了一种LED移相调光电路，包括：延时信号产生电路，接收一PWM输入信号，并提供多对置位信号和复位信号；以及多个锁存器，分别对应接收所述多对置位信号和复位信号，并输出多路彼此间具有相位差的PWM输出信号；其中，所述多对置位信号和复位信号中的每对置位信号和复位信号分别指示所述多路PWM输出信号中相应PWM输出信号脉宽的起始时刻和结束时刻。
根据本发明的另一实施例，提出了一种LED移相调光方法，包括：延时信号产生电路接收一PWM输入信号；通过延时信号产生电路产生多对置位信号和复位信号；将所述多对置位信号和复位信号分别对应送至相应的多个锁存器，并输出多路彼此间具有相位差的PWM输出信号，其中，所述多对置位信号和复位信号中的每对置位信号和复位信号分别指示所述多路PWM输出信号中相应PWM输出信号脉宽的起始时刻和结束时刻。
根据本发明的再一实施例，提出了一种LED移相调光方法，包括：接收一PWM输入信号，并对其倍频，输出倍频信号；通过上升沿延时信号产生电路产生多个置位信号，每个置位信号指示相应PWM输出信号脉宽的起始时刻；通过下降沿延时信号产生电路和反馈控制电路产生与所述多个置位信号成对的多个复位信号，每个复位信号指示相应PWM输出信号脉宽的结束时刻；将所述多对置位信号和复位信号分别对应送至相应的锁存器，并输出多路彼此间具有相位差的PWM输出信号。
本发明的实施例还提供了一种LED控制器，包括如上所述的LED移相调光电路。
附图说明
下面的附图表明了本发明的实施方式。这些附图和实施方式以非限制性、非穷举性的方式提供了本发明的一些实施例，其中：
图1所示为根据本发明一实施例的LED控制器的框图；
图2A所示为根据本发明一实施例的LED移相调光电路的框图；
图2B所示为根据本发明另一实施例的LED移相调光电路的框图；
图3A为图2A和图2B所示移相调光电路中，上升沿延时信号产生电路的示意图；
图3B所示为图3A所示电路的一个实施例波形图；
图4A为图2A和图2B所示移相调光电路中，下降沿延时信号产生电路示意图；
图4B所示为图4A所示电路的一个实施例波形图；
图5为图2B所示移相调光电路中，反馈控制电路的一个实施例示意图；
图6为图5所示控制方式实施例的控制流程图；
图7A所示为图5所示控制方式一种实施例的信号时序图；
图7B所示为图5所示控制方式另一种实施例的信号时序图；
图7C所示为图5所示控制方式再一种实施例的信号时序图；
图8为图2B所示移相调光电路中，反馈控制电路的另一个实施例示意图；
图9为图8所示控制方式实施例的控制流程图；以及
图10为图8所示控制方式一种实施例的信号时序图。
具体实施方式
下面将详细描述本发明的具体实施例，应当注意，这里描述的实施例只用于举例说明，并不用于限制本发明。本领域普通技术人员可知，本发明不仅适用于LED移相调光，也可用于其他相关场合，比如交错并联电路等。
图1所示为根据本发明一实施例的LED控制器的示意框图。LED控制器包括DC/DC转换器101、移相调光电路102和均衡电路103。
DC/DC转换器101控制输入至输出的电压调节，并提供直流电源给多个LED通道。移相调光电路102接收一PWM输入信号PWM_in，并输出n路彼此具有相位差的延时PWM输出信号PWM_1，……，PWM_n(n＝2M，M为正整数)，其中每相邻两路延时信号的相位差为T/n，T为输入信号PWM_in的周期。电流均衡电路103接收移相调光电路102的多路输出，并对多个LED串进行均流控制。
图2A所示为根据本发明一实施例的移相调光电路102的示意框图。当PWM输入信号PWM_in在每个周期的占空比相同，图2A所示实施例可实现对信号PWM_in移相功能。移相调光电路102包括延时信号产生电路210和锁存器2021～202n。
根据本发明的一个实施例，延时信号产生电路210接收一PWM输入信号PWM_in，并提供n对置位信号和复位信号。多个锁存器2021～202n分别对应接收该n对置位信号和复位信号，并输出n路彼此间具有相位差的PWM输出信号。n对置位信号和复位信号中的每对置位信号和复位信号分别指示相应路的PWM输出信号脉宽的起始时刻和结束时刻。
根据本发明的实施例，延时信号产生电路210产生上升沿延时信号和下降沿延时信号，并且包括：倍频电路203、上升沿延时信号产生电路204、下降沿延时信号产生电路205。
倍频电路203接收频率为f的脉宽调制PWM输入信号PWM_in，并对频率为f的脉宽调制PWM输入信号PWM_in进行频率倍增，输出频率为2N×f(N≥1)的方波信号，并将倍频后的方波信号输出至上升沿延时信号产生电路204和下降沿延时信号产生电路205。在另一个实施例中，脉宽调制PWM输入信号PWM_in不是方波，此时，倍频电路203还可以包括一个分频器。该分频器首先将脉宽调制PWM输入信号PWM_in进行二分频，使之变为方波信号，再利用倍频电路的倍频功能实现对脉宽调制PWM输入信号PWM_in倍频。在一个实施例中，分频器可由计数器构成。
上升沿延时信号产生电路204接收脉宽调制PWM输入信号PWM_in以及倍频电路203的输出信号，从脉宽调制PWM输入信号PWM_in的上升沿时刻开始，依次输出n路彼此间具有相位差的信号，并将其送至置位总线S_bus，分别作为锁存器2021，2012，……，201n的置位信号set_1，set_2，……，set_n。
下降沿延时信号产生电路205接收脉宽调制PWM输入信号PWM_in以及倍频电路203的输出信号，从脉宽调制PWM输入信号PWM_in的下降沿时刻开始，依次输出n路彼此间具有相位差的信号，并将其送至复位总线R_bus，分别作为锁存器2021，2012，……，201n的复位信号reset_1，reset_2，……，reset_n。复位信号reset_1，reset_2，……，reset_n分别和置位信号set_1，set_2，……，set_n形成对应于n个锁存器的n对复位信号和置位信号。为简化图形，在图2中，置位信号set_1，set_2，……，set_n用set概括统一表示，复位信号reset_1，reset_2，……，reset_n用reset概括统一表示。
n个锁存器2021～202n的每一个具有复位端R和置位端S，置位端S连接至置位总线S_bus，以分别对应接收上升沿延时信号产生电路204输出的置位信号set_1，set_2，……，set_n。复位端R连接至复位总线R_bus，以分别对应接收下降沿延时信号产生电路205输出的复位信号reset_1，reset_2，……，reset_n。锁存器2021提供第一通道输出延时信号PWM_1，锁存器2022提供第二通道输出延时信号PWM_2，以此类推，锁存器202n提供第n通道输出延时信号PWM_n。如本领域技术人员所知，锁存器2021～202n可选用任何可实现置位、复位以及锁存功能的单元。
图2B所示为根据本发明另一实施例的LED移相调光电路102的示意框图。图2B所示实施例可实现对信号PWM_in移相或移相并改变占空比的功能。与图2A所示实施例相比，图2B所示实施例增加了反馈控制电路206。反馈控制电路206接收PWM输出信号的反馈，且与下降沿延时信号产生电路205相连接，接收下降沿延时信号产生电路205产生的下降沿延时信号，并输出复位信号reset至复位总线R_bus。
图3A为根据本发明一个实施例的图2A和2B所示移相调光电路中的上升沿延时信号产生电路204的示意图300。如图3A所示，脉冲产生电路301接收脉宽调制PWM输入信号PWM_in，在其波形上升沿到来时产生一个脉冲，并同时提供该脉冲输出信号r_pulse给锁存器302的置位端和计数器305的复位端，分别用于置位锁存器302和复位计数器305，使整个移相调光电路同步。
锁存器302的复位端连接至电气地，在输入信号PWM_in的上升沿到来时，脉冲输出信号r_pulse对其置位。锁存器302将输出信号提供给与门303的一个输入端。上升沿延时时钟生成电路304接收倍频电路203的输出信号，根据所需的上升沿延时时间，从频率为2N×f的输出信号生成上升沿延时时钟信号，例如，需要对输入信号进行1/4延时(1/4移相)，则生成4×f的时钟信号，并输出上升沿延时时钟CLK_r至与门303的另一端。根据另一实施例，可以将锁存器302、与门303和上升沿时钟生成电路304形成为计数时钟产生电路310，如图3A所示。另外，在一些实施例中，锁存器302和与门303并不是必须的，尤其在一些对同步精度要求不太高的应用中。
在一个实施例中，上升沿延时时钟生成电路304为分频器。上升沿延时时钟生成电路304可根据所需的上升沿延时时间，提供给计数器305相应的计数时钟。与门303对两个输入信号进行与计算，并将结果送至计数器305的时钟输入端。计数器305在输入信号PWM_in的上升沿到来时，脉冲输出信号r_pulse对其清零复位，开始按上升沿延时时钟CLK_r计数，保证时钟同步，并输出M位二进制数字至译码器306，其中，n＝2M(M为自然数)。译码器306对接收的M位二进制数字译码，输出2M路通道置位信号set至置位总线S_bus。例如，在一个实施例中，需要对信号PWM_in进行1/4、1/2、3/4延时，则M等于2。
图3B所示为图3A所示电路的一个实施例波形图。在如图所示实施例中，输入信号PWM_in占空比为50％，周期为T，频率为f。对输入信号PWM_in依次进行1/4延时，倍频信号2N×f经上升沿延时时钟生成电路304后，上升沿延时时钟信号CLK_r的输出频率为4×f。在输入信号PWM_in上升沿时刻起，译码器306输出4路置位输出信号：set_1，set_2，set_3，set_4，每路置位信号依次延时1/4。此时信号set统一表示set_1，set_2，set_3，set_4。
图4A为根据本发明一个实施例的图2A和2B所示移相调光电路中的下降沿延时信号产生电路205示意图400。如图4A所示，脉冲产生电路401接收脉宽调制PWM输入信号PWM_in，并在其波形下降沿到来时产生一个脉冲，并同时提供该脉冲输出信号f_pulse给锁存器402的置位端和计数器405的复位端，分别用于置位锁存器402和复位计数器405，使整个移相调光电路同步。
锁存器402的复位端连接至电气地，在输入信号PWM_in的下降沿到来时，脉冲输出信号f_pulse对其置位，并将输出信号提供给与门403的一个输入端。与门403的另一个输入端接收倍频电路203的输出信号，对两个信号进行与计算后，输出信号至下降沿延时时钟生成电路404。由于倍频电路203输出信号的频率为2N×f，相对于信号PWM_in的频率f，其值很高，因此在一个周期内，对输入信号下降沿采样时，误差很小，保证信号PWM_in的下降沿与时钟信号上升沿基本同步。下降沿延时时钟生成电路404接收与门403的输出信号，根据所需的下降沿延时时间，从频率为2N×f的输出信号生成下降沿延时时钟信号，例如，需要对输入信号进行1/4延时，则生成4×f的时钟信号，并输出下降沿延时时钟CLK_f至计数器405的时钟输入端。根据另一实施例，可以将锁存器402、与门403和上升沿时钟生成电路404形成为计数时钟产生电路410，如图4A所示。另外，在一些实施例中，锁存器402和与门403并不是必须的，尤其在一些对同步精度要求不太高的应用中。
在一个实施例中，下降沿延时时钟生成电路404为分频器。下降沿延时时钟生成电路404可根据所需的下降沿延时时间，提供给计数器405相应的计数时钟。同时，由于可任意调节下降沿的延时时间，因此下降沿延时信号产生电路205可改变输出信号的占空比。计数器405在信号PWM_in的下降沿到来时，脉冲输入信号对其清零复位，开始按下降沿延时时钟CLK_f计数，保证时钟同步，并输出M位二进制数字至译码器406。译码器406对接收的M位二进制数字译码，输出2M路通道的复位信号reset至复位总线R_bus。
图4B所示为图4A所示电路的一个实施例波形图。在如图所示实施例中，输入信号PWM_in占空比为50％，周期为T，频率为f。对输入信号PWM_in依次进行1/4延时，倍频信号2N×f经下降沿延时时钟生成电路404后，下降沿延时时钟信号CLK_f的输出频率为4×f。在输入信号PWM_in下降沿时刻起，译码器406输出4路复位输出信号：reset_1，reset_2，reset_3，reset_4，每路复位信号依次延时1/4。此时信号reset统一表示reset_1，reset_2，reset_3，reset_4。
图5为图2B所示移相调光电路中，反馈控制电路206的一个实施例示意图500。在图5所示实施例中，计数器405对下降沿延时时钟CLK_f计数，当计数器405的复位端R不受信号PWM_in下一周期下降沿影响，计数器405输出M位二进制码至译码器406，译码器406输出2M路通道的复位信号reset_1至或门阵列510。
当计数器405的复位端R被下一周期下降沿f_pulse复位，计数器405中断计数并将中断计数位送至计数器501继续计数，输出M位二进制码至译码器502，译码器502输出2M路通道的复位信号reset_2至或门阵列510。
在控制器206中，通过第二路和第n路PWM输出信号的反馈，下降沿检测电路520确定计数器501的计数起始时刻和终止时刻，同时保证只对原PWM信号下一周期的下降沿进行检测。当下一周期下降沿脉冲来临时，下降沿检测电路520输出高电平信号(使能信号)至计数器501的使能端EN，使计数器501停止跟踪405的输出开始独立计数，当最后一个延时信号PWM_n的下降沿脉冲来临时，下降沿检测电路520输出低电平信号至计数器501的使能端EN，计数器501计数完毕并再次采样405的输出。这样计数器501在每个新的周期都能更新到405的输出值，与之同步。或门阵列510对两路信号reset_1和reset_2做或运算，并输出复位信号reset至复位总线R_bus。
图6为图5所示控制方式实施例的控制流程图600。首先，在步骤601中，判定下降沿延时信号产生电路400中的计数器405是否被清零，也即是，计数器405是否会受到PWM输入信号PWM_in在下一周期下降沿脉冲影响。当计数器405未被复位，则转至步骤602，译码器输出第一复位信号reset_1至或门阵列。
当计数器被PWM输入信号PWM_in下一周期下降沿脉冲清零，则转至步骤603，计数器锁存中断的计数信号和进位信号锁存并继续计数。在步骤604中，新的计数信号将送至译码器，译码器输出第二复位信号reset_2至或门阵列。在步骤605中，或门阵列对第一复位信号reset_1和第二复位信号reset_2进行或运算，并输出复位信号至复位总线R_bus。
图7A所示为，输入PWM信号PWM_in在每个周期T占空比固定时，图5所示控制方式实施例的信号时序图。在图7A所示实施例中，上升沿延时时钟CLK_r的频率和下降沿延时时钟CLK_f的频率相等，均为8f，信号PWM_in在第一个周期内和第二个周期内的占空比都为D1，通过图2所示实施例的延时移相系统，依次对信号PWM_in进行(1/8)T延时移相，并输出8路延时移相信号。由于信号PWM_in在第一个周期内和第二个周期内的占空比相等，都为D1，计数器405的复位端R不受到信号PWM_in下一周期内的下降沿影响。通过上升沿延时信号产生电路204产生置位信号set_a，通过下降沿延时信号产生电路205产生复位信号reset_a，使输出信号PWM_a的占空比在每个周期内仍然为D1。如图7A所示，信号PWM_a为8路延时移相输出信号中的一相，相对信号PWM_in移相(5/8)T。置位信号set针对输入信号PWM_in上升沿延时时间为t1，复位信号reset针对输入信号PWM_in下降沿延时时间为t2，在此实施例中，t1＝t2＝(5/8)T，延时输出信号PWM_a相对于输入信号PWM_in占空比不变，移相(5/8)T。
在其他实施例中，可通过改变上升沿延时时钟CLK_r的频率和下降沿延时时钟CLK_f的频率来改变延时时间，例如，当上升沿延时时钟CLK_r的频率和下降沿延时时钟CLK_f的频率均为16f时，可输出依次延时时间为(1/16)T的16路移相信号。
图7B所示为，输入PWM信号PWM_in在每个周期占空比不固定时，图5所示控制方式实施例的信号时序图。在图7B所示实施例中，上升沿延时时钟CLK_r和下降沿延时时钟CLK_f的频率相等，均为8f，信号PWM_in在第一个周期内的占空比为D1，第二个周期内占空比为D2，通过图2所示实施例的延时移相系统，依次对信号PWM_in进行(1/8)T延时移相，并输出8路延时移相信号。由于D1＞D2，计数器405的复位端R将被信号PWM_in下一周期内的下降沿脉冲清零复位。通过上升沿延时信号产生电路204产生置位信号set_b，通过下降沿延时信号产生电路205产生复位信号reset_b，使输出信号PWM_b的占空比在第一个周期内仍然为D1，在第二个周期内为D2。通过反馈控制电路500的控制，此时，复位信号reset_b不再受到信号PWM_in下一周期里的下降沿影响。如图7B所示，信号PWM_b为8路延时移相输出信号中的一相，相对信号PWM_in移相(5/8)T。复位信号reset相对输入信号PWM_in下降沿延时时间仍为t2(t2＝t1)，延时输出信号PWM_b相对于输入信号PWM_in占空比依然不变，移相(5/8)T。
在其他实施例中，可通过改变上升沿延时钟CLK_r的频率和下降沿延时时钟CLK_f的频率来改变延时时间，例如，当上升沿延时时钟CLK_r的频率和下降沿延时时钟CLK_f的频率均为16f时，可输出依次延时时间为(1/16)T的16路移相信号。
图7C所示为，延时并改变输入信号PWM_in占空比时，图5所示控制方式实施例的信号时序图。在图2所示实施例中，当计数器305的计数时钟CLK_r的频率和计数器405的计数时钟CLK_f的频率不相等时，输出延时信号占空比改变。
在一个实施例中，上升沿延时钟CLK_r的频率为8f，下降沿延时时钟CLK_f的频率为4f，输入信号PWM_in在第一周期内的占空比为D3，在第二个周期内的占空比为D5，通过图2所示实施例的延时移相系统，依次对信号PWM_in进行(1/8)T延时移相，并输出8路延时移相信号，但此时相对于信号PWM_in，输出的8路延时移相信号占空比改变。如图7C所示，信号PWM_c为8路延时移相输出信号中的一相，相对信号PWM_in移相(1/8)T。置位信号set_c针对输入信号PWM_in上升沿延时时间为t3，复位信号reset_c针对输入信号PWM_in下降沿延时时间为t4。在此实施例中，t3＝(1/8)T，t4＝(1/4)T，D3＝1/2，D5＝1/4。延时输出信号PWM_c相对于输入信号PWM_in延时移相(1/8)T，且在第一周期内的占空比变为D4＝5/8，在第二个周期内的占空比变为D6＝3/8。
在其他实施例中，可通过改变上升沿延时钟CLK_r的频率和下降沿延时时钟CLK_f的频率来改变延时时间和占空比，例如，当上升沿延时时钟CLK_r的频率为16f，下降沿延时时钟CLK_f的频率均为8f时，可输出依次延时时间为(1/16)T的16路占空比改变的移相信号。
图8为图2所示移相调光电路中，反馈控制电路206的另一个实施例示意图800。如图8所示，反馈控制电路800包括n路逻辑电路，每路逻辑电路由锁存器和多个门电路组成，多路延时输出PWM信号被反馈引入反馈控制电路206。例如，PWM_1信号和r_pulse信号被输入到与门的两个输入端，产生的结果信号输入到锁存器的置位端S，且PWM_1的反相信号被输入到该锁存器的置位端R，而锁存器的输出端Q的输出信号与f_pulse在另一与门进行“与”运算，结果信号输出到或门，该或门还接收译码器406的输出，在其输出端输出reset_1信号。其他路的逻辑电路的连接关系如上述相同，这里不再详细描述。
当信号PWM_in在每个周期占空比固定时，计数器405的复位端R不会受到信号PWM_in下一周期内的下降沿影响，计数器405输出M位二进制码至译码器406，译码器406输出2M路通道的复位信号reset，并送至锁存器2021～202n。当信号PWM_in在每个周期占空比不固定时，计数器405的复位端R将被信号PWM_in下一周期内的下降沿脉冲清零复位，计数中断，此时在信号PWM_in将在下一周期的下降沿时刻输出reset信号，将多路延时输出PWM信号复位。因此，此实施例的控制方式，同样可实现对输入信号PWM_in延时并改变占空比的功能。
图9为图8所示控制方式实施例的控制流程图900。首先，在步骤901中，判定下降沿延时信号产生电路400中的计数器405是否被清零，也即是，计数器是否会受到PWM输入信号PWM_in在下一周期的下降沿影响。当PWM输入信号PWM_in在下一周期的下降沿不影响计数器计数，则转至步骤902，译码器直接输出reset信号至锁存器904。
当PWM输入信号PWM_in在下一个周期的下降沿将计数器清零，则转至步骤903，在下一周期的下降沿时刻输出reset信号至锁存器904。
图10为图8所示控制方式实施例的信号时序图。在一个实施例中，上升沿延时钟CLK_r和下降沿延时时钟CLK_f的频率相等，均为8f，信号PWM_in在第一个周期内的占空比为D1，第二个周期内占空比为D2，同图7B所示参数一致。由于D1＞D2，计数器405的复位端R将被信号PWM_in下一周期内的下降沿脉冲清零复位。通过反馈控制电路800的控制，在下一周期内的下降沿时刻输出reset_d，延时移相PWM输出信号时序如PWM_d中实线所示，其中PWM_d为8路延时移相输出信号中的一相，相对信号PWM_in移相(5/8)T。信号PWM_d中虚线所示为图7B中相对应的信号PWM_b的时序。此时，信号reset_d相对输入信号PWM_in下降沿延时时间为t5(t5＜t1)，延时输出信号PWM_d第一周期占空比变为D7，移相(5/8)T。
在其他实施例中，当上升沿延时钟CLK_r的频率和下降沿延时时钟CLK_f的频率不同时，同样可在信号PWM_in下一周期的下降沿时刻复位延时输出PWM信号。
虽然已参照几个典型实施例描述了本发明，但应当理解，所用的术语是说明和示例性、而非限制性的术语。由于本发明能够以多种形式具体实施而不脱离发明的精神或实质，所以应当理解，上述实施例不限于任何前述的细节，而应在随附权利要求所限定的精神和范围内广泛地解释，因此落入权利要求或其等效范围内的全部变化和改型都应为随附权利要求所涵盖。
Claims (19)
1.一种LED移相调光电路，包括：
倍频电路，接收一PWM输入信号，并输出倍频信号；
上升沿延时信号产生电路，接收所述倍频信号和所述PWM输入信号，并提供多个置位信号；
下降沿延时信号产生电路，接收所述倍频信号和所述PWM输入信号，并提供多个复位信号；以及
多个锁存器，分别对应接收所述多对置位信号和复位信号，并输出多路彼此间具有相位差的PWM输出信号；
其中，所述多对置位信号和复位信号中的每对置位信号和复位信号分别指示所述多路PWM输出信号中相应PWM输出信号脉宽的起始时刻和结束时刻。
2.如权利要求1所述的LED移相调光电路，其中，所述PWM输入信号在每个周期的占空比相等；且所述PWM输出信号与所述PWM输入信号的占空比相等。
3.如权利要求1所述的LED移相调光电路，其中，还包括反馈控制电路，电连接在所述下降沿延时信号产生电路和所述多个锁存器输出端之间，接收所述下降沿延时信号产生电路的第一组复位信号和至少部分所述PWM输出信号的反馈，并据此产生提供给锁存器的所述多个复位信号。
4.如权利要求3所述的LED移相调光电路，其中，所述反馈控制电路包括：
下降沿检测电路，接收部分所述PWM输出信号的反馈，输出使能信号；
第一计数器，接收所述使能信号和所述下降沿延时信号产生电路中的中断计数位，并输出第一计数信号；
译码器，接收所述第一计数信号，输出第二组复位信号；
或门阵列，将所述第一组复位信号和所述第二组复位信号进行或运算，输出所述多个复位信号。
5.如权利要求3所述的LED移相调光电路，其中，所述反馈控制电路包括多路逻辑电路，每路逻辑电路包括锁存器和多个门电路。
6.如权利要求1所述的LED移相调光电路，其中上升沿延时信号产生电路包括：
上升沿脉冲产生电路，接收PWM输入信号，并在所述PWM输入信号上升沿产生一个上升沿脉冲信号；
第一计数时钟产生电路，接收所述倍频信号，根据所需上升沿延时时间，输出一个上升沿时钟信号；
第二计数器，在每一个所述上升沿脉冲信号来临时，对所述上升沿时钟信号计数并输出第二计数信号；以及
译码器，接收所述第二计数信号，输出所述多个置位信号。
7.如权利要求1所述的LED移相调光电路，其中下降沿延时信号产生电路包括：
下降沿脉冲产生电路，接收PWM输入信号，并在所述PWM输入信号下降沿产生一个下降沿脉冲信号；
第二计数时钟产生电路，接收所述倍频信号，根据所需下降沿延时时间，选择输出一个下降沿时钟信号；
第三计数器，在每一个所述下降沿脉冲信号来临时，对所述下降沿时钟信号计数并输出第三计数信号；以及
译码器，接收所述第三计数信号，输出所述多个复位信号。
8.如权利要求6所述的LED移相调光电路，其中，改变所述上升沿时钟信号的频率可改变所述PWM输出信号的延时时间。
9.如权利要求7所述的LED移相调光电路，其中，改变所述下降沿时钟信号的频率可改变所述PWM输出信号的占空比。
10.一种LED移相调光方法，包括：
接收一PWM输入信号，并对其倍频，输出倍频信号，其中所述PWM输入信号在每个周期的占空比相等；
通过上升延时信号产生电路产生多个置位信号；
通过下降延时信号产生电路产生多个复位信号；以及将所述多对置位信号和复位信号分别对应送至相应的多个锁存器，并输出多路彼此间具有相位差的PWM输出信号；
其中，所述多对置位信号和复位信号中的每对置位信号和复位信号分别指示所述多路PWM输出信号中相应PWM输出信号脉宽的起始时刻和结束时刻。
11.如权利要求10所述的LED移相调光方法，其中，产生所述多个置位信号的步骤包括：
在所述PWM输入信号的上升沿产生上升沿脉冲信号；
根据PWM输出信号所需移相时间，输出上升沿时钟信号；
在每一个所述上升沿脉冲信号来临时，对所述上升沿时钟信号计数，并输出计数信号；
对所述计数信号译码，输出所述多个置位信号。
12.如权利要求10所述的LED移相调光方法，其中，产生所述多个复位信号的步骤包括：
在所述PWM输入信号的下降沿产生下降沿脉冲信号；
根据PWM输出信号所需移相时间，输出下降沿时钟信号；
在每一个所述下降沿脉冲信号时刻，对所述下降沿时钟信号计数，并输出计数信号；
对所述计数信号译码，输出所述多个复位信号。
13.如权利要求11所述的LED移相调光方法，其中，改变所述上升沿时钟信号的频率可改变所述PWM输出信号的移相时间。
14.如权利要求12所述的LED移相调光方法，其中，改变所述下降沿时钟信号的频率可改变所述PWM输出信号的占空比。
15.一种LED移相调光方法，包括：
接收一PWM输入信号，并对其倍频，输出倍频信号；
通过上升沿延时信号产生电路产生多个置位信号，每个置位信号指示相应PWM输出信号脉宽的起始时刻；
通过下降沿延时信号产生电路和反馈控制电路产生与所述多个置位信号成对的多个复位信号，每个复位信号指示相应PWM输出信号脉宽的结束时刻；
将所述多对置位信号和复位信号分别对应送至相应的锁存器，并输出多路彼此间具有相位差的PWM输出信号。
16.如权利要求15所述的LED移相调光方法，其中，通过上升沿延时信号产生电路提供所述多个置位信号的步骤包括：
在所述PWM输入信号的上升沿产生上升沿脉冲信号；
根据PWM输出信号所需延时时间，输出上升沿时钟信号；
在每一个所述上升沿脉冲信号来临时，对所述上升沿时钟信号计数，并输出计数信号；
对所述计数信号译码，输出所述多个置位信号。
17.如权利要求15所述的LED移相调光方法，其中，通过下降沿延时信号产生电路和反馈控制电路产生多个复位信号的步骤包括：
在所述PWM输入信号的下降沿产生下降沿脉冲信号；
根据下降沿所需延时时间，选择输出一个下降沿时钟信号；
在每一个所述下降沿脉冲信号时刻，对所述下降沿时钟信号计数，输出计数信号；
对所述输出计数信号译码，输出多个第一复位信号；
反馈控制电路锁存中断计数位，继续计数，并译码输出多个第二复位信号；
所述多个第一复位信号和多个第二复位信号进行或运算，输出所述多个复位信号。
18.如权利要求17所述的LED移相调光方法，还包括在所述PWM输入信号下一周期下降沿脉冲信号时刻，输出高电平复位信号。
19.一种LED控制器，包括如权利要求1至9中任一所述LED移相调光电路。
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