WO2022216006A1 - 집적 회로 패키지, 그를 포함하는 전자 장치 및 그의 제조 방법 - Google Patents

집적 회로 패키지, 그를 포함하는 전자 장치 및 그의 제조 방법 Download PDF

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WO2022216006A1
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substrate
integrated circuit
electronic device
interposer
circuit package
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나태양
배기철
박철우
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삼성전자 주식회사
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    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
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    • H05K1/18Printed circuits structurally associated with non-printed electric components
    • H05K1/181Printed circuits structurally associated with non-printed electric components associated with surface mounted components
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    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
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    • H05K2201/10Details of components or other objects attached to or integrated in a printed circuit board
    • H05K2201/10227Other objects, e.g. metallic pieces
    • H05K2201/10378Interposers

Definitions

  • Various embodiments of the present disclosure relate to an integrated circuit package, an electronic device including the same, and a method of manufacturing the same.
  • An electronic device may provide various functions.
  • the electronic device may include a photographing function, a music playback function, a navigation function, a call function, a short-range wireless communication (eg, Bluetooth, Wi-Fi, or near field communication (NFC)) function, and an electronic payment function. functions and/or voice recognition functions.
  • the electronic device may include various integrated circuits (ICs) to provide the various functions described above.
  • ICs integrated circuits included in an electronic device may be packaged in various ways (eg, a ball grid array (BGA) or a land grid array (LGA)).
  • BGA ball grid array
  • LGA land grid array
  • Integrated circuits included in recent electronic devices are being packaged using a double side mold (DSM) ball grid array (BGA) method as lightness, thinness, and miniaturization are required.
  • DSM double side mold
  • BGA ball grid array
  • components eg, integrated circuits, semiconductors
  • first surface top surface
  • second side lower side
  • marking product information around the shouldering ball
  • Laser ablation of the molding to expose the shouldering ball to the outside, reballing, sawing the package, and electromagnetic interference (EMI) shielding may include processes can
  • the molding around the shouldering ball is not uniformly ablated due to deviation and/or processing error of the laser, and deviation may occur.
  • the shape of the shouldering ball may be abnormally formed when the DSM BGA package is revolved in a state in which the molding is abnormally ablated. If the DSM BGA package is mounted on a printed circuit board while the shouldering ball has an abnormal shape, mounting defects (eg, short circuit defects and/or non-wet wettability defects) may occur. .
  • components mounted on the lower surface may be exposed to the outside. Due to this, when the components mounted on the lower surface of the substrate are subjected to an external impact, defects (eg, cracks) may occur.
  • Various embodiments of the present disclosure provide an integrated circuit package capable of reducing a defect rate using an interposer substrate, making a pin map (or a ball map) common, and reducing a packaging size, an electronic device including the same, and A manufacturing method thereof can be provided.
  • An electronic device may include, for example, a printed circuit board; and an integrated circuit package attached to the printed circuit board, wherein the integrated circuit package includes: a substrate to which a plurality of devices are attached to a first surface and a second surface opposite to the first surface; a first molding member covering the first surface of the substrate; an interposer substrate attached to the second surface of the substrate and including landing pads for electrical connection to the printed circuit board; and a connection member electrically connecting the substrate and the interposer substrate.
  • An integrated circuit package may include, for example, a substrate to which a plurality of devices are attached to a first surface and a second surface opposite to the first surface; a first molding member covering the first surface of the substrate; an interposer substrate attached to the second surface of the substrate and including landing pads for electrical connection to a printed circuit board included in an electronic device; and a connection member electrically connecting the substrate and the interposer substrate.
  • a method of manufacturing an integrated circuit package may include, for example, attaching at least one first device to a first surface of a substrate; molding the first surface using a first molding member; grinding the first molding member; attaching at least one second element and at least one connecting member to the second surface of the substrate; and attaching an interposer substrate including landing pads for electrical connection to a printed circuit board included in the electronic device to the second surface of the substrate.
  • the defect of the shouldering ball and/or the integrated circuit due to the deviation of laser ablation in the DSM BGA packaging process A mounting defect of the package may be eliminated.
  • Various embodiments of the present disclosure may share a pin map (or ball map) of an integrated circuit by using an interposer substrate even though the arrangement and/or size of components mounted on the lower surface of the substrate are different.
  • the interposer substrate is mounted on the lower surface of the substrate, the components mounted on the lower surface are not exposed to the outside, thereby protecting the internal components (eg, preventing damage), and the integrated circuit package strength can be supplemented.
  • Various embodiments of the present disclosure may optimize a pin map (or a ball map) using an interposer substrate, thereby reducing the size of an integrated circuit package.
  • Various embodiments of the present disclosure may reduce the time and/or cost for manufacturing (or packaging) the integrated circuit by eliminating the molding process of the bottom surface.
  • FIG. 1 is a block diagram of an electronic device in a network environment, according to various embodiments of the present disclosure
  • FIG. 2A is a cross-sectional view of an integrated circuit package according to an embodiment of the present disclosure.
  • 2B is a diagram illustrating an example of a pin map of a lower surface of an integrated circuit package according to embodiments of the present disclosure
  • 3A is a cross-sectional view of an integrated circuit package according to another embodiment of the present disclosure.
  • 3B is a diagram illustrating an example of a ball map of a lower surface of an integrated circuit package according to another embodiment of the present disclosure.
  • FIG. 4 is a cross-sectional view of an integrated circuit package according to another embodiment of the present disclosure.
  • 5A is a diagram for explaining common use of a pin map of an integrated circuit package according to various embodiments of the present disclosure
  • 5B is a diagram for explaining common use of a pin map of an integrated circuit package according to various embodiments of the present disclosure
  • 6A is a flowchart illustrating a packaging method of an integrated circuit package according to various embodiments of the present disclosure
  • 6B is an exemplary diagram for explaining a packaging method of an integrated circuit package according to various embodiments of the present disclosure
  • FIG. 1 is a block diagram of an electronic device in a network environment, according to an embodiment of the present disclosure.
  • an electronic device 101 communicates with an electronic device 102 through a first network 198 (eg, a short-range wireless communication network) or a second network 199 . It may communicate with the electronic device 104 or the server 108 through (eg, a long-distance wireless communication network). According to an embodiment, the electronic device 101 may communicate with the electronic device 104 through the server 108 .
  • a first network 198 eg, a short-range wireless communication network
  • a second network 199 e.g., a second network 199 . It may communicate with the electronic device 104 or the server 108 through (eg, a long-distance wireless communication network). According to an embodiment, the electronic device 101 may communicate with the electronic device 104 through the server 108 .
  • the electronic device 101 includes a processor 120 , a memory 130 , an input module 150 , a sound output module 155 , a display module 160 , an audio module 170 , and a sensor module ( 176), interface 177, connection terminal 178, haptic module 179, camera module 180, power management module 188, battery 189, communication module 190, subscriber identification module 196 , or an antenna module 197 .
  • at least one of these components eg, the connection terminal 178
  • some of these components are integrated into one component (eg, display module 160 ). can be
  • the processor 120 for example, executes software (eg, the program 140) to execute at least one other component (eg, a hardware or software component) of the electronic device 101 connected to the processor 120. It can control and perform various data processing or operations. According to an embodiment, as at least part of data processing or operation, the processor 120 stores a command or data received from another component (eg, the sensor module 176 or the communication module 190 ) into the volatile memory 132 . may be stored in , process commands or data stored in the volatile memory 132 , and store the result data in the non-volatile memory 134 .
  • software eg, the program 140
  • the processor 120 stores a command or data received from another component (eg, the sensor module 176 or the communication module 190 ) into the volatile memory 132 .
  • the processor 120 stores a command or data received from another component (eg, the sensor module 176 or the communication module 190 ) into the volatile memory 132 .
  • the processor 120 is a main processor 121 (eg, a central processing unit or an application processor) or a secondary processor 123 (eg, a graphic processing unit, a neural network processing unit) a neural processing unit (NPU), an image signal processor, a sensor hub processor, or a communication processor).
  • a main processor 121 eg, a central processing unit or an application processor
  • a secondary processor 123 eg, a graphic processing unit, a neural network processing unit
  • NPU neural processing unit
  • an image signal processor e.g., a sensor hub processor, or a communication processor.
  • the secondary processor 123 may, for example, act on behalf of the main processor 121 while the main processor 121 is in an inactive (eg, sleep) state, or when the main processor 121 is active (eg, executing an application). ), together with the main processor 121, at least one of the components of the electronic device 101 (eg, the display module 160, the sensor module 176, or the communication module 190) It is possible to control at least some of the related functions or states.
  • the auxiliary processor 123 eg, an image signal processor or a communication processor
  • the auxiliary processor 123 may include a hardware structure specialized for processing an artificial intelligence model.
  • Artificial intelligence models can be created through machine learning. Such learning may be performed, for example, in the electronic device 101 itself on which artificial intelligence is performed, or may be performed through a separate server (eg, the server 108).
  • the learning algorithm may include, for example, supervised learning, unsupervised learning, semi-supervised learning, or reinforcement learning, but in the above example not limited
  • the artificial intelligence model may include a plurality of artificial neural network layers.
  • Artificial neural networks include deep neural networks (DNNs), convolutional neural networks (CNNs), recurrent neural networks (RNNs), restricted boltzmann machines (RBMs), deep belief networks (DBNs), bidirectional recurrent deep neural networks (BRDNNs), It may be one of deep Q-networks or a combination of two or more of the above, but is not limited to the above example.
  • the artificial intelligence model may include, in addition to, or alternatively, a software structure in addition to the hardware structure.
  • the memory 130 may store various data used by at least one component of the electronic device 101 (eg, the processor 120 or the sensor module 176 ).
  • the data may include, for example, input data or output data for software (eg, the program 140 ) and instructions related thereto.
  • the memory 130 may include a volatile memory 132 or a non-volatile memory 134 .
  • the program 140 may be stored as software in the memory 130 , and may include, for example, an operating system 142 , middleware 144 , or an application 146 .
  • the input module 150 may receive a command or data to be used by a component (eg, the processor 120 ) of the electronic device 101 from the outside (eg, a user) of the electronic device 101 .
  • the input module 150 may include, for example, a microphone, a mouse, a keyboard, a key (eg, a button), or a digital pen (eg, a stylus pen).
  • the sound output module 155 may output a sound signal to the outside of the electronic device 101 .
  • the sound output module 155 may include, for example, a speaker or a receiver.
  • the speaker can be used for general purposes such as multimedia playback or recording playback.
  • the receiver can be used to receive incoming calls. According to an embodiment, the receiver may be implemented separately from or as a part of the speaker.
  • the display module 160 may visually provide information to the outside (eg, a user) of the electronic device 101 .
  • the display module 160 may include, for example, a control circuit for controlling a display, a hologram device, or a projector and a corresponding device.
  • the display module 160 may include a touch sensor configured to sense a touch or a pressure sensor configured to measure the intensity of a force generated by the touch.
  • the audio module 170 may convert a sound into an electric signal or, conversely, convert an electric signal into a sound. According to an embodiment, the audio module 170 acquires a sound through the input module 150 , or an external electronic device (eg, a sound output module 155 ) connected directly or wirelessly with the electronic device 101 .
  • the electronic device 102) eg, a speaker or headphones
  • the electronic device 102 may output a sound.
  • the sensor module 176 detects an operating state (eg, power or temperature) of the electronic device 101 or an external environmental state (eg, a user state), and generates an electrical signal or data value corresponding to the sensed state. can do.
  • the sensor module 176 may include, for example, a gesture sensor, a gyro sensor, a barometric pressure sensor, a magnetic sensor, an acceleration sensor, a grip sensor, a proximity sensor, a color sensor, an IR (infrared) sensor, a biometric sensor, It may include a temperature sensor, a humidity sensor, or an illuminance sensor.
  • the interface 177 may support one or more specified protocols that may be used by the electronic device 101 to directly or wirelessly connect with an external electronic device (eg, the electronic device 102 ).
  • the interface 177 may include, for example, a high definition multimedia interface (HDMI), a universal serial bus (USB) interface, an SD card interface, or an audio interface.
  • the connection terminal 178 may include a connector through which the electronic device 101 can be physically connected to an external electronic device (eg, the electronic device 102 ).
  • the connection terminal 178 may include, for example, an HDMI connector, a USB connector, an SD card connector, or an audio connector (eg, a headphone connector).
  • the haptic module 179 may convert an electrical signal into a mechanical stimulus (eg, vibration or movement) or an electrical stimulus that the user can perceive through tactile or kinesthetic sense.
  • the haptic module 179 may include, for example, a motor, a piezoelectric element, or an electrical stimulation device.
  • the camera module 180 may capture still images and moving images. According to an embodiment, the camera module 180 may include one or more lenses, image sensors, image signal processors, or flashes.
  • the power management module 188 may manage power supplied to the electronic device 101 .
  • the power management module 188 may be implemented as, for example, at least a part of a power management integrated circuit (PMIC).
  • PMIC power management integrated circuit
  • the battery 189 may supply power to at least one component of the electronic device 101 .
  • the battery 189 may include, for example, a non-rechargeable primary cell, a rechargeable secondary cell, or a fuel cell.
  • the communication module 190 is a direct (eg, wired) communication channel or a wireless communication channel between the electronic device 101 and an external electronic device (eg, the electronic device 102, the electronic device 104, or the server 108). It can support establishment and communication performance through the established communication channel.
  • the communication module 190 may include one or more communication processors that operate independently of the processor 120 (eg, an application processor) and support direct (eg, wired) communication or wireless communication.
  • the communication module 190 is a wireless communication module 192 (eg, a cellular communication module, a short-range wireless communication module, or a global navigation satellite system (GNSS) communication module) or a wired communication module 194 (eg, : It may include a local area network (LAN) communication module, or a power line communication module).
  • a wireless communication module 192 eg, a cellular communication module, a short-range wireless communication module, or a global navigation satellite system (GNSS) communication module
  • GNSS global navigation satellite system
  • wired communication module 194 eg, : It may include a local area network (LAN) communication module, or a power line communication module.
  • a corresponding communication module among these communication modules is a first network 198 (eg, a short-range communication network such as Bluetooth, wireless fidelity (WiFi) direct, or infrared data association (IrDA)) or a second network 199 (eg, legacy It may communicate with the external electronic device 104 through a cellular network, a 5G network, a next-generation communication network, the Internet, or a computer network (eg, a telecommunication network such as a LAN or a WAN).
  • a first network 198 eg, a short-range communication network such as Bluetooth, wireless fidelity (WiFi) direct, or infrared data association (IrDA)
  • a second network 199 eg, legacy It may communicate with the external electronic device 104 through a cellular network, a 5G network, a next-generation communication network, the Internet, or a computer network (eg, a telecommunication network such as a LAN or a WAN).
  • a telecommunication network
  • the wireless communication module 192 uses subscriber information (eg, International Mobile Subscriber Identifier (IMSI)) stored in the subscriber identification module 196 within a communication network such as the first network 198 or the second network 199 .
  • subscriber information eg, International Mobile Subscriber Identifier (IMSI)
  • IMSI International Mobile Subscriber Identifier
  • the electronic device 101 may be identified or authenticated.
  • the wireless communication module 192 may support a 5G network after a 4G network and a next-generation communication technology, for example, a new radio access technology (NR).
  • NR access technology includes high-speed transmission of high-capacity data (eMBB (enhanced mobile broadband)), minimization of terminal power and access to multiple terminals (mMTC (massive machine type communications)), or high reliability and low latency (URLLC (ultra-reliable and low-latency) -latency communications)).
  • eMBB enhanced mobile broadband
  • mMTC massive machine type communications
  • URLLC ultra-reliable and low-latency
  • the wireless communication module 192 may support a high frequency band (eg, mmWave band) to achieve a high data rate, for example.
  • a high frequency band eg, mmWave band
  • the wireless communication module 192 uses various techniques for securing performance in a high-frequency band, for example, beamforming, massive multiple-input and multiple-output (MIMO), all-dimensional multiplexing. It may support technologies such as full dimensional MIMO (FD-MIMO), an array antenna, analog beam-forming, or a large scale antenna.
  • the wireless communication module 192 may support various requirements defined in the electronic device 101 , an external electronic device (eg, the electronic device 104 ), or a network system (eg, the second network 199 ).
  • the wireless communication module 192 includes a peak data rate (eg, 20 Gbps or more) for realizing eMBB, loss coverage (eg, 164 dB or less) for realizing mMTC, or U-plane latency for realizing URLLC ( Example: Downlink (DL) and uplink (UL) each 0.5 ms or less, or round trip 1 ms or less) can be supported.
  • a peak data rate eg, 20 Gbps or more
  • loss coverage eg, 164 dB or less
  • U-plane latency for realizing URLLC
  • the antenna module 197 may transmit or receive a signal or power to the outside (eg, an external electronic device).
  • the antenna module 197 may include an antenna including a conductor formed on a substrate (eg, a PCB) or a radiator formed of a conductive pattern.
  • the antenna module 197 may include a plurality of antennas (eg, an array antenna). In this case, at least one antenna suitable for a communication method used in a communication network such as the first network 198 or the second network 199 is connected from the plurality of antennas by, for example, the communication module 190 . can be selected. A signal or power may be transmitted or received between the communication module 190 and an external electronic device through the selected at least one antenna.
  • other components eg, a radio frequency integrated circuit (RFIC)
  • RFIC radio frequency integrated circuit
  • the antenna module 197 may form a mmWave antenna module.
  • the mmWave antenna module comprises a printed circuit board, an RFIC disposed on or adjacent to a first side (eg, bottom side) of the printed circuit board and capable of supporting a designated high frequency band (eg, mmWave band); and a plurality of antennas (eg, an array antenna) disposed on or adjacent to a second side (eg, top or side) of the printed circuit board and capable of transmitting or receiving signals of the designated high frequency band. can do.
  • peripheral devices eg, a bus, general purpose input and output (GPIO), serial peripheral interface (SPI), or mobile industry processor interface (MIPI)
  • GPIO general purpose input and output
  • SPI serial peripheral interface
  • MIPI mobile industry processor interface
  • the command or data may be transmitted or received between the electronic device 101 and the external electronic device 104 through the server 108 connected to the second network 199 .
  • Each of the external electronic devices 102 or 104 may be the same as or different from the electronic device 101 .
  • all or part of the operations executed by the electronic device 101 may be executed by one or more external electronic devices 102 , 104 , or 108 .
  • the electronic device 101 may perform the function or service itself instead of executing the function or service itself.
  • one or more external electronic devices may be requested to perform at least a part of the function or the service.
  • One or more external electronic devices that have received the request may execute at least a part of the requested function or service, or an additional function or service related to the request, and transmit a result of the execution to the electronic device 101 .
  • the electronic device 101 may process the result as it is or additionally and provide it as at least a part of a response to the request.
  • cloud computing, distributed computing, mobile edge computing (MEC), or client-server computing technology may be used.
  • the electronic device 101 may provide an ultra-low latency service using, for example, distributed computing or mobile edge computing.
  • the external electronic device 104 may include an Internet of things (IoT) device.
  • the server 108 may be an intelligent server using machine learning and/or neural networks.
  • the external electronic device 104 or the server 108 may be included in the second network 199 .
  • the electronic device 101 may be applied to an intelligent service (eg, smart home, smart city, smart car, or health care) based on 5G communication technology and IoT-related technology.
  • At least some of the various components included in the electronic device 101 may be an integrated circuit (IC).
  • the integrated circuit may be packaged in various ways (eg, a ball grid array (BGA), a land grid array (LGA)).
  • BGA ball grid array
  • LGA land grid array
  • Various embodiments of the present disclosure may provide a new structure and method (manufacturing process) for packaging an integrated circuit.
  • a packaging structure and method of an integrated circuit according to various embodiments of the present disclosure will be described.
  • FIG. 2A is a cross-sectional view of an integrated circuit package according to embodiments of the present disclosure
  • FIG. 2B is a diagram illustrating an example of a pin map of a lower surface of an integrated circuit package according to embodiments of the present disclosure.
  • an integrated circuit package 200 includes a substrate 210 , a first molding member 220 , a second molding member 230 , and an interposer. It may include an interposer printed circuit board (PCB) 240 , a connection member 250 , and a plurality of devices (or components) 260 .
  • PCB printed circuit board
  • the integrated circuit package 200 attaches (or adheres, bonds) an integrated circuit (eg, a semiconductor chip) to a printed circuit board (not shown) included in an electronic device (eg, the electronic device 101 ).
  • bonding, lamination) eg, surface mount
  • a plurality of first devices (eg, transistors, diodes, capacitors, resistors, etc.) 261 are attached to the first surface (top surface) of the substrate 210 , and the plurality of first devices 261 are attached. ) to protect at least a portion of the first surface of the substrate 210 with the first molding member 220 (eg, ceramic, metal, or plastic (eg, epoxy molding compound (EMC))).
  • EMC epoxy molding compound
  • an electromagnetic shielding material may be added to the first molding member 220 , or an electromagnetic shielding material may be applied or attached to the surface of the first molding member 220 to provide an electromagnetic shielding structure.
  • a plurality of second elements 262 and a connection member 250 are attached to the second surface (lower surface) of the substrate 210 , and the second surface of the substrate 210 is formed as a second molding member 230 . At least a part of the can be molded.
  • the second molding member 230 may be ground so that the connecting member 250 is exposed to the outside.
  • the outer surface of at least a portion of the second elements 262 may be exposed to the outside.
  • the interposer substrate 240 may be attached to the second surface of the substrate 210 .
  • the interposer substrate 240 may be attached to the substrate 210 through the connection member 250 .
  • At least a portion of the connecting member 250 may electrically connect the substrate 210 and the interposer substrate 240 .
  • the interposer substrate 240 may include a landing pad 241 for electrical connection to a printed circuit board (not shown).
  • the landing pad 241 is, as shown in FIG. 2B , the second surface opposite to the first surface (the surface facing the second surface of the substrate 210 ) (the upper surface) of the interposer substrate 240 . It can be arranged in multiple rows inevitably on the (lower side).
  • the arrangement (pin map) of the landing pad 241 illustrated in FIG. 2B is only an example and does not limit the exemplary embodiment of the present disclosure.
  • the connecting member 250 may electrically connect the interposer substrate 240 and the substrate 210, and may include an interposer ball, a shouldering ball, a copper-cored ball, or It may include a copper post (cu-post).
  • FIG. 3A is a cross-sectional view of an integrated circuit package according to another embodiment of the present disclosure
  • FIG. 3B is a view illustrating an example of a ball map of a lower surface of an integrated circuit package according to another embodiment of the present disclosure.
  • an integrated circuit package 300 includes a substrate 310 , a first molding member 320 , a second molding member 330 , and an interposer substrate 340 . ), a connection member 350 , a plurality of elements (or parts) 360 including first elements 361 and second elements 362 , and a shouldering ball 370 .
  • the substrate 310 , the first molding member 320 , the second molding member 330 , the interposer substrate 340 , the connection member 350 , and the plurality of devices 360 are the substrate 210 of FIG. 2A .
  • the first molding member 220 , the second molding member 230 , the interposer substrate 240 , the connection member 250 , and the plurality of devices 260 may be the same (or similar), respectively. Accordingly, a detailed description thereof will be omitted.
  • the integrated circuit package 300 may form the shouldering ball 370 on the landing pad 341 through a ball operation (eg, a ball drop). Through this, the integrated circuit package 300 may be formed in a BGA type. According to an embodiment, the landing pad 341 of the integrated circuit package 300 may have a shape suitable for ball formation, unlike the shape (eg, a rectangle) illustrated in FIG. 2B .
  • FIG. 4 is a cross-sectional view of an integrated circuit package according to another embodiment of the present disclosure.
  • an integrated circuit package 400 includes a substrate 410 , a first molding member 420 , an interposer substrate 440 , a connection member 450 , and a second A plurality of devices (or components) 460 including first devices 461 and second devices 462 may be included.
  • the substrate 410 , the first molding member 420 , the interposer substrate 440 , the connecting member 450 , and the plurality of devices (or components) 460 are the substrate 210 and the first molding of FIG. 2A .
  • Each of the member 220 , the interposer substrate 240 , the connecting member 250 , and the plurality of devices 260 may be the same (or similar). Accordingly, a detailed description thereof will be omitted.
  • the integrated circuit package 400 does not mold the second surface of the substrate 410 . This is because the second surface of the substrate 410 may be protected by the interposer substrate 440 . Since the second surface is not molded, the integrated circuit package 400 may reduce manufacturing time and manufacturing cost, and may simplify the manufacturing process.
  • the integrated circuit package 400 may further include a shouldering ball (not shown) in the landing pad 441 , similarly to the integrated circuit package 400 of FIG. 3A .
  • FIG. 5A is a view for explaining common use of a pin map of an integrated circuit package according to various embodiments of the present disclosure
  • FIG. 5B is a view for explaining common use of a pin map of an integrated circuit package according to various embodiments of the present disclosure; to be.
  • integrated circuit packages included in an electronic device according to various embodiments of the present disclosure may be produced by a plurality of packaging companies. This is because the manufacturer of the electronic device may manufacture the electronic device using a plurality of integrated circuit packages produced by a plurality of packaging companies in order to smoothly supply and supply the integrated circuit package.
  • the arrangement of a plurality of elements positioned therein may be different depending on the package maker.
  • the plurality of second devices 562a may have a first arrangement structure.
  • a plurality of second elements 562b have a second arrangement different from the first arrangement structure. can have a structure.
  • the arrangement structure of the landing pad 541a of the first integrated circuit package and the arrangement structure of the landing pad 541b of the second integrated circuit package may be the same.
  • the first integrated circuit package and the second integrated circuit package may have the same pin map (or ball map).
  • pin maps of the first interposer substrate 540a of the first integrated circuit package and the second surface of the second interposer substrate 540b of the second integrated circuit package. may be the same.
  • the first integrated circuit package and the second integrated circuit package may have different electrical connection structures between the substrate and the interposer substrate.
  • the arrangement of the first connection member 550a and/or the first wiring 580a of the first integrated circuit package and the second connection member of the second integrated circuit package may be different.
  • a pin map (or a ball map) may be shared among integrated circuit packages produced by a plurality of packaging companies by using an interposer substrate. For this reason, the manufacturer of the electronic device may not separately design and manufacture the printed circuit board (not shown) of the electronic device in response to the integrated circuit package of each company. Accordingly, the manufacturer of the electronic device may reduce the manufacturing cost and/or manufacturing time of the electronic device.
  • FIG. 6A is a flowchart illustrating a packaging method of an integrated circuit package according to various embodiments of the present disclosure
  • FIG. 6B is an exemplary diagram illustrating a packaging method of an integrated circuit package according to various embodiments of the present disclosure.
  • a substrate eg, the substrate 210
  • 310 , 410 a plurality of devices may be attached to the first surface of the first substrate 510a , and the second substrate 510b).
  • a plurality of first devices 661 eg, a plurality of first devices 261
  • the method may bond a wire in operation 603 .
  • an electrical connection process between the first devices 661 and/or an electrical connection process between the first devices 661 and the substrate 610 is performed using a conductive wire (eg, a gold wire). can be performed.
  • a conductive wire eg, a gold wire
  • the first surface may be molded and ground.
  • a plurality of first elements 661 are mounted on the first surface of the substrate 610 , and the first molding member 620 (eg: A packaging process may be performed on the first surface by molding the first surface using the first molding members 220 , 320 , and 420 ) and grinding the first molding member 620 .
  • the method in operation 607 , includes a plurality of second elements 662 (eg, second elements 262 , 562a , 562b ) and a connection member 650 on the second surface of the substrate. (eg, the connection members 250 , 350 , 450 , the first connection member 550a , and the second connection member 550b ) may be attached.
  • the plurality of second elements 662 and the connection member 650 may be surface-mounted on the second surface of the substrate 610 .
  • the second surface may be molded and ground.
  • the second molding member 630 eg, the second molding members 230 and 330
  • a surface may be molded, and a portion of the second molding member 630 may be ground so that the surfaces of the connection member 650 and the second element 652 are exposed to the outside.
  • operation 609 may be omitted.
  • operation 609 may be omitted when manufacturing the integrated circuit package of FIG. 4 .
  • the interposer substrate 640 (eg, the interposer substrates 240 , 340 , 440 ), the first interposer substrate 540a, and the second interposer substrate 640 on the second surface A poser substrate 540b) may be attached.
  • the interposer substrate 640 may be surface mounted on the second surface of the substrate 610 .
  • the method may form a shouldering ball on a landing pad (eg, the landing pads 241 , 341 , 441 , 541a , 541b ) of the interposer substrate.
  • operation 613 may be omitted.
  • the method may perform operation 613 when manufacturing a BGA-type integrated circuit package, such as the integrated circuit package of FIGS. 3A and 3B .
  • an electronic device may include a printed circuit board; and an integrated circuit package (eg, integrated circuit packages 200 , 300 , 400 ) attached to the printed circuit board.
  • the integrated circuit package includes a substrate (eg, substrates 210 , 310 , 410 , 610 ) to which a plurality of devices are attached to a first surface and a second surface opposite to the first surface, a first substrate 510a, and a first surface.
  • first molding member eg, a first molding member 220 , 320 , 420 , 620 covering the first surface of the substrate
  • An interposer substrate eg, an interposer substrate
  • landing pads eg, landing pads 241, 341, 441, 541a, 541b
  • connecting member eg, connecting members 250, 350, 450, 650, first connecting member 550a, and second connecting member 550b electrically connecting the substrate and the interposer substrate.
  • the connecting member may include an interposer ball.
  • the substrate may include a first substrate (eg, a first substrate 510a) in which the plurality of devices have a first arrangement structure;
  • the plurality of devices may include a second substrate (eg, the second substrate 510b) having a second arrangement structure different from the first arrangement structure.
  • the interposer substrate may include a first interposer substrate (eg, a first interposer substrate 540a) corresponding to the first substrate;
  • a second interposer substrate eg, the second interposer substrate 540b corresponding to the second substrate may be included.
  • the first interposer substrate and the second interposer substrate may include landing pads having the same structure, and an electrical connection structure between the first substrate and the first interposer substrate and the second interposer substrate Electrical connection structures between the second substrate and the second interposer substrate may be different.
  • the integrated circuit package is positioned between the second surface of the substrate and the interposer substrate, and a second molding member (eg, the second molding members 230, 330 and 630) covering the second surface. )) may be further included.
  • a second molding member eg, the second molding members 230, 330 and 630 covering the second surface.
  • the integrated circuit package may further include a shouldering ball (eg, a shouldering ball 370 ) formed on the landing pad.
  • a shouldering ball eg, a shouldering ball 370
  • an integrated circuit package (eg, the integrated circuit packages 200 , 300 , and 400 ) is a substrate to which a plurality of devices are attached to a first surface and a second surface opposite to the first surface.
  • a first molding member eg, a first molding member 220 , 320 , 420 , 620
  • An interposer substrate attached to the second surface of the substrate and including landing pads (eg, landing pads 241, 341, 441, 541a, 541b) for electrical connection with a printed circuit board included in an electronic device
  • landing pads eg, landing pads 241, 341, 441, 541a, 541b
  • a connecting member eg, connecting members 250, 350, 450, 650, first connecting member 550
  • the connecting member may include an interposer ball.
  • the substrate may include a first substrate (eg, a first substrate 510a) in which the plurality of devices have a first arrangement structure;
  • the plurality of devices may include a second substrate (eg, the second substrate 510b) having a second arrangement structure different from the first arrangement structure.
  • the interposer substrate may include a first interposer substrate (eg, a first interposer substrate 540a) corresponding to the first substrate;
  • a second interposer substrate eg, the second interposer substrate 540b corresponding to the second substrate may be included.
  • the first interposer substrate and the second interposer substrate may include landing pads having the same structure, and an electrical connection structure between the first substrate and the first interposer substrate and the second interposer substrate Electrical connection structures between the second substrate and the second interposer substrate may be different.
  • the integrated circuit package is positioned between the second surface of the substrate and the interposer substrate, and a second molding member (eg, the second molding member 230, 330, 630) covering the second surface. )) may be further included.
  • a second molding member eg, the second molding member 230, 330, 630
  • the integrated circuit package may further include a shouldering ball (eg, a shouldering ball 370 ) formed on the landing pad.
  • a shouldering ball eg, a shouldering ball 370
  • a first surface of a substrate (eg, the substrates 210 , 310 , 410 , 610 , the first substrate 510a , and the second substrate 510b) is formed.
  • first elements 261 , 361 , 461 , 661 attaching at least one first element (eg, first elements 261 , 361 , 461 , 661 ); molding the first surface using a first molding member (eg, the first molding members 220, 320, 420, and 620); grinding the first molding member; at least one second element (eg, second element 262, 362, 462, 662) and at least one connection member (eg, connection member 250, 350, 450, 650) on the second surface of the substrate; attaching the first connecting member 550a and the second connecting member 550b); and landing pads (eg, landing pads 241, 341, 441, 541a, 541b) for electrical connection with a printed circuit board included in an electronic device (eg, the electronic device 101); an interposer substrate ( Example: attaching the interposer substrates 240 , 340 , 440 , 640 , the first interposer substrate 540a , and the second interposer substrate 540b to the second surface of
  • the method may include molding the second surface using a second molding member (eg, the second molding member 230 , 330 , 630 ); and grinding the first molding member.
  • a second molding member eg, the second molding member 230 , 330 , 630
  • the method may further include forming a shouldering ball (eg, a shouldering ball 370) on the landing pads of the interposer substrate.
  • a shouldering ball eg, a shouldering ball 370
  • the connecting member may include an interposer ball.
  • the electronic device may have various types of devices.
  • the electronic device may include, for example, a portable communication device (eg, a smart phone), a computer device, a portable multimedia device, a portable medical device, a camera, a wearable device, or a home appliance device.
  • a portable communication device eg, a smart phone
  • a computer device e.g., a laptop, a desktop, a tablet, or a smart phone
  • a portable multimedia device e.g., a portable medical device
  • a camera e.g., a portable medical device
  • a camera e.g., a portable medical device
  • a camera e.g., a camera
  • a wearable device e.g., a smart bracelet
  • first”, “second”, or “first” or “second” may simply be used to distinguish the component from other such components, and refer to the component in another aspect (e.g., importance or order) is not limited. It is said that one (eg, first) component is “coupled” or “connected” to another (eg, second) component, with or without the terms “functionally” or “communicatively”. When referenced, it means that one component can be connected to the other component directly (eg by wire), wirelessly, or through a third component.
  • module used in various embodiments of the present disclosure may include a unit implemented in hardware, software, or firmware, for example, interchangeably with terms such as logic, logic block, component, or circuit.
  • a module may be an integrally formed part or a minimum unit or a part of the part that performs one or more functions.
  • the module may be implemented in the form of an application-specific integrated circuit (ASIC).
  • ASIC application-specific integrated circuit
  • one or more instructions stored in a storage medium may be implemented as software (eg, the program 140) including
  • the processor eg, the processor 120
  • the device eg, the electronic device 101
  • the one or more instructions may include code generated by a compiler or code executable by an interpreter.
  • the device-readable storage medium may be provided in the form of a non-transitory storage medium.
  • 'non-transitory' only means that the storage medium is a tangible device and does not contain a signal (eg, electromagnetic wave), and this term is used in cases where data is semi-permanently stored in the storage medium and It does not distinguish between temporary storage cases.
  • a signal eg, electromagnetic wave
  • the method according to various embodiments of the present disclosure may be included and provided in a computer program product.
  • Computer program products may be traded between sellers and buyers as commodities.
  • the computer program product is distributed in the form of a machine-readable storage medium (eg compact disc read only memory (CD-ROM)), or via an application store (eg Play Store TM ) or on two user devices ( It can be distributed (eg downloaded or uploaded) directly or online between smartphones (eg: smartphones).
  • a portion of the computer program product may be temporarily stored or temporarily generated in a machine-readable storage medium such as a memory of a server of a manufacturer, a server of an application store, or a memory of a relay server.
  • each component (eg, module or program) of the above-described components may include a singular or a plurality of entities, and some of the plurality of entities may be separately disposed in other components.
  • one or more components or operations among the above-described corresponding components may be omitted, or one or more other components or operations may be added.
  • a plurality of components eg, a module or a program
  • the integrated component may perform one or more functions of each component of the plurality of components identically or similarly to those performed by the corresponding component among the plurality of components prior to the integration. .
  • operations performed by a module, program, or other component are executed sequentially, in parallel, repeatedly, or heuristically, or one or more of the operations are executed in a different order, omitted, or , or one or more other operations may be added.

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Abstract

본 개시의 다양한 실시 예들은 집적 회로 패키지, 그를 포함하는 전자 장치, 및 그의 제조 방법에 관한 것으로, 상기 방법은 기판의 제1 면에 적어도 하나의 제1 소자를 부착하는 동작; 제1 몰딩 부재를 이용하여 상기 제1 면을 몰딩하는 동작; 상기 제1 몰딩 부재를 그라인딩하는 동작; 상기 기판의 제2 면에 적어도 하나의 제2 소자 및 적어도 하나의 연결 부재를 부착하는 동작; 및 전자 장치에 포함되는 인쇄회로기판과 전기적 연결을 위한 랜딩 패드들을 포함하는 인터포저 기판을 상기 기판의 제2 면에 부착하는 동작을 포함할 수 있다. 그 밖의 다양한 실시 예들이 가능하다.

Description

집적 회로 패키지, 그를 포함하는 전자 장치 및 그의 제조 방법
본 개시의 다양한 실시 예들은 집적 회로 패키지, 그를 포함하는 전자 장치 및 그의 제조 방법에 관한 것이다.
전자 장치(예: 이동 단말, 스마트 폰, 태블릿 PC(personal computer), 또는 착용형(wearable) 단말)는 다양한 기능을 제공할 수 있다. 예를 들어, 전자 장치는 촬영 기능, 음악 재생 기능, 네비게이션 기능, 통화 기능, 근거리 무선 통신(예: 블루투스(bluetooth), 와이파이(Wi-Fi), 또는 NFC(near field communication)) 기능, 전자 결제 기능 및/또는 음성 인식 기능을 제공할 수 있다.
전자 장치는 상술한 다양한 기능을 제공하기 위하여 다양한 집적 회로(integrated circuit: IC)들을 포함할 수 있다. 전자 장치에 포함되는 집적 회로들은 다양한 방식(예: BGA(ball grid array), LGA(land grid array))으로 패키징될 수 있다.
최근의 전자 장치에 포함되는 집적 회로들은 가볍고, 얇으며, 소형화가 요구됨에 따라 DSM(double side mold) BGA(ball grid array) 방식을 이용하여 패키징되고 있다.
일반적으로, 상기 DSM BGA 패키지의 공정은 기판의 제1 면(상부면)에 부품(component)(예: 집적 회로, 반도체)들을 실장하고, 제1 면에 실장된 부품들을 보호하기 위하여 제1 면을 몰딩하고, 기판의 제2 면(하부면)에 부품들 및 숄더링 볼을 실장하고, 제2 면을 몰딩하고, 제2 면의 몰딩을 그라인딩하고, 제품 정보를 마킹하고, 숄더링 볼 주변의 몰딩을 레이저 어블레이션(laser ablation)하여 숄더링 볼을 외부로 노출시키고, 리볼링(reballing)하고, 패키지 절단(sawing)하며, 및 전자기 차폐(electromagnetic interference(EMI) shielding)는 공정들을 포함할 수 있다.
하지만, 상기 DSM BGA 패키지는 상기 레이저의 편차 및/또는 가공 오차로 인하여 숄더링 볼 주변의 몰딩이 일정하게 어블레이션되지 않고, 편차가 발생할 수 있다. 상기 DSM BGA 패키지는 몰딩이 비정상적으로 어블레이션된 상태에서 리볼링하는 경우 숄더링 볼의 형상이 비정상적으로 형성될 수 있다. 숄더링 볼의 형상이 비정상적으로 형성된 상태에서 DSM BGA 패키지를 인쇄회로기판에 실장하는 경우, 실장 불량(예: 단락(short) 불량 및/또는 젖음성(non-wet, wettability) 불량)이 발생할 수 있다.
또한, 상기 DSM BGA 패키지의 하부면의 몰딩을 그라인드하는 경우 하부면에 실장된 부품들이 외부로 노출될 수 있다. 이로 인하여, 기판의 하부면에 실장된 부품들이 외부의 충격을 받은 경우, 불량(예: 크랙(crack))이 발생할 수 있다.
한편, 동일한 기능을 가지는 집적 회로를 다수의 업체에서 제조하는 경우, 동일한 기능을 가지는 집적회로일지라도 각 업체에 따라 기판에 실장되는 부품이 다르게 배치될 수 있다. 또한, 동일한 기능을 가지는 다른 부품이 패키징될 수 있다. 이러한 경우 각 업체마다 DSM BGA 패키징의 볼 맵이 상이하게 형성될 수 있다. 예를 들면, DSM BGA 패키지가 실장되는 인쇄회로기판의 설계는 각 DSM BGA 패키지의 볼 맵에 대응하여 달라져야 하기 때문이다. 부품 수급 등의 문제로 다수 업체의 집적회로를 이용하여 전자 장치를 제조하는 경우, 전자 장치의 제조사는 각각의 다수 업체가 설계한 집적회로에 대응하여 전자 장치에 포함되는 인쇄회로기판을 각각 설계 및 제작해야 한다.
본 개시의 다양한 실시 예들은 인터포저 기판을 이용하여 불량율을 감소할 수 있고, 핀 맵(또는 볼 맵)을 공용화할 수 있고, 패키징 사이즈를 감소할 수 있는 집적 회로 패키지, 그를 포함하는 전자 장치 및 그의 제조 방법을 제공할 수 있다.
본 개시의 다양한 실시 예에 따른 전자 장치는, 예를 들면, 인쇄회로기판; 및 상기 인쇄회로기판에 부착되는 집적 회로 패키지를 포함하고, 상기 집적 회로 패키지는 제1 면 및 상기 제1 면의 반대면인 제2 면에 다수의 소자들이 부착되는 기판; 상기 기판의 제1 면을 커버하는 제1 몰딩 부재; 상기 기판의 제2 면에 부착되며, 상기 인쇄회로기판과 전기적 연결을 위한 랜딩 패드들을 포함하는 인터포저 기판; 및 상기 기판과 상기 인터포저 기판을 전기적으로 연결하는 연결 부재를 포함할 수 있다.
본 개시의 다양한 실시 예에 따른 집적 회로 패키지는, 예를 들면, 제1 면 및 상기 제1 면의 반대면인 제2 면에 다수의 소자들이 부착되는 기판; 상기 기판의 제1 면을 커버하는 제1 몰딩 부재; 상기 기판의 제2 면에 부착되며, 전자 장치에 포함되는 인쇄회로기판과 전기적 연결을 위한 랜딩 패드들을 포함하는 인터포저 기판; 및 상기 기판과 상기 인터포저 기판을 전기적으로 연결하는 연결 부재를 포함할 수 있다.
본 개시의 다양한 실시 예에 따른 집적 회로 패키지의 제조 방법은, 예를 들면, 기판의 제1 면에 적어도 하나의 제1 소자를 부착하는 동작; 제1 몰딩 부재를 이용하여 상기 제1 면을 몰딩하는 동작; 상기 제1 몰딩 부재를 그라인딩하는 동작; 상기 기판의 제2 면에 적어도 하나의 제2 소자 및 적어도 하나의 연결 부재를 부착하는 동작; 및 전자 장치에 포함되는 인쇄회로기판과 전기적 연결을 위한 랜딩 패드들을 포함하는 인터포저 기판을 상기 기판의 제2 면에 부착하는 동작을 포함할 수 있다.
본 개시의 다양한 실시 예들은 랜딩 패드를 포함하는 인터포저 기판을 이용하여 기판의 하부면을 패키징함에 따라, DSM BGA 패키징 공정의 레이저 어블레이션의 편차로 인한, 숄더링 볼의 불량 및/또는 집적 회로 패키지의 실장 불량이 해소될 수 있다.
본 개시의 다양한 실시 예들은 기판의 하부면에 실장되는 부품들의 배치 및/또는 크기가 상이하더라도 인터포저 기판을 이용하여 집적 회로의 핀 맵(또는 볼 맵)을 공용화할 수 있다.
본 개시의 다양한 실시 예들은 기판의 하부면에 인터포저 기판을 실장함에 따라 하부면에 실장된 부품들이 외부로 노출되지 않아, 내부 부품을 보호(예: 손상을 방지)할 수 있고, 집적 회로 패키지의 강도를 보완할 수 있다.
본 개시의 다양한 실시 예들은 인터포저 기판을 이용하여 핀 맵(또는 볼 맵)을 최적화할 수 있어, 집적 회로 패키지의 사이즈를 감소할 수 있다.
본 개시의 다양한 실시 예들은 하부면의 몰딩 공정을 제거하여, 집적 회로의 제조(또는 패키징)를 위한 시간 및/또는 비용을 감소할 수 있다.
도 1은 본 개시의 다양한 실시 예들에 따른, 네트워크 환경 내의 전자 장치의 블록도이다.
도 2a는 본 개시의 한 실시 예들에 따른 집적 회로 패키지의 단면도이다.
도 2b는 본 개시의 한 실시 예들에 따른 집적 회로 패키지의 하부면의 핀 맵의 일 예를 도시한 도면이다.
도 3a는 본 개시의 다른 실시 예에 따른 집적 회로 패키지의 단면도이다.
도 3b는 본 개시의 다른 실시 예에 따른 집적 회로 패키지의 하부면의 볼 맵의 일 예를 도시한 도면이다.
도 4는 본 개시의 또 다른 실시 예에 따른 집적 회로 패키지의 단면도이다.
도 5a는 본 개시의 다양한 실시 예에 따른 집적 회로 패키지의 핀 맵의 공용화를 설명하기 위한 도면이다.
도 5b는 본 개시의 다양한 실시 예에 따른 집적 회로 패키지의 핀 맵의 공용화를 설명하기 위한 도면이다.
도 6a는 본 개시의 다양한 실시 예에 따른 집적 회로 패키지의 패키징 방법을 설명하는 흐름도이다.
도 6b는 본 개시의 다양한 실시 예에 따른 집적 회로 패키지의 패키징 방법을 설명하기 위한 예시도이다.
이하, 첨부된 도면을 참조하여 본 개시의 다양한 실시 예들을 설명한다. 본 개시는 특정 실시 예들이 도면에 예시되고 관련된 상세한 설명이 기재되어 있으나, 이는 본 개시의 다양한 실시 예들을 특정한 형태로 한정하려는 것이 아니다. 예를 들어, 본 개시의 실시 예들은 다양하게 변경될 수 있다는 것은 본 개시가 속하는 기술 분야에서 통상의 지식을 가진 자에게 자명한 것이다.
도 1은 본 개시의 한 실시 예에 따른, 네트워크 환경 내의 전자 장치의 블록도이다.
도 1을 참조하면, 네트워크 환경(100)에서 전자 장치(101)는 제 1 네트워크(198)(예: 근거리 무선 통신 네트워크)를 통하여 전자 장치(102)와 통신하거나, 또는 제 2 네트워크(199)(예: 원거리 무선 통신 네트워크)를 통하여 전자 장치(104) 또는 서버(108)와 통신할 수 있다. 일 실시 예에 따르면, 전자 장치(101)는 서버(108)를 통하여 전자 장치(104)와 통신할 수 있다. 일 실시 예에 따르면, 전자 장치(101)는 프로세서(120), 메모리(130), 입력 모듈(150), 음향 출력 모듈(155), 디스플레이 모듈(160), 오디오 모듈(170), 센서 모듈(176), 인터페이스(177), 연결 단자(178), 햅틱 모듈(179), 카메라 모듈(180), 전력 관리 모듈(188), 배터리(189), 통신 모듈(190), 가입자 식별 모듈(196), 또는 안테나 모듈(197)을 포함할 수 있다. 어떤 실시 예에서는, 전자 장치(101)에는, 이 구성 요소들 중 적어도 하나(예: 연결 단자(178))가 생략되거나, 하나 이상의 다른 구성 요소가 추가될 수 있다. 어떤 실시 예에서는, 이 구성 요소들 중 일부들(예: 센서 모듈(176), 카메라 모듈(180), 또는 안테나 모듈(197))은 하나의 구성 요소(예: 디스플레이 모듈(160))로 통합될 수 있다.
프로세서(120)는, 예를 들면, 소프트웨어(예: 프로그램(140))를 실행하여 프로세서(120)에 연결된 전자 장치(101)의 적어도 하나의 다른 구성 요소(예: 하드웨어 또는 소프트웨어 구성 요소)를 제어할 수 있고, 다양한 데이터 처리 또는 연산을 수행할 수 있다. 일 실시 예에 따르면, 데이터 처리 또는 연산의 적어도 일부로서, 프로세서(120)는 다른 구성 요소(예: 센서 모듈(176) 또는 통신 모듈(190))로부터 수신된 명령 또는 데이터를 휘발성 메모리(132)에 저장하고, 휘발성 메모리(132)에 저장된 명령 또는 데이터를 처리하고, 결과 데이터를 비휘발성 메모리(134)에 저장할 수 있다. 일 실시 예에 따르면, 프로세서(120)는 메인 프로세서(121)(예: 중앙 처리 장치 또는 어플리케이션 프로세서) 또는 이와는 독립적으로 또는 함께 운영 가능한 보조 프로세서(123)(예: 그래픽 처리 장치, 신경망 처리 장치(NPU: neural processing unit), 이미지 시그널 프로세서, 센서 허브 프로세서, 또는 커뮤니케이션 프로세서)를 포함할 수 있다. 예를 들어, 전자 장치(101)가 메인 프로세서(121) 및 보조 프로세서(123)를 포함하는 경우, 보조 프로세서(123)는 메인 프로세서(121)보다 저전력을 사용하거나, 지정된 기능에 특화되도록 설정될 수 있다. 보조 프로세서(123)는 메인 프로세서(121)와 별개로, 또는 그 일부로서 구현될 수 있다.
보조 프로세서(123)는, 예를 들면, 메인 프로세서(121)가 인액티브(예: 슬립) 상태에 있는 동안 메인 프로세서(121)를 대신하여, 또는 메인 프로세서(121)가 액티브(예: 어플리케이션 실행) 상태에 있는 동안 메인 프로세서(121)와 함께, 전자 장치(101)의 구성 요소들 중 적어도 하나의 구성 요소(예: 디스플레이 모듈(160), 센서 모듈(176), 또는 통신 모듈(190))와 관련된 기능 또는 상태들의 적어도 일부를 제어할 수 있다. 일 실시 예에 따르면, 보조 프로세서(123)(예: 이미지 시그널 프로세서 또는 커뮤니케이션 프로세서)는 기능적으로 관련 있는 다른 구성 요소(예: 카메라 모듈(180) 또는 통신 모듈(190))의 일부로서 구현될 수 있다. 일 실시 예에 따르면, 보조 프로세서(123)(예: 신경망 처리 장치)는 인공지능 모델의 처리에 특화된 하드웨어 구조를 포함할 수 있다. 인공지능 모델은 기계 학습을 통해 생성될 수 있다. 이러한 학습은, 예를 들어, 인공지능이 수행되는 전자 장치(101) 자체에서 수행될 수 있고, 별도의 서버(예: 서버(108))를 통해 수행될 수도 있다. 학습 알고리즘은, 예를 들어, 지도형 학습(supervised learning), 비지도형 학습(unsupervised learning), 준지도형 학습(semi-supervised learning) 또는 강화 학습(reinforcement learning)을 포함할 수 있으나, 전술한 예에 한정되지 않는다. 인공지능 모델은, 복수의 인공 신경망 레이어들을 포함할 수 있다. 인공 신경망은 심층 신경망(DNN: deep neural network), CNN(convolutional neural network), RNN(recurrent neural network), RBM(restricted boltzmann machine), DBN(deep belief network), BRDNN(bidirectional recurrent deep neural network), 심층 Q-네트워크(deep Q-networks) 또는 상기 중 둘 이상의 조합 중 하나일 수 있으나, 전술한 예에 한정되지 않는다. 인공지능 모델은 하드웨어 구조 이외에, 추가적으로 또는 대체적으로, 소프트웨어 구조를 포함할 수 있다.
메모리(130)는, 전자 장치(101)의 적어도 하나의 구성 요소(예: 프로세서(120) 또는 센서 모듈(176))에 의해 사용되는 다양한 데이터를 저장할 수 있다. 데이터는, 예를 들어, 소프트웨어(예: 프로그램(140)) 및, 이와 관련된 명령에 대한 입력 데이터 또는 출력 데이터를 포함할 수 있다. 메모리(130)는, 휘발성 메모리(132) 또는 비휘발성 메모리(134)를 포함할 수 있다.
프로그램(140)은 메모리(130)에 소프트웨어로서 저장될 수 있으며, 예를 들면, 운영 체제(142), 미들 웨어(144) 또는 어플리케이션(146)을 포함할 수 있다.
입력 모듈(150)은, 전자 장치(101)의 구성 요소(예: 프로세서(120))에 사용될 명령 또는 데이터를 전자 장치(101)의 외부(예: 사용자)로부터 수신할 수 있다. 입력 모듈(150)은, 예를 들면, 마이크, 마우스, 키보드, 키(예: 버튼), 또는 디지털 펜(예: 스타일러스 펜)을 포함할 수 있다.
음향 출력 모듈(155)은 음향 신호를 전자 장치(101)의 외부로 출력할 수 있다. 음향 출력 모듈(155)은, 예를 들면, 스피커 또는 리시버를 포함할 수 있다. 스피커는 멀티미디어 재생 또는 녹음 재생과 같이 일반적인 용도로 사용될 수 있다. 리시버는 착신 전화를 수신하기 위해 사용될 수 있다. 일 실시 예에 따르면, 리시버는 스피커와 별개로, 또는 그 일부로서 구현될 수 있다.
디스플레이 모듈(160)은 전자 장치(101)의 외부(예: 사용자)로 정보를 시각적으로 제공할 수 있다. 디스플레이 모듈(160)은, 예를 들면, 디스플레이, 홀로그램 장치, 또는 프로젝터 및 해당 장치를 제어하기 위한 제어 회로를 포함할 수 있다. 일 실시 예에 따르면, 디스플레이 모듈(160)은 터치를 감지하도록 설정된 터치 센서, 또는 상기 터치에 의해 발생되는 힘의 세기를 측정하도록 설정된 압력 센서를 포함할 수 있다.
오디오 모듈(170)은 소리를 전기 신호로 변환시키거나, 반대로 전기 신호를 소리로 변환시킬 수 있다. 일 실시 예에 따르면, 오디오 모듈(170)은, 입력 모듈(150)을 통해 소리를 획득하거나, 음향 출력 모듈(155), 또는 전자 장치(101)와 직접 또는 무선으로 연결된 외부 전자 장치(예: 전자 장치(102))(예: 스피커 또는 헤드폰)를 통해 소리를 출력할 수 있다.
센서 모듈(176)은 전자 장치(101)의 작동 상태(예: 전력 또는 온도), 또는 외부의 환경 상태(예: 사용자 상태)를 감지하고, 감지된 상태에 대응하는 전기 신호 또는 데이터 값을 생성할 수 있다. 일 실시 예에 따르면, 센서 모듈(176)은, 예를 들면, 제스처 센서, 자이로 센서, 기압 센서, 마그네틱 센서, 가속도 센서, 그립 센서, 근접 센서, 컬러 센서, IR(infrared) 센서, 생체 센서, 온도 센서, 습도 센서, 또는 조도 센서를 포함할 수 있다.
인터페이스(177)는 전자 장치(101)가 외부 전자 장치(예: 전자 장치(102))와 직접 또는 무선으로 연결되기 위해 사용될 수 있는 하나 이상의 지정된 프로토콜들을 지원할 수 있다. 일 실시 예에 따르면, 인터페이스(177)는, 예를 들면, HDMI(high definition multimedia interface), USB(universal serial bus) 인터페이스, SD카드 인터페이스, 또는 오디오 인터페이스를 포함할 수 있다.
연결 단자(178)는, 그를 통해서 전자 장치(101)가 외부 전자 장치(예: 전자 장치(102))와 물리적으로 연결될 수 있는 커넥터를 포함할 수 있다. 일 실시 예에 따르면, 연결 단자(178)는, 예를 들면, HDMI 커넥터, USB 커넥터, SD 카드 커넥터, 또는 오디오 커넥터(예: 헤드폰 커넥터)를 포함할 수 있다.
햅틱 모듈(179)은 전기적 신호를 사용자가 촉각 또는 운동 감각을 통해서 인지할 수 있는 기계적인 자극(예: 진동 또는 움직임) 또는 전기적인 자극으로 변환할 수 있다. 일 실시 예에 따르면, 햅틱 모듈(179)은, 예를 들면, 모터, 압전 소자, 또는 전기 자극 장치를 포함할 수 있다.
카메라 모듈(180)은 정지 영상 및 동영상을 촬영할 수 있다. 일 실시 예에 따르면, 카메라 모듈(180)은 하나 이상의 렌즈들, 이미지 센서들, 이미지 시그널 프로세서들, 또는 플래시들을 포함할 수 있다.
전력 관리 모듈(188)은 전자 장치(101)에 공급되는 전력을 관리할 수 있다. 일 실시 예에 따르면, 전력 관리 모듈(188)은, 예를 들면, PMIC(power management integrated circuit)의 적어도 일부로서 구현될 수 있다.
배터리(189)는 전자 장치(101)의 적어도 하나의 구성 요소에 전력을 공급할 수 있다. 일 실시 예에 따르면, 배터리(189)는, 예를 들면, 재충전 불가능한 1차 전지, 재충전 가능한 2차 전지 또는 연료 전지를 포함할 수 있다.
통신 모듈(190)은 전자 장치(101)와 외부 전자 장치(예: 전자 장치(102), 전자 장치(104), 또는 서버(108)) 간의 직접(예: 유선) 통신 채널 또는 무선 통신 채널의 수립, 및 수립된 통신 채널을 통한 통신 수행을 지원할 수 있다. 통신 모듈(190)은 프로세서(120)(예: 어플리케이션 프로세서)와 독립적으로 운영되고, 직접(예: 유선) 통신 또는 무선 통신을 지원하는 하나 이상의 커뮤니케이션 프로세서를 포함할 수 있다. 일 실시 예에 따르면, 통신 모듈(190)은 무선 통신 모듈(192)(예: 셀룰러 통신 모듈, 근거리 무선 통신 모듈, 또는 GNSS(global navigation satellite system) 통신 모듈) 또는 유선 통신 모듈(194)(예: LAN(local area network) 통신 모듈, 또는 전력선 통신 모듈)을 포함할 수 있다. 이들 통신 모듈 중 해당하는 통신 모듈은 제 1 네트워크(198)(예: 블루투스, WiFi(wireless fidelity) direct 또는 IrDA(infrared data association)와 같은 근거리 통신 네트워크) 또는 제 2 네트워크(199)(예: 레거시 셀룰러 네트워크, 5G 네트워크, 차세대 통신 네트워크, 인터넷, 또는 컴퓨터 네트워크(예: LAN 또는 WAN)와 같은 원거리 통신 네트워크)를 통하여 외부의 전자 장치(104)와 통신할 수 있다. 이런 여러 종류의 통신 모듈들은 하나의 구성 요소(예: 단일 칩)로 통합되거나, 또는 서로 별도의 복수의 구성 요소들(예: 복수 칩들)로 구현될 수 있다. 무선 통신 모듈(192)은 가입자 식별 모듈(196)에 저장된 가입자 정보(예: 국제 모바일 가입자 식별자(IMSI))를 이용하여 제 1 네트워크(198) 또는 제 2 네트워크(199)와 같은 통신 네트워크 내에서 전자 장치(101)를 확인 또는 인증할 수 있다.
무선 통신 모듈(192)은 4G 네트워크 이후의 5G 네트워크 및 차세대 통신 기술, 예를 들어, NR 접속 기술(new radio access technology)을 지원할 수 있다. NR 접속 기술은 고용량 데이터의 고속 전송(eMBB(enhanced mobile broadband)), 단말 전력 최소화와 다수 단말의 접속(mMTC(massive machine type communications)), 또는 고신뢰도와 저지연(URLLC(ultra-reliable and low-latency communications))을 지원할 수 있다. 무선 통신 모듈(192)은, 예를 들어, 높은 데이터 전송률 달성을 위해, 고주파 대역(예: mmWave 대역)을 지원할 수 있다. 무선 통신 모듈(192)은 고주파 대역에서의 성능 확보를 위한 다양한 기술들, 예를 들어, 빔포밍(beamforming), 거대 배열 다중 입출력(massive MIMO(multiple-input and multiple-output)), 전차원 다중입출력(FD-MIMO: full dimensional MIMO), 어레이 안테나(array antenna), 아날로그 빔형성(analog beam-forming), 또는 대규모 안테나(large scale antenna)와 같은 기술들을 지원할 수 있다. 무선 통신 모듈(192)은 전자 장치(101), 외부 전자 장치(예: 전자 장치(104)) 또는 네트워크 시스템(예: 제 2 네트워크(199))에 규정되는 다양한 요구사항을 지원할 수 있다. 일 실시 예에 따르면, 무선 통신 모듈(192)은 eMBB 실현을 위한 Peak data rate(예: 20Gbps 이상), mMTC 실현을 위한 손실 Coverage(예: 164dB 이하), 또는 URLLC 실현을 위한 U-plane latency(예: 다운링크(DL) 및 업링크(UL) 각각 0.5ms 이하, 또는 라운드 트립 1ms 이하)를 지원할 수 있다.
안테나 모듈(197)은 신호 또는 전력을 외부(예: 외부의 전자 장치)로 송신하거나 외부로부터 수신할 수 있다. 일 실시 예에 따르면, 안테나 모듈(197)은 서브스트레이트(예: PCB) 위에 형성된 도전체 또는 도전성 패턴으로 이루어진 방사체를 포함하는 안테나를 포함할 수 있다. 일 실시 예에 따르면, 안테나 모듈(197)은 복수의 안테나들(예: 어레이 안테나)을 포함할 수 있다. 이런 경우, 제 1 네트워크(198) 또는 제 2 네트워크(199)와 같은 통신 네트워크에서 사용되는 통신 방식에 적합한 적어도 하나의 안테나가, 예를 들면, 통신 모듈(190)에 의하여 상기 복수의 안테나들로부터 선택될 수 있다. 신호 또는 전력은 상기 선택된 적어도 하나의 안테나를 통하여 통신 모듈(190)과 외부의 전자 장치 간에 송신되거나 수신될 수 있다. 어떤 실시 예에 따르면, 방사체 이외에 다른 부품(예: RFIC(radio frequency integrated circuit))이 추가로 안테나 모듈(197)의 일부로 형성될 수 있다.
다양한 실시 예에 따르면, 안테나 모듈(197)은 mmWave 안테나 모듈을 형성할 수 있다. 일 실시 예에 따르면, mmWave 안테나 모듈은 인쇄 회로 기판, 상기 인쇄 회로 기판의 제 1 면(예: 아래 면)에 또는 그에 인접하여 배치되고 지정된 고주파 대역(예: mmWave 대역)을 지원할 수 있는 RFIC, 및 상기 인쇄 회로 기판의 제 2 면(예: 윗 면 또는 측 면)에 또는 그에 인접하여 배치되고 상기 지정된 고주파 대역의 신호를 송신 또는 수신할 수 있는 복수의 안테나들(예: 어레이 안테나)을 포함할 수 있다.
상기 구성 요소들 중 적어도 일부는 주변 기기들간 통신 방식(예: 버스, GPIO(general purpose input and output), SPI(serial peripheral interface), 또는 MIPI(mobile industry processor interface))을 통해 서로 연결되고 신호(예: 명령 또는 데이터)를 상호간에 교환할 수 있다.
일 실시 예에 따르면, 명령 또는 데이터는 제 2 네트워크(199)에 연결된 서버(108)를 통해서 전자 장치(101)와 외부의 전자 장치(104)간에 송신 또는 수신될 수 있다. 외부의 전자 장치(102, 또는 104) 각각은 전자 장치(101)와 동일한 또는 다른 종류의 장치일 수 있다. 일 실시 예에 따르면, 전자 장치(101)에서 실행되는 동작들의 전부 또는 일부는 외부의 전자 장치들(102, 104, 또는 108) 중 하나 이상의 외부의 전자 장치들에서 실행될 수 있다. 예를 들면, 전자 장치(101)가 어떤 기능이나 서비스를 자동으로, 또는 사용자 또는 다른 장치로부터의 요청에 반응하여 수행해야 할 경우에, 전자 장치(101)는 기능 또는 서비스를 자체적으로 실행시키는 대신에 또는 추가적으로, 하나 이상의 외부의 전자 장치들에게 그 기능 또는 그 서비스의 적어도 일부를 수행하라고 요청할 수 있다. 상기 요청을 수신한 하나 이상의 외부의 전자 장치들은 요청된 기능 또는 서비스의 적어도 일부, 또는 상기 요청과 관련된 추가 기능 또는 서비스를 실행하고, 그 실행의 결과를 전자 장치(101)로 전달할 수 있다. 전자 장치(101)는 상기 결과를, 그대로 또는 추가적으로 처리하여, 상기 요청에 대한 응답의 적어도 일부로서 제공할 수 있다. 이를 위하여, 예를 들면, 클라우드 컴퓨팅, 분산 컴퓨팅, 모바일 에지 컴퓨팅(MEC: mobile edge computing), 또는 클라이언트-서버 컴퓨팅 기술이 이용될 수 있다. 전자 장치(101)는, 예를 들어, 분산 컴퓨팅 또는 모바일 에지 컴퓨팅을 이용하여 초저지연 서비스를 제공할 수 있다. 다른 실시 예에 있어서, 외부의 전자 장치(104)는 IoT(internet of things) 기기를 포함할 수 있다. 서버(108)는 기계 학습 및/또는 신경망을 이용한 지능형 서버일 수 있다. 일 실시 예에 따르면, 외부의 전자 장치(104) 또는 서버(108)는 제 2 네트워크(199) 내에 포함될 수 있다. 전자 장치(101)는 5G 통신 기술 및 IoT 관련 기술을 기반으로 지능형 서비스(예: 스마트 홈, 스마트 시티, 스마트 카, 또는 헬스 케어)에 적용될 수 있다.
다양한 실시 예에 따르면, 전자 장치(101)에 포함된 다양한 구성들 중 적어도 일부(예: 프로세서(120), 메모리(130), 통신 모듈(190), 전력 관리 모듈(188), 오디오 모듈(170))는 집적 회로(integrated circuit: IC)일 수 있다. 집적 회로는 다양한 방식(예: BGA(ball grid array), LGA(land grid array))으로 패키징될 수 있다. 본 개시의 다양한 실시 예들은 집적 회로를 패키징하는 새로운 구조 및 방법(제조 공정)을 제공할 수 있다. 이하에서는, 본 개시의 다양한 실시 예에 따른 집적 회로의 패키징 구조 및 방법에 대하여 설명하기로 한다.
도 2a는 본 개시의 한 실시 예들에 따른 집적 회로 패키지의 단면도이고, 도 2b는 본 개시의 한 실시 예들에 따른 집적 회로 패키지의 하부면의 핀 맵의 일 예를 도시한 도면이다.
도 2a 및 도 2b를 참조하면, 본 개시의 한 실시 예에 따른 집적 회로 패키지(200)는 기판(substrate)(210), 제1 몰딩 부재(220), 제2 몰딩 부재(230), 인터포저 기판(interposer PCB(printed circuit board))(240), 연결 부재(250) 및 다수의 소자(또는 부품)(260)를 포함할 수 있다.
다양한 실시 예에 따르면, 집적 회로 패키지(200)는 집적 회로(예: 반도체 칩)를 전자 장치(예: 전자 장치(101))에 포함되는 인쇄회로기판(미도시)에 부착(또는 접착, 접합, 결합, 적층)(예: 표면 실장(surface mount))할 수 있도록 패키징하여 형성될 수 있다. 예를 들어, 기판(210)의 제1 면(상부면)에 다수의 제1 소자들(예: 트랜지스터, 다이오드, 캐패시터, 저항 등)(261)을 부착하고, 다수의 제1 소자들(261)을 보호하기 위해 제1 몰딩 부재(220)(예: 세라믹, 금속, 플라스틱(예: 에폭시 몰딩 컴파운드(expoxy molding compound: EMC)))로 기판(210)의 제1 면의 적어도 일부를 몰딩할 수 있다. 다른 실시 예에 따르면, 제1 몰딩 부재(220)에는 전자기 차폐 물질이 첨가되거나, 제1 몰딩 부재(220)의 표면에 전자기 차폐 물질이 도포 또는 부착되어 전자기 차폐 구조를 제공할 수 있다. 이후, 기판(210)의 제2 면(하부면)에 다수의 제2 소자들(262) 및 연결 부재(250)를 부착하고, 제2 몰딩 부재(230)로 기판(210)의 제2 면의 적어도 일부를 몰딩할 수 있다. 기판(210)의 제2 면을 몰딩한 후 연결 부재(250)가 외부로 노출되도록, 제2 몰딩 부재(230)는 그라인딩(grinding)될 수 있다. 일 실시 예에 따르면, 상기 그라인딩으로 인하여, 제2 소자들(262) 중 적어도 일부의 외면이 외부로 노출될 수 있다.
상기 제2 몰딩 부재(230)를 그라인딩한 후 인터포저 기판(240)은 기판(210)의 제2 면에 부착될 수 있다. 인터포저 기판(240)은 연결 부재(250)를 통해 기판(210)에 부착될 수 있다. 연결 부재(250) 중 적어도 일부는 기판(210)과 인터포저 기판(240)을 전기적으로 연결할 수 있다. 인터포저 기판(240)은 인쇄회로기판(미도시)과 전기적 연결을 위한 랜딩 패드(241)를 포함할 수 있다. 랜딩 패드(241)는, 도 2b에 도시된 바와 같이, 인터포저 기판(240)의 제1 면(기판(210)의 제2 면과 마주보는 면)(상부면)의 반대면인 제2 면(하부면)에 다행 다열로 배치될 수 있다. 도 2b에 도시된 랜딩 패드(241)의 배치(핀 맵)은 일 예일뿐, 본 개시의 실시 예를 한정하지는 않는다.
다양한 실시 예에 따르면, 연결 부재(250)는 인터포저 기판(240)과 기판(210) 사이를 전기적 연결할 수 있으며, 인터포저 볼, 숄더링 볼, 구리 코어드 볼(cu-cored ball), 또는 구리 포스트(cu-post)를 포함할 수 있다.
도 3a는 본 개시의 다른 실시 예에 따른 집적 회로 패키지의 단면도이고, 도 3b는 본 개시의 다른 실시 예에 따른 집적 회로 패키지의 하부면의 볼 맵의 일 예를 도시한 도면이다.
도 3a 및 도 3b를 참조하면, 본 개시의 다른 실시 예에 따른 집적 회로 패키지(300)는 기판(310), 제1 몰딩 부재(320), 제2 몰딩 부재(330), 인터포저 기판(340), 연결 부재(350), 제1 소자들(361) 및 제2 소자들(362)을 포함하는 다수의 소자(또는 부품)(360) 및 숄더링 볼(370)을 포함할 수 있다.
상기 기판(310), 제1 몰딩 부재(320), 제2 몰딩 부재(330), 인터포저 기판(340), 연결 부재(350), 및 다수의 소자(360)는 도 2a의 기판(210), 제1 몰딩 부재(220), 제2 몰딩 부재(230), 인터포저 기판(240), 연결 부재(250) 및 다수의 소자(260)와 각각 동일(또는 유사)할 수 있다. 이에 상세한 설명을 생략하기로 한다.
다양한 실시 예에 따르면, 집적 회로 패키지(300)는 볼 작업(예: 볼 드랍(ball drop))을 통해 랜딩 패드(341)에 숄더링 볼(370)을 형성할 수 있다. 이를 통해, 집적 회로 패키지(300)는 BGA 타입으로 형성될 수 있다. 일 실시 예에 따르면, 집적 회로 패키지(300)의 랜딩 패드(341)는, 도 2b에 도시된 형상(예: 직사각형)과 달리, 볼 형성에 적합한 형상을 가질 수 있다.
도 4는 본 개시의 또 다른 실시 예에 따른 집적 회로 패키지의 단면도이다.
도 4를 참조하면, 본 개시의 또 다른 실시 예에 따른 집적 회로 패키지(400)는 기판(410), 제1 몰딩 부재(420), 인터포저 기판(440), 연결 부재(450), 및 제1 소자들(461) 및 제2 소자들(462)을 포함하는 다수의 소자(또는 부품)(460)을 포함할 수 있다.
상기 기판(410), 제1 몰딩 부재(420), 인터포저 기판(440), 연결 부재(450), 및 다수의 소자(또는 부품)(460)은 도 2a의 기판(210), 제1 몰딩 부재(220), 인터포저 기판(240), 연결 부재(250) 및 다수의 소자(260)와 각각 동일(또는 유사)할 수 있다. 이에 상세한 설명을 생략하기로 한다.
다양한 실시 예에 따르면, 집적 회로 패키지(400)는 기판(410)의 제2 면을 몰딩하지 않는다. 이는 인터포저 기판(440)에 의해 기판(410)의 제2 면이 보호될 수 있기 때문이다. 제2 면을 몰딩하지 않아, 집적 회로 패키지(400)는 제조 시간, 제조 비용을 감소할 수 있고, 제조 공정을 단순화할 수 있다.
일 실시 예에 따르면, 집적 회로 패키지(400)는, 도 3a의 집적 회로 패키지(400)와 유사하게, 랜딩 패드(441)에 숄더링 볼(미도시)을 더 포함할 수 있다.
도 5a는 본 개시의 다양한 실시 예에 따른 집적 회로 패키지의 핀 맵의 공용화를 설명하기 위한 도면이고, 도 5b는 본 개시의 다양한 실시 예에 따른 집적 회로 패키지의 핀 맵의 공용화를 설명하기 위한 도면이다.
도 5a 및 도 5b를 참조하면, 본 개시의 다양한 실시 예에 따른 전자 장치에 포함되는 집적 회로 패키지(예: 집적 회로 패키지(200, 300, 400))는 다수의 패키징 업체에서 생산될 수 있다. 이는 전자 장치의 제조사가, 집적 회로 패키지의 원할한 수급을 위하여, 다수의 패키징 업체에 의해 생산된 다수의 집적회로 패키지를 이용하여 전자 장치를 제조할 수 있기 때문이다. 집적 회로 패키지는, 패키지 업체에 따라, 내부에 위치하는 다수의 소자들의 배치가 상이할 수 있다. 예를 들어, 제1 패키징 업체에서 생산된 제1 집적 회로 패키지의 제1 기판(510a)은, 도 5a에 도시된 바와 같이, 다수의 제2 소자들(562a)이 제1 배치 구조를 가질 수 있고, 제2 패키징 업체에서 생산된 제2 집적 회로 패키지의 제2 기판(510b)은, 도 5b에 도시된 바와 같이, 다수의 제2 소자들(562b)이 제1 배치 구조와 상이한 제2 배치 구조를 가질 수 있다.
다양한 실시 예에 따르면, 제1 집적 회로 패키지의 랜딩 패드(541a)의 배치 구조 및 제2 집적 회로 패키지의 랜딩 패드(541b)의 배치 구조는 동일할 수 있다. 다시 말해, 제1 집적 회로 패키지 및 제2 집적 회로 패키지는 동일한 핀 맵(또는 볼 맵)을 가질 수 있다. 예를 들어, 도 5a 및 5b에 도시된 바와 같이, 제1 집적 회로 패키지의 제1 인터포저 기판(540a) 및 제2 집적 회로 패키지의 제2 인터포저 기판(540b)의 제2 면의 핀 맵은 동일할 수 있다.
다양한 실시 예에 따르면, 제1 집적 회로 패키지 및 제2 집적 회로 패키지는 기판과 인터포저 기판 사이의 전기적 연결 구조가 상이할 수 있다. 예를 들어, 도 5a 및 도 5b에 도시된 바와 같이, 제1 집적 회로 패키지의 제1 연결 부재(550a) 및/또는 제1 배선(580a)의 배치 및 제2 집적 회로 패키지의 제2 연결 부재(550b) 및/또는 제2 배선(580b)의 배치는 상이할 수 있다.
상술한 바와 같이, 본 개시의 다양한 실시 예는, 인터포저 기판을 이용하여, 다수의 패키징 업체들에서 생산된 집적 회로 패키지들이 핀 맵(또는 볼 맵)을 공용화할 수 있다. 이로 인하여, 전자 장치의 제조사는 각 업체의 집적 회로 패키지에 대응하여 전자 장치의 인쇄회로기판(미도시)을 별도로 설계 및 제작하지 않을 수 있다. 따라서, 전자 장치의 제조사는 전자 장치의 제조 비용 및/또는 제조 시간을 감소할 수 있다.
도 6a는 본 개시의 다양한 실시 예에 따른 집적 회로 패키지의 패키징 방법을 설명하는 흐름도이고, 도 6b는 본 개시의 다양한 실시 예에 따른 집적 회로 패키지의 패키징 방법을 설명하기 위한 예시도이다.
도 6a 및 도 6b를 참조하면, 본 개시의 다양한 실시 예에 따른 집적 회로 패키지(예: 집적 회로 패키지(200, 300, 400))의 패키징 방법은, 601 동작에서, 기판(예: 기판(210, 310, 410), 제1 기판(510a), 제2 기판(510b))의 제1 면에 다수의 소자를 부착할 수 있다. 예를 들어, 다수의 제1 소자들(661)(예: 다수의 제1 소자들(261))은 기판(610)의 제1 면에 표면 실장(surface mounting)될 수 있다.
다양한 실시 예에 따르면, 상기 방법은, 603 동작에서, 와이어를 본딩할 수 있다. 예를 들어, 제1 소자들(661) 간에 전기적 연결 공정 및/또는 제1 소자들(661)과 기판(610) 간에 전기적 연결 공정이 도전성 와이어(예: 골드 와이어(gold wire))를 이용하여 수행될 수 있다.
다양한 실시 예에 따르면, 상기 방법은, 605 동작에서, 제1 면을 몰딩하고, 그라인딩할 수 있다. 예를 들어, 도 6b의 식별 부호 631의 도면에 도시된 바와 같이, 기판(610)의 제1 면에 다수의 제1 소자들(661)을 실장하고, 제1 몰딩 부재(620)(예: 제1 몰딩 부재(220, 320, 420))를 이용하여 제1 면을 몰딩하고, 제1 몰딩 부재(620)를 그라인딩하여 제1 면에 대한 패키징 공정을 수행할 수 있다.
다양한 실시 예에 따르면, 상기 방법은, 607 동작에서, 기판의 제2 면에 다수의 제2 소자들(662)(예: 제2 소자들(262, 562a, 562b)) 및 연결 부재(650)(예: 연결 부재(250, 350, 450), 제1 연결 부재(550a), 제2 연결 부재(550b))를 부착할 수 있다. 예를 들어, 도 6b의 식별 부호 633의 도면에 도시된 바와 같이, 다수의 제2 소자들(662) 및 연결 부재(650)는 기판(610)의 제2 면에 표면 실장될 수 있다.
다양한 실시 예에 따르면, 상기 방법은, 609 동작에서, 제2 면을 몰딩하고, 그라인딩할 수 있다. 예를 들어, 도 6b의 식별 부호 635 및 637의 도면에 도시된 바와 같이, 제2 몰딩 부재(630)(예: 제2 몰딩 부재(230, 330))를 이용하여 기판(610)의 제2 면을 몰딩하고, 연결 부재(650) 및 제2 소자(652)의 표면이 외부로 노출되도록 제2 몰딩 부재(630)의 일부를 그라인딩할 수 있다. 어떤 실시 예에 따르면, 609 동작은 생략될 수 있다. 예를 들어, 도 4의 집적 회로 패키지를 생산하는 경우 609 동작은 생략될 수 있다.
다양한 실시 예에 따르면, 상기 방법은, 611 동작에서, 제2 면에 인터포저 기판(640)(예: 인터포저 기판(240, 340, 440), 제1 인터포저 기판(540a), 제2 인터포저 기판(540b))을 부착할 수 있다. 예를 들어, 도 6b의 식별 부호 639의 도면에 도시된 바와 같이, 기판(610)의 제2 면에 인터포저 기판(640)을 표면 실장할 수 있다.
다양한 실시 예에 따르면, 상기 방법은, 613 동작에서, 인터포저 기판의 랜딩 패드(예: 랜딩 패드(241, 341, 441, 541a, 541b))에 숄더링 볼을 형성할 수 있다. 어떤 실시 예에 따르면, 613 동작은 생략될 수 있다. 예를 들어, 상기 방법은 도 3a 및 도 3b의 집적 회로 패키지와 같이, BGA 타입의 집적 회로 패키지를 생산하는 경우에 613 동작을 수행할 수 있다.
본 개시의 다양한 실시 예에 따르면, 전자 장치(예: 전자 장치(101))는 인쇄회로기판; 및 상기 인쇄회로기판에 부착되는 집적 회로 패키지(예: 집적 회로 패키지(200, 300, 400))를 포함할 수 있다. 상기 집적 회로 패키지는 제1 면 및 상기 제1 면의 반대면인 제2 면에 다수의 소자들이 부착되는 기판(예: 기판(210, 310, 410, 610), 제1 기판(510a), 제2 기판(510b)); 상기 기판의 제1 면을 커버하는 제1 몰딩 부재(예: 제1 몰딩 부재(220, 320, 420, 620)); 상기 기판의 제2 면에 부착되며, 상기 인쇄회로기판과 전기적 연결을 위한 랜딩 패드(예: 랜딩 패드(241, 341, 441, 541a, 541b))들을 포함하는 인터포저 기판(예: 인터포저 기판(240, 340, 440, 640), 제1 인터포저 기판(540a), 제2 인터포저 기판(540b)); 및 상기 기판과 상기 인터포저 기판을 전기적으로 연결하는 연결 부재(예: 연결 부재(250, 350, 450, 650), 제1 연결 부재(550a), 제2 연결 부재(550b))를 포함할 수 있다.
다양한 실시 예에 따르면, 상기 연결 부재는 인터포저 볼을 포함할 수 있다.
다양한 실시 예에 따르면, 상기 기판은 상기 다수의 소자들이 제1 배치 구조를 가지는 제1 기판(예: 제1 기판(510a)); 또는 상기 다수의 소자들이 상기 제1 배치 구조와 상이한 제2 배치 구조를 가지는 제2 기판(예: 제2 기판(510b))을 포함할 수 있다.
다양한 실시 예에 따르면, 상기 인터포저 기판은 상기 제1 기판에 대응하는 제1 인터포저 기판(예: 제1 인터포저 기판(540a)); 또는 상기 제2 기판에 대응하는 제2 인터포저 기판(예: 제2 인터포저 기판(540b))을 포함할 수 있다.
다양한 실시 예에 따르면, 상기 제1 인터포저 기판 및 상기 제2 인터포저 기판은 동일한 구조의 랜딩 패드들을 포함할 수 있고, 상기 제1 기판과 상기 제1 인터포저 기판 사이의 전기적 연결 구조와 상기 제2 기판과 상기 제2 인터포저 기판 사이의 전기적 연결 구조는 상이할 수 있다.
다양한 실시 예에 따르면, 상기 집적 회로 패키지는 상기 기판의 제2 면과 상기 인터포저 기판 사이에 위치하고, 상기 제2 면을 커버하는 제2 몰딩 부재(예: 제2 몰딩 부재(230, 330. 630))를 더 포함할 수 있다.
다양한 실시 예에 따르면, 상기 집적 회로 패키지는 상기 랜딩 패드에 형성되는 숄더링 볼(예: 숄더링 볼(370))을 더 포함할 수 있다.
본 개시의 다양한 실시 예에 따르면, 집적 회로 패키지(예: 집적 회로 패키지(200, 300, 400))는 제1 면 및 상기 제1 면의 반대면인 제2 면에 다수의 소자들이 부착되는 기판(예: 기판(210, 310, 410, 610), 제1 기판(510a), 제2 기판(510b)); 상기 기판의 제1 면을 커버하는 제1 몰딩 부재(예: 제1 몰딩 부재(220, 320, 420, 620)); 상기 기판의 제2 면에 부착되며, 전자 장치에 포함되는 인쇄회로기판과 전기적 연결을 위한 랜딩 패드들(예: 랜딩 패드(241, 341, 441, 541a, 541b))을 포함하는 인터포저 기판(예: 인터포저 기판(240, 340, 440, 640), 제1 인터포저 기판(540a), 제2 인터포저 기판(540b)); 및 상기 기판과 상기 인터포저 기판을 전기적으로 연결하는 연결 부재(예: 연결 부재(250, 350, 450, 650), 제1 연결 부재(550a), 제2 연결 부재(550b))를 포함할 수 있다.
다양한 실시 예에 따르면, 상기 연결 부재는 인터포저 볼을 포함할 수 있다.
다양한 실시 예에 따르면, 상기 기판은 상기 다수의 소자들이 제1 배치 구조를 가지는 제1 기판(예: 제1 기판(510a)); 또는 상기 다수의 소자들이 상기 제1 배치 구조와 상이한 제2 배치 구조를 가지는 제2 기판(예: 제2 기판(510b))을 포함할 수 있다.
다양한 실시 예에 따르면, 상기 인터포저 기판은 상기 제1 기판에 대응하는 제1 인터포저 기판(예: 제1 인터포저 기판(540a)); 또는 상기 제2 기판에 대응하는 제2 인터포저 기판(예: 제2 인터포저 기판(540b))을 포함할 수 있다.
다양한 실시 예에 따르면, 상기 제1 인터포저 기판 및 상기 제2 인터포저 기판은 동일한 구조의 랜딩 패드들을 포함할 수 있고, 상기 제1 기판과 상기 제1 인터포저 기판 사이의 전기적 연결 구조와 상기 제2 기판과 상기 제2 인터포저 기판 사이의 전기적 연결 구조는 상이할 수 있다.
다양한 실시 예에 따르면, 상기 집적회로패키지는 상기 기판의 제2 면과 상기 인터포저 기판 사이에 위치하고, 상기 제2 면을 커버하는 제2 몰딩 부재(예: 제2 몰딩 부재(230, 330, 630))를 더 포함할 수 있다.
다양한 실시 예에 따르면, 상기 집적회로패키지는 상기 랜딩 패드에 형성되는 숄더링 볼(예: 숄더링 볼(370))을 더 포함할 수 있다.
본 개시의 다양한 실시 예에 따르면, 집적 회로 패키지의 제조 방법은 기판(예: 기판(210, 310, 410, 610), 제1 기판(510a), 제2 기판(510b))의 제1 면에 적어도 하나의 제1 소자(예: 제1 소자(261, 361, 461, 661))를 부착하는 동작; 제1 몰딩 부재(예: 제1 몰딩 부재(220, 320, 420, 620))를 이용하여 상기 제1 면을 몰딩하는 동작; 상기 제1 몰딩 부재를 그라인딩하는 동작; 상기 기판의 제2 면에 적어도 하나의 제2 소자(예: 제2 소자(262, 362, 462, 662)) 및 적어도 하나의 연결 부재(예: 연결 부재(250, 350, 450, 650), 제1 연결 부재(550a), 제2 연결 부재(550b))를 부착하는 동작; 및 전자 장치(예: 전자 장치(101))에 포함되는 인쇄회로기판과 전기적 연결을 위한 랜딩 패드들(예: 랜딩 패드(241, 341, 441, 541a, 541b))을 포함하는 인터포저 기판(예: 인터포저 기판(240, 340, 440, 640), 제1 인터포저 기판(540a), 제2 인터포저 기판(540b))을 상기 기판의 제2 면에 부착하는 동작을 포함할 수 있다.
다양한 실시 예에 따르면, 상기 방법은 제2 몰딩 부재(예: 제2 몰딩 부재(230, 330, 630))를 이용하여 상기 제2 면을 몰딩하는 동작; 및 상기 제1 몰딩 부재를 그라인딩하는 동작을 더 포함할 수 있다.
다양한 실시 예에 따르면, 상기 방법은 상기 인터포저 기판의 랜딩 패드들에 숄더링 볼(예: 숄더링 볼(370))을 형성하는 동작을 더 포함할 수 있다.
다양한 실시 예에 따르면, 상기 연결 부재는 인터포저 볼을 포함할 수 있다.
본 개시에 개시된 다양한 실시 예들에 따른 전자 장치는 다양한 형태의 장치가 될 수 있다. 전자 장치는, 예를 들면, 휴대용 통신 장치(예: 스마트폰), 컴퓨터 장치, 휴대용 멀티미디어 장치, 휴대용 의료 기기, 카메라, 웨어러블 장치, 또는 가전 장치를 포함할 수 있다. 본 개시의 실시 예에 따른 전자 장치는 전술한 기기들에 한정되지 않는다.
본 개시의 다양한 실시 예들 및 이에 사용된 용어들은 본 개시에 기재된 기술적 특징들을 특정한 실시 예들로 한정하려는 것이 아니며, 해당 실시 예의 다양한 변경, 균등물, 또는 대체물을 포함하는 것으로 이해되어야 한다. 도면의 설명과 관련하여, 유사한 또는 관련된 구성 요소에 대해서는 유사한 참조 부호가 사용될 수 있다. 아이템에 대응하는 명사의 단수 형은 관련된 문맥상 명백하게 다르게 지시하지 않는 한, 상기 아이템 한 개 또는 복수 개를 포함할 수 있다. 본 개시에서, "A 또는 B", "A 및 B 중 적어도 하나", "A 또는 B 중 적어도 하나", "A, B 또는 C", "A, B 및 C 중 적어도 하나", 및 "A, B, 또는 C 중 적어도 하나"와 같은 문구들 각각은 그 문구들 중 해당하는 문구에 함께 나열된 항목들 중 어느 하나, 또는 그들의 모든 가능한 조합을 포함할 수 있다. "제 1", "제 2", 또는 "첫째" 또는 "둘째"와 같은 용어들은 단순히 해당 구성 요소를 다른 해당 구성 요소와 구분하기 위해 사용될 수 있으며, 해당 구성 요소들을 다른 측면(예: 중요성 또는 순서)에서 한정하지 않는다. 어떤(예: 제 1) 구성 요소가 다른(예: 제 2) 구성 요소에, "기능적으로" 또는 "통신적으로"라는 용어와 함께 또는 이런 용어 없이, "커플드" 또는 "커넥티드"라고 언급된 경우, 그것은 상기 어떤 구성 요소가 상기 다른 구성 요소에 직접적으로(예: 유선으로), 무선으로, 또는 제 3 구성 요소를 통하여 연결될 수 있다는 것을 의미한다.
본 개시의 다양한 실시 예들에서 사용된 용어 "모듈"은 하드웨어, 소프트웨어 또는 펌웨어로 구현된 유닛을 포함할 수 있으며, 예를 들면, 로직, 논리 블록, 부품, 또는 회로와 같은 용어와 상호 호환적으로 사용될 수 있다. 모듈은, 일체로 구성된 부품 또는 하나 또는 그 이상의 기능을 수행하는, 상기 부품의 최소 단위 또는 그 일부가 될 수 있다. 예를 들면, 일 실시 예에 따르면, 모듈은 ASIC(application-specific integrated circuit)의 형태로 구현될 수 있다.
본 개시의 다양한 실시 예들은 기기(machine)(예: 전자 장치(101)) 의해 읽을 수 있는 저장 매체(storage medium)(예: 내장 메모리(136) 또는 외장 메모리(138))에 저장된 하나 이상의 명령어들을 포함하는 소프트웨어(예: 프로그램(140))로서 구현될 수 있다. 예를 들면, 기기(예: 전자 장치(101))의 프로세서(예: 프로세서(120))는, 저장 매체로부터 저장된 하나 이상의 명령어들 중 적어도 하나의 명령을 호출하고, 그것을 실행할 수 있다. 이것은 기기가 상기 호출된 적어도 하나의 명령어에 따라 적어도 하나의 기능을 수행하도록 운영되는 것을 가능하게 한다. 상기 하나 이상의 명령어들은 컴파일러에 의해 생성된 코드 또는 인터프리터에 의해 실행될 수 있는 코드를 포함할 수 있다. 기기로 읽을 수 있는 저장 매체는, 비일시적(non-transitory) 저장 매체의 형태로 제공될 수 있다. 여기서, '비일시적'은 저장 매체가 실재(tangible)하는 장치이고, 신호(signal)(예: 전자기파)를 포함하지 않는다는 것을 의미할 뿐이며, 이 용어는 데이터가 저장 매체에 반영구적으로 저장되는 경우와 임시적으로 저장되는 경우를 구분하지 않는다.
일 실시 예에 따르면, 본 개시의 다양한 실시 예들에 따른 방법은 컴퓨터 프로그램 제품(computer program product)에 포함되어 제공될 수 있다. 컴퓨터 프로그램 제품은 상품으로서 판매자 및 구매자 간에 거래될 수 있다. 컴퓨터 프로그램 제품은 기기로 읽을 수 있는 저장 매체(예: compact disc read only memory(CD-ROM))의 형태로 배포되거나, 또는 어플리케이션 스토어(예: 플레이 스토어TM)를 통해 또는 두 개의 사용자 장치들(예: 스마트 폰들) 간에 직접, 온라인으로 배포(예: 다운로드 또는 업로드)될 수 있다. 온라인 배포의 경우에, 컴퓨터 프로그램 제품의 적어도 일부는 제조사의 서버, 어플리케이션 스토어의 서버, 또는 중계 서버의 메모리와 같은 기기로 읽을 수 있는 저장 매체에 적어도 일시 저장되거나, 임시적으로 생성될 수 있다.
다양한 실시 예들에 따르면, 상기 기술한 구성 요소들의 각각의 구성 요소(예: 모듈 또는 프로그램)는 단수 또는 복수의 개체를 포함할 수 있으며, 복수의 개체 중 일부는 다른 구성 요소에 분리 배치될 수도 있다. 다양한 실시 예들에 따르면, 전술한 해당 구성 요소들 중 하나 이상의 구성 요소들 또는 동작들이 생략되거나, 또는 하나 이상의 다른 구성 요소들 또는 동작들이 추가될 수 있다. 대체적으로 또는 추가적으로, 복수의 구성 요소들(예: 모듈 또는 프로그램)은 하나의 구성 요소로 통합될 수 있다. 이런 경우, 통합된 구성 요소는 상기 복수의 구성 요소들 각각의 구성 요소의 하나 이상의 기능들을 상기 통합 이전에 상기 복수의 구성 요소들 중 해당 구성 요소에 의해 수행되는 것과 동일 또는 유사하게 수행할 수 있다. 다양한 실시 예들에 따르면, 모듈, 프로그램 또는 다른 구성 요소에 의해 수행되는 동작들은 순차적으로, 병렬적으로, 반복적으로, 또는 휴리스틱하게 실행되거나, 상기 동작들 중 하나 이상이 다른 순서로 실행되거나, 생략되거나, 또는 하나 이상의 다른 동작들이 추가될 수 있다.

Claims (15)

  1. 전자 장치에 있어서,
    인쇄회로기판; 및
    상기 인쇄회로기판에 부착되는 집적 회로 패키지를 포함하고,
    상기 집적 회로 패키지는
    제1 면 및 상기 제1 면의 반대 면인 제2 면에 다수의 소자들이 부착되는 기판;
    상기 기판의 제1 면을 커버하는 제1 몰딩 부재;
    상기 기판의 제2 면에 부착되며, 상기 인쇄회로기판과 전기적 연결을 위한 랜딩 패드들을 포함하는 인터포저 기판; 및
    상기 기판과 상기 인터포저 기판을 전기적으로 연결하고, 도전성 물질을 포함하는 연결 부재를 포함하는 전자 장치.
  2. 제 1 항에 있어서,
    상기 연결 부재는
    인터포저 볼을 포함하는 전자 장치.
  3. 제 1 항에 있어서,
    상기 기판은
    상기 다수의 소자들이 제1 배치 구조를 가지는 제1 기판; 또는
    상기 다수의 소자들이 상기 제1 배치 구조와 상이한 제2 배치 구조를 가지는 제2 기판을 포함하는 전자 장치.
  4. 제 3 항에 있어서,
    상기 인터포저 기판은
    상기 제1 기판에 대응하는 제1 인터포저 기판; 또는
    상기 제2 기판에 대응하는 제2 인터포저 기판을 포함하는 전자 장치.
  5. 제 4 항에 있어서,
    상기 제1 인터포저 기판 및 상기 제2 인터포저 기판은 동일한 구조의 랜딩 패드들을 포함하며,
    상기 제1 기판과 상기 제1 인터포저 기판 사이의 전기적 연결 구조와 상기 제2 기판과 상기 제2 인터포저 기판 사이의 전기적 연결 구조는 상이한 전자 장치.
  6. 제 1 항에 있어서,
    상기 집적 회로 패키지는 상기 기판의 제2 면과 상기 인터포저 기판 사이에 위치하고,
    상기 집적 회로 패키지는 상기 제2 면을 커버하는 제2 몰딩 부재를 더 포함하는 전자 장치.
  7. 제 6 항에 있어서,
    상기 집적 회로 패키지는
    상기 랜딩 패드에 형성되는 숄더링 볼을 더 포함하는 전자 장치.
  8. 제 1 항에 있어서,
    상기 집적 회로 패키지는
    상기 랜딩 패드에 형성되는 숄더링 볼을 더 포함하는 전자 장치.
  9. 집적 회로 패키지에 있어서,
    제1 면 및 상기 제1 면의 반대면인 제2 면에 다수의 소자들이 부착되는 기판;
    상기 기판의 제1 면을 커버하는 제1 몰딩 부재;
    상기 기판의 제2 면에 부착되며, 전자 장치에 포함되는 인쇄회로기판과 전기적 연결을 위한 랜딩 패드들을 포함하는 인터포저 기판; 및
    상기 기판과 상기 인터포저 기판을 전기적으로 연결하고, 도전성 물질을 포함하는 연결 부재를 포함하는 집적 회로 패키지.
  10. 제 9 항에 있어서,
    상기 연결 부재는
    인터포저 볼을 포함하는 집적 회로 패키지.
  11. 제 9 항에 있어서,
    상기 기판은
    상기 다수의 소자들이 제1 배치 구조를 가지는 제1 기판; 또는
    상기 다수의 소자들이 상기 제1 배치 구조와 상이한 제2 배치 구조를 가지는 제2 기판을 포함하는 집적 회로 패키지.
  12. 제 11 항에 있어서,
    상기 인터포저 기판은
    상기 제1 기판에 대응하는 제1 인터포저 기판; 또는
    상기 제2 기판에 대응하는 제2 인터포저 기판을 포함하는 집적 회로 패키지.
  13. 제 12 항에 있어서,
    상기 제1 인터포저 기판 및 상기 제2 인터포저 기판은 동일한 구조의 랜딩 패드들을 포함하며, 및
    상기 제1 기판과 상기 제1 인터포저 기판 사이의 전기적 연결 구조와 상기 제2 기판과 상기 제2 인터포저 기판 사이의 전기적 연결 구조는 상이한 집적 회로 패키지.
  14. 제 9 항에 있어서,
    상기 기판의 제2 면과 상기 인터포저 기판 사이에 위치하고, 상기 제2 면을 커버하는 제2 몰딩 부재를 더 포함하는 집적 회로 패키지.
  15. 제 14 항에 있어서,
    상기 랜딩 패드에 형성되는 숄더링 볼을 더 포함하는 집적 회로 패키지.
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Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR20160012589A (ko) * 2014-07-24 2016-02-03 삼성전자주식회사 인터포저 기판을 갖는 반도체 패키지 적층 구조체
WO2017035510A1 (en) * 2015-08-27 2017-03-02 Qualcomm Incorporated Integrated circuit (ic) package comprising electrostatic discharge (esd) protection
KR101939011B1 (ko) * 2015-03-04 2019-01-15 애플 인크. 시스템 인 패키지 팬 아웃 적층 아키텍처 및 프로세스 흐름
US20200312733A1 (en) * 2019-03-29 2020-10-01 Advanced Semiconductor Engineering, Inc. Semiconductor package structure and method for manufacturing the same
KR20210018775A (ko) * 2019-08-08 2021-02-18 타이완 세미콘덕터 매뉴팩쳐링 컴퍼니 리미티드 반도체 디바이스 및 제조 방법

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR20160012589A (ko) * 2014-07-24 2016-02-03 삼성전자주식회사 인터포저 기판을 갖는 반도체 패키지 적층 구조체
KR101939011B1 (ko) * 2015-03-04 2019-01-15 애플 인크. 시스템 인 패키지 팬 아웃 적층 아키텍처 및 프로세스 흐름
WO2017035510A1 (en) * 2015-08-27 2017-03-02 Qualcomm Incorporated Integrated circuit (ic) package comprising electrostatic discharge (esd) protection
US20200312733A1 (en) * 2019-03-29 2020-10-01 Advanced Semiconductor Engineering, Inc. Semiconductor package structure and method for manufacturing the same
KR20210018775A (ko) * 2019-08-08 2021-02-18 타이완 세미콘덕터 매뉴팩쳐링 컴퍼니 리미티드 반도체 디바이스 및 제조 방법

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