WO2017082059A1 - 情報処理装置、情報処理方法、およびプログラム - Google Patents

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WO2017082059A1
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clock signal
unit
data stream
system clock
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PCT/JP2016/081807
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義明 大石
平田　稔
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ソニー株式会社
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Definitions

  • the present technology relates to an information processing apparatus, an information processing method, and a program, and in particular, when receiving a data stream including time information and performing clock recovery processing, can perform efficient and stable clock recovery processing.
  • the present invention relates to an information processing apparatus, an information processing method, and a program that can be performed.
  • TS transport stream
  • Non-patent Document 1 a transport stream of the MPEG-2 / Systems standard
  • this synchronization process is a process for locking the system clock to reference time information (PCR: Program Clock Reference) included in the TS using a phase synchronization circuit (PLL: Phase Locked Loop).
  • PCR Program Clock Reference
  • PLL Phase Locked Loop
  • clock recovery process The process of synchronizing the system clock on the receiving side with the reference clock on the transmitting side is called “clock recovery process”.
  • a circuit that performs clock recovery processing is called a “clock recovery circuit”.
  • the configuration of the clock recovery circuit is disclosed in FIG. D.2 of Non-Patent Document 1, for example.
  • PCR jitter transmission jitter
  • Patent Document 1 discloses a method of suppressing PCR jitter using an N: M frequency divider for broadcast TS transmitted intermittently.
  • the TS is temporarily buffered in units of frames, and the read timing is controlled and output.
  • a memory for buffering is required, and the circuit cost increases.
  • the load on the memory bus increases due to TS input / output. Furthermore, once buffering occurs, a buffer retention time of the TS occurs, and a delay time until the next processing for the TS such as decoding processing occurs.
  • the present technology has been made in view of such a situation, and when receiving a data stream including time information and performing clock recovery processing, it is possible to perform efficient and stable clock recovery processing. It is to make.
  • An information processing apparatus includes an extraction unit that extracts time information from a data stream including time information that is a reference when generating a system clock signal, a storage unit that stores the time information, A control unit that outputs the time information stored in the storage unit in synchronization with the system clock signal based on a transmission rate of the data stream and position information of the time information in the data stream, and the storage unit A generation unit that performs a clock recovery process based on the time information output from and generates the system clock signal.
  • the control unit can specify the transmission rate based on transmission parameters attached to the data stream.
  • the control unit divides the system clock signal according to a ratio between the frequency of the system clock signal and the transmission rate, and is represented by the position information of the clock signal obtained by frequency division.
  • the time information can be output from the storage unit in synchronization with the clock signal at the position of the time information.
  • a decoding unit that decodes the data stream and a reproduction control unit that reproduces data obtained by decoding the data stream in synchronization with the system clock signal can be further provided.
  • the data stream can be TS and the time information can be PCR.
  • the data stream can be an MMT-TLV stream and the time information can be NTP.
  • the transmission parameter can be TMCC information.
  • the time information is extracted from a data stream including time information serving as a reference when generating a system clock signal, and the time information is stored in a storage unit. Further, based on the transmission rate of the data stream and the position information of the time information in the data stream, the time information stored in the storage unit is output in synchronization with the system clock signal, and the storage unit A clock recovery process is performed on the basis of the time information output from, and the system clock signal is generated.
  • FIG. 3 is a block diagram illustrating a configuration example of an output controller in FIG. 2. It is a flowchart explaining operation
  • FIG. 1 is a block diagram illustrating a configuration example of a receiving device according to an embodiment of the present technology.
  • 1 includes a control unit 11 and a reception processing unit 12.
  • the control unit 11 includes a CPU (Central Processing Unit), ROM (Read Only Memory), RAM (Random Access Memory), and the like.
  • the control unit 11 executes a predetermined program and controls the operation of the reception processing unit 12.
  • the reception processing unit 12 includes a tuner unit 21, a demodulation unit 22, a TS extraction unit 23, a PCR extraction unit 24, a clock recovery unit 25, a synchronous reproduction control unit 26, a TS decoder unit 27, and a video / audio reproduction unit 28.
  • the reception processing unit 12 is configured by, for example, one chip (LSI).
  • the tuner unit 21 extracts a signal of a predetermined channel from the broadcast wave received by the antenna, and supplies it to the demodulation unit 22 as a transmission path encoded signal.
  • a signal transmitted via a cable instead of a signal received by the antenna may be input to the tuner unit 21.
  • the demodulation unit 22 performs demodulation processing and error correction processing on the transmission path encoded signal supplied from the tuner unit 21, and supplies the resulting signal to the TS extraction unit 23 as error correction output data. Further, the demodulation unit 22 acquires transmission control information (hereinafter referred to as transmission parameters) attached to the error correction output data from the transmission path encoded signal supplied from the tuner unit 21, and the TS extraction unit 23 and PCR extraction To the unit 24.
  • transmission parameters transmission control information
  • Error correction output data depends on the digital broadcasting standard of the signal processed by the receiving device 1.
  • the digital broadcast standard of the signal processed by the receiving device 1 is the domestic satellite digital broadcast standard (Non-Patent Document 2)
  • the frames constituting the TS correspond to the error correction output data.
  • Each frame is composed of a plurality of slots, and the TS is multiplexed in slot units.
  • the “transmission parameter” depends on the digital broadcast standard of the signal processed by the receiving device 1.
  • the digital broadcasting standard of the signal processed by the receiving device 1 is the domestic satellite digital broadcasting standard (Non-Patent Document 2)
  • TMCC Transmission and Multiplexing Configuration and Control
  • TMCC information is control information transmitted along with a frame. From the TMCC information, the receiving apparatus 1 can specify in which slot in the frame the desired TS is included.
  • the TS extraction unit 23 extracts desired TS data from the error correction output data supplied from the demodulation unit 22 based on the transmission parameters, and supplies the extracted TS data to the PCR extraction unit 24 and the TS decoder unit 27.
  • the TS extracting unit 23 selects a desired slot from the frame supplied from the demodulating unit 22 based on the TMCC information.
  • the TS data is extracted from the selected slot.
  • the TS extraction unit 23 supplies the extracted TS data to the PCR extraction unit 24 and the TS decoder unit 27.
  • the PCR extraction unit 24 extracts desired PCR data from the TS data supplied from the TS extraction unit 23, temporarily stores it inside, and then supplies it to the clock recovery unit 25.
  • PCR data is, for example, data with an accuracy of 27 MHz, a field length of 6 bytes, and a transmission cycle of several tens to 100 ms.
  • the supply timing of the PCR data to the clock recovery unit 25 is determined based on the transmission parameter supplied from the demodulation unit 22 and the system clock signal supplied from the clock recovery unit 25.
  • the clock recovery unit 25 performs a clock recovery process for generating a system clock signal (frequency: 27 MHz) based on the PCR data supplied from the PCR extraction unit 24.
  • the clock recovery unit 25 supplies the system clock signal obtained by the clock recovery process to the PCR extraction unit 24 and the synchronous reproduction control unit 26.
  • the clock recovery process is a process of locking the system clock to the PCR included in the TS using a phase synchronization circuit (PLL) or the like.
  • PLL phase synchronization circuit
  • the clock recovery unit 25 has a configuration disclosed in, for example, FIG. D.2 of Non-Patent Document 1.
  • the synchronized playback control unit 26 supplies the video / audio playback unit 28 with playback control instructions for the video signal and the audio signal based on the PTS (Presentation Time-Stamp) data supplied from the TS decoder unit 27.
  • the processing by the synchronous reproduction control unit 26 is performed in synchronization with the system clock signal supplied from the clock recovery unit 25.
  • the TS decoder unit 27 performs a decoding process on the TS data supplied from the TS extraction unit 23 and supplies the video signal and audio signal obtained as a result to the video / audio reproduction unit 28. In addition, the TS decoder unit 27 acquires PTS data that is presentation time information of the video signal and the audio signal from the TS data, and supplies the PTS data to the synchronous reproduction control unit 26.
  • the TS decoder unit 27 includes, for example, a TS demultiplexer, an MPEG video decoder, and an MPEG audio decoder.
  • the video / audio reproduction unit 28 reproduces the video signal and the audio signal supplied from the TS decoder unit 27 based on the reproduction control instruction supplied from the synchronous reproduction control unit 26.
  • the video signal reproduced by the video / audio reproduction unit 28 is supplied to the display unit and used for displaying the video.
  • the audio signal is supplied to a speaker and used for outputting audio.
  • the display unit and the speaker may be provided in the same casing as the receiving apparatus 1 or may be provided in an apparatus in a separate casing.
  • the receiving apparatus 1 only the PCR data is extracted from the TS data and stored, and the stored PCR data is used for the clock recovery process. Therefore, it is necessary to buffer the TS data. There is no. Further, since the receiving device 1 controls the read timing of the stored PCR data and supplies it to the clock recovery unit 25, PCR jitter can be suppressed.
  • FIG. 2 is a block diagram illustrating a configuration example of the PCR extraction unit 24 of FIG.
  • the PCR extraction unit 24 includes a PCR extractor 31, a FIFO 32, a FIFO 33, and an output controller 34.
  • the PCR extractor 31 analyzes the TS data supplied from the TS extractor 23 and extracts desired PCR data.
  • the PCR extractor 31 supplies the extracted PCR data to the FIFO 32. Further, the PCR extractor 31 acquires information indicating the position of the PCR data in the TS data and supplies the information to the FIFO 33.
  • the position of the PCR data is represented by, for example, byte information based on a predetermined position such as the top of the TS data, and is generated by the PCR extractor 31 based on the analysis result of the TS data.
  • information indicating the position of the PCR data generated by the PCR extractor 31 will be referred to as PCR position information as appropriate.
  • the FIFO 32 temporarily stores the PCR data supplied from the PCR extractor 31.
  • the PCR data stored in the FIFO 32 is read in synchronization with the PCR clock signal supplied from the output controller 34 and supplied to the clock recovery unit 25.
  • the FIFO 32 has a capacity for storing one or more PCR data.
  • the FIFO 33 temporarily stores the PCR position information supplied from the PCR extractor 31.
  • the PCR position information stored in the FIFO 33 is read based on the read request supplied from the output controller 34 and supplied to the output controller 34.
  • the FIFO 33 has a capacity for storing one or more pieces of PCR position information.
  • the output controller 34 supplies a read request to the FIFO 32 and reads the PCR position information.
  • the output controller 34 also generates a PCR clock signal based on the transmission parameters supplied from the demodulator 22, the system clock signal supplied from the clock recovery unit 25, and the PCR position information supplied from the FIFO 33, and the FIFO 32. To supply. Details of generation of a PCR clock signal serving as a reference for reading timing of PCR data from the FIFO 32 will be described later.
  • step S 11 the PCR extractor 31 extracts PCR data from the TS data supplied from the TS extraction unit 23 and stores it in the FIFO 32.
  • step S12 the PCR extractor 31 acquires PCR position information indicating the position of the extracted PCR data and stores it in the FIFO 33.
  • step S13 the output controller 34 outputs a read request to the FIFO 33 and reads the PCR position information.
  • the output controller 34 generates a PCR clock signal based on the transmission parameter supplied from the demodulator 22, the system clock signal supplied from the clock recovery unit 25, and the PCR position information read from the FIFO 33, and outputs the PCR clock signal to the FIFO 32. To do.
  • step S14 the FIFO 32 outputs the stored PCR data in synchronization with the PCR clock signal supplied from the output controller 34. Thereafter, the process ends.
  • a PCR clock signal which is a reference for the output timing of PCR data is a signal generated using a system clock signal. It can be said that the output of PCR data from the FIFO 32 is performed in synchronization with the system clock signal.
  • FIG. 4 is a block diagram illustrating a configuration example of the output controller 34 of FIG.
  • the output controller 34 includes a transmission rate calculation unit 41, an N: M frequency divider 42, an up counter 43, a comparator 44, and an AND circuit 45.
  • the transmission rate calculation unit 41 calculates the transmission rate of the TS data based on the transmission parameters supplied from the demodulation unit 22.
  • the calculation method of the transmission rate depends on the digital broadcasting standard. For example, in the domestic satellite digital broadcasting standard (Non-Patent Document 2), when the modulation method is TC8PSK, the transmission rate R is obtained by the following equation (1).
  • Equation (1) S indicates a symbol rate (28.860 Mbaud), and N indicates the number of assigned slots (0 to 48).
  • the unit of R is Mbps (bps: bit per second).
  • the number N of assigned slots is transmitted as part of the TMCC information.
  • the N: M frequency divider 42 is a system supplied from the clock recovery unit 25 based on the system clock frequency (N) supplied from the control unit 11 and the transmission rate (M) supplied from the transmission rate calculation unit 41. Divide the clock signal by the N: M divider ratio. Information representing the frequency of the system clock is supplied from the control unit 11 to the N: M frequency divider 42. For example, when the transmission data is TS data, the system clock frequency (N) is 27 MHz.
  • the N: M frequency divider 42 supplies a signal obtained as a frequency division result to the up counter 43 and the AND circuit 45.
  • a signal obtained by dividing the system clock signal as appropriate is referred to as a TS clock signal.
  • the TS clock signal is a signal having a frequency necessary for transmitting the TS data.
  • the minimum value of the frequency of the TS clock signal is 24 MHz.
  • the up counter 43 increases its own output value by 1 in synchronization with the TS clock signal supplied from the N: M frequency divider 42.
  • a count value which is an output value of the up counter 43 is supplied to the comparator 44.
  • the comparator 44 compares the count value supplied from the up counter 43 with the PCR position information read from the FIFO 33, and supplies a signal to be asserted to the AND circuit 45 as a comparison result when it is determined that they are equal.
  • the AND circuit 45 takes the logical product (AND) of the TS clock signal supplied from the N: M frequency divider 42 and the comparison result supplied from the comparator 44, and uses the resulting signal as a PCR clock signal in the FIFO 32. To supply.
  • the TS clock signal during the period when the comparison result output from the comparator 44 is at the H level becomes valid and is output as the PCR clock signal.
  • step S21 the transmission rate calculation unit 41 calculates the transmission rate of the TS data based on the transmission parameters supplied from the demodulation unit 22.
  • step S22 the N: M frequency divider 42 generates a system clock signal based on the system clock frequency (N) supplied from the control unit 11 and the transmission rate (M) supplied from the transmission rate calculation unit 41.
  • the TS clock signal is generated by dividing by the N: M division ratio.
  • step S23 the up counter 43 generates a count value that increases by one in synchronization with the TS clock signal supplied from the N: M frequency divider 42.
  • step S24 the comparator 44 compares the count value supplied from the up counter 43 with the PCR position information read from the FIFO 33.
  • step S25 the AND circuit 45 calculates a logical product of the comparison result by the comparator 44 and the TS clock signal supplied from the N: M frequency divider 42, and generates a PCR clock signal. Thereafter, the process ends.
  • FIG. 6 is a diagram illustrating an example of processing in the output controller 34.
  • the system clock frequency (N) is 27 MHz and the transmission rate (M) is 72 Mbps.
  • the PCR data is transmitted from the PCR extraction unit 24 (FIFO 32) to the clock recovery unit 25 in units of bytes.
  • the first parameter set indicates that 6-byte PCR data exists from the 6th byte to the 11th byte, counting from the head of the TS data.
  • the second parameter set indicates that 6-byte PCR data exists from the 194th byte to the 199th byte from the head of the TS data.
  • FIG. 6A shows a system clock signal (frequency: 27 MHz) supplied from the clock recovery unit 25 to the N: M frequency divider 42.
  • FIG. 6A shows a system clock signal (frequency: 27 MHz) supplied from the clock recovery unit 25 to the N: M frequency divider 42.
  • FIG. 6B shows a TS clock signal (frequency: 3 MHz) supplied from the N: M frequency divider 42 to the up counter 43.
  • FIG. 6C shows a count value supplied from the up counter 43 to the comparator 44.
  • FIG. The count value increases by 1 in synchronization with the TS clock signal of B in FIG.
  • FIG. 6D shows a comparison result supplied from the comparator 44 to the AND circuit 45.
  • FIG. The comparison result being H level indicates that the TS clock signal is asserted.
  • the PCR position information and the count value of C of FIG. 6 are the same, and are asserted in a section represented by the above two sets of parameters (section corresponding to six clocks of the TS clock signal). .
  • FIG. 6E shows a PCR clock signal supplied from the AND circuit 45 to the FIFO 32.
  • FIG. A signal that oscillates at the same frequency as the TS clock signal is output as the PCR clock signal in the interval in which the comparison result of D in FIG. 6 is asserted. That is, among the TS clock signals, the TS clock signal in the interval in which the comparison result is asserted is output as the PCR clock signal.
  • FIG. 7 is a diagram illustrating an example of processing in the PCR extraction unit 24.
  • Non-Patent Document 2 the standard of the signal processed by the receiving device 1 is the domestic satellite digital broadcasting standard (Non-Patent Document 2)
  • error correction output data is data constituting a frame.
  • Each frame is composed of a plurality of slots, and TS data is transmitted using the slots.
  • FIG. 7A shows error correction output data (frame) supplied from the demodulator 22 to the TS extractor 23.
  • Frame # 1 is output during the period from time t51 to time t52, and frame # 2 is output during the period from time t52 to time t53. Also, frame # 3 is output in the period from time t53 to time t54. Desired TS data is transmitted in the slots indicated by hatching in FIG.
  • FIG. 7B shows TS data extracted by the TS extraction unit 23 and supplied to the PCR extraction unit 24 (PCR extractor 31) and the TS decoder unit 27.
  • FIG. The TS data supplied to the PCR extraction unit 24 (PCR extractor 31) is data for extracting PCR data
  • the TS data supplied to the TS decoder unit 27 is data for decoding.
  • Desired PCR data is transmitted in a portion indicated by a black line in B of FIG.
  • the second slot extracted from frame # 1 includes PCR data.
  • the slots there are a slot containing PCR data and a slot not containing PCR data.
  • the TS extracting unit 23 selects a slot for transmitting desired TS data from the frame (A in FIG. 7) supplied from the demodulating unit 22, and extracts TS data contained therein.
  • the TS data output from the TS extraction unit 23 becomes intermittent data as shown in B of FIG.
  • FIG. 7C shows PCR data supplied from the PCR extractor 31 to the FIFO 32 and stored.
  • FIG. 7D shows a PCR clock signal supplied from the output controller 34 to the FIFO 32.
  • FIG. The PCR clock signal D in FIG. 7 corresponds to the PCR clock signal E in FIG.
  • FIG. 7E shows PCR data supplied from the PCR extraction unit 24 (FIFO 32) to the clock recovery unit 25. As shown in E of FIG. 7, PCR data is read byte by byte from the FIFO 32 in synchronization with the PCR clock signal.
  • the PCR data read from the FIFO 32 is used for clock recovery processing in the clock recovery unit 25 to generate a system clock signal.
  • the generated system clock signal is used in the synchronized playback control unit 26 for the synchronized playback control of video and audio as described above.
  • the receiving apparatus even when a desired data stream is intermittently transmitted, it is necessary to buffer large data such as a frame unit in order to generate a system clock signal. Absent. Thereby, the memory for buffering can be reduced, and the circuit cost and the load of the memory bus can be suppressed.
  • the processing delay time can be reduced compared to the case of buffering large data, and transmission jitter of time information used for clock recovery processing can be suppressed.
  • the receiving apparatus 1 can perform an efficient and stable clock recovery process.
  • FIG. 8 is a block diagram illustrating another configuration example of the receiving apparatus.
  • the receiving apparatus 1 in FIG. 8 includes a receiving apparatus 101 and a receiving apparatus 102.
  • the receiving device 101 and the receiving device 102 are configured by different LSIs.
  • TS data is divided into PCR data extraction and decoding, a system clock signal is generated based on PCR data extracted from PCR data extraction TS data, and decoding TS It is used for synchronous reproduction control of data decoding results.
  • the system can be configured flexibly, for example, by transmitting a data stream using a general-purpose bus that is a transmission path with a large transmission jitter.
  • the general-purpose bus is a transmission path that is also used for transmitting data other than a data stream, such as data processed by a CPU (not shown) mounted on the receiving device 1.
  • processing such as data stream demodulation and error correction, and clock recovery processing are performed in the receiving apparatus 101 in the preceding stage.
  • decoding of the data stream using the system clock signal is performed in the receiving apparatus 102 at the subsequent stage.
  • Transmission of a data stream from the receiving apparatus 101 to the receiving apparatus 102 is performed using a general-purpose bus, and transmission of a system clock signal generated by clock recovery processing is performed using a dedicated line.
  • the receiving apparatus 101 and the receiving apparatus 102 are connected to a signal line 121, which is a dedicated line used for transmitting a system clock signal, and a general-purpose bus 122 used for transmitting TS data.
  • a signal line 121 which is a dedicated line used for transmitting a system clock signal
  • a general-purpose bus 122 used for transmitting TS data.
  • a USB or PCI Express bus is used as the general-purpose bus 122.
  • the receiving apparatus 101 includes a control unit 11-1 and a reception processing unit 12-1.
  • the control unit 11-1 executes a predetermined program and controls the operation of the reception processing unit 12-1.
  • the reception processing unit 12-1 includes a tuner unit 21, a demodulation unit 22, a TS extraction unit 23, a PCR extraction unit 24, a clock recovery unit 25, and a general-purpose bus interface 111.
  • the desired TS data extracted by the TS extraction unit 23 is supplied to the PCR extraction unit 24 as data for PCR data extraction and also supplied to the general-purpose bus interface 111 as a data stream for transmission.
  • the general-purpose bus interface 111 outputs the TS data supplied from the TS extraction unit 23 to the general-purpose bus 122.
  • the system clock signal obtained by performing the clock recovery processing by the clock recovery unit 25 is supplied to the PCR extraction unit 24 and output to the signal line 121.
  • the receiving apparatus 102 includes a control unit 11-2 and a reception processing unit 12-2.
  • the control unit 11-2 executes a predetermined program and controls the operation of the reception processing unit 12-2.
  • the reception processing unit 12-2 includes a synchronous reproduction control unit 26, a TS decoder unit 27, a video / audio reproduction unit 28, and a general-purpose bus interface 131.
  • the synchronized playback control unit 26 supplies a video signal and audio signal playback control instruction to the video / audio playback unit 28 based on the PTS data supplied from the TS decoder unit 27.
  • the processing by the synchronous reproduction control unit 26 is performed in synchronization with the system clock signal supplied from the clock recovery unit 25 of the receiving apparatus 101 via the signal line 121.
  • the general-purpose bus interface 131 receives TS data supplied from the general-purpose bus interface 111 of the receiving apparatus 101 via the general-purpose bus 122 and supplies the TS data to the TS decoder unit 27.
  • the system clock signal is transmitted through a dedicated signal line with little transmission jitter, and is used for synchronous reproduction control. Therefore, even if a data stream is transmitted through a general-purpose bus having a large transmission jitter, it is possible to perform synchronous reproduction of a video signal and an audio signal with the same accuracy as the receiving device 1 in FIG.
  • FIG. 9 is a block diagram illustrating still another configuration example of the receiving device 1.
  • the configuration shown in FIG. 9 is different from the configuration shown in FIG. 8 in that the clock recovery unit 25 is provided not in the reception device 101 but in the reception device 102.
  • a signal line 124 that is a transmission path for PCR data and a signal line 123 that is a transmission path for system clock signals are provided.
  • the PCR data extracted by the PCR extracting unit 24 of the receiving apparatus 101 is supplied to the receiving apparatus 102 via the signal line 124, and the clock recovery process is performed by the receiving apparatus 102. It is made like that.
  • the system clock signal generated by the clock recovery unit 25 of the reception device 102 is supplied to the synchronous reproduction control unit 26 and is also supplied to the PCR extraction unit 24 of the reception device 101 via the signal line 123.
  • the system configuration can be changed as appropriate.
  • the present technology can also be applied to broadcast streams other than TS.
  • the present invention can also be applied to an MMT-TLV (MPEG Media Transport-Type Length Value) stream in the domestic advanced wideband digital satellite broadcasting standard (Non-patent Document 3).
  • MMT-TLV MPEG Media Transport-Type Length Value
  • NTP Network Time Protocol
  • the system clock frequency (N) is 2 ⁇ N (power of 2) MHz.
  • the present technology can be applied not to a receiving device that receives broadcast waves but also to a receiving unit that is mounted on a communication device.
  • FIG. 10 is a block diagram showing an example of the hardware configuration of a computer that executes the above-described series of processing by a program.
  • CPU 301 CPU 301, ROM (Read Only Memory) 302, and RAM (Random Access Memory) 303 are connected to each other by a bus 304.
  • ROM Read Only Memory
  • RAM Random Access Memory
  • An input / output interface 305 is further connected to the bus 304.
  • the input / output interface 305 is connected to an input unit 306 including a keyboard and a mouse, and an output unit 307 including a display and a speaker.
  • the input / output interface 305 is connected to a storage unit 308 made up of a hard disk, nonvolatile memory, etc., a communication unit 309 made up of a network interface, etc., and a drive 310 that drives the removable media 311.
  • the CPU 301 loads the program stored in the storage unit 308 to the RAM 303 via the input / output interface 305 and the bus 304 and executes the program, thereby performing the series of processes described above. Is done.
  • the program executed by the CPU 301 is recorded in the removable medium 311 or provided via a wired or wireless transmission medium such as a local area network, the Internet, or digital broadcasting, and is installed in the storage unit 308.
  • the program executed by the computer may be a program that is processed in time series in the order described in this specification, or in parallel or at a necessary timing such as when a call is made. It may be a program for processing.
  • Embodiments of the present technology are not limited to the above-described embodiments, and various modifications can be made without departing from the gist of the present technology.
  • the system means a set of a plurality of components (devices, modules (parts), etc.), and it does not matter whether all the components are in the same housing. Accordingly, a plurality of devices housed in separate housings and connected via a network and a single device housing a plurality of modules in one housing are all systems. .
  • Embodiments of the present technology are not limited to the above-described embodiments, and various modifications can be made without departing from the gist of the present technology.
  • This technology can also take the following composition.
  • An extraction unit for extracting the time information from a data stream including time information serving as a reference when generating a system clock signal;
  • a storage unit for storing the time information;
  • a control unit that outputs the time information stored in the storage unit in synchronization with the system clock signal based on a transmission rate of the data stream and position information of the time information in the data stream;
  • An information processing apparatus comprising: a generation unit that performs clock recovery processing based on the time information output from the storage unit and generates the system clock signal.
  • the control unit specifies the transmission rate based on a transmission parameter attached to the data stream.
  • the control unit divides the system clock signal according to a ratio between the frequency of the system clock signal and the transmission rate, and is represented by the position information in the clock signal obtained by frequency division.
  • a decoding unit for decoding the data stream The information processing apparatus according to any one of (1) to (3), further including: a reproduction control unit that reproduces data obtained by decoding the data stream in synchronization with the system clock signal .
  • the data stream is a TS;
  • the information processing apparatus according to any one of (1) to (4), wherein the time information is PCR.
  • the data stream is an MMT-TLV stream;
  • the information processing apparatus according to any one of (1) to (4), wherein the time information is NTP.
  • the first information processing unit includes: An extraction unit for extracting the time information from the data stream including time information serving as a reference when generating the system clock signal; A storage unit for storing the time information; A control unit that outputs the time information stored in the storage unit in synchronization with the system clock signal based on a transmission rate of the data stream and position information of the time information in the data stream; A generating unit that outputs the system clock signal generated by performing clock recovery processing based on the time information output from the storage unit to the dedicated signal line; An output unit for outputting the data stream to the general-purpose bus;
  • the second information processing unit A receiving unit that receives the data stream output from the first information processing unit to the general-purpose bus; A decoding unit for decoding the data stream received by the receiving unit; A reproduction control unit that reproduces data obtained by decoding the data stream in
  • a data stream including time information serving as a reference when generating a system clock signal is output to a general-purpose bus, the time information is extracted from the data stream, and clock recovery processing is performed based on the extracted time information
  • a first information processing unit that outputs the system clock signal generated by the method to a dedicated signal line; Decoding the data stream supplied via the general-purpose bus, and reproducing the data obtained by decoding in synchronization with the system clock signal supplied via the dedicated signal line;
  • An information processing apparatus comprising: an information processing unit.

Abstract

本技術は、時刻情報を含むデータストリームを受信してクロックリカバリ処理を行う場合において、効率的に、かつ安定したクロックリカバリ処理を行うことができるようにする情報処理装置、情報処理方法、およびプログラムに関する。 本技術の一側面の情報処理装置は、システムクロック信号を生成するときの基準となる時刻情報を含むデータストリームから時刻情報を抽出し、時刻情報を記憶部に記憶し、データストリームの伝送レートとデータストリームにおける時刻情報の位置情報とに基づいて、記憶部に記憶した時刻情報を、システムクロック信号に同期して出力させ、記憶部から出力された時刻情報に基づいてクロックリカバリ処理を行い、システムクロック信号を生成する。本技術は、デジタル放送の受信機に適用することができる。

Description

情報処理装置、情報処理方法、およびプログラム
　本技術は、情報処理装置、情報処理方法、およびプログラムに関し、特に、時刻情報を含むデータストリームを受信してクロックリカバリ処理を行う場合において、効率的に、かつ安定したクロックリカバリ処理を行うことができるようにした情報処理装置、情報処理方法、およびプログラムに関する。
　デジタルテレビジョン放送の分野では、映像や音声などの符号化データは、各々パケット化された後、同期再生が可能な形式で多重化され、伝送される。多重化形式としては、MPEG-2 Systems規格（非特許文献１）のトランスポートストリーム（TS）などが知られている。
　放送されたTSを受信機において復号した後、TSを再生したり、記録したりする際には、受信側のシステムクロックを、27MHzなどの所定の周波数を有する送信側の基準クロックに同期させる必要がある。具体的には、この同期処理は、位相同期回路（PLL：Phase Locked Loop）などを用いて、システムクロックをTSに含まれる参照時刻情報（PCR：Program Clock Reference）にロックさせる処理となる。
　受信側のシステムクロックを送信側の基準クロックに同期させる処理は「クロックリカバリ処理」と呼ばれる。また、クロックリカバリ処理を行う回路は「クロックリカバリ回路」と呼ばれる。クロックリカバリ回路の構成は、例えば、非特許文献１のFigure D.2に開示されている。
　クロックリカバリ回路においてシステムクロックをPCRに安定してロックさせるためには、クロックリカバリ回路に入力されるPCRデータの伝送ジッタ（以下、PCRジッタと呼ぶ）を抑制する必要がある。
特開２００８-１６０２３９号公報
ISO/IEC 13818-1, Information technology － Generic coding of moving pictures and associated audio information: Systems ARIB STD-B20　衛星デジタル放送の伝送方式　標準規格 ARIB STD-B44　高度広帯域衛星デジタル放送の伝送方式　標準規格
　特許文献１には、間欠的に伝送される放送TSについて、N:M分周器を用いてPCRジッタを抑制する方法が開示されている。この方法は、TSをフレーム単位で一旦バッファリングしておき、読み出しタイミングを制御して出力するものであるが、バッファリングのためのメモリが必要となり、回路コストが高くなる。
　また、TSの入出力を伴うことから、メモリバスへの負荷が大きくなる。さらに、一旦バッファリングすることにより、TSのバッファ滞留時間が発生し、デコード処理などの、TSを対象とした次の処理までの遅延時間が生じてしまう。
　本技術はこのような状況に鑑みてなされたものであり、時刻情報を含むデータストリームを受信してクロックリカバリ処理を行う場合において、効率的に、かつ安定したクロックリカバリ処理を行うことができるようにするものである。
　本技術の一側面の情報処理装置は、システムクロック信号を生成するときの基準となる時刻情報を含むデータストリームから前記時刻情報を抽出する抽出部と、前記時刻情報を記憶する記憶部と、前記データストリームの伝送レートと前記データストリームにおける前記時刻情報の位置情報とに基づいて、前記記憶部に記憶された前記時刻情報を、前記システムクロック信号に同期して出力させる制御部と、前記記憶部から出力された前記時刻情報に基づいてクロックリカバリ処理を行い、前記システムクロック信号を生成する生成部とを備える。
　前記制御部には、前記データストリームに付帯する伝送パラメータに基づいて前記伝送レートを特定させることができる。
　前記制御部には、前記システムクロック信号の周波数と前記伝送レートとの比に応じて前記システムクロック信号を分周させ、分周して得られたクロック信号のうちの、前記位置情報により表される前記時刻情報の位置における前記クロック信号に同期して、前記時刻情報を前記記憶部から出力させることができる。
　前記データストリームをデコードするデコード部と、前記データストリームをデコードすることによって得られたデータを、前記システムクロック信号に同期して再生させる再生制御部とをさらに設けることができる。
　前記データストリームをTSとし、前記時刻情報をPCRとすることができる。
　前記データストリームをMMT-TLVストリームとし、前記時刻情報をNTPとすることができる。
　前記伝送パラメータをTMCC情報とすることができる。
　本技術の一側面においては、システムクロック信号を生成するときの基準となる時刻情報を含むデータストリームから前記時刻情報が抽出され、前記時刻情報が記憶部に記憶される。また、前記データストリームの伝送レートと前記データストリームにおける前記時刻情報の位置情報とに基づいて、前記記憶部に記憶された前記時刻情報が、前記システムクロック信号に同期して出力され、前記記憶部から出力された前記時刻情報に基づいてクロックリカバリ処理が行われ、前記システムクロック信号が生成される。
　本技術によれば、時刻情報を含むデータストリームを受信してクロックリカバリ処理を行う場合において、効率的に、かつ安定したクロックリカバリ処理を行うことができる。
　なお、ここに記載された効果は必ずしも限定されるものではなく、本開示中に記載されたいずれかの効果であってもよい。
本技術を適用した受信装置の構成例を示すブロック図である。 図１のPCR抽出部の構成例を示すブロック図である。 PCR抽出部の動作について説明するフローチャートである。 図２の出力コントローラの構成例を示すブロック図である。 出力コントローラの動作について説明するフローチャートである。 出力コントローラの処理の例を示す図である。 PCR抽出部の処理の例を示す図である。 伝送システムの構成例を示すブロック図である。 伝送システムの他の構成例を示すブロック図である。 コンピュータの構成例を示すブロック図である。
　以下、本技術を実施するための形態について説明する。説明は以下の順序で行う。
　１．第１の実施の形態（クロックリカバリ処理とデコード処理を１チップで行う例）
　（１）受信装置の構成例
　（２）PCR抽出部２４の構成と動作の例
　（３）出力コントローラ３４の構成と動作の例
　（４）出力コントローラ３４の処理の例
　（５）PCR抽出部２４の処理の例
　２．第２の実施の形態（クロックリカバリ処理とデコード処理をそれぞれ異なるチップで行う例）
　３．変形例
＜＜１．第１の実施の形態＞＞
＜（１）受信装置の構成例＞
　図１は、本技術の一実施形態に係る受信装置の構成例を示すブロック図である。
　図１の受信装置１は、制御部１１と受信処理部１２から構成される。
　制御部１１は、CPU(Central Processing Unit)、ROM(Read Only Memory)、RAM(Random Access Memory)などから構成される。制御部１１は、所定のプログラムを実行し、受信処理部１２の動作を制御する。
　受信処理部１２は、チューナ部２１、復調部２２、TS抽出部２３、PCR抽出部２４、クロックリカバリ部２５、同期再生制御部２６、TSデコーダ部２７、および映像・音声再生部２８から構成される。受信処理部１２は例えば１つのチップ（LSI）により構成される。
　チューナ部２１は、アンテナにおいて受信された放送波から所定のチャンネルの信号を抽出し、伝送路符号化信号として復調部２２に供給する。アンテナにおいて受信された信号ではなく、ケーブルを介して伝送されてきた信号がチューナ部２１に入力されるようにしてもよい。
　復調部２２は、チューナ部２１から供給された伝送路符号化信号に対して復調処理と誤り訂正処理を施し、その結果得られた信号を誤り訂正出力データとしてTS抽出部２３に供給する。また、復調部２２は、チューナ部２１から供給された伝送路符号化信号から、誤り訂正出力データに付帯する伝送制御情報（以下、伝送パラメータと呼ぶ）を取得し、TS抽出部２３とPCR抽出部２４に供給する。
　「誤り訂正出力データ」は、受信装置１が処理する信号のデジタル放送規格に依存する。例えば、受信装置１が処理する信号のデジタル放送規格が国内衛星デジタル放送規格（非特許文献２）である場合、TSを構成するフレームが誤り訂正出力データに該当する。各フレームは複数のスロットから構成され、スロット単位でTSが多重化される。
　「伝送パラメータ」も同様に、受信装置１が処理する信号のデジタル放送規格に依存する。例えば、受信装置１が処理する信号のデジタル放送規格が国内衛星デジタル放送規格（非特許文献２）である場合、TMCC（Transmission and Multiplexing Configuration Control）情報が伝送パラメータに該当する。TMCC情報は、フレームに付帯して伝送される制御情報である。受信装置１は、TMCC情報から、当該フレーム内のどのスロットに所望のTSが含まれるか等を特定することができる。
　TS抽出部２３は、復調部２２から供給された誤り訂正出力データから、所望のTSデータを伝送パラメータに基づいて抽出し、PCR抽出部２４とTSデコーダ部２７に供給する。
　受信装置１が処理する信号が上述した国内衛星デジタル放送規格（非特許文献２）の信号である場合、TS抽出部２３は、復調部２２から供給されたフレームから所望のスロットをTMCC情報に基づいて選択し、選択したスロットからTSデータを抽出することになる。TS抽出部２３は、抽出したTSデータをPCR抽出部２４とTSデコーダ部２７に供給する。
　PCR抽出部２４は、TS抽出部２３から供給されたTSデータから所望のPCRデータを抽出し、内部で一時的に記憶した後、クロックリカバリ部２５に供給する。PCRデータは、例えば、精度が27MHz、フィールド長が6バイト、伝送周期が数10ms～100msのデータである。後に詳述するように、クロックリカバリ部２５に対するPCRデータの供給タイミングは、復調部２２から供給された伝送パラメータと、クロックリカバリ部２５から供給されたシステムクロック信号に基づいて決定される。
　クロックリカバリ部２５は、PCR抽出部２４から供給されたPCRデータに基づいて、システムクロック信号（周波数：27MHz）を生成するためのクロックリカバリ処理を行う。クロックリカバリ部２５は、クロックリカバリ処理により得られたシステムクロック信号をPCR抽出部２４と同期再生制御部２６に供給する。
　クロックリカバリ処理は、位相同期回路（PLL）などを用いて、システムクロックをTSに含まれるPCRにロックさせる処理である。放送ストリームがTSである場合、クロックリカバリ部２５は、例えば非特許文献１のFigure D.2に開示されている構成を有する。
　同期再生制御部２６は、TSデコーダ部２７から供給されたPTS(Presentation Time-Stamp)データに基づいて、映像信号と音声信号の再生制御指示を映像・音声再生部２８に供給する。同期再生制御部２６による処理は、クロックリカバリ部２５から供給されたシステムクロック信号に同期して行われる。
　TSデコーダ部２７は、TS抽出部２３から供給されたTSデータに対して復号処理を施し、その結果得られた映像信号と音声信号を映像・音声再生部２８に供給する。また、TSデコーダ部２７は、映像信号と音声信号の提示時刻情報であるPTSデータをTSデータから取得し、同期再生制御部２６に供給する。TSデコーダ部２７は、例えば、TSデマルチプレクサ、MPEG映像デコーダ、およびMPEG音声デコーダなどから構成される。
　映像・音声再生部２８は、同期再生制御部２６から供給された再生制御指示に基づいて、TSデコーダ部２７から供給された映像信号と音声信号を再生する。映像・音声再生部２８により再生された映像信号は表示部に供給され、映像の表示に用いられる。また、音声信号はスピーカに供給され、音声の出力に用いられる。表示部とスピーカが受信装置１と同じ筐体内に設けられるようにしてもよいし、別筐体の装置内に設けられるようにしてもよい。
　以上のように、受信装置１においては、TSデータからPCRデータのみを抽出して記憶しておき、記憶しておいたPCRデータをクロックリカバリ処理に用いるため、TSデータをバッファリングしておく必要がない。また、受信装置１においては、記憶しておいたPCRデータの読み出しタイミングを制御し、クロックリカバリ部２５に供給するため、PCRジッタを抑制することが可能になる。
＜（２）PCR抽出部２４の構成と動作の例＞
　図２は、図１のPCR抽出部２４の構成例を示すブロック図である。
　図２に示すように、PCR抽出部２４は、PCR抽出器３１、FIFO３２、FIFO３３、および出力コントローラ３４から構成される。
　PCR抽出器３１は、TS抽出部２３から供給されたTSデータを解析し、所望のPCRデータを抽出する。PCR抽出器３１は、抽出したPCRデータをFIFO３２に供給する。また、PCR抽出器３１は、当該TSデータにおける当該PCRデータの位置を表す情報を取得し、FIFO３３に供給する。
　PCRデータの位置は、例えば、TSデータの先頭などの所定の位置を基準としたバイト情報により表され、TSデータの解析結果に基づいて、PCR抽出器３１により生成される。以下、適宜、PCR抽出器３１が生成するPCRデータの位置を表す情報をPCR位置情報と呼ぶ。
　FIFO３２は、PCR抽出器３１から供給されたPCRデータを一時的に記憶する。FIFO３２に記憶されたPCRデータは、出力コントローラ３４から供給されたPCRクロック信号に同期して読み出され、クロックリカバリ部２５に供給される。FIFO３２は、１つ以上のPCRデータを記憶する容量を有する。
　FIFO３３は、PCR抽出器３１から供給されたPCR位置情報を一時的に記憶する。FIFO３３に記憶されたPCR位置情報は、出力コントローラ３４から供給された読み出し要求に基づいて読み出され、出力コントローラ３４に供給される。FIFO３３は、１つ以上のPCR位置情報を記憶する容量を有する。
　出力コントローラ３４は、FIFO３２に対して読み出し要求を供給し、PCR位置情報を読み出す。また、出力コントローラ３４は、復調部２２から供給された伝送パラメータ、クロックリカバリ部２５から供給されたシステムクロック信号、および、FIFO３３から供給されたPCR位置情報に基づいてPCRクロック信号を生成し、FIFO３２に供給する。FIFO３２からのPCRデータの読み出しタイミングの基準となるPCRクロック信号の生成の詳細については後述する。
　ここで、図３のフローチャートを参照して、以上のような構成を有するPCR抽出部２４の動作について説明する。
　ステップＳ１１において、PCR抽出器３１は、TS抽出部２３から供給されたTSデータからPCRデータを抽出し、FIFO３２に記憶させる。
　ステップＳ１２において、PCR抽出器３１は、抽出したPCRデータの位置を表すPCR位置情報を取得し、FIFO３３に記憶させる。
　ステップＳ１３において、出力コントローラ３４は、FIFO３３に対して読み出し要求を出力し、PCR位置情報を読み出す。また、出力コントローラ３４は、復調部２２から供給された伝送パラメータ、クロックリカバリ部２５から供給されたシステムクロック信号、およびFIFO３３から読み出したPCR位置情報に基づいてPCRクロック信号を生成し、FIFO３２に出力する。
　ステップＳ１４において、FIFO３２は、出力コントローラ３４から供給されたPCRクロック信号に同期して、記憶しておいたPCRデータを出力する。その後、処理は終了となる。PCRデータの出力タイミングの基準となるPCRクロック信号はシステムクロック信号を用いて生成される信号である。FIFO３２からのPCRデータの出力は、システムクロック信号に同期して行われるともいえる。
＜（３）出力コントローラ３４の構成と動作の例＞
　図４は、図２の出力コントローラ３４の構成例を示すブロック図である。
　図４に示すように、出力コントローラ３４は、伝送レート計算部４１、N:M分周器４２、アップカウンタ４３、比較器４４、およびAND回路４５から構成される。
　伝送レート計算部４１は、復調部２２から供給された伝送パラメータに基づいて、当該TSデータの伝送レートを計算する。伝送レートの計算方法は、デジタル放送規格に依存する。例えば、国内衛星デジタル放送規格（非特許文献２）において、変調方式がTC8PSKである場合、伝送レートＲは下式（１）により求められる。
Figure JPOXMLDOC01-appb-M000001
　式（１）において、Ｓはシンボルレート（28.860Mbaud）、Ｎは割り当てスロット数（0～48）を示す。また、Ｒの単位はMbps（bps：bit per second）である。割り当てスロット数ＮはTMCC情報の一部として伝送される。
　N:M分周器４２は、制御部１１から供給されたシステムクロック周波数（Ｎ）と伝送レート計算部４１から供給された伝送レート（Ｍ）に基づいて、クロックリカバリ部２５から供給されたシステムクロック信号をN:Mの分周比で分周する。制御部１１からN:M分周器４２に対しては、システムクロックの周波数を表す情報が供給される。システムクロック周波数（Ｎ）は、例えば伝送データがTSデータである場合、27MHzである。
　また、N:M分周器４２は、分周結果として得られる信号をアップカウンタ４３とAND回路４５に供給する。以下、適宜、システムクロック信号を分周して得られる信号をTSクロック信号と呼ぶ。
　TSクロック信号は、当該TSデータを伝送するのに必要な周波数を有する信号である。例えば、当該TSデータの伝送レートが24Mbpsであり、それをビット単位で伝送する場合、TSクロック信号の周波数の最小値は24MHzとなる。また、例えば、当該TSデータの伝送レートが24Mbpsであり、それをバイト（8ビット）単位で伝送する場合、TSクロック信号の周波数の最小値は3（＝24/8）MHzとなる。
　アップカウンタ４３は、N:M分周器４２から供給されたTSクロック信号に同期して、自己の出力値を１ずつ増加する。アップカウンタ４３の出力値であるカウント値は比較器４４に供給される。
　比較器４４は、アップカウンタ４３から供給されたカウント値とFIFO３３から読み出したPCR位置情報を比較し、それらが等しいと判断された場合にアサートする信号を比較結果としてAND回路４５に供給する。
　AND回路４５は、N:M分周器４２から供給されたTSクロック信号と、比較器４４から供給された比較結果の論理積（AND）をとり、その結果得られる信号をPCRクロック信号としてFIFO３２に供給する。比較器４４が出力する比較結果がＨレベルである期間におけるTSクロック信号が有効となり、PCRクロック信号として出力される。
　ここで、図５のフローチャートを参照して、以上のような構成を有する出力コントローラ３４の動作について説明する。
　ステップＳ２１において、伝送レート計算部４１は、復調部２２から供給された伝送パラメータに基づいて当該TSデータの伝送レートを計算する。
　ステップＳ２２において、N:M分周器４２は、制御部１１から供給されたシステムクロック周波数（Ｎ）と、伝送レート計算部４１から供給された伝送レート（Ｍ）に基づいて、システムクロック信号をN:Mの分周比で分周し、TSクロック信号を生成する。
　ステップＳ２３において、アップカウンタ４３は、N:M分周器４２から供給されたTSクロック信号に同期して１ずつ増加するカウント値を生成する。
　ステップＳ２４において、比較器４４は、アップカウンタ４３から供給されたカウント値とFIFO３３から読み出したPCR位置情報を比較する。
　ステップＳ２５において、AND回路４５は、比較器４４による比較結果と、N:M分周器４２から供給されたTSクロック信号との論理積をとり、PCRクロック信号を生成する。その後、処理は終了となる。
＜（４）出力コントローラ３４の処理の例＞
　図６は、出力コントローラ３４における処理の例を示す図である。
　この例においては、システムクロック周波数（Ｎ）は27MHz、伝送レート（Ｍ）は72Mbpsである。また、PCR抽出部２４（FIFO３２）からクロックリカバリ部２５に対するPCRデータの伝送はバイト単位で行われる。
　PCR位置情報として、二組のパラメータセットである{6,7,8,9,10,11},{194,195,196,197,198,199}が与えられているものとする。１つ目のパラメータセットは、当該TSデータの先頭から数えて、6バイト目から11バイト目に6バイトのPCRデータが存在することを表す。同様に、２つ目のパラメータセットは、当該TSデータの先頭から数えて、194バイト目から199バイト目に6バイトのPCRデータが存在することを表す。
　図６のＡは、クロックリカバリ部２５からN:M分周器４２に供給されるシステムクロック信号（周波数：27MHz）を示す。
　図６のＢは、N:M分周器４２からアップカウンタ４３に供給されるTSクロック信号（周波数：3MHz）を示す。図６のＡのシステムクロック信号がN:M＝27:72/8＝1:3の分周比で分周されることにより、図６のＢに示すようなTSクロック信号が生成される。
　図６のＣは、アップカウンタ４３から比較器４４に供給されるカウント値を示す。カウント値は、図６のＢのTSクロック信号に同期して１ずつ増加する。
　図６のＤは、比較器４４からAND回路４５に供給される比較結果を示す。比較結果がＨレベルであることは、TSクロック信号がアサートされていることを表す。図６のＤの例においては、PCR位置情報と図６のＣのカウント値が等しい、上記二組のパラメータセットにより表される区間（TSクロック信号の6クロック分の区間）でアサートされている。
　図６のＥは、AND回路４５からFIFO３２に供給されるPCRクロック信号を示す。図６のＤの比較結果がアサートされている区間においてTSクロック信号と同じ周波数で発振する信号がPCRクロック信号として出力される。すなわち、TSクロック信号のうち、比較結果がアサートされている区間のTSクロック信号がPCRクロック信号として出力される。
＜（５）PCR抽出部２４の処理の例＞
　図７は、PCR抽出部２４における処理の例を示す図である。
　ここでは、受信装置１が処理する信号の規格が国内衛星デジタル放送規格（非特許文献２）である場合について説明する。国内衛星デジタル放送規格においては、誤り訂正出力データはフレームを構成するデータとなる。各フレームは複数のスロットから構成され、スロットを用いてTSデータが伝送される。
　図７のＡは、復調部２２からTS抽出部２３に供給される誤り訂正出力データ（フレーム）を示す。
　時刻ｔ５１から時刻ｔ５２までの期間においてフレーム＃１が出力され、時刻ｔ５２から時刻ｔ５３までの期間においてフレーム＃２が出力される。また、時刻ｔ５３から時刻ｔ５４までの期間においてフレーム＃３が出力される。所望のTSデータは、図７のＡ中の斜線を付して示すスロットにおいて伝送される。
　図７のＢは、TS抽出部２３が抽出し、PCR抽出部２４（PCR抽出器３１）とTSデコーダ部２７に供給されるTSデータを示す。PCR抽出部２４（PCR抽出器３１）に供給されるTSデータはPCRデータの抽出用のデータであり、TSデコーダ部２７に供給されるTSデータはデコード用のデータである。
　所望のPCRデータは、図７のＢ中の黒線を付して示す部分で伝送される。例えばフレーム＃１から抽出された２つ目のスロットにはPCRデータが含まれる。スロットの中には、PCRデータを含むスロットとPCRデータを含まないスロットがある。
　TS抽出部２３は、復調部２２から供給されたフレーム（図７のＡ）から、所望のTSデータを伝送するスロットを選択し、そこに含まれるTSデータを抽出する。TS抽出部２３から出力されたTSデータは図７のＢに示すように断続的なデータとなる。
　図７のＣは、PCR抽出器３１からFIFO３２に供給され、記憶されるPCRデータを示す。
　図７のＤは、出力コントローラ３４からFIFO３２に供給されるPCRクロック信号を示す。図７のＤのPCRクロック信号が、図６のＥのPCRクロック信号に対応する。
　図７のＥは、PCR抽出部２４（FIFO３２）からクロックリカバリ部２５に供給されるPCRデータを示す。図７のＥに示すように、PCRデータは、PCRクロック信号に同期して、FIFO３２から１バイトずつ読み出される。
　FIFO３２から読み出されたPCRデータは、クロックリカバリ部２５においてクロックリカバリ処理に用いられ、システムクロック信号が生成される。生成されたシステムクロック信号は、上述したように同期再生制御部２６において映像・音声の同期再生制御に用いられる。
　以上のように、受信装置１においては、所望のデータストリームが間欠的に伝送される場合であっても、システムクロック信号を生成するためにフレーム単位などの大きなデータをバッファリングしておく必要がない。これにより、バッファリング用のメモリを削減することができ、回路コストとメモリバスの負荷を抑えることができる。
　また、大きなデータをバッファリングする場合と比べて、処理の遅延時間を軽減することができ、クロックリカバリ処理に用いられる時刻情報の伝送ジッタを抑制することが可能になる。
　すなわち、受信装置１は、効率的に、かつ安定したクロックリカバリ処理を行うことができる。
＜＜２．第２の実施の形態＞＞
＜汎用バスを用いたデータストリームの伝送システムの構成例＞
　図８は、受信装置の他の構成例を示すブロック図である。
　図８の受信装置１は、受信装置１０１と受信装置１０２とから構成される。例えば、受信装置１０１と受信装置１０２は、それぞれ異なるLSIにより構成される。
　上述したように、本技術においては、TSデータをPCRデータ抽出用とデコード用とに分け、PCRデータ抽出用のTSデータから抽出したPCRデータに基づいてシステムクロック信号を生成し、デコード用のTSデータのデコード結果の同期再生制御等に用いるようになされている。
　従って、同じTSデータを対象としてPCRデータの抽出とデコードを行う場合に比べて、データストリーム伝送におけるタイミング制御（ジッタ抑制）が不要になり、データストリーム伝送の要件が緩和される。その結果、データストリームの伝送を、伝送ジッタが多い伝送路である汎用バスを用いて行うなど、システムを柔軟に構成することが可能になる。汎用バスは、受信装置１が搭載するCPU（図示せず）が処理するデータなどの、データストリーム以外のデータの伝送にも用いられる伝送路である。
　図８に示す受信装置１においては、データストリームの復調、誤り訂正等の処理とクロックリカバリ処理は、前段の受信装置１０１において行われる。また、システムクロック信号を用いたデータストリームのデコードは、後段の受信装置１０２において行われる。受信装置１０１から受信装置１０２に対するデータストリームの伝送は汎用バスを用いて行われ、クロックリカバリ処理によって生成されたシステムクロック信号の伝送は専用線を用いて行われる。
　図８に示すように、受信装置１０１と受信装置１０２は、システムクロック信号の伝送に用いられる専用線である信号線１２１と、TSデータの伝送に用いられる汎用バス１２２によって接続される。汎用バス１２２として、例えばUSB、PCI Expressバスが用いられる。
　以下、図８の受信装置１の構成の詳細について説明する。図８に示す構成のうち、図１に示す構成と対応する構成には同じ符号を付してある。重複する説明については適宜省略する。
　受信装置１０１は、制御部１１－１と受信処理部１２－１から構成される。
　制御部１１－１は、所定のプログラムを実行し、受信処理部１２－１の動作を制御する。受信処理部１２－１は、チューナ部２１、復調部２２、TS抽出部２３、PCR抽出部２４、クロックリカバリ部２５、および汎用バスインタフェース１１１から構成される。
　TS抽出部２３により抽出された所望のTSデータは、PCRデータ抽出用のデータとしてPCR抽出部２４に供給されるとともに、伝送用のデータストリームとして汎用バスインタフェース１１１に供給される。
　汎用バスインタフェース１１１は、TS抽出部２３から供給されたTSデータを汎用バス１２２に出力する。
　クロックリカバリ部２５によりクロックリカバリ処理が行われることによって得られたシステムクロック信号は、PCR抽出部２４に供給されるとともに、信号線１２１に出力される。
　一方、受信装置１０２は、制御部１１－２と受信処理部１２－２から構成される。
　制御部１１－２は、所定のプログラムを実行し、受信処理部１２－２の動作を制御する。受信処理部１２－２は、同期再生制御部２６、TSデコーダ部２７、映像・音声再生部２８、汎用バスインタフェース１３１から構成される。
　同期再生制御部２６は、TSデコーダ部２７から供給されたPTSデータに基づいて、映像信号と音声信号の再生制御指示を映像・音声再生部２８に供給する。同期再生制御部２６による処理は、受信装置１０１のクロックリカバリ部２５から信号線１２１を介して供給されたシステムクロック信号に同期して行われる。
　汎用バスインタフェース１３１は、受信装置１０１の汎用バスインタフェース１１１から汎用バス１２２を介して供給されたTSデータを受信し、TSデコーダ部２７に供給する。
　以上のように、図８の受信装置１においては、システムクロック信号は、伝送ジッタが少ない専用の信号線で伝送され、同期再生制御に用いられる。そのため、伝送ジッタが多い汎用バスでデータストリームが伝送されたとしても、図１の受信装置１と同等の精度で、映像信号と音声信号の同期再生を行うことが可能となる。
＜＜３．変形例＞＞
＜伝送システムの他の構成例＞
　図９は、受信装置１のさらに他の構成例を示すブロック図である。
　図９に示す構成は、クロックリカバリ部２５が受信装置１０１ではなく受信装置１０２に設けられている点で、図８に示す構成と異なる。受信装置１０１と受信装置１０２の間の専用線として、PCRデータ用の伝送路である信号線１２４と、システムクロック信号用の伝送路である信号線１２３が設けられる。
　すなわち、図９の受信装置１においては、受信装置１０１のPCR抽出部２４により抽出されたPCRデータが信号線１２４を介して受信装置１０２に供給され、受信装置１０２により、クロックリカバリ処理が行われるようになされている。受信装置１０２のクロックリカバリ部２５により生成されたシステムクロック信号は、同期再生制御部２６に供給されるとともに、信号線１２３を介して受信装置１０１のPCR抽出部２４に供給される。このように、システム構成は適宜変更可能である。
＜MMT-TLV方式への適用＞
　本技術は、TS以外の放送ストリームにも適用可能である。例えば、国内高度広帯域デジタル衛星放送規格（非特許文献３）におけるMMT-TLV（MPEG Media Transport - Type Length Value）ストリームにも適用可能である。
　受信装置１が処理する信号が国内高度広帯域デジタル衛星放送規格のMMT-TLVストリームである場合、NTP(Network Time Protocol)が、上述した時刻情報に対応する。また、この場合、システムクロック周波数（Ｎ）は、2^N（2のべき乗）MHzとなる。
　また、放送波を受信する受信装置ではなく、通信装置に搭載される受信部にも本技術は適用可能である。
＜コンピュータの構成例＞
　上述した一連の処理は、ハードウェアにより実行することもできるし、ソフトウェアにより実行することもできる。一連の処理をソフトウェアにより実行する場合には、そのソフトウェアを構成するプログラムが、専用のハードウェアに組み込まれているコンピュータ、または汎用のパーソナルコンピュータなどに、プログラム記録媒体からインストールされる。
　図１０は、上述した一連の処理をプログラムにより実行するコンピュータのハードウェアの構成例を示すブロック図である。
　CPU３０１、ROM(Read Only Memory)３０２、RAM(Random Access Memory)３０３は、バス３０４により相互に接続されている。
　バス３０４には、さらに、入出力インタフェース３０５が接続されている。入出力インタフェース３０５には、キーボード、マウスなどよりなる入力部３０６、ディスプレイ、スピーカなどよりなる出力部３０７が接続される。また、入出力インタフェース３０５には、ハードディスクや不揮発性のメモリなどよりなる記憶部３０８、ネットワークインタフェースなどよりなる通信部３０９、リムーバブルメディア３１１を駆動するドライブ３１０が接続される。
　以上のように構成されるコンピュータでは、CPU３０１が、例えば、記憶部３０８に記憶されているプログラムを入出力インタフェース３０５及びバス３０４を介してRAM３０３にロードして実行することにより、上述した一連の処理が行われる。
　CPU３０１が実行するプログラムは、例えばリムーバブルメディア３１１に記録して、あるいは、ローカルエリアネットワーク、インターネット、デジタル放送といった、有線または無線の伝送媒体を介して提供され、記憶部３０８にインストールされる。
　なお、コンピュータが実行するプログラムは、本明細書で説明する順序に沿って時系列に処理が行われるプログラムであっても良いし、並列に、あるいは呼び出しが行われたとき等の必要なタイミングで処理が行われるプログラムであっても良い。
　本技術の実施の形態は、上述した実施の形態に限定されるものではなく、本技術の要旨を逸脱しない範囲において種々の変更が可能である。
　本明細書において、システムとは、複数の構成要素（装置、モジュール（部品）等）の集合を意味し、すべての構成要素が同一筐体中にあるか否かは問わない。したがって、別個の筐体に収納され、ネットワークを介して接続されている複数の装置、及び、１つの筐体の中に複数のモジュールが収納されている１つの装置は、いずれも、システムである。
　本明細書に記載された効果はあくまで例示であって限定されるものでは無く、また他の効果があってもよい。
　本技術の実施の形態は、上述した実施の形態に限定されるものではなく、本技術の要旨を逸脱しない範囲において種々の変更が可能である。
＜構成の組み合わせ例＞
　本技術は、以下のような構成をとることもできる。
（１）
　システムクロック信号を生成するときの基準となる時刻情報を含むデータストリームから前記時刻情報を抽出する抽出部と、
　前記時刻情報を記憶する記憶部と、
　前記データストリームの伝送レートと前記データストリームにおける前記時刻情報の位置情報とに基づいて、前記記憶部に記憶された前記時刻情報を、前記システムクロック信号に同期して出力させる制御部と、
　前記記憶部から出力された前記時刻情報に基づいてクロックリカバリ処理を行い、前記システムクロック信号を生成する生成部と
　を備える情報処理装置。
（２）
　前記制御部は、前記データストリームに付帯する伝送パラメータに基づいて前記伝送レートを特定する
　前記（１）に記載の情報処理装置。
（３）
　前記制御部は、前記システムクロック信号の周波数と前記伝送レートとの比に応じて前記システムクロック信号を分周し、分周して得られたクロック信号のうちの、前記位置情報により表される前記時刻情報の位置における前記クロック信号に同期して、前記時刻情報を前記記憶部から出力させる
　前記（１）または（２）に記載の情報処理装置。
（４）
　前記データストリームをデコードするデコード部と、
　前記データストリームをデコードすることによって得られたデータを、前記システムクロック信号に同期して再生させる再生制御部と
　をさらに備える前記（１）乃至（３）のうちのいずれかに記載の情報処理装置。
（５）
　前記データストリームはTSであり、
　前記時刻情報はPCRである
　前記（１）乃至（４）のうちのいずれかに記載の情報処理装置。
（６）
　前記データストリームはMMT-TLVストリームであり、
　前記時刻情報はNTPである
　前記（１）乃至（４）のうちのいずれかに記載の情報処理装置。
（７）
　前記伝送パラメータはTMCC情報である
　前記（２）に記載の情報処理装置。
（８）
　システムクロック信号を生成するときの基準となる時刻情報を含むデータストリームから前記時刻情報を抽出し、
　前記時刻情報を記憶部に記憶し、
　前記データストリームの伝送レートと前記データストリームにおける前記時刻情報の位置情報とに基づいて、前記記憶部に記憶した前記時刻情報を、前記システムクロック信号に同期して出力させ、
　前記記憶部から出力された前記時刻情報に基づいてクロックリカバリ処理を行い、前記システムクロック信号を生成する
　ステップを含む情報処理方法。
（９）
　システムクロック信号を生成するときの基準となる時刻情報を含むデータストリームから前記時刻情報を抽出し、
　前記時刻情報を記憶部に記憶し、
　前記データストリームの伝送レートと前記データストリームにおける前記時刻情報の位置情報とに基づいて、前記記憶部に記憶した前記時刻情報を、前記システムクロック信号に同期して出力させ、
　前記記憶部から出力された前記時刻情報に基づいてクロックリカバリ処理を行い、前記システムクロック信号を生成する
　ステップを含む処理を実行させるプログラム。
（１０）
　第１の情報処理部と、
　前記第１の情報処理部から、汎用バスを介して供給されたデータストリーム、および専用の信号線を介して供給されたシステムクロック信号を受信し、処理を行う第２の情報処理部と
　を備え、
　前記第１の情報処理部は、
　　前記システムクロック信号を生成するときの基準となる時刻情報を含む前記データストリームから前記時刻情報を抽出する抽出部と、
　　前記時刻情報を記憶する記憶部と、
　　前記データストリームの伝送レートと前記データストリームにおける前記時刻情報の位置情報とに基づいて、前記記憶部に記憶された前記時刻情報を、前記システムクロック信号に同期して出力させる制御部と、
　　前記記憶部から出力された前記時刻情報に基づいてクロックリカバリ処理を行うことによって生成した前記システムクロック信号を、前記専用の信号線に出力する生成部と、
　　前記データストリームを前記汎用バスに出力する出力部と
　を有し、
　前記第２の情報処理部は、
　　前記第１の情報処理部から前記汎用バスに出力された前記データストリームを受信する受信部と、
　　前記受信部により受信された前記データストリームをデコードするデコード部と、
　　前記データストリームをデコードすることによって得られたデータを、前記第１の情報処理部から前記専用の汎用バスに出力された前記システムクロック信号に同期して再生させる再生制御部と
　を有する
　情報処理装置。
（１１）
　システムクロック信号を生成するときの基準となる時刻情報を含むデータストリームを汎用バスに出力するとともに、前記データストリームから前記時刻情報を抽出し、抽出した前記時刻情報に基づいてクロックリカバリ処理を行うことによって生成した前記システムクロック信号を専用の信号線に出力する第１の情報処理部と、
　前記汎用バスを介して供給された前記データストリームをデコードし、デコードすることによって得られたデータを、前記専用の信号線を介して供給された前記システムクロック信号に同期して再生する第２の情報処理部と
　を備える情報処理装置。
　１　受信装置，　１１　制御部，　１２　受信処理部，　２１　チューナ部，　２２　復調部，　２３　TS抽出部，　２４　PCR抽出部，　２５　クロックリカバリ部，　２６　同期再生制御部，　２７　TSデコーダ部，　２８　映像・音声再生部，　３１　PCR抽出器，　３２，３３　FIFO，　３４　出力コントローラ，　４１　伝送レート計算部，　４２　N:M分周器，　４３　アップカウンタ，　４４　比較器，　４５　AND回路

Claims (11)

  1. 　システムクロック信号を生成するときの基準となる時刻情報を含むデータストリームから前記時刻情報を抽出する抽出部と、
    　前記時刻情報を記憶する記憶部と、
    　前記データストリームの伝送レートと前記データストリームにおける前記時刻情報の位置情報とに基づいて、前記記憶部に記憶された前記時刻情報を、前記システムクロック信号に同期して出力させる制御部と、
    　前記記憶部から出力された前記時刻情報に基づいてクロックリカバリ処理を行い、前記システムクロック信号を生成する生成部と
    　を備える情報処理装置。
  2. 　前記制御部は、前記データストリームに付帯する伝送パラメータに基づいて前記伝送レートを特定する
    　請求項１に記載の情報処理装置。
  3. 　前記制御部は、前記システムクロック信号の周波数と前記伝送レートとの比に応じて前記システムクロック信号を分周し、分周して得られたクロック信号のうちの、前記位置情報により表される前記時刻情報の位置における前記クロック信号に同期して、前記時刻情報を前記記憶部から出力させる
    　請求項１に記載の情報処理装置。
  4. 　前記データストリームをデコードするデコード部と、
    　前記データストリームをデコードすることによって得られたデータを、前記システムクロック信号に同期して再生させる再生制御部と
    　をさらに備える請求項１に記載の情報処理装置。
  5. 　前記データストリームはTSであり、
    　前記時刻情報はPCRである
    　請求項１に記載の情報処理装置。
  6. 　前記データストリームはMMT-TLVストリームであり、
    　前記時刻情報はNTPである
    　請求項１に記載の情報処理装置。
  7. 　前記伝送パラメータはTMCC情報である
    　請求項２に記載の情報処理装置。
  8. 　システムクロック信号を生成するときの基準となる時刻情報を含むデータストリームから前記時刻情報を抽出し、
    　前記時刻情報を記憶部に記憶し、
    　前記データストリームの伝送レートと前記データストリームにおける前記時刻情報の位置情報とに基づいて、前記記憶部に記憶した前記時刻情報を、前記システムクロック信号に同期して出力させ、
    　前記記憶部から出力された前記時刻情報に基づいてクロックリカバリ処理を行い、前記システムクロック信号を生成する
    　ステップを含む情報処理方法。
  9. 　システムクロック信号を生成するときの基準となる時刻情報を含むデータストリームから前記時刻情報を抽出し、
    　前記時刻情報を記憶部に記憶し、
    　前記データストリームの伝送レートと前記データストリームにおける前記時刻情報の位置情報とに基づいて、前記記憶部に記憶した前記時刻情報を、前記システムクロック信号に同期して出力させ、
    　前記記憶部から出力された前記時刻情報に基づいてクロックリカバリ処理を行い、前記システムクロック信号を生成する
    　ステップを含む処理を実行させるプログラム。
  10. 　第１の情報処理部と、
    　前記第１の情報処理部から、汎用バスを介して供給されたデータストリーム、および専用の信号線を介して供給されたシステムクロック信号を受信し、処理を行う第２の情報処理部と
    　を備え、
    　前記第１の情報処理部は、
    　　前記システムクロック信号を生成するときの基準となる時刻情報を含む前記データストリームから前記時刻情報を抽出する抽出部と、
    　　前記時刻情報を記憶する記憶部と、
    　　前記データストリームの伝送レートと前記データストリームにおける前記時刻情報の位置情報とに基づいて、前記記憶部に記憶された前記時刻情報を、前記システムクロック信号に同期して出力させる制御部と、
    　　前記記憶部から出力された前記時刻情報に基づいてクロックリカバリ処理を行うことによって生成した前記システムクロック信号を、前記専用の信号線に出力する生成部と、
    　　前記データストリームを前記汎用バスに出力する出力部と
    　を有し、
    　前記第２の情報処理部は、
    　　前記第１の情報処理部から前記汎用バスに出力された前記データストリームを受信する受信部と、
    　　前記受信部により受信された前記データストリームをデコードするデコード部と、
    　　前記データストリームをデコードすることによって得られたデータを、前記第１の情報処理部から前記専用の汎用バスに出力された前記システムクロック信号に同期して再生させる再生制御部と
    　を有する
    　情報処理装置。
  11. 　システムクロック信号を生成するときの基準となる時刻情報を含むデータストリームを汎用バスに出力するとともに、前記データストリームから前記時刻情報を抽出し、抽出した前記時刻情報に基づいてクロックリカバリ処理を行うことによって生成した前記システムクロック信号を専用の信号線に出力する第１の情報処理部と、
    　前記汎用バスを介して供給された前記データストリームをデコードし、デコードすることによって得られたデータを、前記専用の信号線を介して供給された前記システムクロック信号に同期して再生する第２の情報処理部と
    　を備える情報処理装置。
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