WO2016084349A1 - 抵抗変化素子とその製造方法および半導体装置 - Google Patents
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Abstract
Description
(第1の実施形態)
図1は、本発明の第1の実施形態の抵抗変化素子の構造を示す断面図である。本実施形態の抵抗変化素子1は、第1の絶縁膜101に埋め込まれ、第1の絶縁膜101を覆う第2の絶縁膜102の有する開口部103によって上面が第1の絶縁膜101から露出した、金属イオンを供給する第1の電極104を有する。さらに、開口部103を覆って第1の電極104の上面に接する金属析出型の抵抗変化膜105を有する。さらに、抵抗変化膜105の上面に接する第2の電極106を有する。さらに、開口部103の幅は、第1の電極104の上面の幅よりも大きく、開口部103の端部は、開口部103の端部が対向する第1の電極104の上面の端部からのマージン107を有して設けられている。
(第2の実施形態)
図3は、本発明の第2の実施形態の抵抗変化素子の構造を示す断面図である。本実施形態の抵抗変化素子1aは、抵抗変化膜9に金属イオンを供給する電極である第1銅配線5と、バリア絶縁膜7と、抵抗変化膜9と、抵抗変化膜9に金属イオンを供給しない不関電極である上部電極10とを含む。
(第3の実施形態)
図7は、本発明の第3の実施形態の抵抗変化素子の構造を示す断面図である。本実施形態の抵抗変化素子1bは、抵抗変化膜9に金属イオンを供給する電極である第1銅配線5aおよび第1銅配線5bと、バリア絶縁膜7と、抵抗変化膜9と、抵抗変化膜9に金属イオンを供給しない不関電極である上部電極10とを含む。
(第4の実施形態)
図9は、本発明の第4の実施形態の抵抗変化素子の構造を示す断面図である。本実施形態の抵抗変化素子1cは、抵抗変化膜9に金属イオンを供給する電極であるプラグ28と、バリア絶縁膜7と、抵抗変化膜9と、抵抗変化膜9に金属イオンを供給しない不関電極である上部電極10とを含む。
(第5の実施形態)
図12は、本発明の第5の実施形態の抵抗変化素子の構造を示す断面図である。本実施形態の抵抗変化素子1dは、抵抗変化膜9に金属イオンを供給する電極であるプラグ28a、プラグ28bと、バリア絶縁膜7と、抵抗変化膜9と、抵抗変化膜9に金属イオンを供給しない不関電極である上部電極10とを含む。
(付記1)
第1の絶縁膜に埋め込まれ、前記第1の絶縁膜を覆う第2の絶縁膜の有する開口部によって上面が前記第1の絶縁膜から露出した、金属イオンを供給する第1の電極と、
前記開口部を覆って前記第1の電極の上面に接する金属析出型の抵抗変化膜と、
前記抵抗変化膜の上面に接する第2の電極と、を有し、
前記開口部の幅は、前記第1の電極の上面の幅よりも大きく、
前記開口部の端部は、前記開口部の端部が対向する前記第1の電極の上面の端部からのマージンを有して設けられている、抵抗変化素子。
(付記2)
前記第1の電極は、半導体集積回路の多層銅配線内の銅配線を有し、
前記開口部は、前記銅配線の幅方向で対向する辺の双方を含む上面の一部を露出させる、付記1記載の抵抗変化素子。
(付記3)
前記第1の電極は、半導体集積回路の多層銅配線内の銅プラグを有し、
前記開口部は、前記銅プラグの上面全体を露出させる、付記1記載の抵抗変化素子。
(付記4)
前記開口部は、前記第1の電極の上面に連続する前記第1の電極の側面を露出させる、付記1から3の内の1項記載の抵抗変化素子。
(付記5)
前記第1の電極は、複数である、付記1から4の内の1項記載の抵抗変化素子。
(付記6)
前記マージンは、前記開口部の位置ずれを許容する、付記1から5の内の1項記載の抵抗変化素子。
(付記7)
前記マージンは、フォトリソグラフィの精度が保証される範囲以上とする、付記1から6の内の1項記載の抵抗変化素子。
(付記8)
前記第2の電極は、ルテニウムもしくはプラチナを含む、付記1から7の内の1項記載の抵抗変化素子。
(付記9)
第1の絶縁膜に埋め込まれた金属イオンを供給する第1の電極を形成し、
前記第1の絶縁膜と前記第1の電極とを被覆する第2の絶縁膜を形成し、
前記第2の絶縁膜に前記第1の電極の上面を露出させる開口部を、前記開口部の幅は前記第1の電極の上面の幅よりも大きく、前記開口部の端部は前記開口部の端部が対向する前記第1の電極の上面の端部からのマージンを有して、開口し、
前記開口部を覆って前記第1の電極の上面に接する金属析出型の抵抗変化膜を形成し、
前記抵抗変化膜の上面に接する第2の電極を形成する、抵抗変化素子の製造方法。
(付記10)
前記第1の電極は、半導体集積回路の多層銅配線内の銅配線を有し、
前記開口部は、前記銅配線の幅方向で対向する辺の双方を含む上面の一部を露出させる、付記9記載の抵抗変化素子の製造方法。
(付記11)
前記第1の電極は、半導体集積回路の多層銅配線内の銅プラグを有し、
前記開口部は、前記銅プラグの上面全体を露出させる、付記9記載の抵抗変化素子の製造方法。
(付記12)
前記開口部は、前記第1の電極の上面に連続する前記第1の電極の側面を露出させる、付記9から11の内の1項記載の抵抗変化素子の製造方法。
(付記13)
前記第1の電極は複数である、付記9から12の内の1項記載の抵抗変化素子の製造方法。
(付記14)
前記マージンは、前記開口部の位置ずれを許容する、付記9から13の内の1項記載の抵抗変化素子の製造方法。
(付記15)
前記マージンは、フォトリソグラフィの精度が保証される範囲以上とする、付記9から14の内の1項記載の抵抗変化素子の製造方法。
(付記16)
前記第2の電極は、ルテニウムもしくはプラチナを含む、付記9から15の内の1項記載の抵抗変化素子の製造方法。
(付記17)
付記1から8の内の1項記載の抵抗変化素子を、多層銅配線を有する半導体集積回路の前記多層銅配線内に組み込んだ半導体装置。
2 半導体装置
3、7、7’、21、21’ バリア絶縁膜
4、4’、4a、4b、15、15’ 層間絶縁膜
5、5a、5b、5a’、5b’ 第1銅配線
6、6a、6b、6a’、6b’、20、20’、29、29a、29b バリアメタル
9、9’ 抵抗変化膜
10、10’ 上部電極
18、18’ 第2銅配線
19、19’、28、28a、28b プラグ
25 マージン
26a、26b、26c、26d、26’ 開口部
27 オーバーエッチング部
30 半導体集積回路
101 第1の絶縁膜
102 第2の絶縁膜
103 開口部
104 第1の電極
105 抵抗変化膜
106 第2の電極
107 マージン
Claims (10)
- 第1の絶縁膜に埋め込まれ、前記第1の絶縁膜を覆う第2の絶縁膜の有する開口部によって上面が前記第1の絶縁膜から露出した、金属イオンを供給する第1の電極と、
前記開口部を覆って前記第1の電極の上面に接する金属析出型の抵抗変化膜と、
前記抵抗変化膜の上面に接する第2の電極と、を有し、
前記開口部の幅は、前記第1の電極の上面の幅よりも大きく、
前記開口部の端部は、前記開口部の端部が対向する前記第1の電極の上面の端部からのマージンを有して設けられている、抵抗変化素子。 - 前記第1の電極は、半導体集積回路の多層銅配線内の銅配線を有し、
前記開口部は、前記銅配線の幅方向で対向する辺の双方を含む上面の一部を露出させる、請求項1記載の抵抗変化素子。 - 前記第1の電極は、半導体集積回路の多層銅配線内の銅プラグを有し、
前記開口部は、前記銅プラグの上面全体を露出させる、請求項1記載の抵抗変化素子。 - 前記開口部は、前記第1の電極の上面に連続する前記第1の電極の側面を露出させる、請求項1から3の内の1項記載の抵抗変化素子。
- 前記第1の電極は、複数である、請求項1から4の内の1項記載の抵抗変化素子。
- 前記マージンは、前記開口部の位置ずれを許容する、請求項1から5の内の1項記載の抵抗変化素子。
- 第1の絶縁膜に埋め込まれた金属イオンを供給する第1の電極を形成し、
前記第1の絶縁膜と前記第1の電極とを被覆する第2の絶縁膜を形成し、
前記第2の絶縁膜に前記第1の電極の上面を露出させる開口部を、前記開口部の幅は前記第1の電極の上面の幅よりも大きく、前記開口部の端部は前記開口部の端部が対向する前記第1の電極の上面の端部からのマージンを有して、開口し、
前記開口部を覆って前記第1の電極の上面に接する金属析出型の抵抗変化膜を形成し、
前記抵抗変化膜の上面に接する第2の電極を形成する、抵抗変化素子の製造方法。 - 前記第1の電極は、半導体集積回路の多層銅配線内の銅配線を有し、
前記開口部は、前記銅配線の幅方向で対向する辺の双方を含む上面の一部を露出させる、請求項7記載の抵抗変化素子の製造方法。 - 前記第1の電極は、半導体集積回路の多層銅配線内の銅プラグを有し、
前記開口部は、前記銅プラグの上面全体を露出させる、請求項7記載の抵抗変化素子の製造方法。 - 請求項1から6の内の1項記載の抵抗変化素子を、多層銅配線を有する半導体集積回路の前記多層銅配線内に組み込んだ半導体装置。
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Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2018123678A1 (ja) * | 2016-12-27 | 2018-07-05 | 日本電気株式会社 | 抵抗変化素子と半導体装置および製造方法 |
WO2019203169A1 (ja) * | 2018-04-17 | 2019-10-24 | 日本電気株式会社 | 半導体装置 |
Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008192995A (ja) * | 2007-02-07 | 2008-08-21 | Matsushita Electric Ind Co Ltd | 抵抗変化素子とその製造方法ならびにそれを用いた抵抗変化型メモリ |
JP2008306011A (ja) * | 2007-06-08 | 2008-12-18 | Panasonic Corp | 不揮発性半導体記憶装置およびその製造方法 |
JP2009021431A (ja) * | 2007-07-12 | 2009-01-29 | Hitachi Ltd | 半導体装置 |
WO2010150720A1 (ja) * | 2009-06-25 | 2010-12-29 | 日本電気株式会社 | 半導体装置及びその製造方法 |
JP2011151049A (ja) * | 2008-05-16 | 2011-08-04 | Panasonic Corp | 不揮発性半導体記憶装置およびその製造方法 |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7919862B2 (en) * | 2006-05-08 | 2011-04-05 | Taiwan Semiconductor Manufacturing Company, Ltd. | Reducing resistivity in interconnect structures of integrated circuits |
JP5454478B2 (ja) * | 2009-01-09 | 2014-03-26 | 日本電気株式会社 | スイッチング素子及びその製造方法 |
JP2010177393A (ja) * | 2009-01-29 | 2010-08-12 | Sony Corp | 半導体記憶装置およびその製造方法 |
KR101541056B1 (ko) * | 2011-09-13 | 2015-07-31 | 아데스토 테크놀러지스 코포레이션 | 합금 전극을 갖는 저항 스위칭 디바이스 및 그 형성 방법 |
US9231197B2 (en) * | 2012-11-12 | 2016-01-05 | Taiwan Semiconductor Manufacturing Company, Ltd. | Logic compatible RRAM structure and process |
-
2015
- 2015-11-18 JP JP2016561237A patent/JPWO2016084349A1/ja active Pending
- 2015-11-18 WO PCT/JP2015/005766 patent/WO2016084349A1/ja active Application Filing
- 2015-11-18 US US15/523,435 patent/US20170309817A1/en not_active Abandoned
Patent Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008192995A (ja) * | 2007-02-07 | 2008-08-21 | Matsushita Electric Ind Co Ltd | 抵抗変化素子とその製造方法ならびにそれを用いた抵抗変化型メモリ |
JP2008306011A (ja) * | 2007-06-08 | 2008-12-18 | Panasonic Corp | 不揮発性半導体記憶装置およびその製造方法 |
JP2009021431A (ja) * | 2007-07-12 | 2009-01-29 | Hitachi Ltd | 半導体装置 |
JP2011151049A (ja) * | 2008-05-16 | 2011-08-04 | Panasonic Corp | 不揮発性半導体記憶装置およびその製造方法 |
WO2010150720A1 (ja) * | 2009-06-25 | 2010-12-29 | 日本電気株式会社 | 半導体装置及びその製造方法 |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2018123678A1 (ja) * | 2016-12-27 | 2018-07-05 | 日本電気株式会社 | 抵抗変化素子と半導体装置および製造方法 |
US10957739B2 (en) | 2016-12-27 | 2021-03-23 | Nec Corporation | Resistance variation element, semiconductor device, and manufacturing method |
WO2019203169A1 (ja) * | 2018-04-17 | 2019-10-24 | 日本電気株式会社 | 半導体装置 |
Also Published As
Publication number | Publication date |
---|---|
US20170309817A1 (en) | 2017-10-26 |
JPWO2016084349A1 (ja) | 2017-09-07 |
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Legal Events
Date | Code | Title | Description |
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121 | Ep: the epo has been informed by wipo that ep was designated in this application |
Ref document number: 15863019 Country of ref document: EP Kind code of ref document: A1 |
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WWE | Wipo information: entry into national phase |
Ref document number: 15523435 Country of ref document: US |
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ENP | Entry into the national phase |
Ref document number: 2016561237 Country of ref document: JP Kind code of ref document: A |
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NENP | Non-entry into the national phase |
Ref country code: DE |
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122 | Ep: pct application non-entry in european phase |
Ref document number: 15863019 Country of ref document: EP Kind code of ref document: A1 |