WO2015093187A1 - マイクロコンピュータおよびそのクロックの補正方法 - Google Patents

マイクロコンピュータおよびそのクロックの補正方法 Download PDF

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浩 宮坂
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    • Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
    • Y02D10/00—Energy efficient computing, e.g. low power processors, power management or thermal management

Definitions

  • the present invention relates to a microcomputer having a clock for a sleep mode separately from that for a normal operation mode of a CPU, and a method for correcting the clock.
  • the microcomputer does not stop controlling various devices while driving, and the microcomputer automatically controls the room lamps to automatically turn on and off, lock and unlock the doors without keys, security against theft, and engine start-up. It has become so.
  • the microcomputer since the CPU executes a predetermined arithmetic processing based on the clock signal, a clock using a crystal resonator, for example, is provided to generate the clock signal.
  • the CPU shifts from the normal operation mode for various controls required during the operation of the vehicle to the sleep mode for power saving when a predetermined condition is satisfied when the engine is stopped. Even in the mode, for example, a predetermined clock signal for intermittent operation is required.
  • Japanese Patent Laid-Open No. 5-75445 stores the oscillation frequency of the CR oscillation circuit measured when the ambient temperature and the power supply voltage are under the reference measurement conditions as the reference oscillation frequency.
  • the frequency fluctuation from the reference oscillation frequency is calculated from the current temperature and voltage detection values based on the temperature and oscillation frequency characteristics obtained in advance and the voltage and oscillation frequency characteristics, and the current oscillation frequency is obtained and corrected.
  • a technique for maintaining the accuracy of the oscillation frequency has been proposed.
  • Japanese Patent Laid-Open No. 2006-27017 discloses a communication rate for making the data transmission time of one frame managed by the communication circuit constant based on an oscillation output characteristic that varies depending on the temperature of the CR oscillation circuit. There has been proposed a technique for maintaining control accuracy by storing data and setting a communication rate in a communication circuit that is determined by reading stored data in accordance with a detected temperature value.
  • an object of the present invention is to provide a microcomputer capable of holding a clock used in a power-saving sleep mode with higher accuracy and a method for correcting the clock in view of the above-described conventional problems.
  • the present invention acquires count data from a standard clock signal source having a frequency accuracy higher than that of the clock, and uses the count data from the standard clock signal source as a reference. Clock count data is measured, and the clock signal of the clock is corrected based on the measurement result.
  • the clock count data is directly measured, the actual count state is grasped, not estimated, and based on this, reliable correction is performed, and high accuracy requirements can be met.
  • FIG. 1 is a diagram illustrating a vehicle integrated control apparatus according to an embodiment.
  • the vehicle integrated control device 10 includes a microcomputer, a CPU 11, a memory 12 that stores programs and data, a main clock 13 that uses a crystal vibrator that supplies a clock signal to the CPU 11, an external ignition switch 2 and a door switch 3.
  • An input interface (input IF) 14 that connects the input device 1 such as various switches and sensors and the CPU 11 to the CPU 11, an output interface (output IF) 15 that connects the output device 4 such as a door lock, a lamp, and a light and the CPU 11, an in-vehicle network (CAN ) It has a communication interface 16 for connection, and a power supply circuit 17 as a drive source thereof.
  • the CPU 11 can be switched between a normal operation mode and a power saving sleep mode as an operation mode, and includes a sub-clock 20, a time counter 25, and a pulse counter 26.
  • the sub clock 20 includes a CR oscillation circuit 21 and a loop counter 22 that counts oscillation pulses of the CR oscillation circuit 21.
  • the time counter 25 counts a clock signal from the main clock 13 input to the CPU 11 and measures a predetermined time T described later.
  • the pulse counter 26 counts the oscillation pulses of the CR oscillation circuit 21 at a predetermined time T when the time counter 25 operates.
  • the CPU 11 Based on the ON operation of the ignition switch 2 of the vehicle, the CPU 11 activates the main clock 13 and operates in the normal operation mode, and executes arithmetic processing based on the clock signal from the main clock 13.
  • the oscillation frequency of the main clock 13 is 4 MHz
  • the clock signal is directly used as a timing signal for arithmetic processing.
  • the clock signal from the main clock 13 is divided or multiplied to be an internal clock. May be used as a timing signal for arithmetic processing.
  • the CPU 11 shifts to the sleep mode. In shifting to the sleep mode, the CPU 11 pauses the main clock 13 while turning on the built-in subclock 20 and intermittently executes the presence / absence of an interrupt or predetermined monitoring using the clock signal as a timing signal.
  • the sub clock 20 is corrected.
  • the sub clock 20 is set so that the oscillation frequency of the CR oscillation circuit 21 is set to 125 kHz, for example, the target count Pm of the loop counter is set to 125000, and the loop counter 22 exits the loop and outputs a clock signal every time the target count Pm reaches the target count Pm.
  • a clock signal having a period of 1 sec is output as a reference state.
  • the clock interval (cycle 1 sec) in the reference state is called a reference time S.
  • the CPU 11 measures the state of the sub clock 20 by referring to the clock signal of the main clock 13 having a frequency accuracy higher than that of the sub clock as a standard clock signal by interruption at appropriate intervals during the normal operation mode. More specifically, the pulse counter 26 measures the oscillation pulse of the CR oscillation circuit 21 of the sub clock 20 at a predetermined time T counted by counting the clock signal from the main clock 13 by the time counter 25, and counts the pulse. Find P. This acquisition of the pulse count P is repeated, and the loop counter 22 of the sub clock 20 is corrected based on the latest pulse count P acquired last before the transition to the sleep mode.
  • the reference count Po set as the target count Pm as the number of pulses to be output by the CR oscillation circuit 21 becomes 125000.
  • the measured pulse count P is 120,000
  • there is an error ⁇ of 5000 pulses with the target count Pm so that the target count Pm of the loop counter 22 remains 125000 which is the reference count Po.
  • the clock signal output after reaching the target count Pm is delayed from the reference time S, and the clock interval (cycle) is longer than 1 sec.
  • the correction may be performed by changing the target count Pm to the pulse count P that is the measurement result.
  • the predetermined time T to be measured is set to be the same as the reference time S of the clock signal of the sub clock 20, and the difference between the target count Pm and the measured pulse count P is set as the error ⁇ .
  • P / k is an integer based on the INT function.
  • FIG. 2 is a flowchart showing the flow of control related to the correction of the subclock 20 in the CPU 11.
  • the CPU 11 activates the main clock 13 and enters the normal operation mode, and uses the clock signal from the main clock 13 as a basis of processing timing.
  • the CPU 11 first resets the time counter 25 and the pulse counter 26 at step 100 as initialization, and sets the reference count corresponding to a predetermined reference time S of the clock signal to the target count Pm of the loop counter 22 of the sub clock 20.
  • step 101 it is checked whether or not it is an interrupt timing of clock measurement. If it is an interrupt timing, the process proceeds to step 102, and if not, the process proceeds to step 106.
  • step 102 the sub clock 20 built in the CPU 11 is turned ON.
  • step 103 the clock counter 25 starts counting the clock signal from the main clock 13 simultaneously with the time counter 25, and measures the oscillation pulse of the sub clock 20 (CR oscillation circuit 21) at a predetermined time T.
  • the pulse count P is obtained.
  • the predetermined time T is set in advance to k times the reference time S.
  • the measured pulse count P is stored in the memory 12 in the next step 104. When the pulse count P in the previous flow is stored in the memory 12, it is updated by overwriting.
  • the subclock 20 is turned off at step 105 and the routine proceeds to step 106. At this time, the time counter 25 and the pulse counter 26 are also reset.
  • step 106 it is checked whether a predetermined condition for sleep is satisfied in the input apparatus 1 including turning off the ignition switch 2, and if the condition is not satisfied, the process returns to step 101, and the condition is satisfied. If so, go to Step 107.
  • step 107 the pulse count P stored in the memory 12 is read, and the value of the target count Pm of the loop counter 22 of the sub clock 20 is corrected to P / k.
  • step 108 the main clock 13 is turned off and the sub clock 20 is turned on to switch the clock.
  • step 109 the CPU itself shifts to the sleep mode. Thereafter, it is checked whether or not the conditions for the normal operation mode are satisfied. If the conditions are satisfied, the operation mode is switched, but the description is omitted.
  • the error of the sub clock 20 is corrected based on the latest oscillation state of the CR oscillation circuit 21 immediately before the transition to the sleep mode, and the CPU 11 has the same level of accuracy as the high-precision main clock 13 even in the sleep mode.
  • a predetermined process can be executed based on the clock signal.
  • the vehicle integrated control device 10 corresponds to the microcomputer in the invention
  • the sub clock 20 corresponds to the clock for the sleep mode
  • the main clock 13 corresponds to the standard clock signal source.
  • the CR oscillation circuit 21 in the sub clock 20 corresponds to the clock oscillation source.
  • the clock signal of the main clock 13 corresponds to count data from the standard clock signal source, and the oscillation pulse of the CR oscillation circuit 21 corresponds to clock count data.
  • step 104 corresponds to the measuring means and the second process
  • step 108 corresponds to the correcting means and the third process.
  • the embodiment is configured as described above, and the sub clock 20 is formed by the CR oscillation circuit 21 and the loop counter 22 that counts the oscillation pulses and outputs a clock signal every time the target count Pm is reached.
  • the sub clock is corrected by correcting the target count Pm according to the pulse count P. Since 20 clock signals are corrected, the actual count state is grasped, not estimated, and reliable correction is performed based on this.
  • the target count Pm of the loop counter 22 is corrected according to the pulse count P measured with reference to the time measured by the clock signal of the main clock 13 as described above, the sub-clock is configured with low cost and low power consumption. Even in the case of 22, a clock signal having the same level of accuracy as that of the high-precision main clock 13 is output, and it is possible to cope with high required accuracy.
  • the sub clock 20 is operated at predetermined time intervals while the CPU 11 is in the normal operation mode, and the pulse count P of the oscillation pulse is stored in the memory 12.
  • the target count Pm is corrected using the latest pulse count P stored in the memory 12
  • a correction adapted to the state of the latest subclock 20 is always executed, and a highly accurate clock signal is stably output.
  • the sub clock 20 is built in the CPU 11, it is easy to configure it with low power consumption, and wiring and installation space in the vehicle integrated control device 10 are not required.
  • the clock signal from the main clock 13 provided with a crystal resonator and externally attached to the CPU 11 is used as count data for measuring the predetermined time T.
  • the standard radio wave data indicating the extracted standard time and the time signal included in the GPS signal are taken in via the in-vehicle network as count data from the standard clock signal source. It may be used for measuring the predetermined time T. This also makes it possible to output a highly accurate clock signal from the sleep mode sub-clock 20.
  • the clock oscillation circuit 21 in which the clock for sleep mode is built in the CPU 11 is oscillated.
  • the sub-clock 20 is used as the source, the sub-clock 20 is not limited to this, and may be external to the CPU 11. Further, for example, if the oscillation frequency is lower than that of the main clock 13 and the power consumption is small, the clock for the sleep mode is not limited to the CR oscillation circuit, and may be a crystal oscillator or a ceramic oscillator.
  • all the numerical values shown in the embodiment are merely examples, and the present invention is not limited to the described numerical values.
  • Input Device 2 Ignition Switch 3 Output Device 10 Vehicle Integrated Control Device 11
  • CPU 12 memory 13
  • main clock 14 input interface 15
  • output interface 16 communication interface 17
  • power supply circuit 20 subclock 21
  • CR oscillation circuit 22 loop counter 25
  • clock counter 26 pulse counter

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Abstract

【課題】マイクロコンピュータにおけるスリープモード用サブクロックを高精度に保持する。 【解決手段】サブクロック２０はＣＲ発振回路２１の発振パルスをループカウンタ２２でカウントして目標カウントＰｍに達するごとにクロック信号を出力する。ＣＰＵ１１は、クリスタル振動子によるメインクロック１３のクロック信号を用いて計時カウンタ２５で計時する所定時間におけるＣＲ発振回路２１の発振パルスをパルスカウンタ２６でカウントして、そのパルスカウントＰに応じて目標カウントＰｍを補正する。周波数精度の高いメインクロックのクロック信号を基準にして、サブクロック２０の推定ではなく現実のカウント状態を把握してクロック信号を補正するので、温度などの環境変化があってもサブクロックを高精度が保持される。

Description

マイクロコンピュータおよびそのクロックの補正方法
　本発明は、ＣＰＵの通常動作モード用とは別個にスリープモード用のクロックを有するマイクロコンピュータ、およびそのクロックの補正方法に関する。
　現今の車両では、走行中における各種装置の制御に止まらず、停車後においてもルームランプの自動点消灯、キーレスによるドアのロック・アンロック、盗難に対するセキュリティ、エンジン始動等がマイクロコンピュータにより統合制御されるようになっている。マイクロコンピュータはクロック信号に基づいてＣＰＵが所定の演算処理を実行するので、そのクロック信号を生成するために例えばクリスタル振動子を用いたクロックを備えている。
　車両の統合制御においては、ＣＰＵを車両の運転中に必要な諸制御のための通常動作モードから、エンジン停止に伴って所定の条件が成立すると省電力のためのスリープモードに移行させるが、スリープモードにおいても例えば間欠動作のための所定のクロック信号を必要とする。
　通常動作モードでは制御すべき処理対象も多く、発振周波数が高くかつ０．００５％程度の高い周波数精度が得られるクリスタル振動子を用いたクロックが適切であるが、精度が高いものほどコストが増大するとともに消費電力も大きくなる。したがって、とくにバッテリの充電が行われないエンジン停止中、ＣＰＵを省電力のスリープモードに移行させるのに対応して、クロックも通常動作時とは異なる消費電力の小さいクロックに切り替えることが望ましい。
　そこで、スリープ時用のクロックを例えばＣＲ発振回路を用いて構成すると、低コストで消費電力も小さくなるが、雰囲気温度等によっては５％程度発振周波数が変化するなど誤差が大きい。したがって、消費電力の小さいクロックへの切り替えは精度の低下を伴うこととなるが、しかしスリープモードにおいてもクロックの精度に対する要求が高くなっているので、精度保持の方策が必要となる。
　従来、ＣＲ発振回路によるクロックについて、例えば特開平５－７５４４５号公報には、周囲温度および電源電圧が基準測定条件にあるときに測定したＣＲ発振回路の発振周波数を基準発振周波数として記憶しておき、基準発振周波数からの周波数変動をあらかじめ求められた温度と発振周波数の特性、および電圧と発振周波数の特性に基づいて現在の温度と電圧の検出値から演算して現在の発振周波数を求め、補正することにより発振周波数の精度を保持しようとする技術が提案されている。
　また、特開２００６－２７０９１７号公報には、ＣＲ発振回路の温度により変動する発振出力特性に基づいて、通信回路で管理される１フレームのデータ送信時間を一定とするための通信レートを決定するデータを記憶しておき、温度の検出値に応じて記憶データを読み出して決定した通信レートを通信回路に設定することにより、制御精度を保持する技術が提案されている。
特開平５－７５４４５号公報 特開２００６－２７０９１７号公報
　しかしながら、上記従来の技術はいずれもマイクロコンピュータの出荷あるいは車両搭載前に測定された特性やプロファイルを参照して算出した間接的な現在データに基づいて、現在の発振周波数あるいは誤差状態を推定して補正を行うものであり、その推定値が現在の状態と正確に合致しているかどうか検証できないという問題を有している。そのため、高い要求精度に確実に対応できるとは言い難い。
　したがって本発明は、上記従来の問題点に鑑み、省電力のスリープモードで用いられるクロックをより高精度に保持可能としたマイクロコンピュータ、およびそのクロックの補正方法を提供することを目的とする。
　このため、本発明は、少なくとも一つのクロックを有するマイクロコンピュータにおいて、前記クロックより周波数精度の高い標準クロック信号源からのカウントデータを取得し、前記標準クロック信号源からのカウントデータを基準にして前記クロックのカウントデータを計測し、その計測結果に基づいて前記クロックのクロック信号を補正するものとした。
　本発明によれば、クロックのカウントデータを直接計測対象としているので、推定ではなく現実のカウント状態が把握され、これに基づいて確実な補正が行われ、高い精度要求に応えることができる。
実施の形態にかかる車両統合制御装置の構成を示すブロック図である。 サブクロックの補正にかかる制御の流れを示すフローチャートである。
　以下、本発明の実施の形態について説明する。
　図１は実施の形態にかかる車両統合制御装置を示す図である。
　車両統合制御装置１０は、マイクロコンピュータで構成され、ＣＰＵ１１、プログラムやデータを格納するメモリ１２、ＣＰＵ１１にクロック信号を供給するクリスタル振動子を用いたメインクロック１３、外部のイグニションスイッチ２やドアスイッチ３を含む各種スイッチやセンサなどの入力装置１とＣＰＵ１１をつなぐ入力インタフェース（入力ＩＦ）１４、ドアロックやランプ、ライトなどの出力装置４とＣＰＵ１１をつなぐ出力インタフェース（出力ＩＦ）１５、車載ネットワーク（ＣＡＮ）接続用の通信インタフェース１６、およびこれらの駆動源としての電源回路１７を有している。
　ＣＰＵ１１は、動作モードとして通常動作モードと省電力のためのスリープモードとに切り替え可能となっており、サブクロック２０と計時カウンタ２５、およびパルスカウンタ２６を内蔵している。
　サブクロック２０は、ＣＲ発振回路２１とＣＲ発振回路２１の発振パルスをカウントするループカウンタ２２とからなっている。
　計時カウンタ２５は、ＣＰＵ１１に入力するメインクロック１３からのクロック信号をカウントして後述する所定時間Ｔを計時する。
　パルスカウンタ２６は、計時カウンタ２５の動作時に所定時間ＴにおけるＣＲ発振回路２１の発振パルスをカウントする
　車両のイグニションスイッチ２のＯＮ操作に基づいて、ＣＰＵ１１はメインクロック１３を起動するとともに通常動作モードで動作し、メインクロック１３からのクロック信号を基礎として演算処理を実行する。
　ここでは、メインクロック１３の発振周波数が４ＭＨｚで、そのクロック信号がそのまま演算処理のタイミング信号とされるが、ＣＰＵ１１によってはメインクロック１３からのクロック信号を分周あるいは逓倍して内部クロックとし、これを演算処理のタイミング信号とする場合もある。
　イグニションスイッチ２がＯＦＦされてエンジンが停止し、停車状態で例えばドアが開閉されたあと所定時間が経過するなど所定の条件が成立すると、ＣＰＵ１１はスリープモードに移行する。スリープモードへの移行に当たって、ＣＰＵ１１はメインクロック１３を休止させる一方、内蔵のサブクロック２０をＯＮさせてそのクロック信号をタイミング信号として割り込みの有無や所定の監視を間欠的に実行する。
　スリープモード移行に際してはサブクロック２０の補正が行われる。以下、この補正について説明する。
　まず、サブクロック２０はＣＲ発振回路２１の発振周波数を１２５ＫＨｚとし、例えばループカウンタの目標カウントＰｍを１２５０００として、ループカウンタ２２が当該目標カウントＰｍに達するごとにループから抜けてクロック信号を出力する設定となっており、これにより基準状態として周期１ｓｅｃのクロック信号を出力する。基準状態のクロック間隔（周期１ｓｅｃ）を基準時間Ｓと呼ぶ。
　ＣＰＵ１１は、その通常動作モードの間に適時間隔の割り込みで、サブクロックより周波数精度の高いメインクロック１３のクロック信号を標準クロック信号として参照し、サブクロック２０の状態を測定する。
　具体的には、メインクロック１３からのクロック信号を計時カウンタ２５でカウントして計時される所定時間Ｔにおける、サブクロック２０のＣＲ発振回路２１の発振パルスをパルスカウンタ２６で計測して、パルスカウントＰを求める。
　このパルスカウントＰの取得を繰り返し、スリープモード移行前の最後に取得された最新のパルスカウントＰに基づいて、サブクロック２０のループカウンタ２２に補正をかける。
　すなわち、所定時間Ｔを例えば基準時間Ｓと同一の１ｓｅｃとすると、その間にＣＲ発振回路２１が出力すべきパルス数として目標カウントＰｍに設定された基準カウントＰｏは１２５０００となる。しかし、計測されたパルスカウントＰが１２００００であった場合には目標カウントＰｍとの間に５０００パルスの誤差αがあるので、ループカウンタ２２の目標カウントＰｍを基準カウントＰｏである１２５０００のままにしておいた場合には、目標カウントＰｍまで達してから出力されるクロック信号は基準時間Ｓより遅延して、クロック間隔（周期）は１ｓｅｃより長いことになる。
　そこで、ループカウンタ２２の目標カウントＰｍを上記の誤差α分だけ補正すれば、クロック信号が遅延することなく基準時間Ｓに極めて近い周期で出力されることになる。このため、目標カウントＰｍを、Ｐｍ＝Ｐｍ－αにより補正する。
　計測されたパルスカウントＰが基準カウントＰｏより多かった場合も同じ補正により、早まることなく基準時間Ｓに極めて近い周期で出力される。
　ここで、誤差の算出式はα＝Ｐｍ－Ｐであるから、補正後の目標カウントＰｍは
　　Ｐｍ＝Ｐｍ－α＝Ｐｍ－（Ｐｍ－Ｐ）＝Ｐ
となる。
　すなわち、新たなＰｍの値はパルスカウントＰとなる。換言すれば、補正は目標カウントＰｍを測定結果であるパルスカウントＰに変更すればよいことになる。
　なお、上述の例では、計測する所定時間Ｔをサブクロック２０のクロック信号の基準時間Ｓと同一に設定し、目標カウントＰｍと計測したパルスカウントＰの差を誤差αとしたが、例えば計測時間を短縮するため、所定時間Ｔを基準時間Ｓの１／２とする場合には、計測したパルスカウントＰの２倍値と目標カウントＰｍの差を誤差αとして目標カウントＰｍを補正すればよい。
　したがって、一般化して所定時間Ｔを基準時間Ｓのｋ倍とした場合、α＝Ｐｍ－（Ｐ／ｋ）で、目標カウントＰｍは
　　Ｐｍ＝Ｐｍ－α＝Ｐｍ－（Ｐｍ－（Ｐ／ｋ））＝Ｐ／ｋ
に補正することになる。
　なお、ｋが１より大きいときは、Ｐ／ｋはＩＮＴ関数による整数とする。
　図２はＣＰＵ１１におけるサブクロック２０の補正にかかる制御の流れを示すフローチャートである。
　イグニションスイッチ２がＯＮされると、ＣＰＵ１１はメインクロック１３を起動させるとともに通常動作モードに入り、メインクロック１３からのクロック信号を処理タイミングの基礎とする。これにより、車両統合制御装置１０による車両の走行にかかわる制御が開始される。
　ＣＰＵ１１では、まず初期化としてステップ１００において、計時カウンタ２５およびパルスカウンタ２６をリセットするとともに、サブクロック２０のループカウンタ２２の目標カウントＰｍに、クロック信号のあらかじめ定められた基準時間Ｓに対応する基準カウントＰｏ（１２５ＫＨｚの場合Ｓ＝１ｍｓｅｃに対して１２５０００）を設定する。
　ステップ１０１において、クロック計測の割り込みタイミングであるかどうかをチェックし、割り込みタイミングであるときはステップ１０２へ進み、割り込みタイミングでなければステップ１０６へ進む。
　ステップ１０２では、ＣＰＵ１１内蔵のサブクロック２０をＯＮする。
　そして、ステップ１０３において、メインクロック１３からのクロック信号を計時カウンタ２５で計数開始と同時にパルスカウンタ２６のカウントを開始して、所定時間Ｔにおけるサブクロック２０（ＣＲ発振回路２１）の発振パルスを計測しパルスカウントＰを得る。所定時間Ｔはあらかじめ基準時間Ｓのｋ倍に定めてある。
　計測したパルスカウントＰは、続くステップ１０４において、メモリ１２に格納する。メモリ１２に前回のフローにおけるパルスカウントＰが格納されている場合には上書きにより更新される。
　このあと、ステップ１０５でサブクロック２０をＯＦＦしてステップ１０６へ進む。この際、計時カウンタ２５およびパルスカウンタ２６もリセットされる。
　ステップ１０６では、イグニションスイッチ２のＯＦＦを含み入力装置１にスリープへの所定の条件が成立しているかどうかをチェックし、条件が成立していないときはステップ１０１へ戻り、条件が成立しているときはステップ１０７へ進む。
　ステップ１０７では、メモリ１２に格納されているパルスカウントＰを読み出して、サブクロック２０のループカウンタ２２の目標カウントＰｍの値をＰ／ｋに補正する。
　そして、ステップ１０８において、メインクロック１３をＯＦＦさせるとともにサブクロック２０をＯＮして、クロックを切り替える。
　ステップ１０９において、ＣＰＵ自体をスリープモードに移行する。
　このあとは、通常動作モードの条件が成立するかどうかがチェックされ、成立すれば動作モードの切り替えに移るが説明は省略する。
　以上により、スリープモード移行直前の最新のＣＲ発振回路２１の発振状態に基づいて、サブクロック２０の誤差が補正され、ＣＰＵ１１はスリープモードにおいても高精度のメインクロック１３と同等レベルの精度をもったクロック信号に基づいて所定の処理を実行することができる。
　本実施の形態では、車両統合制御装置１０が発明におけるマイクロコンピュータに該当し、とくにサブクロック２０がスリープモード用のクロックに、メインクロック１３が標準クロック信号源に該当する。そして、サブクロック２０におけるＣＲ発振回路２１がクロックの発振源に該当する。
　メインクロック１３のクロック信号が標準クロック信号源からのカウントデータに該当し、ＣＲ発振回路２１の発振パルスがクロックのカウントデータに該当する。
　ＣＰＵ１１に入力するメインクロック１３のクロック信号が計時カウンタ２５に取り込まれる経路構成が発明における標準データ取得手段に該当する。
　また、図２のフローチャートのステップ１０３が発明における第１工程に該当し、ステップ１０４が計測手段および第２工程に、そしてステップ１０８が補正手段および第３工程に該当する。
　実施の形態は以上のように構成され、サブクロック２０をＣＲ発振回路２１とその発振パルスをカウントして目標カウントＰｍに達するごとにクロック信号を出力するループカウンタ２２とで形成し、サブクロック２０より周波数精度の高いメインクロック１３のクロック信号で計時する所定時間Ｔにおけるサブクロック２０（ＣＲ発振回路２１）の発振パルスをカウントして、そのパルスカウントＰに応じた目標カウントＰｍの補正によりサブクロック２０のクロック信号を補正するものとしたので、推定ではなく現実のカウント状態が把握されて、これに基づいて確実な補正が行われる。
　また、上述のようにメインクロック１３のクロック信号による計時を基準として計測したパルスカウントＰに応じて、ループカウンタ２２の目標カウントＰｍを補正するので、低コストで消費電力も低く構成されるサブクロック２２であっても、高精度のメインクロック１３と同等レベルの精度をもったクロック信号が出力され、高い要求精度に対応できるものとなった。
　とくにサブクロック２２の状態については、ＣＰＵ１１が通常動作モードにある間に所定時間間隔でサブクロック２０を動作させ、その発振パルスのパルスカウントＰをメモリ１２に格納しておき、
　ＣＰＵ１１が通常動作モードからスリープモードへの移行するときに、メモリ１２に格納されている最新のパルスカウントＰを用いて目標カウントＰｍの補正を行うので、
スリープモードに入る際には常に最新のサブクロック２０の状態に適応した補正が実行され、安定して高精度のクロック信号が出力される。
　サブクロック２０はＣＰＵ１１に内蔵されているので、低消費電力に構成するのが容易であるとともに、車両統合制御装置１０内の配線や設置スペースが不要となる。
　なお、上記実施の形態では、クリスタル振動子を備えてＣＰＵ１１に対して外付けしたメインクロック１３からのクロック信号を所定時間Ｔを計時するためのカウントデータとしたが、例えば他の車載機器で受信・抽出した標準時刻を示す標準電波データやＧＰＳ信号に含まれる時間信号を標準クロック信号源からのカウントデータとして、車載ネットワークを介して取り込み。所定時間Ｔの計時に使用してもよい。
　これによっても、スリープモード用のサブクロック２０から高精度のクロック信号を出力させることができる。
　また、実施の形態では、先に述べたとおり低消費電力に構成するのが容易であること、また安価に構成出来ることから、スリープモード用のクロックをＣＰＵ１１に内蔵されたＣＲ発振回路２１を発振源とするサブクロック２０としたが、これに限定されず、ＣＰＵ１１に対して外付けのものとしてもよい。
　さらに、例えばメインクロック１３より発振周波数が低くて消費電力の小さいものであれば、スリープモード用のクロックはＣＲ発振回路に限らず、クリスタル振動子やセラミック振動子によるものでもよい。
　なお、実施の形態に示した諸数値はいずれも例示であって、本発明は記載の数値に限定されない。
　１　　入力装置
　２　　イグニションスイッチ
　３　　出力装置
　１０　　車両統合制御装置
　１１　　ＣＰＵ
　１２　　メモリ
　１３　　メインクロック
　１４　　入力インタフェース
　１５　　出力インタフェース
　１６　　通信インタフェース
　１７　　電源回路
　２０　　サブクロック
　２１　　ＣＲ発振回路
　２２　　ループカウンタ
　２５　　計時カウンタ
　２６　　パルスカウンタ

Claims (12)

  1. 　少なくとも一つのクロックを有するマイクロコンピュータにおいて、
    　前記クロックより周波数精度の高い標準クロック信号源からのカウントデータを取得する標準データ取得手段と、
    　前記標準クロック信号源からのカウントデータを基準にして前記クロックのカウントデータを計測する計測手段と、
    　該計測手段による計測結果に基づいて、前記クロックのクロック信号を補正する補正手段とを有することを特徴とするマイクロコンピュータ。
  2. 　前記クロックは、発振源と該発振源からの発振パルスをカウントするループカウンタからなり、発振パルスがループカウンタの目標カウントに達するごとにクロック信号を出力するものであって、
    　前記計測手段は、前記標準クロック信号源からのカウントデータで計時する所定時間における前記クロックの前記発振パルスを計数したパルスカウントを求めるものであることを特徴とする請求項１に記載のマイクロコンピュータ。
  3. 　前記補正手段は、前記計測手段で求めたパルスカウントに応じて、前記ループカウンタの目標カウントを補正するものであることを特徴とする請求項２に記載のマイクロコンピュータ。
  4. 　さらにメモリを有し、
    　前記計測手段は、ＣＰＵの通常動作モード時に所定時間間隔で前記クロックを動作させて前記パルスカウントを求め、該パルスカウントを前記メモリに格納し、
    　前記補正手段は、通常動作モードからスリープモードへの移行時に前記メモリに格納されている最新の前記パルスカウントを用いて前記目標カウントの補正を行うことを特徴とする請求項３に記載のマイクロコンピュータ。
  5. 　前記クロックは、ＣＲ発振回路を前記発振源としてＣＰＵに内蔵されていることを特徴とする請求項２から４のいずれか１に記載のマイクロコンピュータ。
  6. 　前記標準クロック信号源が通常動作モード用に前記ＣＰＵに接続されたメインクロックであり、前記クロックは、前記メインクロックとは別個のスリープモード用のサブクロックであることを特徴とする請求項１から５のいずれか１に記載のマイクロコンピュータ。
  7. 　少なくとも一つのクロックを有するマイクロコンピュータにおける前記クロックの補正方法であって、
    　該クロックより周波数精度の高い標準クロック信号発生源からのカウントデータを取得する第１工程と、
    　前記標準クロック信号発生源からのカウントデータを基準にして前記クロックのカウントデータを計測する第２工程と、
    　第２工程の計測結果に基づいて、前記クロックのクロック信号を補正する第３工程とを有することを特徴とするマイクロコンピュータにおけるクロックの補正方法。
  8. 　前記クロックが、発振源と該発振源からの発振パルスをカウントするループカウンタからなり、発振パルスがループカウンタの目標カウントに達するごとにクロック信号を出力するものであって、
    　前記第２工程は、前記標準クロック信号源からのカウントデータで計時する所定時間における前記クロックの発振パルスを計数したパルスカウントを求めるものであることを特徴とする請求項７に記載のマイクロコンピュータにおけるクロックの補正方法。
  9. 　前記第３工程は、前記第２工程で求めたパルスカウントに応じて、前記ループカウンタの目標カウントを補正することにより行うことを特徴とする請求項８に記載のマイクロコンピュータにおけるクロックの補正方法。
  10. 　前記マイクロコンピュータはメモリを有し、
    　前記第２工程は、ＣＰＵの通常動作モード時に所定時間間隔で前記クロックを動作させて前記パルスカウントを求めるとともに、該パルスカウントを前記メモリに格納し、
    　前記第３工程は、通常動作モードからスリープモードへの移行時に前記メモリに格納されている最新の前記パルスカウントを用いて前記目標カウントの補正を行うことを特徴とする請求項９に記載のマイクロコンピュータにおけるクロックの補正方法。
  11. 　前記第１工程は、前記標準クロック信号源からのカウントデータとして、通常動作モード用にＣＰＵに接続されたメインクロックのクロック信号を読み込むと共に、前記第２工程は、前記クロックのカウントデータとして、前記メインクロックとは別個のスリープモード用のサブクロックのクロック信号を計測することを特徴とする請求項７から１０のいずれか１に記載のマイクロコンピュータにおけるクロックの補正方法。
  12. 　前記第１工程は、前記標準クロック信号源からのカウントデータとして、標準電波またはＧＰＳ信号のクロック信号を読み込むことを特徴とする請求項７から１０のいずれか１に記載のマイクロコンピュータにおけるクロックの補正方法。
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