WO2013161022A1 - 炭化珪素半導体薄膜の形成方法および炭化珪素半導体基板 - Google Patents

炭化珪素半導体薄膜の形成方法および炭化珪素半導体基板 Download PDF

Info

Publication number
WO2013161022A1
WO2013161022A1 PCT/JP2012/061096 JP2012061096W WO2013161022A1 WO 2013161022 A1 WO2013161022 A1 WO 2013161022A1 JP 2012061096 W JP2012061096 W JP 2012061096W WO 2013161022 A1 WO2013161022 A1 WO 2013161022A1
Authority
WO
WIPO (PCT)
Prior art keywords
thin film
silicon nitride
semiconductor thin
nitride semiconductor
sic
Prior art date
Application number
PCT/JP2012/061096
Other languages
English (en)
French (fr)
Inventor
信吉 山田
Original Assignee
株式会社エコトロン
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 株式会社エコトロン filed Critical 株式会社エコトロン
Priority to PCT/JP2012/061096 priority Critical patent/WO2013161022A1/ja
Publication of WO2013161022A1 publication Critical patent/WO2013161022A1/ja

Links

Images

Classifications

    • C—CHEMISTRY; METALLURGY
    • C30—CRYSTAL GROWTH
    • C30B—SINGLE-CRYSTAL GROWTH; UNIDIRECTIONAL SOLIDIFICATION OF EUTECTIC MATERIAL OR UNIDIRECTIONAL DEMIXING OF EUTECTOID MATERIAL; REFINING BY ZONE-MELTING OF MATERIAL; PRODUCTION OF A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; SINGLE CRYSTALS OR HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; AFTER-TREATMENT OF SINGLE CRYSTALS OR A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; APPARATUS THEREFOR
    • C30B29/00—Single crystals or homogeneous polycrystalline material with defined structure characterised by the material or by their shape
    • C30B29/10—Inorganic compounds or compositions
    • C30B29/36—Carbides
    • C—CHEMISTRY; METALLURGY
    • C30—CRYSTAL GROWTH
    • C30B—SINGLE-CRYSTAL GROWTH; UNIDIRECTIONAL SOLIDIFICATION OF EUTECTIC MATERIAL OR UNIDIRECTIONAL DEMIXING OF EUTECTOID MATERIAL; REFINING BY ZONE-MELTING OF MATERIAL; PRODUCTION OF A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; SINGLE CRYSTALS OR HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; AFTER-TREATMENT OF SINGLE CRYSTALS OR A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; APPARATUS THEREFOR
    • C30B19/00—Liquid-phase epitaxial-layer growth
    • C30B19/02—Liquid-phase epitaxial-layer growth using molten solvents, e.g. flux
    • C30B19/04—Liquid-phase epitaxial-layer growth using molten solvents, e.g. flux the solvent being a component of the crystal composition
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02365—Forming inorganic semiconducting materials on a substrate
    • H01L21/02367—Substrates
    • H01L21/0237—Materials
    • H01L21/02373—Group 14 semiconducting materials
    • H01L21/02378—Silicon carbide
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02365—Forming inorganic semiconducting materials on a substrate
    • H01L21/02518—Deposited layers
    • H01L21/02521—Materials
    • H01L21/02524—Group 14 semiconducting materials
    • H01L21/02529—Silicon carbide
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104—Forming layers
    • H01L21/02365—Forming inorganic semiconducting materials on a substrate
    • H01L21/02612—Formation types
    • H01L21/02617—Deposition types
    • H01L21/02623—Liquid deposition
    • H01L21/02625—Liquid deposition using melted materials

Definitions

  • the present invention relates to a method for forming a silicon carbide (SiC) semiconductor thin film and a SiC semiconductor substrate, and more specifically, a method for forming a SiC semiconductor thin film with reduced defects that adversely affect device characteristics, and the SiC semiconductor thin film.
  • the present invention relates to a SiC semiconductor substrate.
  • SiC semiconductors While the performance of Si semiconductors has reached its limit, SiC semiconductors have recently attracted attention as semiconductors for power devices such as diodes and transistors.
  • This device active layer of SiC semiconductor is formed by epitaxially growing a single crystal SiC film on a single crystal SiC substrate.
  • BPD basic plane dislocation
  • TSD threading screw dislocation
  • epi defects such as triangular defects, carrots, comets, and downfalls that cause malfunction of all power devices may occur on the surface of the single crystal SiC film.
  • a plane also referred to as a (0001) plane, a basal plane, or a JUST plane
  • 3C for 4H 3C for 4H
  • a substrate having an inclination (off angle) in a certain direction from the base surface is generally used.
  • the growth of the epitaxial film is caused.
  • the BPD moving on the base surface is expected to be discharged, and the reduction of defects can be expected (Non-patent Document 1).
  • the back surface (crystal growth and The TSD penetrating in the parallel direction cannot be reduced.
  • the TSD of the substrate propagates as it is to the epitaxial film, and the TSD is formed in the epitaxial film at a large density of about 1000 pieces / cm 2, which adversely affects the device characteristics, so that the device yield decreases.
  • the CVD method has a problem that the above-described epi defects are generated at a density of about 0.1 to 100 / cm 2 , which further reduces the device yield.
  • LPE liquid phase epitaxial growth
  • MSE metalstable solvent epitaxy
  • Non-Patent Document 2 in the case of epitaxial growth of a single crystal SiC film using the LPE method, TSD becomes a Frank defect (defect extending in the basal plane direction) that does not adversely affect device characteristics during the growth of the epitaxial film. It has been shown that it can be converted. However, this conversion rate is not 100%, and TSD remains in the epitaxial film. The remaining TSD adversely affects the device characteristics, resulting in a decrease in device yield. As a specific example, in a substrate with an off angle of 1.4 °, the conversion rate from TSD to Frank defect remains at 80%.
  • Non-Patent Document 3 in the case of epitaxial growth of a single crystal SiC film using the MSE method, all the TSDs present on the substrate can be converted into the above-mentioned Frank defects during the growth of the epitaxial film. It has been shown that (99.9%) can be converted to TED (edge dislocations) with little adverse effect on device characteristics. However, for example, the substrate having an off angle of 8 ° has about 10,000 BPDs / cm 2, and even if 99.9% BPD is TED-converted, the epitaxial film has 0.1% (10 pieces / cm 2). The remaining BPD adversely affects the characteristics of the device, so that the device yield decreases.
  • the present invention provides a method for forming a SiC semiconductor thin film capable of forming a single crystal SiC epitaxial film in which defects (BPD, TSD and epi defects) that adversely affect device characteristics are sufficiently reduced, and the SiC semiconductor. It is an object of the present invention to provide a SiC semiconductor substrate using a thin film and capable of a sufficiently improved device yield.
  • a silicon carbide substrate with an off angle of 8 ° has about 10,000 BPDs / cm 2, but by setting the off angle to 0.8 ° or less, the number of BPD surfaces that come out can be reduced. Since it becomes 1/10 or less, BPD can be reduced to about 1000 pieces / cm 2 or less. Since the MSE method is used, as described above, 99.9% of BPD can be converted to TED during the growth of the epitaxial film.
  • the epitaxial film Since the density of BPD that has not been converted to TED in the epitaxial film is 1 piece / cm 2 or less, there is no epi defect, and in combination with the conversion of all TSDs to Frank defects, the epitaxial film The overall defect density is 1 piece / cm 2 or less, and a sufficient yield as a SiC semiconductor element can be obtained.
  • the inventors of the present invention further studied by paying attention to the fact that BPD extends in the basal plane direction together with the Frank defect converted from TSD in the epitaxial growth of the single crystal SiC film using the MSE method.
  • the off-angle of the substrate was set to 0.08 ° or less
  • a single crystal SiC film was epitaxially grown to a thickness of about 200 ⁇ m on a 6-inch (150 mm) SiC substrate, whereby all Frank defects were removed.
  • an epitaxial film having no BPD was obtained and the yield could be further improved.
  • the BPD when a single crystal SiC film is epitaxially grown on a SiC substrate having an off angle of 0.08 ° to a thickness of about 200 ⁇ m, the BPD extends in the direction of the basal plane along with the Frank defect to 150 mm, that is, 6 inches, as shown in FIG. Therefore, the BPD propagated from the substrate to one end of the single crystal SiC film is discharged from the other end, and becomes an epitaxial film having a defect density of 0 / cm 2 .
  • a silicon carbide semiconductor thin film is formed by epitaxially growing a silicon carbide single crystal on a silicon carbide substrate having an off angle greater than 0 ° and less than or equal to 0.8 ° by a metastable solvent epitaxy method. This is a method for forming a thin film.
  • the invention according to claim 2 2.
  • the invention according to claim 3 A silicon carbide semiconductor substrate in which a silicon carbide semiconductor thin film is formed on a silicon carbide substrate, A silicon carbide semiconductor substrate, wherein the silicon carbide semiconductor thin film has a defect density of 1 piece / cm 2 or less in the silicon carbide semiconductor thin film.
  • the invention according to claim 4 The silicon carbide semiconductor substrate according to claim 3, wherein the silicon carbide semiconductor thin film is a silicon carbide semiconductor thin film formed by a metastable solvent epitaxy method.
  • An SiC semiconductor substrate capable of sufficiently improved device yield can be provided by using a thin film.
  • FIG. 1 is a cross-sectional view schematically showing the main part of the SiC semiconductor thin film growth apparatus according to the present embodiment.
  • a layer 30, a carbon atom supply plate 40, an upper spacer 40, and a lower spacer 50 are disposed in a sealed crucible 60.
  • each off-angle single crystal SiC substrate 10 shown in Table 1 has a diameter of 150 mm and a thickness of 200 ⁇ m.
  • the SiC semiconductor thin film was epitaxially grown.
  • the defect density is 1 piece / cm 2 or less, and a high yield of 30 to 100% is obtained. Is done. Of these, in the case of an off angle of 0.08 ° or less (Examples 1 and 2), the defect density is 0 / cm 2 , indicating a higher yield.
  • the defect density is 1 piece / cm 2 or more
  • the yield is as low as 0-30%. This is because, as described above, when the off angle is 0.00 ° (Comparative Example 1), spiral growth occurs in the epitaxial film and TSD remains.

Abstract

　デバイスの特性に悪影響を与える欠陥（ＢＰＤ、ＴＳＤおよびエピ欠陥）が充分に低減された単結晶ＳｉＣエピタキシャル膜を形成させることができるＳｉＣ半導体薄膜の形成方法、および前記ＳｉＣ半導体薄膜が用いられて充分向上したデバイス歩留まりが可能なＳｉＣ半導体基板を提供する。　０°よりも大きく０．８°以下のオフ角の炭化珪素基板上に、準安定溶媒エピタキシー法により炭化珪素単結晶をエピタキシャル成長させて、炭化珪素半導体薄膜を形成する炭化珪素半導体薄膜の形成方法。炭化珪素基板上に炭化珪素半導体薄膜が形成された炭化珪素半導体基板であって、炭化珪素半導体薄膜における欠陥密度が、１個／ｃｍ２以下の炭化珪素半導体薄膜である炭化珪素半導体基板。

Description

炭化珪素半導体薄膜の形成方法および炭化珪素半導体基板
　本発明は、炭化珪素（ＳｉＣ）半導体薄膜の形成方法およびＳｉＣ半導体基板に関し、詳しくは、デバイス特性に悪影響を与える欠陥が低減されたＳｉＣ半導体薄膜の形成方法、および前記ＳｉＣ半導体薄膜が用いられたＳｉＣ半導体基板に関する。
　Ｓｉ半導体の性能が限界を迎える中、近年、ダイオードやトランジスタなどパワーデバイス用の半導体としてＳｉＣ半導体が注目されている。このＳｉＣ半導体のデバイス活性層は、単結晶ＳｉＣ基板上に単結晶ＳｉＣ膜をエピタキシャル成長させることにより形成される。
　このとき、エピタキシャル成長させた単結晶ＳｉＣ膜に、結晶欠陥であるＢＰＤ（基底面転位）やＴＳＤ（貫通螺旋転位）が存在すると、ＳｉＣデバイスの特性に悪影響を与える。具体的には、ＢＰＤはバイポーラデバイスにおける順方向特性を劣化させ、ＴＳＤが多い単結晶ＳｉＣ膜が基板に使用されたＭＯＳＦＥＴは酸化膜耐圧の信頼性を低下させる。
　また、単結晶ＳｉＣ膜のエピタキシャル成長に際して、全てのパワーデバイスの動作不良を引き起こす三角欠陥、キャロット、コメット、ダウンフォールなどのいわゆるエピ欠陥が、単結晶ＳｉＣ膜の表面に発生する場合もある。
　このように、デバイスの特性に悪影響を与える欠陥が形成された単結晶ＳｉＣ膜は、デバイス歩留まりが低下するため、単結晶ＳｉＣ膜のエピタキシャル成長に際して、これらの欠陥を低減させることができる技術が盛んに検討されているが、未だ充分とは言えず、充分なデバイス歩留まりを確保することができていない。
　例えば、単結晶ＳｉＣエピタキシャル膜の成長方法として一般的なＣＶＤ法においては、結晶成長方向と完全に垂直な面（（０００１）面、基底面、ＪＵＳＴ面とも呼ぶ）上へのエピタキシャル成長は異形ポリタイプ（４Ｈに対する３Ｃ）の混入があるため、基底面からある方向に傾斜（オフ角）を持たせた基板が一般的に使用され、極めてオフ角が低い基板を用いた場合、エピタキシャル膜の成長により、基底面上を動くＢＰＤが排出されると予想され、欠陥の低減が期待できるとされている（非特許文献１）が、ＢＰＤの低減は期待できるものの、基板の表面から裏面（結晶成長と平行な方向）に貫通するＴＳＤを低減することはできない。そして、基板のＴＳＤがそのままエピタキシャル膜に伝播して、エピタキシャル膜には１０００個／ｃｍ２程度と大きな密度でＴＳＤが形成されて、デバイスの特性に悪影響を与えるため、デバイス歩留まりが低下する。
　また、ＣＶＤ法には、前記したエピ欠陥が０．１～１００個／ｃｍ２程度の密度で発生するという問題もあり、デバイス歩留まりがさらに低下する。
　ＣＶＤ法に替わる単結晶ＳｉＣエピタキシャル膜の成長方法としては、ＬＰＥ（液相エピタキシャル成長）法やＭＳＥ（準安定溶媒エピタキシー）法（特許文献１）も用いられているが、これらの方法にも以下のような問題があるため、欠陥を充分に低減させることができず、デバイス歩留まりの向上を充分に図ることができない。
　即ち、非特許文献２には、ＬＰＥ法を用いた単結晶ＳｉＣ膜のエピタキシャル成長の場合、エピタキシャル膜の成長に際して、ＴＳＤをデバイスの特性に悪影響を与えないＦｒａｎｋ欠陥（基底面方向に伸びる欠陥）へ変換できることが示されている。しかし、この変換率は１００％ではなく、エピタキシャル膜にＴＳＤが残存する。そして、この残存するＴＳＤが、デバイスの特性に悪影響を与えるため、デバイス歩留まりが低下する。具体的な一例として、オフ角１．４°の基板では、ＴＳＤからＦｒａｎｋ欠陥への変換率は８０％に留まっている。
　また、非特許文献３には、ＭＳＥ法を用いた単結晶ＳｉＣ膜のエピタキシャル成長の場合、エピタキシャル膜の成長に際して、基板に存在するすべてのＴＳＤを前記したＦｒａｎｋ欠陥に変換でき、また、ＢＰＤの大半（９９．９％）をデバイスの特性への悪影響が少ないＴＥＤ（刃状転位）に変換できることが示されている。しかし、例えば、オフ角８°の基板にはＢＰＤが１００００個／ｃｍ２程度あり、９９．９％のＢＰＤがＴＥＤ変換されたとしても、エピタキシャル膜には０．１％（１０個／ｃｍ２程度）のＢＰＤが残り、この残存するＢＰＤが、デバイスの特性に悪影響を与えるため、デバイス歩留まりが低下する。
特開２００８－２３０９４６号公報
Ｊ．Ｈａｓｓａｎ他　「Ｇｒｏｗｔｈ　ａｎｄ　ｐｒｏｐｅｒｔｉｅｓ　ｏｆ　ＳｉＣ　ｏｎ－ａｘｉｓ　ｈｏｍｏｅｐｉｔａｘｉａｌ　ｌａｙｅｒｓ」　Ｍａｔｅｒｉａｌｓ　Ｓｃｉｅｎｃｅ　Ｆｏｒｕｍ　Ｖｏｌｓ．６４５－６４８　（２０１０）　ｐｐ８３－８８ Ｔ．Ｕｊｉｈａｒａ他　「Ｃｏｎｖｅｒｓｉｏｎ　Ｍｅｃｈａｎｉｓｍ　ｏｆ　Ｔｈｒｅａｄｉｎｇ　Ｓｃｒｅｗ　Ｄｉｓｌｏｃａｔｉｏｎ　ｄｕｒｉｎｇ ＳｉＣ　Ｓｏｌｕｔｉｏｎ　Ｇｒｏｗｔｈ」　２０１１　Ｉｎｔｅｒｎａｔｉｏｎａｌ　Ｃｏｎｆｅｒｅｎｃｅ　ｏｎ　Ｓｉｌｉｃｏｎ　Ｃａｒｂｉｄｅ　ａｎｄ　Ｒｅｌａｔｅｄ　Ｍａｔｅｒｉａｌｓ　Ａｂｓｔｒａｃｔ　Ｂｏｏｋ　（２０１１）　ｐｐ３５７ Ｓ．Ｈａｍａｄａ他　「Ｆｒａｎｋ　Ｐａｒｔｉａｌ　Ｄｉｓｌｏｃａｔｉｏｎ　ｉｎ　４Ｈ－ＳｉＣ　ｅｐｉｔａｘｉａｌ　ｌａｙｅｒ　ｂｙ　ＭＳＥ　Ｍｅｔｈｏｄ」　１４ｔｈ　Ｉｎｔｅｒｎａｔｉｏｎａｌ　Ｃｏｎｆｅｒｅｎｃｅ　ｏｎ　Ｄｅｆｅｃｔｓ－Ｒｅｃｏｇｎｉｔｉｏｎ，Ｉｍａｇｉｎｇ　ａｎｄ　Ｐｈｙｓｉｃｓ　ｉｎ　Ｓｅｍｉｃｏｎｄｕｃｔｏｒｓ　Ａｂｓｔｒａｃｔ　ｂｏｏｋ　（２０１１）　ＰＷ－３
　上記のように、従来の単結晶ＳｉＣエピタキシャル膜の成長方法では、いずれの方法を用いても、デバイスの特性に悪影響を与える欠陥の低減は充分とは言えず、充分なデバイス歩留まりを確保することができていない。
　そこで、本発明は、デバイスの特性に悪影響を与える欠陥（ＢＰＤ、ＴＳＤおよびエピ欠陥）が充分に低減された単結晶ＳｉＣエピタキシャル膜を形成させることができるＳｉＣ半導体薄膜の形成方法、および前記ＳｉＣ半導体薄膜が用いられて充分向上したデバイス歩留まりが可能なＳｉＣ半導体基板を提供することを課題とする。
　本発明者は、上記課題の解決について検討する中で、まず、ＭＳＥ法を用いた場合、エピタキシャル膜の成長に際して、ＴＳＤの全てがデバイスの特性に悪影響を与えないＦｒａｎｋ欠陥に変換されることに着目した。そして、本発明者は、種々の実験より、ＭＳＥ法を用いた場合、エピタキシャル膜にはエピ欠陥が全く発生しないことが分かった。
　これらのことより、単結晶ＳｉＣエピタキシャル膜の成長方法としてＭＳＥ法を採用した場合、エピタキシャル膜にはＴＳＤおよびエピ欠陥が存在しないため、ＢＰＤを充分に低減することができれば、デバイスの特性に悪影響を与える欠陥が充分に低減された単結晶ＳｉＣエピタキシャル膜を提供することができ、デバイス歩留まりを向上させることができることが分かった。
　そして、さらに種々の実験、検討を行った結果、極めて低いオフ角、具体的には０°よりも大きく０．８°以下のオフ角の基板を用いて単結晶ＳｉＣ膜のエピタキシャル成長を行った場合には、欠陥密度が１個／ｃｍ２以下にまで低減された単結晶ＳｉＣエピタキシャル膜が得られ、このような単結晶ＳｉＣエピタキシャル膜をＳｉＣ半導体基板として用いることにより、下式に示されるＳｉＣ半導体素子の歩留まりＹ（％）として満足できる３０％以上の歩留まりを確実に確保することができることが分かった。
　　　Ｙ＝ｅｘｐ（－ＤＡ）
　　　　　Ｄ：ＳｉＣ半導体基板の欠陥密度（個／ｃｍ２）
　　　　　　　（欠陥密度：ＢＰＤ、ＴＳＤ、エピ欠陥の各欠陥密度の合計）
　　　　　Ａ：ゲート酸化膜の面積（ｃｍ２）
　即ち、前記したように、オフ角８°の炭化珪素基板にはＢＰＤが１００００個／ｃｍ２程度存在するが、オフ角を０．８°以下にすることにより、出てくるＢＰＤ面の数が１／１０以下となるため、ＢＰＤを１０００個／ｃｍ２程度以下にまで低減させることができる。そして、ＭＳＥ法を用いているため、前記したように、エピタキシャル膜の成長に際して、ＢＰＤの９９．９％をＴＥＤに変換させることができる。この結果、エピタキシャル膜においてＴＥＤに変換されなかったＢＰＤの密度は１個／ｃｍ２以下となるため、エピ欠陥がないこと、および全てのＴＳＤのＦｒａｎｋ欠陥への変換とも相俟って、エピタキシャル膜全体の欠陥の密度が１個／ｃｍ２以下となり、ＳｉＣ半導体素子として充分な歩留まりを得ることができる。
　一方、オフ角が０．８°以下の基板であっても、オフ角０．００°（ＪＵＳＴ面）の基板を用いた場合には、エピタキシャル膜に螺旋成長が起こって、ＴＳＤからＦｒａｎｋ欠陥への変換割合が低下するため、ＴＳＤが残存して、欠陥の密度を１個／ｃｍ２以下とすることができず、ＳｉＣ半導体素子として充分な歩留まりを得ることができない。
　そして、本発明者が、ＭＳＥ法を用いた単結晶ＳｉＣ膜のエピタキシャル成長においては、エピタキシャル成長に際してＢＰＤが、ＴＳＤから変換されたＦｒａｎｋ欠陥と共に、基底面方向に伸びていくことに着目して、さらに検討を進めたところ、基板のオフ角を０．０８°以下とした場合には、６インチ（１５０ｍｍ）のＳｉＣ基板上に厚み２００μｍ程度に単結晶ＳｉＣ膜をエピタキシャル成長させることにより、Ｆｒａｎｋ欠陥の全てが排出されて、さらにＢＰＤの全くないエピタキシャル膜が得られ、より歩留まりを向上させることができることが分かった。
　即ち、オフ角０．０８°のＳｉＣ基板上に厚み２００μｍ程度に単結晶ＳｉＣ膜をエピタキシャル成長させた場合、図２に示すように、ＢＰＤはＦｒａｎｋ欠陥と共に基底面方向に伸びて１５０ｍｍ、即ち６インチ移動するため、単結晶ＳｉＣ膜の一端に基板から伝播されたＢＰＤが他端から排出されて、欠陥密度が０個／ｃｍ２のエピタキシャル膜となる。
　本発明は、以上の知見に基づくものであり、請求項１に記載の発明は、
　０°よりも大きく０．８°以下のオフ角の炭化珪素基板上に、準安定溶媒エピタキシー法により炭化珪素単結晶をエピタキシャル成長させて、炭化珪素半導体薄膜を形成することを特徴とする炭化珪素半導体薄膜の形成方法である。
　また、請求項２に記載の発明は、
　前記炭化珪素基板のオフ角が、０°よりも大きく０．０８°以下であることを特徴とする請求項１に記載の炭化珪素半導体薄膜の形成方法である。
　また、請求項３に記載の発明は、
　炭化珪素基板上に炭化珪素半導体薄膜が形成された炭化珪素半導体基板であって、
　前記炭化珪素半導体薄膜における欠陥密度が、１個／ｃｍ２以下の炭化珪素半導体薄膜であることを特徴とする炭化珪素半導体基板である。
　また、請求項４に記載の発明は、
　前記炭化珪素半導体薄膜が、準安定溶媒エピタキシー法により形成された炭化珪素半導体薄膜であることを特徴とする請求項３に記載の炭化珪素半導体基板である。
　本発明によれば、デバイスの特性に悪影響を与える欠陥（ＢＰＤ、ＴＳＤおよびエピ欠陥）が充分に低減された単結晶ＳｉＣエピタキシャル膜を形成させることができるＳｉＣ半導体薄膜の形成方法、および前記ＳｉＣ半導体薄膜が用いられて充分向上したデバイス歩留まりが可能なＳｉＣ半導体基板を提供することができる。
本発明の一実施の形態におけるＳｉＣ半導体薄膜成長装置の主要部を模式的に示す断面図である。 ＢＰＤおよびＦｒａｎｋ欠陥が排除される機構を説明する図である。
　以下、本発明を実施の形態に基づいて説明する。
（実施例）
１．ＳｉＣ半導体薄膜成長装置
　はじめに、ＳｉＣ半導体薄膜成長装置について説明する。図１は本実施の形態におけるＳｉＣ半導体薄膜成長装置の主要部を模式的に示す断面図であり、図１において、１０はＭＳＥ膜が形成される種基板となる単結晶ＳｉＣ基板、２０はＳｉ層、３０は炭素原子供給板、４０は上部スペーサー、５０は下部スペーサーであり、これらは密閉された坩堝６０内に配置されている。
２．ＳｉＣ半導体薄膜の形成方法
　次に、ＳｉＣ半導体薄膜の作製方法について説明する。まず、図１に示すように配置された坩堝６０を図示しない炉にセットし、その後、以下に示す工程に従って、表１に示す各オフ角の単結晶ＳｉＣ基板１０上に、直径１５０ｍｍ、厚み２００μｍのＳｉＣ半導体薄膜をエピタキシャル成長させた。
Figure JPOXMLDOC01-appb-T000001
（１）初期昇温工程
　まず、３００Ｐａの真空雰囲気において３０℃／ｍｉｎの昇温速度で室温から１５００℃まで昇温させ、Ｓｉ層２０の固体Ｓｉを完全に溶融させてＳｉ融液層を形成した。
（２）Ａｒガス導入工程
　次に、１５００℃で１時間保持し、この間にＡｒガスを導入し、雰囲気の圧力を７０ｋＰａとした。このように真空雰囲気で昇温したＳｉ融液層を形成後、Ａｒガスを導入することにより、Ｓｉ融液層に気泡が含まれることを抑制することができる。
（３）結晶成長（エピタキシャル成長）工程
　次に、３０℃／ｍｉｎの速度で１５００℃から１８００℃まで昇温し、その後１８００℃で６時間保持して、単結晶ＳｉＣ種基板１０上に単結晶ＳｉＣをエピタキシャル成長させる。
（４）Ｓｉ融液蒸発工程
　その後、５℃／ｍｉｎの降温速度で１８００℃から１６００℃まで降温した後、Ａｒガスを排気して真空雰囲気にし、１６００℃で９時間保持する。これにより、残っていたＳｉ液を全て蒸発させた。
（５）冷却工程
　その後、１℃／ｍｉｎの降温速度で１６００℃から室温まで冷却し、膜厚２００μｍのＳｉＣ半導体薄膜を作製した。
３．エピ欠陥の測定
　得られた各ＳｉＣ半導体薄膜について、ノマルスキー顕微鏡観察にてエピ欠陥の有無を測定した。結果を表２に示す。
４．ＢＰＤ、ＴＳＤの測定
　得られた各ＳｉＣ半導体薄膜について、溶融塩エッチングを用いてＢＰＤおよびＴＳＤの有無を測定した。結果を表２に示す。
５．歩留まり
　得られた各ＳｉＣ半導体薄膜を用いて、１１ｍｍ□のＳｉＣ半導体素子を作製し、その歩留まりを求めた。結果を表２に示す。
Figure JPOXMLDOC01-appb-T000002
　表２より、オフ角が０．００°を超え、０．８°以下（実施例１～３）では、欠陥密度が１個／ｃｍ２以下であり、３０～１００％という高い歩留まりを得ることができている。そして、この内でも、０．０８°以下のオフ角の場合（実施例１、２）には、欠陥密度が０個／ｃｍ２となり、より高い歩留まりを示している。
　これに対して、オフ角が０．００°（比較例１）、および０．８°を超えるオフ角（比較例２、３）の場合には、欠陥密度が１個／ｃｍ２以上となり、０～３０％という低い歩留まりに留まっている。これは、前記したように、オフ角が０．００°の場合（比較例１）には、エピタキシャル膜に螺旋成長が起こって、ＴＳＤが残存しているためである。
　また、０．８°を超えるオフ角の場合（比較例２、３）には、ＢＰＤが充分に低減できなかったためである。
　以上、本発明を実施の形態に基づき説明したが、本発明は上記の実施の形態に限定されるものではない。本発明と同一および均等の範囲内において、上記の実施の形態に対して種々の変更を加えることが可能である。
１０　　　単結晶ＳｉＣ基板
２０　　　Ｓｉ層
３０　　　炭素原子供給板
４０　　　上部スペーサー
５０　　　下部スペーサー
６０　　　坩堝

Claims (4)

  1. 　０°よりも大きく０．８°以下のオフ角の炭化珪素基板上に、準安定溶媒エピタキシー法により炭化珪素単結晶をエピタキシャル成長させて、炭化珪素半導体薄膜を形成することを特徴とする炭化珪素半導体薄膜の形成方法。
  2. 　前記炭化珪素基板のオフ角が、０°よりも大きく０．０８°以下であることを特徴とする請求項１に記載の炭化珪素半導体薄膜の形成方法。
  3. 　炭化珪素基板上に炭化珪素半導体薄膜が形成された炭化珪素半導体基板であって、
    　前記炭化珪素半導体薄膜における欠陥密度が、１個／ｃｍ２以下の炭化珪素半導体薄膜であることを特徴とする炭化珪素半導体基板。
  4. 　前記炭化珪素半導体薄膜が、準安定溶媒エピタキシー法により形成された炭化珪素半導体薄膜であることを特徴とする請求項３に記載の炭化珪素半導体基板。
PCT/JP2012/061096 2012-04-25 2012-04-25 炭化珪素半導体薄膜の形成方法および炭化珪素半導体基板 WO2013161022A1 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
PCT/JP2012/061096 WO2013161022A1 (ja) 2012-04-25 2012-04-25 炭化珪素半導体薄膜の形成方法および炭化珪素半導体基板

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
PCT/JP2012/061096 WO2013161022A1 (ja) 2012-04-25 2012-04-25 炭化珪素半導体薄膜の形成方法および炭化珪素半導体基板

Publications (1)

Publication Number Publication Date
WO2013161022A1 true WO2013161022A1 (ja) 2013-10-31

Family

ID=49482392

Family Applications (1)

Application Number Title Priority Date Filing Date
PCT/JP2012/061096 WO2013161022A1 (ja) 2012-04-25 2012-04-25 炭化珪素半導体薄膜の形成方法および炭化珪素半導体基板

Country Status (1)

Country Link
WO (1) WO2013161022A1 (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2015002207A (ja) * 2013-06-13 2015-01-05 昭和電工株式会社 ＳｉＣエピタキシャルウェハ及びその製造方法

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010089983A (ja) * 2008-10-07 2010-04-22 Ecotron:Kk ＳｉＣ単結晶の形成方法
JP2010265126A (ja) * 2009-05-12 2010-11-25 Kwansei Gakuin 単結晶ＳｉＣ基板、エピタキシャル成長層付き単結晶ＳｉＣ基板、ＳｉＣ基板、炭素供給フィード基板及び炭素ナノ材料付きＳｉＣ基板
WO2011074453A1 (ja) * 2009-12-14 2011-06-23 昭和電工株式会社 ＳｉＣエピタキシャルウェハ及びその製造方法

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010089983A (ja) * 2008-10-07 2010-04-22 Ecotron:Kk ＳｉＣ単結晶の形成方法
JP2010265126A (ja) * 2009-05-12 2010-11-25 Kwansei Gakuin 単結晶ＳｉＣ基板、エピタキシャル成長層付き単結晶ＳｉＣ基板、ＳｉＣ基板、炭素供給フィード基板及び炭素ナノ材料付きＳｉＣ基板
WO2011074453A1 (ja) * 2009-12-14 2011-06-23 昭和電工株式会社 ＳｉＣエピタキシャルウェハ及びその製造方法

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2015002207A (ja) * 2013-06-13 2015-01-05 昭和電工株式会社 ＳｉＣエピタキシャルウェハ及びその製造方法

Similar Documents

Publication Publication Date Title
Kimoto Bulk and epitaxial growth of silicon carbide
JP5653598B2 (ja) 低底面転位バルク成長ＳｉＣウェハ
JP4185215B2 (ja) ＳｉＣウエハ、ＳｉＣ半導体デバイス、および、ＳｉＣウエハの製造方法
US8410488B2 (en) Micropipe-free silicon carbide and related method of manufacture
JP5706823B2 (ja) ＳｉＣ単結晶ウエハーとその製造方法
CN106435733B (zh) 碳化硅单晶和碳化硅单晶晶片
US8221546B2 (en) Epitaxial growth on low degree off-axis SiC substrates and semiconductor devices made thereby
JPWO2016088883A1 (ja) 炭化珪素単結晶の製造方法及び炭化珪素単結晶基板
JP2008074661A (ja) エピタキシャル炭化珪素単結晶基板及びその製造方法
JP2009167047A (ja) 炭化珪素単結晶インゴット、これから得られる基板及びエピタキシャルウェハ
JP2009088223A (ja) 炭化珪素半導体基板およびそれを用いた炭化珪素半導体装置
JP2018113303A (ja) ＳｉＣエピタキシャルウェハ及びその製造方法
JP4442366B2 (ja) エピタキシャルＳｉＣ膜とその製造方法およびＳｉＣ半導体デバイス
JP2013067522A (ja) 炭化珪素結晶の製造方法
JP5614387B2 (ja) 炭化珪素単結晶の製造方法、及び炭化珪素単結晶インゴット
JP4408247B2 (ja) 炭化珪素単結晶育成用種結晶と、それを用いた炭化珪素単結晶の製造方法
JP2010053035A (ja) 炭化珪素単結晶インゴット、これから得られる基板及びエピタキシャルウェハ
Spencer et al. Substrate and epitaxial issues for SiC power devices
JP6052465B2 (ja) エピタキシャル炭化珪素ウエハの製造方法
WO2013161022A1 (ja) 炭化珪素半導体薄膜の形成方法および炭化珪素半導体基板
JP4157326B2 (ja) ４ｈ型炭化珪素単結晶インゴット及びウエハ
JP5370025B2 (ja) 炭化珪素単結晶インゴット
JP2004262709A (ja) ＳｉＣ単結晶の成長方法
JP2024500379A (ja) 結晶学的応力が低減した大寸法炭化ケイ素単結晶材料
JP4160770B2 (ja) ４ｈ型炭化珪素単結晶エピタキシャル基板

Legal Events

Date Code Title Description
121 Ep: the epo has been informed by wipo that ep was designated in this application

Ref document number: 12875085

Country of ref document: EP

Kind code of ref document: A1

NENP Non-entry into the national phase

Ref country code: DE

122 Ep: pct application non-entry in european phase

Ref document number: 12875085

Country of ref document: EP

Kind code of ref document: A1

NENP Non-entry into the national phase

Ref country code: JP