WO2010023883A1 - シンセサイザ及びこれを用いた受信装置及び電子機器 - Google Patents

シンセサイザ及びこれを用いた受信装置及び電子機器 Download PDF

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oscillation signal
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synthesizer
time variation
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槻尾泰信
南波昭彦
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パナソニック株式会社
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    • H03—ELECTRONIC CIRCUITRY
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    • H03L7/00—Automatic control of frequency or phase; Synchronisation
    • H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
    • H03L7/16—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop
    • H03L7/18—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop using a frequency divider or counter in the loop
    • H03L7/197—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop using a frequency divider or counter in the loop a time difference being used for locking the loop, the counter counting between numbers which are variable in time or the frequency divider dividing by a factor variable in time, e.g. for obtaining fractional frequency division
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
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    • H03J7/00—Automatic frequency control; Automatic scanning over a band of frequencies
    • H03J7/02—Automatic frequency control
    • H03J7/04—Automatic frequency control where the frequency control is accomplished by varying the electrical characteristics of a non-mechanically adjustable element or where the nature of the frequency controlling element is not significant
    • H03J7/06—Automatic frequency control where the frequency control is accomplished by varying the electrical characteristics of a non-mechanically adjustable element or where the nature of the frequency controlling element is not significant using counters or frequency dividers
    • H03J7/065—Automatic frequency control where the frequency control is accomplished by varying the electrical characteristics of a non-mechanically adjustable element or where the nature of the frequency controlling element is not significant using counters or frequency dividers the counter or frequency divider being used in a phase locked loop
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
    • H03L1/00—Stabilisation of generator output against variations of physical values, e.g. power supply
    • H03L1/02—Stabilisation of generator output against variations of physical values, e.g. power supply against variations of temperature only
    • H03L1/022—Stabilisation of generator output against variations of physical values, e.g. power supply against variations of temperature only by indirect stabilisation, i.e. by generating an electrical correction signal which is a function of the temperature
    • H03L1/027—Stabilisation of generator output against variations of physical values, e.g. power supply against variations of temperature only by indirect stabilisation, i.e. by generating an electrical correction signal which is a function of the temperature by using frequency conversion means which is variable with temperature, e.g. mixer, frequency divider, pulse add/substract logic circuit

Definitions

  • the present invention relates to a synthesizer, a receiving device, and an electronic device.
  • FIG. 6 is a block diagram of a conventional synthesizer.
  • a synthesizer 60 includes a phase comparator 61 that outputs a pulse width signal proportional to the phase difference between a reference oscillation signal output from a reference oscillator 69 and a comparison signal output from a frequency divider 64 described later.
  • a loop filter 62 that inputs a pulse width signal and outputs a low-pass filtered signal, a VCO 63 that outputs an oscillation signal based on the low-pass filtered signal, and an oscillation based on a frequency division ratio set by a control unit 68 described later.
  • a frequency divider 64 that divides the signal and outputs a comparison signal.
  • PLL Phase Locked Loop
  • the synthesizer 60 further includes a temperature detector 65 that detects the ambient temperature of the reference oscillator 69, an AD converter 66 that converts the detected temperature into digitized temperature information, and frequency division ratio information corresponding to the temperature information. And a control unit 68 that sets the frequency division ratio of the frequency divider 64 based on the frequency division ratio information.
  • the oscillation signal output from the synthesizer 60 may generate a frequency fluctuation range greater than or equal to a predetermined value, and the processing is performed by a signal processing unit (not shown) connected to the subsequent stage of the synthesizer 60. There were cases where it had an adverse effect.
  • the synthesizer of the present invention includes a synthesizer unit that outputs an oscillation signal based on a reference oscillation signal, a temperature detection unit that detects temperature, and a time variation of the frequency of the reference oscillation signal based on the temperature detection result of the temperature detection unit. And a control unit that adjusts the frequency of the oscillation signal output from the synthesizer unit based on the detection result of the time variation detection unit.
  • the frequency fluctuation range of the oscillation signal output from the synthesizer can be suppressed to a predetermined value or less, and adverse effects on the subsequent signal processing unit can be suppressed.
  • FIG. 1 is a block diagram of a synthesizer according to Embodiment 1 of the present invention.
  • FIG. 2 is a block diagram of a receiving apparatus equipped with a synthesizer according to Embodiment 1 of the present invention.
  • FIG. 3 is an explanatory diagram of the oscillation signal frequency of the synthesizer in the first embodiment of the present invention.
  • FIG. 4 is a block diagram of a receiving apparatus equipped with a synthesizer according to Embodiment 2 of the present invention.
  • FIG. 5 is an explanatory diagram of the oscillation signal frequency of the synthesizer in the second embodiment of the present invention.
  • FIG. 6 is a block diagram of a conventional synthesizer.
  • FIG. 1 is a block diagram of a synthesizer according to Embodiment 1 of the present invention.
  • the synthesizer 1 detects the ambient temperature of the reference oscillator 6 and the synthesizer unit 2 that outputs an oscillation signal based on the reference oscillation signal output from the reference oscillator 6 and the division ratio set by the control unit 5.
  • the temperature detection unit 3 that detects the time variation of the frequency of the reference oscillation signal based on the temperature detection result of the temperature detection unit 3, and the oscillation that is output from the synthesizer unit 2 based on the time variation.
  • a control unit 5 that performs frequency adjustment of the signal.
  • the synthesizer unit 2 also has a phase comparator 2a that outputs a pulse width signal proportional to the phase difference between the reference oscillation signal output from the reference oscillator 6 and the comparison signal, and a pulse width signal that is input as a low-pass filtered signal.
  • a loop filter 2b for output, a VCO 2c for outputting an oscillation signal based on the low-pass filtered signal, and a frequency divider 2d for dividing the oscillation signal based on the frequency division ratio set by the control unit 5 and outputting a comparison signal And having.
  • PLL Phase Locked Loop
  • the time fluctuation detection unit 4 includes an AD conversion unit 4a that converts the detected temperature output from the temperature detection unit 3 into a digital signal, a differentiation unit 4b that performs time differentiation on the temperature converted into the digital signal, and the time A frequency conversion unit 4c that outputs a time fluctuation amount of the frequency of the reference oscillation signal from the differential value.
  • FIG. 2 is a block diagram of a receiving apparatus equipped with the synthesizer according to the first embodiment of the present invention.
  • a receiving device 20 outputs from the synthesizer 1 a reference oscillator 6 that outputs a reference oscillation signal, a synthesizer 1 that outputs an oscillation signal based on the reference oscillation signal, and a reception signal that is output from the receiving unit 21.
  • a frequency converter 22 that performs frequency conversion based on the generated oscillation signal and outputs a baseband signal (hereinafter referred to as “BB signal”) to the signal processing unit 23.
  • BB signal baseband signal
  • the frequency converter 22 may output a signal of a specific frequency and convert it to a BB signal using a second frequency converter (not shown) connected to the subsequent stage of the frequency converter 22.
  • the signal processing performed by the signal processing unit 23 may be adversely affected.
  • the BB signal is subjected to primary modulation by 64QAM or the like and secondary modulation by OFDM, and the signal processing unit 23 receives the modulated BB.
  • the frequency variation of the oscillation signal breaks the orthogonality between the carriers constituting the OFDM and gives a phase variation to the modulation such as 64QAM. Accordingly, the performance of the demodulation process is deteriorated, and noise is generated in the video display.
  • the relationship between the frequency fluctuation amount of the oscillation signal and the performance deterioration amount of the demodulation process differs depending on the system.
  • the interval between each carrier constituting OFDM is about 1 kHz (in the case of Mode 3), and therefore, when the oscillation signal fluctuates by more than ⁇ 500 Hz, it may be erroneously discriminated from the adjacent carrier.
  • the fluctuation of the frequency Fvco (Hz) of the oscillation signal output from the synthesizer 60 is expressed by ⁇ Fmax (Hz) using the reference oscillation signal whose frequency temperature characteristic is X (ppm / ° C.).
  • the temperature detection accuracy Z (° C.) of the temperature detection unit 65 needs to satisfy (Equation 2).
  • the reference oscillator 69 is configured using a vibrator having a large temperature characteristic, the temperature detection accuracy Z becomes small, and it becomes difficult to realize frequency compensation control.
  • MEMS Micro Electro mechanical System
  • the MEMS resonator is expected to be an alternative device for the crystal resonator because it can be reduced in size and cost as compared with the crystal resonator.
  • it has a drawback that the temperature characteristics are poor as compared with a quartz resonator.
  • the synthesizer 1 in the first embodiment pays attention to the fact that the minimum control unit of the frequency division ratio of the frequency divider 2d is sufficiently smaller than the frequency control unit determined from the temperature detection accuracy Z, and not the absolute value of the detected temperature.
  • the control amount of the frequency divider 2d based on the time change of the detected temperature, it is possible to perform frequency compensation control that suppresses the deterioration of the processing performance of the signal processing unit 23.
  • the differentiation unit 4b outputs a temperature change VT (° C./second) per unit time based on the digitized temperature output from the AD conversion unit 4a.
  • the frequency conversion unit 4c multiplies the VT and the temperature characteristic X (ppm / ° C.) of the reference oscillator 6 to calculate a time change rate (ppm / second) of the frequency fluctuation of the reference oscillation signal. Further, by multiplying the frequency Fvco (Hz) of the oscillation signal, the time change rate Vvco (Hz / second) of the frequency fluctuation amount of the oscillation signal can be obtained. That is, the time change rate Vvco (Hz / second) of the oscillation signal is expressed by (Expression 3).
  • Vvco VT ⁇ X ⁇ Fvco (Equation 3)
  • the control unit 5 performs frequency compensation control by controlling the frequency division ratio of the frequency divider 2d so that the time change rate of the oscillation signal becomes “ ⁇ Vvco”. Thereby, the time change rate of the frequency of the oscillation signal caused by the temperature change cancels the time change rate of the frequency of the oscillation signal caused by the control of the frequency division ratio.
  • the control unit 5 may add the frequency division ratio by Mstep represented by (Equation 4) every control cycle T (seconds).
  • Mstep INT (Vvco ⁇ T / Fmin) (Equation 4)
  • INT (X) represents an integer obtained by rounding off X. From (Equation 4), it is necessary to make the minimum change unit Fmin of the frequency divider 2d smaller than Vvco ⁇ T.
  • fractional frequency division methods such as a fractional N method and a ⁇ method. For example, when the ⁇ method is used, assuming that the number of bits of an accumulator (not shown) included in the frequency divider 2d is N, Fmin is expressed by (Expression 5) using the frequency Fref of the reference oscillation signal.
  • control unit 5 makes the frequency of the oscillation signal output from the synthesizer 1 smaller than the required fluctuation ratio R even when the reference oscillator 6 composed of an oscillator with poor temperature characteristics is used. Can do. This will be described with reference to FIG.
  • FIG. 3 is an explanatory diagram of the oscillation signal frequency of the synthesizer according to the first embodiment of the present invention.
  • the horizontal axis represents time
  • the vertical axis represents frequency.
  • the conventional oscillation signal 30 represents the frequency variation of the oscillation signal when the conventional control is performed
  • the oscillation signal 31 of the present application represents the frequency variation of the oscillation signal when the control of the present invention is performed.
  • ⁇ fz X ⁇ Z ⁇ Fvco (Expression 7)
  • the control unit 68 operates in the control cycle T, but since the minimum control unit is ⁇ fz, the frequency division ratio of the frequency divider 64 can be controlled only at timings t3, t6, and t9. It cannot be controlled at the timing such as t2.
  • the conventional oscillation signal 30 fluctuates within a range of ⁇ ⁇ fz and does not satisfy the condition of (Equation 6), so that the reception quality is deteriorated.
  • the time variation detector 4 in the synthesizer 1 of the first embodiment can calculate the time variation rate of the frequency variation amount of the oscillation signal as (Equation 8) based on the detected temperatures at t0 and t3.
  • Vvco ⁇ fz / (t3-t0) (Equation 8)
  • the control unit 5 adds the frequency division ratio Mstep expressed by (Equation 4) to the frequency division ratio set in the frequency divider 2d at the times t4 and t5.
  • the oscillation signal 31 of the present application can be subjected to frequency compensation control in a frequency control unit ⁇ fz or less that is regulated by the temperature detection accuracy Z.
  • the frequency fluctuation of the oscillation signal can be suppressed to ⁇ ⁇ fmax or less, and the deterioration of the reception quality can be suppressed.
  • the addition amount of the frequency division ratio after t7 may be determined based on the temperatures detected at t0, t3, and t6.
  • the slope of the frequency change (first-order differential value) calculated from the temperature detection result is used.
  • the frequency change slope changes with time. The followability can be improved.
  • the time change rate Vvco of the frequency fluctuation amount is calculated, so that the influence of short-term temperature fluctuations and measurement variations can be reduced. This eliminates the possibility of stable control.
  • the invention of the present application is characterized in that frequency compensation control is performed in units smaller than the frequency control accuracy regulated by the temperature detection accuracy Z based on the time variation of the frequency. Therefore, the method of calculating Vvco in the time fluctuation detection unit 4 is not limited to the above-described differentiation or the like, and even if a term proportional to the current detected temperature or an integral term calculated from the past detected temperature is further added. Good.
  • the synthesizer 1 by using the synthesizer 1 according to the first embodiment, the reference oscillator 6 using a vibrator having poor temperature characteristics such as a MEMS vibrator is used, and the signal processing unit 23 in the subsequent stage uses it. It is possible to configure the receiving device 20 that suppresses reception quality deterioration.
  • a small electronic device using a MEMS vibrator or the like can be configured.
  • FIG. 4 is a block diagram of a receiving apparatus equipped with a synthesizer according to Embodiment 2 of the present invention.
  • a synthesizer 41 includes a synthesizer unit 41a that outputs an oscillation signal based on a reference oscillation signal output from the reference oscillator 6, and an oscillation signal that is output from the synthesizer 41 based on a frequency deviation input from the outside. And a control unit 41b that adjusts the frequency of the oscillation signal based on the time variation.
  • the receiving device 40 includes a reference oscillator 6, a synthesizer 41, and a frequency converter 22 that converts the frequency of the reception signal output from the reception unit 21 based on the oscillation signal output from the synthesizer 41 and outputs a BB signal.
  • the signal processing unit 42 includes a demodulation unit 42a that processes the BB signal and a frequency deviation detection unit 42b that outputs the frequency deviation of the BB signal.
  • the frequency deviation detector 42b can detect a frequency deviation by using a known reference signal (for example, a guard interval signal) or a characteristic of a modulation waveform between transmission and reception inserted in the BB signal.
  • a known reference signal for example, a guard interval signal
  • two frequency deviation calculation circuits a wide band carrier frequency deviation calculation circuit (not shown) and a narrow band carrier frequency deviation calculation circuit (not shown) are used.
  • the broadband carrier frequency deviation calculation circuit can calculate the frequency deviation in units of carrier intervals by using the reference symbol for frequency synchronization inserted at a predetermined period on the transmission side. Therefore, the detection range of the broadband carrier frequency deviation calculation circuit is the transmission bandwidth, and the frequency deviation detection accuracy is about 1 kHz (in the case of Mode 3).
  • the narrowband carrier frequency deviation calculation circuit calculates the frequency deviation within the carrier interval by using the correlation between the guard period signals in the OFDM signal because the guard period signal is a rear copy of the effective symbol period signal.
  • the detection range can be within a carrier interval (about 1 kHz), and the detection accuracy can be within 1% (about 10 Hz) of the carrier interval.
  • the frequency deviation detector 42b can detect the frequency deviation over a wide range and with high accuracy by using the broadband carrier frequency deviation calculation circuit and the narrow band carrier frequency deviation calculation circuit.
  • the frequency compensation control based on the frequency deviation cannot follow the frequency fluctuation.
  • the reference symbol used in the wideband carrier frequency deviation calculation circuit and the effective symbol period signal used in the narrowband carrier frequency deviation calculation circuit are acquired at intervals of about 1 millisecond (in the case of Mode 3). The period cannot be faster than 1 millisecond.
  • the detection cycle becomes several tens of milliseconds to several hundreds of milliseconds by performing an averaging process for alleviating detection variations. Accordingly, when the frequency fluctuation within the detection period exceeds the allowable frequency deviation ⁇ fmax determined by the processing performance of the demodulator 42a, the reception quality is deteriorated.
  • the time variation detector 41c performs time differentiation on the frequency deviation output from the frequency deviation detector 42b, so that the time of the frequency deviation of the oscillation signal output from the synthesizer 41 is obtained. Detect the rate of change. And based on this time change rate, frequency compensation control can be performed in a cycle shorter than the detection cycle.
  • the frequency deviation ⁇ f (t) detected by the frequency deviation detector 42b is expressed by using the frequency deviation ⁇ fRf (t) of the received signal and the frequency deviation ⁇ fLo (t) of the oscillation signal output from the synthesizer 41 (Equation 9 ).
  • ⁇ f (t) / ⁇ t ⁇ fRf (t) / ⁇ t + ⁇ fLo (t) / ⁇ t (Equation 10)
  • ⁇ fRf (t) / ⁇ t of the first term can be set to 0, and ⁇ f (t) / ⁇ t calculated by the time variation detection unit 41c is considered as frequency variation ⁇ fLo (t) / ⁇ t of the oscillation signal.
  • control unit 41b may determine the adjustment speed of the synthesizer unit 41a so that the frequency of the oscillation signal becomes 0 based on ⁇ f (t) / ⁇ t output from the time variation detection unit 41c.
  • FIG. 5 is an explanatory diagram of the oscillation signal frequency of the synthesizer in the second embodiment of the present invention.
  • the horizontal axis represents time and the vertical axis represents frequency.
  • the control period of the control unit 41b is T, and the frequency deviation detection period is 3T.
  • the conventional oscillation signal 50 represents the frequency variation of the oscillation signal when the synthesizer 41a is controlled based on the absolute value of the frequency deviation output from the frequency deviation detector 42b.
  • the oscillation signal 51 of the present application represents the frequency fluctuation of the oscillation signal when the control in the present embodiment is performed.
  • the conventional oscillation signal 50 can perform frequency compensation control only at a cycle 3T (t0, t3, t6,%) Slower than the control cycle. For this reason, the frequency deviation of the oscillation signal exceeds ⁇ fmax, resulting in degradation of reception quality.
  • the oscillation signal 51 of the present application detects the time change rate of the frequency deviation of the oscillation signal based on the frequency deviation detected at t0 and t3. And based on this rate of time change, frequency compensation control can be performed in period T after t4. Therefore, the frequency deviation of the oscillation signal can be suppressed to ⁇ fmax or less, and deterioration of reception quality can be suppressed. Further, since a frequency deviation is newly output from the frequency deviation detector 42b at t6, the addition amount of the frequency division ratio after t7 may be determined based on the detected temperatures at t0, t3, and t6.
  • the synthesizer of the present invention can be used for a receiving apparatus and an electronic device.

Landscapes

  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
  • Superheterodyne Receivers (AREA)

Abstract

　本発明のシンセサイザ（１）は、基準発振信号を基に発振信号を出力するシンセサイザ部（２）と、温度を検出する温度検出部（３）と、温度検出部の温度検出結果に基づいて基準発振信号の周波数の時間変動を検出する時間変動検出部（４）と、時間変動検出部の検出結果に基づいてシンセサイザ部から出力される発振信号の周波数調整を行う制御部（５）と、を備える。このような構成により、温度係数が大きい振動子の周波数補償制御を行う。

Description

シンセサイザ及びこれを用いた受信装置及び電子機器
　本発明は、シンセサイザと受信装置及び電子機器に関する。
　以下、従来のシンセサイザについて図６を用いて説明する。
　図６は従来のシンセサイザのブロック図である。図６において、シンセサイザ６０は、基準発振器６９から出力される基準発振信号と後述する分周器６４から出力される比較信号の位相差に比例したパルス幅信号を出力する位相比較器６１と、このパルス幅信号を入力し低域濾波後信号を出力するループフィルタ６２と、この低域濾波後信号に基づき発振信号を出力するＶＣＯ６３と、後述する制御部６８が設定する分周比に基づいて発振信号を分周し比較信号を出力する分周器６４と、を有する。これらはＰｈａｓｅ　Ｌｏｃｋｅｄ　Ｌｏｏｐ（以下、「ＰＬＬ」という）を構成している。
　さらに、シンセサイザ６０は、基準発振器６９の周囲温度を検出する温度検出部６５と、この検出温度をデジタル化された温度情報に変換するＡＤ変換部６６と、この温度情報に対応した分周比情報が格納された不揮発性メモリ６７と、この分周比情報に基づいて分周器６４の分周比を設定する制御部６８と、を有する。
　このような構成により、基準発振器６９の周囲温度に依存して基準発振信号の周波数が変化しても、シンセサイザ６０から出力される発振信号を一定値に保つ制御（以下、「周波数補償制御」という）を行うことができる。シンセサイザ６０に含まれるＰＬＬにおいて、基準発振信号の周波数をＦｒｅｆ、分周比をＭとすると、シンセサイザ６０から出力される発振信号の周波数Ｆｖｃｏは、（式１）で表される。
　　Ｆｖｃｏ＝Ｆｒｅｆ×Ｍ　・・(式１)
　ここで、Ｆｒｅｆは温度の関数である。この関係を用いることにより、基準発振器６９の周囲温度が変化してＦｒｅｆがａ倍になった場合には、Ｍを１／ａ倍に設定すれば、温度変化にかかわらずＦｖｃｏを一定値に保つことができる。したがって、基準発振器６９の周囲温度とＦｖｃｏとを一定値とするための分周比Ｍの組み合わせ表を、不揮発性メモリ６７に予め書き込んでおき、温度検出部６５が検出した温度に対応して不揮発性メモリ６７から読み出される分周比Ｍを、制御部６８が分周器６４に設定することにより、周波数補償制御を行うことができる。この出願の発明に関連する先行技術文献情報としては、例えば、特許文献１が知られている。
　しかしながら、上記従来の制御方法では、シンセサイザ６０から出力される発振信号が所定値以上の周波数変動幅を生じる場合があり、シンセサイザ６０の後段に接続された信号処理部（図示せず）の処理に悪影響を与える場合があった。
特開平３－２０９９１７号公報
　本発明のシンセサイザは、基準発振信号に基づいて発振信号を出力するシンセサイザ部と、温度を検出する温度検出部と、この温度検出部の温度検出結果に基づいて基準発振信号の周波数の時間変動を検出する時間変動検出部と、この時間変動検出部の検出結果に基づいてシンセサイザ部から出力される発振信号の周波数調整を行う制御部と、を有する。
　上記構成により、シンセサイザから出力される発振信号の周波数変動幅を所定値以下に抑え、後段の信号処理部に与える悪影響を抑制することができる。
図１は本発明の実施の形態１におけるシンセサイザのブロック図である。 図２は本発明の実施の形態１におけるシンセサイザを搭載した受信装置のブロック図である。 図３は本発明の実施の形態１におけるシンセサイザの発振信号周波数の説明図である。 図４は本発明の実施の形態２におけるシンセサイザを搭載した受信装置のブロック図である。 図５は本発明の実施の形態２におけるシンセサイザの発振信号周波数の説明図である。 図６は従来のシンセサイザのブロック図である。
　（実施の形態１）
　図１は、本発明の実施の形態１におけるシンセサイザのブロック図である。図１において、シンセサイザ１は、基準発振器６から出力された基準発振信号と制御部５から設定された分周比に基づいて発振信号を出力するシンセサイザ部２と、基準発振器６の周囲温度を検出する温度検出部３と、温度検出部３の温度検出結果に基づいて基準発振信号の周波数の時間変動を検出する時間変動検出部４と、この時間変動に基づいてシンセサイザ部２から出力される発振信号の周波数調整を行う制御部５と、を有する。また、シンセサイザ部２は、基準発振器６から出力された基準発振信号と比較信号の位相差に比例したパルス幅信号を出力する位相比較器２ａと、パルス幅信号を入力し低域濾波後信号を出力するループフィルタ２ｂと、低域濾波後信号に基づき発振信号を出力するＶＣＯ２ｃと、制御部５から設定された分周比に基づいて発振信号を分周し比較信号を出力する分周器２ｄと、を有する。そして、これらはＰｈａｓｅ　Ｌｏｃｋｅｄ　Ｌｏｏｐ（ＰＬＬ）を構成している。さらに、時間変動検出部４は、温度検出部３から出力される検出温度をデジタル信号に変換するＡＤ変換部４ａと、このデジタル信号に変換された温度を時間微分する微分部４ｂと、この時間微分値から基準発振信号の周波数の時間変動量を出力する周波数換算部４ｃと、を有する。
　図２は本発明の実施の形態１におけるシンセサイザを搭載した受信装置のブロック図である。図２において、受信装置２０は、基準発振信号を出力する基準発振器６と、この基準発振信号に基づいて発振信号を出力するシンセサイザ１と、受信部２１から出力された受信信号をシンセサイザ１から出力された発振信号に基づいて周波数変換しベースバンド信号（以下、「ＢＢ信号」という）を信号処理部２３に対して出力する周波数変換器２２と、を有する。なお、周波数変換器２２が特定の周波数の信号を出力し、周波数変換器２２の後段に接続された第２の周波数変換器（図示せず）を用いてＢＢ信号に変換してもよい。
　ここで、シンセサイザ１から出力される発振信号の周波数が変動すると、信号処理部２３が行う信号処理に悪影響を与える場合がある。例えば、日本の地上デジタル放送（ＩＳＤＢ－Ｔ）を受信する場合には、ＢＢ信号は６４ＱＡＭ等による１次変調及びＯＦＤＭによる２次変調が施されており、信号処理部２３はこの変調されたＢＢ信号の復調処理を行う。発振信号の周波数変動は、ＯＦＤＭを構成するキャリア間の直交性を崩し、６４ＱＡＭ等の変調に位相変動を与える。従って、復調処理の性能劣化をもたらし、映像表示にノイズを生じさせる。発振信号の周波数変動量と復調処理の性能劣化量との関係は、システムにより異なる。ＩＳＤＢ－Ｔでは、ＯＦＤＭを構成する各キャリアの間隔が約１ｋＨｚ（Ｍｏｄｅ３の場合）であるため、発振信号が±５００Ｈｚ以上の周波数変動をすると、隣接キャリアとの判別を誤る場合が生じる。また、キャリア間干渉や位相変動の影響を小さくするためには、例えば、さらに１０分の１である±５０Ｈｚ以下の周波数変動に抑えることが望ましい。したがって、信号処理部２３の処理性能で定まる許容周波数偏差をΔＦｍａｘとすると、制御部５は、ΔＦｍａｘ以下の単位で周波数補償制御を行う必要がある。
　従来のシンセサイザ６０の周波数補償制御の場合は、周波数温度特性がＸ（ｐｐｍ／℃）の基準発振信号を用いて、シンセサイザ６０から出力される発振信号の周波数Ｆｖｃｏ（Ｈｚ）の変動をΔＦｍａｘ（Ｈｚ）以下に抑えるためには、温度検出部６５の温度検出精度Ｚ（℃）は、（式２）を満たす必要がある。
　　Ｚ≦（ΔＦｍａｘ／Ｆｖｃｏ）／Ｘ　・・（式２）
　従来用いられていたＡＴカットの水晶振動子を用いて基準発振器６９を構成した場合は、基準発振信号の常温付近における周波数温度特性Ｘは高々０．１（ｐｐｍ／℃）である。よって、ＩＳＤＢ－Ｔで使われるＵＨＦ帯（４７０～７７０ＭＨｚ）において、ΔＦｍａｘ＝５０Ｈｚを実現するためには、温度検出部３の温度検出精度はＺ≦０．６５℃となる。半導体ベースの簡易な温度検出部でも±０．５℃の温度検出精度を実現できるため、（式２）の条件を満たすことができ、信号処理部２３の処理性能の劣化が問題となることはなかった。
　しかし、温度特性の大きい振動子を用いて基準発振器６９を構成した場合は、温度検出精度Ｚが小さくなり、周波数補償制御が実現困難となる。具体例として近年、実用化検討が進んでいるＭＥＭＳ（ＭｉｃｒｏＥｌｅｃｔｒｏ　ｍｅｃｈａｎｉｃａｌ　Ｓｙｓｔｅｍ）振動子が挙げられる。ＭＥＭＳ振動子は水晶振動子に比べて小型化及び低コスト化を図ることができるため、水晶振動子の代替デバイスとして期待されている。しかしながら、水晶振動子に比べて温度特性が悪いという欠点を有する。例えば、ＭＥＭＳ振動子の１つであるシリコン振動子は、温度特性の１次係数が約－３０ｐｐｍ／℃であり、周波数補償制御に必要な温度検出精度Ｚは、Δｆｍａｘ＝５０Ｈｚの場合、Ｚ≦０．００２２℃となる。この温度検出精度の温度センサーを実現するのは困難であるため、小型で安価なシリコン振動子等のＭＥＭＳ振動子を放送受信装置等の高周波受信装置に適用する阻害要因の１つとなっていた。
　本実施の形態１におけるシンセサイザ１は、温度検出精度Ｚから定まる周波数制御単位に比べて、分周器２ｄの分周比の最小制御単位が十分小さいことに着目し、検出温度の絶対値ではなく、検出温度の時間変化に基づいて分周器２ｄの制御量を決定することにより、信号処理部２３の処理性能の劣化を抑制した周波数補償制御を行うことができる。
　以下、本実施の形態１における周波数補償制御の具体方法を説明する。
　微分部４ｂは、ＡＤ変換部４ａから出力されるデジタル化された温度に基づいて、単位時間当たりの温度変化ＶＴ（℃／秒）を出力する。周波数換算部４ｃは、ＶＴと基準発振器６の温度特性Ｘ（ｐｐｍ／℃）を乗算することにより、基準発振信号の周波数変動の時間変化率（ｐｐｍ／秒）を算出する。さらに発振信号の周波数Ｆｖｃｏ（Ｈｚ）を乗算することにより、発振信号の周波数変動量の時間変化率Ｖｖｃｏ（Ｈｚ／秒）を得ることができる。つまり、発振信号の時間変化率Ｖｖｃｏ（Ｈｚ／秒）は（式３）で表される。
　　Ｖｖｃｏ＝ＶＴ×Ｘ×Ｆｖｃｏ　・・（式３）
　制御部５は、発振信号の時間変化率が“－Ｖｖｃｏ”となるように、分周器２ｄの分周比を制御することにより、周波数補償制御を行う。これにより、温度変化に起因する発振信号の周波数の時間変化率と、分周比の制御に起因する発振信号の周波数の時間変化率が相殺される。分周器２ｄによる最小変更単位をＦｍｉｎ（Ｈｚ）とすると、制御部５は、制御周期Ｔ（秒）ごとに、（式４）で表されるＭｓｔｅｐだけ分周比を加算すればよい。
　　Ｍｓｔｅｐ＝ＩＮＴ（Ｖｖｃｏ×Ｔ／Ｆｍｉｎ）　・・（式４）
　ここで、ＩＮＴ（Ｘ）はＸを四捨五入等して得られる整数を表す。（式４）より、分周器２ｄの最小変更単位ＦｍｉｎをＶｖｃｏ×Ｔより小さくする必要がある。Ｆｍｉｎを小さくする手法として、フラクショナルＮ方式やΔΣ方式などの分数分周方式がある。例えばΔΣ方式を用いた場合は、分周器２ｄに含まれるアキュムレータ（図示せず）のビット数をＮとすると、基準発振信号の周波数Ｆｒｅｆを用いてＦｍｉｎは（式５）で表される。
　　Ｆｍｉｎ＝Ｆｒｅｆ／（２＾Ｎ）　・・（式５）
　従って、Ｎを大きくすることにより、最小変更単位Ｆｍｉｎを格段に小さくすることができる。
　以上の制御により、制御部５は、温度特性が悪い振動子からなる基準発振器６を用いた場合であっても、シンセサイザ１から出力される発振信号の周波数を所要の変動比Ｒより小さくすることができる。この様子を、図３を用いて説明する。
　図３は本発明の実施の形態１におけるシンセサイザの発振信号周波数の説明図である。図３において、横軸は時間で、縦軸は周波数を表している。また、従来発振信号３０は、従来の制御を行った場合の発振信号の周波数変動を表し、本願発振信号３１は、本願発明の制御を行った場合の発振信号の周波数変動を表している。初期状態（ｔ＝ｔ０）で、従来発振信号３０及び本願発振信号３１が、所望の発振周波数（ｆＬｏ）になっているとする。信号処理部２３の許容周波数偏差をΔｆｍａｘとすると、発振信号の周波数ｆは（式６）を満たさない場合に、受信品質が劣化する。
　　（ｆＬｏ－Δｆｍａｘ）＜ｆ＜（ｆＬｏ＋Δｆｍａｘ）　・・（式６）
　従来のシンセサイザ６０における制御部６８は、温度検出部６５の検出温度に対応した分周比を不揮発性メモリ６７から読み出し、分周器６４に設定するので、温度検出部６５の温度検出精度Ｚ（℃）が、周波数制御精度を律束する。つまり、シンセサイザ６０から出力される発振信号の周波数制御単位Δｆｚは（式７）で表される。
　　Δｆｚ＝Ｘ×Ｚ×Ｆｖｃｏ　・・（式７）
　図３において、制御部６８は、制御周期Ｔで動作するが、最小制御単位がΔｆｚであるので、ｔ３、ｔ６、ｔ９のタイミングでしか分周器６４の分周比を制御できず、ｔ１、ｔ２等のタイミングでは制御することができない。その結果、従来発振信号３０は、±Δｆｚの範囲で変動することとなり、（式６）の条件を満たさないので、受信品質が劣化する。
　本実施の形態１のシンセサイザ１における時間変動検出部４は、ｔ０及びｔ３における検出温度に基づいて、発振信号の周波数変動量の時間変化率は（式８）と算出することができる。
　　Ｖｖｃｏ＝Δｆｚ／（ｔ３－ｔ０）　・・（式８）
　制御部５は、Ｖｖｃｏに基づいて、ｔ４及びｔ５の時点で、（式４）で表される分周比Ｍｓｔｅｐを分周器２ｄに設定された分周比に加算する。その結果、本願発振信号３１は、温度検出精度Ｚで律束される周波数制御単位Δｆｚ以下で、周波数補償制御を行うことができる。これにより、発振信号の周波数変動を±Δｆｍａｘ以下に抑えることができ、受信品質の劣化を抑制することが可能となる。また、ｔ６では温度検出部３の検出温度が変化するため、ｔ０、ｔ３、ｔ６における検出温度に基づいてｔ７以降の分周比の加算量を決めればよい。
　上述の説明では、温度検出結果から算出した周波数変化の傾き（１階微分値）を用いたが、さらに２階微分値をも考慮することにより、周波数変化の傾きが時間的に変化する場合に対する追従性を上げることが可能となる。また、温度検出結果を移動平均処理、あるいは所定の重みを付したスライディング平均処理を施した後に、周波数変動量の時間変化率Ｖｖｃｏを算出することにより、短周期の温度変動や測定ばらつきの影響を排除し、安定した制御を行うことが可能となる。
　なお、本願発明は、周波数の時間変動に基づいて、温度検出精度Ｚで律束される周波数制御精度より小さい単位で周波数補償制御を行うところに特徴を有する。従って、時間変動検出部４におけるＶｖｃｏの算出方法は、上述の微分等に限られるものでなく、現在の検出温度に比例する項や、過去の検出温度から算出した積分項をさらに加算してもよい。
　また、図２に示すように、本実施の形態１におけるシンセサイザ１を用いることにより、ＭＥＭＳ振動子等の温度特性の悪い振動子を用いた基準発振器６を使って、後段の信号処理部２３における受信品質劣化を抑制した受信装置２０を構成することができる。
　また、信号処理部２３、及びその後段に表示部（図示せず）を備えることにより、ＭＥＭＳ振動子等を用いた小型な電子機器を構成することができる。
　（実施の形態２）
　図４は、本発明の実施の形態２におけるシンセサイザを搭載した受信装置のブロック図である。図４において、シンセサイザ４１は、基準発振器６から出力される基準発振信号に基づいて発振信号を出力するシンセサイザ部４１ａと、外部から入力された周波数偏差に基づいて、シンセサイザ４１から出力される発振信号の周波数の時間変動を検出する時間変動検出部４１ｃと、この時間変動に基づいて発振信号の周波数を調整する制御部４１ｂと、を有する。また、受信装置４０は、基準発振器６と、シンセサイザ４１と、受信部２１から出力される受信信号をシンセサイザ４１から出力される発振信号に基づいて周波数変換しＢＢ信号を出力する周波数変換器２２と、を有する。さらに、信号処理部４２は、ＢＢ信号を処理する復調部４２ａと、ＢＢ信号の周波数偏差を出力する周波数偏差検出部４２ｂと、を有する。
　以下、ＢＢ信号の周波数偏差の検出方法について説明し、この周波数偏差の時間変動に基づいて周波数補償制御を行う方法を説明する。
　周波数偏差検出部４２ｂは、ＢＢ信号に挿入された送受信間で既知の基準信号（例えば、ガードインターバル信号）や、変調波形の特徴を用いることにより周波数偏差を検出することができる。ＩＳＤＢ－Ｔの例では、広帯域キャリア周波数偏差算出回路（図示せず）と狭帯域キャリア周波数偏差算出回路（図示せず）の２つの周波数偏差算出回路が用いられている。広帯域キャリア周波数偏差算出回路は、送信側において所定の周期で挿入された周波数同期用の基準シンボルを用いることにより、キャリア間隔単位の周波数偏差を算出することができる。従って、広帯域キャリア周波数偏差算出回路の検出範囲は伝送帯域幅で、周波数偏差の検出精度は約１ｋＨｚ（Ｍｏｄｅ３の場合）となる。また、狭帯域キャリア周波数偏差算出回路は、ＯＦＤＭ信号の中のガード期間信号が有効シンボル期間信号の後部のコピーであるので、それらの間の相関を利用することにより、キャリア間隔以内の周波数偏差を検出する。この狭帯域キャリア周波数偏差算出回路は、検出範囲がキャリア間隔（約１ｋＨｚ）で、検出精度はキャリア間隔の１％（約１０Ｈｚ）以内とすることが可能である。周波数偏差検出部４２ｂは、これら広帯域キャリア周波数偏差算出回路と狭帯域キャリア周波数偏差算出回路を用いて、広範囲かつ高精度な周波数偏差の検出をすることができる。
　ここで、周波数変動速度に比べて、周波数偏差検出部４２ｂの検出周期が遅い場合には、周波数偏差に基づく周波数補償制御では周波数変動に追従することができない。ＩＳＤＢ－Ｔの場合、広帯域キャリア周波数偏差算出回路に用いる基準シンボルや、狭帯域キャリア周波数偏差算出回路に用いる有効シンボル期間信号は、約１ミリ秒（Ｍｏｄｅ３の場合）の間隔で取得するので、検出周期は１ミリ秒より早くすることができない。また、実際には、検出ばらつきを緩和するための平均化処理を行うことにより、検出周期は数十ミリ秒～数百ミリ秒となる。従って、検出周期内における周波数変動が、復調部４２ａの処理性能で定まる許容周波数偏差Δｆｍａｘを超える場合は、受信品質の劣化をもたらす。
　本実施の形態２におけるシンセサイザ４１は、時間変動検出部４１ｃが周波数偏差検出部４２ｂから出力された周波数偏差に対して時間微分を施すことにより、シンセサイザ４１から出力される発振信号の周波数偏差の時間変化率を検出する。そして、この時間変化率に基づいて、検出周期より短い周期で周波数補償制御を行うことができる。
　以下、本実施の形態２におけるシンセサイザ４１における周波数補償制御の方法を説明する。
　周波数偏差検出部４２ｂが検出する周波数偏差Δｆ（ｔ）は、受信信号が有する周波数偏差ΔｆＲｆ（ｔ）と、シンセサイザ４１から出力される発振信号の周波数偏差ΔｆＬｏ（ｔ）を用いて、（式９）で表される。
　　Δｆ（ｔ）＝ΔｆＲｆ（ｔ）＋ΔｆＬｏ（ｔ）　・・（式９）
　両辺を検出周期Δｔで除算すると、（式１０）となる。
　　Δｆ（ｔ）／Δｔ＝ΔｆＲｆ（ｔ）／Δｔ＋ΔｆＬｏ（ｔ）／Δｔ　・・(式１０)
　ここで、放送局における送信機では一般にＯＣＸＯ等の周波数安定性に優れた発振器が用いられるため、送信周波数の時間変動は十分小さい。したがって、第１項のΔｆＲｆ（ｔ）／Δｔは０とすることができ、時間変動検出部４１ｃが算出するΔｆ（ｔ）／Δｔは、発振信号の周波数変動ΔｆＬｏ（ｔ）／Δｔと考えることができる。
　従って、制御部４１ｂは、時間変動検出部４１ｃから出力されるΔｆ（ｔ）／Δｔに基づいて、発振信号の周波数が０となるようにシンセサイザ部４１ａの調整速度を決めればよい。
　本実施の形態２における、発振信号の周波数変動について図５を用いて説明する。図５は本発明の実施の形態２におけるシンセサイザの発振信号周波数の説明図である。図５において、横軸は時間で、縦軸は周波数を表している。制御部４１ｂの制御周期はＴ、周波数偏差の検出周期は３Ｔである。従来発振信号５０は、周波数偏差検出部４２ｂから出力される周波数偏差の絶対値に基づいてシンセサイザ部４１ａの制御を行った場合の発振信号の周波数変動を表す。また、本願発振信号５１は、本実施の形態における制御を行った場合の発振信号の周波数変動を表す。
　従来発振信号５０は、制御周期より遅い周期３Ｔ（ｔ０、ｔ３、ｔ６、・・・）でしか周波数補償制御を行うことができない。そのため、発振信号の周波数偏差がΔｆｍａｘを超え、受信品質の劣化をもたらしている。
　一方、本願発振信号５１は、ｔ０とｔ３で検出した周波数偏差に基づいて、発振信号の周波数偏差の時間変化率を検出する。そして、この時間変化率に基づくことにより、ｔ４以降は周期Ｔで周波数補償制御を行うことができる。従って、発振信号の周波数偏差をΔｆｍａｘ以下に抑えることができ、受信品質の劣化を抑制することができる。また、ｔ６では新たに周波数偏差検出部４２ｂから周波数偏差が出力されるので、ｔ０、ｔ３、ｔ６における検出温度に基づいてｔ７以降の分周比の加算量を決めればよい。
　本発明のシンセサイザは、受信装置及び電子機器に利用することができる。
１，４１　　シンセサイザ
２，４１ａ　　シンセサイザ部
２ａ　　位相比較器
２ｂ　　ループフィルタ
２ｃ　　ＶＣＯ
２ｄ　　分周器
３　　温度検出部
４，４１ｃ　　時間変動検出部
４ａ　　ＡＤ変換部
４ｂ　　微分部
４ｃ，２２　　周波数換算部
５，４１ｂ　　制御部
６　　基準発振器
２０，４０　　受信装置
２１　　受信部
２３，４２　　信号処理部
３０，５０　　従来発振信号
３１，５１　　本願発振信号
４２ａ　　復調部
４２ｂ　　周波数偏差検出部

Claims (10)

  1. 基準発振信号に基づいて発振信号を出力するシンセサイザ部と、
    温度を検出する温度検出部と、
    前記温度検出部の温度検出結果に基づいて前記基準発振信号の周波数の時間変動を検出する時間変動検出部と、
    前記時間変動検出部の検出結果に基づいて前記シンセサイザ部から出力される発振信号の周波数調整を行う制御部と、を備えた
    シンセサイザ。
  2. 基準発振信号に基づいて発振信号を出力するシンセサイザ部と、
    前記シンセサイザ部の出力信号に基づいて前記基準発振信号の周波数の時間変動を検出する時間変動検出部と、
    前記時間変動検出部の検出結果に基づいて前記シンセサイザ部から出力される発振信号の周波数調整を行う制御部と、を備えた
    シンセサイザ。
  3. 前記周波数の時間変動は、周波数の１階時間微分値である
    請求項１又は請求項２のうちいずれか一つに記載のシンセサイザ。
  4. 前記周波数の時間変動は、周波数の２階時間微分値である
    請求項１又は請求項２のうちいずれか一つに記載のシンセサイザ。
  5. 受信信号を周波数変換する周波数変換器と、
    基準発振信号を出力する基準発振器と、
    前記基準発振器から出力された基準発振信号に基づいて発振信号を前記周波数変換器に供給するシンセサイザ部と、
    温度を検出する温度検出部と、
    前記温度検出部の温度検出結果に基づいて前記基準発振信号の周波数の時間変動を検出する時間変動検出部と、
    前記時間変動検出部の検出結果に基づいて前記シンセサイザ部から出力される発振信号の周波数調整を行う制御部と、を備えた
    受信装置。
  6. 受信信号を周波数変換する周波数変換器と、
    基準発振信号を出力する基準発振器と、
    前記基準発振器から出力された基準発振信号に基づいて発振信号を前記周波数変換器に供給するシンセサイザ部と、
    前記周波数変換器の出力信号に基づいて前記基準発振信号の周波数の時間変動を検出する時間変動検出部と、
    前記時間変動検出部の検出結果に基づいて前記シンセサイザ部から出力される発振信号の周波数調整を行う制御部と、を備えた
    受信装置。
  7. 前記時間変動検出部は、前記周波数変換器の出力信号に含まれる基準シンボルに基づいて前記基準発振信号の周波数の時間変動を検出する
    請求項６に記載の受信装置。
  8. 前記時間変動検出部は、前記周波数変換器の出力信号に含まれるガードインターバル信号に基づいて前記基準発振信号の周波数の時間変動を検出する
    請求項６に記載の受信装置。
  9. 前記基準発振器はＭＥＭＳ振動子を備えた
    請求項５又は請求項６のうちいずれか一つに記載の受信装置。
  10. 請求項５又は請求項６のうちいずれか一つに記載の受信装置と、
    前記周波数変換器の出力側に接続された信号処理部と、
    前記信号処理部の出力側に接続された表示部と、を備えた
    電子機器。
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