TWI689913B - 顯示裝置 - Google Patents

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Abstract

一種顯示裝置包括：一驅動電路及一控制電路。該驅動電路用以相應於一掃描訊號接收一資料電壓，並用以根據該資料電壓控制一發光元件進行發光的亮度。該控制電路用以根據一數位訊號及該掃描訊號，提供一停止訊號至該驅動電路，以令該發光元件停止發光，以控制該發光元件進行發光的時間長度。

Description

顯示裝置
本發明涉及一種電子裝置。具體而言，本發明涉及一種顯示裝置。
隨著電子科技的快速進展，顯示裝置已被廣泛地應用在人們的生活當中，諸如行動電話或電腦等。
一般而言，顯示裝置可包括閘極驅動電路、源極驅動電路、與像素電路陣列。閘極驅動電路可依序提供複數筆掃描訊號至像素電路，以逐列開啟像素電路的開關電晶體。源極驅動電路可提供複數筆資料訊號至開關電晶體開啟的像素電路，以使像素電路根據資料訊號進行顯示操作。
本發明一實施態樣涉及一種顯示裝置。根據本發明一實施例，顯示裝置包括：一驅動電路及一控制電路。該驅動電路用以相應於一掃描訊號接收一資料電壓，並用 以根據該資料電壓控制一發光元件進行發光的亮度。該控制電路用以根據一數位訊號及該掃描訊號，提供一停止訊號至該驅動電路，以令該發光元件停止發光，以控制該發光元件進行發光的時間長度。
本發明另一實施態樣涉及一種顯示裝置。根據本發明一實施例，顯示裝置包括：一發光元件；一驅動元件，電性連接該發光元件的一陽極端或一陰極端；一資料開關，電性連接一資料輸入端與該驅動元件的一控制端之間；一停止開關，電性連接於一重置輸入端與該驅動元件的該控制端之間；一計數電路，該計數電路的一或多輸入端電性連接一或多數位訊號輸入端；以及一輸出電路，該輸出電路的一或多輸入端電性連接該計數電路的一或多輸出端，該輸出電路的一輸出端電性連接該停止開關的一控制端。
藉由應用上述一實施例，控制電路即可控制發光元件進行發光的時間長度。如此一來，顯示裝置可進行更精準的發光調控。
100:顯示裝置
102:像素陣列
106:像素電路
110:閘極驅動電路
120:源極驅動電路
G(1)-G(N)、G(n):掃描訊號
D(1)-D(M):資料訊號
DRV:驅動電路
CTL:控制電路
VDATA:資料電壓
VOFF:停止訊號
DIGI:數位訊號
CLK:時脈訊號
RST:重置訊號
T1-T2:開關
LT:發光元件
DVC:驅動元件
CST:電容
VSS、VDD:供應電壓
CNT:計數電路
OPT:輸出電路
STC:設置電路
Q1-Q4:計數訊號
VDG1-VDG4:位元訊號
TFF1-TFF4:正反器
PGC1-PGC4:脈波產生電路
T11-T14、T21-T24、T31-T34、TCK:開關
D1-D4:期間
為讓本發明之上述和其他目的、特徵、優點與實施例能更明顯易懂，所附圖式之說明如下：第1圖為根據本發明一實施例所繪示的顯示裝置的示意圖； 第2圖為根據本發明一實施例所繪示的控制電路及驅動電路的示意圖；第3圖為根據本發明一實施例所繪示的驅動電路的示意圖；第4圖為根據本發明一實施例所繪示的控制電路的示意圖；第5圖為根據本發明一操作例所繪示的控制電路的訊號圖；及第6圖為根據本發明一實施例所繪示的源極驅動電路的示意圖；第7圖為根據本發明另一實施例所繪示的控制電路及驅動電路的示意圖；及第8圖為根據本發明另一實施例所繪示的驅動電路的示意圖。
以下將以圖式及詳細敘述清楚說明本揭示內容之精神，任何所屬技術領域中具有通常知識者在瞭解本揭示內容之實施例後，當可由本揭示內容所教示之技術，加以改變及修飾，其並不脫離本揭示內容之精神與範圍。
關於本文中所使用之『第一』、『第二』、...等，並非特別指稱次序或順位的意思，亦非用以限定本發明，其僅為了區別以相同技術用語描述的元件或操作。
關於本文中所使用之『電性連接』，可指二或多個元件相互直接作實體或電性接觸，或是相互間接作實 體或電性接觸，而『電性連接』還可指二或多個元件相互操作或動作。
關於本文中所使用之『包含』、『包括』、『具有』、『含有』等等，均為開放性的用語，即意指包含但不限於。
關於本文中所使用之『及/或』，係包括所述事物的任一或全部組合。
關於本文中所使用之用語『大致』、『約』等，係用以修飾任何可些微變化的數量或誤差，但這種些微變化或誤差並不會改變其本質。
關於本文中所使用之用詞(terms)，除有特別註明外，通常具有每個用詞使用在此領域中、在此揭露之內容中與特殊內容中的平常意義。某些用以描述本揭露之用詞將於下或在此說明書的別處討論，以提供本領域技術人員在有關本揭露之描述上額外的引導。
第1圖為根據本發明實施例所繪示的顯示裝置100的示意圖。顯示裝置100可包括閘極驅動電路110、源極驅動電路120、以及像素陣列102。像素陣列102可包括複數個以矩陣排列的像素電路106。閘極驅動電路110可依序產生並提供複數筆掃描訊號G(1)、…、G(N)給像素陣列102中的像素電路106，以導通像素電路106的資料開關(如第3圖中的開關T1)，其中N為自然數。在一實施例中，掃描訊號G(1)、…、G(N)逐筆延遲一倍列時間(line time)(如第5圖中期間D1的時間長度)。源極驅動電路120 可產生複數筆資料訊號D(1)、…、D(M)，並透過複數條資料線提供此些資料訊號D(1)、…、D(M)給資料開關導通的像素電路106，以使此些像素電路106根據資料訊號D(1)、…、D(M)進行發光操作或顯示操作，其中M為自然數。
參照第2圖，在本案一實施例中，像素電路106包括控制電路CTL及驅動電路DRV。在一實施例中，資料訊號D(1)、…、D(M)的一者包含資料電壓VDATA與數位訊號DIGI，但本案不以此為限。
在一實施例中，驅動電路DRV用以相應於掃描訊號G(n)接收資料電壓VDATA，並用以根據資料電壓VDATA控制一發光元件(如第3圖中的發光元件LT)進行發光的亮度，其中掃描訊號G(n)為前述掃描訊號G(1)、…、G(N)中的一者。在一實施例中，控制電路CTL用以根據數位訊號DIGI及掃描訊號G(n)，提供停止訊號VOFF至驅動電路DRV，以令上述發光元件停止發光，以控制此一發光元件進行發光的時間長度。在一實施例中，控制電路CTL是根據數位訊號DIGI及掃描訊號G(n)，決定停止訊號VOFF提供至驅動電路DRV的時間。
藉由上述操作，驅動電路DRV可分別依據資料電壓VDATA及停止訊號VOFF，進行發光元件發光亮度及發光期間的控制，而可使發光調控更為精準。
在一些應用中，在前述發光元件為次毫米發光二極體(mini LED)的情況下，由於其在導通時的電流-電 壓曲線(IV curve)之斜率大，微幅的電壓變化會導致大幅電流變化，因而不易藉由控制發光二極體的電壓或電流，來對發光元件進行調光。
在本案一實施例中，藉由利用停止訊號VOFF控制前述發光元件進行發光的時間長度，即可有效地對發光元件進行調光。
例如，若在特定跨壓時，發光元件的亮度為每秒1200nit，顯示裝置100可控制發光元件在每一幀(frame)中一半的時間發光，並在另一半的時間不發光，以使人眼感知到的亮度大致為每秒600nit。
在一實施例中，控制電路CTL可根據時脈訊號CLK進行計數，以決定停止訊號VOFF提供至驅動電路DRV的時間。在一實施例中，控制電路CTL可根據數位訊號DIGI決定計數初始值，以決定停止訊號VOFF提供至驅動電路DRV的時間。
例如，控制電路CTL可根據接收並暫存的數位訊號DIGI決定計數初始值為9，並根據計數初始值及時脈訊號CLK進行計數。在時脈訊號CLK的每一週期中計數值增加2。當計數值為31時，控制電路CTL可輸出停止訊號VOFF至驅動電路DRV。
在一實施例中，控制電路CTL可根據對應的掃描訊號G(n)開始進行計數，以決定停止訊號VOFF提供至驅動電路DRV的時間。在一實施例中，控制電路CTL可根據對應的掃描訊號G(n)暫存數位訊號DIGI，並根據 暫存的數位訊號DIGI進行計數，以決定停止訊號VOFF提供至該驅動電路的時間。
例如，控制電路CTL可在接收到對應的掃描訊號G(n)時暫存數位訊號DIGI，並在對應的掃描訊號G(n)結束後開始根據暫存的數位訊號DIGI進行計數。
在一實施例中，控制電路CTL可根據時脈訊號CLK的週期，決定輸出停止訊號VOFF的時間。在一實施例中，時脈訊號CLK的週期可為2倍列時間，但本案不以此為限。在一實施例中，控制電路CTL的時脈訊號CLK可和閘極驅動電路110中用以產生掃描訊號G(1)、…、G(N)的時脈訊號CLK相同，但本案不以此為限。
在一實施例中，控制電路CTL亦可根據重置訊號RST，輸出停止訊號VOFF，以進行重置操作。
在本案一實施例中，控制電路CTL及驅動電路DRV可應用於顯示裝置100的背光模組中，但不以此為限。在不同實施例中，控制電路CTL及驅動電路DRV亦可應用於主動發光的顯示裝置中，如主動矩陣有機發光二極體(AMOLED)顯示裝置中。
參照第3圖，在本案一實施例中，驅動電路DRV可包括開關T1、T2、驅動元件DVC、電容CST、及發光元件LT。
在一實施例中，發光元件LT的陽極端電性連接驅動元件DVC的第一端，且發光元件LT的陰極端用以接收供應電壓VSS。驅動元件DVC的第二端用以接收供 應電壓VDD。開關T1(於本案中又稱資料開關)電性連接於用以接收資料電壓VDATA的資料輸入端與驅動元件DVC的控制端之間，且開關T1的控制端電性連接用以接收掃描訊號G(n)的掃描訊號輸入端。開關T2(於本案中又稱停止開關)電性連接於用以接收供應電壓VSS的重置輸入端與驅動元件DVC的控制端之間，且開關T2的控制端電性連接用以接收停止訊號VOFF的停止訊號輸入端。電容Cst電性連接於驅動元件DVC的第一端與控制端之間。
在本實施例中，開關T1用以相應於掃描訊號G(n)導通，以提供資料電壓VDATA至驅動元件DVC的控制端，以令驅動元件DVC根據資料電壓VDATA驅動發光元件LT進行發光。在本實施例中，開關T2用以相應於停止訊號VOFF導通，以提供供應電壓VSS至驅動元件DVC的控制端，以令驅動元件DVC停止驅動發光元件LT。
應注意到，在不同實施例中，驅動電路DRV可具有不同架構，本案不以上述實施例為限。舉例而言，參照第8圖，在變化的實施例中，驅動電路DRV可改為以發光元件LT陰極端電性連接驅動元件DVC，並以陽極端接收供應電壓VDD。其餘細節可參照上述段落，在此不贅述。
參照第4圖，以下段落將以數位訊號DIGI具有4個位元訊號VDG1-VDG4為例進行說明，但本案不以此為限。在本實施例中，控制電路CTL可根據位元訊號VDG1-VDG4，決定停止訊號VOFF提供至驅動電路DRV 的時間。
在一實施例中，控制電路CTL包括計數電路CNT、輸出電路OPT、及設置電路STC。在一些實施例中，設置電路STC可隨實際需求省略或置換。
在一實施例中，計數電路CNT用以暫存數位訊號DIGI，並根據數位訊號DIGI產生計數訊號Q1-Q4(相應於前述計數值)，並進行計數。在一實施例中，計數電路CNT可受時脈訊號CLK觸發，以進行計數。
在一實施例中，輸出電路OPT用以根據計數訊號Q1-Q4決定是否產生停止訊號VOFF。例如，在計數訊號Q1-Q4皆為「1」時，輸出電路OPT產生停止訊號VOFF，然本案不以此為限，其它形式的設置亦在本案範圍之中。
此外，輸出電路OPT亦用以根據計數訊號Q1-Q4決定是否阻止計數電路CNT進行計數。例如，在計數訊號Q1-Q4皆為「1」時，輸出電路OPT可阻止計數電路CNT接收時脈訊號CLK，然本案不以此為限，其它形式的設置亦在本案範圍之中。
在一實施例中，設置電路STC用以根據掃描訊號G(n)提供數位訊號DIGI的複數位元至計數電路CNT。亦即，設置電路STC用以根據掃描訊號G(n)提供位元訊號VDG1-VDG4至計數電路CNT，以令計數電路CNT暫存位元訊號VDG1-VDG4，並根據位元訊號VDG1-VDG4進行計數，以產生計數訊號Q1-Q4。
在一實施例中，設置電路STC亦用以根據掃描訊號G(n)，提供去能訊號至計數電路CNT，以阻止計數電路CNT進行計數。在一實施例中，去能訊號例如是提供至計數電路CNT的時脈輸入端，作為空時間訊號。在一實施例中，去能訊號例如可以是供應電壓VSS，但不以此為限。
在一實施例中，設置電路STC亦用以根據停止訊號VOFF提供去能訊號至計數電路CNT，以阻止計數電路CNT進行計數。在一實施例中，去能訊號例如是提供至計數電路CNT的時脈輸入端，作為空時間訊號。在一實施例中，去能訊號例如可以是供應電壓VSS，但不以此為限。
在一實施例中，計數電路CNT包括複數正反器TFF1-TFF4及複數脈波產生電路PGC1-PGC4。在一實施例中，正反器TFF1-TFF4與脈波產生電路PGC1-PGC4彼此交錯地電性串聯連接。
例如，脈波產生電路PGC1的輸入端用以接收時脈訊號CLK，輸出端電性連接正反器TFF1的時脈輸入端。脈波產生電路PGC2的輸入端電性連接正反器TFF1的Q’輸出端(又稱Q bar輸出端)，且脈波產生電路PGC2的輸出端電性連接正反器TFF2的時脈輸入端。脈波產生電路PGC3的輸入端電性連接正反器TFF2的Q’輸出端，且脈波產生電路PGC3的輸出端電性連接正反器TFF3的時脈輸入端。脈波產生電路PGC4的輸入端電性連接正 反器TFF3的Q’輸出端，且脈波產生電路PGC4的輸出端電性連接正反器TFF4的時脈輸入端。
在一實施例中，正反器TFF1-TFF4可用T型正反器(toggle flip flop)實現，但不以此為限。在一實施例中，正反器TFF1-TFF4的T輸入端接收供應電壓VDD，正反器TFF1-TFF4的設置端(即set端)用以分別接收位元訊號VDG1-VDG4，且正反器TFF1-TFF4的Q輸出端用以分別輸出計數訊號Q1-Q4至輸出電路OPT。亦即，輸出電路OPT所接收的計數訊號Q1-Q4中包括正反器TFF1-TFF4分別產生的輸出訊號。
在一實施例中，脈波產生電路PGC1-PGC4用以根據時脈訊號CLK及正反器TFF1-TFF3的Q’輸出的上升緣產生脈衝訊號，並分別提供此些脈衝訊號給正反器TFF1-TFF4。在一實施例中，脈波產生電路PGC1-PGC4中的每一者皆包括2個反閘(NOT gate)及一個反及閘(NAND gate)，但本案不以此為限。
在一實施例中，輸出電路OPT可包括彼此串接的一反及閘及一個反閘，但本案不以此為限。在本實施例中，輸出電路OPT的反及閘的輸入端分別用以接收計數訊號Q1-Q4。在計數訊號Q1-Q4皆為「1」的情況下，反及閘輸出「0」至反閘，以令反閘輸出「1」，此即為停止訊號VOFF。
另一方面，控制電路CTL更包括開關TCK，且開關TCK的一端用以接收時脈訊號CLK，另一端用以 電性連接脈波產生電路PGC1的輸入端。在計數訊號Q1-Q4皆為「1」的情況下，反及閘輸出「0」至開關TCK的控制端，以令開關TCK關斷，以阻止計數電路CNT接收時脈訊號CLK。
在一實施例中，設置電路STC包括開關T11-T14(在本案中又稱第一開關)、開關T21-T24(在本案中又稱第二開關)、及開關T31-T34(在本案中又稱第三開關)。在一實施例中，開關T11-T14電性連接於用以分別接收位元訊號VDG1-VDG4的位元訊號輸入端及正反器TFF1-TFF4的設置端之間，且開關T11-T14的控制端用以接收掃描訊號G(n)。在一實施例中，開關T11-T14用以分別根據掃描訊號G(n)導通，以分別提供位元訊號VDG1-VDG4至正反器TFF1-TFF4。
在一實施例中，開關T21-T24電性連接於用以分別接收去能訊號(如供應電壓VSS)的去能訊號輸入端及正反器TFF1-TFF4的時脈輸入端之間，且開關T21-T24的控制端用以接收掃描訊號G(n)。在一實施例中，開關T21-T24用以分別根據掃描訊號G(n)導通，以分別提供去能訊號(如供應電壓VSS)至正反器TFF1-TFF4的時脈輸入端，作為空時脈訊號。
在一實施例中，開關T31-T34電性連接於用以分別接收去能訊號(如供應電壓VSS)的去能訊號輸入端及正反器TFF1-TFF4的時脈輸入端之間，且開關T31-T34的控制端用以接收停止訊號VOFF。在一實施例中，開關 T31-T34用以分別根據停止訊號VOFF導通，以分別提供去能訊號(如供應電壓VSS)至正反器TFF1-TFF4的時脈輸入端，作為空時脈訊號。
在以下段落中，將同時搭配第4、5圖，以一操作例具體說明本案細節，然本案並不以下述操作例為限。
在本操作例中，以位元訊號VDG1-VDG4分別依序為「0」、「1」、「0」、「1」為例進行描述，但本案不以此為限。
在期間D1中，開關T11-T14分別根據掃描訊號G(n)導通，以分別提供位元訊號VDG1-VDG4至正反器TFF1-TFF4。開關T21-T24分別根據掃描訊號G(n)導通，以分別提供空時脈訊號至正反器TFF1-TFF4。
此時，正反器TFF1-TFF4的Q輸出端所輸出的計數訊號Q1-Q4分別依序為「1」、「0」、「1」、「0」(相應於前述計數初始值)。亦即，若將計數訊號Q4-Q1的對應數值「0101」由二進位轉換為十進位，可得到數值5。
此時，輸出電路OPT根據計數訊號Q1-Q4而不輸出停止訊號VOFF，且導通開關TCK，以令時脈訊號CLK可提供至計數電路CNT。
在期間D2中，掃描訊號G(n)結束，開關T11-T14及開關T21-T24關斷。此時，計數訊號Q1-Q4分別依序保持為「1」、「0」、「1」、「0」。
在期間D3中，正反器TFF1-TFF4受時脈訊號CLK所觸發，以使計數訊號Q1、Q2轉態。此時，計數 訊號Q1-Q4分別依序為「0」、「1」、「1」、「0」。亦即，若將計數訊號Q4-Q1的對應數值「0110」由二進位轉換為十進位，可得到數值6。
在期間D4中，正反器TFF1-TFF4受時脈訊號CLK所觸發，以使計數訊號Q1轉態。此時，計數訊號Q1-Q4分別依序為「1」、「1」、「1」、「0」。亦即，若將計數訊號Q4-Q1的對應數值「0111」由二進位轉換為十進位，可得到數值7。
以此類推，計數訊號Q4-Q1的對應數值會不斷向上計數，直到計數訊號Q4-Q1的對應數值「1111」。
此時，輸出電路OPT根據計數訊號Q1-Q4而輸出停止訊號VOFF，以使驅動電路DRV停止驅動發光元件LT發光。開關T31-T34分別根據停止訊號VOFF導通，以分別提供空時脈訊號至正反器TFF1-TFF4。開關TCK相應於停止訊號VOFF關斷，以阻止時脈訊號CLK提供至計數電路CNT。
藉由上述的操作，在時脈訊號CLK的週期為2倍列時間的情況下，控制電路CTL即可控制驅動電路DRV在一幀中發光21倍的列時間。類似地，若位元訊號VDG1-VDG4分別依序為「1」、「1」、「0」、「1」，控制電路CTL即可控制驅動電路DRV在一幀中發光23倍的列時間。
在一實施例中，位元訊號VDG1-VDG4與發光的列時間倍數的對應關係可如下表所示，但本案不以此 為限。
Figure 107147026-A0305-02-0017-1
應注意到，雖然在本案上述實施例中，是以4位元的數位訊號DIGI為例進行說明，但數位訊號DIGI的位元數可依實際需求改變，如改為1、2、3、5個、或更多，且控制電路CTL中的正反器、脈波產生電路、第一開關、第二開關、第三開關的數量、及輸出電路OPT中反及 閘的設置也會對應改變，故本案不以上述實施例為限。
參照第6圖，在本案一實施例中，源極驅動電路120可用以提供前述數位訊號DIGI。舉例而言，源極驅動電路120可利用電性連接於資料閂鎖器(data latch)與數位類比轉換器(DAC)之間的位準移位器(level shifter)提供前述數位訊號DIGI。在其它實施例中，源極驅動電路120也可利用移位暫存器(shift register)、用以接收灰階資料的輸入暫存器(input register)、或前述資料閂鎖器(data latch)等數位電路，提供前述數位訊號DIGI，然本案不以此為限。
參照第7圖，在本案一實施例中，控制電路CTL可設置在像素電路106之外。例如，控制電路CTL可設置在源極驅動電路120中或顯示裝置100的其它位置。在此一實施例中，像素電路106是包括驅動電路DRV而不包括控制電路CTL(相對於對應第2圖的實施例)。此外，在此些實施例中，資料訊號D(1)、…、D(M)的一者可包含資料電壓VDATA與停止訊號，而不包含數位訊號DIGI(相對於對應第2圖的實施例)。
雖然本發明已以實施例揭露如上，然其並非用以限定本發明，任何熟習此技藝者，在不脫離本發明之精神和範圍內，當可作各種之更動與潤飾，因此本發明之保護範圍當視後附之申請專利範圍所界定者為準。
106‧‧‧像素電路
G(n)‧‧‧掃描訊號
DRV‧‧‧驅動電路
CTL‧‧‧控制電路
VDATA‧‧‧資料電壓
VOFF‧‧‧停止訊號
DIGI‧‧‧數位訊號
CLK‧‧‧時脈訊號
RST‧‧‧重置訊號

Claims (19)

  1. 一種顯示裝置，包括：一驅動電路，用以相應於一掃描訊號接收一資料電壓，並用以根據該資料電壓控制一發光元件進行發光的亮度；以及一控制電路，用以根據一數位訊號及該掃描訊號，提供一停止訊號至該驅動電路，以令該發光元件停止發光，以控制該發光元件進行發光的時間長度，其中該控制電路根據一時脈訊號進行計數，以決定該停止訊號提供至該驅動電路的時間。
  2. 如請求項1所述之顯示裝置，其中該控制電路根據該數位訊號及該掃描訊號決定該停止訊號提供至該驅動電路的時間。
  3. 如請求項1所述之顯示裝置，其中該控制電路根據該掃描訊號開始進行計數，以決定該停止訊號提供至該驅動電路的時間。
  4. 如請求項1所述之顯示裝置，其中該控制電路根據該數位訊號決定一計數初始值，以決定該停止訊號提供至該驅動電路的時間。
  5. 如請求項1所述之顯示裝置，其中該控制電路根據該掃描訊號暫存該數位訊號，並根據暫存的該數位訊號進行計數，以決定該停止訊號提供至該驅動電路的時間。
  6. 如請求項1所述之顯示裝置，其中該控制電路包括：一計數電路，用以暫存該數位訊號，並根據該數位訊號進行計數，以產生一計數訊號；及一輸出電路，用以根據該計數訊號決定是否產生該停止訊號。
  7. 如請求項6所述之顯示裝置，其中該計數電路包括：複數正反器；及複數脈波產生電路，該些脈波產生電路與該些正反器彼此交錯地電性串聯連接。
  8. 如請求項7所述之顯示裝置，其中該輸出電路所接收的該計數訊號中包括該些正反器分別產生的一輸出訊號。
  9. 如請求項7所述之顯示裝置，其中該控制電路更用以根據該掃描訊號，提供一去能訊號至該些正反器。
  10. 如請求項7所述之顯示裝置，其中該控制電路更用以根據該停止訊號，提供一去能訊號至該些正反器。
  11. 如請求項7所述之顯示裝置，其中該控制電路更包括：一設置電路，用以根據該掃描訊號提供該數位訊號的複數位元至該些正反器。
  12. 如請求項11所述之顯示裝置，其中該設置電路包括：複數第一開關，該些第一開關中的每一者的一第一端電性連接該些正反器，該些第一開關中的每一者的一第二端分別用以接收該數位訊號的複數位元中的一者，且該些第一開關中的每一者的一控制端用以接收該掃描訊號。
  13. 如請求項11所述之顯示裝置，其中該設置電路包括： 複數第二開關，該些第二開關中的每一者的一第一端電性連接該些正反器，該些第二開關中的每一者的一第二端用以接收一去能訊號，且該些第二開關中的每一者的一控制端用以接收該掃描訊號。
  14. 如請求項11所述之顯示裝置，其中該設置電路包括：複數第三開關，該些第三開關中的每一者的一第一端電性連接該些正反器，該些第三開關中的每一者的一第二端用以接收該停止訊號，且該些第三開關中的每一者的一控制端用以接收該掃描訊號。
  15. 如請求項6所述之顯示裝置，其中該輸出電路更用以相應於該計數訊號決定是否阻止該計數電路接收一時脈訊號。
  16. 一種顯示裝置，包括：一發光元件；一驅動元件，電性連接該發光元件的一陽極端或一陰極端；一資料開關，電性連接一資料輸入端與該驅動元件的一控制端之間；一停止開關，電性連接於一重置輸入端與該驅動元件的該控制端之間； 一計數電路，該計數電路的一或多輸入端電性連接一或多數位訊號輸入端；以及一輸出電路，該輸出電路的一或多輸入端電性連接該計數電路的一或多輸出端，該輸出電路的一輸出端電性連接該停止開關的一控制端，其中該計數電路根據一時脈訊號進行計數，以決定該輸出電路提供一停止訊號至該驅動元件的時間。
  17. 如請求項16所述之顯示裝置，更包括：至少一第一開關，其中該至少一第一開關電性連接於一或多位元訊號輸入端及該計數電路的該一或多輸入端之間，且該至少一第一開關的控制端電性連接一掃描訊號輸入端。
  18. 如請求項16所述之顯示裝置，更包括：至少一第二開關，其中該至少一第二開關電性連接於一去能訊號輸入端及該計數電路的該一或多輸入端之間，且該至少一第二開關的控制端電性連接一掃描訊號輸入端。
  19. 如請求項16所述之顯示裝置，更包括：至少一第三開關，其中該至少一第三開關電性連接於一去能訊號輸入端及該計數電路的該一或多輸入端 之間，且該至少一第三開關的控制端電性連接該輸出電路的一輸出端。
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