CN110349532B - 显示装置 - Google Patents

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Abstract

一种显示装置，包括：一驱动电路及一控制电路。该驱动电路用以相应于一扫描信号接收一数据电压，并用以根据该数据电压控制一发光元件进行发光的亮度。该控制电路用以根据一数字信号及该扫描信号，提供一停止信号至该驱动电路，以令该发光元件停止发光，以控制该发光元件进行发光的时间长度。

Description

显示装置
技术领域
本发明涉及一种电子装置。具体而言，本发明涉及一种显示装置。
背景技术
随着电子科技的快速进展，显示装置已被广泛地应用在人们的生活当中，诸如移动电话或电脑等。
一般而言，显示装置可包括栅极驱动电路、源极驱动电路、与像素电路阵列。栅极驱动电路可依序提供多笔扫描信号至像素电路，以逐列开启像素电路的开关晶体管。源极驱动电路可提供多笔数据信号至开关晶体管开启的像素电路，以使像素电路根据数据信号进行显示操作。
发明内容
本发明一实施方式涉及一种显示装置。根据本发明一实施例，显示装置包括：一驱动电路及一控制电路。该驱动电路用以相应于一扫描信号接收一数据电压，并用以根据该数据电压控制一发光元件进行发光的亮度。该控制电路用以根据一数字信号及该扫描信号，提供一停止信号至该驱动电路，以令该发光元件停止发光，以控制该发光元件进行发光的时间长度。
本发明另一实施方式涉及一种显示装置。根据本发明一实施例，显示装置包括：一发光元件；一驱动元件，电性连接该发光元件的一阳极端或一阴极端；一数据开关，电性连接一数据输入端与该驱动元件的一控制端之间；一停止开关，电性连接于一重置输入端与该驱动元件的该控制端之间；一计数电路，该计数电路的一或多输入端电性连接一或多数字信号输入端；以及一输出电路，该输出电路的一或多输入端电性连接该计数电路的一或多输出端，该输出电路的一输出端电性连接该停止开关的一控制端。
通过应用上述一实施例，控制电路即可控制发光元件进行发光的时间长度。如此一来，显示装置可进行更精准的发光调控。
附图说明
为让本发明的上述和其他目的、特征、优点与实施例能更明显易懂，说明书附图的说明如下：
图1为根据本发明一实施例所示出的显示装置的示意图；
图2为根据本发明一实施例所示出的控制电路及驱动电路的示意图；
图3为根据本发明一实施例所示出的驱动电路的示意图；
图4为根据本发明一实施例所示出的控制电路的示意图；
图5为根据本发明一操作例所示出的控制电路的信号图；及
图6为根据本发明一实施例所示出的源极驱动电路的示意图；及
图7为根据本发明另一实施例所示出的控制电路及驱动电路的示意图；及
图8为根据本发明另一实施例所示出的驱动电路的示意图。
附图标记说明：
100：显示装置
102：像素阵列
106：像素电路
110：栅极驱动电路
120：源极驱动电路
G(1)-G(N)、G(n)：扫描信号
D(1)-D(M)：数据信号
DRV：驱动电路
CTL：控制电路
VDATA：数据电压
VOFF：停止信号
DIGI：数字信号
CLK：时脉信号
RST：重置信号
T1-T2：开关
LT：发光元件
DVC：驱动元件
CST：电容
VSS、VDD：供应电压
CNT：计数电路
OPT：输出电路
STC：设置电路
Q1-Q4：计数信号
VDG1-VDG4：位元信号
TFF1-TFF4：触发器(正反器)
PGC1-PGC4：脉冲产生电路
T11-T14、T21-T24、T31-T34、TCK：开关
D1-D4：期间
具体实施方式
以下将以附图及详细叙述清楚说明本公开内容的构思，任何所属技术领域中技术人员在了解本公开内容的实施例后，当可由本公开内容所教示的技术，加以改变及修饰，其并不脱离本公开内容的构思与范围。
关于本文中所使用的“第一”、“第二”等，并非特别指称次序或顺位的意思，亦非用以限定本发明，其仅为了区别以相同技术用语描述的元件或操作。
关于本文中所使用的“电性连接”，可指二或多个元件相互直接作实体或电性接触，或是相互间接作实体或电性接触，而“电性连接”还可指二或多个元件相互操作或动作。
关于本文中所使用的“包含”、“包括”、“具有”、“含有”等等，均为开放性的用语，即意指包含但不限于。
关于本文中所使用的“及/或”，包括所述事物的任一或全部组合。
关于本文中所使用的用语“大致”、“约”等，是用以修饰任何可些微变化的数量或误差，但这种些微变化或误差并不会改变其本质。
关于本文中所使用的用词(terms)，除有特别注明外，通常具有每个用词使用在此领域中、在此公开的内容中与特殊内容中的平常意义。某些用以描述本公开的用词将于下或在此说明书的别处讨论，以提供本领域技术人员在有关本公开的描述上额外的引导。
图1为根据本发明实施例所示出的显示装置100的示意图。显示装置100可包括栅极驱动电路110、源极驱动电路120、以及像素阵列102。像素阵列102可包括多个以矩阵排列的像素电路106。栅极驱动电路110可依序产生并提供多笔扫描信号G(1)、……、G(N)给像素阵列102中的像素电路106，以导通像素电路106的数据开关(如图3中的开关T1)，其中N为自然数。在一实施例中，扫描信号G(1)、……、G(N)逐笔延迟一倍列时间(line time)(如图5中期间D1的时间长度)。源极驱动电路120可产生多笔数据信号D(1)、……、D(M)，并通过多条数据线提供此些数据信号D(1)、……、D(M)给数据开关导通的像素电路106，以使此些像素电路106根据数据信号D(1)、……、D(M)进行发光操作或显示操作，其中M为自然数。
参照图2，在本公开一实施例中，像素电路106包括控制电路CTL及驱动电路DRV。在一实施例中，数据信号D(1)、……、D(M)的一者包含数据电压VDATA与数字信号DIGI，但本公开不以此为限。
在一实施例中，驱动电路DRV用以相应于扫描信号G(n)接收数据电压VDATA，并用以根据数据电压VDATA控制一发光元件(如图3中的发光元件LT)进行发光的亮度，其中扫描信号G(n)为前述扫描信号G(1)、……、G(N)中的一者。在一实施例中，控制电路CTL用以根据数字信号DIGI及扫描信号G(n)，提供停止信号VOFF至驱动电路DRV，以令上述发光元件停止发光，以控制此一发光元件进行发光的时间长度。在一实施例中，控制电路CTL是根据数字信号DIGI及扫描信号G(n)，决定停止信号VOFF提供至驱动电路DRV的时间。
通过上述操作，驱动电路DRV可分别依据数据电压VDATA及停止信号VOFF，进行发光元件发光亮度及发光期间的控制，而可使发光调控更为精准。
在一些应用中，在前述发光元件为次毫米发光二极管(mini LED)的情况下，由于其在导通时的电流-电压曲线(IV curve)的斜率大，微幅的电压变化会导致大幅电流变化，因而不易通过控制发光二极管的电压或电流，来对发光元件进行调光。
在本公开一实施例中，通过利用停止信号VOFF控制前述发光元件进行发光的时间长度，即可有效地对发光元件进行调光。
例如，若在特定跨压时，发光元件的亮度为每秒1200nit，显示装置100可控制发光元件在每一帧(frame)中一半的时间发光，并在另一半的时间不发光，以使人眼感知到的亮度大致为每秒600nit。
在一实施例中，控制电路CTL可根据时脉信号CLK进行计数，以决定停止信号VOFF提供至驱动电路DRV的时间。在一实施例中，控制电路CTL可根据数字信号DIGI决定计数初始值，以决定停止信号VOFF提供至驱动电路DRV的时间。
例如，控制电路CTL可根据接收并暂存的数字信号DIGI决定计数初始值为9，并根据计数初始值及时脉信号CLK进行计数。在时脉信号CLK的每一周期中计数值增加2。当计数值为31时，控制电路CTL可输出停止信号VOFF至驱动电路DRV。
在一实施例中，控制电路CTL可根据对应的扫描信号G(n)开始进行计数，以决定停止信号VOFF提供至驱动电路DRV的时间。在一实施例中，控制电路CTL可根据对应的扫描信号G(n)暂存数字信号DIGI，并根据暂存的数字信号DIGI进行计数，以决定停止信号VOFF提供至该驱动电路的时间。
例如，控制电路CTL可在接收到对应的扫描信号G(n)时暂存数字信号DIGI，并在对应的扫描信号G(n)结束后开始根据暂存的数字信号DIGI进行计数。
在一实施例中，控制电路CTL可根据时脉信号CLK的周期，决定输出停止信号VOFF的时间。在一实施例中，时脉信号CLK的周期可为2倍列时间，但本公开不以此为限。在一实施例中，控制电路CTL的时脉信号CLK可和栅极驱动电路110中用以产生扫描信号G(1)、……、G(N)的时脉信号CLK相同，但本公开不以此为限。
在一实施例中，控制电路CTL亦可根据重置信号RST，输出停止信号VOFF，以进行重置操作。
在本公开一实施例中，控制电路CTL及驱动电路DRV可应用于显示装置100的背光模块中，但不以此为限。在不同实施例中，控制电路CTL及驱动电路DRV亦可应用于主动发光的显示装置中，如主动矩阵有机发光二极管(AMOLED)显示装置中。
参照图3，在本公开一实施例中，驱动电路DRV可包括开关T1、T2、驱动元件DVC、电容CST、及发光元件LT。
在一实施例中，发光元件LT的阳极端电性连接驱动元件DVC的第一端，且发光元件LT的阴极端用以接收供应电压VSS。驱动元件DVC的第二端用以接收供应电压VDD。开关T1(于本公开中又称数据开关)电性连接于用以接收数据电压VDATA的数据输入端与驱动元件DVC的控制端之间，且开关T1的控制端电性连接用以接收扫描信号G(n)的扫描信号输入端。开关T2(于本公开中又称停止开关)电性连接于用以接收供应电压VSS的重置输入端与驱动元件DVC的控制端之间，且开关T2的控制端电性连接用以接收停止信号VOFF的停止信号输入端。电容Cst电性连接于驱动元件DVC的第一端与控制端之间。
在本实施例中，开关T1用以相应于扫描信号G(n)导通，以提供数据电压VDATA至驱动元件DVC的控制端，以令驱动元件DVC根据数据电压VDATA驱动发光元件LT进行发光。在本实施例中，开关T2用以相应于停止信号VOFF导通，以提供供应电压VSS至驱动元件DVC的控制端，以令驱动元件DVC停止驱动发光元件LT。
应注意到，在不同实施例中，驱动电路DRV可具有不同架构，本公开不以上述实施例为限。举例而言，参照图8，在变化的实施例中，驱动电路DRV可改为以发光元件LT阴极端电性连接驱动元件DVC，并以阳极端接收供应电压VDD。其余细节可参照上述段落，在此不赘述。
参照图4，以下段落将以数字信号DIGI具有4个位元信号VDG1-VDG4为例进行说明，但本公开不以此为限。在本实施例中，控制电路CTL可根据位元信号VDG1-VDG4，决定停止信号VOFF提供至驱动电路DRV的时间。
在一实施例中，控制电路CTL包括计数电路CNT、输出电路OPT、及设置电路STC。在一些实施例中，设置电路STC可随实际需求省略或置换。
在一实施例中，计数电路CNT用以暂存数字信号DIGI，并根据数字信号DIGI产生计数信号Q1-Q4(相应于前述计数值)，并进行计数。在一实施例中，计数电路CNT可受时脉信号CLK触发，以进行计数。
在一实施例中，输出电路OPT用以根据计数信号Q1-Q4决定是否产生停止信号VOFF。例如，在计数信号Q1-Q4皆为“1”时，输出电路OPT产生停止信号VOFF，然本公开不以此为限，其它形式的设置亦在本公开范围之中。
此外，输出电路OPT亦用以根据计数信号Q1-Q4决定是否阻止计数电路CNT进行计数。例如，在计数信号Q1-Q4皆为“1”时，输出电路OPT可阻止计数电路CNT接收时脉信号CLK，然本公开不以此为限，其它形式的设置亦在本公开范围之中。
在一实施例中，设置电路STC用以根据扫描信号G(n)提供数字信号DIGI的多个位元至计数电路CNT。亦即，设置电路STC用以根据扫描信号G(n)提供位元信号VDG1-VDG4至计数电路CNT，以令计数电路CNT暂存位元信号VDG1-VDG4，并根据位元信号VDG1-VDG4进行计数，以产生计数信号Q1-Q4。
在一实施例中，设置电路STC亦用以根据扫描信号G(n)，提供去能信号至计数电路CNT，以阻止计数电路CNT进行计数。在一实施例中，去能信号例如是提供至计数电路CNT的时脉输入端，作为空时间信号。在一实施例中，去能信号例如可以是供应电压VSS，但不以此为限。
在一实施例中，设置电路STC亦用以根据停止信号VOFF提供去能信号至计数电路CNT，以阻止计数电路CNT进行计数。在一实施例中，去能信号例如是提供至计数电路CNT的时脉输入端，作为空时间信号。在一实施例中，去能信号例如可以是供应电压VSS，但不以此为限。
在一实施例中，计数电路CNT包括多个触发器TFF1-TFF4及多个脉冲产生电路PGC1-PGC4。在一实施例中，触发器TFF1-TFF4与脉冲产生电路PGC1-PGC4彼此交错地电性串联连接。
例如，脉冲产生电路PGC1的输入端用以接收时脉信号CLK，输出端电性连接触发器TFF1的时脉输入端。脉冲产生电路PGC2的输入端电性连接触发器TFF1的Q’输出端(又称Qbar输出端)，且脉冲产生电路PGC2的输出端电性连接触发器TFF2的时脉输入端。脉冲产生电路PGC3的输入端电性连接触发器TFF2的Q’输出端，且脉冲产生电路PGC3的输出端电性连接触发器TFF3的时脉输入端。脉冲产生电路PGC4的输入端电性连接触发器TFF3的Q’输出端，且脉冲产生电路PGC4的输出端电性连接触发器TFF4的时脉输入端。
在一实施例中，触发器TFF1-TFF4可用T型触发器(toggle flip flop)实现，但不以此为限。在一实施例中，触发器TFF1-TFF4的T输入端接收供应电压VDD，触发器TFF1-TFF4的设置端(即set端)用以分别接收位元信号VDG1-VDG4，且触发器TFF1-TFF4的Q输出端用以分别输出计数信号Q1-Q4至输出电路OPT。亦即，输出电路OPT所接收的计数信号Q1-Q4中包括触发器TFF1-TFF4分别产生的输出信号。
在一实施例中，脉冲产生电路PGC1-PGC4用以根据时脉信号CLK及触发器TFF1-TFF3的Q’输出的上升缘产生脉冲信号，并分别提供此些脉冲信号给触发器TFF1-TFF4。在一实施例中，脉冲产生电路PGC1-PGC4中的每一者皆包括2个非门(反闸，NOT gate)及一个与非门(反及闸，NAND gate)，但本公开不以此为限。
在一实施例中，输出电路OPT可包括彼此串接的一与非门及一个非门，但本公开不以此为限。在本实施例中，输出电路OPT的与非门的输入端分别用以接收计数信号Q1-Q4。在计数信号Q1-Q4皆为“1”的情况下，与非门输出“0”至非门，以令非门输出“1”，此即为停止信号VOFF。
另一方面，控制电路CTL还包括开关TCK，且开关TCK的一端用以接收时脉信号CLK，另一端用以电性连接脉冲产生电路PGC1的输入端。在计数信号Q1-Q4皆为“1”的情况下，与非门输出“0”至开关TCK的控制端，以令开关TCK关断，以阻止计数电路CNT接收时脉信号CLK。
在一实施例中，设置电路STC包括开关T11-T14(在本公开中又称第一开关)、开关T21-T24(在本公开中又称第二开关)、及开关T31-T34(在本公开中又称第三开关)。在一实施例中，开关T11-T14电性连接于用以分别接收位元信号VDG1-VDG4的位元信号输入端及触发器TFF1-TFF4的设置端之间，且开关T11-T14的控制端用以接收扫描信号G(n)。在一实施例中，开关T11-T14用以分别根据扫描信号G(n)导通，以分别提供位元信号VDG1-VDG4至触发器TFF1-TFF4。
在一实施例中，开关T21-T24电性连接于用以分别接收去能信号(如供应电压VSS)的去能信号输入端及触发器TFF1-TFF4的时脉输入端之间，且开关T21-T24的控制端用以接收扫描信号G(n)。在一实施例中，开关T21-T24用以分别根据扫描信号G(n)导通，以分别提供去能信号(如供应电压VSS)至触发器TFF1-TFF4的时脉输入端，作为空时脉信号。
在一实施例中，开关T31-T34电性连接于用以分别接收去能信号(如供应电压VSS)的去能信号输入端及触发器TFF1-TFF4的时脉输入端之间，且开关T31-T34的控制端用以接收停止信号VOFF。在一实施例中，开关T31-T34用以分别根据停止信号VOFF导通，以分别提供去能信号(如供应电压VSS)至触发器TFF1-TFF4的时脉输入端，作为空时脉信号。
在以下段落中，将同时搭配图4、图5，以一操作例具体说明本公开细节，然本公开并不以下述操作例为限。
在本操作例中，以位元信号VDG1-VDG4分别依序为“0”、“1”、“0”、“1”为例进行描述，但本公开不以此为限。
在期间D1中，开关T11-T14分别根据扫描信号G(n)导通，以分别提供位元信号VDG1-VDG4至触发器TFF1-TFF4。开关T21-T24分别根据扫描信号G(n)导通，以分别提供空时脉信号至触发器TFF1-TFF4。
此时，触发器TFF1-TFF4的Q输出端所输出的计数信号Q1-Q4分别依序为“1”、“0”、“1”、“0”(相应于前述计数初始值)。亦即，若将计数信号Q4-Q1的对应数值“0101”由二进位转换为十进位，可得到数值5。
此时，输出电路OPT根据计数信号Q1-Q4而不输出停止信号VOFF，且导通开关TCK，以令时脉信号CLK可提供至计数电路CNT。
在期间D2中，扫描信号G(n)结束，开关T11-T14及开关T21-T24关断。此时，计数信号Q1-Q4分别依序保持为“1”、“0”、“1”、“0”。
在期间D3中，触发器TFF1-TFF4受时脉信号CLK所触发，以使计数信号Q1、Q2转态。此时，计数信号Q1-Q4分别依序为“0”、“1”、“1”、“0”。亦即，若将计数信号Q4-Q1的对应数值“0110”由二进位转换为十进位，可得到数值6。
在期间D4中，触发器TFF1-TFF4受时脉信号CLK所触发，以使计数信号Q1转态。此时，计数信号Q1-Q4分别依序为“1”、“1”、“1”、“0”。亦即，若将计数信号Q4-Q1的对应数值“0111”由二进位转换为十进位，可得到数值7。
以此类推，计数信号Q4-Q1的对应数值会不断向上计数，直到计数信号Q4-Q1的对应数值“1111”。
此时，输出电路OPT根据计数信号Q1-Q4而输出停止信号VOFF，以使驱动电路DRV停止驱动发光元件LT发光。开关T31-T34分别根据停止信号VOFF导通，以分别提供空时脉信号至触发器TFF1-TFF4。开关TCK相应于停止信号VOFF关断，以阻止时脉信号CLK提供至计数电路CNT。
通过上述的操作，在时脉信号CLK的周期为2倍列时间的情况下，控制电路CTL即可控制驱动电路DRV在一帧中发光21倍的列时间。类似地，若位元信号VDG1-VDG4分别依序为“1”、“1”、“0”、“1”，控制电路CTL即可控制驱动电路DRV在一帧中发光23倍的列时间。
在一实施例中，位元信号VDG1-VDG4与发光的列时间倍数的对应关系可如下表所示，但本公开不以此为限。
Figure BDA0002132691400000101
Figure BDA0002132691400000111
应注意到，虽然在本公开上述实施例中，是以4位元的数字信号DIGI为例进行说明，但数字信号DIGI的位元数可依实际需求改变，如改为1、2、3、5个、或更多，且控制电路CTL中的触发器、脉冲产生电路、第一开关、第二开关、第三开关的数量、及输出电路OPT中与非门的设置也会对应改变，故本公开不以上述实施例为限。
参照图6，在本公开一实施例中，源极驱动电路120可用以提供前述数字信号DIGI。举例而言，源极驱动电路120可利用电性连接于数据闩锁器(data latch)与数字模拟转换器(DAC)之间的位准移位器(level shifter)提供前述数字信号DIGI。在其它实施例中，源极驱动电路120也可利用移位暂存器(shift register)、用以接收灰阶数据的输入暂存器(input register)、或前述数据闩锁器(data latch)等数字电路，提供前述数字信号DIGI，然本公开不以此为限。
参照图7，在本公开一实施例中，控制电路CTL可设置在像素电路106之外。例如，控制电路CTL可设置在源极驱动电路120中或显示装置100的其它位置。在此一实施例中，像素电路106是包括驱动电路DRV而不包括控制电路CTL(相对于对应图2的实施例)。此外，在此些实施例中，数据信号D(1)、……、D(M)的一者可包含数据电压VDATA与停止信号，而不包含数字信号DIGI(相对于对应图2的实施例)。
虽然本发明已以实施例公开如上，然其并非用以限定本发明，任何本领域技术人员，在不脱离本发明的构思和范围内，当可作各种的变动与润饰，因此本发明的保护范围当视权利要求所界定者为准。

Claims (19)

1.一种显示装置，包括：
一驱动电路，用以相应于一扫描信号接收一数据电压，并用以根据该数据电压控制一发光元件进行发光的亮度；以及
一控制电路，用以根据一数字信号及该扫描信号，提供一停止信号至该驱动电路，以令该发光元件停止发光，以控制该发光元件进行发光的时间长度，
其中该控制电路包括：
一计数电路，用以暂存该数字信号，并根据该数字信号进行计数，以产生一计数信号；及
一输出电路，用以根据该计数信号决定是否产生该停止信号。
2.如权利要求1所述的显示装置，其中该控制电路根据该数字信号及该扫描信号决定该停止信号提供至该驱动电路的时间。
3.如权利要求1所述的显示装置，其中该控制电路根据一时脉信号进行计数，以决定该停止信号提供至该驱动电路的时间。
4.如权利要求1所述的显示装置，其中该控制电路根据该扫描信号开始进行计数，以决定该停止信号提供至该驱动电路的时间。
5.如权利要求1所述的显示装置，其中该控制电路根据该数字信号决定一计数初始值，以决定该停止信号提供至该驱动电路的时间。
6.如权利要求1所述的显示装置，其中该控制电路根据该扫描信号暂存该数字信号，并根据暂存的该数字信号进行计数，以决定该停止信号提供至该驱动电路的时间。
7.如权利要求1所述的显示装置，其中该计数电路包括：
多个触发器；及
多个脉冲产生电路，所述多个脉冲产生电路与所述多个触发器彼此交错地电性串联连接。
8.如权利要求7所述的显示装置，其中该输出电路所接收的该计数信号中包括所述多个触发器分别产生的一输出信号。
9.如权利要求7所述的显示装置，其中该控制电路更用以根据该扫描信号，提供一去能信号至所述多个触发器。
10.如权利要求7所述的显示装置，其中该控制电路更用以根据该停止信号，提供一去能信号至所述多个触发器。
11.如权利要求7所述的显示装置，其中该控制电路还包括：
一设置电路，用以根据该扫描信号提供该数字信号的多个位元至所述多个触发器。
12.如权利要求11所述的显示装置，其中该设置电路包括：
多个第一开关，所述多个第一开关中的每一者的一第一端电性连接所述多个触发器，所述多个第一开关中的每一者的一第二端分别用以接收该数字信号的多个位元中的一者，且所述多个第一开关中的每一者的一控制端用以接收该扫描信号。
13.如权利要求11所述的显示装置，其中该设置电路包括：
多个第二开关，所述多个第二开关中的每一者的一第一端电性连接所述多个触发器，所述多个第二开关中的每一者的一第二端用以接收一去能信号，且所述多个第二开关中的每一者的一控制端用以接收该扫描信号。
14.如权利要求11所述的显示装置，其中该设置电路包括：
多个第三开关，所述多个第三开关中的每一者的一第一端电性连接所述多个触发器，所述多个第三开关中的每一者的一第二端用以接收该停止信号，且所述多个第三开关中的每一者的一控制端用以接收该扫描信号。
15.如权利要求1所述的显示装置，其中该输出电路更用以相应于该计数信号决定是否阻止该计数电路接收一时脉信号。
16.一种显示装置，包括：
一发光元件；
一驱动元件，电性连接该发光元件的一阳极端或一阴极端；
一数据开关，电性连接一数据输入端与该驱动元件的一控制端之间；
一停止开关，电性连接于一重置输入端与该驱动元件的该控制端之间；
一计数电路，该计数电路的一或多输入端电性连接一或多数字信号输入端；以及
一输出电路，该输出电路的一或多输入端电性连接该计数电路的一或多输出端，该输出电路的一输出端电性连接该停止开关的一控制端。
17.如权利要求16所述的显示装置，还包括：
至少一第一开关，其中该至少一第一开关电性连接于一或多位元信号输入端及该计数电路的该一或多输入端之间，且该至少一第一开关的控制端电性连接一扫描信号输入端。
18.如权利要求16所述的显示装置，还包括：
至少一第二开关，其中该至少一第二开关电性连接于一去能信号输入端及该计数电路的该一或多输入端之间，且该至少一第二开关的控制端电性连接一扫描信号输入端。
19.如权利要求16所述的显示装置，还包括：
至少一第三开关，其中该至少一第三开关电性连接于一去能信号输入端及该计数电路的该一或多输入端之间，且该至少一第三开关的控制端电性连接该输出电路的一输出端。
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