TWI380593B - Clock generator, spread spectrum clock generator and method for generating spread spectrum clock signals - Google Patents

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TWI380593B
TWI380593B TW097143824A TW97143824A TWI380593B TW I380593 B TWI380593 B TW I380593B TW 097143824 A TW097143824 A TW 097143824A TW 97143824 A TW97143824 A TW 97143824A TW I380593 B TWI380593 B TW I380593B
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    • H03B19/00—Generation of oscillations by non-regenerative frequency multiplication or division of a signal from a separate source
    • H—ELECTRICITY
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    • H03L7/1976—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop using a frequency divider or counter in the loop a time difference being used for locking the loop, the counter counting between numbers which are variable in time or the frequency divider dividing by a factor variable in time, e.g. for obtaining fractional frequency division for fractional frequency division using a phase accumulator for controlling the counter or frequency divider

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  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)

Description

1380593 九、發明說明： 【發明所屬之技術領域】 本發明係關於時脈產生器、展頻時脈產生器以及展 頻時脈信號之產生方法。 【先前技術】 傳統的電磁干擾（electronic magnetic interference; Μ〗）預防措施包括電磁干擾濾、波器、陶鐵磁珠（ferrite φ beads)、控流線圈（ch〇ke)、增加電源層與接電層至電路板 中、金屬遮蔽、特殊塗層、以及射頻襯墊（RF gasket)等等。 然而，電磁干擾之主要來源係為系統時脈，例如來自於 .頻率時脈產生器、晶體振盪器、壓控振盪器以及鎖相迴 路。降低整個系統之電磁干擾的一個有效方法為使用低 電磁干擾展頻時脈（spread spectrum clock)振盪器。使用 低電磁干擾展頻時脈振盪器的優點在於符合規範測試、 上市時程很短（short time-to-market)以及成本降低。 【發明内容】 為了降低系統之電磁干擾，本發明提供了一種時脈 產生器、展頻時脈產生器以及展頻時脈信號之產生方法。 本發明提供了 一種展頻時脈產生器，包括鎖相迴 路，用以根據一第一、第二輸入時脈，產生輸出時脈； 延遲線路，耦接於第一輸入時脈與鎖相迴路之間；以及 調變單元，用以提供調變信號控制延遲線路，藉以調變 第一輸入時脈之相位，使得鎖相迴路所產生之輸出時脈 0758-A32328TWF;MTKI-〇6-183 5 的頻率產生週期性地變化。 本發明另提供了—種展 路，用以根擄-第-、第氏生器’包括鎖相迴 延遲線路，_於第時脈’產—輸出時脈； I 輪入時脈與鎖相迴路之間；調變 接㈣㈣；縮放單元，純 變以及校正單^_縮放單元。^ 报本發明提供了—種展頻時脈信號產生方法’包括提 二調變信號；以及根據調變信號對來自鎖相迴路之第一 t時脈進行調變，使得鎖相迴路所產生之輸出時脈的 頻率產生週期性變化。 本發明提供了一種時脈產生器，包括：鎖相迴路， 用以根據第一輸入時脈以及第二輸入時脈，產生輸出時 脈，以及延遲線路，輕接於第—輸人時脈與鎖相迴路之 間，根據調變信號調變第一輸入時脈之相位，藉以控制 該輸出時脈之頻率。 本發明另提供了一種時脈產生器，包括：鎖相迴路， 用以根據第一輸入時脈以及第二輸入時脈，產生輸出時 脈’調變單元’用以根據具有預設幅度的輸入信號提供 調變信號；.以及延遲線路，用以根據調變信號調變第一 輸入時脈的相位，以使藉由該鎖相迴路產生的輸出時脈 的頻率變化作為輸入信號之預設幅度變化。 本發明提供之時脈產生器、展頻時脈產生器以及展 頻時脈信號之產生方法，通過提供調變信號控制延遲線 路’以調變第一輸入時脈之相位，使得鎖相迴路所產生 〇758-A32328TWF；MTKI-〇6-183 6 1380593 之輸出時脈的頻率產生週期性地變化，可以達到降低系 統的電磁干擾的效杲。 【實施方式】 第1圖係為展頻時脈產生器之一實施例之示意圖。 如第1圖所示，展頻時脈產生器100包括鎖相迴路10、 延遲線路20、調變單元30、縮放單元40以及校正單元 50 ° _ 鎖相迴路10用以根據第一輸入時脈S1以及第二輸 入時脈S2，產生輸出時脈SOUT。舉例而言，鎖相迴路 10可包括頻率相位積測器（phase/frequency detector， FPD)、電荷栗、低通遽波器以及壓控振盪器（voltage controlled oscillator，VC0)。頻率相位偵測器係用以镇測 第一、第二輸入時脈間之相位差，並輸出一充電（pump-up) 信號或一放電（pump-down)信號，以便控制電荷栗。電荷 泵所產生之電壓係藉由低通濾波器進行濾波，並供應至 Φ 壓控振盪器以作為參考電壓。壓控振盪器係根據參考電 壓產生時脈信號。壓控振盪器係可為任何可依據一輸入 參考電壓產生時脈頻率信號之電路。通常環狀振盪器係 為典型的壓控振盪器結構。由於鎖相迴路10之結構皆為 本領域之人所知，其細部内容於此就不再累述。 舉例而言，第一輸入時脈S1係可由一晶體振盪器所 提供，且第二輸入時脈S2係可為一除頻器根據鎖相迴路 10之輸出時脈S0UT所產生。或者是，第一輸入時脈S1 0758-A32328TWF;MTKI-06-183 7 1380593 係可為一除頻器根據鎖相迴路10之輪出時脈s〇ut所產 生，且第二輪入時脈S2係可由一晶體振盪器所提供。 由於第—、第一輸入時脈S1與S2間之相位差會導 致輸出時脈SOUT的頻率產生變化，所以第一、第二輸 入％脈S1與S2間=相位差與輸出時脈s〇UT之頻率間
之關係可表示成/ = 1。因此，本發明係藉由調變第一輸 入時脈S1之相位來產生一展頻時脈信號。換言之，調變 單元30係提供一調變信號MS用以控制耦接於第一輪入 時脈si^鎖相迴路10之間的延遲線路2〇，以便調變第 一輸入時脈S1之相位，使得鎖相迴路1〇所產生之輸出 時脈SOUT的頻率會產生週期性地變化。 舉例而言，延遲線路20係可為數位延遲線路或類t 延遲線路，但不限定於此。再者，縮放單元4〇係可嗖” 於延遲線路20與調變單元3G之間1㈣放調變^ MS，且校正單元50係用以調整縮放單元仙之縮放比。例 第2A圖係為展頻時脈產生器之另一實施例 圖二：2B圖係為第2A圖所示之展頻時脈產生器之波: 不』。如第2A圖所示，展頻時脈產生器2〇〇
圖中所不之展頻時脈產生器刚相似，其差異在於、 迴路U)、延遲線路20、縮放單一^及校正單元/ 於此實施例中，第一輸入時脈S1係由晶體振盤器70月 提供，第-輸人時脈S2係藉由除頻器6()根據鎖 10之輸出時脈SOUT來提供。 A 調變單元30包括三角波產生器32、減法器33、積 〇758-A32328TWF;MTK1-〇6-183 δ 1380593 分器34、縮放單元36以及量化器38。三角波產生器32 係用以產生如第2B圖中所示之三角波信號ST，並藉由 減法器33輸出至積分器34。舉例而言，三角波產生器 32係可為上下數計數器（up-down counter)，但不限定於 此。量化器38係用以根據調變信號MS(即積分後的三角 波信號），產生一個為0或1的數值SQ。舉例而言，當調 變信號MS到達（超出）一臨界值TH時，量化器38所產 生之數值SQ為1，而於調變信號MS未到達（未超出）臨 • 界值TH時，量化器38所產生之數值SQ為0。 縮放單元36用以縮放量化器38所產生之數值SQ 以輸出給減法器33。舉例而言，當量化器38因為調變信 號MS到達臨界值TH而產生為1之數值SQ時，縮放單 元36會縮放數值SQ並將縮放後的數值輸出至減法器 33。因此，減法器33會由積分器34所積分的信號（即調 變信號MS)中減去縮放後的數值，使得調變信號MS被重 置，並因而變為0。如第2B圖中所示，於時間t2、t4 ' • t6、t8(依此類推）時，調變信號MS被來自縮放單元36之 縮放後的數值所重置。再者，當調變信號MS被重置（變 為0)時，量化器38會產生為0之數值SQ，直到調變信 號MS再度達到臨界值TH。因此，如第2B圖所示，來 自三角波產生器32之三角波信號ST會重覆地由0被積 分到臨界值TH，用以作為調變信號MS。減法器33、積 分器34、量化器38以縮放單元36係連接成一迴授路徑， 使得三角波信號ST被積分成第2B圖中所示之調變信號 075 8-A32328TWF;MTKI-06-183 9 1380593 MS。 積分器34所輸出之調變信號MS接著會被縮放單元 40所縮放並且輸出至延遲線路20。延遲線路20係根據 縮放後的調變信號MS”調變第一輸入時脈S1的相位，使 得鎖相迴路10所產生之輸出時脈SOUT的頻率產生週期 性地變化。舉例而言，如第2B中所示，鎖相迴路10所 產生之輸出時脈S1的頻率係以三角波形式於頻率fl與 f2之間變化。 • 當鎖相迴路之一個輸入時脈的相位領先鎖相迴路之 其它輸入時脈時，頻率相位偵測器會輸出充電信號用以 控制電荷泵，以便增加鎖相迴路之輸出時脈的頻率。相 反地，當鎖相迴路之一個輸入時脈的相位落後於鎖相迴 路之其它輸入時脈時，頻率相位偵測器會輸出放電信號 ’用以控制電荷泵，以便降低鎖相迴路之輸出時脈的頻率。 第2C圖係延遲線路之一實施例之示意圖。於此實 施例中，如第2C圖中所示，延遲線路20包括二進位-溫 _ 度碼轉換器（binary to thermal code converter)、複數串聯 連接的反相器、複數耦接至反相器之開關元件、以及複 數電容器，每一電容器係耦接於一對應開關元件與接地 端之間。二進位-溫度碼轉換器係用以將縮放後之調變信 號MS”轉換成一控制（溫度）碼THC，用以切換開關元件， 以改變第一輸入時脈S1的相位。換言之，調變後之第一 輸入時脈與晶體振盪器70所提供之原始第一輸入時脈 S1之間的相位變化係由第2B圖中縮放後之調變信號 O758-A32328TWF;MTKI-06-183 10 MS”所決定。 舉例而言，於初始時所有的開關元件皆會被導通， 且第一、第二輸入時脈S1與S2是相同相位。一旦— 夕個開關疋件被截止，由於被充電之電容器的數目 2 ’第-輸人時脈S1的相位會會突然地超前第二輸入 —“2，故輸出時脈s〇u丁的頻率會因而增加。再者， 的相位差(即第一輸入時脈S1超前第二輸入時脈 將二？差)已經超過第二輸入時脈S2之半個週期’它 出輸入時脈82已經超前第—輸入時脈S1，故輸 出時脈SOUT的頻率會因而下降。 替言’本實施例中之延遲線路2 g中之開關元件 2 後的簡信m MS，，分段地被截止直到所有的 歼=皆被截止或所累積的延遲時間已達到—預設時 =,輸㈣脈S0UT的頻率會隨著愈多開關元件 過第二二增：’直到所累積的相位差於時間u時已經超 S贿S2的半個週期’於時間11後輸出時脈 合= 減少直㈣間t2時所有關關元件皆 樣地’於時間t2時輸出時脈S()UT的頻率 依:：，然後於時間t3時開始降低直到時間-， 有：更體元件的限制’在實務上不可能使用-個具 遲:路。因此’本實施例中當延遲線路 赌出脈S1時，係藉由㈣器60跳 過輸出時脈贿的幾個週期並重置延遲線路20。於此 〇758-A32328TWF;MTKI-06-183 11
丄 J 實施例中，哈 為30之除頻因 /、、式，用以藉由數值 二操作桓彳數對第―輸人⑽S2進行除頻，以及第 旧式，用以藉由數值為2 鴻以及弟 ㈣S2進行 之除頻因數對第二輸入 切換。巧’並且操作模式係藉由調變信號他來 ™時舉'=V38當:r號Ms已經到達(超過)臨界值 以及除頻器60，使得u 到縮放單元36 藉由減法器33 ^大後的數值，並 能以由第ΐΠ MS ’同時除頻器60會被致 钟作模式進入第二择作植 相迴路1〇之輪出時脈SOUT於時間't2時:此，來自鎖 =頻因數所除頻，且輪出時脈s〇UT時會:數值為Μ 跳過（Skipp 的一個週期會被 的-二二預設延遲週期為輪㈣脈_τ = (1Τ)時’輸出時脈3_被 付第-、第二輸入時脈S1與：週期會使 而言，當延遲線路Γ〇Γ 與除頻因數有關。舉例 頻=::::=將;數值為-之除 出時脈卿了的兩個週^因^：：；1^，以便跳過輸 杈正單兀50調整縮放單元4〇之 :ΐ路!。直之4實延遲週期與被跳過的週期二以= 而吕，右真貫的延遲週期比預設的延遲週期短時，= 0758-A32328TWF;MTKI-06-183 12 1380593 單元50會提高縮放單元40之縮放比例。相反地，若真 實的延遲週期比預設的延遲週期長時，校正單元50會降 低縮放單元40之縮放比例。換言之，校正單元50會調 整縮放單元40之縮放比例，使得延遲線路20之真實的 延遲週期與預設的延遲週期匹配於被跳過的週期。 第3A圖係為展頻時脈產生器之另一實施例之示意 圖。第3B圖係為第3A圖所示之展頻時脈產生器之波形 示意圖。如第3A圖所示，展頻時脈產生器300係與第 • 2A圖中所示之展頻時脈產生器200相似，其差異在於延 遲線路20係耦接於鎖相迴路10與除頻器60之間用以調 變第二輸入時脈S2,以及反相器IN1耦接於延遲線路20 與調變單元30之間，且反相器IN2耦接於除頻器60與 調變單元30之間。實施例中相同的結構與動作於此不再 累述。要注意的是，展頻時脈產生器300中鎖相迴路10 的輸出時脈SOUT係如第3B圖中所示，並且會與展頻時 脈產生器200中鎖相迴路10的輸出時脈SOUT相位相反。 ® 第4圖係為展頻時脈信號之產生方法之流程圖。步 驟S410，提供第一、第二輸入時脈至鎖相迴路。舉例而 言，如第2A圖與第3A圖中所示，第一輸入時脈S1係 由晶體振盪器70所提供以及第二輸入時脈S2係由除頻 器60所提供。於第2A圖所示實施例中，除頻器60係具 有第一模式用以藉由數值為30之除頻因數對第二輸入時 脈S2進行除頻，以及第二模式用以藉由數值為29之除 頻因數對第二輸入時脈S2進行除頻。 0758-A32328TWF;MTKI-06-183 13 1380593 步驟S420，於輸入時脈與鎖相迴路之間設置延遲線 路。舉例而言，如第2A圖中所示，延遲線路20係耦接 鎖相迴路10以調變來自晶體振盪器70之第一輸入時脈 S1，或者如第3A圖中所示，延遲線路20係用以調變除 頻器60所提供之第二輸入時脈S2。舉例而言，如第2C 圖中所示，延遲線路20係可包括一二進位-溫度碼轉換 器、複數串聯連接的反相器、複數耦接至反相器之開關 元件以及複數電容器，每一電容器係耦接於一對應開關 • 元件與接地端之間。 步驟S430，產生一調變信號並供應至延遲線路。舉 例而言，調變信號MS係可由調變單元30所產生，並且 供應至延遲線路20。於調變單元30中，三角波產生器 32係用以產生三角波信號ST並供應至積分器34，積分 後的三角波信號係作為調變信號MS。調變信號MS係被 供應至縮放單元40，並且縮放後之調變信號MS”係被供 應至延遲線路20。於某些實施例中，調變信號MS係可 • 直接供應至延遲線路20而不需經過縮放單元40的縮放。 再者，調變信號MS亦會被供應至量化器38，量化 器38根據所接收到的調變信號MS輸出一數值SQ至縮 放單元36以及除頻器60。舉例而言，當調變信號MS到 達一臨界值TH時，量化器38所產生之數值SQ為1，接 著為1之數值SQ會被縮放單元36所縮放並輸出至減法 器33。因此，減法器33會由積分器34所輸出之調變信 號MS中減去縮放後的數值，使得調變信號MS被重置， O758-A32328TWF;MTKI-06-183 14 ^80593 如第2B圖中所示，係於時間t2、t4、t6、 ’調變信號MS皆會被縮放後的數值所 值τΛ —#崎錢·财置嶋g)並且低於臨界 /化^ 38會產生為G之數值SQ直到調變信 1度到達臨界值TH。因此，如第2B圖中所示，來自 生器32之三角波信號ST會再三地由0被積分
並因而變為〇。 t8(依此類推）時 重置。 臨界值JH，用以作為調變信號Ms。換言之，減法器 、，分器34、縮放單元36與量化器38係連接成一迴 授路徑’使得三角波信號ST被積分成第2b圖中所示之 調變信號MS。 步驟S440’藉由延遲線路來根據調變信號調變第一 輸入時脈之相位，使得鎖相迴路之輸出時脈的頻率會產 生週期性地變化。㈣線路2G純據來自縮放單元40 之縮放後的調變信號Ms，，調變第一輸入時脈S1的相位， 但不限定於此。於某些實施例中，延遲線路20亦可以根 據來自積分器34但未經縮放單元40進行縮放的調變信 號MS，對第一輸入時脈S1的相位進行調變。 舉例而言，第2C圖中之二進位-溫度碼轉換器係可 將縮放後之調變信號MS”轉換成一控制（溫度）碼THC， 用以切換開關元件’以改變第一輸入時脈S1之相位。於 初始時’所有的開關元件皆會被導通，並且第一、第二 輸入時脈具有相同的相位。當開關元件之一者或多者被 截止時’由於被充電的電容變少，故第一輸入時脈S1會 〇758.A32328TWF;MTKI-06-183 15 〇«0593 突然地超前第二輸入時脈S2。因此，輸出時脈s〇UT的 =率會因而增加。再者，當所累積的相位差（即第一輸入 時脈S1超前於第二輸入時脈S2的相位差）超過第二輸入 時的半個週期時，它將當作第二輸入時脈s2已經 超則第一輸入時脈S1，故輸出時脈SOUT的頻率會因而
於此實施例中’延遲線路20中之開關元件係根據縮 放後的調變信號MS”分段地被截止直到所有的開關元件 皆被戴止。因此，輸出時脈S〇UT的頻率會隨著愈多的 開關元件被截止而增加，直到所累積的相位差於時間ti 時已經超過第二輸入時脈S2的半個週期’接著於時間tl 之後輸出時脈SOUT的頻率開始減少直到時間t2時所有 的開關元件皆截止。換言之，鎖相迴路1〇之輸出時脈 SOUT的頻率會如同第2B圖與第3B圖中所示的三角 波’在頻率fl與f2之間變化。 、，步驟S450’改變除頻因數以對鎖相迴路之輸出時脈 j行除頻。由於硬體元件的限制，在實務上不可能使用 告個具有$限長度之延遲線路。因此’在本實施例中， 二〉，線路20無法再延遲第一輸入時脈時，係藉由 政'員裔6G跳過輸出時脈s〇ut的幾個週期並重置延遲線 硌20來實現。 舉例而言，者响銳；/ 田為變信號MS已經到達（超過）臨界值 TH時，量化器38合鉍 、 曰輪出為1的數值SQ到縮放單元36 以及除頻器60。因此，卜， 、缩放單元36輸出的縮放後的數值 0758-A323 28TWF;MTKI-〇6-183 會藉由減法考33曹番& 致能以由第一操作模乂二號：作同時除頻器60會被 間t2時來自鎖相迴路】模式。因此，於時 29之除頻因數所除頻 〗广脈S〇)UT會被數值為 會被跳過。 並且輸出時脈SOUT的一個週期 假設延遲線路20、庙
的-個避期（1T)時，輪 叹延、’週期為輸出時脈SOUT 得第―、第二輸人時脈⑽被跳過-個週期會使 步碌S460,若延遲路^時序達到匹配。 週期不匹配時，調整路之真貫延遲週期與預定延遲 遲週期比預設的延遲週期短時，校丄單 玲叔咼縮放單元40之給妨仅正早π 週期比預㈣輯週實的延遲 70 40之縮放比例。 权正早疋50會降低縮放單 關。^的數目係與除頻因數有 脈咖的二個;=:2=_週期為輪*時 %之除頻隨變1=二 。υτ㈣數值為 :::出二_τ的兩個週期叫依此類推頻二 伽中&正早7"50係用以調整縮放單元40之^實 例，使得延遲線路20之真實延遲週期為2丁。化敌比 於本發明中，第一輸入時脈s丨之位 :MS進行調變’使得如第功圖與第則：調變信 出時脈S〇UT之頻率可以（於頻㈣與》之間）週;= 0758-A32328TWF;MTKI-06-183 17 1380593 變化。換言之，展頻時脈產生器200與300可以藉由調 變鎖相迴路10的相位產生展頻時脈信號。再者，當延遲 線路無法再延遲輸入時脈時，本發明會跳過幾個輸入時 脈的週期，所以只需要具有一個既定延遲週期的延遲線 路，因此不需要一個具有無限長度之延遲線路。 雖然本發明已以較佳實施例揭露如上，然其並非用 以限定本發明，任何熟知技藝者，在不脫離本發明之精 神和範圍内，當可作些許更動與潤飾，因此本發明之保 • 護範圍當視後附之申請專利範圍所界定者為準。 【圖式簡單說明】 第1圖係為展頻時脈產生器之一實施例之示意圖。 第2A圖係為展頻時脈產生器之另一實施例之示意 圖。 第2B圖係為第2A圖所示之展頻時脈產生器之波形 示意圖。 • 第2C圖係延遲線路之一實施例之示意圖。 第3A圖係為展頻時脈產生器之另一實施例之示意 圖。 第3B圖係為第3A圖所示之展頻時脈產生器之波形 示意圖。 第4圖係為展頻時脈信號之產生方法之流程圖。 【主要元件符號說明】 10 :鎖相迴路； 20 :延遲線路； 0758-A32328TWF;MTKI-06-183 18 1380593 30 :調變單元； 32 ： 三角波產生器； 33 :減法器； 34 ： 積分器； 38 :量化器； 36、 40 :縮放單元； 50 :校正單元； 60 ： 除頻器； 70 :晶體振盪器； 100、200、300 :展頻時脈產生器 t MS :調變信號； S1 ： 第一輸入時脈； S2 :第二輸入時脈； SOUT :輸出時脈； MS” ：縮放後的調變信號； THC :控制碼； TH :臨界值； ST ： 三角波信號； f 1、f2 :頻率； IN1 、IN2 :反相器。 O758-A32328TWF;MTKI-06-l 83 19

Claims (1)

1-380593 _ 第97143824號之申請專利範圍修正本 101年5月17日修正替換頁 十、申請專利範圍： 1. 一種展頻時脈產生器，包括： 一鎖相迴路，用以根據一第一輸入時脈以及一第二輸 入時脈，產生一輸出時脈； 一延遲線路，耦接於該第一輸入時脈與該鎖相迴路之 間； 一調變單元，用以提供一調變信號以控制該延遲線 路，藉以調變該第一輸入時脈之相位，以使該鎖相迴路所 產生之該輸出時脈的頻率週期性地變化；以及 一除頻器，根據該調變信號對該輸出時脈進行除頻。 2. 如申請專利範圍第1項所述之展頻時脈產生器，更 . 包括：一縮放單元，用以縮放來自該調變單元之該調變信 號，並將縮放後之調變信號輸出至該延遲線路。 3. 如申請專利範圍第1項所述之展頻時脈產生器，更 包括： 一振盪器，用以提供該第一輸入時脈；以及 該除頻器，用以根據來自該鎖相迴路之該輸出時脈， 產生該第二輸入時脈。 4. 如申請專利範圍第1項所述之展頻時脈產生器，更 包括： 該除頻器，用以根據來自該鎖相迴路之該輸出時脈， 產生該第一輸入時脈；以及 一振盪器，用以提供該第二輸入時脈。 5. 如申請專利範圍第2項所述之展頻時脈產生器，更 0758-A32328TWF1 (201202 20) 20 1380593 _： 第97M3824號之申請專利範圍修正本 101年5月17曰修正替換頁 包括：一校正單元，用以調整該縮放單元之一縮放比例。 6. 如申請專利範圍第1項所述之展頻時脈產生器，其 中該調變單元包括： 一三角波產生器，用以產生一三角波信號；以及 一積分器，用以對該三角波信號進行積分，以產生該 調變信號。 7. 如申請專利範圍第6項所述之展頻時脈產生器，其 中該除頻器根據來自該鎖相迴路之該輸出時脈輸出該第一 輸入時脈，其中，該除頻器根據該調變信號並藉由除頻因 數X或Y，對該輸出時脈進行除頻，其中，X與Y皆為整 數，並且X>Y。 8. 如申請專利範圍第7項所述之展頻時脈產生器，其 中，該調變單元更包括一量化器，用以當該調變信號超出 一臨界值時，觸發該除頻器藉由該除頻因數Υ對來自該鎖 相迴路之該輸出時脈進行除頻。 9. 一種展頻時脈產生器，包括： 一鎖相迴路，用以根據一第一輸入時脈以及一第二輸 入時脈，產生一輸出時脈； 一延遲線路，耦接於該第一輸入時脈與該鎖相迴路之 間； 一調變單元，耦接於該延遲線路； 一縮放單元，耦接於該延遲線路與該調變單元之間； 以及 一校正單元，耦接於該縮放單元。 0758-A32328TWF1 (20120220) 21 1580593 _ 苐97143824號之申請專利範圍修正本 ]01年5月17日修正替換頁 10. 如申請專利範圍第9項所述之展頻時脈產生器，其 中，該調變單元包括： 一三角波產生器，用以產生一三角波信號；以及 一積分器，耦接於該三角波產生器與該延遲線路之 間。 11. 如申請專利範圍第10項所述之展頻時脈產生器， 更包括： 一振盪器，用以提供該第一輸入時脈；以及 一除頻器，耦接於該第二輸入時脈以及該鎖相迴路之 該輸出時脈之間。 12. 如申請專利範圍第10項所述之展頻時脈產生器， • 更包括： . 一除頻器，耦接於該第一輸入時脈以及該鎖相迴路之 該輸出時脈之間；以及 一振盪器，用以提供該第二輸入時脈。 13. —種展頻時脈信號之產生方法，包括： 提供一調變信號； 根據該調變信號對來自一鎖相迴路之一第一輸入時 脈之相位進行調變，以使該鎖相迴路所產生之一輸出時脈 的頻率週期性地變化；以及 藉由一除頻器根據該鎖相迴路之該輸出時脈，產生一 第二輸入時脈； 其中，該除頻器根據該調變信號對該輸出時脈進行除 頻0 0758-A32328TWF1 (20120220) 22 第97143824繞之申請專利範園修正本 L】01年〕月17日修正替換頁 14.如申請專利範圍第13項所 〜-- 生方法，並令ϋ〆士 展頻時脈信號之產 兵r，該弟一輸入時脈传蘇 坑·^座 調變信號而被調變。 / θ 延遲線路根據該 15·如申請專利範圍第14項所述 生方法，更肖括.於茲山分 x頻時脈信號之產 匕诒·於猎由該延遲線路調 一 之相位之前，對該調變信號進行縮放。輸入時脈 认如申請專利範園第14項所 生方法，苴申，趄也社袖η 、頻8才脈信號之產 /、中Φζ供該Β周變信號的步驟包括： — 提供一三角波信號；以及 =該二角波信號進行積分，以產生該調變 17.如申請專利範圍第】 丫 生方法，更包括： $ k之展頻〜脈信號之產 提供該第二輸入時脈至 係=該調變信號並藉由除頻因數W對:輸 仃除頻，其令，X與Y皆為整數，並且χ>γ。輸出％脈進 2如申請專鄕_ 17項所述之展頻時师號 方法’更包括：當該調變信 “ς 除頻哭蕻ώ兮mi 力風时’觸發該 進=頻因數Y對來自該鎖相迴路之該輪出時脈 19.一種時脈產生器，包括： 鎖相沿路’用以根據一第一輸入時脈以及 入時脈，產生一輸出時脈； 弟一輸 問，：線I—於該第-輸入時脈與該鎖相迴路之 凋’文彳s#u調變該第一輸入時脈之相位，藉以控 0758-A32328TWFl(20120220) 23 1380593 _ 第97M3824號之申請專利範圍修正本 101年5月17日修正替換頁 制該輸出時脈之頻率；以及 一除頻器，根據該調變信號對該輸出時脈進行除頻。 20. 如申請專利範圍第19項所述之時脈產生器，更包 括： 一振盪器，用以提供該第一輸入時脈；以及 該除頻器，用以根據來自該鎖相迴路之該輸出時脈， 產生該第二輸入時脈。 21. 如申請專利範圍第20項所述之時脈產生器，其 中，根據該調變信號，該除頻器藉由除頻因數X或Y選擇 性地對來自該鎖相迴路之該輸出時脈進行除頻以產生該第 二輸入時脈，其中，X與Y皆為整數，並且Χ>γ。 ' 22.如申請專利範圍第19項所述之時脈產生器，其中 . 該除頻器根據來自該鎖相迴路之該輸出時脈，產生該第一 輸入時脈；以及 一振盪器，用以提供該第二輸入時脈。 23. 如申請專利範圍第22項所述之時脈產生器，其 中，根據該調變信號，該除頻器藉由除頻因數X或Υ選擇 性地對來自該鎖相迴路之該輸出時脈進行除頻，以產生該 第一輸入時脈，其中，X與Υ皆為整數，並且Χ>Υ。 24. —種時脈產生器，包括： 一鎖相迴路，用以根據一第一輸入時脈以及一第二輸 入時脈，產生一輸出時脈； 一調變單元，用以根據具有一預設幅度的一輸入信號 提供一調變信號；以及 0758-A32328TWFl(20120220) 24 1380593 _： 第97143824號之申請專利範圍修正本 101年5月17曰修正替換頁 一延遲線路，用以根據該調變信號調變該第一輸入時 脈的相位，以使藉由該鎖相迴路產生的輸出時脈的一頻率 變化作為該輸入信號之該預設幅度變化。 0758-A32328TWF1(20120220) 25
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