TW531726B - Device circuit of a liquid crystal display device - Google Patents

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Mitsuhisa Nishimura
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Description

531726
【發明所屬技術領域】 本發明係有關於在電腦等之顯示裝置使用之 裝置，尤其係有關於適合於液晶面板之驅動電 :員不 晶顯示裝置之驅動電路。 之液 【習知技術】 _ 近年來，使用比CRT(Cathode Ray Tube)易令意择$ 冋解析度兩全之液晶面板之液晶顯示裝 1 型終端機等之顯示裝置。 电驷或攜帶
圖10係表示驅動該液晶顯示裝置之驅動電路之羽 驅動電路之構造之方塊圖。在圖丨0，丨係顯示影像之白液口曰 ，板’ 1 01係將液晶面板i所顯示之影像資料作為48位曰曰 ^自1個埠經由48位元之匯流排線輸出之控制 态，02-m(m係1以上之整數）係自控制器1〇1所輸出之資料 BUS 1 48產生用以顯示影像之驅動信號後驅動液晶面 源極驅動器（以下稱為SD)。 此外’以下說明表示該SD之個數之m為1 0之情況。 又’在圖ίο，未圖示SD1〇2 —5〜1〇。 圖1〇所示控制器1〇1輸出之資料BUS卜24和讥1〇2—卜1〇
之中，奇數編號之各31)3 —1、3、5、7、9連接。一樣的， ，制器101輸出之時計CLK3及控制信號SP3也和奇數編號之 各 SD3-1、3、5、7、9連接。 ^ 之 而’控制器101輸出之BUS25〜48和SD102-1〜10之中之 數、’爲號之各SD3,2、4、6、8、10連接，一樣的，控制器
531726 五、發明說明（2) 101輪出之時計CLK4及控制信號SP4也和偶數編號之各 SD3-2、4、6、8、10連接。 此外，該資料BUS卜24和資料BUS25〜48各自之24位元 信號之内容係紅（R)、綠（G)、藍（B)之各8位元之信號，利 用這些R、G、B信號實現2 5 6階之彩色顯示。 在這種構造之習知之液晶顯示裝置之驅動電路，奇數 編號之各SD102-1、3、5、7、9各自按照控制信號SP3之時 序閃鎖自控制器101和時計CLK3同步輸出之資料BUS1〜24。 而’偶數編號之各SD1 02-2、4、6、8、1 0各自按照控制信 號SP4之時序閃鎖自控制器1(π和時計CLK4同步輸出之資 BUS25〜48。 ' 接著，各SD102-；l〜1〇輸入指示開始驅動液晶面板丄之 號（圖上未示）時’產生依照各自所閃鎖之 ' 或Μ〜48之驅動信號。這些各〇2-1 ~ 1 〇產生 1驅動信號輸入液晶面板1時，在該.液晶面板！上顯示影 傳送=之=;=之_2 + 10在係影像資料之 將影像資料之傳；、4之頻率有-定之限制。為了 性反轉判定·】至該限制頻率以下1自資料極 之匯流排線分成各。〜4向各別102 — 1〜10傳送影像資料 SDm、3、5 t 〇 分別傳給奇數編號之各 8、1()。 、7、9和偶數編號之各SD102 —2、4、6、
第7頁 531726 五、發明說明（3) 【發明要解決之課題】 •^排推在上述之習知之液晶顯示裝置之驅動電路，匯 斤傳送之資料圆，之各位元值之變化量多時， 有液日日颂不裝置之驅動電路之耗電力變大之問題。 月圍=送該資料麵，之匯流排線因在液晶面板1之 向配線而變長，又因其條數也多而有帶來天線效 ,..^ '因而，該匯流排線傳送之資料BUS 1〜48之各位 匕量多時，因該各位元值變化而放射之電磁干擾 $大，電磁干擾雜訊特性（EMI特性）變差。該放射之 塑之原Ξ雜Γ成為對周邊之電子機器引起誤動作等不良影 精密電子機器之附近或電腦室等使用之液晶 ，，H’在該EMI特性差之情況，成為很大之問題。 it:，為了令該電磁干擾雜訊之放 昂貴對策用元件，液晶顯示裝置之價格變貴而要使用 線引起之雜訊，…法疋否是由匯流排 ’/ίΓ特疋其放射要因之問題。 =，在該資料BUS1〜48之各位元值之變化量多之 ΐ題"流排線間發生串訊，也有成為資料錯誤之原因之 提供想2的…的在於 像貝枓之液晶顯$裝置之 ==衫 送之資料之各位元值之變化量。j降低在K線傳
Η 第8頁
531726 五、發明說明（4) I解決課題之方式】 為了解決上述之課題，如申請專利範圍第1項之發 明，係關於輸出多個傳送資料信號之具有該傳送資料信號 數寬之匯流排線之液晶顯示裝置之驅動電路，具備： 資料極性反轉判定裝置，在該多個傳送資料信號上向 該匯流排線輸出之多個資料信號之中過半數以上在令往該 匯流排線之輸出發生極性變化之情況，輸出表示將該多個 資料信號之極性全部反轉後向該匯流排線輸出之極性反轉 信號； 及極性反轉裝置，按照自該資料極性反轉判定裝置輸 出之該極性反轉信號，將所輸入之該多個資料信號之極性 全部反轉後，作為該多個傳送資料信號輸出。 如申請專利範圍第2項之發明，係關於如申請專利範 圍第1項之發明’其特徵在於在多條匯流排線各自具備該 資料極性反轉判定裝置和該極性反轉裝置。 如申明專利範圍第3項之發明，係關於輸出多個傳送 資料信號之具有該傳送資料信號數寬之匯流排線之液晶顯 示裝置之驅動電路，具備： 第一閂鎖電路，和輸入時計同步的閂鎖多個輪入資料 信號後，作為多個第一資料信號輸出； 極陘反轉電路，在輸入之第一極性反轉信號係既定之 反轉指示位準之情;兄，將該多個第一資料信號之極性全部 反轉後，作為多個第二資料信號輸出； 資料極性反轉判定電路，在該多個輸人資料信號和該
第9頁 531726 五、發明說明（5) 多個第二資料信號之對應之信號之間，極性不同之個數有 該信號數之過半數以上之情況，將第二極性反轉信號作為 該反轉指示位準輸出； 以及第二閂鎖電路，和該輸入時計同步的閂鎖該第二 極性反轉信號後，作為該第一極性反轉信號輸出。 如申請專利範圍第4項之發明，係關於如申請專利範 圍第3項之發明，其特徵在於具備： 第三閂鎖電路，和該輸入時計同步的閂鎖該多個第二 資料信號後，作為該多個傳送資料信號輸出； 及第四閃鎖電路，和該輸入時計同步的閃鎖該第一極 _ 性反轉信號後，作為該第三極性反轉信號輸出。 如申請專利範圍第5項之發明，係關於如申請專利範 圍第4項之發明，其特徵在於在多條匯流排線各自具備該 第一至第四閂鎖電路和該資料極性反轉判定裝置以及該極 性反轉裝置。 如申請專利範圍第4項之發明，係關於如申請專利範 圍第5項之發明，其特徵在於該輸入時計之和該多條匯流 排線之半數對應之該輸入時計與和其他之半數對應之該輸 入時計之相位相差半週期。 【發明之實施例】 以下參照圖面說明本發明之一實施例。 〜 圖1係該實施例之液晶顯示裝置之驅動電路之構造之 、 方塊圖。在圖1，1係顯示影像之液晶面板，2係將液晶面
第10頁 531726 五、發明說明（6) 板1所顯示之影像資料分割成各24個位元之資料 BUS A1 〜24、BUS-B 卜 24、BUS-C 卜 24、BUS-D 卜 24 後向 4 個 埠輸产並控制該影像之顯示之控制器，3 —1〇(111係1以上之整 數）係自控制器2所輪出之資料BUS —M〜24、Ms —B卜24、 BUS C卜24、BUS-D1〜24產生用以顯示影像之驅動信號後驅 動液晶面板1之源極驅動器（以下稱為SD)。驅動該液晶面 之SD3-m係在1個SD產生和多個像素顯示對應之各驅動 信號的，利用m個SD3-m驅動液晶面板i整體，顯示影像。 例如在圖1所示之一實施例，液晶面板1之像素數為128〇， 1個SD之像素驅動數為128，表示SD之個數之m係10。該10 個SD3-：l〜10之中，3-1係第1個SD，3一2係第2個SD，3-3係 第3個SD，3-4係第4個SD，第5個至第10個之SD3-5〜10在圖 上未示。此外，因各SD3-：1〜1〇對每個像素驅動紅（R)、綠 (G)、藍（B)三原色量，每一個之SD之輸出數成為係丨28之3 倍之384，但是在圖1以1條為代表表示那384條輸出。 圖1所示控制器2輸出之資料BUS-A卜24 *BUS-B卜24各 自經由24位元之匯流排線在〜10之中和奇數編號之各 SD3-1、3、5、7、9連接。一樣的，控制器2輸出之極性反 轉信號INV-A、INV-B和時計CLK1以及控制信號SP1也和奇 數編號之各SD3-1、3、5、7、9連接。 而’控制器2輸出之BUS-C卜24、BUS-D卜24各自經由 24位元之匯流排線在SD3-：l〜10之中和偶數編號之各 SD3-2、4、6、8、10連接。一樣的，控制器2輸出之極性 反轉信號INV-C、INV-D和時計CLK2以及控制信號SP2也和
531726
偶數編號之各SD3-2、4、6、8、1〇連接。 號之=上述之圖1所示之一實施例，藉著對奇數編 8 ° , 〇 ^ 、5、7、9和偶數編號之各邡3_2、4、6、 時^ 指派2埠之輸出，將時計CLK1或時計CLO之每個 =之^像素數設為2個像素，把各時計頻率降為1/2。 ，在時計CU1之一個時計時間，同時各自 供給2個像素資料BUS —A卜24、BUS B124。 又，該資料BUS-A1〜24、 MS-D1〜24各自之24位元信號 (B)三原色之各8位元之信號 2 5 6階之彩色顯示。 BUS-B 1 〜24、BUS-C1〜24、 之内容係紅（R)、綠（G)、藍 ，利用這些R、G、B信號實現 其次，說明在上述之圖1所示構造之液晶顯示裝置之 驅動電路驅動液晶面板1後顯示影像之動作。 首先，在奇數編號之各SD3-1、3、5、7、9輸入自控 制器2和時計CLK1同步輸出之資料BUS —A卜24、 BUS-B1〜24、極性反轉信號INV-A、INV-B之各信號，按照 一樣的輸入之控制信號SP1之時序閂鎖那些輪入之信號。 該所閂鎖之極性反轉信號INV-A表示一樣的閂鎖之資料 BUS-A1〜24之極性是否反轉，又，所閂鎖之極性反轉信號 INV-B表示一樣的閂鎖之資料BUS-B1〜24之極性是否反轉。 接著，各SD3-1、3、5、7、9按照這些所閂鎖之極性反轉 信號INV-A、INV-B將所閃鎖之資料BUS-A1〜24、BUS-B1〜24 之極性反轉。 而，在偶數編號之各SD3-2、4、6、8、10輸入自控制
第12頁 531726 五、發明說明（8) 器2和時計CLK2同步輸出之資料Ms —Cl 24、bus 極性反轉信號INV-C、INV —D之各信號，按昭一〜4、 控制信號SP2之時序閂鎖那此輸 ，、輪入之 巧q二铷入之指被。該所閂舖 性反轉信號I N V - C表示一樣的pi雜夕次上丨d τ 门鎖之極性反轉信號ι矣+ ^ . t #BUS-D1 ^24 ^ ^ # 0 # ^D3：；^ 二V8、10按照24些所問鎖之極性反轉信號1 nv_c、 INV:D將所閃鎖之資料BUS_C1〜24、BUS_D卜24之極性反 接著，各汕3 —卜10輸入指示開始驅動液晶面板i =驅動信號(圖上未示)時，“產生依照極性反轉之:未 反轉之貧料BUS-A卜24、BUS-B卜24或BUS-Π〜24、 BUS-D卜24之驅動信號。這些利用各SJ)3 —卜^ 信號輸入液晶面板m，在其液晶面初上顯示影像之驅動 其次，參照圖2〜圖7說明上述之控制器2 出部4之構造和其動作。 、侑之貝科輪 百先’圖2係表示該控制器2所具備之資料輸出部々之 ，之方塊圖。如圖2所示，資料輸出部4具有4個埠A〜D。 这些各埠A〜D各自產生上述之資料MS —A1〜24、
BfS^Bl 〜24、BUS - Cl 〜24、BUS-D 卜 24 以及 INV-A 〜INV - D 之各 ^號後輸出。自該各埠A〜D輪出之信號利用設於各〜D 資料極性反轉判定·產生部1 〇 — 1〜1 〇 — 4產生。 一在這些資料極性反轉判定•產生部丨0440-4將96位 兀之資料BUS1〜96分割成各4個24位元後輸入。該分割成4
第13頁 531726 五、發明說明（9) 個之資料BUS-1〜96之中，資料BUS1〜24輸入資料極性反轉 判定·產生部1 0-1、資料BUS25〜48輸入資料極性反轉判定 •產生部1 0-2、資料BUS49〜72輸入資料極性反轉判定•產 生部10-3、資料BUS73〜96輸入資料極性反轉判定·產生部 10-4。又，時計CLK1輸入資料極性反轉判定·產生部 1 0 -1、1 0 - 2，時計C L K 2輸入資料極性反轉判定·產生部 10-3、10- 4。如上述所示，自控制器2輸出這些時計 CLK1 、 2 ° 接著，埠A之資料極性反轉判定•產生部1 〇 -1判定是 否將資料BUS-：1〜24之極性反轉，按照該判定結果將資料極 性反轉後作為資料BUS-A1〜24輸出。此外，在該輸出之資 料BUS-ΑΙ〜24之極性反轉時，同時將表示極性反轉之極性 反轉信號INV-A設為「H」後輸出。又，在其他之埠B〜D之 各資料極性反轉判定•產生部1 〇 — 2〜4，一樣的判定是否將 各自輸入之資料BUS25〜48、BUS49〜72、BUS73〜96之極性反 轉’按照這些判定結果將資料極性反轉後作為資料 BUS-ΒΙ〜24、BUS-C1〜24、BUS-D卜24輸出。又，在這些輸 出之貧料BUS-B卜24、BUS-C卜24、BUS-D卜24之極性反轉 時’同時將各埠B〜β輸出之極性反轉信號INV —b〜d各自設為 「Η」後輸出。 圖3係表示上述之時計CLn、2及資料BUS_A1〜24、 BUS-ΒΙ〜24、BUS-C1〜24、BUS-IH〜24之相位關係之波形 圖。如圖3(a)〜（c)所示，資料MSb48和時計CLK1之上升 緣（在圖3為PA1〜3之時刻）同步的變化，資料BUS —A1〜24、
第14頁 531726 五、發明說明（ίο) BUS-B1〜24和時計CLK1之下降绥,卢回 步的變化。而，如圖3 (d )〜（所—回3_為PB1〜3之時刻）同 CLK2之上升緣（在圖3為PB1〜 不’賁料BUS49〜96和時計 BUS-C1〜24、BUS-D1〜24和時計Γτ 1^同步的變化，資料 ΡΑ"之時刻）同步的變化。；，：2上下降緣 CLK1之相位和時計CLK2之相 =(a)、（d)所示，時計 如上述所示，自控制w (⑽度）。 BUS1〜9fi，乂曰、> L ☆ A ° 2刀成4個埠A〜β輸出資料 出時，控制旦哭】：^ 電1 按/相同之時序改變各信號後輪 述所干制以之解間電流變大。為了解決此問題，如上 期夺計CLK1之相位和時計CLK2之相位偏移半週 差半埠A 4之輸出變化和埠c、D之輸出變化之時刻相 移，在=^於是，藉著將埠A、B和埠C、D之各輸出變化偏 2個埠，刀成4個埠A〜D輸出之情況也因輸出同時變化的至多 况之、/可抑制成和以2個埠輸出控制器2之瞬間電流之情 瞬間電流相同之程度。 和其2次’說明資料極性反轉判定•產生部1 0 —1〜4之構造 之^ 作。圖4係表示資料極性反轉判定·產生部1〇-1〜4 部^ 之一之構造例之方塊圖，資料極性反轉判定•產生 1〜4全部係相同之構造。 之輪在圖4，係圖2之各資料極性反轉判定·產生部10-1〜4 係^入之資料BUS1 〜24、BUS25〜48、BUS49〜72、BUS73〜96 又/入之資料da卜24，時計CLK1、2係輸入之時計elk。 1 Oy輪出之資料化卜24係自各資料極性反轉判定·產生部 4 輪出之資料BUS一A1 〜24、BUS-B1 〜24、BUS-C1 〜24、
I酬
第15頁 531726 五、發明說明（11) " " MS-D1〜24，輸出之信號inv3係極性反轉信號INV —八〜^。u 係在^料dal〜24和資料del〜24之各24位元之中值不同之位 元，半數以上（1 3位元以上）之情況，將指示資料極性反轉 之仏號1 n v 1設為「Η」後輪出之資料極性反轉判定電路， 12係將在輸入之信號inv2為「Η」之期間輸入之資料 db 1〜2 4之全部位元之極性反轉後输出之極性反轉電路。 13-1〜24係在時計Clk之下降緣各自閂鎖輸入之資料dal〜24 後作為資料db卜24輸出之D正反器，14-：[〜24係在時計elk
之下降緣各自閂鎖輸入之資料^卜“後作為資料d(U〜24輸 出之D正反器。15、16係在時計elk之下降緣各自閂鎖輸入 之信號invl、inv2後作為信號inv2、inv3各自輸出之D正 反器。 圖5係表示上述之圖4所示資料極性反轉判定·產生部 1 0 -1〜4之各部之波形之波形圖。現在，設輸入時計c丨k如 圖5(a)所示、輸入之資料dal〜24如圖5(b)所示。如圖5(b) 所示，輸入之資料dal〜24最初24位元全部係1，在時計elk 之上升緣tl之時刻24位元全部自1變為〇，而在上升緣13之 時刻2 4位元全部自0變為1。輸入照這樣變化之資料d a 1〜2 4 時，D正反器13-1〜24之輸出變成圖5(c)所示之波形，在時 計c 1 k之下降緣12之時刻2 4位元全部自1變為Q，在下降緣 t4之時刻24位元全部自〇變為1。 圖5(d)表示極性反轉電路12之輸出資料〜24之波 形，在圖5(e)之波形所示之D正反器15之輸出信號inv2為 「Η」之期間輸入之資料db卜2 4之全部位元利用極性反轉
第16頁 531726 五、發明說明（12) 電路12自0反轉為1後輸出。圖5(b)之資料dal〜24和圖5(d) 之資料del〜24輸入資料極性反轉判定電路η時，因在時 刻資料dal〜24全部變成0，變成和資料del〜24不同之位元 數為過半數以上，資料極性反轉判定電路1丨將信號丨nv丨設 為「Η」後輸出。D正反器1 5在12時刻閂鎖自該資料極性反 轉判定電路11輸出之信號invl「H」，在信號inv2輸出 「H」。接著，因在t3時刻資料dal〜24全部變成1，變成和 資料del〜24不同之位元數為未過半數，資料極性反轉判定 電路11將信號invl設為「L」後輸出。D正反器15在t4時刻 閂鎖之，信號inv變成「L」。 圖5(f)表示D正反器14-1〜24輸出之資料ddl〜24之波 形，在時計c 1 k之下降緣之時刻閂鎖圖5 ( d)所示之資料 dc卜24後輸出，全部之位元無變化，係1。又，圖5(g)表 示D正反器16輸出之信號inv3之波形，在輸入之資料 da卜24之極性自〇反轉為1後向資料d(H〜24輸出之時刻 t4〜t5之期間變成「H」。 其次，圖6係表示圖5所示資料極性反轉判定電路11之 一構造例之電路圖。在圖6，21由24個EOR(EOR)電路23構 成，係藉著在圖4之資料da卜24和資料dc卜24之對應之各 位元之間取互斥性邏輯和偵測自資料dc卜24往資料da卜24 之各位元之極性之變化之極性變化偵測電路，22係由自24 個E0R電路23之輸出選擇13個輸出後取邏輯積之組合個數 量之13輸入AND電路24和取那些13輸入AND電路24之全部之 輸出之邏輯和之OR電路2 5構成之多數決電路。利用該多數
531726 五、發明說明（13) 決電路，在極性變化偵測電路21之各輸ώΑι〜24之中，變 成之輸出數為過半數之13以上之情況將輸出信號 nV Η」，在變成「Η」之輸出數為未滿過半數之12 以下之情況將輸出信號invl設為rL」。 圖7係用以說明極性變化偵測電路2丨之動作之表，第 一列係輸入資料da卜24、dc：l〜24以及極性變化偵測電路21 之輸出A1〜24之各位元編號n(n係1〜24之整數），第二〜四列 係和各位元編號n對應之資料dan、dcn、E0r電路23之輸出 An之值之例子。在本表，位元編號2〜5、23之資料“打、 den之值不同，和那些值不同之位元對應之位元編號2〜5、 2_3之輸出^之值變成「η」。在像這樣所偵測之不同之位 兀數為過半數之13以上之情況，在輸出信號inv3輸出 「H」。 圖8係用以說明在上述之資料輸出部4藉著將輸出埠分 割成四個埠A〜D後對各埠A〜D將資料極性反轉所得到之效果 之表。 此外，為了便於說明，設輸入資料極性反轉判定•產 生部之資料之總位元數為24，說明將輸出埠分割成各12位 元之2個埠將資料極性反轉之情況。 在圖8 ( A )〜（D )，第一列係第二〜四列所示資料之位元 編號n(n係1〜24之整數），第二列係1個時計前之輸出資料 Xn ’第三列係現在之輸入資料γn，第四列係第三列所示之 和現在之輸入資料Yn對應之輸出資料Zn。 此外，圖8(A)〜（D)所示表中之資料Xn、Yn、Zn之值係
第18頁 531726 五、發明說明（14) -例’在這些表表示相對於資#χη，資料γη之^位元之中 :半之12位元之極性變化之例子。又，圖8(α)所示之表係 使用1個資料極性反轉判定 ” 一一 彳疋·屋生邛，按2 4位元單位進 行貧料反轉之情況之例子，圖8(B)〜（D) 個資料極性反轉判定•產斗卹骆w+次 ^ # ^ #J ^ ^ 6艟夕棒、、w + m 後，按照12位兀單位進行資料 反轉之情況之例子。 百先，圖8(A)所示表之資料χη全部係「L」、資 之位兀編號卜7、13〜17之12位元係「H」。在本圖8(A)之 情況^因按照24位元單位判定定是否有過半數以上之 發生，化，因係未過半數之丨2位元發生變化，資料不7 ΐ 1貧料Yn直接成為輸出資料Zn。結果，資料輸出之變化 ΐ k成12位元，成為按照24位元單位進行資料反 之最大變化量。 付心It況 其次，圖8(B)所示表之資料Xn全部係「^」、資 之位元編號卜7、13〜17之12位元係「H」，和圖8(M之^ ，，同。可是，在圖8(B)之情況，因按照12位元單位月十 定是否有過半數以上之資料發生變化，位元編號卜12 = 疋、’Ό，係過半數以上之7位元發生變化，將資料反轉，位 元編號卜12之輸出資料Ζη變成由資料γη反轉的。而， 兀編，1,3〜24，只有5位元發生變化，因變化量不及過半立 數，貝料不反轉。結果，資料輸出之變化量變成位 12之5位元和位元編號13〜17之5位元之共1〇位元，和於^ 照24位元單位進行資料反轉之情況相比，變化量少了 2 =
第19頁 531726
一樣的，在圖8(c)所+令法 Υη被資料反轉後作為輪出二位元編號卜12之資料 之變化量變成位元編號二貝二:輪出之結果，該資料輸出 位元之共8位元，和按昭2 2位之元4!元和位元編號13〜16之4 相比，變化量少了4位;;几早位進行資料反轉之情況 被資轉ί 所示之情況’位元編號1〜12之資料Yn 元之共6位元，和按，昭2/位位/和位元編號13〜15之3位 比^置少了6位元，可將變化量抑制成-半。 1”/ 1「ίΤ Λ雖味未不，在資料〜之位元編號卜U、13之 資料z: r出之」社之果障況，一樣的將資料Yn反轉後作為輸出 i 料輸出之變化量變成位元編號 i「Η Ϊ疋。又:在資料Yn之位元編號卜12之12位元 浐Ψ /^之#月況β ~一樣的將資料Υη反轉後作為輸出資料Ζη ίίί 料輸出之變化量變成0位元(輸出之極性 無變化）。 如上述所不，藉著在24位元之中對於一樣之12位元變 化量之貧料輸入分割成各i 2位元之二部分後進行資料反 轉，在按照24位兀單位進行資料反轉之情況之最大變化量 係12位兀時，分割成二部分後進行資料反轉之情況之 變化量變成2位元。即，藉著分割成各⑴立元之二部分後 進行資料反轉’和按照24位元單位進行資料反轉之情況相 531726 五、發明說明（16) 比，可將資料輸出之變化量最大減為Q ^ 此外’在圖8為了便於說明，說明 元數設為24，並將輪出埠分割成2個埠之入資料之位 述之一實施例所示，在將96位元之資以子，但是如上 個埠Α〜D後按照24位&單位進行資料反轉之1二6分割成四 到減少資料輸出之變化量之效果。又 月况，也可得 例，採用按照R、G 1各8位元之共立之J之-實施 反轉之構造’但是改為按照各色8 =早位進5資料 轉之構造也可。 70之早位進行資料反 此外在上述之一實施例，表示2 5 6階之3色顧-况，但是對於階數或色數可進行各種變更。 、丁之十月 於是，因資料輸出之變化量減少，可得到資料 ，資料輸出所需之耗電力減少之效果用“巧 ^之，在亡述之—實施例之液晶顯示裝置之驅動雷、 17使用資料反轉功能之習知之液晶顯示裝置之 電路相比，耗電力減少了25%。 衣罝之驅動 此外’還可得到因資料輸出之變化而發生之 之效果。 #死减少 • 圖9係表示可得到雜訊減少之效果之量測結果之波^ 圖，圖9所示之波形係使用圖丨所示一實施例之液晶顯厂化 ^之驅動電路驅動液晶面板1時之電磁干擾雜訊特性裝 )之里測結果。此外，在圖9所示Ε Μ I特性之量剛，才 下裝在液晶顯示裝置之遮蔽板後，量測了自液晶顯示裝斥 之驅動電路及液晶面板1直接放射之電磁干擾雜訊。&
531726
五、發明說明（π)
又，圖11所示之波形係在和圖9所示之ΕΜΙ特性之量測 一樣之條件所量測之波形，表示使用未利用資料反轉功能 之習知之液晶顯示裝置之驅動電路驅動液晶面板i時之E M J 在圖9和圖11所示之波形，在橫轴以百萬赫（MHz)單位 表不電磁干擾雜訊之頻率，在縱軸以分貝（dB)單位表示電 磁干擾雜訊之強度。比較這些圖9和圖u之波形所示之emi 特性時，藉著使用上述之一實施例之液晶顯示裝置之驅動 電路，在頻帶可得到10 dB以上之電磁干擾雜訊之 效 【發明之效果】 如以上之說明所示’若依據本發明，在具有用以向液 晶面板傳送影像資料之匯流排線之液晶顯示裝置之驅動電 路，因在令往該匯流排線之輸出發生極性變化之資料信號 有過半數以上之情況，將資料信號之極性全部反轉後向匯 流排線輪出，又，使得輸出表示向該匯流排線輪出之資料 信號反轉之極性反轉信號，可將往匯流排線之輸出之極性 之變化Ϊ降至傳送之資料信號之半數以下。 〜果’和習知之液晶顯示裝置之驅動電路相比， 少耗電力。 此外’和習知之液晶顯示裝置之驅動電路相比，也可 得到改善EM I特性之效果。 還藉著改善其EMI特性，因不需要使用在習知之液晶
因在匯流排線之輸出之極性之變化量減少 531726 五、發明說明（18) 顯示裝置之驅動電路需要之昂貴之ΕΜ ί對策用元件，和習 知之液晶顯示裝置相比’可降低費用。
此外，藉著比較使用了本發明之液晶顯示裝置之EM I 特性和未使用之液晶顯示裝置之EM I特性，因得知匯流排 線所引起之雜訊所放射之頻率，可區別在習知係困難之自 液晶顯示裝置放射之電磁干擾雜訊是否是由匯流排線引起 之雜訊。 又 成為資料錯誤之原因之匯流排線間之串訊減少之政果。 此外，因使得在各匯流排線設置資料極性反轉判定華 可象Ϊ性反轉裝置，藉著在各匯流排線資料之極性反轉， 降低往匯流排線之輪出之極性之變化量。 流排i之：ϊϋί半數之匯流排線之時計和其他半數之圈 出半週期，可令在往匯流排㈣ 2之瞬間電流。 夕可降低驅動匯流排線之控制署
第23頁 531726 圖式簡單說明 圖1係表示本發明之一實施液晶_ 電路之構造之方塊圖。 下裝置之驅動 之構 關係 圖2係表示該實施例之控 2所具備 造之方塊圖。貝枓輸出部4 圖3係表示圖2所示資料輸出部4之輸出 之波形圖。 八仏遽之相位 之構r/m圖。2所示資料極性反轉判定·產生部 之波ΪΛ係表示圖4所示資料極性反轉判定·產生部之動作 之一構造 f生變化偵測電路2 1之動彳乍< 圖6係表示圖5所示資料極性反轉判定電路 例之電路圖。 表 圖7係用以說明圖6所示極,1 係用以說明圖丨所示一實施例所得到之效果之 動電表Λ使用圖1所示—實施例之液晶顯示裝置之驅 圖1〇传ia-a，板1時之ΕΜί特性之量測結果之波形圖。 方塊圖。、&不習知之液晶顯示裝置之驅動電路之構造之 =11係表不使用習知之液晶顯示置之驅 液晶面板1時之則特性之量測結果之波形圖。 乾動 【符號說明] 1 液晶面板 麵 第24頁 531726 圖式簡單說明 2 控制器 3 - 1〜4 源極驅動器 1^·! 第25頁

Claims (1)

  1. 531726 六、申請專利範圍 1 · 一種 資料信號之 資料極 之向該匯流 在令往該匯 將該多個資 極性反轉信 極性反 之該極性反 部反轉後， 2. 如申 路，其中， 裝置和該極 3. —種 資料信號之 第一閂 地予以閂鎖 極性反 反轉指示位 反轉後，作 資料極 多個第二資 #信號數之 該反轉指示 液晶顯示 該傳送資 性反轉判 排線輪出 流排線之 料信號之 號予以輸 轉裝置， 轉信號， 作為該多 請專利範 在多條匯 性反轉裝 液晶顯示 該傳送資 鎖電路， ，應將之 轉電路， 準之情況 為多個第 性反轉判 料信號之 過半數以 位準輪出 裝置之驅動電路，具有輸出多個傳送 料信號數寬之匯流排線，包含： 定裝置，在作為該多個傳送資料信號 之多個資料信號之中，有過半數二二 輸出發生極性變化之情況下，將表示 極性全部反轉後向該匯流排線輸出之 出；及 按照自該資料極性反轉判定裝置輸出 將所輸入之該多個資料信號之極性全 個傳送資料信號予以輸出。 圍第1項之液晶顯示裝置之驅動電 流排線各自具備該資料極性反轉 置。 又 ，置之驅動電路，具有輸出多個傳送 料信號數寬之匯流排線，包含： 將夕個輪入資料信號和輸入時計同步 輪出作為多個第一資料信號； 在輸入之第一極性反轉信號係既定之 二將該多個第一資料信號之極性全部 =資料信號輸出； 電路在该多個輸入資料信號和該 對應之信號之間，極性不同之個數有 上之情況，將第二極性反轉信號作為 :及 531726 六、申請專利範圍 第二問鎖電路，將該第二極性反轉信號和該輸入時計 同步地予以閂鎖，並將之輸出作為該第一極性反轉信號。 4.如申請專利範圍第3項之液晶顯示裝置之驅動電 路，其中，具備： 第三閂鎖電路，將該多個第二資料信號和該輸入時計 同步地予以閂鎖，並將之輸出作為該多個傳送資料信號； 及 第四閂鎖電路，將該第一極性反轉信號和該輸入時計 同步地予以閂鎖，並將之輸出作為該第三極性反轉信號。 5:如申請專利範圍第4項之液晶顯示裝置之驅動電 路，其中，在多條匯流排線各自具備該第一至第四閂鎖電 路和該資料極性反轉判定裝置以及該極性反轉裝置。 6.如申請專利範圍第5項之液晶顯不裝置之驅動電 路，其中，該輸入時計之和該多條匯流排線之半·數對應之 該輸入時計，與和其他之半數對應之該輸入時計之相位相 差半週期。
    第27頁
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