TW201907295A - 介面組件 - Google Patents

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Abstract

在一實例中，一種裝置可具有用於耦合至一主機之一控制器、耦合至該控制器之一介面組件及耦合至該介面組件之複數個記憶體器件。該介面組件可引起該複數個記憶體器件之一記憶體器件回應於來自該控制器之一命令而執行一操作。

Description

介面組件
本發明大體上係關於儲存器(諸如資料儲存器)，且更特定言之，本發明係關於介面組件。
儲存系統(例如用於儲存資料)可實施於諸如電腦、蜂巢式電話、手持器件等等之電子系統中。儲存系統通常包含用於控制可用於儲存(例如資料儲存)之記憶體器件之一控制器(例如一記憶體控制器)。
一些儲存系統(諸如固態儲存器件(例如固態硬碟))可包含非揮發性記憶體器件。非揮發性記憶體器件藉由在未被供電時保存儲存資料來提供持久資料且可包含「反及」快閃記憶體、「反或」快閃記憶體、氮化物唯讀記憶體(NROM)、相變記憶體(例如相變隨機存取記憶體)、電阻記憶體(例如電阻隨機存取記憶體)或其類似者。
在一些實施例中，一儲存系統可具有可與一主機(諸如一電腦)通訊之一控制器(例如一記憶體控制器)且可自主機接收位址信號(例如位址)、命令信號(例如命令)及資料信號(資料)且可將資料發送至主機。控制器可經由一通道(諸如一通訊通道(例如一記憶體通道))而與一記憶體器件通訊。例如，一通道可將位址、命令及資料自控制器傳送至記憶體器件及將資料自記憶體器件傳送資料至控制器。複數個接針可(例如)將一通道耦合至控制器。在一些實例中，一控制器可經由複數個通道而與記憶體器件之複數個群組通訊。例如，控制器可經由耦合至一各自群組之通道個別控制各自群組。
根據本發明之一實施例，提供一種裝置，其包括：一控制器，其用於耦合至一主機；一介面組件，其耦合至該控制器；及複數個記憶體器件，其等耦合至該介面組件；其中該介面組件引起該複數個記憶體器件之一記憶體器件回應於來自該控制器之一命令而執行一操作。
根據本發明之另一實施例，提供一種裝置，其包括：一控制器；及複數個介面組件，其中該控制器分別經由複數個第一通道之各自者而與該複數個介面組件之各自者通訊；其中該複數個介面組件之至少一者經由複數個第二通道之一第一者而與第一複數個記憶體器件通訊及經由該複數個第二通道之一第二者而與第二複數個記憶體器件通訊。
根據本發明之另一實施例，提供一種操作一裝置之方法，其包括：自一控制器接收一介面組件處之一封包；使用該介面組件來解封包化該封包；及回應於該解封包化封包中之一指令而對耦合至該介面組件之一記憶體器件執行一操作。
在一實例中，一種裝置可具有用於耦合至一主機之一控制器、耦合至該控制器之一介面組件及耦合至該介面組件之複數個記憶體器件。該介面組件可引起該複數個記憶體器件之一記憶體器件回應於來自該控制器之一命令而執行一操作。
本發明之若干實施例提供諸如相較於先前儲存系統增加一儲存系統之儲存容量之益處。例如，與先前儲存系統相比，更多記憶體器件可耦合至一儲存系統之一控制器(諸如一記憶體控制器)，且很少增加(例如或不增加)控制器之頻寬、控制器之接針之數目及/或控制器之實體大小(例如矽之數量)。與先前儲存系統相比，額外益處可包含降低成本、提高效能及減少每單位儲存之電力消耗。
在以下詳細描述中，參考構成本發明之部分之附圖，且附圖中依繪示方式展示特定實例。在圖式中，相同元件符號描述所有若干視圖中之實質上類似組件。可利用其他實例且可在不背離本發明之範疇之情況下作出結構及電性改變。因此，以下詳細描述不應被視為意在限制，且本發明之範疇僅由隨附申請專利範圍及其等效物界定。
圖1係根據先前技術之一裝置(諸如一系統100 (例如一運算系統，諸如一基於網際網路(例如「雲端」)之運算系統、一企業運算系統等等)之一部分)之一方塊圖。系統100可包含可包含(例如)一或多個處理器之一主機105。系統100可包含藉由一介面108 (諸如一主機介面)耦合至主機105之一儲存系統110 (例如一記憶體系統，諸如一固態硬碟)。術語「耦合」可包含無線耦合、直接耦合及/或無介入元件之直接連接(例如藉由直接實體接觸)或具有介入元件之間接耦合及/或連接。
儲存系統110可包含諸如一記憶體系統控制器之一控制器115 (例如記憶體控制電路、韌體及/或軟體)。儲存系統110可為(例如)一企業儲存系統且控制器115可為(例如)一企業控制器。一企業儲存系統當前可(例如)以太位元組之儲存及快速效能能力(例如100 MB/sec、每秒100 K輸入/輸出等等)為特徵。在一些實例中，儲存系統110可為一雲端儲存系統且控制器115可為一雲端控制器。
在一些實例中，控制器115可經由複數個通道118 (諸如通道118-1 (Ch1)至118-N (ChN)，其中N可為8、16、32、64等等)通訊。一通道(例如通道118-1至118-N之各者)可耦合於一或多個記憶體器件120 (諸如「反及」記憶體器件)與控制器115之間。例如，各通道118可耦合於記憶體器件120-1至120-M與控制器115之間。在一些實例中，記憶體器件120-1至120-M可包含於一記憶體封裝122中。例如，控制器115可經由通道118-1至118-N之各自者分別與記憶體封裝122-1至122-N之各自者通訊。如本文所使用，一通道可包含一實體傳輸媒體，諸如一或多個導線或一無線傳輸媒體。
儲存系統(諸如儲存系統110)之容量(例如)隨著儲存需求不斷增加而不斷增長，但有時以犧牲通道頻寬為代價。例如，可藉由增加耦合至各通道118之記憶體器件之數目來增加儲存容量。
增加儲存容量之另一方式可為(例如)增加通道118之數目。然而，此會增加控制器115之大小(諸如矽面積)、接針之數目、印刷電路板選路層之數目及控制器之電力需求。
圖2A係根據本發明之若干實施例之一裝置(諸如一儲存系統210 (例如一記憶體系統，諸如一固態硬碟))之一方塊圖。在一些實例中，儲存系統210可藉由一鏈路208耦合至一主機以形成一運算系統之一部分。
儲存系統210可包含可藉由鏈路208耦合至主機之一控制器215 (例如記憶體控制電路、韌體及/或軟體)，諸如一記憶體系統控制器。例如，控制器215可自主機接收命令、位址及資料且可將資料及狀態信號傳輸至主機。儲存系統210可為(例如)一企業儲存系統且控制器215可為(例如)一企業控制器。在一些實例中，儲存系統210可為一雲端儲存系統且控制器215可為一雲端控制器。
記憶體系統210可包含諸如介面組件225-1至225-N之複數個介面組件225 (例如專用積體電路(ASIC))。控制器215可經由一各自通道218而與一各自介面組件225通訊。例如，控制器215可經由一通道218控制一介面組件225。一各自通道218可將位址、命令及資料自控制器215傳送至一各自介面組件225及將資料及狀態信號自各自介面組件225傳送至控制器215。在一些實例中，控制器215可充當一主控制器且介面組件225可充當控制器215之從屬單元。
在一些實例中，控制器可分別經由通道218-1 (Ch1)至218-N (ChN)之各自者而與介面組件225-1至225-N之各自者通訊(例如控制介面組件225-1至225-N之各自者)。例如，通道218-1至218-N之各自者可分別耦合於介面組件225-1至225-N之各自者而與控制器215之間。
一各自介面組件225可經由一通道227而與一或多個記憶體器件(諸如記憶體器件230-1至230-M之一群組(例如一記憶體封裝232))通訊(例如控制一或多個記憶體)。例如，介面組件225-1至225-N之各者可分別經由通道227-1至227-L之各自者而與記憶體封裝232-1至232-L之各自者通訊。例如，通道227-1至227-L之各自者可分別耦合於記憶體封裝232-1至232-L之各自者而與一介面組件225之間。一各自通道227可(例如)將位址、命令及資料自一各自介面組件225傳送至一各自封裝232且因此傳送至各自封裝232之一各自記憶體器件230及將資料及狀態信號自各自介面封裝232傳送至各自介面組件225。
各介面組件225可(例如)將各通道218延伸至L個通道中。每介面組件225使用多個通道227可用於增加記憶體器件之數目且因此增加儲存系統210之儲存容量(例如不增加每控制器215之通道數目)。例如，與儲存系統110相比，此可增加儲存系統210之儲存容量，且很少增加(例如或不增加)控制器215之大小(諸如矽面積)、控制器215之接針之數目、控制器215之印刷電路板選路層之數目及/或控制器215之電力需求。
在一些實例中，一介面組件225 (例如介面組件225-1至225-N之各者)可基於控制器(例如處理器)且可管理存取操作，諸如自耦合至介面組件225之記憶體器件230讀取及寫入至耦合至介面組件225之記憶體器件230。例如，一介面組件225可自控制器215接收封包化傳輸(例如封包)，可解封包化傳輸(例如解構封包)，且可基於含於解構封包中之指令(例如命令)來決定存取哪個記憶體器件230及執行哪些存取操作(例如讀取或寫入)。在諸如(例如)儲存系統110之先前儲存系統中，控制器115可管理各記憶體器件之存取操作。在圖2A之實例中，根據本發明之若干實施例，控制器215上之一些負載可轉移至介面組件225。
例如，一介面組件225可回應於來自控制器215之命令而決定與封裝232-1至232-L之哪個封裝中之記憶體器件230-1至230-M之哪個記憶體器件通訊(例如存取哪個記憶體器件)。例如，一介面組件225可自控制器215接收一寫入命令、一位址(例如一邏輯位址)及寫入至對應於邏輯位址之一位置之資料且可決定將資料寫入至哪個記憶體器件。例如，介面組件225可管理(例如控制)該記憶體器件之寫入操作。一介面組件225可自控制器215接收一讀取命令及一位址且可決定自哪個記憶體器件讀取資料。例如，介面組件225可管理該記憶體器件之讀取操作。
圖2B係根據本發明之若干實施例之一介面組件225 (諸如介面組件225-1至225-N之任一者)之一實例之方塊圖。例如，介面組件225可包含可控制介面組件225之操作之一控制器(例如一主控制器，諸如一中央控制器) 250。控制器250可包含(例如)一處理器。介面組件225可控制耦合至介面組件225之封裝232-1至232-L之各者之記憶體器件230-1至230-M之各者之操作。可(例如)獨立定址(例如且控制)介面組件225之通道227-1至227-L之各者。
在一些實例中，介面組件225可包含可耦合至一通道218且可經由通道218而與控制器215通訊之一(例如高速)介面252，諸如一串列介面。例如，介面252可為一串列化器/解串列化器(SerDes)介面、一低電壓差動發信(LVDS)介面、一串列化開放式「反及」快閃介面工作群組(ONFI)介面(諸如一SerDes ONFI介面)等等。介面252可(例如)使用一串列格式(例如串列傳輸)來經由一通道218而與控制器215通訊。例如，介面252可自控制器215接收串列傳輸作為輸入且可將串列傳輸輸出至控制器215。例如，一串列傳輸可包含可(例如)包含命令(例如讀取及寫入)、位址及資料之一系列封包。在一些實例中，介面252可解串列化來自控制器215之一串列輸入(例如含有一系列封包)且串列化用於輸出至控制器215之並列信號(例如封包)。
介面組件225可包含對應於介面252之一介面控制器254以控制跨介面252之信號流量(諸如位址、命令及資料流量)符合諸如一高速串列標準、一SerDes標準、一SerDes ONFI標準、LVDS標準等等之特定標準。
在一些實例中，介面組件225可包含可分別經由通道227-1至227-L而與記憶體封裝232-1至232-L通訊之一介面256。例如，介面256可為一(例如標準) ONFI介面、一串列化ONFI介面、一LVDS介面等等。在一些實例中，介面256可為一並列介面(諸如一標準ONFI介面)且可使用一並列格式(例如並列傳輸)來經由通道227-1至227-L之各者通訊。在其他實例中，介面256可為一串列介面且可使用一串列格式來經由通道227-1至227-L之各者通訊。在一些實例中，介面256可解串列化來自一通道227之一串列輸入(例如解串列化為諸如信號之並列輸入)且串列化用於輸出至一通道227之並列信號。
介面組件225可包含對應於介面256之一介面控制器258以控制跨介面256之流量傳輸(諸如位址、命令及資料之流量)以使其符合諸如一ONFI標準、一SerDes ONFI標準、一LVDS標準等等之特定標準。
在一些實例中，控制器250可耦合至且可控制一封包化器/解封包化器264。例如，控制器250可引起封包化器/解封包化器264解封包化來自介面252及因此來自控制器215之封包。例如，封包化器/解封包化器264可解封包化來自控制器215之封包，其可包含命令(例如讀取、寫入或擦除)、位址(諸如在耦合至一通道227之記憶體器件230-1至230-M之一記憶體器件230中)(例如待寫入至記憶體器件230、自記憶體器件230讀取或擦除)及待寫入之資料。封包化器/解封包化器264可封包化(例如)自一記憶體器件230讀取之資料以輸出至控制器215。在一些實例中，封包化器/解封包化器264可解封包化命令、位址及資料以經由一通道227傳輸至一各自封裝232中之一記憶體器件230。
在一些實例中，介面組件225可包含耦合至控制器250之一記憶體管理單元(例如記憶體管理引擎) 270。例如，記憶體管理單元270可用於控制經由一通道227存取至記憶體器件230。在一些實例中，記憶體管理單元270可控制回應於來自控制器215之一命令(諸如一解封包化封包中之一命令)(例如一讀取命令或一寫入命令)而存取至一記憶體器件230。
介面組件225可包含耦合至(例如)控制器250之一損耗均衡引擎272。控制器250可回應於來自(例如)控制器215之指令而使用損耗均衡引擎272來控制對耦合至一通道227之記憶體器件230所執行之損耗均衡操作。介面組件225可向(例如)控制器215指示損耗均衡完成。
介面組件225可包含耦合至控制器250之一錯誤校正引擎274，諸如一低密度同位檢查引擎。例如，控制器250可回應於來自控制器215之指令(使用錯誤校正碼，諸如低密度同位檢查校正碼)而使用錯誤校正引擎274來校正自耦合至一通道227之記憶體器件230讀取之資料。介面組件225可向(例如)控制器215報告錯誤校正之結果，諸如錯誤校正是否成功。
在一些實例中，控制器250可回應於來自(例如)控制器215之指令而控制對耦合至一通道227之記憶體器件230所執行之廢棄項目收集操作。介面組件225可向(例如)控制器215指示廢棄項目收集操作完成。
在一些實例中，控制器250可回應於來自(例如)控制器215之指令而控制對耦合至一通道227之記憶體器件230所執行之預留空間(overprovisioning)操作。例如，介面組件225可每次對一記憶體器件230之記憶體單元之群組(諸如記憶體單元之一區塊)執行一讀取/寫入操作時通知控制器215。當針對一記憶體器件230之一特定區塊之寫入/擦除操作達到一特定數目時，控制器215可指示介面組件225引起記憶體器件使用另一區塊來替換特定區塊。介面組件225可向(例如)控制器215指示替換完成。
在諸如(例如)儲存系統110之先前儲存系統中，控制器115可管理各記憶體器件之損耗均衡、錯誤校正、廢棄項目收集、記憶體管理、預留空間等等。此會用盡原本可用於(例如)讀取及寫入之頻寬。由於將此等操作分配給一介面組件225，所以控制器215之頻寬可用於讀取及寫入而非管理各記憶體器件之損耗均衡、錯誤校正、廢棄項目收集、記憶體管理、預留空間等等。與諸如儲存系統110之先前儲存系統相比，此可導致電力消耗減少及效能提高(例如更快讀取及寫入，因為控制器215可不被可分配給介面組件225之應用程式占用)。
在一些實例中，(例如串列化)封包(例如一系列封包)可在可將封包傳輸至封包化器/解封包化器264之介面252處自控制器215接收。例如，介面252可在將來自一系列封包之封包傳輸至封包化器/解封包化器264之前解串列化封包。接著，封包化器/解封包化器264可將封包解封包化(例如解構)為(例如)命令及位址以判定對哪個封包232 (例如耦合至哪個通道227)中之哪個記憶體器件230執行何種操作。例如，位址可包含一特定封裝232中之一特定記憶體器件230中之一特定位置。
命令可為(例如)一讀取命令。介面組件225 (例如控制器250)可回應於讀取命令而引起資料自具有位址之位置(例如位址位置)讀取。例如，控制器250可引起讀取命令及位址發送至介面256且可引起介面256經由一通道227 (例如耦合至特定封裝232之通道227-1至227-L之各自者)將讀取命令及位址傳輸至具有位址位置之記憶體器件230。記憶體器件230可回應於讀取命令及位址而自位址位置讀取資料。讀取資料可經由通道227自記憶體器件230傳輸至介面256。例如，可在介面256處接收來自記憶體器件230之讀取資料。
在一些實例中，控制器250可引起讀取資料發送至封包化讀取資料之封包化器/解封包化器264。控制器250可引起封包化讀取資料發送至將經封包化讀取資料傳輸至記憶體控制器215之介面252。例如，介面252可在將封包化讀取資料傳輸至記憶體控制器215之前串列化封包化讀取資料(例如與其他封包化讀取資料串列)。
在一些實例中，解封包化封包可包含一寫入命令及待寫入至位址位置之資料。控制器250可回應於寫入命令而引起資料寫入至位址位置。例如，控制器250可引起寫入命令、位址及資料發送至介面256且可引起介面256經由通道227將寫入命令、位址及資料傳輸至具有位址位置之記憶體器件230。記憶體器件230可回應於寫入命令及位址而將資料寫入至位址位置。
圖3係根據本發明之若干實施例之一裝置(諸如一儲存系統310 (例如一記憶體系統，諸如一固態硬碟))之一方塊圖。在一些實例中，儲存系統310可耦合至一主機以形成一運算系統之一部分。
儲存系統310可包含可類似於(例如相同於)控制器215之一控制器315 (例如記憶體控制電路、韌體及/或軟體)，諸如一記憶體系統控制器。控制器315可耦合至主機，可自主機接收命令、位址及資料，且可將資料及狀態信號傳輸至主機。
控制器315可經由一各自通道318 (例如通道318-1至318-N之一各自者)而與串列耦合介面組件325 (例如串列耦合介面組件325-1至325-K)(諸如ASIC)之一各自群組324 (例如群組324-1至324-N之一各自者)(諸如一序列)通訊。例如，控制器315可分別經由通道318-1至318-N之各自者而與群組324-1至324-N之各自者通訊。例如，通道318-1至318-N之各自者可分別耦合於群組324-1至324-N之各自者而與控制器315之間。
通道318之各者可將信號傳送於控制器315與介面組件325之一各自群組324之間，諸如將位址自控制器315傳送至各自群組324、將命令自控制器315傳送至各自群組324、將狀態信號自各自群組324傳送至控制器315及將資料自控制器315傳送至各自群組324及/或將資料自各自群組324傳送至控制器315。
一群組324 (例如群組324-1至324-N之各者)中之各介面組件325 (例如介面組件325-1至325-K之各者)可經由一或多個通道(諸如(例如並列)通道327-1至327-L)通訊。通道327-1至327-L之各者可耦合於一各自介面組件325與記憶體器件330-1至330-M之一群組(例如一記憶體封裝332)之間。
一通道327可(例如)將信號傳送於一介面組件325與一各自封裝332及因此各自封裝中之各記憶體器件之間，諸如將位址自介面組件325傳送至各自封裝332、將命令自介面組件325傳送至各自封裝332、將狀態信號自各自封裝332傳送至介面組件325及將資料自介面組件325傳送至各自封裝332及/或將資料自各自封裝332傳送至介面組件325。
介面組件之一群組324中之介面組件325 (例如介面組件325-1至325-K)可(例如)藉由雙向鏈路335串列互連(例如用於形成介面組件325-1至325-K之一序列)。例如，一雙向鏈路335 (諸如雙向鏈路335-1至335-(K-1)之一者)可耦合兩個連續(例如緊鄰)介面組件325。例如，鏈路335-1可串列耦合連續介面組件325-1及325-2。
在一些實例中，一群組324中之介面組件325-1及325-2可判定對來自控制器315之一(例如下游)信號(例如一封包)施加作用或將封包傳遞至群組324中之下一(例如下游)介面組件。介面組件325-3 (例如K=3時之群組324中之最後介面組件)可對自一上游介面組件(諸如介面組件325-2)接收之一封包施加作用。例如，介面組件325-1可將封包傳遞至介面組件325-2 (例如回應於一封包識別符不匹配介面組件325-1之一識別符)，且介面組件325-2可將封包傳遞至介面組件325-3 (例如回應於封包識別符不匹配介面組件325-2之一識別符)。
在一些實例中，一介面組件325-1可判定來自控制器315之一各自通道318之一封包是否意欲用於介面組件325-1且因此是否由介面組件325-1施加作用。例如，若封包意欲用於介面組件325-1 (例如，封包識別符匹配介面組件325-1之識別符)，則介面組件325-1可解封包化封包且可決定封包意欲用於哪個記憶體封裝332之哪個記憶體器件330。若介面組件325-1自解封包化封包判定資料自耦合至其之一記憶體器件讀取，則介面組件325-1可引起資料被讀取，可封包化讀取資料，且可將讀取資料(例如向上游)發送至控制器315。
若封包不意欲用於介面組件325-1 (例如，封包識別符不匹配介面組件325-1之識別符)，則介面組件325-1可(例如)將封包(例如向下游(例如無第一解封包化))傳遞至介面組件325-2 (例如K=3時之記憶體介面組件325-1至325-3之群組中之下一介面組件)，介面組件325-2可判定封包是否意欲用於介面組件325-2。例如，若封包意欲用於介面組件325-2 (例如，封包識別符匹配介面組件325-2之識別符)，則介面組件325-2可解封包化封包且可決定封包意欲用於哪個記憶體封裝332之哪個記憶體器件330。否則，介面組件325-2可將封包(例如向下游)傳遞至可對封包施加作用之介面組件325-3。例如，當介面組件325-3係序列中之最後介面組件時，由介面組件325-3接收之封包可被預設施加作用，因為其不意欲用於序列中之前述介面組件(例如介面組件325-1及325-2)且未被前述介面組件施加作用。
當介面組件325-2自解封包化封包判定資料自耦合至其之一記憶體器件讀取時，介面組件325-2可引起資料被讀取，可封包化讀取資料，且可透過介面組件325-1將封包化讀取資料(例如向上游)發送至控制器315。例如，介面組件325-1可自介面組件325-2 (例如序列中之一下游介面組件)傳遞資料(例如向上游移動)。
當介面組件325-3自介面組件325-2接收一封包時，介面組件325-3可解封包化封包。當介面組件325-3自解封包化封包判定資料自耦合至其之一記憶體器件讀取時，介面組件325-3可引起資料被讀取，可封包化讀取資料，且可透過介面組件325-3與控制器315之間的序列中之介面組件(諸如介面組件325-1及325-2)將封包化讀取資料(例如向上游)發送至控制器315。例如，介面組件325-1及325-2可(例如向上游)傳遞朝向控制器315移動之資料(例如來自下游介面組件)。
在一些實例中，一介面組件325 (例如介面組件325-1至325-K之各者)可包含用於控制介面組件325之操作之一控制器(例如一主控制器)，其可(例如)類似於(例如相同於)控制器250。一介面組件325可包含可(例如)類似於(例如相同於)介面252之一介面352。例如，介面組件325-1之介面352可耦合至一通道318，介面組件325-2之介面352可耦合至鏈路335-1，且介面組件325-K之介面352可耦合至鏈路335-(K-1)。一介面組件325可包含對應於介面352以控制跨介面352之傳輸流量(諸如位址、命令及資料之流量)之一介面控制器，其可(例如)類似於(例如相同於)介面控制器254。
在一些實例中，一介面組件325可包含可(例如)類似於(例如相同於)介面256之一介面356。例如，介面356可耦合至記憶體封裝332-1至332-L。一介面組件325可包含對應於介面356以控制跨介面356之傳輸流量(諸如位址、命令及資料之流量)之一介面控制器，其可(例如)類似於(例如相同於)介面控制器258。在一些實例中，一介面組件325可包含可耦合至介面組件325之控制器之一封包化器/解封包化器，其可(例如)類似於(例如相同於)封包化器/解封包化器264。
在一些實例中，介面組件325-K與控制器315之間的介面組件325 (諸如介面組件325-1及325-2)可包含可(例如)類似於(例如相同於)介面252之一介面362。例如，介面組件325-1之介面362可耦合至介面組件325-2之介面352，介面組件325-2之介面362可耦合至介面組件325-3之介面352 (例如，當K=3時)。可包含一介面362之介面組件325可包含對應於介面362以控制跨介面362之傳輸流量(諸如位址、命令及資料之流量)之一介面控制器，其可(例如)類似於(例如相同於)介面控制器254。
在一些實施例中，一介面組件325可包含：耦合至介面組件325之控制器之一記憶體管理單元，其可(例如)類似於(例如相同於)記憶體管理單元270；耦合至介面組件325之控制器之一損耗均衡引擎，其可(例如)類似於(例如相同於)損耗均衡引擎272；及耦合至介面組件325之控制器之一錯誤校正引擎，其可(例如)類似於(例如相同於)錯誤校正引擎274。
在一些實例中，一介面組件325之控制器可回應於來自(例如)控制器315之指令而控制針對耦合至一通道327之記憶體器件330之廢棄項目收集操作。在一些實例中，一介面組件325之控制器可回應於來自(例如)控制器315之指令而依類似於(例如相同於)上文結合圖2B所討論之預留空間之一方式控制針對耦合至一通道327之記憶體器件330之預留空間操作。
在一些實例中，一封包可接收於一群組324中之一介面組件325-1之介面352處。介面組件325-1之控制器可判定封包是否意欲用於介面組件325-1 (例如藉由判定封包之一識別符是否匹配介面組件325-1之一識別符)。控制器可回應於識別符匹配而判定封包意欲用於介面組件325-1。當封包意欲用於介面組件325-1時，介面組件325-1之封包化器/解封包化器可將封包解封包化為(例如)命令及位址以判定對耦合至介面組件325-1之哪個封裝332中之哪個記憶體器件330執行何種操作。在一些實例中，介面組件325-1之介面352可回應於介面組件325-1之控制器判定封包意欲用於介面組件325-1而在解封包化封包之前解串列化封包。
當命令係(例如)一讀取命令時，介面組件325-1 (例如介面組件325-1之控制器)可回應於讀取命令而(諸如)依類似於(例如相同於)上文結合圖2A及圖2B所描述之方式的一方式引起資料自耦合至介面組件325-1之介面356之一記憶體器件330讀取。讀取資料可自記憶體器件330經由一通道327傳輸至介面356。在一些實例中，控制器可引起讀取資料發送至封包化讀取資料之封包化器/解封包化器。控制器可引起封包化讀取資料發送至將封包化讀取資料傳輸至控制器315之介面352。在一些實例中，介面組件325-1之介面352可在將封包化讀取資料傳輸至控制器315之前串列化封包化讀取資料。
在一些實例中，解封包化封包可包含一寫入命令及待寫入至耦合至介面組件325-1之一記憶體器件330之資料。介面組件325-1之控制器可回應於寫入命令而(諸如)依類似於(例如相同於)上文結合圖2A及圖2B所描述之方式的一方式引起資料寫入至記憶體器件330。
當識別符不匹配一介面組件325-1時，封包可不意欲用於介面組件325-1，且封包可發送(例如無解串列化或解封包化)至介面組件325-1之介面362且隨後自介面組件325-1之介面362經由鏈路335-1發送至介面組件325-2之介面352。介面組件325-2之控制器可判定封包是否意欲用於介面組件325-2 (例如藉由判定封包之識別符是否匹配介面組件325-2之一識別符)。控制器可回應於識別符匹配而判定封包意欲用於介面組件325-2。
當封包意欲用於介面組件325-2時，介面組件325-2之封包化器/解封包化器可將封包解封包化為(例如)命令及位址以判定對耦合至介面組件325-2之哪個封裝332中之哪個記憶體器件330執行何種操作。在一些實例中，介面組件325-2之介面352可回應於介面組件325-2之控制器判定封包意欲用於介面組件325-2而在解封包化封包之前解串列化封包。取決於命令係一讀取命令或一寫入命令，介面組件325-2之控制器可(諸如)依一類似於(例如相同於)上文針對介面組件325-1所描述之方式的一方式引起資料自耦合至介面組件325-2之介面356之一記憶體器件330讀取或引起封包中之資料寫入至耦合至介面組件325-2之介面356之一記憶體器件330。
讀取資料可自記憶體器件330經由一通道327傳輸至介面356。在一些實例中，介面組件325-2之控制器可引起讀取資料發送至封包化讀取資料之封包化器/解封包化器。控制器可引起封包化讀取資料發送至介面組件325-2之介面352，介面組件325-2之介面352經由鏈路335-1將封包化讀取資料傳輸至介面組件325-1之介面362，介面組件325-1之介面362可將封包化讀取資料傳遞至介面組件325-1之介面352，其中介面組件325-1之介面352可經由一鏈路320將封包化讀取資料發送至控制器315。在一些實例中，介面組件325-K與控制器315之間的一群組324之介面組件325 (諸如介面組件325-1及325-2)之控制器可引起該等介面組件325傳遞向上游移動至控制器315之資料(例如讀取資料之封包)或信號。在一些實例中，介面組件325-2之介面352可在將封包化讀取資料傳輸至介面組件325-1之介面362之前串列化封包化讀取資料。
來自控制器315之一封包可在一群組324中自介面組件325 (例如向下游)移動至介面組件325，直至其到達其意欲用於之介面組件325 (例如直至封包之識別符匹配一介面組件325之一識別符)。當判定一封包不意欲用於介面組件325-K與控制器315之間的介面組件325之任何者時，封包可(例如最終)到達介面組件325-K。
介面組件325-K之封包化器/解封包化器可將封包解封包化為(例如)命令及位址以判定對耦合至介面組件325-K之哪個記憶體封裝332中之哪個記憶體器件330執行何種操作。在一些實例中，介面組件325-K之介面352可回應於介面組件325-K之控制器判定封包意欲用於介面組件325-K而在解封包化封包之前解串列化封包。取決於命令係一讀取命令或一寫入命令，介面組件325-K之控制器可(諸如)依類似於(例如相同於)上文針對介面組件325-1及325-2所描述之方式的一方式引起資料自耦合至介面組件325-K之介面356之一記憶體器件330讀取或封包中之資料寫入至耦合至介面組件325-K之介面356之一記憶體器件330。
讀取資料可自記憶體器件330經由一通道327傳輸至介面組件325-K之介面356。在一些實例中，介面組件325-K之控制器可引起讀取資料發送至封包化讀取資料之封包化器/解封包化器。介面組件325-K之控制器可引起封包化讀取資料發送至介面組件325-K之介面352，介面組件325-K之介面352將封包化讀取資料傳輸至下一上游介面組件(諸如K=3時之介面組件325-2)之介面362。介面組件325-2可將封包化讀取資料傳遞至其介面352，介面352可將封包化讀取資料傳輸至介面組件325-1之介面362，介面組件325-1之介面362可將封包化讀取資料傳遞至其介面352，介面352可將封包化讀取資料傳輸至控制器315。在一些實例中，介面組件325-3之介面352可在將封包化讀取資料傳輸至下一上游控制器之介面362之前串列化封包化讀取資料。
儘管本文已繪示及描述特定實例，但一般技術者應瞭解，經計算以達成相同結果之一配置可取代所展示之特定實施例。本發明意欲涵蓋本發明之一或多個實施例之調適或變動。應瞭解，已依一繪示方式而非一限制方式進行以上描述。應參考隨附申請專利範圍以及此等申請專利範圍有權要求之等效物之全範圍來判定本發明之一或多個實例之範疇。
100‧‧‧系統
105‧‧‧主機
108‧‧‧介面
110‧‧‧儲存系統
115‧‧‧控制器
118‧‧‧通道
118-1至118-N‧‧‧通道
120‧‧‧記憶體器件
120-1至120-M‧‧‧記憶體器件
122‧‧‧記憶體封裝
122-1至122-N‧‧‧記憶體封裝
208‧‧‧鏈路
210‧‧‧儲存系統/記憶體系統
215‧‧‧控制器
218‧‧‧通道
218-1至281-N‧‧‧通道
225‧‧‧介面組件
225-1至225-N‧‧‧介面組件
227‧‧‧通道
227-1至227-L‧‧‧通道
230‧‧‧記憶體器件
230-1至230-M‧‧‧記憶體器件
232‧‧‧記憶體封裝
232-1至232-L‧‧‧記憶體封裝
250‧‧‧控制器
252‧‧‧介面
254‧‧‧介面控制器
256‧‧‧介面
258‧‧‧介面控制器
264‧‧‧封包化器/解封包化器
270‧‧‧記憶體管理單元
272‧‧‧損耗均衡引擎
274‧‧‧錯誤校正引擎
310‧‧‧儲存系統
315‧‧‧控制器
318‧‧‧通道
318-1至318-N‧‧‧通道
320‧‧‧鏈路
324‧‧‧群組
324-1至324-N‧‧‧群組
325‧‧‧介面組件
325-1至325-K‧‧‧介面組件
327‧‧‧通道
327-1至327-L‧‧‧通道
330‧‧‧記憶體器件
330-1至330-M‧‧‧記憶體器件
332‧‧‧記憶體封裝
332-1至332-L‧‧‧記憶體封裝
335‧‧‧雙向鏈路
335-1至335-(K-1)‧‧‧雙向鏈路
352‧‧‧介面
356‧‧‧介面
362‧‧‧介面
圖1係繪示根據先前技術之一裝置之一實例的一方塊圖。
圖2A係繪示根據本發明之若干實施例之一裝置之一實例的一方塊圖。
圖2B係繪示根據本發明之若干實施例之一介面組件之一實例的一方塊圖。
圖3係繪示根據本發明之若干實施例之一裝置之另一實例的一方塊圖。

Claims (20)

  1. 一種裝置，其包括： 一控制器，其用於耦合至一主機； 一介面組件，其耦合至該控制器；及 複數個記憶體器件，其等耦合至該介面組件； 其中該介面組件用於引起該複數個記憶體器件之一記憶體器件回應於來自該控制器之一命令而執行一操作。
  2. 如請求項1之裝置，其中該控制器係一第一控制器且其中該介面組件包括一第二控制器。
  3. 如請求項2之裝置，其中該介面組件進一步包括耦合至該第一控制器之一介面。
  4. 如請求項3之裝置，其中該介面組件進一步包括對應於該介面之一介面控制器。
  5. 如請求項1之裝置，其中該介面組件包括封包化器/解封包化器。
  6. 如請求項1至5中任一項之裝置，其中該介面組件進一步包括一記憶體管理引擎、一損耗均衡引擎及一錯誤校正引擎之至少一者。
  7. 如請求項1至5中任一項之裝置，其中該介面組件係一專用積體電路(ASIC)。
  8. 如請求項1至5中任一項之裝置，其中該介面組件用於串列化至該控制器之輸出及解串列化來自該控制器之輸入。
  9. 如請求項1之裝置，其中該介面組件用於封包化來自該複數個記憶體器件之一記憶體器件之一輸入且將該封包化輸入發送至該控制器。
  10. 如請求項1或9之裝置，其中該介面組件用於解封包化來自控制器之一輸入且自該解封包化輸入判定待對該複數個記憶體器件之一記憶體器件執行之一操作。
  11. 如請求項1至5中任一項之裝置，其中該介面組件用於控制以下之至少一者：錯誤校正、存取至該複數個記憶體器件之一記憶體器件、針對該複數個記憶體器件之一記憶體器件之一預留空間操作及針對該複數個記憶體器件之一記憶體器件之一廢棄項目收集操作。
  12. 一種裝置，其包括： 一控制器；及 複數個介面組件，其中該控制器分別經由複數個第一通道之各自者而與該複數個介面組件之各自者通訊； 其中該複數個介面組件之至少一者經由複數個第二通道之一第一者而與第一複數個記憶體器件通訊及經由該複數個第二通道之一第二者而與第二複數個記憶體器件通訊。
  13. 如請求項12之裝置，其中該複數個介面組件之該至少一者係一第一介面組件，且進一步包括與該第一介面組件串列耦合之一第二介面組件，其中該第二介面組件經由複數個第三通道之一第一者而與第三複數個記憶體器件通訊及經由該複數個第三通道之一第二者而與第四複數個記憶體器件通訊。
  14. 如請求項13之裝置，其中 該第一介面組件用於判定來自該控制器之一封包是否意欲用於該第一介面組件；且 該第一介面組件用於回應於判定該封包意欲用於該第一介面組件而對該封包施加作用及回應於判定該封包不意欲用於該第一介面組件而將該封包發送至該第二介面組件。
  15. 一種操作一裝置之方法，其包括： 在一介面組件處自一控制器接收一封包； 使用該介面組件來解封包化該封包；及 回應於該解封包化封包中之一指令而對耦合至該介面組件之一記憶體器件執行一操作。
  16. 如請求項15之方法，其中對該記憶體器件執行該操作包括：自該解封包化封包中所指定之該記憶體器件中之一位置讀取資料。
  17. 如請求項16之方法，其進一步包括：使用該介面組件來封包化該讀取資料；及將該封包化讀取資料自該介面組件發送至該控制器。
  18. 如請求項17之方法，其進一步包括：在將該封包化讀取資料發送至該控制器之前使用該介面組件來串列化該封包化讀取資料。
  19. 如請求項15之方法，其中對該記憶體器件執行該操作包括：將含於該解封包化封包中之資料寫入至該解封包化封包中所指定之該記憶體器件中之一位置。
  20. 如請求項15至19中任一項之方法，其進一步包括：在解封包化該封包之前使用該介面組件來解串列化該封包。
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Families Citing this family (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US10140222B1 (en) * 2017-07-06 2018-11-27 Micron Technology, Inc. Interface components
KR102226712B1 (ko) 2020-10-14 2021-03-10 한수일 치과용 봉합 밴드
US20230068580A1 (en) * 2021-08-27 2023-03-02 Micron Technology, Inc. Memory device with multiple input/output interfaces

Family Cites Families (38)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US813913A (en) 1905-02-17 1906-02-27 Joseph Reid Support for power-carrying lines.
US6215727B1 (en) * 2000-04-04 2001-04-10 Intel Corporation Method and apparatus for utilizing parallel memory in a serial memory system
US7013359B1 (en) * 2001-12-21 2006-03-14 Cypress Semiconductor Corporation High speed memory interface system and method
US20060195631A1 (en) * 2005-01-31 2006-08-31 Ramasubramanian Rajamani Memory buffers for merging local data from memory modules
US7577039B2 (en) * 2005-11-16 2009-08-18 Montage Technology Group, Ltd. Memory interface to bridge memory buses
US7636813B2 (en) * 2006-05-22 2009-12-22 International Business Machines Corporation Systems and methods for providing remote pre-fetch buffers
US7865674B2 (en) 2007-08-31 2011-01-04 International Business Machines Corporation System for enhancing the memory bandwidth available through a memory module
US8131913B2 (en) * 2008-02-04 2012-03-06 Mosaid Technologies Incorporated Selective broadcasting of data in series connected devices
US8856434B2 (en) * 2008-09-26 2014-10-07 Cypress Semiconductor Corporation Memory system and method
US7957173B2 (en) * 2008-10-14 2011-06-07 Mosaid Technologies Incorporated Composite memory having a bridging device for connecting discrete memory devices to a system
US8254191B2 (en) * 2008-10-30 2012-08-28 Micron Technology, Inc. Switched interface stacked-die memory architecture
US8161221B2 (en) 2008-11-25 2012-04-17 Hitachi, Ltd. Storage system provided with function for detecting write completion
US8412880B2 (en) * 2009-01-08 2013-04-02 Micron Technology, Inc. Memory system controller to manage wear leveling across a plurality of storage nodes
US8832354B2 (en) * 2009-03-25 2014-09-09 Apple Inc. Use of host system resources by memory controller
EP2476079A4 (en) 2009-09-09 2013-07-03 Fusion Io Inc APPARATUS, SYSTEM, AND METHOD FOR STORAGE ALLOCATION
US8164936B2 (en) * 2009-10-14 2012-04-24 Seagate Technology Llc Switched memory devices
US8909831B2 (en) * 2009-11-27 2014-12-09 International Business Machines Corporation Logic device
WO2011130007A1 (en) * 2010-04-14 2011-10-20 Rambus Inc. Levelization of memory interface for communicating with multiple memory devices
JP5665974B2 (ja) * 2010-05-07 2015-02-04 コンバーサント・インテレクチュアル・プロパティ・マネジメント・インコーポレイテッドＣｏｎｖｅｒｓａｎｔ Ｉｎｔｅｌｌｅｃｔｕａｌ Ｐｒｏｐｅｒｔｙ Ｍａｎａｇｅｍｅｎｔ Ｉｎｃ． 単一のバッファを用いて複数のメモリ素子を同時にリードする方法及び装置
EP2686774B1 (en) * 2011-03-14 2017-02-01 Hewlett-Packard Enterprise Development LP Memory interface
US9406346B2 (en) * 2011-06-30 2016-08-02 Sandisk Technologies Llc Smart bridge for memory core
US8599623B1 (en) * 2011-12-23 2013-12-03 Suvolta, Inc. Circuits and methods for measuring circuit elements in an integrated circuit device
US9405355B2 (en) * 2012-08-21 2016-08-02 Micron Technology, Inc. Memory operation power management by data transfer time adjustment
KR101987426B1 (ko) * 2012-09-07 2019-09-30 삼성전자주식회사 불휘발성 메모리 모듈, 불휘발성 메모리 모듈을 포함하는 메모리 시스템, 그리고 불휘발성 메모리 모듈의 제어 방법
JP5842174B2 (ja) * 2013-03-13 2016-01-13 パナソニックＩｐマネジメント株式会社 バス制御装置、中継装置およびバスシステム
KR102100707B1 (ko) * 2013-08-19 2020-04-16 에스케이하이닉스 주식회사 데이터 저장 장치
US9213498B2 (en) * 2013-09-03 2015-12-15 Kabushiki Kaisha Toshiba Memory system and controller
US9471254B2 (en) * 2014-04-16 2016-10-18 Sandisk Technologies Llc Storage module and method for adaptive burst mode
US9846661B2 (en) * 2014-07-17 2017-12-19 Empire Technology Development Llc Utilization of solid state memory devices
US10008250B2 (en) * 2015-03-27 2018-06-26 Intel Corporation Single level cell write buffering for multiple level cell non-volatile memory
US9904635B2 (en) * 2015-08-27 2018-02-27 Samsung Electronics Co., Ltd. High performance transaction-based memory systems
KR20170039451A (ko) * 2015-10-01 2017-04-11 삼성전자주식회사 메모리 모듈 및 이를 포함하는 반도체 메모리 시스템
US10146711B2 (en) * 2016-01-11 2018-12-04 Intel Corporation Techniques to access or operate a dual in-line memory module via multiple data channels
KR20170109108A (ko) * 2016-03-17 2017-09-28 에스케이하이닉스 주식회사 메모리 장치를 포함하는 메모리 시스템 및 그의 동작 방법
US10459855B2 (en) * 2016-07-01 2019-10-29 Intel Corporation Load reduced nonvolatile memory interface
JP2018022383A (ja) * 2016-08-04 2018-02-08 東芝メモリ株式会社 メモリシステム
US10282097B2 (en) * 2017-01-05 2019-05-07 Western Digital Technologies, Inc. Storage system and method for thin provisioning
US10140222B1 (en) * 2017-07-06 2018-11-27 Micron Technology, Inc. Interface components

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