SU760113A1 - Синусно-косинусный преобразователь 1 - Google Patents
Синусно-косинусный преобразователь 1 Download PDFInfo
- Publication number
- SU760113A1 SU760113A1 SU782580337A SU2580337A SU760113A1 SU 760113 A1 SU760113 A1 SU 760113A1 SU 782580337 A SU782580337 A SU 782580337A SU 2580337 A SU2580337 A SU 2580337A SU 760113 A1 SU760113 A1 SU 760113A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- outputs
- inputs
- increments
- driver
- input
- Prior art date
Links
Landscapes
- Compression, Expansion, Code Conversion, And Decoders (AREA)
Description
Изобретение относится к области.автоматики и вычислительной техники и может быть использовано в специализированных цифровых вычислителях.
Известно устройство, содержащее 5 кодовый регистр, блок управления, память и сумматоры [1].
Недостатком известного устройства является ограниченное быстродействие. 'θ
Наиболее близок по технической сущности к изобретению преобразователь, содержащий интерполятор, вход’ которого соединен с младшими разрядами кодового регистра, 'генератор. ' 15
меандра, коммутаторы, шифраторы и сумматоры 12].
К недостаткам этого преобразователя относятся его сложность и недостаточное быстродействие. 20
Цель изобретения - повышение быстродействия и упрощение устройства.
Поставленная цель достигается тем, что в синусно-косинусный преобраэова-_ тель, содержащий интерполятор, вход 25 которого подключен к выходам, младших разрядов кодового регистра, введены формирователи приращений по числу старших разрядов кодового регистра, причем выходы старших разрядов кодо- 30
2
вого регистра подключены соответственно к управляющим входам формирователей приращений, первый и второй выходы , -го формирователя приращений соединены;.- с первым и вторым входами ( ί + ( ) -го (формирователя приращенйй, первый и второй выходы интерполятора подключены соответственно к первому и второму входам первого формирователя приращений, а выходы последнего формирователя приращений к выходам преобразователя.
Каждый формирователь приращений содержит сумматоры нечетных и четных приращений, первые входы которых соединены через матричный сумматор с первым входом формирователя, управляющий вход которого подключен к первым входам первого и второго элементов И, вторые входа которых соединены со вторым входом формирователя, выходы элементов И подключены соответственно ко вторым входам сумматоров нечетных и четных приращений, выходы которых соответственно соединены с первым и вторым выходами формирователя.
На фиг. 1 представлена блок-схема преобразователя? на фиг. 2 - эпюры изменения эквивалентных величин выходных сигналов интерполятора; на’
3
760113
4
Фиг. 3, 4"- примеры построения'-О'хемы ( интерполятора соответственно в случае' представления аргумента в виде двоичного рефлективного и двоичного позиционного кодов? на .фиг. 5 - упрощенные эпюры итерационного процесса ИЭ' менения величин на выходах функциональных узлов преобразователя.
Преобразователь (фиг, 1) содержит' кодовый регистр 1, интерполятор 2, формирователи 3, 4, 5 приращений, ,' включающие в себя матричный сумматор ’θ 6, сумматоры 7 и 8 нечетных й четных приращений, элементы И 9, 10.
Преобразователь работает следующим образом. .
. Масштабы значений преобразуемого 15 кода х^(а) и результирующих· функций
х (ά) , ί2*- εο5 γ х (а) опрёдеСены таким образом, что угол в рад · максимальное значение функции ^макс = 1 соответствуют 2П единицам 20 дискретности, Число Ё младших разрядов кодового регистра, образующих .интервал линейной интерполяции, опреде-. ляется с учетом того, чтобы ошибка интерполяции не превосходила одного кванта дискретизации значений функции 8 = 2-".
На фиг. 3 и 4 обозначены одноразрядные сумматоры 11, элементы НЕ 12, α4, а2, аг> ~ двоичные переменные в разрядах рефлективного двоичного ко- 30 да в порядке их возрастания, ао значение Двоичной переменной в дополнительном младшем разряде кода, аналогично через оСа, осл , <х2, οί&(οί4,
) обозначены переменные и 35
лос инверсий в' разрядах позиционного , двоичного кода. В сумматорах 11 осуществляется суммирование помодулю I "2. Код чётной треугольной функции Т(а) получается путем инверсии эле- до ментами НЕ 12 значений οί.,, ос2, <х э в ; разрядах нечетной треугольной функции Т (а), кроме дополнительного младшего разряда кода. )
С первого выхода интерполятора 2 снимается код нечетной треугольной функции Т(а), которая на первом линейном участке интерполяции изменяется в фазе с изменением ко;да аргумента (фиг. 2) > со вто- « рого выхода интерполятора поступа-' 50 ёт кед смещенной на полпериода чётной, треугольной функции Т(а) ( фиг. 2, 3,
4). При этом на обоих выходах реализу; ется дополнйтельный младший разряд кода (фиг. 3, 4) с весом {8= 2-ίηΜ1 » 55
что позволяет усреднить ошибку квантоу вания треугольных функций (фиг. 2).
Сформированные на нечетном и четном выходах интерполятора 2 функции 60 Ύ(α) , Т (а) поступают н'а№Швейй^^|в: о'й'ёрацйонйые входы первого формирователя 3, в котором осуществляется ’ вычисление приращений заданных функ·
•ций на втором шаге итерации. 65
Итерационный процесс вычисления функций реализуется таким образом,, что значение приращений синуса (косинуса) вычисляемые в формирователях '3, 4, 5~ в процессе очередной ’ итерации, находятся в результате умножения на заданный коэффициент $к в сумматоре 6 значений нечетной составляющей > аппроксимирующей функции, полученной в течение предыдущей итерации, и сложения этой величины с удвоенными значениями четной составляющей, поступающей со смещением влево на один разряд на сумматоры 7 и 8 через элементы И 9 и 10 в течение промежутка, который определяется в зависимости от значения двоичной переменной (а^, а5 , ά6) в данном разряде рефлективного кода (фиг. 5). Изменение двоичных переменных в структуре этого кода соот.ветствует порядку суммирования нечетных и четных составляющих аппроксимирующих функций в процессе осуществления очередной итераций (фиг. 5).
Максимальное значение функций Т(а), (а), получаемое в интерполяторе и формирователях приращений, соответствует точкам многократного деления на 2 заданного промежутка ' изменения аргумента^[0,] (фиг. 5). Значения функции з)η X в этих точках определяют .соотношение масштабов между соседними аппроксимирующими функциями
макс
'^^Э^макс
Пад)
макс
(а^мснкс Р(°4) макс
Т*(о) ма кс
-Ζ4 ,4
-^52005(,-2-)-2^
3ί^.2οο^^).2ι;·
5<П
(и
8
5'" Е
С увеличением числа разрядов преобразуемого кодакустановленные коэфеициенты, определяющие соотношение г ежду аппроксимирующими функциями, остаются без изменения, изменяется только количество этих коэффициентов, которое равно количеству формирователей.
В результате выполнения последней итерации в формирователе 5 на выходах
преобразователя получаются искомые____'
значения функций синуса и косинуса, вычисленные с точностью, определяемой числом разрядов аргумента. ' ,
_ Изобретение позволяет повысить быстродействие вдвое по сравнению с ·
прототипом и уменьшить объем изпользуемой аппаратуры.
Claims (1)
- Формула изобретенияI. Синусно-косинусный преобразова тель, содержащий интерполятор, вход57601136'которого подключен к выходам младшйх разрядов кодового регистра, отлич а ю ад и й с я тем, что, с целью повышения быстродействия, и упрощения устройства, преобразователь содержит,формирователи приращений по » числу (старших разрядов кодового регистра, причем выходы старших разрядов кодового регистра подключены соответственно к управляющим входам формирователей приращений, первый и второй выходы ι -го формирователя прираще·’0 ний соединены с первым и вторым входами (ΐ + 1)-го формирователя приращений, первый и второй выходы интерполятора подключены соответственно к первому и второму входам первого 15 формирователя приращений, выходы .(последнего формирователя приращений соединены с выходами преобразователя, 2. Преобразователь по п.1, отформирователь приращений содержит сумматоры нечетных и четных Приращений, первые входы которых соединены через матричный сумматор с первым входом формирователя, управляющий вход которого подключен к первым входам первого и второго элементов И, вторые входы которых соединены со вторым входом формирователя, выходы элементов |И подключены соответственно ко вторым входам сумматора нечетных и четных приращений, 'выходы которых соответственно соединены с первым и вторым выходами формирователя.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU782580337A SU760113A1 (ru) | 1978-02-13 | 1978-02-13 | Синусно-косинусный преобразователь 1 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU782580337A SU760113A1 (ru) | 1978-02-13 | 1978-02-13 | Синусно-косинусный преобразователь 1 |
Publications (1)
Publication Number | Publication Date |
---|---|
SU760113A1 true SU760113A1 (ru) | 1980-08-30 |
Family
ID=20749170
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU782580337A SU760113A1 (ru) | 1978-02-13 | 1978-02-13 | Синусно-косинусный преобразователь 1 |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU760113A1 (ru) |
-
1978
- 1978-02-13 SU SU782580337A patent/SU760113A1/ru active
Similar Documents
Publication | Publication Date | Title |
---|---|---|
EP0364627B1 (en) | Data processing apparatus for calculating a multiplicatively inverted element of a finite field | |
Bettis | Numerical integration of products of Fourier and ordinary polynomials | |
KR100309724B1 (ko) | 리드 솔로몬 부호화 장치 및 방법 | |
KR900702327A (ko) | 절대위치 엔코더 | |
JPS5922165A (ja) | アドレス制御回路 | |
SU760113A1 (ru) | Синусно-косинусный преобразователь 1 | |
Blackburn | Fast rational interpolation, Reed-Solomon decoding, and the linear complexity profiles of sequences | |
SU1751735A1 (ru) | Синусно-косинусный преобразователь | |
SU879603A1 (ru) | Функциональный преобразователь | |
SU676986A1 (ru) | Цифровой функциональный преобразователь | |
SU580564A1 (ru) | Цифро-аналоговый кусочно-линейный аппроксиматор | |
SU1086428A1 (ru) | Цифровой масштабный преобразователь | |
SU942004A1 (ru) | Цифровой преобразователь координат | |
SU953721A2 (ru) | Цифро-аналоговый преобразователь | |
SU1072033A1 (ru) | Цифровой функциональный генератор | |
JPH0778748B2 (ja) | ガロア体演算ユニット | |
SU1132295A2 (ru) | Вычислительный узел цифровой сетки | |
SU1385239A1 (ru) | Формирователь сигналов с заданным законом изменени фазы | |
SU741234A1 (ru) | Линейно-круговой интерпол тор | |
SU1064280A1 (ru) | Синусно-косинусный преобразователь | |
SU982003A1 (ru) | Псевдостохастический сумматор | |
SU849210A1 (ru) | Устройство дл вычислени логарифмачиСлА | |
SU541189A1 (ru) | Преобразователь перемещени в код | |
SU834725A1 (ru) | Устройство дл линеаризации харак-ТЕРиСТиК чАСТОТНыХ дАТчиКОВ | |
SU1278897A1 (ru) | Устройство дл синусно-косинусного цифроаналогового преобразовани |