SU1441395A1 - Сумматор-умножитель по модулю три - Google Patents
Сумматор-умножитель по модулю три Download PDFInfo
- Publication number
- SU1441395A1 SU1441395A1 SU874264760A SU4264760A SU1441395A1 SU 1441395 A1 SU1441395 A1 SU 1441395A1 SU 874264760 A SU874264760 A SU 874264760A SU 4264760 A SU4264760 A SU 4264760A SU 1441395 A1 SU1441395 A1 SU 1441395A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- elements
- inputs
- input
- adder
- multiplier
- Prior art date
Links
Landscapes
- Complex Calculations (AREA)
Abstract
Изобретение относитс к. области автоматики и вычислительной техники и может быть использовано в системах и устройствах, фун|сционирующих в системе остаточных классов. Цель изобретени - сокращение аппаратурных затрат. Поставленна цель дости- гаетс тем, что сумматор-уможитель по модулю три, содержапц й элементы И 2,6,12 - 18,24-29, элементы ИЛИ-НЕ 3,7, элементы ИСКЛЮЧАЮЩЕЕ ИЛИ 4,8 и элементы ИЛИ 19, 21,содержит элементы И 30-35 с соответствующими св з ми 59 9 « 1 Ш1., 1 табл. с Ш (Л :о ю СП
Description
Изобретение относитс к автоматике и вычислительной технике и может быть использовано в системах и устройствах , функционирующих в система остаточных классов (СОК).
Целью изобретени вл етс сокращение аппаратурных затрат.
На чертеже представлена схема сумматора-умножител по модулю три.
Сумматор-умножитель содержит вход 1 старшего разр да первого операнда сумматора-умножител , первый элемент И 2, первый элемент ИЛИ- НЕ 3, первый элемент ИСКЛЮЧАЩЕЕ ИЛИ 4, вход 5 младшего разр да первого операнда сумматора-умножител , второй элемент И 6, второй элемент ИЛИ-НЕ 7, второй элемент ИСКЛЮЧАЮЩЕЕ ИЛИ 8, вход 9 старшего разр да второго операнда сумматора-умножител , вход 10 задани режима умножени сумматора-умножител , вход 11 задани режима сложени сумматора- умножител , с третьего по дев тый элементы И 12 - 18 соответственно, первый элемент ИЛИ 19, выход 20 старшего разр да результата сзгммато- ра-умножител , второй элемент ИЛИ 21, выход 22 младшего разр да результата сумматора-умножител , вход 23 младшего разр да второго операнда сумматор,а-умножител , с дес того по двадцать первый элементы И 24 - -35 соответственно.
При этом элементы И 2, ИЛИ-НЕ 3, ИСКЛЮЧАЩЕЕ ИЛИ 4, И 6, ШШ-РЕ 7, ИСКЛЮЧАЮЩЕЕ ИЛИ 8 образуют два дешифратора двоичного кода в унитарный код.
Сумматор-умножитель по модулю три работает следующим образом.
На входы 1 и 9 сумматора-умножитл поступает значение а , старших разр дов входных операндов А (а., а, ), В (/5.,,, , ), а на входы 5 и 23 - значение а,, , младших ,разр дов.
Алгоритм образовани двухразр дного Y Y. выходного кода (результата операции) дл операции сложени и умножени задан таблицей.
Элементы И 2, ИЛИ-НЕ 3, ИСКЛЮЧАЮЩЕЕ ИЖ 4 И 6, ИЛИ-НЕ 7, ИСКЛЮЧАЮЩЕЕ ИЛИ 8 формируют сигналы коли- чества единиц в старшем (младшем) разр де операндов А и В. Затем в зависимости от признака операции - наличие сигнала входа 10 (умножение
5
0
5
0
5
0
5
0
5
или наличие сигнала входа 11 (сложение ) - сформированные сигналы анализируютс посредством элементов И 24 - 35, элементов И 12 - 18 и элементов ИЛИ 19 и 21. Далее данна группа логических элементов шифрует эти сигналы в код суммы (произведени ) по модулю три, поступающий на выходы 20 и 22 сумматора-умножител .
Claims (1)
- Формула изобретениСумматор-умножитель по модулю три, содержащий два элемента ЙЛИ-НЕ, два элемента ИСКЛЮЧАВДЕЕ ИЛИ, два элемента ИЛИ и п тнадцать элементов И, причем вход старшего разр да первого операнда сумматора-умножител соединен с первыми входами первого элемента И, первого элемента ИЛИ-НЕ и первого элемента ИСКЛЮЧАЩЕЕ ИЛИ, вход младшего разр да второго операнда сумматора-умножител Соединен с- первыми входами второго элемента И, второго элемента ИЛИ-НЕ и второго элемента ИСКЛЮЧАЩЕЕ ИЛИ, выходы элементов И с третьего по дев тый соединены соответственно с первым и вторым входами первого элемента ИЛИ, с первым и вторым входами второго элемента ИЛИ, с третьим входом первого элемента ИЛИ, с третьим и четвертым входами второго элемента ИЛИ, вход задани режима умножени сумматора-умножител соединен с первыми входами элементов И с дес того по двенадцатый,.вход задани режима сложени сумматора- умножите-. л соединен с первыми входами элементов И с тринадцатого по п тнадцатый, отличающийс тем, что, с целью сокращени аппаратурных затрат , он содержит элементы И с шестнадцатого по двадцать первый, причем вход старшего разр да второго операнда сумматора-умножител соединен с вторыми входами первого элемента И, первого элемента ШШ-НЕ и первого элемента ИСКШОЧАЩЕЕ ИЛИ, вход младшего разр да пергого операнда сумматора-умножител соединен с вторыми входами второго элемента IT, второго элемента ШШ-НЕ и второго элемента , ИСКЛЮЧАЩЕЕ ИЛИ, выходы первого и второго элементов ИЛИ вл ютс соответственна выходами старшего и младшего разр дов результата сумматора- умножител , вход задани режима умножени сумматора-умножител соединенс первыми входами элементов И с шестнадцатого по восемнадцать, вход задани режима сложени сумматора- умножител соединен с первыми входами элементов И с дев тнадцатого по двадцать первый, выход первого элемента И соединен с вторыми входами дес того и тринадцатого элементов И, выходы которых соединены с первыми входами соответственно дев того и п того элементов И, выход первого элемента ИЛИ-НЕ соединен с вторыми входами одиннадцатого и четырнадцатого элементов И, выходы которых сое- динены соответственно с первыми входами восьмого и третьего элементов И,- выход первого элемента ИСКЛЮЧАЮЩЕЕ ИЛИ соединен с вторыми входами дев тнадцатого, и п тнадцатого элементов И, выходы которых соедипены: соответственно с первыми входами седьмого и четвертого элементов И,.выход второго элемента И соединен с вторыми входами шестнадцатого и дев тнадцатого элементов И, выходы которых соединены соответственно с вторыми входами восьмого и третьего элементов И, выход второго элемента ИЛИ-НЕ соединен с вторыми -йходами семнадцатого и двадцатого элементов0 И, выходы которых соединены с втЬры- ми входами соответственно дев того и четвертого элементов И, выход второго элемента ИСКЛЮЧАЮЩЕЕ ИЛИ соединен с вторыми входами восе надЦатого5 и двадцать первого элементов И, выходы которых соединены соответственно с вторым входом седьмого элемента И и с первым входом шестого элемента И, второй вход которого соединен с0 выходом четырнадцатого элемента И, выход двадцатого элемента И соединен с вторым входом п того элемента И.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU874264760A SU1441395A1 (ru) | 1987-06-19 | 1987-06-19 | Сумматор-умножитель по модулю три |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU874264760A SU1441395A1 (ru) | 1987-06-19 | 1987-06-19 | Сумматор-умножитель по модулю три |
Publications (1)
Publication Number | Publication Date |
---|---|
SU1441395A1 true SU1441395A1 (ru) | 1988-11-30 |
Family
ID=21311941
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU874264760A SU1441395A1 (ru) | 1987-06-19 | 1987-06-19 | Сумматор-умножитель по модулю три |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU1441395A1 (ru) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
RU2762548C1 (ru) * | 2020-09-25 | 2021-12-21 | федеральное государственное бюджетное образовательное учреждение высшего образования "Ульяновский государственный технический университет" | Сумматор-умножитель по модулю три |
RU2778676C1 (ru) * | 2021-06-17 | 2022-08-23 | федеральное государственное бюджетное образовательное учреждение высшего образования "Ульяновский государственный технический университет" | Арифметическое устройство по модулю три |
-
1987
- 1987-06-19 SU SU874264760A patent/SU1441395A1/ru active
Non-Patent Citations (1)
Title |
---|
Авторское свидетельство СССР № 1173409, кл. G 06 F 7/72, 1983. Авторское свидетельство СССР № 378845, кл. G 06 F 7/72, 1970. * |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
RU2762548C1 (ru) * | 2020-09-25 | 2021-12-21 | федеральное государственное бюджетное образовательное учреждение высшего образования "Ульяновский государственный технический университет" | Сумматор-умножитель по модулю три |
RU2778676C1 (ru) * | 2021-06-17 | 2022-08-23 | федеральное государственное бюджетное образовательное учреждение высшего образования "Ульяновский государственный технический университет" | Арифметическое устройство по модулю три |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
EP0921462B1 (en) | Arithmetic unit | |
EP0162499A2 (en) | Fading circuit for video signals | |
US4660165A (en) | Pyramid carry adder circuit | |
US3575591A (en) | Addition circuit for the digital codes generated in accordance with a nonlinear compression law | |
SU1441395A1 (ru) | Сумматор-умножитель по модулю три | |
US4713828A (en) | Data reduction circuit | |
RU2015537C1 (ru) | Умножитель на два по модулю | |
SU1667054A1 (ru) | Сумматор-умножитель по модулю три | |
EP0470793B1 (en) | Digital signal orthogonal transformer apparatus | |
RU2149442C1 (ru) | Устройство для умножения по модулю семь | |
RU2143722C1 (ru) | Устройство для умножения по модулю семь | |
RU2021630C1 (ru) | Устройство для сложения по модулю три | |
SU1401452A1 (ru) | Сумматор по модулю три | |
KR100200490B1 (ko) | 데이타 인터페이스 장치 | |
KR100239631B1 (ko) | 디지틀 승산기 | |
RU2192092C1 (ru) | УСТРОЙСТВО ДЛЯ ПРЕОБРАЗОВАНИЯ n-РАЗРЯДНОГО ДВОИЧНОГО ПОЗИЦИОННОГО КОДА В ДВОИЧНЫЙ КОД ОСТАТКА ПО МОДУЛЮ m | |
SU1683014A1 (ru) | Устройство дл возведени чисел в степень по модулю три | |
SU1162040A1 (ru) | Цифровой накопитель | |
RU2090924C1 (ru) | Вычислительное устройство по модулю три | |
RU2018925C1 (ru) | УСТРОЙСТВО ДЛЯ СЛОЖЕНИЯ И ВЫЧИТАНИЯ ТРЕХ ЧИСЕЛ ПО МОДУЛЮ 2n-1 | |
RU2037269C1 (ru) | Преобразователь четырехразрядного кода грея в двоично-десятичный код | |
SU1136153A1 (ru) | Устройство дл вычислени функции @ = @ + @ | |
SU789998A1 (ru) | След щий стохастический интегратор | |
SU1019447A1 (ru) | Двоично-дес тичный кодочастотный перемножитель | |
SU1043636A1 (ru) | Устройство дл округлени числа |