SU117503A1 - Двоичный реверсивный счетчик с запуском триггеров по единичным входам - Google Patents
Двоичный реверсивный счетчик с запуском триггеров по единичным входамInfo
- Publication number
- SU117503A1 SU117503A1 SU583496A SU583496A SU117503A1 SU 117503 A1 SU117503 A1 SU 117503A1 SU 583496 A SU583496 A SU 583496A SU 583496 A SU583496 A SU 583496A SU 117503 A1 SU117503 A1 SU 117503A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- trigger
- state
- counter
- reversible counter
- input
- Prior art date
Links
Landscapes
- Bus Control (AREA)
Description
Одним из узлов вычислительных машин дискретного действи служит реверсивный счетчик, преобразующий последовательность входных импульсов в код числа импульсов, поступивших в течение команды «сложение (иногда с вычетом числа импульсов, пришедших в течение команды «вычитание).
Во всех известных схемах двоичных реверсивных счетчиков используетс счетный запуск триггера, когда сигнал подаетс одновременно на оба входа триггера.
Однако счетный запуск триггера имеет малую надежность и недостаточное быстродействие.
В описываемом счетчике осушествл етс не счетный, а раздельны запуск триггеров. Кроме того, из логических систем схем типа «И образованы две цепочки раздельного управлени , к которым подключено по одному входу триггера каждого разр да, а передача сигнала по цепочкам осуществл етс при совпадении сигналов на общем входе счетчика и на шине сложени (или на шине вычитани ), что увеличивает надежность работы и быстродействие.
На чертеже приведена принципиальна схема реверсивного счетчика с запуском триггеров по единичным входам.
Схема работает следующим образом.
Счетные импульсы поступают на входы схем совпадени С+ и С. В зависимости от команды « + или «- импульсы подают на цепочку схем совпадени (шину) сложени (Q, , С, и т. д. дл большего числа разр дов) или на цепочку схем совпадений (шину вычитани (Cj-, С, и т. д.). Кажда из схем совпадени ,+, С,/, нропускает импульс в том случае, если соответствующий триггер Ti, TZ, Т находитс в состо нии «1, а кажда из схем совпадечи С, С.,, Су пропускает импульс, когда соответствующий триггер TI, TZ, TZ находитс в состо нии «о.
№ 117503- 2 -
При подаче команды « + счетный импульс поступает на вход «1 триггера TI и через врем задержки линии, равное длительности импульса tu, переводит триггер в состо ние «1, если триггер находилс в состо нии «О. Схема совпадений С|+ при этом не пропускает, так как триггер в течение времени импульса остаетс в состо нии «О. Таким образом , число, запасенное в счетчике, увеличиваетс на единицу.
Если в исходном состо нии триггер TI находилс в состо нии «1, то импульс, приход щий на вход 1, не мен ет состо ни триггера. Схема совпадени Ci+ при этом пропускает входной импульс, который устанавливает единицу во втором разр де счетчика. Через врем 2tu импульс с выхода Cj поступает на вход установки нул триггера TI и приводит его в состо ние «О. Следовательно, и в этом случае число, запасенное в счетчике, увеличиваетс на единицу (единица во втором разр де минус единица в первом разр де).
Аналогично работает счетчик при команде «-, а именно: если триггер TI находилс в состо нии «1, то входной импульс переводит его в состо ние «О, схема совпадени Ci при этом не пропускает. Число, запасенное в счетчике, уменьшаетс на единицу.
Если триггер Г находилс в состо нии «О, то входной импульс, не мен состо ни TI, поступает на вход установки нзл триггера Т. По истечении времени, равного 2tu, триггер TI переводитс в состо ние «1 импульсом с выхода схемы Ci. Следовательно, и в этом случае число, запасенное в счетчике, уменьшаетс на единицу.
Предмет изобретени
Двоичный реверсивный счетчик с запуском триггеров по единичным входам, содержащий триггеры, логические схемы и линии задержки сигналов , отличающийс тем, что, с целью увеличени надежности работы и быстродействи , из логичных схем типа «И образованы две цепочки раздельного управлени , к которым подключено по одному входу триггера каждого разр да, а передача сигнала по цепочкам осуществл етс при совпадении сигналов на общем входе счетчика и на шине сложени или на шине вычитани .
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU583496A SU117503A1 (ru) | 1957-09-17 | 1957-09-17 | Двоичный реверсивный счетчик с запуском триггеров по единичным входам |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU583496A SU117503A1 (ru) | 1957-09-17 | 1957-09-17 | Двоичный реверсивный счетчик с запуском триггеров по единичным входам |
Publications (1)
Publication Number | Publication Date |
---|---|
SU117503A1 true SU117503A1 (ru) | 1957-11-30 |
Family
ID=48389649
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU583496A SU117503A1 (ru) | 1957-09-17 | 1957-09-17 | Двоичный реверсивный счетчик с запуском триггеров по единичным входам |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU117503A1 (ru) |
-
1957
- 1957-09-17 SU SU583496A patent/SU117503A1/ru active
Similar Documents
Publication | Publication Date | Title |
---|---|---|
SU117503A1 (ru) | Двоичный реверсивный счетчик с запуском триггеров по единичным входам | |
SU470922A1 (ru) | Устройство дл счета импульсов | |
SU402156A1 (ru) | Распределитель импульсов | |
SU455493A1 (ru) | Реверсивный двоично-дес тичный счетчик | |
SU425337A1 (ru) | Устройство для выделения одиночного импульсам\ | |
SU1267614A1 (ru) | Счетчик | |
SU520714A1 (ru) | Двоичный счетчик импульсов с контролем ошибок | |
SU527825A1 (ru) | Счетчик импульсов | |
SU433643A1 (ru) | ||
SU497733A1 (ru) | Счетчик импульсов в телеграфном коде | |
SU508940A1 (ru) | Двоичный счетчик | |
SU560222A1 (ru) | Устройство дл преобразовани двоичного кода в код гре и обратно | |
SU1406789A1 (ru) | Реверсивный счетчик | |
SU678672A1 (ru) | Перестраиваемый делитель частоты | |
SU1275762A1 (ru) | Делитель частоты следовани импульсов | |
SU466508A1 (ru) | Устройство дл сравнени двоичных чисел | |
SU457158A1 (ru) | Цифрова регулируема лини задержки | |
SU1522383A1 (ru) | Цифровой генератор импульсов | |
SU473181A1 (ru) | Устройство дл сравнени двоичных чисел | |
SU364964A1 (ru) | Всесоюзная пат?111110-1шяп?! | |
SU474051A1 (ru) | Устройство дл ввода информации в сдвиговый регистр | |
SU843248A2 (ru) | Двоично-дес тичное пересчетноеуСТРОйСТВО | |
SU575645A2 (ru) | Устройство дл срвнени следующих друг за другом чисел | |
SU1264165A1 (ru) | Накапливающий сумматор | |
SU1024905A1 (ru) | Устройство дл вычислени разности квадратов двух чисел |