RU2005128884A - Преобразователь время-код - Google Patents

Claims (3)

1. Преобразователь время-код, содержащий соединенный с входным зажимом буферный элемент, цифровую линию задержки, которая имеет множество выходов, соединенный с опорным генератором сигнальный вход и управляющий вход, подключенный к выходу блока фазового сравнения, пара входов которого присоединена к входу и основному выходу цифровой линии задержки, а также первый блок регистров, информационные входы регистров которого подключены к соответствующим выходам цифровой линии задержки, причем каждый регистр в первом блоке регистров имеет собственный тактовый вход, отличающийся тем, что в него введены управляемый элемент задержки, блок фазовой интерполяции, второй блок регистров, первый и второй шифраторы, счетчик импульсов и блок вычитания, выходы которого являются выходами преобразователя время-код, а соответствующие входы подключены к выходам счетчика импульсов, второго и первого шифраторов, при этом входы первого и второго шифраторов соединены с соответствующими выходами первого и второго блока регистров соответственно, информационные входы второго блока регистров объединены с соответствующими информационными входами первого блока регистров, тактовые входы всех регистров в обоих блоках регистров присоединены к соответствующим выходам блока фазовой интерполяции, первый вход которого вместе с управляющим входом счетчика импульсов и входом управляемого элемента задержки подключен к выходу буферного элемента, а второй вход - к выходу управляемого элемента задержки, управляющий вход управляемого элемента задержки объединен с управляющим входом цифровой линии задержки, основным выходом присоединенной к счетному входу счетчика импульсов.

2. Преобразователь время-код по п.1, отличающийся тем, что цифровая линия задержки выполнена в виде последовательной цепи управляемых элементов задержки, объединенные управляющие входы которых служат управляющим входом цифровой линии задержки, а их выходы - выходами цифровой линии задержки.

3. Преобразователь время-код по п.1, отличающийся тем, что блок фазовой интерполяции содержит последовательно соединенные каскады интерполяции, каждый i-ый каскад интерполяции имеет (2^i-1+1) входов и (2ⁱ+1) выходов, выходы оконечного каскада интерполяции служат выходами блока фазовой интерполяции, при этом каждый каскад интерполяции включает (2^i-1+1) элементов интерполяции, имеющих первый и второй парафазные входы и парафазный выход, первый и второй входы элементов интерполяции с нечетными порядковыми номерами в каждом упомянутом каскаде объединены и служат входами каскада интерполяции, первый и второй входы элементов интерполяции с четными порядковыми номерами в каждом упомянутом каскаде подключены к объединенным входам соответствующих элементов интерполяции с нечетными порядковыми номерами, отличающимися от порядкового номера данного элемента интерполяции на ±1, выходы всех элементов интерполяции данного каскада составляют совокупность выходов каскада интерполяции.