KR970705232A - 열밸런스회로 - Google Patents
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- H03K21/08—Output circuits
- H03K21/12—Output circuits with parallel read-out
Abstract
CMOSㆍIC를 지연회로로서 이용하는 경우에, 이 지연회로에의 입력신호의 주파수가 변하더라도 입력신호에 일정한 지연시간을 부여할 수 있는 열밸런스 회로를 제공한다. CMOSㆍIC내에 지연회로(10)및 이 지연회로와 동일한 구성의 더미회로(11)를 설치한다. 지연회로에 공급하는 제 1펄스신호(CP1)를 일정시간 계수하는 카운터 및 이 카운터의 계수치와 미리 정한 설정치와의 차를 구하는 연산수단을 설치하고, 이 연산수단으로 부터 산출된 차의 값과 동일한 개수의 제2의 펄스신호를 더미회로에 공급하고, 단위시간내에 CMOSㆍIC에 공급하는 제1및 제2펄스의 수를 일정치로 규정함으로써, CMOSㆍIC의 발열량을 균일화 한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 1도는 이 발명에 의한 열 밸런스회로의 일실시예를 도시하는 블록도이다.
제 2도는 제 1도의 열 밸런스회로의 동작을 설명하기 위한 파형도이다.
Claims (7)
- 입력신호에 소정의 지연시간을 부여하여 출력하는 지연회로와 상기 지연회로에 접속되어, 지연되어야 할 제1의 펄스신호를 상기 지연회로에 공급하기 위한 제1의 펄스공급로, 상기 제1의 펄스공급로로부터 공급되는 제1의 펄스신호의 주파수와 동일하거나 그 이상의 주파수의 제2의 펄스신호를 공급하기 위한 제2의 펄스공급로, 미리 정한 일정시간내에 상기 제1의 펄스신호의 수를 계수하는 카운터, 상기 카운터의 계수치와 미리 정한 값과의 차를 구하는 연산수단과, 상기 연산수단에서 구한 차와 동일한 수의 상기 제2의 펄스신호를 추출하는 펄스추출수단, 및 상기 펄스 추출수단에 의하여 추출된 상기 제2의 클록펄스가 부여되고, 동시에 상기 지연회로에 근접하여 설치된 상기 지연회로와 동일한 구성의 더미회로를 구비하는 것을 특징으로 하는 열밸런스회로.
- 제 1 항에 있어서, 상기 연산수단은 프리세트 가능한 카운터에 의하여 구성되고, 상기 프리세트 가능한 카운터는 상기 풀카운트치와 상기 카운터로 부터 입력된 상기 카운터의 계수치와의 차를 구하도록 동작하는 것을 특징으로 하는 열밸런스회로.
- 제 1 항에 있어서, 상기 지연회로 및 더미회로는 하나의 반도체 집적회로로서 구성되어 있는 것을 특징으로 하는 열밸런스회로.
- 제 3 항에 있어서, 상기 반도체 집적회로가 CMOSㆍIC인 것을 특징으로 하는 열밸런스회로.
- 제 1 항 또는 2 항에 있어서, 상기 카운터가 상기 제1펄스신호를 계수하는 시간을 일정하게 제어하기 위한 시간계측수단을 더욱 포함하는 것을 특징으로 하는 열밸런스회로.
- 제 5 항에 있어서, 상기 시간계측수단은 상기 제2의 펄스공급로에 접속된 카운터 및 상기 카운터의 출력을 논리제어하는 논리회로로 구성되어 있고, 상기 카운터가 상기 제2의 펄스신호의 계수를 시간계측한 후 풀카운트치에 도달하기까지의 시간에, 상기 제1의 펄스신호를 계수하는 동작을 수행하게 하는 것을 특징으로 하는 열밸런스회로.
- 제 5 항에 있어서, 상기 시간계측수단은 상기 제2의 펄스공급로에 접속된 카운터 및 상기 카운터의 출력을 논리제어하는 논리회로로 구성되어 있고 상기 카운터가 풀카운트 치에 도달하였을 때에 상기 제1의 펄스 신호를 계수하는 카운터의 계수치를 상기 연산수단에 입력시키도록 하는 것을 특징으로 하는 열밸런스회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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