KR970008210A - 반도체 메모리의 고속 리던던시 디코더 회로 - Google Patents

반도체 메모리의 고속 리던던시 디코더 회로 Download PDF

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KR970008210A
KR970008210A KR1019950021048A KR19950021048A KR970008210A KR 970008210 A KR970008210 A KR 970008210A KR 1019950021048 A KR1019950021048 A KR 1019950021048A KR 19950021048 A KR19950021048 A KR 19950021048A KR 970008210 A KR970008210 A KR 970008210A
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    • G11C17/14Read-only memories programmable only once; Semi-permanent stores, e.g. manually-replaceable information cards in which contents are determined by selectively establishing, breaking or modifying connecting links by permanently altering the state of coupling elements, e.g. PROM
    • G11C17/143Read-only memories programmable only once; Semi-permanent stores, e.g. manually-replaceable information cards in which contents are determined by selectively establishing, breaking or modifying connecting links by permanently altering the state of coupling elements, e.g. PROM using laser-fusible links

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Abstract

1. 청구 범위에 기재된 발명이 속한 기술 분야
반도체 메모리의 리던던시 디코더 회로.
2. 발명이 해결하려고 하는 기술적 과제
동작 지연시간을 줄일 수 있는 고속 리던던시 회로를 제공한다.
3. 발명의 해결방법의 요지
개선된 반도체 메모리의 리던던시 디코더 회로는 어드레스 입력부와; 전류 스위칭부와; 에미터 플로워와; 전류 오소스부를 가짐을 특징으로 한다.
4. 발명의 중요한 용도
반도체 메모리의 리던던시 디코더로서 적합하게 사용된다.

Description

반도체 메모리의 고속 리던던시 디코더 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명에 따른 리던던시 디코더 회로도.

Claims (4)

  1. 반도체 메모리의 리던던시 디코더 회로에 있어서: 각각의 콜렉터단자로는 전원 전압을 수신하며 각각의 베이스 단자로는 리던던시 어드레스 및 상보 어드레스의 신호를 차례로 각기 수신하는 바이폴라 트랜지스터들과, 상기 바이폴라 트랜지스터들의 각각의 에미터와 풀다운 노드간에 각기 접속된 퓨징가능한 퓨즈들을 포함하는 어드레스 입력부와; 미리설정된 기준전압을 베이스단자로 수신하는 바이폴라 트랜지스터와, 상기 바이폴라 트랜지스터의 에미터와 상기 풀다운 노드간에 접속된 퓨즈, 및 상기 바이폴라 트랜지스터의 콜렉터단자와 상기 전원전압간에 연결된 저항을 포함하는 전류스위칭부와; 상기 전류 스위칭부의 상기 저항과 상기 콜렉터단자간의 중간접속점에 베이스 단자가 연결되고 콜렉터단자가 상기 전원전압에 연결되며 출력노드에 에미터가 연결된 바이폴라 트랜지스터 및 상기 출력노드에 드레인 단자가 연결되고 접지단에 소오스 단자가 연결되고 전류소오스 제어노드에 게이트 단자가 연결된 모오스 트랜지스터를 포함하는 에미터 플로워와; 및 상기 전원전압에 일단이 연결된 저항 및 상기 저항의 타단이 되는 상기 전류소오스 제어노드와 접지간에 연결된 퓨즈와 상기 전류소오스 제어노드에 게이트 단자가 연결되고 상기 풀다운 노드와 접지간에 드레인 소오스 채널이 연결된 풀다운 트랜지스터를 포함하는 전류 소오스부를 가짐을 특징으로 하는 디코더 회로.
  2. 스태이틱 반도체 메모리의 리던던시 디코더 회로에 있어서:각각의 드레인 단자로는 전원전압을 수신하며 각각의 게이트 단자로는 리던던시 어드레스 및 상보 어드레스의 신호를 차례로 각기 수신하는 모오스 트랜지스터들과, 상기 모오스 트랜지스터들의 각각의 소오스와 풀다운 노드간에 각기 접속된 퓨징가능한 퓨즈들을 포함하는 어드레스 입력부와; 미리설정된 기준전압을 베이스단자로 수신하는 바이폴라 트랜지스터와, 상기 바이폴라 트랜지스터의 에미터와 상기 풀다운 노드간에 접속된 퓨즈, 및 상기 바이폴라 트랜지스터의 콜렉터단자와 상기 전원전압간에 연결된 저항을 포함하는 전류 스위칭부와; 상기 전류 스위칭부의 상기 저항과 상기 콜렉터단자간의 중간접속점에 베이스 단자가 연결되고 콜렉터단자가 상기 전원전압에 연결되며 출력노드에 에미터가 연결된 바이폴라 트랜지스터 및 상기 출력노드에 드레인 단자가 연결되고 접지단에 소오스 단자가 연결되고 전류소오스 제어노드에 게이트 단자가 연결된 모오스 트랜지스터를 포함하는 에미터 플로워와; 및 상기 전원전압에 일단이 연결된 저항 및 상기 저항의 타단이 되는 상기 전류소오스 제어노드와 접지간에 연결된 퓨즈와 상기 전류소오스 제어노드에 게이트 단자가 연결되고 상기 풀다운 노드와 접지간에 드레인 소오스 채널이 연결된 풀다운 트랜지스터를 포함하는 전류 소오스부와; 상기 출력노드의 전압레벨을 인버팅하여 디코딩 신호로서제공하는 인버터를 포함하는 것을 특징으로 하는 디코더 회로.
  3. 제2항에 있어서, 상기 퓨즈들은 레이저 광에 의해 퓨징되는 것을 특징으로 하는 디코더 회로.
  4. 제2항에 있어서, 상기 미리설정된 기준전압은 상기 리던던시 어드레스 신호의 로직 하이와 로우의 중간레벨 정도의 전압임을 특징으로 하는 디코더 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019950021048A 1995-07-18 1995-07-18 반도체 메모리의 고속 리던던시 디코더 회로 KR0164398B1 (ko)

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Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100373980B1 (ko) * 1996-03-14 2003-05-12 (주)베이크라이트코리아 자동차 이그니션 코일용 에폭시수지 조성물
KR20030056495A (ko) * 2001-12-28 2003-07-04 주식회사 효성 몰드변압기용 에폭시 수지 조성물 및 그의 제조방법
KR20030059513A (ko) * 2001-12-29 2003-07-10 주식회사 금강고려화학 고전압 전기부품용 열경화성 에폭시수지 조성물 및 그제조방법
KR100487491B1 (ko) * 1997-08-26 2005-07-28 삼성전자주식회사 반도체메모리장치의리던던시선택회로

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