KR960028664A - 64×64 비트 스위치회로 - Google Patents
64×64 비트 스위치회로 Download PDFInfo
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- H04Q11/00—Selecting arrangements for multiplex systems
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- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)
Abstract
1.청구범위에 기재된 발명이 속한 기술분야
교환시스템의 스위치회로.
2.발명이 해결하려고 하는 기술적 과제.
PCM 스위치인 경우에는 대개 1개의 칩으로 상용화되어 있는데 반하여 CVSD 방식에서는 PCM 프레임구조인 8비트와는 다르게 1비트가 1채널이기 때문에 별도의 다른 스위칭 구조를 갖춘 스위치가 필요하다.
3.발명의 해결방법의 요지.
제1-제4 다중화 신호열을 하나로써 64채널인 다중화 신호열에 변환하고 다시 상기 64채널의 신호열을 4개의 다중화 신호열로 변환하기 위한 다중화 신호열 접속부와, 상기 다중화 신호열 접속부를 통해서 입력한 트래픽을 순차적으로 저장하였다가 필요시 읽어내기 위한 통화 메모리와, 연결정보를 저장하였다가 상기 통화메모리로 공급해 주기 위한 제어메모리와, 상기 통화메모리와 상기 제어메모리에 순차적으로 분주 번지와 교환정보 먼지를 할당해 주기 위한 번지할당부와, 상기 교환시스템의 중앙처리장치에서 제공되는 읽기 및 쓰기 신호와 데이터버스 어드레스버스를 통해 내부를 제어할 수 있도록 제어신호를 조합하고, 상기 제어메모리와 상기 통화 메모리에 번지와 정보를 제공하여 교환동작을 할 수 있도록 접속해주기 위한 외부접속 및 디코딩부로 구성한다.
4.발명의 중요한 용도.
소용량의 64 ×64 비트 스위치회로
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명이 적용되는 통신망의 구성도. 제2도는 본 발명이 적용되는 통신방비의 구성도. 제3도는 본 발명에 따른 64 ×64비트 스위치회로의 구성도.
Claims (6)
- 교환시스템의 64 ×64비트 스위치회로에 있어서 제1-제4 다중화 신호열을 하나로써 64채널인 다중화 신호열로 변환하고 다시 상기 64채널의 신호열을 4개의 다중화 신호열에 변환하기 위한 다중화 신호열 접속수단과, 상기 다중화 신호열 접속수단을 통해서 입력한 트래픽을 순차적으로 저장하였다가 필요시 읽어내기 위한 통화 메모리와, 연결저보를 저장하였다가 상기 통화메모리로 곱급해 주기 위한 제어메모리와, 상기 통화메모리와 상기 제어메모리에 순차적으로 분주 번지와 교환정보 번지를 할당해 주기위한 번지할당수단과, 상기 교환시스템의 중앙처리장치에서 제공되는 읽기 및 쓰기신호와 데이터 버스 어드레스버스를 통해 내부를 제어할 수 있도록 제어신호를 조합하고, 상기 제어메모리와 상기 통화메모리에 번지와 정보를 제공하여 교환동작을 할 수 있도록 접속해 주기 위한 외부접속 및 디코딩수단으로 구성됨을 특징으로 하는 회로.
- 제1항에 있어서, 상기 외부접속 및 디코딩수단이, 상기 중앙처리장치로부터 번지정보를 입력하기위한 인터페이스수단과, 상기 인터페이스부를 통해서 입력한 번지정보를 디코딩하여 상기 통화메모리와 제어메모리에 필요한 번지를 할당해주기 위한 디코딩수단으로 구성됨을 특징으로 하는 회로.
- 제1항에 있어서, 타이밍을 맞추기 위해 상기 디코딩신호를 일시적으로 래치하기 위한 래치수단을 더 구비함을 특징으로 하는 회로.
- 제1항에 있어서, 상기 번지할당수단이,프레임 동기신호를 기준으로 상기 통화메모리 및 상기 제어메모리에 번지를 제공하기 위한 하는 64진 분주기를 더 구비함을 특징으로 하는 회로.
- 제4항에 있어서, 상기 다중화 신호열 접속수단이, 제1-제4 다중화신호열을 각각 입력하여 스위칭할 64개의 다중화신호열을 출력하는 다중화기와, 스위칭된64개의 다중화신호열을 입력하여 각각 제1-제4 다중화 신호열을 출력하는 4개의 디플립플롭들로 구성됨을 특징으로 하는 회로.
- 제1항에 있어서, 상기제어메모리의 연결정보가 소스 연결데이타와 데스티네이션 연결데이타로 이루어짐을 특징으로 하는 회로.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019940038106A KR100298341B1 (ko) | 1994-12-28 | 1994-12-28 | 64x64비트스위치회로 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019940038106A KR100298341B1 (ko) | 1994-12-28 | 1994-12-28 | 64x64비트스위치회로 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| KR960028664A true KR960028664A (ko) | 1996-07-22 |
| KR100298341B1 KR100298341B1 (ko) | 2001-10-24 |
Family
ID=37528351
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR1019940038106A KR100298341B1 (ko) | 1994-12-28 | 1994-12-28 | 64x64비트스위치회로 |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR100298341B1 (ko) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100528742B1 (ko) * | 1998-12-30 | 2006-02-09 | 삼성탈레스 주식회사 | 교환시스템의 다자간 회의통화장치 |
-
1994
- 1994-12-28 KR KR1019940038106A patent/KR100298341B1/ko not_active IP Right Cessation
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100528742B1 (ko) * | 1998-12-30 | 2006-02-09 | 삼성탈레스 주식회사 | 교환시스템의 다자간 회의통화장치 |
Also Published As
| Publication number | Publication date |
|---|---|
| KR100298341B1 (ko) | 2001-10-24 |
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